KR100602357B1 - Light emitting display and driving method thereof - Google Patents

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Abstract

본 발명은 트랜지스터의 특성 편차로 인한 화상 불균일 현상을 최소화할 수 있도록 한 발광 표시장치와 그의 구동방법에 관한 것이다.BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a light emitting display device and a driving method thereof capable of minimizing image unevenness due to variations in characteristics of transistors.

본 발명에 따른 발광 표시장치는 주사신호가 공급되는 복수의 주사선들과 데이터 신호가 공급되는 복수의 데이터선들 및 복수의 전원선들에 의해 정의되는 복수의 화소들을 포함하고, 상기 각 화소는, 한 프레임의 각 서브-프레임에 대응되는 전원으로부터 상기 데이터 신호에 대응되는 전류를 출력하는 트랜지스터와 상기 트랜지스터의 문턱전압을 보상하기 위한 보상회로를 포함하는 화소회로와, 상기 화소회로로부터 출력되는 전류에 의해 발광하는 발광소자를 구비한다.A light emitting display device according to the present invention includes a plurality of pixels defined by a plurality of scan lines supplied with a scan signal, a plurality of data lines supplied with a data signal, and a plurality of power lines, wherein each pixel includes one frame. A pixel circuit including a transistor for outputting a current corresponding to the data signal from a power source corresponding to each sub-frame of the pixel and a compensation circuit for compensating the threshold voltage of the transistor, and emitting light by a current output from the pixel circuit A light emitting element is provided.

이러한 본 발명은 트랜지스터의 특성 편차로 인한 화상 불균일 현상을 최소화할 수 있다. The present invention can minimize the image non-uniformity caused by the variation of the characteristics of the transistor.

Description

발광 표시장치 및 그의 구동방법{LIGHT EMITTING DISPLAY AND DRIVING METHOD THEREOF} LIGHT EMITTING DISPLAY AND DRIVING METHOD THEREOF             

도 1은 일반적인 발광 표시장치의 화소를 나타내는 회로도이다.1 is a circuit diagram illustrating a pixel of a general light emitting display device.

도 2는 본 발명의 제 1 실시 예에 따른 발광 표시장치를 나타내는 도면이다.2 is a diagram illustrating a light emitting display device according to a first embodiment of the present invention.

도 3은 도 2에 도시된 제 1 전원 공급부를 나타내는 도면이다.3 is a diagram illustrating the first power supply unit illustrated in FIG. 2.

도 4는 도 2에 도시된 화소를 나타내는 회로도이다.4 is a circuit diagram illustrating a pixel illustrated in FIG. 2.

도 5는 본 발명의 제 1 실시 예에 따른 발광 표시장치의 구동방법을 나타내는 파형도이다.5 is a waveform diagram illustrating a method of driving a light emitting display device according to a first embodiment of the present invention.

도 6은 본 발명의 제 2 실시 예에 따른 발광 표시장치의 화소를 나타내는 도면이다.6 is a diagram illustrating a pixel of a light emitting display device according to a second embodiment of the present invention.

도 7은 본 발명의 제 2 실시 예에 따른 발광 표시장치의 구동방법을 나타내는 파형도이다.7 is a waveform diagram illustrating a method of driving a light emitting display device according to a second embodiment of the present invention.

<도면의 주요 부분에 대한 부호의 설명><Explanation of symbols for the main parts of the drawings>

11, 111 : 화소 40, 140 : 화소회로11, 111: pixel 40, 140: pixel circuit

110 : 화상 표시부 120 : 주사 구동부110: image display unit 120: scan driver

130 : 데이터 구동부 150 : 제 1 전원 공급부130: data driver 150: first power supply

144 : 보상회로 152 : 쉬프트 레지스터부144: compensation circuit 152: shift register

154 : 전압 발생부 156 : 선택부154: voltage generator 156: selection unit

160 : 초기화 전원 공급부 170 : 제 2 전원 공급부160: initialization power supply unit 170: second power supply unit

본 발명은 발광 표시장치에 관한 것으로, 특히 트랜지스터의 특성 편차로 인한 화상 불균일 현상을 최소화할 수 있도록 한 발광 표시장치와 그의 구동방법에 관한 것이다.BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a light emitting display device, and more particularly, to a light emitting display device and a driving method thereof capable of minimizing image unevenness due to variations in transistor characteristics.

최근, 음극선관(Cathode Ray Tube)의 단점인 무게와 부피를 줄일 수 있는 각종 평판 표시장치들이 개발되고 있다. 평판 표시장치로는 액정 표시장치(Liquid Crystal Display), 전계방출 표시장치(Field Emission Display), 플라즈마 디스플레이 패널(Plasma Display Panel) 및 발광 표시장치(Light Emitting Display) 등이 있다.Recently, various flat panel displays have been developed to reduce weight and volume, which are disadvantages of cathode ray tubes. The flat panel display includes a liquid crystal display, a field emission display, a plasma display panel, a light emitting display, and the like.

평판 표시장치 중 발광 표시장치는 전자와 정공의 재결합으로 형광물질을 발광시키는 자발광소자로서, 재료 및 구조에 따라 무기물의 발광층을 포함하는 무기 발광 표시장치와 유기물의 발광층을 포함하는 유기 발광 표시장치로 대별된다. 이때, 유기 발광 표시장치는 전계발광 표시장치라고 불리기도 한다.Among the flat panel displays, a light emitting display device is a self-light emitting device that emits a fluorescent material by recombination of electrons and holes, and includes an inorganic light emitting display device including an inorganic light emitting layer and an organic light emitting layer according to materials and structures. It is roughly divided into. In this case, the organic light emitting diode display may be referred to as an electroluminescent display.

이러한, 발광 표시장치는 액정 표시장치와 같이 별도의 광원을 필요로 하는 수동형 발광소자에 비하여 음극선관과 같은 빠른 응답속도를 가지는 장점을 갖고 있다.Such a light emitting display device has an advantage of having a fast response speed, such as a cathode ray tube, compared to a passive light emitting device requiring a separate light source like a liquid crystal display device.

도 1은 일반적인 발광 표시장치의 화소를 나타내는 회로도이다.1 is a circuit diagram illustrating a pixel of a general light emitting display device.

도 1을 참조하면, 일반적인 발광 표시장치의 각 화소(11)는 주사선(Sn)과 데이터선(Dm)의 교차영역에 인접하도록 배치된다. 이러한, 각 화소(11)는 주사선(Sn)에 주사신호가 인가될 때 선택되고, 데이터선(Dm)에 공급되는 데이터 신호에 상응하는 빛을 발생하게 된다.Referring to FIG. 1, each pixel 11 of a typical light emitting display device is disposed to be adjacent to an intersection region of the scan line Sn and the data line Dm. Each pixel 11 is selected when a scan signal is applied to the scan line Sn, and generates light corresponding to the data signal supplied to the data line Dm.

이를 위해, 각 화소(11)는 제 1 전원(VDD)과, 제 2 전원(VSS), 발광소자(OLED) 및 화소회로(40)를 구비한다.To this end, each pixel 11 includes a first power source VDD, a second power source VSS, a light emitting element OLED, and a pixel circuit 40.

발광소자(OLED)의 애노드 전극은 화소회로(40)에 접속되고, 캐소드 전극은 제 2 전원(VSS)에 접속된다. 이때, 발광소자(OLED)는 유기발광소자가 될 수 있다.The anode electrode of the light emitting element OLED is connected to the pixel circuit 40, and the cathode electrode is connected to the second power source VSS. In this case, the light emitting device OLED may be an organic light emitting device.

유기발광소자는 애노드 전극과 캐소드 전극 사이에 형성된 유기물의 발광층(Emitting Layer : EML), 전자 수송층(Electron Transport Layer : ETL) 및 정공 수송층(Hole Transport Layer : HTL)을 포함한다. 또한, 유기발광소자는 전자 주입층(Electron Injection Layer : EIL)과 정공 주입층(Hole Injection Layer : HIL)을 추가적으로 포함할 수 있다. 이러한, 유기발광소자에서 애노드 전극과 캐소드 전극 사이에 전압을 인가하면 캐소드 전극으로부터 발생된 전자는 전자 주입층 및 전자 수송층을 통해 발광층 쪽으로 이동하고, 애노드 전극으로부터 발생된 정공은 정공 주입층 및 정공 수송층을 통해 발광층 쪽으로 이동한다. 이에 따라, 발광층에서는 전자 수송층과 정공 수송층으로부터 공급되어진 전자와 정공이 충돌하여 재결합함에 의해 빛이 발생하게 된다.The organic light emitting diode includes an emission layer (EML), an electron transport layer (ETL), and a hole transport layer (HTL) of an organic material formed between the anode electrode and the cathode electrode. The organic light emitting diode may further include an electron injection layer (EIL) and a hole injection layer (HIL). In the organic light emitting diode, when a voltage is applied between the anode electrode and the cathode electrode, electrons generated from the cathode electrode move toward the light emitting layer through the electron injection layer and the electron transport layer, and holes generated from the anode electrode are transferred to the hole injection layer and the hole transport layer. It moves to the light emitting layer through. Accordingly, in the light emitting layer, light is generated by collision between electrons and holes supplied from the electron transporting layer and the hole transporting layer and recombination.

화소회로(40)는 제 1 및 제 2 트랜지스터(M1, M2) 및 커패시터(C)를 구비한다. 여기서, 제 2 트랜지스터(M2) 및 제 1 트랜지스터(M1)는 P 타입 금속 산화막 반도체 전계 효과 트랜지스터(MOSFET, Metal-Oxide Semiconductor Field Effect Transistor)이다. 한편, 제 2 전원(VSS)은 제 1 전원(VDD)보다 낮은 전압레벨을 가지며, 그라운드 전압레벨을 가질 수 있다.The pixel circuit 40 includes first and second transistors M1 and M2 and a capacitor C. Here, the second transistor M2 and the first transistor M1 are P-type metal oxide semiconductor field effect transistors (MOSFETs). The second power source VSS may have a lower voltage level than the first power source VDD and may have a ground voltage level.

제 1 트랜지스터(M1)의 게이트 전극은 주사선(Sn)에 접속되고, 소스 전극은 데이터선(Dm)에 접속됨과 아울러 드레인 전극은 제 1 노드(N1)에 접속된다. 이러한, 제 1 트랜지스터(M1)는 주사선(Sn)에 공급되는 주사신호에 응답하여 데이터선(Dm)으로부터의 데이터 신호를 제 1 노드(N1)에 공급한다.The gate electrode of the first transistor M1 is connected to the scan line Sn, the source electrode is connected to the data line Dm, and the drain electrode is connected to the first node N1. The first transistor M1 supplies the data signal from the data line Dm to the first node N1 in response to the scan signal supplied to the scan line Sn.

커패시터(C)는 주사선(Sn)에 주사신호가 공급되는 구간에 제 1 트랜지스터(M1)를 통해 제 1 노드(N1) 상에 공급되는 데이터 신호에 대응되는 전압을 저장한 후, 제 1 트랜지스터(M1)가 오프되면 제 2 트랜지스터(M2)의 온 상태를 한 프레임 동안 유지시키게 된다.The capacitor C stores a voltage corresponding to the data signal supplied on the first node N1 through the first transistor M1 in a section in which the scan signal is supplied to the scan line Sn, and then the first transistor ( When M1 is off, the on state of the second transistor M2 is maintained for one frame.

제 2 트랜지스터(M2)의 게이트 전극은 제 1 트랜지스터(M1)의 드레인 전극과 커패시터(C)가 공통으로 접속된 제 1 노드(N1)에 접속되고, 소스 전극은 제 1 전원(VDD)에 접속됨과 아울러 드레인 전극은 발광소자(OLED)의 애노드 전극에 접속된다. 이러한, 제 2 트랜지스터(M2)는 데이터 신호에 따라 제 1 전원(VDD)으로부터 발광소자(OLED)에 공급되는 데이터 신호에 대응되는 전류량을 조절하게 된다. 이에 따라, 발광소자(OLED)는 제 2 트랜지스터(M2)를 통해 제 1 전원(VDD)으로부터 공급되는 전류에 의해 발광하게 된다.The gate electrode of the second transistor M2 is connected to the first node N1 to which the drain electrode and the capacitor C of the first transistor M1 are commonly connected, and the source electrode is connected to the first power source VDD. In addition, the drain electrode is connected to the anode electrode of the light emitting element OLED. The second transistor M2 adjusts the amount of current corresponding to the data signal supplied from the first power supply VDD to the light emitting element OLED according to the data signal. Accordingly, the light emitting device OLED emits light by a current supplied from the first power supply VDD through the second transistor M2.

이와 같은, 화소들(11)의 구동을 설명하면 다음과 같다. 먼저, 주사선(Sn)에 로우(LOW) 상태의 주사신호가 공급되는 구간에서는 제 1 트랜지스터(M1)가 턴-온된다. 이로 인하여, 데이터선(Dm)에 공급되는 데이터 신호는 제 1 트랜지스터(M1)와 제 1 노드(N1)를 통해 제 2 트랜지스터(M2)의 게이트 전극에 공급된다. 이때, 커패시터(C)는 제 2 트랜지스터(M2)의 게이트 전극과 제 1 전원(VDD)간의 차전압을 저장하게 된다.The driving of the pixels 11 as described above is as follows. First, the first transistor M1 is turned on in a section in which a scan signal in a low state is supplied to the scan line Sn. Thus, the data signal supplied to the data line Dm is supplied to the gate electrode of the second transistor M2 through the first transistor M1 and the first node N1. In this case, the capacitor C stores the difference voltage between the gate electrode of the second transistor M2 and the first power supply VDD.

이에 따라, 제 2 트랜지스터(M2)는 제 1 노드(N1)의 전압에 따라 턴-온되어 데이터 신호에 상응하는 전류를 발광소자(OLED)에 공급하게 된다. 따라서, 발광소자(OLED)는 제 2 트랜지스터(M2)로부터 공급되는 전류에 의해 발광하여 화상을 표시하게 된다.Accordingly, the second transistor M2 is turned on according to the voltage of the first node N1 to supply a current corresponding to the data signal to the light emitting device OLED. Accordingly, the light emitting element OLED emits light by the current supplied from the second transistor M2 to display an image.

그런 다음, 주사선(Sn)에 하이(HIGH) 상태의 주사신호가 공급되는 구간에서는 커패시터(C)에 저장된 데이터 신호에 대응되는 전압에 의해 제 2 트랜지스터(M2)의 온상태가 유지됨으로써 발광소자(OLED)는 한 프레임 기간 동안 발광하여 화상을 표시하게 된다.Then, in the period in which the scan signal in the HIGH state is supplied to the scan line Sn, the on state of the second transistor M2 is maintained by the voltage corresponding to the data signal stored in the capacitor C, so that the light emitting device ( OLED) emits light for one frame period to display an image.

이러한, 일반적인 발광 표시장치는 제조공정에 의한 제 2 트랜지스터(M2)의 문턱전압(Vth)의 불균일을 보상하기 위한 보상회로를 추가적으로 구비한다. 이에 따라, 보상회로를 가지는 발광 표시장치는 옵셋(Offset) 보상 방식이나 전류 프로 그램 방식을 채택하고 있으나, 이 또한 균일한 화상을 표시하는데 한계점이 있다.Such a general light emitting display device further includes a compensation circuit for compensating for the variation of the threshold voltage Vth of the second transistor M2 by the manufacturing process. Accordingly, the light emitting display device having the compensation circuit adopts the offset compensation method or the current program method, but this also has a limitation in displaying a uniform image.

따라서, 본 발명의 목적은 트랜지스터의 특성 편차로 인한 화상 불균일 현상을 최소화할 수 있도록 한 발광 표시장치와 그의 구동방법을 제공하는데 있다.
Accordingly, it is an object of the present invention to provide a light emitting display device and a method of driving the same, which can minimize image irregularities caused by variations in characteristics of transistors.

상기 목적을 달성하기 위한 수단으로써, 본 발명의 제 1 측면은 주사신호가 공급되는 복수의 주사선들과 데이터 신호가 공급되는 복수의 데이터선들 및 복수의 전원선들에 의해 정의되는 복수의 화소들을 포함하고, 상기 각 화소는, 한 프레임의 각 서브-프레임에 대응되는 전원으로부터 상기 데이터 신호에 대응되는 전류를 출력하는 트랜지스터와 상기 트랜지스터의 문턱전압을 보상하기 위한 보상회로를 포함하는 화소회로와, 상기 화소회로로부터 출력되는 전류에 의해 발광하는 발광소자를 구비하는 발광 표시장치를 제공한다.As a means for achieving the above object, a first aspect of the present invention includes a plurality of pixels defined by a plurality of scan lines supplied with a scan signal, a plurality of data lines supplied with a data signal, and a plurality of power lines; And each pixel comprises a pixel circuit including a transistor for outputting a current corresponding to the data signal from a power source corresponding to each sub-frame of one frame, and a compensation circuit for compensating a threshold voltage of the transistor; A light emitting display device including a light emitting element that emits light by a current output from a circuit is provided.

바람직하게, 상기 발광 표시장치는 발광 제어신호가 공급되는 발광 제어선과, 초기화 전원이 공급되는 초기화 전원선을 더 구비한다.Preferably, the light emitting display device further includes a light emission control line supplied with a light emission control signal and an initialization power supply line supplied with initialization power.

본 발명의 제 2 측면은 복수의 주사선들, 복수의 데이터선들 및 복수의 전원선들에 의해 정의되며 상기 데이터선에 공급되는 데이터 신호에 대응되는 전류를 상기 전원선으로부터 공급받아 발광하는 복수의 화소들을 포함하는 화상 표시부와, 상기 주사선들에 주사신호를 공급하기 위한 주사 구동부와, 상기 데이터선에 상기 데이터 신호를 공급하기 위한 데이터 구동부와, 한 프레임의 각 서브-프레임에 대응되는 전원을 상기 전원선에 공급하기 위한 전원 공급부와, 상기 각 화소에 초기화 전원을 공급하기 위한 초기화 전원 공급부를 구비하는 발광 표시장치를 제공한다.According to a second aspect of the present invention, a plurality of pixels defined by a plurality of scan lines, a plurality of data lines, and a plurality of power lines are configured to emit light by receiving current from the power line corresponding to a data signal supplied to the data line An image display unit, a scan driver for supplying scan signals to the scan lines, a data driver for supplying the data signals to the data lines, and a power source corresponding to each sub-frame of one frame; A light emitting display device comprising: a power supply for supplying power to a pixel; and an initialization power supply for supplying power to each pixel.

바람직하게, 상기 본 발명의 제 1 및 제 2 측면에서 상기 각 화소는 각 서브-프레임마다 발광되는 밝기의 합에 의해 원하는 계조를 표시한다. 또한, 상기 데이터 신호는 상기 서브-프레임에 대응되는 i(단, i는 양의 정수)비트를 가지는 디지털 데이터 신호이다. 그리고, 상기 전원의 레벨은 상기 디지털 데이터 신호의 최상위 비트로 갈수록 높아지는 것을 특징으로 한다.Preferably, in the first and second aspects of the present invention, each pixel displays a desired gray scale by the sum of brightnesses emitted for each sub-frame. Also, the data signal is a digital data signal having i (where i is a positive integer) bit corresponding to the sub-frame. The level of the power source is increased as the most significant bit of the digital data signal.

본 발명의 제 3 측면은 복수의 주사선들과 복수의 데이터선들 및 복수의 전원선들에 의해 정의되며 상기 데이터선에 공급되는 데이터 신호에 대응되는 전류를 출력하는 트랜지스터를 포함하는 복수의 화소의 구동방법에 있어서, 제 1 주사선에 공급되는 제 1 주사신호에 따라 초기화 전원을 이용하여 상기 트랜지스터의 문턱전압에 대응되는 전압을 커패시터에 저장하는 단계와, 상기 데이터선에 상기 데이터 신호를 공급하는 단계와, 한 프레임의 각 서브-프레임에 대응되는 전원을 상기 전원선에 공급하는 단계와, 제 2 주사선에 공급되는 제 2 주사신호에 따라 상기 전원과 상기 데이터 신호의 차전압을 상기 커패시터에 저장하는 단계와, 상기 커패시터에 저장된 전압을 이용하여 상기 트랜지스터를 구동시켜 상기 전류를 상기 전원선에 공급되는 전원으로부터 출력하여 발광소자를 발광시키는 단계를 포함하는 발광 표시장치의 구동방법을 제공한다.A third aspect of the present invention is a driving method of a plurality of pixels including a transistor which is defined by a plurality of scan lines, a plurality of data lines and a plurality of power lines, and outputs a current corresponding to a data signal supplied to the data line. The method of claim 1, further comprising: storing a voltage corresponding to the threshold voltage of the transistor in the capacitor according to the first scan signal supplied to the first scan line, supplying the data signal to the data line; Supplying power corresponding to each sub-frame of one frame to the power supply line, and storing a voltage difference between the power supply and the data signal in the capacitor according to a second scan signal supplied to a second scan line; A power supplied to the power line by driving the transistor using the voltage stored in the capacitor A method of driving a light emitting display device, the method comprising: outputting from a light emitting device to emit light.

이하, 본 발명이 속하는 기술분야에서 통상의 지식을 가진 자가 본 발명을 용이하게 실시할 수 있는 가장 바람직한 실시 예를 첨부된 도 2 내지 도 7을 참조하여 상세히 설명하면 다음과 같다.Hereinafter, preferred embodiments of the present invention will be described in detail with reference to FIGS. 2 to 7 which can be easily implemented by those skilled in the art.

도 2는 본 발명의 제 1 실시 예에 따른 발광 표시장치를 나타내는 도면이다.2 is a diagram illustrating a light emitting display device according to a first embodiment of the present invention.

도 2를 참조하면, 본 발명의 제 1 실시 예에 따른 발광 표시장치는 화상 표시부(110)와, 주사 구동부(120)와, 데이터 구동부(130)와, 제 1 전원 공급부(150). 제 2 전원 공급부(170) 및 초기화 전원 공급부(160)를 구비한다.Referring to FIG. 2, the light emitting display device according to the first embodiment of the present invention includes an image display unit 110, a scan driver 120, a data driver 130, and a first power supply unit 150. The second power supply unit 170 and the initialization power supply unit 160 are provided.

화상 표시부(110)는 복수의 주사선(S1 내지 SN)과 복수의 데이터선(D1 내지 DM) 및 복수의 제 1 전원선(V1 내지 VN)에 의해 정의되는 복수의 화소(111)를 포함한다. 이때, 제 1 전원선(V1 내지 VN)은 화상 표시부(110) 상에 형성된 주사선(S1 내지 SN)과 나란하도록 배치된다.The image display unit 110 includes a plurality of pixels 111 defined by a plurality of scan lines S1 to SN, a plurality of data lines D1 to DM, and a plurality of first power lines V1 to VN. At this time, the first power lines V1 to VN are arranged to be parallel to the scan lines S1 to SN formed on the image display unit 110.

각 화소(111)는 주사선(S1 내지 SN)에 주사신호가 인가될 때 선택되고, 데이터선(D1 내지 DM)에 공급되는 데이터 신호에 대응되는 전류를 제 1 전원선(V1 내지 VN)으로부터 공급받아 빛을 발생하게 된다. 구체적으로, 각 화소(111)는 디지털 데이터 신호의 각 비트에 대응되는 전류를 제 1 전원선(V1 내지 VN)에 공급되는 서로 다른 레벨의 제 1 전원으로부터 공급받아 발광하는 발광소자(OLED)의 밝기를 조절하여 계조를 표시함으로써 원하는 화상을 표시하게 된다.Each pixel 111 is selected when a scan signal is applied to the scan lines S1 to SN, and supplies a current corresponding to the data signal supplied to the data lines D1 to DM from the first power lines V1 to VN. Receive light. In detail, each pixel 111 of the light emitting device OLED emits light by receiving a current corresponding to each bit of the digital data signal from a first power source having different levels supplied to the first power lines V1 to VN. By adjusting the brightness to display the gray scale, a desired image is displayed.

주사 구동부(120)는 도시하지 않은 제어부로부터의 주사 제어신호들, 즉 스 타트펄스와 클럭신호에 응답하여 주사선들(S1 내지 SN)을 순차적으로 구동시키기 위한 주사신호를 발생하여 주사선들(S1 내지 SN)에 순차적으로 공급한다.The scan driver 120 generates a scan signal for sequentially driving the scan lines S1 to SN in response to scan control signals from a controller (not shown), that is, a start pulse and a clock signal, thereby scanning the scan lines S1 to S1. Sequentially feed into SN).

데이터 구동부(130)는 제어부로부터 공급되는 데이터 제어신호들에 응답하여 제어부로부터의 i 비트 디지털 데이터 신호를 데이터선들(D1 내지 DM)을 통해 각 화소(111)에 공급한다. 즉, 데이터 구동부(130)는 i 비트 디지털 데이터 신호의 각 비트 디지털 데이터 신호를 j(단, j는 i와 같거나 큰 양의 정수)개의 서브-프레임마다 데이터선들(D1 내지 DM)에 공급한다. 이때, i 비트 디지털 데이터 신호 중 최하위 비트의 디지털 데이터 신호는 제 1 서브-프레임에 공급된다.The data driver 130 supplies an i-bit digital data signal from the controller to each pixel 111 through the data lines D1 to DM in response to data control signals supplied from the controller. That is, the data driver 130 supplies each bit digital data signal of the i bit digital data signal to the data lines D1 to DM for each j sub-frames (where j is a positive integer equal to or greater than i). . At this time, the least significant bit of the i-bit digital data signal is supplied to the first sub-frame.

제 2 전원 공급부(170)는 제 2 전원을 발생하여 각 화소(111)의 제 2 전원선에 공급한다. 이때, 제 2 전원선은 화상 표시부(110)의 전면에 형성된 각 화소(111)의 캐소드 전극에 전기적으로 접속된다.The second power supply unit 170 generates a second power and supplies the second power line to the second power line of each pixel 111. At this time, the second power supply line is electrically connected to the cathode electrode of each pixel 111 formed on the front surface of the image display unit 110.

초기화 전원 공급부(160)는 이전 주사선들(SN 내지 SN-1)에 공급되는 주사신호에 따라 각 화소(111)에 초기화 전원을 공급한다.The initialization power supply unit 160 supplies initialization power to each pixel 111 according to the scan signals supplied to the previous scan lines SN through SN-1.

제 1 전원 공급부(150)는 한 프레임을 구성하는 j개의 서브-프레임마다 서로 다른 레벨의 제 1 전원을 발생하게 된다. 이러한, 제 1 전원 공급부(150)는 i 비트 디지털 데이터 신호의 각 비트에 따라 주사선들(S1 내지 SN)에 공급되는 주사신호에 동기되도록 제 1 전원을 제 1 전원선들(V1 내지 VN)에 순차적으로 공급한다. 이때, 제 1 전원은 i 비트의 디지털 데이터 신호 중 상위 비트로 갈수록 높은 레벨을 가지게 된다.The first power supply 150 generates the first power of different levels for each of the j sub-frames constituting one frame. The first power supply unit 150 sequentially supplies the first power to the first power lines V1 to VN to be synchronized with the scan signal supplied to the scan lines S1 to SN according to each bit of the i-bit digital data signal. To supply. At this time, the first power source has a higher level toward an upper bit of the i-bit digital data signal.

도 3은 도 2에 도시된 주파수 공급부(150)를 나타내는 블록도이다.3 is a block diagram illustrating the frequency supply unit 150 illustrated in FIG. 2.

도 3을 도 2와 결부하면, 발광 표시장치의 주파수 공급부(150)는 전압 발생부(154), 쉬프트 레지스터부(152) 및 선택부(156)를 구비한다.Referring to FIG. 3 and FIG. 2, the frequency supply unit 150 of the light emitting display device includes a voltage generator 154, a shift register unit 152, and a selection unit 156.

전압 발생부(154)는 서로 다른 레벨을 가지는 제 1 전원(VO)을 발생하여 선택부(156)에 공급한다.The voltage generator 154 generates the first power VO having different levels and supplies it to the selector 156.

쉬프트 레지스터부(152)는 복수의 쉬프트 레지스터를 포함한다. 각 쉬프트 레지스터는 주사신호에 동기되어 공급되는 전압선택 시작신호(VSSS)를 순차적으로 쉬프트시켜 선택부(156)에 공급한다. 즉, 각 쉬프트 레지스터는 순차적으로 쉬프트되는 전압선택 신호를 발생하여 선택부(156)에 공급한다. 이때, 각 쉬프트 레지스터는 k 비트를 순차적으로 쉬프트시켜 전압선택 신호를 발생하여 선택부(156)에 공급한다. 여기서, i 비트 디지털 데이터 신호가 8비트이고, 8개의 서브-프레임으로 구성될 경우 각 쉬프트 레지스터는 3비트의 전압선택 신호를 발생하여 선택부(156)에 공급한다.The shift register unit 152 includes a plurality of shift registers. Each shift register sequentially shifts the voltage selection start signal VSSS supplied in synchronization with the scan signal and supplies it to the selection unit 156. That is, each shift register generates a voltage selection signal that is sequentially shifted and supplies it to the selection unit 156. At this time, each shift register sequentially shifts k bits to generate a voltage selection signal and supply the voltage selection signal to the selection unit 156. Here, when the i-bit digital data signal is 8 bits and is composed of eight sub-frames, each shift register generates a 3-bit voltage selection signal and supplies it to the selection unit 156.

선택부(156)는 복수의 전압 선택기를 포함한다. 이때, 각 전압 선택기는 아나로그 스위치가 될 수 있다. 각 전압 선택기는 각 쉬프트 레지스터로부터 공급되는 전압선택 신호에 따라 전압 발생부(154)로부터 공급되는 서로 다른 복수의 제 1 전원(VO) 중 어느 하나를 선택하여 제 1 전원선(V1 내지 VN)에 순차적으로 공급한다. 이때, 선택부(156)로부터 제 1 전원선(V1 내지 VN)에 순차적으로 공급되는 제 1 전원은 주사선(S1 내지 SN)에 공급되는 주사신호에 동기되도록 공급된다.The selector 156 includes a plurality of voltage selectors. At this time, each voltage selector may be an analog switch. Each voltage selector selects one of a plurality of different first power sources VO supplied from the voltage generator 154 according to a voltage selection signal supplied from each shift register, and selects one of the plurality of first power lines V1 to VN. Supply sequentially. At this time, the first power supplied sequentially from the selector 156 to the first power lines V1 to VN is supplied in synchronization with the scan signals supplied to the scan lines S1 to SN.

도 4는 도 2에 도시된 화소(111)를 나타내는 회로도이다.FIG. 4 is a circuit diagram illustrating the pixel 111 illustrated in FIG. 2.

도 4를 도 2와 결부하면, 각 화소(111)는 발광소자(OLED)와, 화소회로(140)를 구비한다.Referring to FIG. 4 and FIG. 2, each pixel 111 includes a light emitting element OLED and a pixel circuit 140.

발광소자(OLED)의 애노드 전극은 화소회로(140)에 접속되고, 캐소드 전극은 제 2 전원(VSS)이 공급되는 제 2 전원선에 접속된다. 이때, 발광소자(OLED)는 유기발광소자가 될 수 있다. 유기발광소자는 애노드 전극과 캐소드 전극 사이에 형성된 유기물의 발광층(Emitting Layer : EML), 전자 수송층(Electron Transport Layer : ETL) 및 정공 수송층(Hole Transport Layer : HTL)을 포함한다. 또한, 유기발광소자는 전자 주입층(Electron Injection Layer : EIL)과 정공 주입층(Hole Injection Layer : HIL)을 추가적으로 포함할 수 있다. 이러한, 유기발광소자에서 애노드 전극과 캐소드 전극 사이에 전압을 인가하면 캐소드 전극으로부터 발생된 전자는 전자 주입층 및 전자 수송층을 통해 발광층 쪽으로 이동하고, 애노드 전극으로부터 발생된 정공은 정공 주입층 및 정공 수송층을 통해 발광층 쪽으로 이동한다. 이에 따라, 발광층에서는 전자 수송층과 정공 수송층으로부터 공급되어진 전자와 정공이 충돌하여 재결합함에 의해 빛이 발생하게 된다.The anode electrode of the light emitting device OLED is connected to the pixel circuit 140, and the cathode electrode is connected to the second power line to which the second power source VSS is supplied. In this case, the light emitting device OLED may be an organic light emitting device. The organic light emitting diode includes an emission layer (EML), an electron transport layer (ETL), and a hole transport layer (HTL) of an organic material formed between the anode electrode and the cathode electrode. The organic light emitting diode may further include an electron injection layer (EIL) and a hole injection layer (HIL). In the organic light emitting diode, when a voltage is applied between the anode electrode and the cathode electrode, electrons generated from the cathode electrode move toward the light emitting layer through the electron injection layer and the electron transport layer, and holes generated from the anode electrode are transferred to the hole injection layer and the hole transport layer. It moves to the light emitting layer through. Accordingly, in the light emitting layer, light is generated by collision between electrons and holes supplied from the electron transporting layer and the hole transporting layer and recombination.

화소회로(140)는 제 1 내지 제 3 트랜지스터(M1, M2, M3) 및 보상회로(144)를 구비한다.The pixel circuit 140 includes first to third transistors M1, M2, and M3 and a compensation circuit 144.

보상회로(144)는 제 4 및 제 5 트랜지스터(M4, M5) 및 커패시터(C)를 구비한다. 여기서, 제 1 내지 제 5 트랜지스터(M1, M2, M3, M4, M5)는 P 타입 금속 산화막 반도체 전계 효과 트랜지스터(MOSFET, Metal-Oxide Semiconductor Field Effect Transistor)이다. 한편, 화소회로(140)가 P 타입 트랜지스터로 구성될 경우 제 2 전원(VSS)은 제 1 전원(VDD)보다 낮은 전압레벨을 가지며, 그라운드 전압레벨을 가질 수 있다.The compensation circuit 144 includes fourth and fifth transistors M4 and M5 and a capacitor C. Here, the first to fifth transistors M1, M2, M3, M4, and M5 are P-type metal oxide semiconductor field effect transistors (MOSFETs). On the other hand, when the pixel circuit 140 is formed of a P-type transistor, the second power source VSS may have a lower voltage level than the first power source VDD and may have a ground voltage level.

제 1 트랜지스터(M1)의 게이트 전극은 제 n 주사선(Sn)에 접속되고, 소스 전극은 데이터선(Dm)에 접속됨과 아울러 드레인 전극은 제 3 트랜지스터(M3)의 소스 전극에 접속된다. 이러한, 제 1 트랜지스터(M1)는 제 n 주사선(Sn)에 공급되는 제 1 주사신호에 따라 데이터선(Dm)으로부터의 디지털 데이터 신호를 보상회로(144)의 제 4 트랜지스터(M4)의 소스 전극에 공급한다.The gate electrode of the first transistor M1 is connected to the nth scan line Sn, the source electrode is connected to the data line Dm, and the drain electrode is connected to the source electrode of the third transistor M3. The first transistor M1 receives the digital data signal from the data line Dm in response to the first scan signal supplied to the nth scan line Sn, and the source electrode of the fourth transistor M4 of the compensation circuit 144. To feed.

제 4 트랜지스터(M4)의 게이트 전극은 제 1 노드(N1)에 접속되고, 소스 전극은 제 1 트랜지스터(M1)의 드레인 전극에 접속됨과 아울러 드레인 전극은 제 1 노드(N1) 및 제 5 트랜지스터(M5)의 드레인 전극에 접속된다. 이때, 제 4 트랜지스터(M4)는 자신의 게이트 전극과 드레인 전극이 서로 전기적으로 접속됨으로써 제 1 트랜지스터(M1)의 드레인 전극과 제 5 트랜지스터(M5)의 소스 전극 사이에 다이오드 형태로 접속된다.The gate electrode of the fourth transistor M4 is connected to the first node N1, the source electrode is connected to the drain electrode of the first transistor M1, and the drain electrode is connected to the first node N1 and the fifth transistor ( It is connected to the drain electrode of M5). At this time, the fourth transistor M4 is electrically connected with its gate electrode and the drain electrode, and is connected in a diode form between the drain electrode of the first transistor M1 and the source electrode of the fifth transistor M5.

제 5 트랜지스터(M5)의 게이트 전극은 제 n-1 주사선(Sn-1)에 접속되고, 소스 전극은 제 4 트랜지스터(M3)의 드레인 전극 및 제 1 노드(N1)에 접속됨과 아울러 드레인 전극은 초기화 전원선(Vint)에 접속된다. 이러한, 제 5 트랜지스터(M5)는 제 n-1 주사선(Sn-1)에 공급되는 제 2 주사신호에 따라 초기화 전원선(Vint)으로부터의 초기화 전원을 제 1 노드(N1)에 공급한다.The gate electrode of the fifth transistor M5 is connected to the n-th scan line Sn-1, the source electrode is connected to the drain electrode and the first node N1 of the fourth transistor M3, and the drain electrode It is connected to the initialization power supply line Vint. The fifth transistor M5 supplies the initialization power from the initialization power supply line Vint to the first node N1 according to the second scan signal supplied to the n-1th scan line Sn-1.

제 2 트랜지스터(M2)의 게이트 전극은 제 1 노드(N1)에 접속되고, 소스 전극 은 제 1 전원선(Vn)에 접속됨과 아울러 드레인 전극은 제 3 트랜지스터(M3)의 소스 전극에 접속된다. 이러한, 제 2 트랜지스터(M2)는 자신의 게이트-소스간의 전압에 대응되는 전류를 제 1 전원선(Vn)으로부터 제 3 트랜지스터(M3)로 출력한다.The gate electrode of the second transistor M2 is connected to the first node N1, the source electrode is connected to the first power supply line Vn, and the drain electrode is connected to the source electrode of the third transistor M3. The second transistor M2 outputs a current corresponding to the voltage between its gate and source from the first power supply line Vn to the third transistor M3.

한편, 제 2 및 제 4 트랜지스터(M2, M4)는 전류미러(Current Mirror)를 형성하도록 상호 전기적으로 접속된다. 이에 따라, 제 2 및 제 4 트랜지스터(M2, M4)가 동일한 채널폭을 갖는 것으로 가정하면 동일한 디지털 데이터 신호에 대하여 제 2 및 제 3 트랜지스터(M2, M4) 각각에 흐르는 전류양은 동일하게 된다.On the other hand, the second and fourth transistors M2 and M4 are electrically connected to each other to form a current mirror. Accordingly, assuming that the second and fourth transistors M2 and M4 have the same channel width, the amount of current flowing through each of the second and third transistors M2 and M4 is the same for the same digital data signal.

커패시터(C)의 제 1 전극은 제 1 노드(N1), 즉 제 2 및 제 4 트랜지스터(M2, M4)의 게이트 전극에 공통으로 접속되고, 제 2 전극은 제 1 전원선(Vn)에 접속된다. 이러한, 커패시터(C)는 제 n-1 주사선(Sn-1)에 제 2 주사신호가 공급되는 구간에 제 5 트랜지스터(M5)를 통해 제 1 노드(N1)에 공급되는 초기화 전원에 상응하는 전압을 저장한다. 또한, 커패시터(C)는 제 n 주사선(Sn)에 제 1 주사신호가 공급되는 구간에 저장된 전압을 이용하여 제 2 트랜지스터(M2)를 턴-온시켜 제 1 및 제 4 트랜지스터(M1, M4)를 통해 공급되는 디지털 데이터 신호를 저장하게 된다. 이때, 커패시터(C)에 저장된 디지털 데이터 전압은 제 4 트랜지스터(M4)의 문턱전압(Vth)을 뺀 나머지가 된다.The first electrode of the capacitor C is commonly connected to the first node N1, that is, the gate electrodes of the second and fourth transistors M2 and M4, and the second electrode is connected to the first power supply line Vn. do. The capacitor C has a voltage corresponding to the initialization power supplied to the first node N1 through the fifth transistor M5 in a section in which the second scan signal is supplied to the n-1 th scan line Sn-1. Save it. In addition, the capacitor C turns on the second transistor M2 by using a voltage stored in a section in which the first scan signal is supplied to the nth scan line Sn, and thus the first and fourth transistors M1 and M4. It stores the digital data signal supplied through. At this time, the digital data voltage stored in the capacitor C becomes the remainder obtained by subtracting the threshold voltage Vth of the fourth transistor M4.

그리고, 커패시터(C)는 제 1 트랜지스터(M1)가 오프되면 저장된 전압을 이용하여 한 프레임을 구성하는 각 서브-프레임 동안 제 2 트랜지스터(M2)의 온(On) 상태를 유지시킨다. 이에 따라, 제 2 트랜지스터(M2)의 게이트-소스간 전압(Vgs)은 제 1 전원선(V1 내지 VN)에 공급되는 제 1 전원과 커패시터(C)에 저장된 디지털 데 이터 신호와 제 4 트랜지스터(M4)의 문턱전압(Vth)의 차에 해당되는 전압이 된다.When the first transistor M1 is turned off, the capacitor C maintains the on state of the second transistor M2 during each sub-frame constituting one frame using the stored voltage. Accordingly, the gate-source voltage Vgs of the second transistor M2 includes the digital data signal stored in the first power supply line V1 through VN and the capacitor C and the fourth transistor ( It becomes a voltage corresponding to the difference of the threshold voltage Vth of M4).

제 3 트랜지스터(M3)의 게이트 전극은 발광 제어선(En)에 접속되고, 소스 전극은 제 2 트랜지스터(M2)의 드레인 전극에 접속됨과 아울러 드레인 전극은 발광소자(OLED)의 애노드 전극에 접속된다. 이러한, 제 3 트랜지스터(M3)는 발광 제어선(En)에 공급되는 발광 제어신호에 따라 제 2 트랜지스터(M2)로부터 출력되는 전류를 발광소자(OLED)에 공급한다.The gate electrode of the third transistor M3 is connected to the emission control line En, the source electrode is connected to the drain electrode of the second transistor M2, and the drain electrode is connected to the anode electrode of the light emitting element OLED. . The third transistor M3 supplies the current output from the second transistor M2 to the light emitting device OLED according to the light emission control signal supplied to the light emission control line En.

이에 따라, 발광소자(OLED)는 제 3 트랜지스터(M3)를 통해 제 2 트랜지스터(M2)로부터 공급되는 전류에 의해 발광하게 된다.Accordingly, the light emitting device OLED emits light by the current supplied from the second transistor M2 through the third transistor M3.

이와 같은, 본 발명의 제 1 실시 예에 따른 발광 표시장치는 각 화소(111)의 전류 미러 형태로 형성된 제 2 및 제 4 트랜지스터(M2, M4)의 특성이 동일하여 문턱전압(Vth)이 동일하다면 커패시터(C)에는 각 비트의 디지털 데이터 신호와 제 4 트랜지스터(M4)의 문턱전압(Vth)이 저장되고, 제 2 트랜지스터(M2)의 문턱전압(Vth)을 빼므로 제 2 트랜지스터(M2)의 문턱전압(Vth)이 보상된다.As described above, the light emitting display device according to the first exemplary embodiment of the present invention has the same characteristics as that of the second and fourth transistors M2 and M4 formed in the shape of current mirrors of the pixels 111, and thus the threshold voltage Vth is the same. If so, the digital data signal of each bit and the threshold voltage Vth of the fourth transistor M4 are stored in the capacitor C, and the threshold voltage Vth of the second transistor M2 is subtracted. The threshold voltage Vth of is compensated for.

따라서, 본 발명의 제 1 실시 예에 따른 발광 표시장치의 발광소자(OLED)는 각 비트 디지털 데이터 신호에 상응하는 전류를 제 1 전원선(Vn)으로부터 공급받아 발광하게 된다. 결과적으로, 본 발명의 제 1 실시 예에 따른 발광 표시장치는 각 화소(111)마다 제 2 트랜지스터(M2)의 문턱전압(Vth)의 편차가 각 서브 프레임마다 제 1 전원선(Vn)에 공급되는 서로 다른 제 1 전원의 가중치보다 클 경우에도 각 비트 디지털 데이터 신호에 상응하는 전류를 발광소자(OLED)에 공급할 수 있다.Therefore, the light emitting device OLED of the light emitting display device according to the first embodiment of the present invention emits light by receiving a current corresponding to each bit digital data signal from the first power line Vn. As a result, in the light emitting display device according to the first embodiment of the present invention, the deviation of the threshold voltage Vth of the second transistor M2 is supplied to the first power line Vn for each subframe for each pixel 111. The current corresponding to each bit digital data signal may be supplied to the light emitting device OLED even when the weights of the first power supplies are different.

도 5는 본 발명의 제 1 실시 예에 따른 발광 표시장치의 구동방법을 나타내는 파형도이다.5 is a waveform diagram illustrating a method of driving a light emitting display device according to a first embodiment of the present invention.

도 5를 참조하면, 본 발명의 제 1 실시 예에 따른 발광 표시장치와 그의 구동방법은 제 2 트랜지스터(M2)의 문턱전압(Vth) 변화에 의한 휘도 불균일을 방지함과 아울러 발광소자(OLED)의 밝기를 조절하여 원하는 계조를 표시하기 위하여, i 비트 디지털 데이터 신호의 각 비트에 대응되며 동일한 발광기간을 가지도록 하나의 프레임을 다수의 서브-프레임(SF1 내지 SFj)으로 분할하여 구동하게 된다. 이때, i 비트 디지털 데이터 신호일 경우에 제 1 내지 제 j 서브-프레임(SF1 내지 SFj)은 서로 다른 가중치의 밝기에 대응되는 계조를 가지며, 제 1 내지 제 j 서브-프레임(SF1 내지 SFj)의 밝기에 대응되는 계조의 비율은 20:21:22:23 :24:25:...:2i이 된다.Referring to FIG. 5, the light emitting display device and the driving method thereof according to the first embodiment of the present invention prevent luminance unevenness due to a change in the threshold voltage Vth of the second transistor M2 and also emit a light emitting device OLED. In order to display a desired gray scale by adjusting the brightness of the light source, one frame is divided into a plurality of sub-frames SF1 to SFj so as to correspond to each bit of the i-bit digital data signal and have the same emission period. In this case, in the case of an i-bit digital data signal, the first to j th sub-frames SF1 to SFj have gray levels corresponding to brightnesses of different weights, and the brightness of the first to j th sub-frames SF1 to SFj. The ratio of gradations corresponding to 2 0 : 2 1 : 2 2 : 2 3 : 2 4 : 2 5 : ...: 2 i .

도 5를 도 4와 결부하여 본 발명의 제 1 실시 예에 따른 발광 표시장치와 그의 구동방법을 설명하면 다음과 같다.Referring to FIG. 5 and FIG. 4, a light emitting display device and a driving method thereof according to the first embodiment of the present invention will be described below.

먼저, 한 프레임 중 제 1 서브-프레임(SF1)에서는 이전 주사선들(SN 내지 SN-1)에 로우(LOW) 상태의 제 2 주사신호(SSn 내지 SSn-1)가 순차적으로 공급됨으로써 제 2 각 화소(111)의 제 5 트랜지스터(M5)가 턴-온된다. 제 5 트랜지스터(M5)의 턴-온에 의해 초기화 전원선(Vint)으로부터의 초기화 전원이 제 5 트랜지스터(M5)를 통해 제 1 노드(N1)에 공급된다. 이에 따라, 제 1 노드(N1)에 공급되는 초기화 전원은 커패시터(C)에 저장된다. 그리고, 일정시간이 경과되면 로우 상태의 제 2 주사신호(SSn 내지 SSn-1)가 하이(HIGH) 상태가 되므로 제 5 트랜지스터(M5)가 오프되므로 초기화 구간이 완료된다.First, in the first sub-frame SF1 of one frame, the second scan signals SSn to SSn-1 having a low state are sequentially supplied to the previous scan lines SN to SN-1, thereby providing a second angle. The fifth transistor M5 of the pixel 111 is turned on. By the turn-on of the fifth transistor M5, the initialization power supply from the initialization power supply line Vint is supplied to the first node N1 through the fifth transistor M5. Accordingly, the initialization power supplied to the first node N1 is stored in the capacitor C. After a predetermined time has elapsed, since the second scan signals SSn to SSn-1 in the low state become HIGH, the fifth transistor M5 is turned off, and thus the initialization period is completed.

한편, 제 3 트랜지스터(M3)는 이전 주사선들(SN 내지 SN-1) 및 현재 주사선들(S1 내지 SN)에 공급되는 로우 상태의 제 1 및 제 2 주사신호(SS)가 공급되는 구간동안 발광 제어선(En)에 공급되는 하이 상태의 발광 제어신호(ES)에 의해 오프 상태가 된다.Meanwhile, the third transistor M3 emits light during a period in which the first and second scan signals SS in a low state supplied to the previous scan lines SN through SN-1 and the current scan lines S1 through SN are supplied. It is turned off by the light emission control signal ES in the high state supplied to the control line En.

그런 다음, 제 1 서브-프레임(SF1)에서는 현재 주사선들(S1 내지 SN)에 로우 상태의 제 1 주사신호(SSn 내지 SSn-1)가 공급됨으로써 각 화소(111)의 제 1 트랜지스터(M1)가 턴-온된다. 이와 동시에, 현재 주사선들(S1 내지 SN)에 공급되는 로우 상태의 제 1 주사신호(SS1 내지 SSn)에 동기되도록 제 1 전원선들(V1 내지 VN)에는 제 1 레벨의 제 1 전원(VDD1)이 공급된다. 이에 따라, 제 1 트랜지스터(M1)의 턴-온에 의해 데이터선(Dm)에 공급된 i 비트 중 제 1 비트 디지털 데이터 신호가 상기 제 1 트랜지스터(M1)를 통해 제 4 트랜지스터(M4)의 소스 전극에 공급된다. 이때, 제 4 트랜지스터(M4)는 커패시터(C)에 저장된 초기화 전원에 의해 턴-온되어 제 1 트랜지스터(M1)로부터 공급되는 제 1 비트 디지털 데이터 신호를 제 1 노드(N1)에 공급된다. 이로 인하여, 각 화소(111)의 커패시터(C)는 제 1 노드(N1)에 공급되는 제 1 비트 디지털 데이터 신호에 상응하는 전압을 저장하게 된다. 커패시터(C)에 저장되는 전압은 제 1 노드(N1) 상의 제 1 비트 디지털 데이터 신호와 상기 제 4 트랜지스터(M4)의 문턱전압(Vth)의 차가 된다.Then, in the first sub-frame SF1, the first scan signals SSn through SSn-1 in the low state are supplied to the current scan lines S1 through SN, so that the first transistor M1 of each pixel 111 is provided. Is turned on. At the same time, the first power source lines VDD to VN are provided with the first power source VDD1 at the first level to be synchronized with the first scan signals SS1 to SSn in the low state supplied to the current scan lines S1 to SN. Supplied. Accordingly, a first bit digital data signal of the i bits supplied to the data line Dm by the turn-on of the first transistor M1 is supplied to the source of the fourth transistor M4 through the first transistor M1. Supplied to the electrode. In this case, the fourth transistor M4 is turned on by the initialization power source stored in the capacitor C to supply the first bit digital data signal supplied from the first transistor M1 to the first node N1. As a result, the capacitor C of each pixel 111 stores a voltage corresponding to the first bit digital data signal supplied to the first node N1. The voltage stored in the capacitor C becomes a difference between the first bit digital data signal on the first node N1 and the threshold voltage Vth of the fourth transistor M4.

그런 다음, 일정시간이 경과되면 로우 상태의 제 1 주사신호(SS1 내지 SSn)가 하이 상태가 되어 제 4 트랜지스터(M4)가 오프되므로 제 2 트랜지스터(M2)는 커패시터(C)에 저장된 전압에 의해 온 상태를 유지한다. 이에 따라, 각 화소(111)의 제 2 트랜지스터(M2)는 상기 커패시터(C)에 저장된 전압에 의해 구동되어 제 1 전원선(V1 내지 VN)에 공급되는 제 1 레벨의 제 1 전원(VDD1)과 커패시터(C)에 저장된 전압의 차전압에 대응되는 전류를 제 3 트랜지스터(M3)에 공급한다.Then, when a predetermined time elapses, since the first scan signals SS1 to SSn in the low state become high and the fourth transistor M4 is turned off, the second transistor M2 is driven by the voltage stored in the capacitor C. Keep on. Accordingly, the second transistor M2 of each pixel 111 is driven by the voltage stored in the capacitor C to be supplied to the first power lines V1 to VN, and the first power VDD1 of the first level is supplied. The current corresponding to the difference voltage of the voltage stored in the capacitor C is supplied to the third transistor M3.

이어서, 이전 주사선들(SN 내지 SN-1) 및 현재 주사선들(S1 내지 SN)에 공급되는 로우(LOW) 상태의 제 1 및 제 2 주사신호(SS)가 하이 상태가 되면, 발광 제어선(En)에 로우 상태의 발광 제어신호(ES)가 공급되어 각 화소(111)의 제 3 트랜지스터(M3)가 턴-온됨으로써 제 2 트랜지스터(M2)로부터의 전류는 제 3 트랜지스터(M3)를 통해 발광소자(OLED)에 공급된다.Subsequently, when the first and second scan signals SS in the low state supplied to the previous scan lines SN through SN-1 and the current scan lines S1 through SN become high, the emission control line ( The emission control signal ES in a low state is supplied to En so that the third transistor M3 of each pixel 111 is turned on so that current from the second transistor M2 is transferred through the third transistor M3. It is supplied to the light emitting element OLED.

이에 따라, 발광소자(OLED)는 제 1 서브-프레임(SF1) 동안 제 1 전원선(V1 내지 VN)에 공급되는 제 1 레벨의 제 1 전원(VDD1)으로부터 제 1 비트 디지털 데이터 신호에 대응되는 전류를 제 2 및 제 3 트랜지스터(M2, M3)를 통해 공급받아 "0" 및 "20" 계조 중 어느 하나의 계조에 대응되는 밝기로 발광하게 된다. 즉, 발광소자(OLED)는 제 1 비트 디지털 데이터 신호가 "0"일 경우에 "20" 계조에 대응되는 밝기로 발광하고 "1"일 경우에 비발광하게 된다.Accordingly, the light emitting device OLED corresponds to the first bit digital data signal from the first power source VDD1 of the first level supplied to the first power lines V1 through VN during the first sub-frame SF1. Current is supplied through the second and third transistors M2 and M3 to "0" and "2 0 ". The light is emitted at a brightness corresponding to one of the gray levels. That is, the light emitting element OLED has "2 0 " when the first bit digital data signal is " 0 ". When light is emitted at a brightness corresponding to the gradation and is "1", the light is not emitted.

마찬가지로, 한 프레임 중 제 2 서브-프레임(SF2)에서 각 발광소자(OLED)는 상술한 제 1 서브-프레임(SF1)과 동일한 방식에 의해 제 2 비트 디지털 데이터 신 호에 상응하는 전류를 제 1 레벨의 제 1 전원(VDD1)보다 높은 제 2 레벨의 제 1 전원(VDD2)이 공급되는 제 1 전원선(V1 내지 VN)으로부터 공급받아 "0" 및 "21" 계조 중 어느 하나의 계조에 대응되는 밝기로 발광하게 된다.Similarly, in the second sub-frame SF2 of one frame, each of the light emitting diodes OLED receives a current corresponding to the second bit digital data signal in the same manner as the first sub-frame SF1 described above. &Quot; 0 " and " 2 1 " received from the first power lines V1 to VN supplied with the first power supply VDD2 of the second level higher than the first power supply VDD1 of the level. The light is emitted at a brightness corresponding to one of the gray levels.

이와 마찬가지로, 한 프레임 중 제 3 내지 제 j 서브-프레임(SF3 내지 SFj) 동안 발광소자(OLED)는 상술한 제 1 및 제 2 서브-프레임(SF1, SF2)과 동일한 방식에 의해 제 3 내지 제 i 비트 디지털 데이터 신호에 상응하는 전류를 점점 높아지는 제 3 내지 제 j 레벨의 제 1 전원(VDD3 내지 VDDj)이 공급되는 제 1 전원선(V1 내지 VN)으로부터 공급받아 "0" 또는 "22 내지 2i" 계조에 대응되는 밝기로 발광하게 된다.Similarly, during the third to jth sub-frames SF3 to SFj of one frame, the light emitting device OLED may be configured to have the same properties as those of the first and second sub-frames SF1 and SF2 described above. i bits, the third to the first power of the j-th level gradually increasing the current corresponding to the digital data signals (VDD3 to VDDj) when supplied from the first power supply lines (V1 to VN) are supplied to "0" or "22 to It emits light with brightness corresponding to 2 i "gradation.

이와 같은, 본 발명의 제 1 실시 예에 따른 발광 표시장치와 그의 구동방법은 보상회로(144)를 이용하여 제 2 트랜지스터(M2)의 문턱전압(Vth)을 보상함과 아울러 발광소자(OLED)의 애노드 전극에 공급되는 제 1 전원(VDD1 내지 VDDj)의 레벨을 각 서브-프레임(SF1 내지 SFj) 마다 다르게 함으로써 각 서브-프레임(SF1 내지 SFj) 동안 밝기의 합에 의해 원하는 계조를 가지는 화상을 표시할 수 있다. 또한, 본 발명의 제 1 실시 예에 따른 발광 표시장치와 그의 구동방법은 트랜지스터의 특성 편차로 인한 화상 불균일 현상을 최소화할 수 있다. 또한, 본 발명의 제 1 실시 예에 따른 발광 표시장치와 그의 구동방법은 디지털 구동방식에서 서브-프레임들(SF1 내지 SFj)의 발광기간을 동일함으로써 각 서브-프레임(SF1 내지 SFj)의 계조 표현시간을 충분하게 확보할 수 있다.As described above, the light emitting display device and the driving method thereof according to the first exemplary embodiment of the present invention compensate for the threshold voltage Vth of the second transistor M2 by using the compensation circuit 144 and the light emitting device OLED. By varying the level of the first power supplies VDD1 to VDDj supplied to the anode electrodes of the respective sub-frames SF1 to SFj, an image having a desired gray scale is obtained by the sum of the brightness for each sub-frame SF1 to SFj. I can display it. In addition, the light emitting display device and the driving method thereof according to the first embodiment of the present invention can minimize image unevenness due to variations in characteristics of transistors. In addition, the light emitting display device and the driving method thereof according to the first exemplary embodiment of the present invention provide the gray scale representation of each sub-frame SF1 to SFj by equalizing the emission period of the sub-frames SF1 to SFj in the digital driving method. Sufficient time can be secured.

도 6은 본 발명의 제 2 실시 예에 따른 발광 표시장치의 화소를 나타내는 도면이고, 도 7은 본 발명의 제 2 실시 예에 따른 발광 표시장치의 구동방법을 나타내는 파형도이다.6 is a diagram illustrating a pixel of a light emitting display device according to a second embodiment of the present invention, and FIG. 7 is a waveform diagram illustrating a method of driving the light emitting display device according to the second embodiment of the present invention.

도 6 및 도 7을 참조하면, 본 발명의 제 2 실시 예에 따른 발광 표시장치의 화소는 화소회로(140)를 구성하는 트랜지스터(M1, M2)의 전도타입을 제외하고는 상술한 도 4에 도시된 본 발명의 제 1 실시 예와 동일하게 된다.6 and 7, the pixel of the light emitting display device according to the second exemplary embodiment of the present invention is described with reference to FIG. 4 except for the conduction type of the transistors M1 and M2 constituting the pixel circuit 140. Same as the first embodiment of the present invention shown.

즉, 본 발명의 제 2 실시 예에 따른 발광 표시장치는 N 타입의 트랜지스터들(M1, M2)을 구동하기 위한 주사신호를 제외하고는 상술한 본 발명의 제 1 실시 예와 동일하게 된다. 이에 따라, 당업자라면 상술한 본 발명의 제 1 실시 예의 설명만으로 본 발명의 제 2 실시 예를 용이하게 실시할 수 있을 것이다. 따라서, 본 발명의 제 2 실시 예에 따른 발광 표시장치와 그의 구동방법은 상술한 P 타입의 트랜지스터를 포함하는 본 발명의 제 1 실시 예에 대한 설명으로 대신하기로 한다.That is, the light emitting display device according to the second embodiment of the present invention is the same as the first embodiment of the present invention except for the scan signal for driving the N-type transistors M1 and M2. Accordingly, those skilled in the art will be able to easily implement the second embodiment of the present invention only by the above description of the first embodiment of the present invention. Therefore, the light emitting display device and the driving method thereof according to the second embodiment of the present invention will be replaced with the description of the first embodiment of the present invention including the P-type transistor.

한편, 본 발명의 실시 예에 따른 발광 표시장치 및 그의 구동방법에서 각 서브-프레임은 동일한 발광기간을 가지는 것으로 설명되었으나, 계조 표현 및 화질 개선을 위하여 서로 다른 발광기간을 가질 수 있다.Meanwhile, in the light emitting display device and the driving method thereof, each sub-frame has been described as having the same light emitting period, but may have different light emitting periods for gray scale expression and image quality improvement.

그리고, 본 발명의 실시 예에 따른 발광 표시장치 및 그의 구동방법은 전류를 제어하여 화상을 표시하는 표시장치에 동일하게 적용될 수 있다.The light emitting display device and the driving method thereof according to the embodiment of the present invention can be equally applied to a display device for displaying an image by controlling a current.

상기 발명의 상세한 설명과 도면은 단지 본 발명의 예시적인 것으로서, 이는 단지 본 발명을 설명하기 위한 목적에서 사용된 것이지 의미한정이나 특허청구범위에 기재된 본 발명의 범위를 제한하기 위하여 사용된 것은 아니다. 따라서, 이상 설명한 내용을 통해 당업자라면 본 발명의 기술사상을 일탈하지 아니하는 범위에서 다양한 변경 및 수정이 가능함을 알 수 있을 것이다. 따라서, 본 발명의 기술적 보호 범위는 명세서의 상세한 설명에 기재된 내용으로 한정되는 것이 아니라 특허청구범위에 의해 정하여 져야만 할 것이다.The above detailed description and drawings are merely exemplary of the present invention, which are used only for the purpose of illustrating the present invention and are not intended to limit the scope of the present invention as defined in the claims or the claims. Accordingly, those skilled in the art will appreciate that various changes and modifications can be made without departing from the technical spirit of the present invention. Therefore, the technical protection scope of the present invention should not be limited to the contents described in the detailed description of the specification but should be defined by the claims.

상술한 바와 같이, 본 발명의 실시 예에 따른 발광 표시장치는 미러형 제 3 트랜지스터를 이용하여 제 2 트랜지스터의 문턱전압을 보상함과 아울러 발광소자의 애노드 전극에 공급되는 제 1 전원을 각 서브-프레임마다 다르게 함으로써 각 서브-프레임 동안 밝기의 합에 의해 원하는 계조를 가지는 화상을 표시할 수 있다. 이에 따라, 본 발명은 트랜지스터의 특성 편차로 인한 화상 불균일 현상을 최소화할 수 있다. 또한, 본 발명은 서브-프레임들의 발광기간을 동일함으로써 각 서브-프레임의 계조 표현시간을 충분하게 확보할 수 있다.
As described above, the light emitting display device according to the exemplary embodiment of the present invention compensates the threshold voltage of the second transistor using a mirror-type third transistor and supplies the first power supplied to the anode electrode of the light emitting device. By varying from frame to frame, it is possible to display an image having a desired gradation by the sum of the brightness for each sub-frame. Accordingly, the present invention can minimize the image non-uniformity caused by the variation of the characteristics of the transistor. In addition, the present invention can sufficiently secure the gray scale expression time of each sub-frame by making the light emission period of the sub-frames the same.

Claims (22)

주사신호가 공급되는 복수의 주사선들과 데이터 신호가 공급되는 복수의 데이터선들 및 복수의 전원선들에 의해 정의되는 복수의 화소들을 포함하고,A plurality of pixels defined by a plurality of scan lines supplied with a scan signal, a plurality of data lines supplied with a data signal, and a plurality of power supply lines, 상기 각 화소는,Each pixel, 한 프레임의 각 서브-프레임에 대응되는 전원으로부터 상기 데이터 신호에 대응되는 전류를 출력하는 트랜지스터와 상기 트랜지스터의 문턱전압을 보상하기 위한 보상회로를 포함하는 화소회로와,A pixel circuit including a transistor for outputting a current corresponding to the data signal from a power source corresponding to each sub-frame of one frame, and a compensation circuit for compensating a threshold voltage of the transistor; 상기 화소회로로부터 출력되는 전류에 의해 발광하는 발광소자를 구비하는 발광 표시장치.And a light emitting element emitting light by current output from the pixel circuit. 제 1 항에 있어서,The method of claim 1, 발광 제어신호가 공급되는 발광 제어선과,A light emission control line to which a light emission control signal is supplied; 초기화 전원이 공급되는 초기화 전원선을 더 구비하는 발광 표시장치.A light emitting display device further comprising an initialization power line supplied with initialization power. 제 2 항에 있어서,The method of claim 2, 상기 화소회로는,The pixel circuit, 제 1 주사선에 공급되는 제 1 주사신호에 제어되며 상기 데이터선에 공급된 상기 데이터 신호를 상기 보상회로로 출력하는 제 1 트랜지스터와,A first transistor controlled by the first scan signal supplied to the first scan line and outputting the data signal supplied to the data line to the compensation circuit; 상기 보상회로로부터의 전압에 따라 상기 전원선으로부터 상기 전류를 출력 하는 제 2 트랜지스터와,A second transistor for outputting the current from the power supply line in accordance with the voltage from the compensation circuit; 상기 발광 제어선에 공급되는 발광 제어신호에 의해 제어되며 상기 제 2 트랜지스터로부터의 전류를 상기 발광소자에 공급하는 제 3 트랜지스터를 구비하는 발광 표시장치.And a third transistor that is controlled by an emission control signal supplied to the emission control line and supplies current from the second transistor to the light emitting element. 제 3 항에 있어서,The method of claim 3, wherein 상기 보상회로는,The compensation circuit, 상기 제 2 트랜지스터와 미러 형태로 접속됨과 동시에 다이오드 형태로 연결되어 상기 제 1 트랜지스터로부터의 데이터 신호를 상기 제 2 트랜지스터로 출력하는 제 4 트랜지스터와,A fourth transistor connected to the second transistor in a mirror form and simultaneously connected in a diode form to output a data signal from the first transistor to the second transistor; 제 2 주사선에 공급되는 제 2 주사신호에 의해 제어되며 상기 제 2 및 제 3 트랜지스터의 게이트가 접속된 제 1 노드에 상기 초기화 전원을 공급하는 제 5 트랜지스터와,A fifth transistor controlled by a second scan signal supplied to a second scan line and supplying the initialization power to a first node to which gates of the second and third transistors are connected; 상기 제 1 노드와 상기 전원선간에 접속되는 커패시터를 구비하는 발광 표시장치.And a capacitor connected between the first node and the power line. 복수의 주사선들, 복수의 데이터선들 및 복수의 전원선들에 의해 정의되며 상기 데이터선에 공급되는 데이터 신호에 대응되는 전류를 상기 전원선으로부터 공급받아 발광하는 복수의 화소들을 포함하는 화상 표시부와,An image display unit including a plurality of pixels defined by a plurality of scan lines, a plurality of data lines, and a plurality of power lines, and configured to emit light by receiving a current corresponding to a data signal supplied to the data line from the power line; 상기 주사선들에 주사신호를 공급하기 위한 주사 구동부와,A scan driver for supplying scan signals to the scan lines; 상기 데이터선에 상기 데이터 신호를 공급하기 위한 데이터 구동부와,A data driver for supplying the data signal to the data line; 한 프레임의 각 서브-프레임에 대응되는 전원을 상기 전원선에 공급하기 위한 전원 공급부와,A power supply unit for supplying power corresponding to each sub-frame of one frame to the power line; 상기 각 화소에 초기화 전원을 공급하기 위한 초기화 전원 공급부를 구비하는 발광 표시장치.And an initialization power supply for supplying initialization power to each of the pixels. 제 1 항 또는 5 항에 있어서,The method according to claim 1 or 5, 상기 각 화소는 각 서브-프레임마다 발광되는 밝기의 합에 의해 원하는 계조를 표시하는 발광 표시장치.Wherein each pixel displays a desired gray scale by the sum of brightnesses emitted for each sub-frame. 제 6 항에 있어서,The method of claim 6, 상기 데이터 신호는 상기 서브-프레임에 대응되는 i(단, i는 양의 정수)비트를 가지는 디지털 데이터 신호인 발광 표시장치.And the data signal is a digital data signal having i (where i is a positive integer) bit corresponding to the sub-frame. 제 7 항에 있어서,The method of claim 7, wherein 상기 전원의 레벨은 상기 디지털 데이터 신호의 최상위 비트로 갈수록 높아지는 것을 특징으로 하는 발광 표시장치.And the level of the power is increased to the most significant bit of the digital data signal. 제 7 항에 있어서,The method of claim 7, wherein 상기 전원은 상기 주사신호에 동기되도록 상기 전원선에 공급되는 발광 표시 장치.And the power is supplied to the power line in synchronization with the scan signal. 제 5 항에 있어서,The method of claim 5, 상기 전원 공급부는,The power supply unit, 서로 다른 전압을 발생하는 전압 발생부와,A voltage generator for generating different voltages, 상기 각 서브-프레임에 대응되는 전압 선택신호를 발생하는 쉬프트 레지스터부와,A shift register unit generating a voltage selection signal corresponding to each sub-frame; 상기 전압 선택신호에 따라 상기 전압 발생부로부터 공급되는 상기 서로 다른 전압 중 어느 하나를 선택하여 상기 전원선에 공급하는 선택부를 구비하는 발광 표시장치.And a selector configured to select one of the different voltages supplied from the voltage generator and supply the selected voltage to the power line according to the voltage select signal. 제 5 항에 있어서,The method of claim 5, 상기 화상 표시부는,The image display unit, 발광 제어신호가 공급되는 발광 제어선과,A light emission control line to which a light emission control signal is supplied; 상기 초기화 전원이 공급되는 초기화 전원선을 더 구비하는 발광 표시장치.And an initialization power line supplied with the initialization power. 제 11 항에 있어서,The method of claim 11, 상기 화소는,The pixel, 상기 각 서브-프레임마다 상기 데이터 신호에 대응되는 전류를 상기 전원선에 공급되는 상기 전원으로부터 출력하는 트랜지스터와 상기 트랜지스터의 문턱전 압을 보상하기 위한 보상회로를 포함하는 화소회로와,A pixel circuit including a transistor for outputting a current corresponding to the data signal from the power source supplied to the power line for each sub-frame, and a compensation circuit for compensating the threshold voltage of the transistor; 상기 화소회로로부터 출력되는 전류에 의해 발광하는 발광소자를 구비하는 발광 표시장치.And a light emitting element emitting light by current output from the pixel circuit. 제 12 항에 있어서,The method of claim 12, 상기 화소회로는,The pixel circuit, 상기 주사선에 공급되는 제 1 주사신호에 제어되며 상기 데이터선에 공급된 상기 데이터 신호를 상기 보상회로로 출력하는 제 1 트랜지스터와,A first transistor controlled by a first scan signal supplied to the scan line and outputting the data signal supplied to the data line to the compensation circuit; 상기 보상회로로부터의 전압에 따라 상기 전원선으로부터 상기 전류를 출력하는 제 2 트랜지스터와,A second transistor for outputting the current from the power supply line in accordance with the voltage from the compensation circuit; 상기 발광 제어선에 공급되는 발광 제어신호에 의해 제어되며 상기 제 2 트랜지스터로부터의 전류를 상기 발광소자에 공급하는 제 3 트랜지스터를 구비하는 발광 표시장치.And a third transistor that is controlled by an emission control signal supplied to the emission control line and supplies current from the second transistor to the light emitting element. 제 13 항에 있어서,The method of claim 13, 상기 보상회로는,The compensation circuit, 상기 제 2 트랜지스터와 미러 형태로 접속됨과 동시에 다이오드 형태로 연결되어 상기 제 1 트랜지스터로부터의 데이터 신호를 상기 제 2 트랜지스터로 출력하는 제 4 트랜지스터와,A fourth transistor connected to the second transistor in a mirror form and simultaneously connected in a diode form to output a data signal from the first transistor to the second transistor; 상기 주사선에 공급되는 제 2 주사신호에 의해 제어되며 상기 초기화 전원을 상기 제 2 및 제 3 트랜지스터의 게이트가 접속된 제 1 노드에 공급하는 제 5 트랜지스터와,A fifth transistor controlled by a second scan signal supplied to the scan line and configured to supply the initialization power to a first node to which gates of the second and third transistors are connected; 상기 제 1 노드와 상기 전원선간에 접속되는 커패시터를 구비하는 발광 표시장치.And a capacitor connected between the first node and the power line. 제 1 항 또는 5 항에 있어서,The method according to claim 1 or 5, 상기 전원선은 상기 주사선과 나란하도록 위치하는 발광 표시장치.And the power supply line is parallel to the scan line. 복수의 주사선들과 복수의 데이터선들 및 복수의 전원선들에 의해 정의되며 상기 데이터선에 공급되는 데이터 신호에 대응되는 전류를 출력하는 트랜지스터를 포함하는 복수의 화소의 구동방법에 있어서,A driving method of a plurality of pixels including a transistor defined by a plurality of scan lines, a plurality of data lines, and a plurality of power lines and outputting a current corresponding to a data signal supplied to the data line, 제 1 주사선에 공급되는 제 1 주사신호에 따라 초기화 전원을 이용하여 상기 트랜지스터의 문턱전압에 대응되는 전압을 커패시터에 저장하는 단계와,Storing a voltage corresponding to the threshold voltage of the transistor in the capacitor using an initialization power source according to the first scan signal supplied to the first scan line; 상기 데이터선에 상기 데이터 신호를 공급하는 단계와,Supplying the data signal to the data line; 한 프레임의 각 서브-프레임에 대응되는 전원을 상기 전원선에 공급하는 단계와,Supplying power corresponding to each sub-frame of one frame to the power line; 제 2 주사선에 공급되는 제 2 주사신호에 따라 상기 전원과 상기 데이터 신호의 차전압을 상기 커패시터에 저장하는 단계와,Storing the voltage difference between the power source and the data signal in the capacitor according to a second scan signal supplied to a second scan line; 상기 커패시터에 저장된 전압을 이용하여 상기 트랜지스터를 구동시켜 상기 전류를 상기 전원선에 공급되는 전원으로부터 출력하여 발광소자를 발광시키는 단 계를 포함하는 발광 표시장치의 구동방법.And driving the transistor by using the voltage stored in the capacitor to output the current from the power supplied to the power line so as to emit light from the light emitting device. 제 16 항에 있어서,The method of claim 16, 상기 각 화소는 상기 각 서브-프레임마다 상기 발광소자의 발광에 따른 밝기의 합에 의해 원하는 계조를 표시하는 발광 표시장치의 구동방법.And wherein each pixel displays a desired gray level by the sum of brightnesses of the light emitting elements for each sub-frame. 제 17 항에 있어서,The method of claim 17, 상기 데이터 신호는 상기 서브-프레임에 대응되는 i(단, i는 양의 정수)비트를 가지는 디지털 데이터 신호인 것을 특징으로 하는 발광 표시장치의 구동방법.And the data signal is a digital data signal having i (where i is a positive integer) bit corresponding to the sub-frame. 제 18 항에 있어서,The method of claim 18, 상기 전원의 레벨은 상기 디지털 데이터 신호의 최상위 비트로 갈수록 높아지는 것을 특징으로 하는 발광 표시장치의 구동방법.And the level of the power is increased to the most significant bit of the digital data signal. 제 16 항에 있어서,The method of claim 16, 상기 전원은 상기 주사신호에 동기되도록 상기 전원선에 공급되는 발광 표시장치의 구동방법.And the power is supplied to the power line in synchronization with the scan signal. 제 16 항에 있어서,The method of claim 16, 상기 데이터 신호는 제 2 주사선에 공급되는 제 2 주사신호에 따라 상기 트 랜지스터와 미러 형태로 접속됨과 동시에 다이오드 형태로 연결된 미러 트랜지스터를 경유하여 상기 커패시터에 공급되는 발광 표시장치의 구동방법.And the data signal is connected to the transistor in a mirror form according to a second scan signal supplied to a second scan line and is supplied to the capacitor via a mirror transistor connected in a diode form. 제 16 항에 있어서,The method of claim 16, 발광 제어신호에 따라 상기 트랜지스터로부터 출력되는 전류를 상기 발광소자에 공급하는 단계를 더 포함하는 발광 표시장치의 구동방법.And supplying a current output from the transistor to the light emitting device according to a light emission control signal.
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