KR100587969B1 - Flash analog digital converter - Google Patents
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Abstract
본 발명은 플래쉬 아날로그 디지털 컨버터에 관한 것으로서, 보다 상세하게는 플래쉬 전원전압의 이상, 비교기의 준안정, 및 잡음 등의 원인에 의해 발생되는 버블의 특성에 따라 제거하여 아날로그 디지털 컨버터의 성능을 개선시키는 기술을 개시한다.The present invention relates to a flash analog-to-digital converter, and more particularly, to improve the performance of the analog-to-digital converter by removing according to the characteristics of the bubble generated by the cause of the flash power supply voltage abnormality, metastable stability of the comparator, noise, etc. Discuss the technique.
이를 위한 본 발명은 기준전압을 분배하여 출력하는 기준전압 발생부와, 분배된 기준전압과 외부로부터 입력되는 아날로그 입력전압을 각각 비교 증폭하여 출력하는 비교부 및 비교부의 출력을 온도계 코드로 변환하고, 온도계 코드를 이진코드로 변환시켜 출력하되, 비교부의 출력에 발생한 버블을 제거하여 출력하는 엔코더를 포함하여 구성함을 특징으로 한다.The present invention for this purpose is to convert the output of the reference voltage generator for distributing and outputting the reference voltage, and the output of the comparison unit and the comparison unit to compare and amplify and output the divided reference voltage and the analog input voltage input from the outside into a thermometer code, It converts the thermometer code into a binary code and outputs, characterized in that it comprises an encoder for removing and outputting the bubble generated in the output of the comparator.
Description
도 1은 일반적인 플래쉬 아날로그 디지털 컨버터의 구성도.1 is a configuration diagram of a typical flash analog to digital converter.
도 2는 도 1의 엔코더의 출력 파형도.2 is an output waveform diagram of the encoder of FIG.
도 3a 및 도 3b는 도 1의 엔코더의 회로도.3A and 3B are circuit diagrams of the encoder of FIG.
도 4는 본 발명의 실시예에 따른 플래쉬 아날로그 디지털 컨버터의 구성도.4 is a block diagram of a flash analog to digital converter according to an embodiment of the present invention.
도 5는 도 4의 엔코더의 세부 구성도.5 is a detailed configuration diagram of the encoder of FIG. 4.
본 발명은 플래쉬 아날로그 디지털 컨버터에 관한 것으로서, 보다 상세하게는 플래쉬 전원전압의 이상, 비교기의 준안정, 및 잡음 등의 원인에 의해 발생되는 버블의 특성에 따라 제거하여 아날로그 디지털 컨버터의 성능을 개선시키는 기술이다.The present invention relates to a flash analog-to-digital converter, and more particularly, to improve the performance of the analog-to-digital converter by removing according to the characteristics of the bubble generated by the cause of the flash power supply voltage abnormality, metastable stability of the comparator, noise, etc. Technology.
일반적으로, 아날로그 디지털 컨버터(analog-digital converter; 이하, ADC라 함)는 아날로그 입력신호를 디지털 코드로 변환하는 회로로서, 아날로그 시스템과 디지털 시스템 사이에 구비되어 인터페이싱(interfacing) 역할을 담당한다. In general, an analog-digital converter (hereinafter, referred to as an ADC) is a circuit for converting an analog input signal into a digital code and is provided between an analog system and a digital system to serve as an interfacing role.
도 1은 일반적인 플래쉬 아날로그 디지털 컨버터의 구성도이다.1 is a configuration diagram of a typical flash analog to digital converter.
플래쉬 아날로그 디지털 컨버터는 기준전압 발생부(10), 비교부(20), 및 엔코더(30)를 구비한다. The flash analog to digital converter includes a
기준전압 발생부(10)는 기준전압 VREF과 접지전압 VSS 사이에 복수개의 저항 R1 내지 R2m을 직렬연결하여, 기준전압 VREF을 분배하여 출력한다. The
비교부(20)는 기준전압 발생부(10)로부터 출력되는 복수개의 기준전압 VREF과 아날로그 입력전압 VIN을 각각 비교 증폭하는 복수개의 차동증폭기 C1 내지 C2m-1를 구비한다. 비교부(20)는 아날로그 입력전압 VIN이 높아질수록 도 2와 같이, 노드 N1 내지 N2n-1로 로우레벨에서 하이레벨로 온도계 코드(thermometer code)를 출력한다.The
엔코더(30)는 비교부(20)로부터 출력되는 온도계 코드를 1-of-n 코드로 출력하고, 1-of-n 코드를 이진코드(binary code)로 변환시켜 n 비트의 출력신호 OUT를 출력한다.The
예를 들어, 64 비트 플래쉬 아날로그 디지털 컨버터의 경우, 기준전압 발생부(10)는 64개의 저항을 구비하고 비교부(20)는 63개의 차동증폭기를 구비한다.For example, in the case of a 64-bit flash analog to digital converter, the
도 3a 및 도 3b는 도 1의 엔코더(30)의 회로도이다.3A and 3B are circuit diagrams of the
엔코더(30)는 복수개의 앤드게이트를 구비하여, 비교부(20)로부터 출력되는 온도계 코드를 1-of-n 코드로 변환한다.The
도 3a는 비교부(20)의 출력에 버블(bubble)이 없는 경우, 즉 정상적으로 동작하는 경우의 도면이고, 도 3b는 비교부(20)의 출력에 버블이 발생한 경우의 도면 이다.FIG. 3A illustrates a case in which there is no bubble at the output of the
도 3a에 도시한 바와같이, 엔코더(30)는 비교부(20)로부터 출력되는 온도계 코드를 1-of-n 코드로 변환시켜 출력한다. 이렇게 변환된 1-of-n 코드는 6비트 이진 변환기(미도시)에서 6비트 이진(binary)로 재변환된다.As shown in FIG. 3A, the
그런데, 종래의 플래쉬 아날로그 디지털 컨버터는 고속 동작 시 전력소모가 커서 비교부(20)에 잡음이나 준안정 문제등이 발생하여 도 3b와 같이, 비교부(20)의 출력에 버블이 발생하는 경우가 많다.However, in the conventional flash analog-to-digital converter, power consumption is high during high-speed operation, and noise or metastable problems occur in the
버블은 엔코더(30)의 출력이 "00001111"과 같은 형태로 출력되어야 정상인데, "00001011"와 같이 엔코더(30)의 출력값 중 "1"과 "1" 사이에 "0"이 나타나는 형태이다.The bubble is normal when the output of the
도 3a에서는 엔코더(30)가 비교부(20)로부터 출력되는 정상 온도계 코드가 "01111"를 정상 1-of-n 코드 "1000"로 변환한다. 그에 반하여, 도 3b에서는 비교부(20)의 출력에 버블이 발생하여 온도계 코드가 "01011" 값을 갖는다. 따라서, 엔코더(30)는 버블이 발생한 온도계 코드 "01011"를 이용하여 1-of-n 코드로 변환하므로 1-of-n 코드에도 버블이 발생하게 되어 "1010"으로 출력된다. In FIG. 3A, the normal thermometer code output from the
결국, 버블이 발생한 1-of-n 코드를 이용하여 이진 코드로 변환하는 이진 변환 시 오동작을 유발시켜 단조도 특성이 떨어지고 결국 플래쉬 아날로그 디지털 컨버터의 성능을 저하시키는 문제점이 있다.As a result, when a binary conversion is performed using a 1-of-n code in which a bubble is generated, a malfunction occurs in the binary conversion, resulting in a decrease in the monotonic property and deteriorating the performance of the flash analog to digital converter.
상기와 같은 문제점을 해결하기 위한 본 발명의 목적은, 비교부의 온도계 코 드에 발생되는 버블의 특성에 따라 버블을 용이하게 제거하는 엔코더를 제공하는데 있다.An object of the present invention for solving the above problems is to provide an encoder that easily removes bubbles in accordance with the characteristics of the bubbles generated in the thermometer code of the comparator.
또한, 본 발명의 다른 목적은 비교부의 온도계 코드에 발생되는 버블의 특성에 따라 버블을 용이하게 제거하여 플래쉬 아날로그 디지털 컨버터의 성능을 향상시키는데 있다.In addition, another object of the present invention is to improve the performance of the flash analog to digital converter by easily removing the bubbles in accordance with the characteristics of the bubbles generated in the thermometer code of the comparator.
상기 과제를 달성하기 위한 본 발명은 기준전압을 분배하여 출력하는 기준전압 발생부; 분배된 기준전압과 외부로부터 입력되는 아날로그 입력전압을 각각 비교 증폭하여 출력하는 비교부; 및 비교부의 출력을 온도계 코드로 변환하고, 온도계 코드를 이진코드로 변환시켜 출력하되, 비교부의 출력에 발생한 버블을 제거하여 출력하는 엔코더를 포함하고, 엔코더는 비교부의 출력코드의 "0"과 "1" 사이의 버블을 보정하는 제 1차 버블제거부; 및 제 1차 버블 제거부의 출력코드의 "1"과 "1"의 배열 중에 발생된 버블을 제거하는 제 2차 버블제거부를 포함하여 구성함을 특징으로 한다.The present invention for achieving the above object is a reference voltage generator for distributing and outputting a reference voltage; A comparison unit for comparing and amplifying each of the divided reference voltage and the analog input voltage input from the outside and outputting them; And an encoder for converting the output of the comparator to a thermometer code, and converting the thermometer code to a binary code and outputting the same, removing the bubbles generated at the output of the comparator, and outputting the encoder. A first bubble removing unit configured to correct bubbles between 1 "; And a secondary bubble removing unit for removing bubbles generated during the arrangement of "1" and "1" of the output code of the primary bubble removing unit.
상술한 목적 및 기타의 목적과 본 발명의 특징 및 이점은 첨부도면과 관련한 다음의 상세한 설명을 통해 보다 분명해질 것이다.The above and other objects and features and advantages of the present invention will become more apparent from the following detailed description taken in conjunction with the accompanying drawings.
이하, 첨부된 도면을 참조하여 본 발명의 실시예를 상세히 설명하면 다음과 같다.Hereinafter, exemplary embodiments of the present invention will be described in detail with reference to the accompanying drawings.
도 4는 본 발명의 실시예에 따른 플래쉬 아날로그 디지털 컨버터의 구성도이다.4 is a configuration diagram of a flash analog to digital converter according to an embodiment of the present invention.
플래쉬 아날로그 디지털 컨버터는 기준전압 발생부(100), 비교부(200), 및 엔코더(300)를 구비한다.The flash analog to digital converter includes a
기준전압 발생부(100)는 기준전압 VREF과 접지전압 VSS 사이에 복수개의 저 항 R1 내지 R2m을 직렬연결하여, 기준전압 VREF을 분배하여 출력한다.The
비교부(200)는 기준전압 발생부(100)로부터 출력되는 기준전압 VREF과 입력전압 VIN을 비교 증폭한다.The
엔코더(300)는 비교부(200)의 출력을 수신하여, 온도계 코드(thermometer code)를 이진코드(binary code)로 변환시켜 n 비트의 출력신호 OUT를 출력한다. 이때, 엔코더(300)는 비교기의 출력의 버블이 발생하면 버블을 제거한 후 이진코드로 변환시켜 출력한다.The
도 5를 참조하여, 엔코더(300)를 더욱 상세히 설명하기로 한다.5, the
엔코더(300)는 제 1차 버블 제거부(301) 및 제 2차 버블 제거부(302)로 구성된다.The
제 1차 버블 제거부(301)는 "0"과 "1" 사이의 버블을 제거한다. 이를 위해, 제 1차 버블 제거부(301)는 복수개의 앤드게이트 및 오아게이트로 구성되어, 비교부(200)의 복수개의 출력을 논리연산하여 출력한다.The primary
제 2차 버블제거부(302)는 온도계 코드의 "1"의 연속된 배열 중에 발생된 버블을 제거한다. 이를 위해, 제 2 차 버블제거부(301)는 복수개의 앤드게이트로 구성되어 제 1차 버블 제거부(301)의 복수개의 출력을 논리연산하여 출력한다.The secondary
이하, 본 발명의 실시예에 따른 엔코더의 동작 및 작용을 설명하기로 한다.Hereinafter, the operation and operation of the encoder according to an embodiment of the present invention will be described.
예를 들어, 버블이 발생한 비교부(200)의 출력신호 R<7:0>가 "00010111"인 경우, 정상적인 출력은 "00000111", "00001111", "00011111" 중의 하나가 된다.
For example, when the output signal R <7: 0> of the
제 1차 버블제거부(301)는 출력신호 R<7:0> "00010111"를 상기 3가지 경우 중 중간값인 "00001111"로 보정한다. 오류를 보정 시에 너무 급격히 AD 변환값이 증가하거나 감소하면 단조도가 감소하므로 이를 방지하기 위해 정상으로 예측되는 값 중 중간값으로 보정한다. The primary
도 5에서는 하나의 버블을 제거하는 경우를 예로 들고 있으나, 제 1차 버블제거부(302)의 단수를 증가시키면 더 많은 단수의 버블을 제거할 수 있다. 예를들어, 비교부(200)의 출력신호 R<7:0>가 "00100111"인 경우 "1" 사이에 2개의 "0"이 포함된 경우이므로 1차 버블제거부(301)를 두번 통과시키면 "00001111"로 보정된다.In FIG. 5, the case of removing one bubble is taken as an example. However, increasing the number of stages of the first
이렇게 보정된 출력신호 "00001111"를 출력함으로써 버블로 인한 아날로그 디지털 컨버터의 오동작을 방지할 수 있다.By outputting the corrected output signal "00001111", malfunction of the analog-to-digital converter due to the bubble can be prevented.
한편, 제 2차 버블제거부(302)는 비교부(200)의 출력신호 R<7:0>이 "00110111"인 경우, 즉 버블이 "1"의 배열 중에 발생된 경우에 그 버블을 제거하여, 출력신호 Q<7:0>는 "00111111"로 출력된다.On the other hand, the second
[표 1]TABLE 1
표 1은 온도계코드에 버블이 발생한 경우 이를 제거하여 에러를 보정한 후, 이진코드로 변환한 예이다.Table 1 is an example of converting to a binary code after correcting the error by removing the bubble in the thermometer code.
이상에서 살펴본 바와 같이, 비교부의 출력에 발생한 버블의 특성에 맞게 버블을 용이하게 제거함으로써, 단조증가 특성을 증가시키고, 플래쉬 아날로그 디지털 컨버터의 성능을 향상시키는 효과가 있다. As described above, by easily removing the bubbles in accordance with the characteristics of the bubbles generated at the output of the comparator, there is an effect of increasing the monotone increase characteristics, and improve the performance of the flash analog to digital converter.
아울러 본 발명의 바람직한 실시예는 예시의 목적을 위한 것으로, 당업자라면 첨부된 특허 청구범위의 기술적 사상과 범위를 통해 다양한 수정, 변경, 대체 및 부가가 가능할 것이며, 이러한 수정 변경 등은 이하의 특허 청구범위에 속하는 것으로 보아야 할 것이다.In addition, a preferred embodiment of the present invention is for the purpose of illustration, those skilled in the art will be able to various modifications, changes, replacements and additions through the spirit and scope of the appended claims, such modifications and changes are the following claims It should be seen as belonging to a range.
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KR1020040027057A KR100587969B1 (en) | 2004-04-20 | 2004-04-20 | Flash analog digital converter |
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Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
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US10466279B2 (en) | 2016-04-18 | 2019-11-05 | Lsis Co., Ltd. | Analog signal detecting circuit for processing an analog signal for monitoring by discriminating the normal signal from noise |
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2004
- 2004-04-20 KR KR1020040027057A patent/KR100587969B1/en active IP Right Grant
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Publication number | Priority date | Publication date | Assignee | Title |
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US10466279B2 (en) | 2016-04-18 | 2019-11-05 | Lsis Co., Ltd. | Analog signal detecting circuit for processing an analog signal for monitoring by discriminating the normal signal from noise |
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