KR100469344B1 - 전계발광 디스플레이 패널 및 그의 구동방법 - Google Patents

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KR100469344B1
KR100469344B1 KR10-2001-0067155A KR20010067155A KR100469344B1 KR 100469344 B1 KR100469344 B1 KR 100469344B1 KR 20010067155 A KR20010067155 A KR 20010067155A KR 100469344 B1 KR100469344 B1 KR 100469344B1
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이한상
박준규
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엘지.필립스 엘시디 주식회사
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Abstract

본 발명은 전 프레임 동작 후, 현 프레임 동작 전, 일정 구간동안 전 프레임에서의 커패시터를 초기화하면서 전계발광부의 발광을 방지함으로써, 화면상의 블러링(blurring) 현상을 제거할 수 있는 전계발광 디스플레이 패널 및 그의 구동방법에 관한 것으로, 교차 배치되는 복수 개의 게이트 라인 및 소오스 라인에 의해 정의되는 각각의 단위픽셀을 이루는 전계발광 디스플레이 패널에 있어서, 상기 각각의 단위픽셀은, 상기 게이트 라인의 활성화신호에 온되어 데이터 신호를 스위칭하는 제 1 스위칭부와, 상기 제 1 스위칭부가 온되는 동안에 상기 제 1 스위칭부를 통해 전달된 데이터 전압을 저장하는 커패시터와, 적어도 2개의 트랜지스터의 게이트단이 상기 커패시터에 직접 연결되어 상기 제 1 스위칭부가 오프되는 동안에 상기 커패시터에 저장된 전압에 의해 전원전압을 스위칭하는 전류미러부와, 상기 전류미러부를 통한 전원전압에 의해 빛을 발광시키는 전계발광부와, 현 프레임 동작 전, 전단 게이트 라인의 활성화신호에 의해 전 프레임의 상기 커패시터에 저장되어 있는 전하를 방전시켜, 상기 전계발광부를 일정 시간 오프(OFF) 시키는 발광억제부를 포함하는 것을 특징으로 한다.

Description

전계발광 디스플레이 패널 및 그의 구동방법{ELECTROLUMINESCENT DISPLAY PANEL AND METHOD FOR OPERATING THE SAME}
본 발명은 전계발광 디스플레이 패널(Electroluminescent Display Panel)에 관한 것으로, 보다 구체적으로는 전계 발광 소자의 동작을 제어하여 고해상도 디스플레이를 구현할 수 있는 전계발광 디스플레이 패널 및 그의 구동방법에 관한 것이다.
전계발광(Electroluminescen) 소자는 액정표시소자(LCD)와 같은 수광형태의 소자에 비하여 응답속도가 빠르고, 자체발광 형태이므로 휘도가 우수하며, 구조가 간단하여 생산시 제조가 용이하고, 경량박형의 장점을 가지고 있어 차세대 평판 디스플레이 소자로 주목받고 있다. 이러한 전계발광 소자는 LCD 백라이트, 휴대용 단말기, 자동차 항법 시스템(CNS, Car Navigation System), 노트북 컴퓨터 및 벽걸이용 TV 까지 그 용도가 다양하다.
상기 전계 발광 디스플레이는 사용하는 재료에 따라 무기 발광 소자와 유기 발광 소자로 크게 나뉘어지는데, 이중 유기 발광 소자는 전자 주입 전극과 정공 주입 전극 사이에 형성된 유기 박막층에 전하를 주입하면 전자와 정공이 쌍을 이룬 후 소멸하면서 빛을 내는 소자이고, 무기 발광 소자는 높은 전계에 의해 가속된 전자가 발광체에 충돌, 여기시키고, 여기된 발광체가 기저 상태로 떨어지면서 발광하는 소자이다.
이하, 첨부된 도면을 참조하여 종래의 전계발광 디스플레이 패널을 설명하면 다음과 같다.
도 1은 종래의 전계발광 디스플레이 패널의 단위 픽셀의 회로도를 도시한 것이다.
도시된 바와같이, 전계 발광 디스플레이 패널의 단위 픽셀은 소오스 라인(SL)에 직렬 연결되어 게이트 라인(GL)에 인가되는 신호에 의해 제어되어 데이터 신호를 스위칭하는 제 1, 제 2 스위칭 소자(11)(13)와, 제 1 단자가 상기 제 2 스위칭 소자(13)의 출력단에 연결되고 제 2 단자는 전원전압단(Vdd)에 연결되어 제 1, 제 2 스위칭 소자(11,13)를 통해 전달된 데이터 전압을 충전하는 커패시터(15)와, 상기 제 1 스위칭 소자(11)의 출력단과 상기 커패시터(15)의 제 2 단자 사이에 연결되며 상기 커패시터(15)의 제 1 단자에 유기된 전압에 의해 제어되는 제 3 스위칭 소자(17)와, 상기 전원전압단(Vdd)과 전계 발광 소자(20) 사이에 연결되어 상기 커패시터의 제 1 단자에 유기된 전압에 의해 스위칭되는 제 4 스위칭 소자(19)로 구성된다. 여기서, 상기 제 1 내지 제 4 스위칭 소자는 PMOS 트랜지스터로 구성된다.
상기 구성을 갖는 종래의 전계발광 디스플레이 패널의 동작을 설명하면 다음과 같다.
단위 픽셀에서 게이트 라인(GL)에 활성화 신호를 인가하고, 소오스 라인(SL)에 싱크 전류를 흘리면 커패시터(15)에서는 상기 신호에 해당되는 데이터 전압이제 1, 제 2 스위칭 소자(11,13)를 통해 상기 커패시터(15)에 충전된다. 그 다음, 상기 제 3 스위칭 소자(17)를 통해 흐르는 전류에 상응하는 전류가 제 4 스위칭 소자(19)를 통해 전계 발광 소자(20)로 전달되어 전계 발광 소자는 일정시간 빛을 발하게 된다.
이후, 상기 제 1, 제 2 스위칭 소자(11,13)를 제어하는 게이트 신호를 절단하더라도 커패시터(15)에 저장된 데이터 전압이 방전되면서 전계 발광 소자는 계속해서 발광하게 된다.
그러나, 종래 기술에 따른 전계발광 디스플레이 패널은 다음과 같은 문제점이 있었다.
전계발광 디스플레이 패널의 전영역에 배치되는 픽셀 소오스 라인에는 저항 성분이 있고, 또한, 게이트 라인과 소오스 라인 사이에서 기생 캐패시터가 형성되어 있다. 이는 전 프레임 동작 후, 현 프레임에서 소오스 라인(SL)에 적은 양의 싱크 전류가 흐를 경우, 커패시터(15)에 상기 신호에 해당되는 데이터 전압을 저장하는 데에는 오랜 시간이 필요하게 된다. 이에 의해, 도 2에 도시된 바와같이, 전 프레임(1f) 동작 후, 현 프레임(2f) 동작시, 화면상의 블러링(blurring)현상이 발생하여 고해상도의 전계발광 디스플레이 패널을 제작하기가 어려웠다.
따라서, 본 발명은 상기 문제점을 해결하기 위해 안출된 것으로, 현 프레임 동작 전 일정구간에서, 전계 발광 소자를 발광시키는 전 프레임의 커패시터에 저장되어 있는 전하를 방전하도록 하여 상기 전계 발광 소자를 오프(OFF)한 다음, 현프레임에서 적은 양의 싱크 전류가 소오스 라인에 흘러도 커패시터에서 그 신호에 해당하는 데이터 전압을 빠르게 충전하여 디스플레이할 수 있도록 하는 고해상도의 전계발광 디스플레이 패널 및 그의 구동방법을 제공하는 것을 그 목적으로 한다.
도 1은 종래의 전계발광 디스플레이 패널의 단위 픽셀의 회로도.
도 2는 종래의 전계발광 디스플레이 패널의 문제점을 설명하기 위한 타이밍도.
도 3는 본 발명의 제 1 실시예에 따른 전계발광 디스플레이 패널의 회로도.
도 4 및 도 5는 도 3의 동작 타이밍도.
도 6은 본 발명의 제 2 실시예에 따른 회로도.
도 7은 도 6의 동작 타이밍도.
도 8 내지 도 13은 본 발명의 제 3 내지 제 8 실시예에 따른 회로도.
도 14는 본 발명의 제 9 실시예에 따른 전계발광 디스플레이 패널의 단위픽셀을 설명하기 위한 회로도.
도 15는 도 14의 단위 픽셀을 구비하는 전계발광 디스플레이 패널의 전체구성도.
도 16은 도 15의 동작타이밍도.
* 도면의 주요 부분에 대한 부호 설명 *
100, 200 : 제 1 스위칭부 110, 210 : 커패시터
120 : 전류미러부 130, 230 : 전계발광부
140, 240 : 발광억제부 150, 220 : 제 2 스위칭부
상기 목적 달성을 위한 본 발명의 전계발광 디스플레이 패널은, 교차 배치되는 복수 개의 게이트 라인 및 소오스 라인에 의해 정의되는 각각의 단위픽셀을 이루는 전계발광 디스플레이 패널에 있어서, 상기 각각의 단위픽셀은, 상기 게이트 라인의 활성화신호에 온되어 데이터 신호를 스위칭하는 제 1 스위칭부와, 상기 제 1 스위칭부가 온되는 동안에 상기 제 1 스위칭부를 통해 전달된 데이터 전압을 저장하는 커패시터와, 적어도 2개의 트랜지스터의 게이트단이 상기 커패시터에 직접 연결되어 상기 제 1 스위칭부가 오프되는 동안에 상기 커패시터에 저장된 전압에 의해 전원전압을 스위칭하는 전류미러부와, 상기 전류미러부를 통한 전원전압에 의해 빛을 발광시키는 전계발광부와, 현 프레임 동작 전, 전단 게이트 라인의 활성화신호에 의해 전 프레임의 상기 커패시터에 저장되어 있는 전하를 방전시켜, 상기 전계발광부를 일정 시간 오프(OFF) 시키는 발광억제부를 포함하는 것을 특징으로 한다.
또한, 본 발명에 따르면, 교차 배치되는 복수 개의 게이트 라인 및 소오스 라인에 의해 정의되는 각각의 단위픽셀을 이루는 전계발광 디스플레이 패널에 있어서, 상기 각 소오스 라인과 전원전압단 사이에 연결되어 상기 소오스 라인에 인가된 전류원의 데이터 신호를 전압으로 변환하는 제 1 PMOS 트랜지스터를 구비하고, 상기 각 단위픽셀은, 상기 게이트 라인의 활성화 신호에 의해 상기 제 1 PMOS 트랜지스터를 통한 데이터 신호를 스위칭하는 제 1 스위칭부와, 상기 제 1 스위칭부가 온되는 동안에 상기 제 1 스위칭부를 통해 전달된 데이터 전압을 저장하는 커패시터와, 상기 제 1 스위칭부가 온되는 동안 상기 제 1 PMOS 트랜지스터와 전류미러를 형성하고 상기 커패시터에 저장된 전압에 의해 전원전압을 스위칭하는 제 2 스위칭부와, 상기 제 2 스위칭부를 통해 흐르는 전류에 상응하여 소정 시간 발광하는 전계발광부와, 현 프레임 동작 전 일정 구간에서 상기 커패시터의 방전이 수행되도록 하는 인에이블 신호에 의해 전 프레임의 상기 커패시터에 저장되어 있는 전하를 방전시켜, 상기 전계발광부를 일정 시간 오프(OFF)시키는 발광억제부를 포함하여 이루어진 것을 특징으로 한다.
또한, 본 발명의 다른 견지에 의하면, 교차 배치되는 복수 개의 게이트 라인 및 소오스 라인과, 상기 게이트 라인 및 소오스 라인의 교차부위에 형성된 전계발광부와, 상기 전계발광부의 발광을 제어하는 커패시터를 구비하여 각각의 단위 픽셀을 이루는 전계발광 디스플레이 패널의 구동방법에 있어서, 현 프레임 동작 전, 전단 게이트 라인의 활성화 신호에 의해 전 프레임의 커패시터에 저장되어 있는 전하를 방전하여 상기 전계발광부를 오프(OFF)한 다음, 상기 현 프레임 동작시 그에 해당하는 데이터 전압을 충전하여 상기 전계발광부를 발광시키는 것을 특징으로 한다.
이하, 본 발명에 따른 바람직한 실시예를 첨부한 도면을 참조하여 상세히 설명한다.
도 3는 본 발명의 제 1 실시예에 따른 전계발광 디스플레이 패널의 회로도이고, 도 4 및 도 5는 도 3의 동작 타이밍도이며, 도 6은 본 발명의 제 2 실시예에따른 회로도이고, 도 7은 도 6의 동작 타이밍도이며. 도 8 내지 도 13은 본 발명의 제 3 내지 제 8 실시예에 따른 회로도이다.
그리고, 도 14는 본 발명의 제 9 실시예에 따른 전계발광 디스플레이 패널의 단위픽셀을 설명하기 위한 회로도이고, 도 15는 도 14의 단위 픽셀을 구비하는 전계발광 디스플레이 패널의 전체구성도이며, 도 16은 도 15의 동작타이밍도이다.
먼저, 도 3에 도시된 바와같이, 교차 배치되는 복수 개의 게이트 라인(GL) 및 소오스 라인(SL)에 의해 정의되는 각각의 단위픽셀을 제공한다. 도면상에는 하나의 단위픽셀을 도시하였다.
본 발명의 전계발광 디스플레이 패널은 상기 단위픽셀 상에 상기 게이트 라인(GL)에 인가되는 신호에 의해 제어되어 데이터 신호를 스위칭하는 제 1 스위칭부(100)와, 제 1 단자가 상기 제 1 스위칭부의 출력단과 연결되고 제 2 단자는 전원전압단에 연결되어 상기 제 1 스위칭부를 통해 전달된 데이터 전압을 충전하는 커패시터(110)와, 상기 제 1 스위칭부(100)와 상기 커패시터(110)의 타측단자 사이에 적어도 2개의 트랜지스터의 게이트단이 연결되며 상기 제 1 스위칭부(100)가 오프되는 동안에 상기 커패시터에 저장된 전압에 의해 전원전압을 스위칭하는 전류미러부(120)와, 상기 전류미러부(120)를 통한 전원전압에 의해 빛을 발광시키는 전계발광부(130)와, 현 프레임 동작 전, 일정 구간에서 상기 커패시터(110)의 방전이 수행되도록 하는 인에이블 신호를 수신하여 전 프레임의 커패시터에 저장되어 있는 전하를 방전하도록 함으로써, 상기 전계발광부(130)를 상기 일정 구간에서 오프(OFF)시키는 발광억제부(140)를 포함하여 이루어진다.
상기 제 1 스위칭부(100)는 상기 게이트 라인(GL)의 활성화 신호에 따라 스위칭되어 상기 소오스 라인(SL)의 데이터 신호를 스위칭하는 제 1 PMOS 트랜지스터(P1)와 상기 게이트 라인(GL)의 활성화 신호에 따라 스위칭되어 상기 제 1 PMOS 트랜지스터(P1)를 통한 데이터 신호를 스위칭하는 제 2 PMOS 트랜지스터(P2)로 구성되고, 상기 전류미러부(120)는 제 1 PMOS 트랜지스터(P1)의 출력단과 전원전압단(Vdd) 사이에 연결되어 상기 커패시터(110)에 저장된 전압에 의해 스위칭되는 제 3 PMOS 트랜지스터(P3)와, 상기 커패시터(110)에 저장된 전압에 의해 상기 제 3 PMOS 트랜지스터(P3)를 통해 흐르는 전류에 상응하는 전류를 전계발광부(130)로 선택적으로 출력하는 제 4 PMOS 트랜지스터(P4)를 포함하여 이루어진다. 전계발광부(130)는 상기 제 4 PMOS 트랜지스터(P4)의 출력단에 접속하여 이를 통해 흐르는 전류에 상응하여 소정 시간 발광하는 역할을 수행한다.
상기 발광억제부(140)는 바람직하게 PMOS 트랜지스터로 구성된다. 이러한 발광억제부(140)는 커패시터(110)의 제 1 단자와 제 2 단자 사이에서 커패시터(110)와 병렬적으로 연결되어, 상기 복수 개의 게이트 라인에 각각의 활성화 신호 인가 전, 로우(LOW)레벨의 일정 펄스를 인가하도록 하는 발광억제구동부(미도시)에 의해 생성되는 인에이블 신호를 통하여 상기 커패시터(110)의 방전 전압이 전계발광부(130)로 전달되지 못하도록 한다.
상기 구성의 단위 픽셀을 갖는 전계발광 디스플레이 패널의 동작을 타이밍도를 참조하여 설명하면 다음과 같다.
즉, 도 4에 도시된 바와같이, 현 프레임 동작 전, 즉 게이트 신호가 활성화되기 이전에 상기 발광억제구동부(미도시)가 커패시터(110) 양단에 구성된 발광억제부(140)로 소거 신호(E)를 출력하면 전 프레임의 커패시터(110)에 충전된 전압이 완전히 방전되면서 발광억제부(140)에 의해 전계발광부(130)는 더 이상 발광하지 못하게 된다.
그런다음, 현 프레임 동작시, 즉 게이트 라인(GL)에 활성화 신호를 인가한다음, 소오스 라인(SL)에 싱크 전류를 흘리면, 커패시터(110)에서는 상기 신호에 해당되는 데이터 전압을 제 1, 제 2 PMOS 트랜지스터(P1)(P2)를 통해 상기 커패시터(110)에 충전시킨 후, 상기 제 3 PMOS 트랜지스터(P3)를 통해 흐르는 전류에 상응하는 전류가 제 4 PMOS 트랜지스터(P4)를 통해 전계발광부(130)로 전달되게 하여 전계발광부(130)가 일정시간 빛을 발하게 한다.
여기서, 상기 전계발광부(130)가 발광하기 시작한 시점에서부터 다음 프레임 전의 소거 신호가 출력될 때까지의 시간을 t1이라고 가정할 경우, 상기 t1을 조정하는 것에 의해 전계발광부(130)의 발광 시간을 조절할 수가 있다.
상기 동작에 의해 도 5에 도시된 바와같이, 전 프레임(1f) 동작 후, 현 프레임(2f) 동작 전, 일정 구간동안 전 프레임(1f)에서의 커패시터(110)에 저장되어 있는 데이터 전압을 완전히 방전하여 전계발광부(130)의 발광을 방지함으로써, 화면상의 블러링(blurring) 현상을 제거할 수 있다.
그 다음, 도 6은 본 발명에 따른 제 2 실시예를 도시한 것으로, 발광억제부(140)의 인에이블 신호인 소거 신호(E)가 복수 개의 게이트 라인(GL(N)) 중 전 단의 게이트 라인(GL(N-1))에 의해 활성화되는 신호인 것을 특징으로 한다. 이는 도 4에서 설명된 발광억제부(140)를 제어하는 발광억제구동부(미도시)가 필요치 않고, 자체적으로 발광억제부(140)를 제어하여 커패시터(110)를 초기화한다.
이에 대한 동작을 도 7을 참조하여 설명하면 다음과 같다.
도시된 바와같이, 전 단의 게이트 라인(GL(N-1))이 활성화되면 상기 라인에 연결된 화소에 비디오 신호가 저장된다. 그 다음, 게이트 라인(GL(N))에 연결된 화소는 발광억제부(140)를 구동시켜 도 4에서 설명된 바와같이, 전 프레임의 커패시터(110)에 저장된 데이터 전압을 완전히 방전하여 초기화시킨다. 그 다음, 게이트 라인(GL(N))이 활성화되고 소오스 라인(SL)을 통해 싱크 전류가 흐르면, 이에 해당하는 데이터 전압이 제 1, 제 2 PMOS 트랜지스터(P1)(P2)를 통해 상기 커패시터(110)에 충전시킨 후, 상기 제 3 PMOS 트랜지스터(P3)를 통해 흐르는 전류에 상응하는 전류가 제 4 PMOS 트랜지스터(P4)를 통해 전계발광부(130)로 전달되게 하여 전계발광부(130)가 일정시간 빛을 발하게 한다.
도 8은 본 발명에 따른 제 3 실시예를 설명하기 위한 회로도이다. 이에 대한 동작 타이밍도는 도 4와 동일하다.
도시된 바와같이, 상기 발광억제부(140)는 상기 제 2 PMOS 트랜지스터(P2)의 출력단과 제 4 PMOS 트랜지스터(P4)의 출력단 사이에 접속되어 있다. 이는 현 프레임 동작 전, 즉 게이트 신호가 활성화되기 이전에 상기 발광억제구동부(미도시)가 커패시터(110) 양단에 구성된 발광억제부(140)로 소거 신호(E)를 출력하면 발광억제부(140)가 구동하여 전 프레임의 커패시터에 저장된 데이타 전압을 제 4 PMOS 트랜지스터(P4)의 문턱전압 근처의 값으로 초기화함으로써, 전계발광부(130)가 발광하지 못하게 한다.
그런다음, 현 프레임 동작시, 즉 게이트 라인(GL)에 활성화 신호를 인가한 다음, 소오스 라인(SL)에 싱크 전류를 흘리면, 상기 설명된 바와같이, 소오스 라인에 흐르는 싱크 전류에 따라 커패시터(110)에 데이터 전압이 충전되고, 그 이후에 전계발광부(130)가 일정시간 동안 발광하게 된다.
도 9는 본 발명의 제 4 실시예를 설명하기 위한 회로도이다. 이에 대한 동작타이밍도는 도 7과 동일하다.
도시된 바와같이, 본 발명의 제 4 실시예는 도 6과 도 8에 설명된 실시예를 조합한 것이다. 즉, 상기 발광억제부(140)는 상기 제 2 PMOS 트랜지스터(P2)의 출력단과 제 4 PMOS 트랜지스터(P4)의 출력단 사이에 접속되고, 발광억제부(140)의 인에이블 신호인 소거 신호(E)가 복수 개의 게이트 라인(GL(N)) 중 전 단의 게이트 라인(GL(N-1))에 의해 활성화되는 신호인 것을 특징으로 한다.
도 10 내지 도 13은 상술된 제 1 내지 제 4 실시예로 구성된 전계발광 디스플레이 패널상에 전류미러부(120)의 제 4 PMOS 트랜지스터(P4)와 전계발광부(130) 사이를 스위칭하고, 발광억제부(140)를 구동시키는 인에이블 신호를 수신하는 제 2 스위칭부(150)를 더 포함하여 구성하는 제 5 내지 제 8 실시예를 도시한 것이다. 상기 제 2 스위칭부(150)는 바람직하게 NMOS 트랜지스터로 형성되어 발광억제부(140)가 구동할 때에는 턴 오프되고, 발광억제부(140)가 구동하지 않을 때는 턴 온되어, 전계발광부(130)를 좀 더 효과적으로 제어할 수가 있다.
도 14는 본 발명의 전계발광 디스플레이 패널의 단위픽셀을 설명하기 위한 제 9 실시예에 따른 회로도이다.
도시된 바와같이, 교차 배치되는 복수 개의 게이트 라인(GL) 및 소오스 라인(SL)에 의해 정의되는 각각의 단위픽셀을 이루는 전계발광 디스플레이 패널에 있어서, 상기 각각의 단위픽셀상의 게이트 라인(GL)에 인가되는 신호에 의해 제어되어 데이터 신호를 스위칭하는 제 1 스위칭부(200)와, 제 1 단자가 제 1스위칭부(200)의 출력단과 연결되고 제 2 단자는 전원전압단(Vdd)에 연결되어 제 1 스위칭부(200)를 통해 전달된 데이터 전압을 충전하는 커패시터(210)와, 상기 커패시터(210)의 제 1 단자에 유기된 전압에 의해 제어되는 제 2 스위칭부(220)와, 상기 제 2 스위칭부(220)의 출력단에 접속하여 이를 통해 흐르는 전류에 상응하여 소정 시간 발광하는 전계발광부(230)와, 현 프레임 동작 전 일정 구간에서 상기 커패시터의 방전이 수행되도록 하는 인에이블 신호를 수신하여 전 프레임의 커패시터에 저장되어 있는 전하를 방전하도록 함으로써, 전계발광부(230)를 상기 일정 구간에서 오프(OFF)시키는 발광억제부(240)를 포함한다. 이때, 상기 제 1 스위칭부(200) 및 제 2 스위칭부(220)는 각각 제 2, 제 3 PMOS 트랜지스터(PM2)(PM3)로 구성된다.
상기 구성을 갖는 각각의 단위픽셀로 이루어지는 전계발광 디스플레이 패널은 도 15에 도시된 바와같이, 복수 개의 소오스 라인(SL) 각각에 하나씩 상기 제 1 스위칭부(200)의 입력단과 전원전압단(Vdd) 사이에 연결되고, 제 1 스위칭부(200)의 출력단이 게이트 단에 접속되는 제 1 PMOS 트랜지스터(PM1)를 더 포함하여 상기 제 1 PMOS 트래지스터를 통해 흐르는 전류에 상응하는 전류를 상기 제 2 스위칭부(220)로 출력하여 전계발광부(230)를 선택적으로 발광시킨다. 이는 소오스 라인(SL)을 공동으로 제 1 PMOS 트랜지스터(PM1)와 조합하여 전류미러를 형성함으로써, 상술된 제 1 내지 제 8 실시예의 단위픽셀에 각각 구비되는 전류미러부를 제거하여 레이아웃 면적을 확보할 수 있다.
도 16은 도 15의 전계발광 디스플레이 패널의 동작 타이밍도로서, 도시된 바와같이, 복수 개의 게이트 신호(GL)가 차례로 활성화되기 이전에, 캐패시터(210)양단에 구성된 발광억제부(240)에 소거 신호(E)를 각각 입력하여 전계발광부(230)를 제어한다. 이에 대한 구체적인 설명은 제 1 실시예에서 설명된 도 4의 동작타이밍도와 동일하다.
이와같은 구성을 갖는 전계발광 디스플레이 패널은, 도면에는 도시하지 않았지만, 상기 상술된 제 2 내지 제 8 실시예를 상기 제 9 실시예에 적용하여 여러가지의 다른 실시예를 형성할 수 있다.
한편, 이상에서 설명한 본 발명은 상술한 실시예 및 첨부된 도면에 한정되는 것이 아니고, 본 발명의 기술적 사상을 벗어나지 않는 범위내에서 여러 가지 치환, 변형 및 변경이 가능하다는 것이 본 발명이 속하는 기술분야에서 통상의 지식을 가진 자에게 있어 명백할 것이다.
상술한 본 발명에 따른 전계발광 디스플레이 패널 및 그의 구동방법에 의하면 다음과 같은 효과가 있다.
전 프레임(1f) 동작 후, 현 프레임(2f) 동작 전, 일정 구간동안 전 프레임(1f)에서의 커패시터(110)를 초기화하면서 전계발광부(130)의 발광을 방지함으로써, 화면상의 블러링(blurring) 현상을 제거할 수 있고, 현 프레임에서 적은 양의 싱크 전류가 소오스 라인에 흘러도 커패시터(110)(210)에서 그 신호에 해당하는 데이터 전압을 빠르게 충전할 수 있어 고해상도의 전계발광 디스플레이 패널을 제작할 수 있다.
또한, 제 9 실시예에서와 같이 복수 개의 소오스 라인(SL) 각각에 하나씩 제1 PMOS 트랜지스터(PM1)를 더 포함하여 소오스 라인(SL)을 공동으로 제 1 PMOS 트랜지스터(PM1)와 조합하여 전류미러를 형성함으로써, 단위픽셀 구조를 단순하게 제작하여 레이아웃 면적 확보 및 수율 향상이 가능하다.

Claims (23)

  1. 교차 배치되는 복수 개의 게이트 라인 및 소오스 라인에 의해 정의되는 각각의 단위픽셀을 이루는 전계발광 디스플레이 패널에 있어서,
    상기 각각의 단위픽셀은,
    상기 게이트 라인의 활성화신호에 온되어 데이터 신호를 스위칭하는 제 1 스위칭부와,
    상기 제 1 스위칭부가 온되는 동안에 상기 제 1 스위칭부를 통해 전달된 데이터 전압을 저장하는 커패시터와,
    적어도 2개의 트랜지스터의 게이트단이 상기 커패시터에 직접 연결되어 상기 제 1 스위칭부가 오프되는 동안에 상기 커패시터에 저장된 전압에 의해 전원전압을 스위칭하는 전류미러부와,
    상기 전류미러부를 통한 전원전압에 의해 빛을 발광시키는 전계발광부와,
    현 프레임 동작 전, 전단 게이트 라인의 활성화신호에 의해 전 프레임의 상기 커패시터에 저장되어 있는 전하를 방전시켜, 상기 전계발광부를 일정 시간 오프(OFF) 시키는 발광억제부를 포함하는 것을 특징으로 하는 전계발광 디스플레이 패널.
  2. 제 1항에 있어서,
    상기 제 1 스위칭부는 상기 게이트 라인의 활성화 신호에 따라 스위칭되어 상기 소오스 라인의 데이터 신호를 스위칭하는 제 1 PMOS 트랜지스터와, 상기 게이트 라인의 활성화 신호에 따라 스위칭되어 상기 제 1 PMOS 트랜지스터를 통한 데이터 신호를 스위칭하는 제 2 PMOS 트랜지스터를 구비하여 구성되는 것을 특징으로 하는 전계발광 디스플레이 패널.
  3. 제 2항에 있어서,
    상기 전류미러부는 상기 제 2 PMOS 트랜지스터의 출력단과 전원전압단 사이에 연결되어 상기 커패시터에 저장된 전압에 의해 스위칭되는 제 3 PMOS 트랜지스터와,
    상기 커패시터에 저장된 전압에 의해 상기 제 3 PMOS 트랜지스터를 통해 흐르는 전류에 상응하는 전류를 상기 전계발광부로 선택적으로 출력하는 제 4 PMOS 트랜지스터를 포함하는 것을 특징으로 하는 전계발광 디스플레이 패널.
  4. 제 3항에 있어서,
    상기 전계발광부는 상기 제 4 PMOS 트랜지스터의 출력단에 접속하여 이를 통해 흐르는 전류에 상응하여 소정 시간 발광하는 것을 특징으로 하는 전계발광 디스플레이 패널.
  5. 제 1항에 있어서,
    상기 발광억제부는 상기 커패시터와 병렬로 연결되는 것을 특징으로 하는 전계발광 디스플레이 패널.
  6. 제 1항에 있어서,
    상기 발광억제부는 상기 제 1 스위칭부와 상기 전류미러부 사이에 연결되는 것을 특징으로 하는 전계발광 디스플레이 패널.
  7. 제 3항에 있어서,
    상기 발광억제부는 상기 제 2 PMOS 트랜지스터의 출력단과 상기 제 4 PMOS 트랜지스터의 출력단 사이에 접속되는 것을 특징으로 하는 전계발광 디스플레이 패널.
  8. 제 1항에 있어서,
    상기 발광억제부는 PMOS 트랜지스터로 구성되는 것을 특징으로 하는 전계발광 디스플레이 패널
  9. 삭제
  10. 삭제
  11. 제 1항에 있어서,
    상기 전단의 게이트 활성화 신호에 의해 상기 전류미러부와 전계발광부 사이를 스위칭하는 제 2 스위칭부를 더 포함하는 것을 특징으로 하는 전계발광 디스플레이 패널.
  12. 제 11항에 있어서,
    상기 제 2 스위칭부는 NMOS 트랜지스터로 구성되는 것을 특징으로 하는 전계발광 디스플레이 패널.
  13. 교차 배치되는 복수 개의 게이트 라인 및 소오스 라인에 의해 정의되는 각각의 단위픽셀을 이루는 전계발광 디스플레이 패널에 있어서,
    상기 각 소오스 라인과 전원전압단 사이에 연결되어 상기 소오스 라인에 인가된 전류원의 데이터 신호를 전압으로 변환하는 제 1 PMOS 트랜지스터를 구비하고,
    상기 각 단위픽셀은,
    상기 게이트 라인의 활성화 신호에 의해 상기 제 1 PMOS 트랜지스터를 통한 데이터 신호를 스위칭하는 제 1 스위칭부와,
    상기 제 1 스위칭부가 온되는 동안에 상기 제 1 스위칭부를 통해 전달된 데이터 전압을 저장하는 커패시터와,
    상기 제 1 스위칭부가 온되는 동안 상기 제 1 PMOS 트랜지스터와 전류미러를 형성하고 상기 커패시터에 저장된 전압에 의해 전원전압을 스위칭하는 제 2 스위칭부와,
    상기 제 2 스위칭부를 통해 흐르는 전류에 상응하여 소정 시간 발광하는 전계발광부와,
    현 프레임 동작 전 일정 구간에서 상기 커패시터의 방전이 수행되도록 하는 인에이블 신호에 의해 전 프레임의 상기 커패시터에 저장되어 있는 전하를 방전시켜, 상기 전계발광부를 일정 시간 오프(OFF)시키는 발광억제부를 포함하여 이루어진 것을 특징으로 하는 전계발광 디스플레이 패널.
  14. 삭제
  15. 제 13항에 있어서,
    상기 제 1 스위칭부 및 상기 제 2 스위칭부는 각각 제 2, 제 3 PMOS 트랜지스터로 구성되는 것을 특징으로 하는 전계발광 디스플레이 패널.
  16. 제 13항에 있어서,
    상기 발광억제부는 상기 커패시터와 병렬로 연결되는 것을 특징으로 하는 전계발광 디스플레이 패널.
  17. 제 13항에 있어서,
    상기 발광억제부는 상기 제 1 스위칭부의 출력단과 상기 제 2 스위칭부의 출력단 사이에 접속되는 것을 특징으로 하는 전계발광 디스플레이 패널.
  18. 제 13항에 있어서,
    상기 발광억제부는 PMOS 트랜지스터로 구성되는 것을 특징으로 하는 전계발광 디스플레이 패널
  19. 제 13항에 있어서,
    상기 인에이블 신호는 상기 복수 개의 게이트 라인에 각각의 활성화 신호 인가 전, 로우(LOW)레벨의 일정 펄스를 인가하도록 하는 발광억제구동부에 의해 생성되는 것을 특징으로 하는 전계발광 디스플레이 패널.
  20. 제 13항에 있어서,
    상기 인에이블 신호는 상기 복수 개의 게이트 라인 중 전단 게이트 라인의 활성화 신호임을 특징으로 하는 전계발광 디스플레이 패널.
  21. 제 18항에 있어서,
    상기 인에이블 신호에 의해 상기 제 2 스위칭부와 상기 전계발광부 사이를 스위칭하는 제 3 스위칭부를 더 포함하는 것을 특징으로 하는 전계발광 디스플레이 패널.
  22. 제 21항에 있어서,
    상기 제 3 스위칭부는 NMOS 트랜지스터로 구성되는 것을 특징으로 하는 전계발광 디스플레이 패널.
  23. 교차 배치되는 복수 개의 게이트 라인 및 소오스 라인과, 상기 게이트 라인 및 소오스 라인의 교차부위에 형성된 전계발광부와, 상기 전계발광부의 발광을 제어하는 커패시터를 구비하여 각각의 단위 픽셀을 이루는 전계발광 디스플레이 패널의 구동방법에 있어서,
    현 프레임 동작 전, 전단 게이트 라인의 활성화 신호에 의해 전 프레임의 커패시터에 저장되어 있는 전하를 방전하여 상기 전계발광부를 오프(OFF)한 다음, 상기 현 프레임 동작시 그에 해당하는 데이터 전압을 충전하여 상기 전계발광부를 발광시키는 것을 특징으로 하는 전계발광 디스플레이 패널의 구동방법.
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