KR0166274B1 - Receiver of a frequency hopping system - Google Patents
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Abstract
본 발명은 주파수 호핑 시스템의 수신장치에 관한 것으로, 수신안테나(20)를 통해 수신된 신호를 디호핑(dehopping)시켜 출력하는 주파수 디호핑부(22)와; 상기 주파수 디호핑부(22)에서 출력된 신호를 복조하여 출력하는 복조부(24); 상기 복조부(24)에서 출력된 신호의 각 호프의 빈중에서 가장 작은 빈을 1로 설정하고, 파워가 큰 순서대로 1씩 증가시켜 모든 빈의 등급을 설정하는 랭크처리부(25) 및; 상기 랭크처리부(25)에서 출력된 신호를 모듈러 뺄셈함과 더불어 모듈러 뺄셈된 신호에 대해 각 호프의 동일 순서의 빈에 설정된 등급을 가산하여 가장 큰 값을 가지는 빈을 데이타 심벌이 담간 빈으로 결정하여 출력하는 소스 디코더(28)로 출력하는 모듈러 뺄셈부(26)를 포함하여 구성되어, 페이딩 현상에 의해 수신 성능이 저하되는 것을 방지할 수 있는 것이다.The present invention relates to a receiving apparatus of a frequency hopping system, comprising: a frequency dehopping unit (22) for dehopping and outputting a signal received through a receiving antenna (20); A demodulator (24) for demodulating and outputting the signal output from the frequency de-hopping unit (22); A rank processing unit 25 for setting the smallest bin among the bins of each hop of the signal output from the demodulator 24 to 1, and setting the class of all bins by increasing the power by 1 in order of increasing power; In addition to modular subtraction of the signal output from the rank processing unit 25, the modular subtraction signal is added to the bins of the same order of each hop, and the bin having the largest value is determined as the bin containing the data symbol. It includes a modular subtraction section 26 output to the output source decoder 28 to output, it is possible to prevent the reception performance is deteriorated by the fading phenomenon.
Description
제1도는 종래의 주파수 호핑 시스템의 송신장치의 개략적인 블럭도.1 is a schematic block diagram of a transmitter of a conventional frequency hopping system.
제2도는 모듈러(modulo) 덧셈 및 모듈러 뺄셈을 하기 위한 코더(coder)를 도시한 것이고,2 shows a coder for modulo addition and modular subtraction,
제3도는 모듈러 덧셈을 수행하기 전의 데이타 심벌을 도시한 것이며,3 shows data symbols before performing modular addition,
제4도는 제2도에 도시된 코더를 사용하여 제3도에 도시된 데이타 심벌을 모듈러 덧셈한 결과를 도시한 것이고,4 shows the result of modular addition of the data symbols shown in FIG. 3 using the coder shown in FIG.
제5도는 종래의 주파수 호핑 시스템의 수신장치의 개략적인 블럭도.5 is a schematic block diagram of a receiver of a conventional frequency hopping system.
제6도는 본 발명에 따른 주파수 호핑 시스템의 수신장치를 개략적인 블럭도이다.6 is a schematic block diagram of a receiving apparatus of the frequency hopping system according to the present invention.
* 도면의 주요 부분에 대한 부호의 설명* Explanation of symbols for the main parts of the drawings
20 : 수신 안테나 22 : 주파수디호핑부20: receiving antenna 22: frequency dehopping unit
24 : 복조부 25 : 랭크처리부24: demodulation unit 25: rank processing unit
26 : 모듈러 뺄셈부 28 : 소스 디코더26: modular subtraction unit 28: source decoder
30 : D/A 컨버터30: D / A Converter
본 발명은 확산 스펙트럼 통신 시스템(Spread spectrum communication system)의 하나인 주파수 호핑 시스템( Frequency hopping system)에 관한 것으로, 특히 페이딩 현상에 의해 수신 성능이 저하되는 것을 방지 할 수 있는 주파수 호핑 시스템의 수신 장치에 대한 것이다.BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a frequency hopping system, which is one of spread spectrum communication systems, and more particularly, to a receiving apparatus of a frequency hopping system capable of preventing the reception performance from being degraded due to fading. It is about.
상기와 같이 본 발명은 확산 스펙트럼을 이용한 코드 분할 다중 접속(CDMA : Code Division Multiple Access) 방식의 무선 통신에 적용 가능하며, 향후 코드 분할 다중 접속을 이용한 셀룰라 폰 및 개인 휴대 통신(PCS : Personal Communication services) 방식에도 적용 가능한다.As described above, the present invention is applicable to wireless division of code division multiple access (CDMA) scheme using spread spectrum, and in the future, cellular phones and personal communication services using division of code division multiple access (PCS). It is also applicable to the method.
일반적으로, 확산 스펙트럼 통신 시스템은 군사적 목적으로 연구 사용되어져 왔으며, 현재에는 코드 분할 다중 접속(CDMA : Code Division Multiple Access)방식의 무선 통신에 적용되고 있다.In general, spread spectrum communication systems have been studied and used for military purposes, and are currently applied to wireless communication using code division multiple access (CDMA).
상기 확산 스펙트럼 통신 시스템의 하니인 주파수 호핑 시스템은 전송신호를 한 중심 주파수에서 다른 중심 주파수로 도약시켜 주파수 스펙트럼이 확산되게 한다.The frequency hopping system of the spread spectrum communication system hops the transmission signal from one center frequency to another to spread the frequency spectrum.
이때, 확산 과정은 의사 랜덤 시퀀스로 제어되며 이 과정은 완전히 무작위로 수행되지만, 수신기가 상기 의사 랜덤 시퀀스를 재생하여 수신 신호에 동기시킴으로써 역확산 과정을 수행할 수 있는 것이다.In this case, the spreading process is controlled by a pseudo random sequence, which is performed completely randomly, but the receiver may perform the despreading process by reproducing the pseudo random sequence and synchronizing with the received signal.
그러나, 대역내의 다른 신호의 확산 과정이 희망신호에 대해서 사용하는 확산과 독립적이라면 희망신호의 역확산은 동시에 희망하지 않는 신호를 역확산하며, 이 확산의 직교성 또는 독립은 낮은 상관 관계를 갖는 확산 코드 집단을 선택함으로써 성취될 수 있다.However, if the spreading process of other signals in the band is independent of the spreading used for the desired signal, the despreading of the desired signal at the same time despreads the undesired signal, and orthogonality or independence of the spreading has a low correlation spreading code. This can be accomplished by selecting a group.
즉, 한 신호의 역확산 과정이 과잉코드 일치로 인해 다른 신호의 역확산을 일으키기 않도록 낮은 교차일치 성질을 갖추어야 하는 것이다.In other words, the despreading process of one signal should have a low cross-matching property so that the de-spreading of the other signal is not caused by overcode matching.
한편, 제1도는 종래의 주파수 호핑 시스템의 송신장치의 개략적인 블럭도로서, 입력 신호를 디지탈 신호로 변환시켜 출력하는 A/D 컨버터(2)와; 상기 A/D 컨버터(2)에서 출력된 디지탈 신호를 소스 엔코딩하여 출력하는 소스 엔코도(4); 상기 소스 엔코더(4)에서 출력된 디지탈 신호를 모듈러 덧셈하여 출력하는 모듈러 뎃셈부(6); 상기 모듈러 덧셈부(6)에서 출력된 신호를 변조시켜 출력하는 변조부(8) 및; 상기 변조부(8)에서 출력된 신호를 주파수 호핑시켜 송신안테나(10)를 통해 전송하는 주파수 호핑부(12)를 포함하여 구성되어 있다.1 is a schematic block diagram of a transmitter of a conventional frequency hopping system, comprising: an A / D converter 2 for converting an input signal into a digital signal and outputting the digital signal; A source encoder (4) for source encoding and outputting the digital signal output from the A / D converter (2); A modular multiplier (6) for modularly adding and outputting the digital signal output from the source encoder (4); A modulator (8) for modulating and outputting the signal output from the modular adder (6); And a frequency hopping unit 12 for frequency hopping the signal output from the modulator 8 and transmitting the same through the transmission antenna 10.
상기와 같은 종래의 주파수 호핑 시스템의 송신장에 있어서, 상기 소스 엔코더(4)는 A/D 컨버터(4)로부터 디지탈 신호를 입력받아 디지탈 신호를 압축함과 더불어 전송 패킷으로 형성시켜 출력한다.In the transmission field of the conventional frequency hopping system as described above, the source encoder 4 receives the digital signal from the A / D converter 4, compresses the digital signal, and forms the output signal into a transport packet.
그리고, 상기 모듈러 덧셈부(6)는 상기 소스 엔코더(4)에서 출력 된 데이타 심벌을 모듈러 덧셈하여 출력한다.The modular adder 6 adds and outputs data symbols output from the source encoder 4.
즉, 제2도는 모듈러(modulo) 덧셈 및 모듈러 뺄샘을 하기 위한 코더(corder)를 도시한 것으로, 4개의 빈을 이용하여 8번 주파수 호핑을 할 경우를 도시한 것이다.That is, FIG. 2 shows a coder for modulo addition and modular subtraction, and shows a case where frequency hopping is performed eight times using four bins.
예를 들어, 빈수가 4이고, 주파수 호핑수가 8인 경우에 2번 빈을 통해 데이타 심벌을 전송한다고 하면, 모듈러 뺄셈하기 전의 데이타 심벌은 제3도와 같이 도시된다.For example, if the number of bins is 4 and the frequency hopping number is 8, data symbols are transmitted through bin 2, and the data symbols before modular subtraction are shown in FIG.
즉, 한 채널이 4개의 빈(bin)으로 나누어지고, 1번에서 4번 까지의 빈 중에서 2번째 빈에 전송하고자 하는 데이타 심벌을 담아 8번 주파수 호핑시켜 전송한다.That is, one channel is divided into four bins, and a frequency hopping is performed 8 times containing data symbols to be transmitted in a second bin among the first to fourth bins.
상기 제3도에 도시된 바와같은 데이타 심벌을 상기 제2도에 도시된 코더를 사용하여 모듈러 덧셈을 수행하면 제4도에 도시된 바와 같은 결과를 얻을 수 있다.Modular addition of the data symbols as shown in FIG. 3 using the coder shown in FIG. 2 can result in the results as shown in FIG.
즉, 첫번째 호프에서 두번째 빈에 데이타 심벌이 실리고, 두번째 호프에서는 세번째 빈에 데이타 심벌이 실리며, 세번째 호프에서는 네번째 빈에 데이타 심벌이 실리고, 네번째 호프에서는 첫번째 빈에 데이타 심벌이 실리게 되는 것이다.That is, data symbols are loaded on the second bean in the first hop, data symbols are loaded on the third bean in the second hop, data symbols are loaded on the fourth bean in the third hop, and data symbols are loaded on the first bean in the fourth hop.
상기와 같이 모듈러 덧셈된 데이타 심벌은 변조부(8)에서 변조된 다음 주파수 호핑부(12)에서 주파수 호핑되어 송신 안테나(10)를 통해서 전송되는 것이다.As described above, the modular added data symbols are modulated by the modulator 8 and then frequency-hopped by the frequency hopping unit 12 to be transmitted through the transmission antenna 10.
주파수를 호핑시키는 패턴은 의사 랜덤 시퀀스에 의해 제어되어 완전히 무작위로 수행되며, 수신기는 상기 의사 랜덤 시퀀스를 재생한 다음 의사 랜덤 시퀀스를 수신 신호에 동기시킴으로써 디호핑하여 수신 신호를 기본 주파수 채널로 변환시키는 것이다.The frequency hopping pattern is controlled by a pseudo random sequence and is performed completely randomly, and the receiver regenerates the pseudo random sequence and then dehops by synchronizing the pseudo random sequence to the received signal to convert the received signal into a fundamental frequency channel. will be.
한편, 제5도는 종래의 주파수 호핑 시스템의 수신장치의 개략적인 블럭도로서, 수신안테나(20)를 통해 수신된 신호를 디호핑(dehopping)시켜 출력하는 주파수 디호핑부(22)와; 상기 주파수 디호핑부(22)에서 출력된 신호를 복조하여 출력하는 복조부(24); 상기 복조부(24)에서 복조되어 출력된 신호를 모듈러 뺄셈함과 더불어 각 빈마다 모든 호프의 값을 가산하여 가장 큰 값을 가지는 빈을 데이타 심벌이 담긴 빈으로 결정하여 출력하는 모듈러 뺄셈부(26); 상기 모듈러 뺄셈부(26)에서 출력된 신호를 소스 디코딩하여 출력하는 소스 디코더(28)및; 상기 소스 디코디(28)에서 출력된 신호를 아날로그 신호로 변환시켜 출력하는 D/A 컨버터(30)를 포함하여 구성되어 있다.5 is a schematic block diagram of a receiver of a conventional frequency hopping system, which includes a frequency dehopping unit 22 for dehopping and outputting a signal received through a receiving antenna 20; A demodulator (24) for demodulating and outputting the signal output from the frequency de-hopping unit (22); A modular subtractor 26 which modulates the demodulated signal output by the demodulator 24 and adds the values of all hops to each bin to determine and output the bin having the largest value as a bin containing data symbols. ); A source decoder 28 for source decoding and outputting the signal output from the modular subtraction unit 26; And a D / A converter 30 for converting the signal output from the source decoder 28 into an analog signal and outputting the analog signal.
상기와 같이 구성된 종래의 주파수 호핑 시스템에서의 수신장치에 있어서, 상기 주파수 디호핑부(22)는 여러개의 각각 다른 채널을 통해 송신된 데이타 심벌을 수신하여 동일한 채널로 모아 출력한다.In the receiver of the conventional frequency hopping system configured as described above, the frequency dehopping unit 22 receives and outputs data symbols transmitted through different channels.
그리고, 복조부(24)는 상기 주파수 디호핑부(22)에서 출력된 채널을 복조하여 출력한다.The demodulator 24 demodulates and outputs the channel output from the frequency dehopping unit 22.
따라서, 상기 복조부(24)에서 출력된 신호는 상기 제4도에 도시된 바와 같은 결과를 얻게 된다.Thus, the signal output from the demodulator 24 obtains the result as shown in FIG.
즉, 상기 복조부(24)에서 출력된 신호는 첫번째 호프에서 두번째 빈에 데이타 심벌이 실리고, 두번째 호프에서는 세번째 빈에 데이타 심벌이 실리며, 세번째 호프에서는 네번째 빈에 데이타 심벌이 실리고, 네번째 호프에서는 첫번째 빈에 데이타 심벌이 실려 있는 구조로 된다.That is, the signal output from the demodulator 24 carries a data symbol on the second bin in the first hop, a data symbol on the third bin in the second hop, a data symbol on the fourth bin in the third hop, and a fourth hop on the fourth hop. The first bean contains a data symbol.
그리고, 모듈러 뺄셈부(26)는 상기 복조부(24)에서 출력된 신호를 모듈러 뺄셈함과 더불어 각 빈마다 모든 호프의 값을 가산하여 가장 큰 값을 가지는 빈을 데이타 심벌이 담긴 빈으로 결정하여 출력한다.The modular subtractor 26 modulates the signal output from the demodulator 24 and adds all hop values to each bin to determine the bin having the largest value as the bin containing the data symbols. Output
이때, 상기 모듈러 뺄셈부(26)에서 모듈러 뺄셈된 신호는 상기 제3도에서 도시된 바와 같이, 각 호프의 두번째 빈에 데이타 심벌이 실려 있는 구조로 된다.In this case, the modular subtracted signal in the modular subtractor 26 has a structure in which a data symbol is loaded in the second bin of each hop, as shown in FIG.
상기 모듈러 뺄셈부(26)에서 출력된 신호는 소스 디코더(28)에서 소스 디코딩된 다음 D/A 컨버터(30)에서 아날로그 신호로 변환되어 출력되는 것이다.The signal output from the modular subtractor 26 is source decoded by the source decoder 28 and then converted into an analog signal by the D / A converter 30 and output.
그러나. 이러한 종래의 주파수 호핑 시스템의 수신 장치는, 주변의 건물이나 가옥 또는 지형지물에 의해 직접파와 반사파가 함께 수신되는 다중 경로로 인해 발생되는 페이딩 현상에 의해 큰 노이즈나 간섭이 발생되면 에러율이 큰 문제점이 있었다.But. The reception apparatus of the conventional frequency hopping system has a large error rate when a large noise or interference occurs due to a fading phenomenon caused by a multipath in which direct waves and reflected waves are received together by surrounding buildings, houses, or features. there was.
따라서, 본 발명은 상기와 같은 종래의 문제점을 해소하기 위한 것으로, 페이딩 현상에 의해 수신 성능이 저하되는 것을 방지할 수 있는 주파수 호핑 시스템의 수신장치를 제공하는데 그 목적이 있다.Accordingly, an object of the present invention is to solve a conventional problem as described above, and to provide a receiver of a frequency hopping system that can prevent a reception performance from being degraded due to fading.
이러한 목적을 달성하기 위한 본 발명에 따른 주파수 호핑 시스템에서의 수신장치는, 수신안테나를 통해 수신된 신호를 디호핑시켜 출력하는 주파수 디호핑부와;A receiving device in a frequency hopping system according to the present invention for achieving the above object comprises: a frequency de-hopping unit for de-hopping and outputting a signal received through the receiving antenna;
상기 주파수 디호핑부에서 출력된 신호를 복조하여 출력하는 복조부;A demodulator for demodulating and outputting the signal output from the frequency dehopping unit;
상기 복조부에서 출력된 신호의 각 호프의 빈중에서 파워가 가장 작은 빈을 1로 설정하고, 파워가 큰 순서대로 1씩 증가시켜 모든 빈의 등급을 설정하는 랭크처리부 및;A rank processor configured to set bins having the smallest power to 1 among bins of each hop of the signal output from the demodulator, and set the class of all bins by increasing the power by 1 in order of increasing power;
상기 랭크처리부에서 출력된 신호를 모듈러 뺄셈함과 더불어 모듈러 뺄셈된 신호에 대해 각 호프의 동일 순서의 빈에 설정된 등급을 가산하여 가장 큰 값을 가지는 빈을 데이타 심벌이 담긴 빈으로 결정하여 출력하는 소스 디코더로 출력하는 모듈러 뺄셈부를 포함하여 구성된 것을 특징으로 한다.A source that modulates the signal output from the rank processing unit and adds a grade set to the bins of the same order of each hop to the modular subtracted signal to determine and output the bin having the largest value as a bin containing data symbols. And a modular subtraction unit output to the decoder.
이하, 첨부된 도면을 참조하여 본 발명을 상세히 설명한다.Hereinafter, with reference to the accompanying drawings will be described in detail the present invention.
제6도는 본 발명에 따른 주파수 호핑 시스템의 수신장치를 개략적인 블럭도로서, 수신안테나(20)를 통해 수신된 신호를 디호핑(dehopping)시켜 출력하는 주파수 디호핑부(22)와; 상기 주파수 디호핑부(22)에서 출력된 신호를 복조하여 출력하는 복조부(24); 상기 복조부(24)에서 출력된 신호의 각 호프의 빈중에서 파워가 가장 작은 빈을 1로 설정하고, 파워가 큰 순서대로 1씩 증가시켜 모든 빈의 등급을 설정하는 랭크처리부(25); 상기 랭크처리부(25)에서 출력된 신호를 모듈러 뺄셈함과 더불어 모듈러 뺄셈된 신호에 대해 각 호프의 동일 순서의 빈에 설정된 등급을 가산하여 가장 큰 값을 가지는 빈을 데이타 심벌이 담긴 빈으로 결정하여 출력하는 모듈러 뺄샘부(26); 상기 모듈러 뺄샘부(26)에서 출력된 신호를 소스 디코딩하여 출력하는 소스 디코더(28) 및; 상기 소스 디코더(28)에서 출력된 신호를 아날로그 신호로 변환시켜 출력하는 D/A 컨버터(30)를 포함하여 구성되어 있다.6 is a schematic block diagram of a receiver of a frequency hopping system according to the present invention, comprising: a frequency dehopping unit 22 for dehopping and outputting a signal received through a receiving antenna 20; A demodulator (24) for demodulating and outputting the signal output from the frequency de-hopping unit (22); A rank processor 25 for setting bins having the smallest power to 1 among bins of each hop of the signal output from the demodulator 24, and setting the class of all bins by increasing the power by 1 in order of increasing power; In addition to the modular subtraction of the signal output from the rank processing unit 25, the modular subtraction signal is added to the bins of the same order of each hop to determine the bin having the largest value as the bin containing the data symbols. A modular subtraction part 26 for outputting; A source decoder 28 for source decoding and outputting the signal output from the modular subtractor 26; The D / A converter 30 converts the signal output from the source decoder 28 into an analog signal and outputs the analog signal.
상기와 같이 구성된 종래의 주파수 호핑 시스템에서의 수신장치에 있어서, 상기 주파수 디호핑부(22)는 여러개의 각각 다른 채널을 통해 송신된 데이타 심벌을 수신하여 동일한 채널로 모아 출력한다.In the receiver of the conventional frequency hopping system configured as described above, the frequency dehopping unit 22 receives and outputs data symbols transmitted through different channels.
그리고, 복조부(24)는 상기 주파수 디호핑부(22)에서 출력한 채널을 복조하여 출력한다.The demodulator 24 demodulates and outputs the channel output from the frequency dehopping unit 22.
따라서, 상기 복조부(24)에서 출력된 신호는 상기 제4도에서 도시된 바와 같은 결과를 얻게 된다.Thus, the signal output from the demodulator 24 obtains the result as shown in FIG.
즉, 상기 복조부(24)에서 출력된 신호는 첫번째 호프에서 두번째 빈에 데이타 심벌이 실리고, 두번째 호프에서는 세번째 빈에 데이타 심벌이 실리며, 세번째 호프에서는 네번째 빈에 데이타 심벌이 실리고, 네번째 호프에서는 첫번째 빈에 데이타 심벌이 실려 있는 구조로 된다.That is, the signal output from the demodulator 24 carries a data symbol on the second bin in the first hop, a data symbol on the third bin in the second hop, a data symbol on the fourth bin in the third hop, and a fourth hop on the fourth hop. The first bean contains a data symbol.
그리고, 상기 랭크처리부(25)는 상기 복조부(24)에서 출력된 신호의 각 호프의 빈중에서 파워가 가장 작은 빈을 1로 설정하고, 파워가 큰 순서대로 1씩 증가시켜 모든 빈의 등급을 설정한다.The rank processor 25 sets the bins having the smallest power to 1 among bins of each hop of the signal output from the demodulator 24, and increases the bins by 1 in order of increasing power. Set it.
예를 들어, 상기 복조부(24)에서 제4도에 도시된 바와 같은 신호가 출력되면, 신호의 파워가 가장 큰 것부터 32, 31, ······으로 설정하고, 가장 작은 파워를 가지는 신호를 1로 설정하여 총 4×8 개의 등급을 설정하는 것이다.For example, when the signal as shown in FIG. 4 is output from the demodulator 24, the signal power is set from the largest to 32, 31, ..., and has the smallest power. Setting the signal to 1 sets a total of 4x8 ratings.
그리고 모듈러 뺄셈부(26)는 상기 복조부(24)에서 출력된 신호를 모듈러 뺄셈함 다음 각 호프의 동일 순서의 빈에 설정된 등급을 가산하여 가장 큰 값을 가지는 빈을 데이타 심벌이 담긴 빈으로 결정하여 출력하는 것이다.The modular subtractor 26 modulates the signal output from the demodulator 24, and then adds a grade set to the bins of the same order of each hop to determine the bin having the largest value as the bin containing the data symbols. To print.
이때, 상기 모듈러 뺄셈부(26)에서 모듈러 뺄셈된 신호는 상기 제3도에 도시된 바와 같이, 각 호프의 두번째 빈에 데이타 심벌이 실려 있는 구조로 된다.In this case, the modular subtracted signal from the modular subtractor 26 has a structure in which a data symbol is loaded in the second bin of each hop, as shown in FIG.
따라서, 노이즈가 실려 있다 하더라도 각 호프의 두번째 빈의 등급을 모두 가산한 값이 가장 크므로, 두번째 빈이 데이타 심벌리 담긴 빈으로 결정되어 출력되는 것이다.Therefore, even if noise is present, the second bin of each hop is added with the largest value, so the second bin is determined and output as a bin containing data symbols.
상기 모듈러 뺄셈부(26)에서 출력된 신호는 소스 디코더(28)에서 소스 디코딩된 다음 D/A 컨버터(30)에서 아날로그 신호로 변환되어 출력되는 것이다.The signal output from the modular subtractor 26 is source decoded by the source decoder 28 and then converted into an analog signal by the D / A converter 30 and output.
이상에서 살펴본 바와 같이 본 발명에 따르면, 랭크 처리에 의해 신호가 담긴 빈을 결정함으로써 주변의 건물이나 가옥 또는 지형지물에 의해 직접파와 반사파가 함께 수신되는 다중 경로로 인해 발생되는 페이딩 현상에 의해 큰 노이즈나 간섭이 발생되더라도 에러 발생율을 감소시킬 수 있는 것이다.As described above, according to the present invention, a large noise is generated by a fading phenomenon caused by a multipath in which direct and reflected waves are received together by surrounding buildings, houses, or features by determining a bin containing a signal by rank processing. However, even if interference occurs, the error rate can be reduced.
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| KR20010063114A (en) * | 1999-12-21 | 2001-07-09 | 이형도 | Projector with communication function of wireless local area network |
-
1995
- 1995-12-28 KR KR1019950061411A patent/KR0166274B1/en not_active IP Right Cessation
Also Published As
| Publication number | Publication date |
|---|---|
| KR970055745A (en) | 1997-07-31 |
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