KR0163938B1 - 박막 트랜지스터형 액정표시장치의 구동회로 - Google Patents

박막 트랜지스터형 액정표시장치의 구동회로 Download PDF

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Abstract

이 발명은 박막 트랜지스터형 액정표시장치(TFT LCD : Thin-Film-Transistor Liquid Crystal Display)의 구동회로에 관한 것으로서, 공통전극 전압(Vcom)이 인가되는 액정 패널 상의 소정 위치 전압을 왜곡된 공통전극 전압(DVcom)으로서 감지하는 왜곡신호 감지부와; 상기 왜곡신호 감지부에서 검출되는 왜곡된 공통전극 전압(DVcom)과 외부에서 제공되는 반전된 공통전극 전압(VcomB)을 양단전압으로서 입력받으며, 상기 두 양잔전압 사이의 두 전압(Va, Vb)을 계조기준전압으로서 발생시키는 레벨 시프트부와; 상기 레벨 시프트부에서 생성되는 두 계조 기준전압(Va, Vb)을 소정 수로 분배하며, 상기 전압분배에 의해 얻어지는 소정 수의 전압을 계조전압(VG1∼VG4)으로서 소스 구동부에 출력하는 계조전압 발생부로 구성되어, 액정 패널에서 검출되는 왜곡된 공통전극 전압의 왜곡정도에 비례하는 계조전압을 생성하고, 이를 소스 구동회로를 통해 액정 셀에 인가함으로써 공통전극 전압이 왜곡되더라도 액정 셀에는 항상 동일한 전위차가 인가되도록 하여 크로스 토크 현상을 근본적으로 제거할 수 있다.

Description

박막 트랜지스터형 액정표시장치의 구동회로
제1도는 이 발명의 실시예에 따른 박막 트랜지스터형 액정표시장치 구동회로의 구성 블록도.
제2도는 상기 제1도에 도시된 액정 패널의 일부를 상세하게 도시한 등가 회로도.
제3도는 상기 제1도에 도시된 왜곡신호 감지부를 액정패널 상에 구현하는 예를 개략적으로 도시한 평면도.
제4도는 상기 제3도의 A-A´의 단면도.
제5도는 상기 제1도에 도시된 레벨 시프트부 및 계조전압 발생부를 상세하게 도시한 회로도.
제6도는 상기 제5도의 계조전압 발생부에서 출력되는 계조전압의 일례를 도시한 파형도.
제7도의 (a),(b)는 각각 화이트(white)시 및 블랙(black)시 임의의 한 셀에 인가되는 전압을 도시한 파형도.
제8도는 일반적인 액정 패널의 일부를 도시하는 등가 회로도.
제9도의 (a),(b)는 상기 제8도의 회로에 적용되는 공통전극 인가전압 및 왜곡된 전압을 도시한 파형도.
제10도의 (a),(b)는 상기 제8도의 회로에 적용되는 것으로서 화이트시 및 불랙시 임의의 한 셀에 인가되는 전압을 도시한 파형도이다.
* 도면의 주요부분에 대한 부호의 설명
1 : 액정 패널 2 : 소스 구동부
3 : 게이트 구동부 4 : 타이밍 회로
5 : 왜곡신호 감지부 6 : 레벨 시프트부
7 : 계조전압 발생부
이 발명은 박막 트랜지스터형 액정표시장치(TFT LCD Thin-Film-Transistor Liquid Crystal Display)의 구동회로에 관한 것으로서, 더욱 상세하게 말하자면 공통전극 신호의 왜곡 정도에 비례하는 기준신호를 생성하고, 이 기준신호에 의거하여 계조전압(Gray voltage)이 생성되도록 함으로써 액정 셀(cell)에서 발생하는 크로스토크(crosstalk)를 줄일 수 있는 박막트랜지스터형 액정표시장치의 구동회로에 관한 것이다.
하나의 액정 셀에 하나의 박막 트랜지스터가 대응하도록 구성되며, 소정 수의 셀을 구비한 박막 트랜지스터형 액정표시장치는 콘트라스트(contrast) 비가 크고, 계조표시나 동화면 표시에 적합하며, 풀칼러(full color)화가 용이한 잇점 때문에 여러 종류의 액정표시장치 중에서도 특히 각광받고 있다.
게다가, 화질을 손상시키지 않고 대용량화할 수 있기 때문에 고해상도 텔리비젼(HD TV : High Definition Television)등의 분야에도 적용되고 있다.
그런데, 이러한 박막 트랜지스터형 액정표시장치의 비정상적인 표시특성중에는 크로스 토크 현상이 있다. 크로스 토크 현상이란 화이트(white) 또는 블랙(black)표시가 화면의 일정 영역에 집중적으로 표시될 때, 그 상하 또는 좌우 방향에 위치하는 일부 셀의 계조가 주변의 화이트 또는 블랙 표시 영역의 영향으로 인하여 다른 계조로 표시되는 것을 말한다.
이때, 전자의 것을 수직형 크로스 토크(Vertical Crosstalk)라고 하고, 후자의 것을 수평형 크로스 토크(Horizontal Crosstalk)라고 한다.
수직형 크로스 토크는, 박막 트랜지스터가 전기적으로 충분히 턴오프(Turn off)되지 않을 경우에, 박막 트랜지스터의 소스 단자에 연결된 데이타 라인을 통해 인가되는 원하지 않는 계조전압이 드레인 단자를 거쳐 액정에 전달됨으로써 발생한다. 따라서, 수직형 크로스 토크는 박막 트랜지스터를 충분히 턴오프시켜 주기 위하여 더욱 낮은 오프 전압을 인가하거나, 오프 전류를 최소화하는 박막 트랜지스터의 구조 및 공정적인 조정에 의해 해결될 수 있다.
수평형 크로스 토크는 액정셀들의 공통전극 전위의 변동에 의해 발생하는 것으로서, 인접 액정 셀에 전하를 충전시킬 때 공통전극의 전위가 변동하여 그 영향으로 임의의 한 액정 셀에 정확한 계조 전압이 인가되지 않음으로써 발생한다.
다음으로, 크로스 토크의 발생 메카니즘을 첨부된 도면을 참조하여 보다 상세하게 설명한다.
제8도는 일반적인 액정 패널의 일부를 도시하는 등가 회로도이고,
제9도의 (a),(b)는 상기 제8도의 회로에 적용되는 공통전극 인가전압 및 왜곡된 전압을 도시한 파형도이고,
제10도의 (a),(b)는 상기 제8도의 회로에 적용되는 것으로서 화이트시 및 블랙시 임의의 한 셀에 인가되는 전압을 도시한 파형도이다.
제8도에 도시된 등가 회로는 각 액정 셀에 연결되는 박막 트랜지스터를 생략한 구성이며, 저항(Rcom)은 패널의 저항이고, Clc1,Clc2, 등등은 액정 셀의 커패시턴스(capacitance)이다.
제8도를 참조하면, 일반적인 박막 트랜지스터형 액정표시장치에서는 공통 전극 전압(Vcom)과 박막 트랜지스터를 거쳐 인가되는 계조전압간의 차이가 액정 셀에 인가되며, 액정 셀에 인가되는 전압의 크기에 따라 투과율이 결정됨으로써 셀의 밝기가 결정된다.
일반적으로, 화이트 표시시에는 액정 셀의 양단 전위차가 최소이고 블랙 표시시에 최대가 되므로, 각 액정 셀에 충전되는 전하량은 화이트시에 최소, 블랙시에 최대가 된다. 따라서, 공통전극에 흐르는 전류량도 화이트시에 최소, 블랙 시에 최대가 된다.
이러한 이유로, 표시되는 계조에 따라 공통전극에 흐르는 전류량이 변하게 된다. 제9도의 (a)는 액정 셀의 공통전극에 인가하기 위한 전압의 파형이며, (b)는 화이트 또는 블랙 표시시 공통전극에서 나타나는 전압의 파형이다.
제9도의 (b)를 참조하면, 화이트 시에는 공통전극 전압 파형에 왜곡이 없으나, 블랙 시에는 공통전극 전압 파형에 왜곡이 발생한다. 이것은 패널의 자체 저항이 존재하고, 블랙 시에는 공통전극에 흐르는 전류량이 더 크므로 패널 저항에 의한 전압 강하 성분이 영향을 미치기 때문이다.
제10도의 (a),(b)에는 화이트 및 블랙시 동일한 계조전압이 인가되는 것을 도시하고 있다. 상기 제10도의 (a),(b)에 도시된 바와 같이, 종래의 계조전압은 일정한 크기를 가지는 직류레벨이다.
이에 따라, 인접하는 소정 영역의 액정 셀에 화이트 또는 블랙이 표시되고 그사이의 일부 셀에 다른 것이 표시될 경우, 공통전극 전압의 왜곡으로 인하여 상기 일부 셀에 원하는 크기의 전압이 인가되지 않는다. 즉, 동일한 계조전압이 인가되더라도 액정 셀에 인가되는 전압은 다르게 되어 서로 다른 계조가 표시된다.
제10도의 (a)에 도시된 면적 A는 인접 셀들이 해당 셀과 마찬가지로 화이트를 표시할 경우 공통전극 전압과 계조전압 간의 차이 즉, 액정 양단전압을 도시하고 있으며, 제10도(b)에 도시된 면적 B는 인접셀들이 블랙을 표시할 경우 액정 양단 전압을 도시하고 있다. 상기 제10도의 두 면적 A,B간의 차이가 계조 표시의 차이가 된다.
상기 두 면적의 차이를 줄이기 위하여 패널 저항(Rcom)의 저항값을 줄이기 위해 공정적인 노력이 수행되어 크로스 토크가 상당히 감소되었다. 그러나, 더욱 낮은 크로스 토크 수준에 대한 요구가 있으며, 액정표시장치 패널의 대형화 추세에 따라 액정 용량이 증가하고, 이에 비례하는 공통전극 신호의 왜곡이 발생함으로써 크로스 토크의 근본적인 제거가 이루어지지 못하고 있다.
그러므로, 이 발명의 목적은 상기한 바와 같은 종래의 기술적 문제점을 해결하기 위한 것으로서, 공통전극 전압의 왜곡 정도에 비례하는 계조전압을 생성하고, 이를 액정패널에 인가하도록 함으로써 크로스토크의 발생 원인을 근본적으로 제거할 수 있는 박막트랜지스터형 액정표시장치의 구동회로를 제공하는데 있다.
상기한 목적을 달성하기 위한 기술적 수단으로서, 이 빌명의 특징에 따른 박막 트랜지스터형 액정표시장치 구동회로의 구성은, 공통전극 전압(Vcom)이 인가되는 액정 패널 상의 소정 위치 전압을 왜곡된 공통전극 전압(DVcom)으로서 감지하는 왜곡신호 감지부와;
상기 왜곡신호 감지부에서 검출되는 왜곡된 공통전극 전압(DVcom)과 외부에서 제공되는 반전된 공통전극 전압(VcomB)을 양단전압으로서 입력받으며, 상기 두 양단전압 사이의 두 전압(Va, Vb)을 계조 기준전압으로서 발생시키는 레벨 시프트부와;
상기 레벨 시프트부에서 생성되는 두 계조 기준전압(Va, Vb)을 소정수로 분배하며, 상기 전압분배에 의해 얻어지는 소정 수의 전압을 계조전압(VG1∼VG4)으로서 소스 구동부에 출력하는 계조전압 발생부를 포함하여 이루어진다.
상기한 이 발명의 구성에 따르면, 상기 왜곡신호 감지부에 의해 액정패널 상의 소정 위치에서 왜곡된 공통전극 전압이 검출되고, 상기 검출되는 왜곡된 공통전극 전압과 반전된 공통전극 전압을 양단전압으로 하여 두개의 계조 기준전압이 발생되며, 이 계조 기준전압에 의거하여 계조전압을 발생시킨다.
이에 따라, 생성되는 계조전압은 공통전극 전압의 왜곡정도를 반영하고 있으며, 상기 계조전압이 액정 셀에 인가됨으로써 공통전극 전압이 왜곡되더라도 인접 셀의 계조에 영향받지 않고 항상 동일한 전위차가 액정 셀에 인가될 수 있다.
결과적으로, 크로스 토크 현상이 근본적으로 제거될 수 있다.
이하, 첨부된 도면을 참조하여 이 발명의 바람직한 실시예를 상세히 설명한다.
제1도는 이 발명의 실시예에 따른 박막 트랜지스터형 액정표시장치 구동회로의 구성 블록도이고, 제2도는 상기 제1도에 도시된 액정 패널의 일부를 상세하게 도시한 등가 회로도이고, 제3도는 상기 제1도에 도시된 왜곡신호 감지부를 액정패널 상에 구현하는 예를 개략적으로 도시한 평면도이고, 제4도는 상기 제3도의 A-A´의 단면도, 제5도는 상기 제1도에 도시된 레벨 시프트부 및 계조전압 발생부를 상세하게 도시한 회로도이고, 제6도는 상기 제5도의 계조전압 발생부에서 출력되는 계조전압의 일례를 도시한 파형도이고, 제7도의 (a),(b)는 각각 화이트(white)시 및 블랙(black)시 임의의 한 셀에 인가되는 전압을 도시한 파형도이다.
먼저, 제1도 내지 제5도를 참조하여 이 발명의 실시예에 따른 박막트랜지스터형 액정표시장치 구동회로의 구성을 설명한다.
제1도에 도시된 바와 같이, 이 발명의 실시예에 따른 박막트랜지스터형 액정표시장치 구동회로는, 하나의 액정 셀에 하나의 박막트랜지스터가 대응하도록 구성되며, 소정 수의 셀로 구성되는 액정 패널(1)과; 상기 액정 패널(1)의 각 액정 셀을 구성하는 박막트랜지스터의 게이트 단자 및 소스 단자에 연결되는 게이트 구동부(3) 및 소스 구동부(2)와; 공통전극 전압(Vcom) 및 반전된 공통전극 전압(VcomB)을 생성하는 타이밍 회로(4)와; 상기 액정 패널(1) 상의 소정 위치에 설치되는 왜곡신호 감지부(5)와; 상기 왜곡신호 감지부(5)의 출력신호(DVcom)와 상기 타이밍 회로(4)의 반전된 공통전극 전압(VcomB)을 받아들여 계조 기준전압(Va, Vb)을 생성하는 레벨 시프트부(6)와; 상기 레벨 시프트부(6)의 기준전압(Va, Vb)을 받아들여 계조전압(VG1∼VG4)을 생성하며, 생성된 계조전압(VG1∼VG4)이 상기 소스 구동부(2)에 인가되도록 하는 계조전압 발생부(7)로 구성된다.
다음으로, 제2도를 참조하여 상기 액정 패널(1)의 등가 회로의 구성을 설명한다.
제2도에 도시된 바와 같이, 액정 패널(1)은 다수의 액정 셀(Clc1, Clc2, …)과, 각 셀에 하나씩 연결된 박막 트랜지스터(T1, T2, …)로 구성되며, 각 액정 셀(Clc1, Clc2, …)의 트랜지스터가 연결되지 않은 반대편에는 공통전극 전압(Vcom)이 인가된다. 상기 공통전극 전압(Vcom)과 액정 셀 사이에는 패널 저항(Rcom)이 존재하며, 공통전극(Vcom)의 반대편에서는 왜곡된 공통전극 전압(DVcom)이 검출된다.
상기 제2도에 도시된 각 박막 트랜지스터의 게이트 단자에는 게이트 구동부(3)의 신호가 인가되며, 소스 단자에는 소스 구동부(2)의 신호가 인가된다.
제3도는 이 발명의 실시예에 따른 구동회로에서 왜곡신호 감지부(5)가 구현되는 일례를 보여준다.
제3도를 참조하면, 액정 패널(1)은 탭(83) 위에 장착되는 구동IC(Intergrated Circuit)(82)와 와이어 본딩(wire bonding)으로 연결되며, 이 구동IC(82)는 인쇄회로기판(PCB:Printed Circuit Board)과 연결된다. 상기 구동IC(82)는 제1도의 소스 구동부(2)에 상응하는 것으로서, 하나의 액정 패널(1)에는 보통 16개정도 구비되어 있다.
상기한 하나의 구동IC(82)에는 2개의 더미 단자(dummy port)(84,85)가 존재하며, 둘 중 하나의 더미 단자는 공통전극 전압(Vcom)을 액정패널을 인가하는데 사용되고 있다. 이 발명의 구동회로에서는 나머지 하나의 더미 단자가 왜곡된 공통전극 전압(DVcom)을 감지하는데 사용된다.
언급한 바와 같이 구동IC(82)는 다수개 존재하며, 이 발명의 구동회로에서는, 게이트 구동 IC 소스 구동 IC와 같은, 다수개의 구동IC중 임의로 선택된 한 구동 IC의 더미 단자가 왜곡신호 감지부(5)로서 사용된다. 보다 바람직하게, 본 발명의 실시예에서는 소스 구동 IC로부터 가장 멀리 떨어진 게이트 구동 IC의 더미 단자가 왜곡신호 감지부(5)로서 사용되고 있다.
제4도는 상기 제3도의 A-A´을 도시하는 단면도로서, 11은 상부기판, 12는 블랙 매트리스, 13은 상부 투명 공통전극, 14는 은(Ag)도전막, 15는 봉지재(seal), 16은 다수의 박막트랜지스터, 다수의 화소 전극 및 다수의 도전 라인(17)을 구비한 하부 투명 기판이다.
제3도의 더미 단자(84))를 통해 공통전극 전압(Vcom)이 인가된다고 가정하면, 구동IC(82)의 더미 단자(84)에서 제공되는 공통전극 전압(Vcom)은 온도전막(14)을 거쳐 상부 투명 공통전극(13)에 인가된다.
또한, 왜곡된 공통전극 전압(DVcom)은 도전 라이(17) 및 더미단자(85)를 경유하여 구동IC(82)를 통과하며, 이 전압(DVcom)은 인쇄회로기판(81) 상에 실장되는 레벨 시프트부(6)에 입력된다.
이때, 후에 보다 상세히 설명하겠지만, 왜곡된 공통전극전압(DVcom)이 충분한 전류구동능력을 가지지 못하면, 레벨 시프트부(6)전단에 증폭기가 부가될 수 있다.
다음으로, 제5도를 참조하여 레벨 시프트부(6) 및 계조전압 발생부(7)의 구성을 보다 상세하게 설명한다.
제5도를 참조하면, 반전된 공통전극 전압(VcomB)과 왜곡된 공통전극 전압(DVcom) 사이에는 저항(R61), 5개의 직렬 연결된 다이오드(D1∼D5) 및 저항(R62)이 차례로 연결되고, 상기 직렬 다이오드(D1∼D5)에 병렬로 극성이 반대 방향인 5개의 다이오드(D6∼D10)가 연결된다.
상기 두 다이오드(D1, D2)간의 접점 및 두 다이오드(D9, D10)간의 접점에서 기준전압(Va)이 검출되고, 두 다이오드(D4, D5)간의 접점 및 두 다이오드(D6, D7)간의 접점에서 기준전압(Vb)이 검출된다.
상기 두 기준전압(Va, Vb) 사이에는 5개의 저항(R71∼R75)이 직렬연결되며, 각 저항(R71∼R75) 간의 접점에서 4개의 계조전압이 얻어진다.
이 발명의 실시예에 따른 구동회로에서는 계조전압이 4가지 레벨을 가지는 것을 가정하였으나, 이 발명의 기술적 범위는 여기에 한정되지 않고 계조전압 레벨의 축소 및 확장이 가능하다.
다음으로, 상기와 같이 설명된 구성 및 제6도, 제7도의 파형도를 참조하여 이 발명의 실시예에 따른 박막트랜지스터형 액정표시장치 구동회로의 동작을 설명한다.
전원이 인가되면 회로의 동작이 시작된다. 회로의 동작이 시작되면, 소스 구동부(2) 및 게이트 구동부(3)에서는 액정패널(1)의 박막트랜지스터를 구동하기 위한 신호가 출력되고, 타이밍 회로(4)에서는 액정 패널(1)의 공통전극에 인가하기 위한 공통전극 전압(Vcom) 및 이의 반전 신호(VcomB)가 생성되어 출력된다.
액정 패널(1)에서는 게이트 구동부(3)와 소스 구동부(2)의 신호에 의해 결정되는 소정의 전압이 각 액정 셀에 인가되며, 상기 인가전압에 대응하는 각 액정 셀의 투과율에 따라 소정의 표시 동작이 수행된다.
제2도에 도시된 액정 패널(1)의 등가회로를 참조하면, 공통전극전압(Vcom) 중 패널 저항(Rcom)에 의한 전압 강하분을 제외한 전압이 각 액정 셀의 일단에 인가되고, 각 박막 트랜지스터의 드레인 전압이 각 액정 셀의 타단에 인가된다. 이때, 각 박막 트랜지스터의 드레인 전압은 게이트 단자가 턴온될 경우에 소스 단자에 인가되는 전압이다. 각 박막 트랜지스터의 소스 단자에 인가되는 전압은 소스 구동부(2)에서 출력되는 신호로서, 계조 표시를 위한 계조전압이다.
한편, 왜곡신호 감지부(5)는 왜곡된 공통전극 전압(DVcom)을 검출하기 위한 것으로서, 위에서 설명한 바와 같이 전극 패드 또는 전극 패드에 증폭기가 부가된 형태로 구현된다. 상기 왜곡된 공통전극 전압을 검출하기 위하여, 전극 패드는 공통전극 전압(Vcom)이 인가되는 한 전극과 또다른 전극 사이 또는 공통전극 전압(Vcom)이 인가되는 전극과 가장 멀리 떨어져 있는 위치에 설치된다. 또한, 증폭기는 검출된 왜곡된 공통전극 전압이 액정 셀의 전류 구동능력을 가지지 못할 경우에만 부가된다. 이러한 증폭기로는 일반적인 푸쉬-풀 증폭기(Push pull amplifier)가 사용된다.
상기 왜곡 신호 감지부(5)에서 감출된 왜곡된 공통전극 전압(DVcom)은 레벨 시프트부(6)에 입력되며, 이때 타이밍 회로(4)에서 제공되는 반전된 공통전극 전압(VcomB)도 함께 입력된다.
레벨 시프트부(6)와 계조전압 발생부(7)의 동작은 제5도의 회로도를 참조하여 보다 상세하게 설명한다.
제5도를 참조하면, 5개의 직렬 다이오드(D1∼D5, D6∼D10)가 극성이 서로 반대방향으로 되도록 연결되어 있으며, 이것은 왜곡된 공통전극 전압(DVcom)과 반전된 공통전극 전압(VcomB) 중 크기가 더 큰 쪽에서 더 작은 쪽으로 전류가 흐르도록 하기 위한 것이다.
예를 들어, 반전된 공통전극 전압(VcomB)이 왜곡된 공통전극 전압(DVcom)보다 더 클 경우에는, 5개의 직렬 다이오드(D1∼D5)가 턴온되며, 그 반대의 경우에는 5개의 직렬 다이오드(D6∼D10)가 턴온된다.
또한, 반전된 공통전극 전압(VcomB)과 왜곡된 공통전극 전압(DVcom)사이의 두 전압이 기준전압(Va, Vb)으로서 검출되며, 상기 검출된 두 전압(Va, Vb)은 5개의 저항(R71∼R75)에 의해 분배된다.
상기 5개의 저항(R71∼R75)에 의한 전압 분배를 통해 4개의 계조전압(VG1∼VG4)이 얻어지며, 이 계조전압은 소스 구동부(2)에 출력된다. 소스 구동부(2)에서는 입력되는 4개의 계조전압 중 하나가 내부의 스위칭 소자에 의해 선택되고, 액정 패널(1) 상의 박막 트랜지스터 소스 단자에 출력된다.
제6도를 참조하면, 타이밍 회로(4)에서 출력되는 공통전극 전압(Vcom)과, 레벨 시프트부(6)에서 생성되는 기준전압(Va, Vb) 및 계조전압 발생부(7)에서 생성되는 계조전압(VG∼VG4) 파형의 일례가 도시되어 있다. 상기 도시된 바와 같이, 계조전압(VG∼VG4)의 파형은 액정패널(1)에서 검출되는 왜곡된 공통전극 전압(DVcom)의 파형을 따르게 된다.
제7도의 (a), (b)는 인접하는 액정 셀이 화이트 및 블랙 표시시 임의의 한 액정 셀에 소정 레벨의 계조전압이 인가될때의 왜곡된 공통전극 전압의 파형을 도시하고 있다.
제7도(a)의 면적 A는 왜곡된 공통전극 전압(DVcom)과 인가되는 계조전압의 차이로서, 인접 셀이 화이트를 표시할때 실제 액정 셀에 인가되는 전압이며, 제7도(b)의 면적 B는 인접 셀이 블랙을 표시할때 실제 액정 셀에 인가되는 전압이다.
제7도의 (b)에 도시된 바와 같이, 이 발명의 구동회로에서는 왜곡된 공통전극 전압(DVcom)의 왜곡정도에 비례하는 계조전압이 액정 셀에 인가됨으로써, 면적 A와 면적 B의 차이가 거의 없다. 결국, 제7도의 (a) 및 (b)의 경우에 동일한 계조전압에 대하여 동일한 계조표시가 가능하게 되어 크로스 토크 현상이 제거될 수 있다.
이상에서와 같이 이 발명의 실시예에 따르면, 액정 패널에서 검출되는 왜곡된 공통전극 전압의 왜곡정도에 비례하는 기준전압을 생성하고, 이 생성된 기준전압에 의거하여 계조전압을 생성하여 소스 구동회로에 제공함으로써 공통전극 전압이 왜곡되더라도 계조전압에 이것을 반영할 수 있다.
이에 따라, 공통전극 전압이 왜곡되더라도 액정 셀에는 항상 동일한 전위차가 인가됨으로써 크로스 토크 현상이 근본적으로 제거될 수 있다.

Claims (6)

  1. 공통전극 전압(Vcom)이 인가되는 액정 패널 상의 소정 위치 전압을 왜곡된 공통전극 전압(DVcom)으로서 감지하는 왜곡신호 감지부와; 상기 왜곡신호 감지부에서 검출되는 왜곡된 공통전극 전압(DVcom)과 외부에서 제공되는 반전된 공통전극 전압(VcomB)을 양단전압으로서 입력받으며, 상기 두 양단전압 사이의 두 전압(Va, Vb) 기준전압으로서 발생시키는 레벨 시프트부와; 상기 레벨 시프트부에서 생성되는 두 계조 기준전압(Va, Vb)소정수로 분배하며, 상기 전압분배에 의해 얻어지는 소정 수의 전압을 계조전압(VG1∼VG4)으로서 소스 구동부에 출력하는 계조전압 발생부를 포함하여 이루어지는 것을 특징으로 하는 박막트랜지스터형 액정표시장치의 구동회로.
  2. 제1항에 있어서, 상기한 왜곡신호 감지부는 액정 패널 상의 소정 위치에 설치되는 전극패드로 구현되는 것을 특징으로 하는 박막트랜지스터형 액정표시장치의 구동회로.
  3. 제2항에 있어서, 상기한 전극 패드는 액정 패널 상의 공통전극 전압이 인가되는 한 전극과 또다른 전극 사이 또는 공통전극 전압이 인가되는 전극에서 가장 멀리 떨어져 있는 위치에 설치되는 것을 특징으로 하는 박막 트랜지스터형 액정표시장치의 구동회로.
  4. 제2항 또는 제3항에 있어서, 상기한 전극 패드에는 증폭기가 부가하여 연결되는 것을 특징으로 하는 박막 트랜지스터형 액정표시장치의 구동회로.
  5. 제1항에 있어서 상기한 레벨 시프트부는 상기 왜곡된 공통전극 전압(DVcom)과 반전된 공통전극 전압(VcomB)사이의 소정 위치에 연결되는 저항과; 상기 두 전압 사이에 직렬로 연결되는 소정 수의 다이오드 및 이와 극성이 반대가 되도록 직렬 연결되는 동수의 다이오드로 구성되며, 상기 두 그룹의 다이오드 중 양똑 가장자리 위치의 전압이 두 기준전압(Va, Vb)으로서 검출되는 것을 특징으로 하는 박막트랜지스터형 액정표시장치의 구동회로.
  6. 제1항 또는 제5항에 있어서, 상기한 계조전압 발생부는 상기 레벨 시프트부에서 검출되는 두 기준전압 사이에 연결되어 두 기준전압을 분배하는 소정 수의 저항으로 구성되며, 각 저항의 접점에서 계조전압이 생성되는 것을 특징으로 하는 박막트랜지스터형 액정표시장치의 구동회로.
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