JPWO2006046711A1 - 再構成可能な論理回路を有するデータ処理装置 - Google Patents
再構成可能な論理回路を有するデータ処理装置Info
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Abstract
Description
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- サイクル毎に再構成可能な論理回路と、ハードウェア制御情報を格納したライブラリとを有するデータ処理装置であって、
前記ハードウェア制御情報は、アプリケーションを実行するためのサイクル毎の機能をそれぞれ実現するための複数のサイクルベース回路を個々に前記論理回路にマッピングするための複数のサイクルベースマッピング情報と、前記アプリケーションの実行状態により、それらのサイクルベースマッピング情報の少なくともいずれかを選択するための構成選択情報とを備えており、さらに、当該データ処理装置は、
前記構成選択情報に基づくサイクル毎の要請により、前記複数のサイクルベースマッピング情報の少なくともいずれかにより前記論理回路の少なくとも一部を再構成する制御ユニットを有するデータ処理装置。 - 請求項1において、前記複数のサイクルベースマッピング情報は、前記サイクル毎の機能を阻害することなくマージできるサイクルベースマッピング情報がマージされた複合サイクルベースマッピング情報を含む、データ処理装置。
- 請求項1において、前記複数のサイクルベースマッピング情報は、サイクル毎の前記制御ユニットを前記論理回路にマッピングするための情報をそれぞれ含んでおり、
前記サイクル毎の制御ユニットが、前記論理回路に再構成される、データ処理装置。 - サイクル毎に再構成可能な論理回路と、ハードウェア制御情報を格納したライブラリとを有するデータ処理装置であって、
前記ハードウェア制御情報は、アプリケーションを実行するためのサイクル毎の機能をそれぞれ実現するための複数のサイクルベース回路情報を個々に、前記論理回路にマッピングするための複数のサイクルベースマッピング情報と、前記アプリケーションの実行状態により、それらのサイクルベースマッピング情報の少なくともいずれかを選択するための構成選択情報とを備えており、
前記論理回路の少なくとも一部は、前記構成選択情報に基づくサイクル毎の要請により、前記複数のサイクルベースマッピング情報の少なくともいずれかにより再構成される、データ処理装置。 - 請求項4において、前記複数のサイクルベースマッピング情報は、サイクル毎の前記制御ユニットを前記論理回路にマッピングするための情報をそれぞれ含んでおり、
前記論理回路の少なくとも一部は、前記論理回路に再構成された前記サイクル毎の制御ユニットの要請により再構成される、データ処理装置。 - サイクル毎に再構成可能な論理回路を有するデータ処理装置の制御方法であって、ハードウェア制御情報に基づき前記論理回路の少なくとも一部を再構成する工程を有し、
前記ハードウェア制御情報は、アプリケーションを実行するためのサイクル毎の機能をそれぞれ実現するための複数のサイクルベース回路を個々に前記論理回路にマッピングするための複数のサイクルベースマッピング情報と、前記アプリケーションの実行状態により、それらのサイクルベースマッピング情報の少なくともいずれかを選択するための構成選択情報とを含み、
前記再構成する工程は、前記構成選択情報に基づくサイクル毎の要請により、前記複数のサイクルベースマッピング情報のいずれかを選択して前記論理回路の少なくとも一部を再構成することを含む、制御方法。 - 請求項6において、前記複数のサイクルベースマッピング情報は、サイクル毎の前記制御ユニットを前記論理回路にマッピングするための情報をそれぞれ含んでおり、
前記再構成する工程は、前記論理回路に再構成された前記サイクル毎の制御ユニットの要請により、前記論理回路の少なくとも一部を再構成することを含む、データ処理装置。 - 再構成可能な論理回路を制御するためのハードウェア制御情報を生成するための生成システムであって、
アプリケーションを実行するためのサイクル毎の機能をそれぞれ実現するための複数のサイクルベース回路の回路情報を生成する機能と、
前記複数のサイクルベース回路を前記論理回路にそれぞれマッピングするための複数のサイクルベースマッピング情報、および、前記アプリケーションの実行状態により、それらのサイクルベースマッピング情報の少なくともいずれかを選択するための構成選択情報を含む前記ハードウェア制御情報を生成する機能とを有する、生成システム。 - 請求項8において、さらに、前記複数のサイクルベースマッピング情報の中の、前記サイクル毎の機能を阻害することなくマージできるサイクルベースマッピング情報を抽出して、それらをマージして複合サイクルベースマッピング情報を生成する機能を有する、生成システム。
- 請求項8において、前記ハードウェア制御情報を生成する機能は、サイクル毎の前記構成選択情報を生成して前記サイクルベースマッピング情報にマージする、生成システム。
- 請求項8において、前記回路情報を生成する機能は、前記アプリケーションを実行するためのコントロールデータフローダイアグラムに基づき、前記複数のサイクルベース回路の情報を生成する、生成システム。
- 請求項8において、前記回路情報を生成する機能は、前記アプリケーションを実行するためのRTLをサイクルベースに分解して、前記複数のサイクルベース回路の情報を生成する、生成システム。
- 再構成可能な論理回路を制御するためのハードウェア制御情報を生成する方法であって、
アプリケーションを実行するためのサイクル毎の機能をそれぞれ実現するための複数のサイクルベース回路の回路情報を生成する工程と、
前記複数のサイクルベース回路を前記論理回路にそれぞれマッピングするための複数のサイクルベースマッピング情報、および、前記アプリケーションの実行状態により、それらのサイクルベースマッピング情報の少なくともいずれかを選択するための構成選択情報を含む前記ハードウェア制御情報を生成する工程とを有する、生成する方法。 - 請求項13において、さらに、前記複数のサイクルベースマッピング情報の中の、前記サイクル毎の機能を阻害することなくマージできるサイクルベースマッピング情報を抽出して、それらをマージして複合サイクルベースマッピング情報を生成する工程を有する、生成する方法。
- 請求項13において、前記ハードウェア制御情報を生成する工程では、サイクル毎の前記構成選択情報を生成し、前記サイクルベースマッピング情報にマージする、生成する方法。
- 請求項13において、前記回路情報を生成する工程では、前記アプリケーションを実行するためのコントロールデータフローダイアグラムに基づき、前記複数のサイクルベース回路の情報を生成する、生成する方法。
- 請求項13において、前記回路情報を生成する工程では、前記アプリケーションを実行するためのRTLをサイクルベースに分解して、前記複数のサイクルベース回路の情報を生成する、生成する方法。
- 再構成可能な論理回路を有するデータ処理装置を制御するためのハードウェア制御情報であって、アプリケーションを実行するためのサイクル毎の機能をそれぞれ実現するための複数のサイクルベース回路を個々に前記論理回路にマッピングするための複数のサイクルベースマッピング情報と、前記アプリケーションの実行状態により、それらのサイクルベースマッピング情報の少なくともいずれかを選択するための構成選択情報とを有するハードウェア制御情報が記録されている記録媒体。
- 請求項18において、前記複数のサイクルベースマッピング情報は、前記サイクル毎の機能を阻害することなく、複数のサイクルベースマッピング情報がマージされた複合サイクルベースマッピング情報を含んでいる、記録媒体。
- 請求項18において、前記構成選択情報は、サイクル毎の構成選択情報であり、前記サイクルベースマッピング情報にマージされている、記録媒体。
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