JPS6398761A - Inter-processor communication control system - Google Patents
Inter-processor communication control systemInfo
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Abstract
Description
【発明の詳細な説明】
〔概要〕
通信メモリと、各処理部(以下CPU)に共通の割込み
信号を発生する通知手段とを通(8制御部に設けたもの
で、
通信制御部はコマンドを通イ3メモリにセットして共通
の割込みイ:号を発生し、各CPUでは自己のコマンド
領域にコマンドがあればレスポンスデータを通信メモリ
に格納し、このレスポンスデータを通信制御部が読取っ
て通(Sを行う方式であり、特に各CPUの通信処理手
段を通信制御部に設けて共通に使用すると、プロセッサ
間の通(、T制御を通イδ制御部に局所化できる効果が
ある。[Detailed Description of the Invention] [Summary] The communication control unit receives commands through a communication memory and a notification means (provided in the 8 control unit) that generates a common interrupt signal to each processing unit (hereinafter referred to as CPU). A common interrupt number A: is generated by setting it in the communication memory 3, and if each CPU has a command in its own command area, the response data is stored in the communication memory, and the communication control unit reads this response data and transmits it. In particular, if the communication processing means of each CPU is provided in the communication control unit and used in common, it has the effect of localizing the communication between the processors (and the T control to the A δ control unit).
本発明は、それぞれプロセッサを備えた通信制御部と複
数の処理部との間でプロセッサ間通信を行う通信制御方
式の改良に関する。The present invention relates to an improvement in a communication control method for performing inter-processor communication between a communication control unit each equipped with a processor and a plurality of processing units.
例えば、マルチプロセッサシステムにおけるコンソール
(iffi作部9通信制御部に対応)は、各CPUごと
に設けるか、またはコンソールの備えるプロセッサと各
CPUとの間で通信を行い共通化している。For example, in a multiprocessor system, a console (corresponding to the communication control section of the iffi production section 9) may be provided for each CPU, or may be shared by communicating between the processor provided in the console and each CPU.
この各CPUとコンソールとのプロセッサ間通信として
、コンソールが共通メモリにコマンドを格納した後その
CPUに割込みを発生し、割込みを受けたCPUが割り
込み処理を行ってそのコマンドに応答する方式が用いら
れている。For this interprocessor communication between each CPU and the console, a method is used in which the console stores a command in a common memory and then generates an interrupt to the CPU, and the CPU that receives the interrupt processes the interrupt and responds to the command. ing.
この方式では、共通メモリに通信領域を確保するととも
に、コンソールに各CPUごとに割込み信号を発生する
手段と、各CPUにコンソール制御に対する割込み処理
手段とを設けているため、制御が分散し、システム構成
上柔軟に対応できないという問題点がある。In this method, a communication area is secured in the common memory, and the console is provided with means for generating an interrupt signal for each CPU, and each CPU is provided with an interrupt processing means for console control, so control is distributed and the system There is a problem in that the structure cannot be handled flexibly.
このため、上記問題点を解決する簡易なプロセッサ間の
通信制御方式が求められている。Therefore, there is a need for a simple inter-processor communication control system that solves the above problems.
以下コンソール制御を例として第3図を参照しつつ説明
する。Console control will be explained below with reference to FIG. 3 as an example.
(従来例その1)
第3図(al、 (blは、従来のコンソール制御方式
説明図(その1)である。(Conventional example No. 1) FIG. 3 (al, (bl) is an explanatory diagram (No. 1) of a conventional console control system.
第3図(a)は、マルチプロセッサシステムの各処理部
cPUごとにコンソールパネルを設けたもので、コンソ
ールパネルCP0、CPnは制御アダプタAD0、AD
nにより各内部バスLB0、LI3nに接続され、オペ
レータの操作によりそれぞれ処理部CPU0.CPUn
を監視、制御する。FIG. 3(a) shows a multiprocessor system in which a console panel is provided for each processing unit cPU, and the console panels CP0 and CPn are connected to control adapters AD0 and AD.
n to each internal bus LB0, LI3n, and is connected to each processing unit CPU0. C.P.U.N.
monitor and control.
例えばcpuoのプロセッサMPU0 (以下プロセッ
サをMPUとしてCPU (プロセッサユニット、処理
部)と区別する。〕の内部レジスタをコンソールパネル
CPOに表示させる場合、第3図(b)にその詳細を示
すように、
(1)プロセッサMPU0の内部レジスタ表示を指示す
るキーに1を押下す・ると、プロセンサMPU0に割込
みが発生する。For example, when displaying the internal registers of processor MPU0 (hereinafter referred to as MPU and distinguished from CPU (processor unit, processing unit)) of CPUO on the console panel CPO, the details are shown in FIG. 3(b). (1) When 1 is pressed on the key that instructs the internal register display of the processor MPU0, an interrupt is generated in the processor MPU0.
(2)プロセッサMPU0は割込みにより内部レジスタ
の内容を制御アダプタADO内の画面メモリ6にセント
し、表示制御部7はこれを読取ってコンソールパネルC
POの表示部8に表示する。(2) The processor MPU0 writes the contents of the internal register to the screen memory 6 in the control adapter ADO by an interrupt, and the display control unit 7 reads this and writes it to the console panel C.
It is displayed on the display section 8 of the PO.
なお、上記動作を行うコンソール制御プログラムは読出
し専用メモリROM0に格納されており、本割込み信号
により起動される。The console control program that performs the above operations is stored in the read-only memory ROM0, and is activated by this interrupt signal.
(従来例その2)第3図(C1
第3図(C)は従来のコンソール制御方式説明図(その
2)であって、コンソールパネルCPの制?1)アダプ
タ10を共通バス100に接続し、共通メモリ5に通信
領域53を設けてプロセッサ間通信を行い、各処理部C
PUでコンソールを共通化した例である。(Conventional Example No. 2) FIG. 3 (C1) FIG. , a communication area 53 is provided in the common memory 5 to perform inter-processor communication, and each processing unit C
This is an example in which the console is shared between PUs.
(1) 制御アダプタ10のプロセッサMPUcはオ
ペレータからの入力(処理部CPU0指定、内部レジス
タ表示)を解読し、通信領域53にコマンド54をセッ
トする。(1) The processor MPUc of the control adapter 10 decodes the input from the operator (processing unit CPU0 designation, internal register display) and sets the command 54 in the communication area 53.
続いて制御アダプタ10の割込み制御部9に割込みデー
タをセットして、MPU0に対する割込み信号INTO
を発生する。Next, interrupt data is set in the interrupt control unit 9 of the control adapter 10, and the interrupt signal INTO is sent to the MPU0.
occurs.
(2)MPUOは、割込み信号INTOにより、ROM
0内に格納されているコンソール制御プログラムを起動
し、通信領域53にセットされているコマンド54を読
取る。(2) MPUO interrupts the ROM by interrupt signal INTO.
0 and reads the command 54 set in the communication area 53.
(3) コマンド54を解析し、内部レジスタの内容
(レスポンス55)を通信領域53にセットして制御ア
ダプタ10へ割込み信号lNTcを発生する。(3) Analyze the command 54, set the contents of the internal register (response 55) in the communication area 53, and generate an interrupt signal lNTc to the control adapter 10.
(4)制御アダプタ10は通信領域53に格納されたレ
スポンス55を読取り、コンソールパネルCPに表示す
る。(4) The control adapter 10 reads the response 55 stored in the communication area 53 and displays it on the console panel CP.
従来のコンソール制御は、各CPUごとにコンソールパ
ネルを備えるか、またはコンソールパネルを共通化する
ため、共通メモリに通信領域を設けるとともに、各CP
Uごとに割込み信号を発生する手段をコンソールに設け
、割込みにより起動されるコンソール制御プログラムを
それぞれのROMに設けていた。Conventional console control requires a console panel for each CPU, or to share the console panel, a communication area is provided in the common memory, and each CPU
The console was provided with means for generating an interrupt signal for each U, and a console control program activated by the interrupt was provided in each ROM.
このため、処理装置が高価になるとか、コンソール制御
機能が分散するため、コンソールをオプション化するこ
とが困難であるという問題点があった。For this reason, there are problems in that the processing device becomes expensive and the console control function is dispersed, making it difficult to make the console optional.
本発明は上記問題点に鑑み、プロセッサ間の通信手段を
局所化する通信制御方式を提供することを目的とする。In view of the above problems, it is an object of the present invention to provide a communication control method that localizes communication means between processors.
(問題点を解決するための手段)
上記目的のため、本発明のプロセッサ間の通信制御方式
は、第1図本発明の原理説明図に示すように、
コマンドを格納するコマンド領域(50)とレスポンス
データを格納するレスポンス領域(51)とをそれぞれ
該処理部(CPU0、CPOn )に対応して設けた通
信メモリ (3)と、
通信先の該処理部に対する該コマンドを該コマンド領域
(50)に格納するとともに、レスポンス領域(51)
より該レスポンスデータを読取る制御部(12)と、
前記コマンド格納後、すべての該処理部(Cr’UO。(Means for Solving the Problems) For the above purpose, the communication control method between processors of the present invention has a command area (50) for storing commands, as shown in FIG. A response area (51) for storing response data is provided in a communication memory (3) corresponding to each processing unit (CPU0, CPOn), and a command area (50) for storing the command for the processing unit at the communication destination. In addition to storing it in the response area (51)
a control unit (12) that reads the response data from the command; and after storing the command, all the processing units (Cr'UO).
CPUn )に共通の割込み信号(52)を送出する通
知手段(1)と、
を該通信制御部(CCA )に設け、
前記割込み信号(52)に起動されるとともに、自己に
対する該コマンドが該コマンド領域(50)に存在した
とき、レスポンスデータを該レスポンス領域(51)に
格納する通信処理手段(4)を該処理部(CPU0、C
PUn )に設けたものである。A notification means (1) for sending a common interrupt signal (52) to CPUn) is provided in the communication control unit (CCA), and is activated by the interrupt signal (52), and the command to itself is sent to the command. When the response data exists in the area (50), the communication processing means (4) for storing the response data in the response area (51) is connected to the processing unit (CPU0, C
PUn).
共通バスに接続された通信制御部に、各CPUと通信を
行うための通信メモリを設け、それぞれコマンド領域、
レスポンス領域を設ける。The communication control unit connected to the common bus is provided with a communication memory for communicating with each CPU, and each has a command area,
Provide a response area.
通イδ制御部は通信先のcpuに対応する通信領域にコ
マンドを格納し、各CPUに共通の割込み信号を発生す
る。The communication δ control unit stores commands in the communication area corresponding to the communication destination CPU, and generates an interrupt signal common to each CPU.
割込み信号を受けた各CPUは、共通バスを獲得したの
ち、例えば通信制御部に用意された処理プログラムを実
行する。After receiving the interrupt signal, each CPU acquires the common bus and then executes a processing program prepared in the communication control section, for example.
このプログラムによりコマンド領域を検索し、コマンド
無しの場合は割込み処理より復帰(リターン)し、コマ
ンド有りの場合はコマンドを解析してレスポンスデータ
を該当通信領域にセットする。This program searches the command area, and if there is no command, returns from the interrupt process, and if there is a command, it analyzes the command and sets response data in the corresponding communication area.
′通信制御部はレスポンス領域をサーチし、そのレスポ
ンスデータを読み込む。'The communication control unit searches the response area and reads the response data.
以上により、割込み信号を共通化するとともに、通信領
域と処理プログラムとを通信制御部に局所化することが
でき、オプション化とともに種々のシステム構成に対応
できる効果がある。As described above, the interrupt signal can be shared, the communication area and the processing program can be localized to the communication control unit, and there is an effect that it can be made optional and compatible with various system configurations.
本発明の実施例を第2図に基づき説明する。 An embodiment of the present invention will be described based on FIG.
第2図(a)は動作フローチャート図、第2図中)は実
施例のマルチプロセッサシステムブロック図、第2図(
C)はメモリ構成説明図であり、本実施例は、通信制御
部OCAにコンソール制御プログラム1)を設けた例を
示すものである。FIG. 2(a) is an operation flowchart, FIG. 2(a) is a block diagram of the multiprocessor system of the embodiment,
C) is a memory configuration explanatory diagram, and this embodiment shows an example in which a console control program 1) is provided in the communication control unit OCA.
第2図(b)に示す通信制御部OCAにおいて、3は通
信メモリ、
1・3は、プロセッサMPU0.M1’Unに共通の割
込み信号INTを発生する割込み制御部、1)は、割込
み信号INTにより各MPUが実行するコンソールa制
御プログラムで、通信処理プログラム2に対応するもの
、
12は制御部であって、コンソールパネルCPの扱作デ
ータを読取り、コマンド54を通信メモI73にセット
して割込み制御部13に指令するとともに、通イ3メモ
リ3をサーチしてレスポンスデータ55を読取り、コン
ソールパネルCPに表示するもの、
であり、その他企図を通じて同一符号は同一対象物を表
す。In the communication control unit OCA shown in FIG. 2(b), 3 is a communication memory, 1 and 3 are processors MPU0. 1) is a console a control program executed by each MPU in response to the interrupt signal INT, and corresponds to the communication processing program 2; 12 is a control unit; reads the operation data of the console panel CP, sets the command 54 in the communication memo I73, and instructs the interrupt control unit 13, searches the communication memory 3, reads the response data 55, and sends the command to the console panel CP. The same reference numerals represent the same objects throughout the design.
なお、通信処理プログラム2はコンソール制御プログラ
ム1)に、通知手段1は割込み制御部13にそれぞれ対
応する。Note that the communication processing program 2 corresponds to the console control program 1), and the notification means 1 corresponds to the interrupt control section 13.
第2図(C)−(1)各CPUの内部バス空間配置図お
よび第2図(C1−(If)通信メモリ3のフォーマン
ト図に示すように、通信制御部OCAの備える通信メモ
リ3に共通領域として通信領域を設けたもので、各処理
部CPUごとにコマンド領域50とレスポンス領域51
とが設けられ、それぞれコマンドデータ、レスポンスデ
ータの存在を表すコマンドフラグCMDおよびレスポン
スフラグR3Pが設けられる。As shown in FIG. 2(C)-(1) Internal bus space layout diagram of each CPU and FIG. 2(C1-(If) formant diagram of communication memory 3, A communication area is provided as a common area, and a command area 50 and a response area 51 are provided for each processing unit CPU.
A command flag CMD and a response flag R3P each indicating the presence of command data and response data are provided.
また、コンソール制御プログラム1)も、第2図(C)
−CI)に示すように、前記通信領域と同様に共通領域
に設けられ、各CPUによってアクセスされる。In addition, the console control program 1) is also
-CI), it is provided in a common area similarly to the communication area and is accessed by each CPU.
以上の構成において、例えば、MPU0の内部レジスタ
の内容を表示する場合、以下の手順で実行される。In the above configuration, for example, when displaying the contents of the internal register of MPU0, the following procedure is executed.
■ 通信制御部CCAのプロセッサMPUcはコンソー
ルパネルCPからの入力を解読し、通信メモリ3のコマ
ンド領域50−0 (CPUOに対応する領域を表す)
に内部レジスタ表示コマンドとともにコマンドフラグC
MDをセットする。■ The processor MPUc of the communication control unit CCA decodes the input from the console panel CP and reads the command area 50-0 of the communication memory 3 (representing the area corresponding to CPUO).
command flag C along with the internal register display command.
Set the MD.
■ MPUcは割込み制御部13に割込み指示56を発
して、すべてのプロセッサMPUに共通の割込み信号I
NTを発生する。■ The MPUc issues an interrupt instruction 56 to the interrupt control unit 13, and sends an interrupt signal I common to all processors MPU.
Generates NT.
■ 各MPUは、割込み信号INTにより、共通バス1
00を獲得した後、ROMcに格納されているコンソー
ル制御プログラム1)を実行する。■ Each MPU uses the common bus 1 by interrupt signal INT.
After obtaining 00, the console control program 1) stored in the ROMc is executed.
■ コマンドフラグCMDを参照し、MP U O以外
のMPUは、コ”7ンドがセントされていないため、リ
ターンする。- Referring to the command flag CMD, MPUs other than MPU O return because the command "7" has not been sent.
■ MPU0は通信メモリ3のコマンド領域50−0に
セットされているコマンド54をML’lした後、内部
レジスタの内容とともにレスポンスフラグR3Pをレス
ポンス領域51−0にセットする。(2) After ML'ling the command 54 set in the command area 50-0 of the communication memory 3, the MPU0 sets the response flag R3P in the response area 51-0 together with the contents of the internal register.
■ MP[Jcはレスポンス領域51−oのレスポンス
フラグRSPをサーチし、レスポンスの受信が確認され
るとその内容を読取り、コンソールパネルCPに表示す
る。(2) MP[Jc searches for the response flag RSP in the response area 51-o, and when reception of the response is confirmed, reads the content and displays it on the console panel CP.
以上のどと(、通信制御部に通(3メモリとコンソール
制御プログラムとを設けるとともに、割込み信号を共通
化することにより、コンソール制御を局所化することが
できる。As described above, console control can be localized by providing a communication control section with a memory and a console control program, and by sharing interrupt signals.
なお上記実施例はコンソール制御に付いて説明シタが、
他のプロセッサ間通信に適用することは容易であり、ま
た両方向通信も同様に実施できるものである。Note that the above embodiment is not explained in terms of console control.
It is easy to apply to other inter-processor communications, and bidirectional communications can be implemented as well.
以上説明したように、本発明は通信メモリと通信のため
の処理プログラムとを通イ二制御部に設けたものである
から、プロセッサ間通信を局所することができ、システ
ム構成上柔軟に対応できる効果は多大なものがある。As explained above, since the present invention provides a communication memory and a processing program for communication in two control units, inter-processor communication can be localized, and the system configuration can be flexibly handled. The effects are enormous.
第1図は本発明の原理説明図、
第2図(n)は動作フローチャート図、第2図(b)は
実施例のマルチプロセッサシステムブロック図、
第2図(C)はメモリ構成説明図、
第3図(a)は従来のコンソール制御方式説明図(その
1−1)
第3図(b)は従来のコンソール制御方式説明図(その
1−2)、
第3図(0)は従来のコンソール制御方式説明図(その
2)、
である。図中、
lは通知手段、 2は通信処理プログラム、3は通
信メモリ、 4は通信処理手段、5は共通メモリ、
6は画面メモリ、7は表示制御部、 8は
表示部、
9は割込み制御部、 10は制御アダプタ、1)は
コンソール制御プログラム、
12は制御部、 13は割込み制御部、50は
コマンド領域、 51はレスポンス領域、52は割込み
信号、 53は通信領域、54はコマンド、
55はレスポンス、56は割込み指示、
CPU0.CPUnは処理部、
MPU0.MPUn、MPUcはプロセッサ、r20M
o、ROMn、ROMcは読出し専用メモリ、
OCAは通信制御部、
CP O” CP nは:J 7ソールハネ)Lt、A
D0、ADnは制御アダプタ、
Li20、LBnは内部ハス、
INT、INT0、lNTcは割込み信号、CMDはコ
マンドフラグ、
R3Pはレスポンスフラグ、
第1図
第2図C司
■2図山中
(1)各CPUの空間配置図
(r[)通信領域のフォーマット図
メモリ構成説明図
第2図(C1
従来のコンソール制御方式説明IJ(その1−1)第3
図fat
第3図(C3FIG. 1 is an explanatory diagram of the principle of the present invention, FIG. 2(n) is an operation flowchart diagram, FIG. 2(b) is a block diagram of a multiprocessor system according to an embodiment, FIG. 2(C) is an explanatory diagram of a memory configuration, Figure 3(a) is an explanatory diagram of the conventional console control method (Part 1-1). Figure 3(b) is an explanatory diagram of the conventional console control method (Part 1-2). Figure 3(0) is an explanatory diagram of the conventional console control method (Part 1-2). This is an explanatory diagram of the console control method (Part 2). In the figure, l is a notification means, 2 is a communication processing program, 3 is a communication memory, 4 is a communication processing means, 5 is a common memory,
6 is a screen memory, 7 is a display control unit, 8 is a display unit, 9 is an interrupt control unit, 10 is a control adapter, 1) is a console control program, 12 is a control unit, 13 is an interrupt control unit, 50 is a command area, 51 is a response area, 52 is an interrupt signal, 53 is a communication area, 54 is a command,
55 is a response, 56 is an interrupt instruction, CPU0. CPUn is a processing unit, MPU0. MPUn, MPUc are processors, r20M
o, ROMn, ROMc are read-only memories, OCA is communication control unit, CP n is: J 7 Sole Hane) Lt, A
D0, ADn are control adapters, Li20, LBn are internal hubs, INT, INT0, lNTc are interrupt signals, CMD is a command flag, R3P is a response flag. Space layout diagram (r[) Communication area format diagram Memory configuration explanatory diagram Figure 2 (C1 Conventional console control method explanation IJ (Part 1-1) Part 3
Figure fat Figure 3 (C3
Claims (2)
接続された通信制御部(CCA)と複数の処理部(CP
U0、CPUn)との間でプロセッサ間通信を行う通信
制御方式であって、 コマンドを格納するコマンド領域(50)とレスポンス
データを格納するレスポンス領域(51)とをそれぞれ
該処理部(CPU0、CPUn)に対応して設けた通信
メモリ(3)と、 通信先の該処理部に対する該コマンドを該コマンド領域
(50)に格納するとともに、レスポンス領域(51)
より該レスポンスデータを読取る制御部(12)と、 前記コマンド格納後、すべての該処理部(CPU0、C
PUn)に共通の割込み信号(52)を送出する通知手
段(1)と、 を該通信制御部(CCA)に設け、 前記割込み信号(52)に起動されるとともに、自己に
対する該コマンドが該コマンド領域(50)に存在した
とき、レスポンスデータを該レスポンス領域(51)に
格納する通信処理手段(4)を該処理部(CPU0、C
PUn)に設け、 該通信制御部(CCA)が該通信メモリ(3)にコマン
ドを格納した後共通の割込み信号(52)を出力して該
処理部(CPU0、CPUn)と通信を行うことを特徴
とするプロセッサ間の通信制御方式。(1) A communication control unit (CCA) and a plurality of processing units (CP
This is a communication control method that performs inter-processor communication with the respective processing units (CPU0, CPUn), and a command area (50) for storing commands and a response area (51) for storing response data. ), the command for the processing unit of the communication destination is stored in the command area (50), and the response area (51)
A control unit (12) that reads the response data from the command, and after storing the command, all the processing units (CPU0, C
The communication control unit (CCA) is provided with a notification means (1) for sending out an interrupt signal (52) common to PUn), and is activated by the interrupt signal (52), and the command to itself is sent to the command. When the response data exists in the area (50), the communication processing means (4) for storing the response data in the response area (51) is connected to the processing unit (CPU0, C
The communication controller (CCA) outputs a common interrupt signal (52) after storing a command in the communication memory (3) to communicate with the processing units (CPU0, CPUn). Features a communication control method between processors.
に設けられた通信処理プログラム(2)であることを特
徴とする特許請求の範囲第(1)項記載のプロセッサ間
の通信制御方式。(2) The communication processing means (4) is a communication control unit (CCA)
The inter-processor communication control method according to claim (1), characterized in that the communication processing program (2) is provided in a communication processing program (2).
Priority Applications (1)
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JP24438586A JPS6398761A (en) | 1986-10-15 | 1986-10-15 | Inter-processor communication control system |
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JP (1) | JPS6398761A (en) |
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH02213976A (en) * | 1988-12-29 | 1990-08-27 | Internatl Business Mach Corp <Ibm> | Communication method between multiprocessing computer and processor |
US7691072B2 (en) | 2002-02-22 | 2010-04-06 | Lg Household & Health Care Ltd. | Spout for spraying aerosol and massaging and container comprising the spout |
-
1986
- 1986-10-15 JP JP24438586A patent/JPS6398761A/en active Pending
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH02213976A (en) * | 1988-12-29 | 1990-08-27 | Internatl Business Mach Corp <Ibm> | Communication method between multiprocessing computer and processor |
US7691072B2 (en) | 2002-02-22 | 2010-04-06 | Lg Household & Health Care Ltd. | Spout for spraying aerosol and massaging and container comprising the spout |
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