JPS6397042A - Line interface device - Google Patents
Line interface deviceInfo
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- JPS6397042A JPS6397042A JP61241981A JP24198186A JPS6397042A JP S6397042 A JPS6397042 A JP S6397042A JP 61241981 A JP61241981 A JP 61241981A JP 24198186 A JP24198186 A JP 24198186A JP S6397042 A JPS6397042 A JP S6397042A
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- Power Sources (AREA)
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Abstract
Description
【発明の詳細な説明】
（産業上の利用分野）
本発明は、ＬＡＮ （ローカル・エリア・ネットワーク
）等において用いられる回線インターフェース装置に関
する。DETAILED DESCRIPTION OF THE INVENTION (Field of Industrial Application) The present invention relates to a line interface device used in a LAN (Local Area Network) or the like.
（従来の技術）
ＬＡＮ等において用いられる回線インターフェース装置
としては、従来、第５図に示すものが知られている。(Prior Art) As a line interface device used in a LAN or the like, the one shown in FIG. 5 is conventionally known.
この図に示す回線インターフェース装置１は、電源スィ
ッチ２によって制御される電源制御部と、この電源制御
部が出力する電源電圧で動作する周辺機器入出力制御部
、ネットワーク入出力制御部等とを備えており、各周辺
機器３から入力された情報をケーブル４を介して他の回
線インターフェース装置１に伝送したり、これら伯の回
線インターフェース装置１から伝送された情報をケーブ
ル４を介して受信して、これを各周辺ＩＩｌ器３に供給
したりする。The line interface device 1 shown in this figure includes a power supply control section controlled by a power switch 2, a peripheral device input/output control section, a network input/output control section, etc. that operate with the power supply voltage output from this power supply control section. It transmits information input from each peripheral device 3 to other line interface devices 1 via cable 4, and receives information transmitted from these line interface devices 1 via cable 4. , and supplies this to each peripheral device 3.
（発明が解決しようとする問題点）
ところでこのような従来の回線インターフェース装置に
おいては、電源スィッチ２をオン／オフすることによっ
て回線インターフェース装置１をオン／オフするように
していたので、各周辺機器３を使用している人のうち、
Ｒｍの人が回線インターフェース装置１の電源を切らな
ければならない。(Problems to be Solved by the Invention) However, in such a conventional line interface device, the line interface device 1 was turned on and off by turning on and off the power switch 2, so each peripheral device Of those using 3,
Person Rm must turn off the power to line interface device 1.
しかしながらこの場合、他の人が周辺機器３を使用する
と思ってＲ後の人が回線インターフェース装置１の電源
をオフしなかったり、他の人が周辺機器３を使用してい
るのにかかわらず、この人が席を外した時、別の人が自
分を最後の人だと思い込んで、回線インターフェース装
置１の電源をオフにしてしまうことがあった。However, in this case, the person after R did not turn off the power to the line interface device 1 because he or she thought that another person would use the peripheral device 3, or even though another person was using the peripheral device 3. When this person leaves his/her seat, another person may think that he or she is the last person and turn off the power to the line interface device 1.
本発明は上記の事情に鑑み、各周辺様器を使用している
人のうち、最後の人がその使用を止めたときには、回線
インターフェース装置自身の電源を自動的に切ることが
できる回線インターフェース装置を提供することを目的
としている。In view of the above circumstances, the present invention provides a line interface device that can automatically turn off the power of the line interface device itself when the last person who uses each peripheral device stops using it. is intended to provide.
（問題点を解決するための手段）
上記問題点を解決するため本発明による回線インターフ
ェース装置は、通信回線と、１つ以上の周辺機器とを接
続する回線インターフェース装置において、外部から供
給される電′ｆＱ電圧から内部電源電圧を生成して装置
各部に供給する電源回路と、前記周辺機器の電源オン／
オフ状態を検知する電源状態検知部と、この電源状態検
知部によって前記周辺機器の全てについて電源オフが検
出されたときに前記電源回路をオフさせて装置の電源を
切る制御回路とを備えたことを特徴としている。(Means for Solving the Problems) In order to solve the above problems, a line interface device according to the present invention is a line interface device that connects a communication line and one or more peripheral devices. A power supply circuit that generates an internal power supply voltage from the fQ voltage and supplies it to each part of the device, and a power supply circuit that generates an internal power supply voltage from the
The device includes a power state detection section that detects an off state, and a control circuit that turns off the power circuit and turns off the power of the device when the power state detection section detects that all of the peripheral devices are powered off. It is characterized by
（実施例）
第１図は本発明による回線インターフェース装置の一実
施例を示すブロック図である。(Embodiment) FIG. 1 is a block diagram showing an embodiment of a line interface device according to the present invention.
この図に示す回線インターフェース装置９は、電源制御
部１０と、周辺機器入出力制御部１１と、制御部（ＣＰ
Ｕ）１２と、ネットワーク入出力制御部１３とを備えて
おり、ケーブル１４を介して供給された情報を各周辺機
器１５へ供給したり、これら各周辺機器１５から入力さ
れた情報をケーブル１４を介して他の回線インターフェ
ース装置に伝えたりする。The line interface device 9 shown in this figure includes a power supply control section 10, a peripheral device input/output control section 11, and a control section (CP
U) 12 and a network input/output control unit 13, which supplies information supplied via the cable 14 to each peripheral device 15, and transmits information input from each peripheral device 15 via the cable 14. It is also transmitted to other line interface devices via the network interface.
電源制御部１０は、第２図に示す如く、電源制御回路１
７を備えており、装置の外部パネルに設けられた電源ス
ィッチ（例えば、モーメンタリ型のスイッチ）１６が押
されて第１制御端子１７Ｇにオン信号が供給されたとき
、電源制御回路１７がオンして、入力端子１７ａに印加
されている外部電源電圧（例えば、ＡＣＩ ０ＯＶ）か
ら内部電源電圧（例えば、ＤＣ５Ｖ等）を生成して、こ
れを出力端子１７ｂを介して周辺機器入出力制御部１１
、制御部１２、ネットワーク入出力制御部１３等に供給
する。そして、その第２１．制御端子１７ｄにオフ信号
が供給されたとき、電源制御回路１７がオフして前記周
辺機器入出力制御部１１、ｔｉ制御部１２、ネットワー
ク入出力制御部１３等に内部ｆｆｉ［電圧を供給しなく
なる。これによって、回線インターフェース装２！９が
オフ状態になる。The power supply control section 10 includes a power supply control circuit 1 as shown in FIG.
7, and when the power switch (for example, a momentary type switch) 16 provided on the external panel of the device is pressed and an on signal is supplied to the first control terminal 17G, the power control circuit 17 is turned on. Then, an internal power supply voltage (for example, DC 5V, etc.) is generated from the external power supply voltage (for example, ACI 0OV) applied to the input terminal 17a, and this is sent to the peripheral device input/output control unit 11 via the output terminal 17b.
, the control unit 12, the network input/output control unit 13, etc. And the 21st. When an off signal is supplied to the control terminal 17d, the power supply control circuit 17 is turned off and no longer supplies internal ffi voltage to the peripheral device input/output control section 11, TI control section 12, network input/output control section 13, etc. . As a result, the line interface device 2!9 is turned off.
また周辺機器入出力制御部１１は、第３図に示す如く、
複数のＡＣＩＡ１８と、１つの信号線検出回路１９とを
怖えており、前記各周辺機器１５から情報を入力された
ときに、これを受けてＣＰＵ１２へ供給したり、このＣ
ＰＵ１２から情報が出力されたときに、これを各周辺１
１器１５に供給したりするとともに、前記各周辺ｇｌ器
１５の電源が全てにオフされたとき、これを検出してＣ
ＰＵ１２に７ｒｉ源オフ検出信号を供給する。Further, the peripheral device input/output control unit 11, as shown in FIG.
There are multiple ACIAs 18 and one signal line detection circuit 19, and when information is input from each peripheral device 15, it receives the information and supplies it to the CPU 12, and this C
When information is output from PU12, it is sent to each peripheral 1.
At the same time, when the power of each peripheral GL device 15 is turned off, this is detected and the C
A 7ri source off detection signal is supplied to the PU12.
この場合、八ＣｌＡ１８は、周辺機器１５がオンしてい
るときに常時出力される信号ＤＲ，Ｒ８（周辺機器１５
がオンしているとき、これら各信号ＤＲ，Ｒ８のいずれ
かは１″になっている）に基づいて動作するように構成
されており、前記ＣＰＵ１２が出力する信号（データ信
＠）を取り込んで、これを信号ＳＤとして周辺機器１５
に供給したり、この周辺１５１器１５が出力する信号Ｒ
Ｄ（これは、データ信号）を取り込んで、これをＣＰＵ
１２に供給したりする。In this case, 8ClA18 outputs signals DR and R8 (peripheral device 15
is on, either of these signals DR, R8 is 1''), and it takes in the signal (data signal @) output by the CPU 12. , this is used as the signal SD for the peripheral device 15.
The signal R output from this peripheral 151
D (this is a data signal) and sends it to the CPU
12.
また前記信号線検出回路１９は、前記各周辺機器１５が
信号ＯＲ，Ｒ８を出力しているかどうかを検出し、これ
ら各周辺機器１５から信号ＤＲ１Ｒ８が全て出力されな
くなったとき、全ての周辺機器１５がオフされたことを
示す′ｉＩｉ源オフ検出信号を発生して、これをＣＰＵ
１２に供給する。Further, the signal line detection circuit 19 detects whether each of the peripheral devices 15 outputs the signals OR and R8, and when all the signals DR1R8 are no longer output from each of the peripheral devices 15, all the peripheral devices 15 Generates a 'iIi source off detection signal indicating that the
Supply to 12.
またネットワーク入出力υ制御部１３は、ＣＰＵ１２が
情報を出力したとき、この情報から通信信号を生成して
ケーブル１４上に送り出したり、このケーブル１４上に
送出された他の回線インターフェース装置からの通信信
号を取り込んで、これをＣＰＬ１１２で処理できる情報
に変換してＣＰＬ１１２へ供給したりする。In addition, when the CPU 12 outputs information, the network input/output υ control unit 13 generates a communication signal from this information and sends it onto the cable 14, and also controls communication from other line interface devices sent onto the cable 14. It takes in a signal, converts it into information that can be processed by the CPL 112, and supplies it to the CPL 112.
ＣＰＵ１２は、マイクロプロセッサ等を備えており、前
記ネットワーク入出力制御部１３から情報が供給された
とき、これをその宛先に対応するＡＣＩＡ１８に送った
り、各ＡＣＩＡ１８から情報を供給されたとき、これを
ネットワーク入出力制御部１３に供給したりする。また
、前記周辺機器入出力制御部１１の信号線検出回路１９
から電源オフ検出信号が出力されたとき、ＣＰＵ１２は
電源制御回路１７の第２１．ＩＪ御端子１７ｄにオフ信
号を供給し、電源制御部１０をオフさせる。The CPU 12 is equipped with a microprocessor, etc., and when information is supplied from the network input/output control section 13, it is sent to the ACIA 18 corresponding to its destination, and when information is supplied from each ACIA 18, it is sent to the ACIA 18. It is also supplied to the network input/output control unit 13. Further, the signal line detection circuit 19 of the peripheral device input/output control section 11
When the power off detection signal is output from the 21st . An off signal is supplied to the IJ control terminal 17d to turn off the power supply control section 10.
次に、第４図（Ａ）〜（Ｄ）に示すタイミングチャート
を参照しながらこの実施例の動作を説明する。Next, the operation of this embodiment will be explained with reference to the timing charts shown in FIGS. 4(A) to 4(D).
まず、第４図（Ａ）に示す如く電源制御部１０内に設け
られた電源制御回路１７の入力端子１７ａに外部ｆｆ１
ｌ電圧が印加されている状態で、各周辺機器１５を使用
する最初の操作員が電源スィッチ１６を押し、Ｘｆ源制
御回路１７の第１制御ｌｌ端子１７Ｃに第４図（Ｂ）に
示すオン信号が供給されれば、電源制御回路１７がオン
して第４図（Ｄ）に示す如く内部電源電圧を生成し、こ
れを周辺機器入出力制御部１１、制御部１２、ネットワ
ーク入出力制御部１３等に供給してこの回線インターフ
ェース装置９をオンさせる。この後、周辺機器１５が全
て使用されなくなってこれら各周辺機器１５から信号Ｄ
Ｒ，Ｒ８が全て出力されなくなったとき、信号線検出回
路１９がこれを検出してＣＰＵ１２に電源オフ検出信号
を供給する。これによって、ＣＰＵ１２は各周辺機器１
５が全て使用されなくなったと判断して第４図（Ｃ）に
示す如くオフ信号を発生し、これをＭ ｍ ｉｌＪ御回
路１７の第２制御端子１７ｄに供給して、この電源制御
回路１７をオフさせ、回線インターフェース装置９全体
をオフさせる。First, as shown in FIG. 4(A), the input terminal 17a of the power supply control circuit 17 provided in the power supply control section 10 is
With l voltage being applied, the first operator to use each peripheral device 15 presses the power switch 16, and the first control ll terminal 17C of the Xf source control circuit 17 is turned on as shown in FIG. 4(B). When the signal is supplied, the power supply control circuit 17 turns on and generates an internal power supply voltage as shown in FIG. 13 etc. to turn on this line interface device 9. After this, all the peripheral devices 15 are no longer used and the signal D is output from each peripheral device 15.
When R and R8 are all no longer output, the signal line detection circuit 19 detects this and supplies a power off detection signal to the CPU 12. As a result, the CPU 12
5 is no longer used, generates an off signal as shown in FIG. The entire line interface device 9 is turned off.
この侵、電源スィッチ１６が再度、押されれば、上述し
た動作が再びくり返されて、周辺機器１５が全てオフさ
れるまで回線インターフェース装置９がオンし続け、こ
れら各周辺機器１５が全てオフにされたとぎ、回線イン
ターフェース装置９の’ＩＦＪが自動的に切れる。If the power switch 16 is pressed again in this case, the above-mentioned operation is repeated again, and the line interface device 9 continues to be turned on until all peripheral devices 15 are turned off, and all of these peripheral devices 15 are turned off. IFJ of the line interface device 9 is automatically disconnected.
これによって、各周辺機器１５を使用している人のうち
、Ｒｍの人がこれを使用しなくなったとき、回線インタ
ーフェース装置９の電源を自動的に切ることができる。As a result, when the person Rm who uses each peripheral device 15 no longer uses it, the power to the line interface device 9 can be automatically turned off.
（発明の効果）
以上説明したように本発明によれば、各周辺機器を使用
している人のうち、最後の人がその使用を止めたときに
は、回線インターフェース装置自身の電源を自動的に切
ることができる。(Effects of the Invention) As explained above, according to the present invention, when the last person who is using each peripheral device stops using it, the power of the line interface device itself is automatically turned off. be able to.
第１図は本発明による回線インターフェース装置の一実
施例を示すブロック図、第２図は第１図に示す電源制御
部の詳細なブロック図、第３図は第１図に示す周辺機器
入出力制御部の詳細なブロック図、第４図（Ａ）〜（Ｄ
）は各々同実施例の動作例を示すタイミングチャート、
第５図は従来の回線インターフェース装置の一例を示す
ブロック図である。
９・・・回線インターフェース装置、１０・・・電源回
路（ｍ源制御部）、１１・・・電源状態検知部（周辺機
器入出力！１３６！１部）、１２・・・制御回路（制御
部）、１４・・・通信口ｎ（ケーブル）。
代理人 弁理士 岩倉哲二（他１名）第 １ 図
９− 回線インターフェース装置
１〇−電源回路（電源ｗ８）
′、１− 電５Ｗ（ν剣ａ部（局ワ２４稽入土又商ば萌
ｆ）１２− ｗＩ８路（制餌部）
１４− 通信線（ケーブル）
第２図
Ｃ１）Ｕ１２からのオフ信号FIG. 1 is a block diagram showing an embodiment of the line interface device according to the present invention, FIG. 2 is a detailed block diagram of the power supply control section shown in FIG. 1, and FIG. 3 is a peripheral device input/output shown in FIG. 1. Detailed block diagram of the control unit, FIGS. 4(A) to (D)
) are timing charts showing operation examples of the same embodiment,
FIG. 5 is a block diagram showing an example of a conventional line interface device. 9... Line interface device, 10... Power supply circuit (m source control unit), 11... Power state detection unit (peripheral device input/output! 136! 1 part), 12... Control circuit (control unit) ), 14...Communication port n (cable). Agent Patent attorney Tetsuji Iwakura (and 1 other person) No. 1 Figure 9- Line interface device 10- Power supply circuit (power supply w8) ) 12- wI8 path (feed control section) 14- Communication line (cable) Fig. 2 C1) Off signal from U12
Claims (1)
ターフエース装置において、外部から供給される電源電
圧から内部電源電圧を生成して装置各部に供給する電源
回路と、前記周辺機器の電源オン／オフ状態を検知する
電源状態検知部と、この電源状態検知部によつて前記周
辺機器の全てについて電源オフが検出されたときに前記
電源回路をオフさせて装置の電源を切る制御回路とを備
えたことを特徴とする回線インターフエース装置。In a line interface device that connects a communication line and one or more peripheral devices, there is a power supply circuit that generates an internal power supply voltage from an external power supply voltage and supplies it to each part of the device, and a power supply circuit that turns on the power of the peripheral device. / a power state detection section that detects an off state; and a control circuit that turns off the power circuit and turns off the power of the device when the power state detection section detects that all of the peripheral devices are powered off. A line interface device characterized by:
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP61241981A JPS6397042A (en) | 1986-10-14 | 1986-10-14 | Line interface device |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP61241981A JPS6397042A (en) | 1986-10-14 | 1986-10-14 | Line interface device |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6397042A true JPS6397042A (en) | 1988-04-27 |
Family
ID=17082467
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP61241981A Pending JPS6397042A (en) | 1986-10-14 | 1986-10-14 | Line interface device |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6397042A (en) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0338710A (en) * | 1989-07-05 | 1991-02-19 | Shizuoka Nippon Denki Software Kk | Automatic stop control system for computer |
-
1986
- 1986-10-14 JP JP61241981A patent/JPS6397042A/en active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0338710A (en) * | 1989-07-05 | 1991-02-19 | Shizuoka Nippon Denki Software Kk | Automatic stop control system for computer |
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