JPS6328476Y2 - - Google Patents
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- JPS6328476Y2 JPS6328476Y2 JP1986135220U JP13522086U JPS6328476Y2 JP S6328476 Y2 JPS6328476 Y2 JP S6328476Y2 JP 1986135220 U JP1986135220 U JP 1986135220U JP 13522086 U JP13522086 U JP 13522086U JP S6328476 Y2 JPS6328476 Y2 JP S6328476Y2
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Description
本考案は時分割された各エンベロープ波形の振
幅値を変化できるようにしたエンベロープ発生装
置を具えた電子楽器に関するものである。
従来の電子楽器のエンベロープ信号発生回路の
方式にはコンデンサと抵抗より成る時定数回路の
充放電特性を利用したアナログ方式と量子化ステ
ツプ情報を記憶させたデジタル方式とがある。し
かし、アナログ方式ではエンベロープを構成する
ADSR（アタツク、デイケイ、サステイン、リリ
ース）各部分に対し各種の特性を用意するため、
多数の抵抗器、ダイオード、切換スイツチを組合
せて切り換える形式があるが回路構成が複雑とな
る。これに対し、デジタル方式では量子化ステツ
プ数を密にしてしかも各種のアタツク時間、デイ
ケイ時間の特性を用意するには、これらの情報を
記憶する記憶容量がぼう大なものとなるという問
題点があつた。
これに対し本出願人は新規のエンベロープ発生
回路を提案している。すなわち、アタツク、デイ
ケイ時間に関連する係数を記憶回路に記憶してお
き、該係数を累算器で累算し、累算出力信号をア
ドレスとしてエンベロープ波形記憶回路からエン
ベロープ波形を読み出すものであり、アタツク波
形とデイケイ波形を共通にしてデイケイ波形はエ
ンベロープ波形を反転して形成するものである。
これにより各種のアタツク時間、デイケイ時間の
エンベロープ波形を少ない記憶容量で得ることが
できる。この場合キースイツチまたはセレクトス
イツチで選択される各エンベロープは各チヤンネ
ル毎に時分割で処理されている。しかし従来はど
のチヤンネルも振幅値が同一であるため平板的な
印象を免れなかつた。そこで、このチヤンネルの
振幅値に変化を与えて趣きのある楽音を得ること
が要望される。
本考案の目的は提案のエンベロープ発生装置に
つき時分割されたエンベロープの振幅値を変化で
きるようにした電子楽器を提供することである。
前記目的を達成するため、本考案の電子楽器
は、タイミングパルスを発生するタイミング発生
回路と、該タイミング発生回路で駆動されるアド
レスカウンタと、該アドレスカウンタのアドレス
パルスによつて、アタツク・デイケイ時間を制御
する係数が読出されるアタツク・デイケイ係数メ
モリと、該アタツク・デイケイ係数メモリからの
アタツク・デイケイ係数と記憶回路からの読出し
値とを加算する加算器と該加算結果を記憶し再び
加算回路に読出す上記記憶回路とより成り、前記
タイミング発生回路のタイミングパルスと前記ア
ドレスカウンタのアドレスパルスとに応じ、前記
加算器から前記アタツク・デイケイ係数の累算出
力信号を出力するとともに累算出力が所定値にな
つたことを検知してアタツク・デイケイの各終了
信号を出力する累算器と、外部からのアタツク信
号と前記累算器からのアタツク・デイケイの各終
了信号とにより累算器に与える係数をアタツクの
時はアタツク係数とし、デイケイの時はデイケイ
係数とするエンベロープ制御回路と、対数曲線を
持つエンベロープ波形の振幅を記憶し前記累算出
力信号により読出すエンベロープ波形テーブルお
よび該エンベロープ波形テーブルの出力信号を反
転または非反転するEX−OR回路と、該EX−
OR回路の出力信号をアナログ波形に変換する
Ｄ／Ａ変換器と、前記アドレスカウンタの出力信
号を用いて各チヤンネルに対応する時分割多重化
信号を出力するチヤンネルデコーダと、前記Ｄ／
Ａ変換器のアナログ出力を対応するチヤンネル毎
に時分割し、振分けるアナログマルチプレクサ
と、各チヤンネル毎の振幅値を独立して制御する
ための振幅値を記憶し時分割で読出されるエンベ
ロープ振幅値メモリと該エンベロープ振幅値メモ
リ出力をＤ／Ａ変換して前記エンベロープ波形
Ｄ／Ａ変換器に入力してエンベロープＤ／Ａ変換
器の出力のレベルを制御するレベルＤ／Ａ変換器
とを具備し、
前記累算器を上記時分割多重化信号を用いて各
チヤンネルで時分割動作させるとともに前記累算
器からのアドレスで各チヤンネルのアタツク対応
のエンベロープ波形を形成した後、累算器からの
デイケイ期間出力信号により前記アタツク・デイ
ケイ係数メモリの読出しをデイケイ係数とすると
ともに前記エンベロープ波形テーブルからのエン
ベロープ波形データを上記EX−OR回路で反転
させてデイケイ波形を形成し、かつ、前記累算器
からのデイケイ終了信号によりエンベロープ制御
回路は累算を終了させることによりエンベロープ
波形の全てを形成し、
その後対応するチヤンネル毎に、前記アドレス
カウンタの出力信号から、前記チヤンネルデコー
ダの各チヤンネルの時分割多重化信号を得て、前
記アナログマルチプレクサにより時分割して振分
け出力するとともに、前記エンベロープ振幅値メ
モリからの出力信号をレベルＤ／Ａ変換器により
レベル変換しエンベロープＤ／Ａ変換器の出力の
レベルを制御するようにしたことを特徴とするも
のである。
以下本考案を施例につき詳述する。
第１図は本考案の実施例の構成を示す説明図で
ある。同図は前述の提案のエンベロープ発生回路
に本考案の構成を付加したものである。いま、電
子楽器の鍵盤回路の押鍵信号またはリズム発生装
置のリズムパターン信号によるアタツク信号をエ
ンベロープ発生回路に入力させる。ここで音源数
を16として16チヤンネルを設け、そのエンベロー
プ波形の形成を時分割で行なうものとする。同図
において、リズムパターン発生器よりのリズムパ
ターン信号（以下アタツク信号という）とエンベ
ロープ制御回路１７に入力し、エンベロープ波形
のアタツクとデイケイのタイミングを後述の信号
Ｃ１，Ｃ２により形成し、タイミングクロツク発
生回路１９で駆動するアドレスカウンタ２０を介
して指定されるチヤンネルデコーダ２１からのチ
ヤンネル指定信号をエンベロープ制御回路１７に
与え、指定されたアドレス信号をOR回路１５を
介してアタツクデイケイ係数メモリ１３に入力す
る。アタツクデイケイ係数メモリ１３はアドレス
カウンタ２０からのアドレスにより、後述のアタ
ツクとデイケイの加算係数を読み出し、加算器、
ゲート回路、レジスタ、記憶回路（RAM）より
成る累算器１１に与える。
累算器１１においては、アドレスカウンタ２０
からのアドレスと、エンベロープ制御回路１７か
らOR回路１６を介して与えられるチヤンネル指
定信号により指定され、加算係数が後述する方法
で累算されて累算出力信号として８ビツトの２進
のアドレス情報を出力し、エンベロープ波形テー
ブル１４に与える。累算器１１の処理データは10
ビツトとし、前記８ビツトのアドレスデータの外
に桁上げ信号C1，C2が含まれる。そして８ビツ
トのアドレスデータがエンベロープ波形テーブル
１４に送られる場合上位５ビツトをアドレスと
し、下位３ビツトは切り捨てられる。また信号Ｃ
１はアタツク期間が終了したことを示し、信号Ｃ
２はデイケイが終了したことを表わし、前述のエ
ンベロープ制御回路１７に送られる。この累算器
１１においては16チヤンネルに対応し16個のエン
ベロープ波形の累算出力信号が得られる。
アタツクデイケイ係数メモリ１３に格納される
アタツク、デイケイ係数により累算されるエンベ
ロープ波形の立上り、立下り間のエンベロープ時
間Ｔは下式により求められる。
Ｔ＝Ｎ×Ｗ／CL／ｎ×AAD
ここで Ｎ；チヤンネル数
Ｗ；ワード数
AAD；エンベロープ加算係数
CL；クロツク周波数
ｎ；タイミング分周数
実施例でＮ＝16，Ｗ＝32，ｎ＝４とすれば
Ｔ＝512×４／CL×AAD
いまCL＝10KHzとすれば
AAD＝１／23のとき Ｔ＝1.64秒
AAD＝１のとき Ｔ＝0.20秒
となる。
以上のようにしてエンベロープ加算係数値AAD
により、アタツク、デイケイの立上り、立下り時
間が決まる。そしてアタツクデイケイ係数メモリ
１３は１６の音源に対応したアタツク、デイケイ
の加算係数値AADを記憶するものである。
第１表はアタツクとデイケイにつき、係数値
AADの累算時間Ｔ（秒）の１例を示したものであ
る。
The present invention relates to an electronic musical instrument equipped with an envelope generator capable of changing the amplitude value of each time-divided envelope waveform. Conventional envelope signal generation circuit systems for electronic musical instruments include an analog system that utilizes the charging and discharging characteristics of a time constant circuit consisting of a capacitor and a resistor, and a digital system that stores quantization step information. However, in the analog method, the envelope is
In order to prepare various characteristics for each part of ADSR (Attack, Decay, Sustain, Release),
There is a type of switching that combines a large number of resistors, diodes, and changeover switches, but the circuit configuration is complicated. In contrast, digital methods have the problem that in order to increase the number of quantization steps and provide various attack time and decay time characteristics, the storage capacity for storing this information becomes enormous. It was hot. In response, the present applicant has proposed a new envelope generation circuit. That is, coefficients related to attack and decay times are stored in a memory circuit, the coefficients are accumulated in an accumulator, and the envelope waveform is read out from the envelope waveform memory circuit using the accumulated output signal as an address. The attack waveform and the decay waveform are common, and the decay waveform is formed by inverting the envelope waveform.
As a result, envelope waveforms of various attack times and decay times can be obtained with a small storage capacity. In this case, each envelope selected by the key switch or select switch is processed in a time-division manner for each channel. However, in the past, all channels had the same amplitude value, giving the impression of a flat panel. Therefore, it is desired to obtain an interesting musical tone by varying the amplitude value of this channel. An object of the present invention is to provide an electronic musical instrument that can change the amplitude value of the time-divided envelope using the proposed envelope generator. In order to achieve the above object, the electronic musical instrument of the present invention includes a timing generation circuit that generates a timing pulse, an address counter driven by the timing generation circuit, and an address pulse of the address counter that generates an attack decay time. an attack decay coefficient memory from which coefficients for controlling the control are read, an adder for adding the attack decay coefficient from the attack decay coefficient memory and a value read from the storage circuit, and a circuit for storing the addition result and adding it again. and the storage circuit for reading out the attack decay coefficient from the adder in response to the timing pulse of the timing generation circuit and the address pulse of the address counter. an accumulator that detects that a predetermined value has been reached and outputs each attack/decay end signal; an envelope control circuit that uses a coefficient to be given as an attack coefficient in the case of attack and as a decay coefficient in the case of decay; an envelope waveform table that stores the amplitude of an envelope waveform having a logarithmic curve and reads it out using the cumulative output signal; and the envelope waveform. An EX-OR circuit that inverts or non-inverts the output signal of the table, and
a D/A converter that converts the output signal of the OR circuit into an analog waveform; a channel decoder that outputs a time division multiplexed signal corresponding to each channel using the output signal of the address counter;
An analog multiplexer that time-divisions and distributes the analog output of the A converter to each corresponding channel, and an envelope amplitude value that stores and reads out the amplitude value in a time-division manner to independently control the amplitude value of each channel. It comprises a memory and a level D/A converter which D/A converts the envelope amplitude value memory output and inputs it to the envelope waveform D/A converter to control the level of the output of the envelope D/A converter. , The accumulator is time-divisionally operated on each channel using the time-division multiplexed signal, and an envelope waveform corresponding to the attack of each channel is formed using the address from the accumulator, and then the decay signal from the accumulator is The period output signal reads out the attack decay coefficient memory as a decay coefficient, and the envelope waveform data from the envelope waveform table is inverted by the EX-OR circuit to form a decay waveform. The envelope control circuit forms all the envelope waveforms by terminating the accumulation by the Decay end signal, and then time-division multiplexing each channel of the channel decoder from the output signal of the address counter for each corresponding channel. A signal is obtained and distributed and outputted in a time-division manner by the analog multiplexer, and the level of the output signal from the envelope amplitude value memory is converted by a level D/A converter to control the level of the output of the envelope D/A converter. It is characterized by the fact that it is made to do so. The present invention will be described in detail below with reference to examples. FIG. 1 is an explanatory diagram showing the configuration of an embodiment of the present invention. This figure shows the configuration of the present invention added to the envelope generating circuit proposed above. Now, an attack signal based on a key press signal from the keyboard circuit of the electronic musical instrument or a rhythm pattern signal from the rhythm generator is input to the envelope generating circuit. Here, it is assumed that the number of sound sources is 16, 16 channels are provided, and the envelope waveform is formed in a time-division manner. In the figure, a rhythm pattern signal (hereinafter referred to as an attack signal) from a rhythm pattern generator is input to an envelope control circuit 17, and attack and decay timings of the envelope waveform are formed by signals C1 and C2, which will be described later, and a timing clock is generated. A channel designation signal from the channel decoder 21 designated via the address counter 20 driven by the generation circuit 19 is given to the envelope control circuit 17, and the designated address signal is input to the attack decay coefficient memory 13 through the OR circuit 15. . The attack decay coefficient memory 13 reads the attack and decay coefficients to be described later based on the address from the address counter 20, and the adder
It is applied to an accumulator 11 consisting of a gate circuit, a register, and a memory circuit (RAM). In the accumulator 11, an address counter 20
, and a channel designation signal given from the envelope control circuit 17 via the OR circuit 16, and the addition coefficients are accumulated in a manner described later to produce 8-bit binary address information as an accumulated output signal. It is output and given to the envelope waveform table 14. The processing data of accumulator 11 is 10
In addition to the 8-bit address data, carry signals C1 and C2 are included. When 8-bit address data is sent to the envelope waveform table 14, the upper 5 bits are used as the address, and the lower 3 bits are truncated. Also signal C
1 indicates that the attack period has ended, and the signal C
2 indicates that decay has ended, and is sent to the envelope control circuit 17 mentioned above. In this accumulator 11, accumulated output signals of 16 envelope waveforms corresponding to 16 channels are obtained. The envelope time T between the rise and fall of the envelope waveform accumulated by the attack and decay coefficients stored in the attack decay coefficient memory 13 is determined by the following formula. T=N×W/C L /n×A AD where N: Number of channels W; Number of words A AD ; Envelope addition coefficient C L ; Clock frequency n; Timing frequency division number In the example, N=16, W=32 , n = 4, then T = 512 x 4 / C L × A AD Now, if C L = 10KHz, then A AD = 1/2 3 , T = 1.64 seconds, A AD = 1, T = 0.20 seconds. Become. As above, envelope addition coefficient value A AD
This determines the rise and fall times of attack and decay. The attack decay coefficient memory 13 stores attack and decay addition coefficient values A AD corresponding to 16 sound sources. Table 1 shows the coefficient values for attack and decay.
An example of the cumulative time T (seconds) of A AD is shown.
【表】
エンベロープ波形テーブル１４は５ビツトの累
算出力信号をアドレスとする32ワードのエンベロ
ープ波形を記憶している。第２表はその１例を示
す。[Table] The envelope waveform table 14 stores a 32-word envelope waveform whose address is a 5-bit cumulative output signal. Table 2 shows one example.
【表】【table】
【表】
この値は下式により求めたものである。エンベ
ロープ波形テーブル１４は32ワード、８ビツトの
固定メモリ（ROM）の場合、
Ｙ；ビツト数
Ｗ；ワード数（０〜31）
この波形は第２図に示され、アタツク、デイケ
イ両波形に共用される。以上は累算器１１の出力
信号の上位５ビツトをアドレスとする32ワードで
示したが、さらに６ビツト以上とることにより量
子化ステツプ数を密にできる。
次にエンベロープ波形テーブル１４の内容を排
他的（EX）OR回路２２に入れ、信号Ｃ１によ
りアタツク波形32ワード終了後、信号Ｃ１が次の
サイクルの初期値より高レベルになると、エンベ
ロープ波形テーブル１４からのデータを反転させ
デイケイの波形を形成する。第３図ａはアタツク
とデイケイの波形の反転を示すもので、同図ｂの
信号Ｃ１はアタツクの終了を、同図ｃの信号Ｃ２
はデイケイの終了を示すこととなる。この場合、
エンベロープ波形テーブル１４の同じ内容をアタ
ツクとデイケイに共通の波形として使用する。次
にEX−OR回路２２の出力をＤ／Ａ変換器２３
を通してアナログ量に変換し、次のアナログマル
チプレクサ２４により時分割されたアナログデー
タを各チヤンネル毎に振り分け、サンプルホール
ド回路２５により1/16単位時間のアナログデータ
をホールドする。
以上は別出願によるエンベロープ発生回路のと
おりであるが、本考案では各チヤンネル毎のエン
ベロープの振幅値を変化できるようにするため、
アドレスカウンタ２０からのアドレスを入力し
てエンベロープ振幅値を読み出すエンベロープ振
幅値メモリ３１と、読み出した振幅値データを
アナログ変換するレベルＤ／Ａ変換器３２とを付
加し、レベルＤ／Ａ変換器３２からの時分割され
たアナログデータ 1′ を前述のエンベロープ発生
回路のＤ／Ａ変換器２３に入力し、対応する時分
割エンベロープ波形と乗算してレベル変化出力
を得るものである。
第４図は第１図における本考案の要部の詳細説
明図である。
同図において、EX−OR回路２２からのエン
ベロープ波形の８ビツトデータをエンベロープ
Ｄ／Ａ変換器２３でアナログデータに変換し、
演算増幅器を介して16チヤンネルのアナログマル
チプレクサ２４に入れ、各チヤンネルCH１〜
CH１６に振り分けて出力することは、第１図で
前述したとおりである。本考案の場合、エンベロ
ープＤ／Ａ変換器２３としてとくに乗算形Ｄ／Ａ
変換器が用いられ、EX−OR回路２２からの８
ビツトデータ入力に対し、チヤンネル対応に
REF（参照）端子からのレベル情報（係数）を乗
算させることにより、そのアナログ出力にレベル
変化をもたせるようにしたものである。
このレベル情報を与えるため、エンベロープ振
幅値メモリ３１に各チヤンネルに対応した８ビツ
トのレベル情報を記憶させておき、第１図の（チ
ヤンネル）アドレスカウンタ２０からのアドレス
により読み出す。このアドレスはアナログマル
チプレクサ２４に与えられるアドレスが分岐して
与えられている。このエンベロープ振幅値メモリ
３１から出力したレベル情報はレベルＤ／Ａ変
換器３２によりアナログ信号に変換し、演算増幅
器を介してアナログレベル情報 1′ を前述のエン
ベロープＤ／Ａ変換器２３のREF端子に入力し、
エンベロープ波形データに対しチヤンネル対応の
乗算を行なう。たとえばエンベロープＤ／Ａ変換
器２３の時分割の第１チヤンネルCH１のエンベ
ロープ波形データにエンベロープ振幅値メモリ３
１からの１番地のレベル情報を乗算し、次に第２
チヤンネルCH２のエンベロープ波形データに２
番地のレベル情報を乗算するというように、全チ
ヤンネルにつき同様の動作を行ない、その出力信
号のレベル変化を行なうものである。
実施例では、エンベロープ振幅値メモリ３１に
８ビツトのレベル情報を記憶させているので、最
大データは“11111111”であり、10進では255で
ある。従つて１ステツプは１／255であり、レベ
ル比Ｒは次式で与えられる。
Ｒ＝20ogＸ／255
ここでＸ；ステツプ数（０≦Ｘ≦255）
レベルの最大値を0dBとすると、１ステツプダ
ウンではＸ＝254であり、Ｒ＝−0.034dBダウン
となる。
3dBダウンさせるためには、Ｒ＝−3dBである
からＸ＝181ステツプとればよいことになる。
以上説明したように、本考案によれば、前述の
提案のエンベロープ発生装置から各チヤンネル毎
のエンベロープ波形を時分割で出力し、各チヤン
ネル毎の所望のエンベロープ振幅値をエンベロー
プ振幅値記憶回路に記憶し、該エンベロープ振幅
値をＤ／Ａ変換器でアナログ量に変換し、前記エ
ンベロープ波形を乗算形Ｄ／Ａ変換器に入れて前
記Ｄ／Ａ変換器の出力信号に比例するアナログ量
に変換するものである。これにより各チヤンネル
毎にエンベロープ波形の振幅値を変化したものが
得られ、従来の各チヤンネルが同レベルであるも
のに比べ変化に富んだ趣きのある楽音を出力する
ことが可能となる。[Table] This value was calculated using the formula below. If the envelope waveform table 14 is a 32-word, 8-bit fixed memory (ROM), Y: Number of bits W: Number of words (0 to 31) This waveform is shown in FIG. 2 and is shared by both the attack and decay waveforms. Although the above example uses 32 words with the upper 5 bits of the output signal of the accumulator 11 as the address, the number of quantization steps can be made denser by using 6 or more bits. Next, the contents of the envelope waveform table 14 are input into the exclusive (EX) OR circuit 22, and when the signal C1 becomes higher level than the initial value of the next cycle after the completion of 32 words of the attack waveform by the signal C1, the contents of the envelope waveform table 14 are input. The data is inverted to form the Decay waveform. Figure 3a shows the inversion of the attack and decay waveforms; signal C1 in Figure 3b indicates the end of the attack; signal C2 in Figure 3C indicates the end of the attack;
indicates the end of Decay. in this case,
The same contents of the envelope waveform table 14 are used as a common waveform for attack and decay. Next, the output of the EX-OR circuit 22 is transferred to the D/A converter 23.
The time-divided analog data is then distributed to each channel by the analog multiplexer 24, and the sample and hold circuit 25 holds the analog data of 1/16 unit time. The above is the same as the envelope generation circuit filed separately, but in the present invention, in order to be able to change the amplitude value of the envelope for each channel,
An envelope amplitude value memory 31 that inputs the address from the address counter 20 and reads out the envelope amplitude value, and a level D/A converter 32 that converts the read amplitude value data into analog are added. The time-divided analog data 1' is input to the D/A converter 23 of the envelope generating circuit described above, and is multiplied by the corresponding time-division envelope waveform to obtain a level-change output. FIG. 4 is a detailed explanatory diagram of the main parts of the present invention in FIG. 1. In the figure, 8-bit envelope waveform data from an EX-OR circuit 22 is converted into analog data by an envelope D/A converter 23,
It is input to the 16-channel analog multiplexer 24 through an operational amplifier, and each channel CH1~
The distribution and output to CH16 is as described above with reference to FIG. In the case of the present invention, the envelope D/A converter 23 is a multiplication type D/A converter.
A converter is used and the 8 from EX-OR circuit 22
Channel support for bit data input
By multiplying the level information (coefficient) from the REF (reference) terminal, the analog output is made to have a level change. In order to provide this level information, 8-bit level information corresponding to each channel is stored in the envelope amplitude value memory 31, and is read out using the address from the (channel) address counter 20 in FIG. This address is given by branching the address given to the analog multiplexer 24. The level information output from the envelope amplitude value memory 31 is converted into an analog signal by the level D/A converter 32, and the analog level information 1' is sent to the REF terminal of the envelope D/A converter 23 through the operational amplifier. Input,
Perform channel-compatible multiplication on envelope waveform data. For example, the envelope waveform data of the first channel CH1 of the envelope D/A converter 23 is stored in the envelope amplitude value memory 3.
Multiply the level information of address 1 from 1, then the second
2 to the envelope waveform data of channel CH2
The same operation is performed for all channels, such as multiplying the level information of the address, and the level of the output signal is changed. In the embodiment, since 8-bit level information is stored in the envelope amplitude value memory 31, the maximum data is "11111111", which is 255 in decimal. Therefore, one step is 1/255, and the level ratio R is given by the following equation. R = 20og In order to lower the signal by 3 dB, since R=-3 dB, it is necessary to take X=181 steps. As explained above, according to the present invention, the envelope waveform for each channel is output in a time-division manner from the envelope generator proposed above, and the desired envelope amplitude value for each channel is stored in the envelope amplitude value storage circuit. Then, the envelope amplitude value is converted into an analog quantity by a D/A converter, and the envelope waveform is inputted into a multiplication type D/A converter and converted into an analog quantity proportional to the output signal of the D/A converter. It is something. As a result, it is possible to obtain envelope waveforms with varying amplitude values for each channel, and it is possible to output a musical tone with a rich variety and taste compared to a conventional system in which each channel is at the same level.
第１図は本考案の実施例の構成を示す説明図、
第２図、第３図ａ〜ｃは本考案の実施例の動作説
明図、第４図は第１図の実施例の要部の詳細説明
図であり、図中、１１は累算器、１３はアタツク
デイケイ係数メモリ、１４はエンベロープ波形テ
ーブル、１５，１６はOR回路、１７はエンベロ
ープ制御回路、１９はタイミングクロツク発生回
路、２０はアドレスカウンタ、２１はチヤンネル
デコーダ、２２はEX−OR回路、２３はＤ／Ａ
変換器、２４はアナログマルチプレクサ、２５は
サンプルホールド回路、３１はエンベロープ振幅
値メモリ、３２はレベルＤ／Ａ変換器を示す。
FIG. 1 is an explanatory diagram showing the configuration of an embodiment of the present invention;
2 and 3 a to 3 c are explanatory diagrams of the operation of the embodiment of the present invention, and FIG. 4 is a detailed explanatory diagram of the main parts of the embodiment of FIG. 1, in which 11 is an accumulator; 13 is an attack decay coefficient memory, 14 is an envelope waveform table, 15 and 16 are OR circuits, 17 is an envelope control circuit, 19 is a timing clock generation circuit, 20 is an address counter, 21 is a channel decoder, 22 is an EX-OR circuit, 23 is D/A
24 is an analog multiplexer, 25 is a sample and hold circuit, 31 is an envelope amplitude value memory, and 32 is a level D/A converter.
Claims (1)
路１９と、 該タイミング発生回路で駆動されるアドレスカ
ウンタ２０と、 該アドレスカウンタのアドレスパルスによつ
て、アタツク・デイケイ時間を制御する係数が読
出されるアタツク・デイケイ係数メモリ１３と、 該アタツク・デイケイ係数メモリ１３からのア
タツク・デイケイ係数と記憶回路からの読出し値
とを加算する加算器と該加算結果を記憶し再び加
算回路に読出す上記記憶回路とより成り、前記タ
イミング発生回路のタイミングパルスと前記アド
レスカウンタのアドレスパルスとに応じ、前記加
算器から前記アタツク・デイケイ係数の累算出力
信号を出力するとともに累算出力が所定値になつ
たことを検知してアタツク・デイケイの各終了信
号を出力する累算器１１と、 外部からのアタツク信号と前記累算器１１から
のアタツク・デイケイの各終了信号とにより累算
器に与える係数をアタツクの時はアタツク係数と
し、デイケイの時はデイケイ係数とするエンベロ
ープ制御回路１７と、 対数曲線を持つエンベロープ波形の振幅を記憶
し前記累算出力信号により読出すエンベロープ波
形テーブル１４および該エンベロープ波形テーブ
ルの出力信号を反転または非反転するEX−OR
回路２２と、 該EX−OR回路２２の出力信号をアナログ波
形に変換するＤ／Ａ変換器２３と、 前記アドレスカウンタ２０の出力信号を用いて
各チヤンネルに対応する時分割多重化信号を出力
するチヤンネルデコーダ２１と、 前記Ｄ／Ａ変換器のアナログ出力を対応するチ
ヤンネル毎に時分割し、振分けるアナログマルチ
プレクサ２４と、 各チヤンネル毎の振幅値を独立して制御するた
めの振幅値を記憶し時分割で読出されるエンベロ
ープ振幅値メモリ３１と該エンベロープ振幅値メ
モリ出力をＤ／Ａ変換して前記エンベロープ波形
Ｄ／Ａ変換器２３に入力してエンベロープＤ／Ａ
変換器２３の出力のレベルを制御するレベルＤ／
Ａ変換器３２とを具備し、 前記累算器を上記時分割多重化信号を用いて各
チヤンネルで時分割動作させるとともに前記累算
器からのアドレスで各チヤンネルのアタツク対応
のエンベロープ波形を形成した後、累算器１１か
らのデイケイ期間出力信号により前記アタツク・
デイケイ係数メモリ１３の読出しをデイケイ係数
とするとともに前記エンベロープ波形テーブル１
４からのエンベロープ波形データを上記EX−
OR回路２２で反転させてデイケイ波形を形成
し、かつ、前記累算器１１からのデイケイ終了信
号によりエンベロープ制御回路１７は累算を終了
させることによりエンベロープ波形の全てを形成
し、 その後対応するチヤンネル毎に、前記アドレス
カウンタ２０の出力信号から、前記チヤンネルデ
コーダ２１の各チヤンネルの時分割多重化信号を
得て、前記アナログマルチプレクサ２４により時
分割して振分け出力するとともに、前記エンベロ
ープ振幅値メモリ３１からの出力信号をレベル
Ｄ／Ａ変換器３２によりレベル変換しエンベロー
プＤ／Ａ変換器２３の出力レベルを制御するよう
にしたことを特徴とする電子楽器。[Claims for Utility Model Registration] A timing generation circuit 19 that generates timing pulses, an address counter 20 driven by the timing generation circuit, and a coefficient that controls the attack decay time by the address pulse of the address counter. an attack decay coefficient memory 13 from which the attack decay coefficient memory 13 is read; an adder for adding the attack decay coefficient from the attack decay coefficient memory 13 and a value read from the storage circuit; and an adder for storing the addition result and reading it back to the addition circuit. and outputs a cumulative output signal of the attack decay coefficient from the adder in response to a timing pulse of the timing generating circuit and an address pulse of the address counter, and outputs a cumulative output signal of the attack decay coefficient from the adder, and also outputs a cumulative output signal of the attack decay coefficient to a predetermined value. an accumulator 11 which detects that the number of attacks has increased and outputs each end signal of the attack decay; an envelope control circuit 17 which uses the coefficient to be given as an attack coefficient in the case of attack and as a decay coefficient in the case of decay; EX-OR to invert or non-invert the output signal of the envelope waveform table
circuit 22, a D/A converter 23 that converts the output signal of the EX-OR circuit 22 into an analog waveform, and outputs a time division multiplexed signal corresponding to each channel using the output signal of the address counter 20. a channel decoder 21; an analog multiplexer 24 that time-divides and distributes the analog output of the D/A converter to each corresponding channel; and an analog multiplexer 24 that stores amplitude values for independently controlling the amplitude values of each channel. The envelope amplitude value memory 31 read out in a time-division manner and the envelope amplitude value memory output are D/A converted and inputted to the envelope waveform D/A converter 23 to convert the envelope D/A.
level D/ which controls the level of the output of the converter 23;
A converter 32, the accumulator is operated in a time division manner on each channel using the time division multiplexed signal, and an envelope waveform corresponding to the attack of each channel is formed using the address from the accumulator. After that, the decay period output signal from the accumulator 11 causes the attack
The decay coefficient memory 13 is read out as the decay coefficient, and the envelope waveform table 1 is
4. Extract the envelope waveform data from EX-
The OR circuit 22 inverts the waveform to form a decay waveform, and in response to the decay end signal from the accumulator 11, the envelope control circuit 17 terminates the accumulation to form the entire envelope waveform, and then the corresponding channel At each time, a time division multiplexed signal of each channel of the channel decoder 21 is obtained from the output signal of the address counter 20, and the time division multiplexed signal is distributed and outputted by the analog multiplexer 24 and outputted from the envelope amplitude value memory 31. An electronic musical instrument characterized in that the level of the output signal of the envelope D/A converter 23 is converted by a level D/A converter 32 to control the output level of the envelope D/A converter 23.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1986135220U JPS6328476Y2 (en) | 1986-09-03 | 1986-09-03 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1986135220U JPS6328476Y2 (en) | 1986-09-03 | 1986-09-03 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS6251392U JPS6251392U (en) | 1987-03-30 |
| JPS6328476Y2 true JPS6328476Y2 (en) | 1988-08-01 |
Family
ID=31037198
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1986135220U Expired JPS6328476Y2 (en) | 1986-09-03 | 1986-09-03 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6328476Y2 (en) |
Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5350723A (en) * | 1976-10-19 | 1978-05-09 | Nippon Gakki Seizo Kk | Electronic musical instrument |
| JPS5383610A (en) * | 1976-12-29 | 1978-07-24 | Nippon Gakki Seizo Kk | Wave generator for electronic musical instruments |
-
1986
- 1986-09-03 JP JP1986135220U patent/JPS6328476Y2/ja not_active Expired
Patent Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5350723A (en) * | 1976-10-19 | 1978-05-09 | Nippon Gakki Seizo Kk | Electronic musical instrument |
| JPS5383610A (en) * | 1976-12-29 | 1978-07-24 | Nippon Gakki Seizo Kk | Wave generator for electronic musical instruments |
Also Published As
| Publication number | Publication date |
|---|---|
| JPS6251392U (en) | 1987-03-30 |
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