JPS63226115A - ゼロクロスカウンタ - Google Patents

ゼロクロスカウンタ

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Publication number
JPS63226115A
JPS63226115A JP62060417A JP6041787A JPS63226115A JP S63226115 A JPS63226115 A JP S63226115A JP 62060417 A JP62060417 A JP 62060417A JP 6041787 A JP6041787 A JP 6041787A JP S63226115 A JPS63226115 A JP S63226115A
Authority
JP
Japan
Prior art keywords
zero cross
zero
input signal
delay circuit
signal
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP62060417A
Other languages
English (en)
Inventor
Yoshitaka Abe
芳孝 阿部
Keiichi Murakami
敬一 村上
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Fujitsu Ltd
Original Assignee
Fujitsu Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Fujitsu Ltd filed Critical Fujitsu Ltd
Priority to JP62060417A priority Critical patent/JPS63226115A/ja
Priority to US07/160,227 priority patent/US4882740A/en
Priority to EP88400633A priority patent/EP0284498B1/en
Priority to DE3852556T priority patent/DE3852556T2/de
Publication of JPS63226115A publication Critical patent/JPS63226115A/ja
Pending legal-status Critical Current

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    • G—PHYSICS
    • G01—MEASURING; TESTING
    • G01R—MEASURING ELECTRIC VARIABLES; MEASURING MAGNETIC VARIABLES
    • G01R23/00—Arrangements for measuring frequencies; Arrangements for analysing frequency spectra
    • G01R23/02—Arrangements for measuring frequency, e.g. pulse repetition rate; Arrangements for measuring period of current or voltage
    • G01R23/10—Arrangements for measuring frequency, e.g. pulse repetition rate; Arrangements for measuring period of current or voltage by converting frequency into a train of pulses, which are then counted, i.e. converting the signal into a square wave
    • G—PHYSICS
    • G01—MEASURING; TESTING
    • G01R—MEASURING ELECTRIC VARIABLES; MEASURING MAGNETIC VARIABLES
    • G01R23/00—Arrangements for measuring frequencies; Arrangements for analysing frequency spectra

Landscapes

  • Physics & Mathematics (AREA)
  • General Physics & Mathematics (AREA)
  • Measuring Frequencies, Analyzing Spectra (AREA)
  • Manipulation Of Pulses (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 （概要） 本発明はゼロクロスカウンタにおいて、リアルタイムで
ゼロクロス量を検出できない従来の問題点を解決するた
め、 遅延回路の入力信号及び出力信号の夫々のゼロクロス量
の差分を検出することにより、リアルタイムでゼロクロ
ス量を検出できるようにしたものである。
〔産業上の利用分野〕
本発明は特に信号の周波数解析等に用いられるゼロクロ
スカウンタに関する。周波数変化の激しい信号を周波数
解析する場合、リアルタイムで瞬時瞬時のゼロクロス量
を検出する必要がある。
〔従来の技術〕
第４図は従来のブロック図を示す。端子１に入来した入
力信号ａ（第５図（Ａ））はゼロクロス検出回路２にて
ゼロクロス点を検出されて信号ｂ（同図（Ｂ））とされ
、カウンタ３に供給されてここで時間Δを内のゼロクロ
ス量をカウントされる。つまり、カウンタ３は同期信号
発生回路４からの同期信号Ｃ（第５図（Ｃ））の立上り
でクリアされ（周期６丁）、その立手りから次の立上り
までの時間Δを内で信号すをカウントする。
カウンタ３の出力はラッチ回路５に供給され、ここで上
記同期信号Ｃによりカウンタ３のクリア直前においてラ
ッチされ、出力端子６より取出される。このものは周期
ΔＴ毎にゼロクロス量を検出する。
〔発明が解決しようとする問題点〕
上記従来のものは周期ΔＴ毎にゼロクロス量を検出する
構成であるため、周期６丁より短い時間内で周波数が激
しく変化する信号のゼロクロス量を検出し得ず、勿論、
リアルタイムでゼロク［１スけを検出すること等はでき
ない問題点があった。
もし、周期６丁より短い周期でゼ［１り［１ス量を検出
するには、第５図（Ｃ）に示す同期信号Ｃのタイミング
の中間に入るようなタイミングをもつ周期へＴのカウン
タを別に用意する必要があり、例えば、周期Δ王より短
い周期ΔＴ′でゼロクロス量を検出するには（ΔＴ／Δ
Ｔ’　）個のカウンタが必要となる問題点があった。
〔問題点を解決するための手段〕 第１図は本発明になるげロクロスカウンタの原理ブロッ
ク図を示す。同図中、７は例えばアナログディレーライ
ン等（例えばシフトレジスタ等でもよい）の遅延回路、
８１　、８２はゼロクロス検出回路、９は差分検出回路
である。同図に示す如く、・本発明になるゼロクロスカ
ウンタは、入力信号を所定時間遅延する遅延回路７と、
該入力信号のゼロクロス点及び遅延回路７の出力信号の
ヒ［１クロス点を夫々検出するゼロクロス検出回路８１
゜８２と、ゼロクロス検出回路８１．８２にて夫々検出
された上記入力信号及び１記遅延回路７の出力信号の夫
々のゼロクロス点を供給され、上記所定時間内において
該夫々のゼロクロス点の量の差分を検出する差分検出回
路９とよりなる。
〔作用〕
アップダウンカウンタ１１において、遅延回路７の入力
信号又は出力信号にｙ　ｏクロスを生じるたびにアップ
又はダウンが繰返されてカウント値が更新され、これに
より、入力信号のゼロクロス量がリアルタイムに検出さ
れる。
〔実施例〕
第２図は本発明の一実施例のブロック図を示し、同図中
、第４図及び第１図と同一構成部分には同一番号を付し
てその説明を省略する。同図中、１０はアンドゲート、
１１はアップダウンカウンタ、１２はスタートストップ
回路であり、これらにて差分検出回路９が構成されてい
る。
端子１に入来したアナログ入力信号は、アナログディレ
ーライン７にて時間Δを遅延された後ゼロクロス検出回
路８１に供給されてここでゼロクロス点を検出されてパ
ルスとされる一方、ゼロクロス検出回路８２には、アナ
ログ入力信号がそのまま供給されてゼロクロス点を検出
されてパルスとされる。
ここで、スタートアップ回路１２からはクリア信号ｄ（
第３図（Ａ））が出力されてアップダウンカウンタ１１
をクリアする一方、クリア信号ｄ＝　　４　　− の立上りからＬレベルとなってその立下りからディレー
ライン７の遅延時間Δを後にＨレベルとなるマスク信号
ｅ（第３図（Ｂ））が出力されてアンドゲート１０の一
方の入力端子に供給される。
マスク信号ｅのＬレベルによってゼロク［ｌス検出回路
８Ｉのパルス出力はアンドゲート１０を介してマスクさ
れてアップダウンカウンタ１１のダウン入力端子に供給
されず、ゼロクロス検出回路８２のパルス出力のみアッ
プダウンカウンタ１１のアップ入力端子に供給される。
これにより、アップダウンカウンタはスタートアップさ
れて、第３図（Ｃ）に示すように例えば「５」までカウ
ントアツプされる。
マスク信号ｅがＨレベルになるとゼ［ｌクロス検出回路
８Ｉのパルス出力はアンドゲート１０を介してアップダ
ウンカウンタ１１のダウン入力端子に供給され、これ以
後、アップダウンカウンタ１１はゼロクロス検出回路８
２のパルス出力によってカウントアツプされると共にゼ
ロクロス検出回路８１のパルス出力によってカウントダ
ウンされる。つまり、スタートアップ完了以後、アップ
ダウンカウンタ１１は上記カウント値「５」から、遅延
時間Δを内において、遅延回路７の入力信号又は出力信
号にゼロクロスを生じるたびにアップ又はダウンを繰返
されてカウント値を更新され（夫々のゼロクロス量の差
分を検出され）、これにより、入力信号のゼロクロス量
がリアルタイムに検出される。
この場合、遅延回路７の入力信号又は出力信号にゼロク
ロスを生じるたびにカウント値が更新されるので、遅延
回路７の遅延時間Δｔの周期毎にではなく、常に瞬時瞬
時のゼロクロス量が検出される。
〔発明の効果〕
本発明によれば、リアルタイムゼロクロス量を検出し得
、これにより、短い時間で周波数が激しく変化する信号
のゼロクロス量を検出し得る等の特長を有する。
【図面の簡単な説明】
第１図は本発明の原理ブロック図、 第２図は本発明の一実施例のブロック図、第３図は本発
明の動作説明用タイミングチャート、 第４図は従来のブロック図、 第５図は従来のカウンタのタイミングチャートである。 図において、 １は入力端子、 ６は出力端子、 ７はアナログディレーライン（遅延回路）、８１　、８
２はゼロクロス検出回路、 ９は差分検出回路、 １０はアンドゲート、 １１はアップダウンカウンタ、 １２はスタートアップ回路である。

Claims (1)

  1. 【特許請求の範囲】 入力信号を所定時間遅延する遅延回路（７）と、該入力
    信号のゼロクロス点及び該遅延回路（７）の出力信号の
    ゼロクロス点を夫々検出するゼロクロス検出回路（８＿
    １、８＿２）と、 該ゼロクロス検出回路（８＿１、８＿２）にて夫々検出
    された上記入力信号及び上記遅延回路（７）の出力信号
    の夫々のゼロクロス点を供給され、上記所定時間内にお
    いて該夫々のゼロクロス点の量の差分を検出する差分検
    出回路（９）とよりなることを特徴とするゼロクロスカ
    ウンタ。
JP62060417A 1987-03-16 1987-03-16 ゼロクロスカウンタ Pending JPS63226115A (ja)

Priority Applications (4)

Application Number Priority Date Filing Date Title
JP62060417A JPS63226115A (ja) 1987-03-16 1987-03-16 ゼロクロスカウンタ
US07/160,227 US4882740A (en) 1987-03-16 1988-02-25 Frequency counter for counting a frequency and partly varied frequencies of a signal in real time
EP88400633A EP0284498B1 (en) 1987-03-16 1988-03-16 Frequency counter in particular for counting partly varying frequencies in real time
DE3852556T DE3852556T2 (de) 1987-03-16 1988-03-16 Frequenzzähler, insbesondere zur Echtzeitzählung von teilweise veränderlichen Frequenzen.

Applications Claiming Priority (1)

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JP62060417A JPS63226115A (ja) 1987-03-16 1987-03-16 ゼロクロスカウンタ

Publications (1)

Publication Number Publication Date
JPS63226115A true JPS63226115A (ja) 1988-09-20

Family

ID=13141599

Family Applications (1)

Application Number Title Priority Date Filing Date
JP62060417A Pending JPS63226115A (ja) 1987-03-16 1987-03-16 ゼロクロスカウンタ

Country Status (4)

Country Link
US (1) US4882740A (ja)
EP (1) EP0284498B1 (ja)
JP (1) JPS63226115A (ja)
DE (1) DE3852556T2 (ja)

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