JPS63108238U - - Google Patents
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- Publication number
- JPS63108238U JPS63108238U JP20173986U JP20173986U JPS63108238U JP S63108238 U JPS63108238 U JP S63108238U JP 20173986 U JP20173986 U JP 20173986U JP 20173986 U JP20173986 U JP 20173986U JP S63108238 U JPS63108238 U JP S63108238U
- Authority
- JP
- Japan
- Prior art keywords
- serial data
- data
- signal conversion
- model registration
- utility
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
- 238000006243 chemical reaction Methods 0.000 claims description 3
- 230000005540 biological transmission Effects 0.000 claims 1
- 238000010586 diagram Methods 0.000 description 2
- 238000000034 method Methods 0.000 description 1
Landscapes
- Selective Calling Equipment (AREA)
Description
第1図は本考案の一実施例の構成を示すブロツ
ク図、第2図は同実施例によりパラレルデータに
変換されるべきシリアルデータの一例を示す図、
第3図は同実施例によるデータ変換処理のプロセ
スを示す流れ図である。 M……ワンチツプマイクロコンピユータ、1…
…入力バツフア、2……ROM、3……RAM、
4……タイマ、5……ALU、6……出力バツフ
ア。
ク図、第2図は同実施例によりパラレルデータに
変換されるべきシリアルデータの一例を示す図、
第3図は同実施例によるデータ変換処理のプロセ
スを示す流れ図である。 M……ワンチツプマイクロコンピユータ、1…
…入力バツフア、2……ROM、3……RAM、
4……タイマ、5……ALU、6……出力バツフ
ア。
Claims (1)
- 【実用新案登録請求の範囲】 (1) 少なくとも、外部から割り込み入力される
シリアルデータがセツトされる入力バツフアと、
前記シリアルデータのパルス間隔を検出するタイ
マと、このパルス間隔の相違に基づいて前記シリ
アルデータを所定ビツトのパラレルデータに変換
する演算処理ユニツトと、前記パラレルデータが
セツトされる出力バツフアと、前記シリアルデー
タを前記所定ビツトのパラレルデータに変換する
際に必要な制御プログラムがフアームウエアとし
て格納されているメモリとを備えたワンチツプマ
イクロコンピユータからなることを特徴とする信
号変換回路。 (2) 赤外線を伝送媒体としたシリアルデータに
より、各機能選択をリモートコントロールユニツ
ト側から行なうように構成された電子機器の、前
記シリアルデータの受信系回路に設けられている
実用新案登録請求の範囲第1項記載の信号変換回
路。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP20173986U JPS63108238U (ja) | 1986-12-27 | 1986-12-27 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP20173986U JPS63108238U (ja) | 1986-12-27 | 1986-12-27 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS63108238U true JPS63108238U (ja) | 1988-07-12 |
Family
ID=31165473
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP20173986U Pending JPS63108238U (ja) | 1986-12-27 | 1986-12-27 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS63108238U (ja) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2007195254A (ja) * | 2000-03-14 | 2007-08-02 | Altera Corp | プログラマブルロジックデバイス回路に結合されるクロックデータリカバリ回路 |
-
1986
- 1986-12-27 JP JP20173986U patent/JPS63108238U/ja active Pending
Cited By (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2007195254A (ja) * | 2000-03-14 | 2007-08-02 | Altera Corp | プログラマブルロジックデバイス回路に結合されるクロックデータリカバリ回路 |
JP2010172014A (ja) * | 2000-03-14 | 2010-08-05 | Altera Corp | プログラマブルロジックデバイス回路に結合されるクロックデータリカバリ回路 |
JP2011142631A (ja) * | 2000-03-14 | 2011-07-21 | Altera Corp | プログラマブルロジックデバイス回路に結合されるクロックデータリカバリ回路 |
JP2015073313A (ja) * | 2000-03-14 | 2015-04-16 | アルテラ コーポレイションAltera Corporation | プログラマブルロジックデバイス回路に結合されるクロックデータリカバリ回路 |
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