JPS63103592A - Fast feeding reproducing device in video tape recorder - Google Patents
Fast feeding reproducing device in video tape recorderInfo
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- JPS63103592A JPS63103592A JP61250579A JP25057986A JPS63103592A JP S63103592 A JPS63103592 A JP S63103592A JP 61250579 A JP61250579 A JP 61250579A JP 25057986 A JP25057986 A JP 25057986A JP S63103592 A JPS63103592 A JP S63103592A
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Landscapes
- Television Signal Processing For Recording (AREA)
Abstract
Description
【発明の詳細な説明】
(産業上の利用分野)
本発明は、少なくとも1つのダブルアジマスヘッドを搭
載したビデオテープレコーダ(以下、VTRと称す)に
おける早送り再生装置に関する。DETAILED DESCRIPTION OF THE INVENTION (Field of Industrial Application) The present invention relates to a fast forward playback device in a video tape recorder (hereinafter referred to as VTR) equipped with at least one double azimuth head.
(従来の技術)
従来のVTRでは、早送り再生をした場合、逆アジマス
ヘッドで記録されたトラックを再生ヘッドが横切るため
、再生画面の水平方向に数本のノイズバーが現れる。(Prior Art) In a conventional VTR, when performing fast-forward playback, the playback head crosses a track recorded with a reverse azimuth head, so that several noise bars appear in the horizontal direction of the playback screen.
このため、例えばダブルアジマスヘッドを装備し、この
ヘッド出力を切換えるように構成したものが提供されて
いる。また、フィールドメモリを備え、再生映像信号を
1フイールド毎に記録し、特殊再生を行う装置も提供さ
れている。For this reason, for example, devices equipped with a double azimuth head and configured to switch the output of the head have been provided. Furthermore, there has also been provided a device that is equipped with a field memory, records a reproduced video signal field by field, and performs special reproduction.
(発明が解決しようとする問題点)
しかるに、ダブルアジマスヘッドによって映像信号を再
生し、再生した画像データをフィールドメモリに書込む
場合、ヘッド切換時の再生水平同期信号のH並びが不均
一であるのでノイズやスキューが発生する。(Problem to be Solved by the Invention) However, when a video signal is reproduced by a double azimuth head and the reproduced image data is written into a field memory, the H arrangement of the reproduced horizontal synchronization signals when switching heads is uneven. Therefore, noise and skew occur.
(問題点を解決するための手段)
本発明ビデオテープレコーダにおける早送り再生装置は
、ダブルアジマスヘッドを搭載したビデオテープレコー
ダにおいて、高速再生時の再生映像信号を輝度・クロマ
分離し、分離後の信号をデジタル信号に変換して書込み
を行うメモリで、続出しアドレス及び書込みアドレスと
が別々に設定可能な記憶手段と、前記再生映像信号のエ
ンベロープ出力レベルの低い範囲を検出し、この範囲を
再生水平同期信号で同期をとることにより、ダブルヘッ
ドのヘッド切換後におけるメモリ書込み禁止エリアを決
定し、このエリア内では書込み禁止制御する占込み禁止
制御手段とを備えたものである。前記記憶手段には、例
えば少なくとも1フイ一ルド分の映像信号が記憶できる
フィールドメモリが用いられる。(Means for Solving the Problems) A fast-forward playback device in a video tape recorder of the present invention separates the brightness and chroma of a playback video signal during high-speed playback in a video tape recorder equipped with a double azimuth head, and separates the separated signal. It is a memory that converts and writes into a digital signal, and includes a storage means in which a continuous address and a write address can be set separately, and a low range of the envelope output level of the reproduced video signal, and this range is used as a reproduction level. By synchronizing with a synchronization signal, a memory write prohibition area is determined after head switching of the double head, and write prohibition control means is provided for controlling write prohibition within this area. As the storage means, for example, a field memory is used which can store at least one field's worth of video signals.
(作用)
高速再生時には、ダブルアジマスヘッドをトラック渡り
に対応して切換えて記憶手段への書込み及び読出しを行
う。この書込み、読出しの処理は輝度、クロマ分離後の
信号をデジタル変換して行い、クロマ信号の不連続性に
基づく色ずれを防止する。さらに、再生映像信号のエン
ベロープ出力レベルが一定値よりも低い範囲を検出し、
この範囲を再生水平同期信号で同期することでメモリ書
込み禁止エリアを決定し、このエリア内で書込み禁止制
御する。一方、ダブルアジマス3ヘツド方式の場合はダ
ブルアジマスヘッド側と異なる他のチャンネルの再生時
には、記憶手段にすでに記憶した画像データのみの読出
しを行う。(Function) During high-speed playback, the double azimuth head is switched in correspondence with track crossing to perform writing to and reading from the storage means. This writing and reading processing is performed by digitally converting the signals after luminance and chroma separation to prevent color shift due to discontinuity of chroma signals. Furthermore, it detects the range where the envelope output level of the reproduced video signal is lower than a certain value,
By synchronizing this range with a reproduction horizontal synchronizing signal, a memory write-inhibited area is determined, and write-inhibit control is performed within this area. On the other hand, in the case of the double azimuth three head system, when reproducing another channel different from the double azimuth head side, only the image data already stored in the storage means is read out.
(実施例)
以下、本発明の実施例について図面を参照して説明する
。(Example) Hereinafter, an example of the present invention will be described with reference to the drawings.
本例は、ダブルアジマス3ヘツド方式のVTRに適用し
た場合を示している。This example shows the case where it is applied to a double azimuth three head system VTR.
第2図に示すVTRの回転ドラム1には、RヘッドとL
′ヘッドが複合構造になされた、いわゆるダブルアジマ
スへフド2が配置され、一方この回転ドラムlを挾んで
Rヘッドと反対側にはLヘッドが配置されている。本例
では、このダブルアジマスヘッド2側を第1チヤンネル
(I Ch)とし、Lヘッド側を第2チヤンネル(2c
h)としている。この時に、通常再生速度の5倍で再
生を行った場合のヘッド切換タイミングと再生RFエン
ベロープ出力との関係を第3図に示している。The rotary drum 1 of the VTR shown in FIG. 2 has an R head and an L head.
'A so-called double azimuth head hood 2 with a composite head structure is disposed, and an L head is disposed on the opposite side of the R head across the rotating drum 1. In this example, the double azimuth head 2 side is the first channel (I Ch), and the L head side is the second channel (2c
h). FIG. 3 shows the relationship between head switching timing and reproduction RF envelope output when reproduction is performed at five times the normal reproduction speed.
第3図において、同図(a)はチャンネルの切換タイミ
ングを示し、第1チヤンネル側に切換えられている時(
rHJレベルの時)には、同図(b)に示すようにRヘ
ッドとL′ヘッドとの切換が交互になされ、記録トラッ
ク(図示省略)のアジマス角と同一のアジマス角を有す
るヘッドによって再生される。このため、この第1チヤ
ンネルにおける再生RFエンベロープ出力は、トラック
渡り時に幾分レベルがダウンした低レベル範囲18を有
する波形となる〔同図(C)参照〕。一方、第2チヤン
ネル側では、Lヘッドと同一のアジマス角で記録された
トラック情報のみが再生されるので、再生RFエンベロ
ープ出力は複数箇所で零レベルと交差する波形となる。In Fig. 3, (a) shows the channel switching timing, and when the channel is switched to the first channel side (
rHJ level), the R head and L' head are alternately switched as shown in FIG. be done. Therefore, the reproduced RF envelope output in the first channel has a waveform having a low level range 18 whose level is slightly lowered at the time of track transition [see FIG. 3C]. On the other hand, on the second channel side, only the track information recorded at the same azimuth angle as the L head is reproduced, so the reproduced RF envelope output has a waveform that crosses the zero level at multiple points.
この第3図(C1に示す再生エンベロープ信号及び再生
映像信号は、高速再生時には、第1図に示す早送り再生
装置に入力される。During high-speed playback, the playback envelope signal and playback video signal shown in FIG. 3 (C1) are input to the fast-forward playback device shown in FIG. 1.
第1図は、本発明に係るVTRの早送り再生装置の構成
を示すブロック図である。FIG. 1 is a block diagram showing the configuration of a fast forward playback device for a VTR according to the present invention.
端子4からは、早送りによって再生された再生映像信号
(ビデオ信号)S+が入力され、この信号S1は、輝度
/クロマ分離回路5によって輝度信号Y、色差信号(R
−Y、B−Y)に分離され、フィールドメモリ6に人力
される。このフィールドメモリ6のデータ入出力部分は
、デジタル変換後の1フイ一ルド分の再生映像信号をメ
モリ部7へ書込み及び読出すもので、前記輝度信号Y、
色差信号(R−Y、B−Y)のそれぞれをデジタル信号
に変換するA/D変換部8a〜8Cと、これらのA/D
変換部8a〜8Cの出力を一定のサンプリングクロック
S2を基にデータセレクトデコーダ9のセレクトタイミ
ングに合わせて、前記メモリ部7へ入出力制御する入力
側スイッチ10a及び出力側スイッチ10bと、前記A
/D変換部8a〜8cの逆動作をなしてアナログ信号に
変換するD/A変換部113〜IICによって構成され
ている。メモリ部7における読出し、書込みアドレス設
定は、別個のカウンタである読出しアドレスカウンタ1
2aと書込みアドレスカウンタ12bによってなされ、
これらカウンタ12a、12bは前記サンプリングクロ
ックS2を基にカウントするもので、指定アドレスは切
換スイッチ13の切換動作によって選択入力される。こ
の切換スイッチ13は、第1チヤンネル側の再生時には
書込みと読出しを交互に行い、第2チヤンネル側の再生
時には書込みを行わないで第1チヤンネルで書込んだ画
像データを読出すように切換えられる。A reproduced video signal (video signal) S+ reproduced by fast forwarding is input from the terminal 4, and this signal S1 is converted into a luminance signal Y and a color difference signal (R) by a luminance/chroma separation circuit 5.
-Y, B-Y) and manually stored in the field memory 6. The data input/output portion of the field memory 6 is for writing and reading out one field's worth of reproduced video signals after digital conversion to and from the memory section 7.
A/D conversion units 8a to 8C that convert each of the color difference signals (R-Y, B-Y) into digital signals, and these A/D
An input side switch 10a and an output side switch 10b which control the input and output of the outputs of the conversion units 8a to 8C to the memory unit 7 based on a constant sampling clock S2 and in accordance with the selection timing of the data select decoder 9;
It is constituted by D/A converters 113 to IIC that perform the reverse operation of the /D converters 8a to 8c and convert them into analog signals. Read and write address settings in the memory section 7 are performed by a separate counter, the read address counter 1.
2a and write address counter 12b,
These counters 12a and 12b count based on the sampling clock S2, and the designated address is selectively inputted by the switching operation of the changeover switch 13. This changeover switch 13 is switched so that writing and reading are performed alternately during reproduction on the first channel side, and writing is not performed and image data written on the first channel is read out during reproduction on the second channel side.
前記書込みアドレスカウンタ12bの作動は、メモリ書
込み禁止エリア検出部14の出力によってゲート制御さ
れている。すなわち、このメモリ書込み禁止エリア検出
部14において、検波16後のRFエンベロープ信号と
参照電圧V r e rとをコンパレータ17によって
比較し、RFエンベロープ信号のレベルが低レベル範囲
18 (前記コンパレーク17の参照電圧V r+at
以下として定義される)にあるときの出力をD−フリッ
プフロップ19を介し、再生映像信号から水平間朋分#
20した水平同期信号S、で同期させ、前記M込みア
ドレスカウンタ12bの作動を制御するANDゲート2
1に入力している。The operation of the write address counter 12b is gate-controlled by the output of the memory write-inhibited area detection section 14. That is, in this memory write-protected area detection unit 14, the RF envelope signal after the detection 16 and the reference voltage V r e r are compared by the comparator 17, and the level of the RF envelope signal is in the low level range 18 (reference to the comparator 17). Voltage V r+at
(defined as below), the output from the reproduced video signal through the D-flip-flop 19,
AND gate 2 which synchronizes with the horizontal synchronization signal S, which is 20, and controls the operation of the M-inclusive address counter 12b.
1 is entered.
しかして、ダブルアジマスヘッド2のRヘッドと■、′
ヘッドの切換時における)I並への不均一性は、前記メ
モリ書込み禁止エリア検出部14によって再生エンベロ
ープ出力の低レベル範囲18の期間内に水平同期信号で
同期をとることにより、メモリ書込み禁止エリア23(
第4図参照)を決定し、このエリア内では前記書込みア
ドレスカウンタ12bのカウント動作を停止させ、この
間メモリ部7には再生映像信号を記憶させない。However, the R head of double azimuth head 2 and ■,'
The non-uniformity (at the time of head switching) to the level of I can be eliminated by synchronizing with the horizontal synchronization signal within the period of the low level range 18 of the reproduction envelope output by the memory write prohibited area detection unit 14. 23(
(see FIG. 4), the counting operation of the write address counter 12b is stopped within this area, and the reproduced video signal is not stored in the memory section 7 during this period.
すなわち、第4図に示すように再生水平同期信号の間隔
が前記RヘッドとL′ヘッドとのヘッド切換時点でずれ
るために、このずれた間隔をnII記メ子メモリ書込止
エリア23として決定し、このエリア23以降に再生さ
れる水平同期信号を均一なH並べになるように補正して
いる〔第4図(b)〕。That is, as shown in FIG. 4, since the interval between the reproduced horizontal synchronizing signals deviates at the time of head switching between the R head and the L' head, this deviated interval is determined as the write stop area 23 of the nII memory. However, the horizontal synchronizing signals reproduced after this area 23 are corrected so that they are arranged in a uniform H pattern [Fig. 4(b)].
よって、メモリ部7から読出される画像データは11並
べが均一になるのでスキュー及びノイズは生じない。Therefore, the image data read out from the memory section 7 is uniformly arranged in 11 rows, so that no skew or noise occurs.
また、本例ではメモリ部7への書込み、読出し処理を映
像信号ではなく、Y/C分離後の信号によって行ってい
るので、クロマ信号の不連続性にともなう色ずれは発生
しない。Furthermore, in this example, the writing and reading processes to and from the memory section 7 are performed not with the video signal but with the signal after Y/C separation, so that color shift due to discontinuity of the chroma signal does not occur.
さらに、本例では第1チヤンネルで読み込んだ画像デー
タは、一定の遅延時間25(第5図参照)後に読出し制
御されている。そして、第1チヤンネル側を再生してい
るときには、メモリ部7に書込みながら読出しを行い、
また、第2チヤンネル側を再生しているときには、第1
チヤンネルの再生時にメモリ部7への込んだ画像データ
の読出しのみを行うように制御されている。このため、
第1チヤンネルに切換ねってから所定の遅延時間25を
経過してから次の第1チヤンネルの始まりまでの間、同
じ画面が映しだされることになる。Further, in this example, the image data read through the first channel is controlled to be read out after a certain delay time 25 (see FIG. 5). When the first channel side is being reproduced, reading is performed while writing to the memory section 7,
Also, when playing the second channel side, the first
It is controlled so that only the image data stored in the memory section 7 is read out when a channel is reproduced. For this reason,
The same screen will be displayed from when the predetermined delay time 25 has elapsed after switching to the first channel until the start of the next first channel.
なお、上述した実施例の他に本発明は第2チヤンネルの
ヘッドとしてダブルアジマスヘッドを使用した4ヘツド
方弐のVTR等にも適用することができる。この場合に
は、第2チヤンネルの再生動作を上述した第1チヤンネ
ルと同じ動作で行えばよい。In addition to the embodiments described above, the present invention can also be applied to a four-head VTR using a double azimuth head as the second channel head. In this case, the second channel may be reproduced in the same manner as the first channel described above.
(発明の効果)
以上述べたように、本発明によれば、ダブルアジマスヘ
ッドを搭載したVTRにおいて、ヘッド切換時にノイズ
やスキューが発生せず、また色ずれも生じない。(Effects of the Invention) As described above, according to the present invention, in a VTR equipped with a double azimuth head, no noise or skew occurs when switching heads, and no color shift occurs.
第1図は本発明に係るビデオテープレコーダにおける早
送り再生装置の実施例を示すブロック図、第2図はダブ
ルアジマス3ヘツドの配置を示す概略図、第3図(al
〜(C)は5倍速再生時におけるヘッド切換タイミング
とエンベロープ波形を示すタイミング図、第4図(fl
)、 (b)はメモリ書込み禁止エリアを説明するため
のタイミング図、第5図(al、 (b)はメモリ部の
書込み及び読出しタイミングを示す図である。
2・・・ダブルアジマスヘッド
5・・・輝度/クロマ分離回路
6・・・フィールドメモリ 7・・・メモリ部1
2a・・・読出しアドレスカウンタ
12b・・・書込みアドレスカウンタ
(a) チw〉ネルtJH亀
タイミレクー
ヘッドを刀捜
(b) タイミング゛
(c) 再生RF工)ベローア
出力
窮2図
第3図
7878 1/3 1flFIG. 1 is a block diagram showing an embodiment of a fast forward playback device in a video tape recorder according to the present invention, FIG. 2 is a schematic diagram showing the arrangement of three double azimuth heads, and FIG.
~(C) is a timing diagram showing the head switching timing and envelope waveform during 5x speed playback, and FIG.
), (b) is a timing diagram for explaining the memory write prohibited area, and FIG. 5 (al) is a diagram showing the write and read timing of the memory section. ...Brightness/chroma separation circuit 6...Field memory 7...Memory section 1
2a...Read address counter 12b...Write address counter (a) Channel tJH Tortoise head search (b) Timing (c) Reproduction RF engineering) Velor output 2 Figure 3 7878 1/3 1fl
Claims (1)
ーダにおいて、 高速再生時の再生映像信号を輝度・クロマ 分離し、分離後の信号をデジタル信号に変換して書込み
を行うメモリで、読出しアドレス及び書込みアドレスと
が別々に設定可能な記憶手段と、 前記再生映像信号のエンベロープ出力レベ ルの低い範囲を検出し、この範囲を再生水平同期信号で
同期をとることにより、ダブルヘッドのヘッド切換後に
おけるメモリ書込み禁止エリアを決定し、このエリア内
では書込み禁止制御する書込み禁止制御手段とを備えた
ことを特徴とするビデオテープレコーダにおける早送り
再生装置。[Claims] 1) In a video tape recorder equipped with a double azimuth head, a memory that separates the luminance and chroma of a reproduced video signal during high-speed playback, converts the separated signal into a digital signal, and writes the digital signal, A storage means in which a read address and a write address can be set separately, and a double head head switching system that detects a low envelope output level range of the reproduced video signal and synchronizes this range with a reproduction horizontal synchronization signal. 1. A fast-forward playback device for a video tape recorder, comprising a write prohibition control means for determining a later memory write prohibition area and controlling write prohibition within this area.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP61250579A JPS63103592A (en) | 1986-10-20 | 1986-10-20 | Fast feeding reproducing device in video tape recorder |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP61250579A JPS63103592A (en) | 1986-10-20 | 1986-10-20 | Fast feeding reproducing device in video tape recorder |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS63103592A true JPS63103592A (en) | 1988-05-09 |
Family
ID=17209988
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP61250579A Pending JPS63103592A (en) | 1986-10-20 | 1986-10-20 | Fast feeding reproducing device in video tape recorder |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS63103592A (en) |
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS647783A (en) * | 1987-06-30 | 1989-01-11 | Sony Corp | High-speed queue review reproducing system for video signal |
JPH05219481A (en) * | 1992-02-05 | 1993-08-27 | Victor Co Of Japan Ltd | Video signal magnetic reproducer and time base correcting circuit |
-
1986
- 1986-10-20 JP JP61250579A patent/JPS63103592A/en active Pending
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS647783A (en) * | 1987-06-30 | 1989-01-11 | Sony Corp | High-speed queue review reproducing system for video signal |
JPH05219481A (en) * | 1992-02-05 | 1993-08-27 | Victor Co Of Japan Ltd | Video signal magnetic reproducer and time base correcting circuit |
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