JPS63102506A - Digital control gain controller - Google Patents
Digital control gain controllerInfo
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- JPS63102506A JPS63102506A JP24877286A JP24877286A JPS63102506A JP S63102506 A JPS63102506 A JP S63102506A JP 24877286 A JP24877286 A JP 24877286A JP 24877286 A JP24877286 A JP 24877286A JP S63102506 A JPS63102506 A JP S63102506A
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- gain controller
- output
- operational amplifier
- amplification means
- output signal
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- 238000003199 nucleic acid amplification method Methods 0.000 claims abstract description 26
- 239000003990 capacitor Substances 0.000 claims abstract description 11
- 238000010586 diagram Methods 0.000 description 3
Landscapes
- Control Of Amplification And Gain Control (AREA)
Abstract
Description
【発明の詳細な説明】
産業上の利用分野
本発明は、アナログ信号のディジタル制御ゲインコント
ローラに関するものである。DETAILED DESCRIPTION OF THE INVENTION Field of the Invention The present invention relates to a digitally controlled gain controller for analog signals.
従来の技術
従来のこの種のコントローラは、第３図に示すように、
各制御入力信号Ｄｏ、Ｄ１．・・・Ｄ了を取込む複数の
アナログ・スイッチ１と、電流量を制御する抵抗群几、
２Ｒと、それを電圧に変換する演算増幅器２，３とを備
えて成り、前記各制御入力信号ＤＯ〜Ｄ７に応じて、デ
ィジタルコントローラ入力信号Ｖ ｉ ｎ’を電流量制
御することによりディジタルコントローラ出力信号Ｖｏ
ｕｔ’を得るように構成されている。BACKGROUND OF THE INVENTION A conventional controller of this type, as shown in FIG.
Each control input signal Do, D1. ...A plurality of analog switches 1 that take in the D completion, and a group of resistors that control the amount of current,
2R and operational amplifiers 2 and 3 that convert it into a voltage, and controls the amount of current of the digital controller input signal V in' according to each of the control input signals DO to D7 to generate a digital controller output. Signal Vo
ut'.
発明が解決しようとする問題点
しかし、かかる構成によれば、周辺のインピーダンスが
、スイッチ自体のコンタクト抵抗（オン抵抗）及び演算
増幅器の出力インピーダンスと互いに影響し合う結果、
期待する出力と実際の出力とが一致しないという問題点
があった。Problems to be Solved by the Invention However, with this configuration, the surrounding impedance mutually influences the contact resistance (on resistance) of the switch itself and the output impedance of the operational amplifier.
There was a problem that the expected output and the actual output did not match.
本発明は、上述の問題点に鑑みて為されたもので、本発
明の目的とするところは、前記スイッチ自体のオン抵抗
と演算増幅器の出力インピーダンスを無視することので
きるディジタル制御ゲインコントローラを提供すること
にある。The present invention has been made in view of the above problems, and an object of the present invention is to provide a digitally controlled gain controller that can ignore the on-resistance of the switch itself and the output impedance of the operational amplifier. It's about doing.
問題点を解決するための手段
本発明は、上述の問題点を解決するため、キャパシタと
アナログ・スイッチと演算増幅器との組合わせからなる
回路構成としたものである。Means for Solving the Problems In order to solve the above-mentioned problems, the present invention provides a circuit configuration consisting of a combination of a capacitor, an analog switch, and an operational amplifier.
作 用
本発明は上述の構成によって、発生する電圧は、従来の
ように抵抗を流れる電流量ではなく、キャパシタ間を移
動する電荷量に対応するため、前記スイッチのオン抵抗
および演算増幅器の出力インピーダンスを無視すること
が可能となり、期待する出力と一致した実際の出力が得
られることとなる。According to the present invention, with the above-described configuration, the generated voltage corresponds to the amount of charge moving between the capacitors rather than the amount of current flowing through the resistor as in the conventional case. can be ignored, and the actual output will match the expected output.
実施例
第１図は本発明に係るディジタル制御ゲインコントロー
ラの一実施例を示す概略構成ブロック図で、図中、１１
は後述のアナログ・スイッチの制御端子に供給された制
御入力信号ＤＯ１Ｄ１、・・・Ｄ７に応じた増幅量でゲ
インコントローラ入力信号Ｖｉｎを増幅するための可変
増幅手段で、この可変増幅手段１１は複数のアナログ・
スイッチ１２と複数のキャパシタＣ，２Ｃ，４Ｃ，・・
２５６Ｃと１個の演算増幅器１３との組合わせ回路より
成る。Embodiment FIG. 1 is a schematic block diagram showing an embodiment of a digital control gain controller according to the present invention.
is a variable amplification means for amplifying the gain controller input signal Vin by an amplification amount according to the control input signal DO1D1, . . . D7 supplied to the control terminal of the analog switch described later. Analog of
Switch 12 and multiple capacitors C, 2C, 4C,...
It consists of a combination circuit of 256C and one operational amplifier 13.
１４は前記可変増幅手段１１の可変増幅出力信号ＶＢ（
入力信号Ｂ）とゲインコントローラ入力信号Ｖｉｎ （
入力信号Ａ）との差を増幅するための差動増幅手段で、
この差動増幅手段１４は複数のアナログ・スイッチ１２
と２個のキャパシタＣｌ２Ｃと１個の演算増幅器１３と
の組合わせ回路より成る。14 is a variable amplification output signal VB(
input signal B) and gain controller input signal Vin (
A differential amplification means for amplifying the difference with the input signal A),
This differential amplification means 14 includes a plurality of analog switches 12
, two capacitors Cl2C, and one operational amplifier 13.
１６は前記差動増幅手段１４の差動増幅出力信号ＶＤを
時間選択的に選出してこれをゲインコントローラ出力信
号Ｖｏｕｔとして出力するためのサンプルホールド手段
で、このサンプルホールド手段１６は各１個ずつのアナ
ログ・スイッチ１２さキャパシタＣと演算増幅器１３と
の組合わせ回路より成る。Reference numeral 16 designates sample and hold means for time-selectively selecting the differential amplified output signal VD of the differential amplification means 14 and outputs it as the gain controller output signal Vout. It consists of a combination circuit of an analog switch 12, a capacitor C, and an operational amplifier 13.
尚、第１図において、φ１．φ２は同時にはオンしない
２相りロック信号である。In addition, in FIG. 1, φ1. φ2 is a two-phase lock signal that does not turn on at the same time.
次に動作について説明すると、ゲインコントローラ入力
信号Ｖ ｉ ｎは可変増幅手段１１への入力信号と差動
増幅手段１４への入力信号Ａとになる。Next, the operation will be described. The gain controller input signal V in becomes an input signal to the variable amplification means 11 and an input signal A to the differential amplification means 14.
前記可変増幅手段１１への入力信号は、制御信号ＤＯ〜
Ｄ７に応じた増幅量で２５６／Ｘ（但しＸはｏ、１．・
・・２５６）倍に増幅され（可変増幅出力信号ＶＢ）、
これが差動増幅手段１４の入力信号Ｂとなる。The input signal to the variable amplification means 11 is the control signal DO~
The amplification amount according to D7 is 256/X (however, X is o, 1.
...256) times (variable amplified output signal VB),
This becomes the input signal B of the differential amplification means 14.
差動増幅手段１４は、前記入力信号Ａと入力信号Ｂとの
差を増幅し、差動増幅出力信号ＶＤを出力する。The differential amplification means 14 amplifies the difference between the input signal A and the input signal B, and outputs a differential amplification output signal VD.
サンプルホールド手段１５は、その差動増幅出力信号Ｖ
Ｄを時間選択的に選出して、これをゲインコントローラ
出力信号Ｙｏｕｔとして出力する。The sample hold means 15 receives its differential amplified output signal V
D is time-selectively selected and output as the gain controller output signal Yout.
第２図は第１図における各主要部の信号波形を示したも
のである。FIG. 2 shows signal waveforms of each main part in FIG. 1.
発明の効果
以上の説明から明らかなように、本発明は、アナログ・
スイッチとキャパシタと演算増幅器との組合わせ回路で
ケインコントローラを構成したものであるから、キャパ
シタ間を移動する電荷の移動量に対応して電圧が発生せ
しめられるため、前記スイッチのオン抵抗及び演算増幅
器の出力インピーダンスを無視でき、期待する出力と一
致した実際の出力を得ることができるという効果を奏す
るものである。Effects of the Invention As is clear from the above explanation, the present invention has advantages over analog
Since the Kane controller is configured with a combination circuit of a switch, a capacitor, and an operational amplifier, a voltage is generated corresponding to the amount of charge that moves between the capacitors, so the on-resistance of the switch and the operational amplifier This has the effect that the output impedance of the output impedance can be ignored and an actual output that matches the expected output can be obtained.
第１図は本発明に係るディジタル制御ゲインコントロー
ラの一実施例を示す概略構成ブロック図、第２図は第１
図の各主要部の信号波形図、第３図は従来のディジタル
制御ゲインコントローラの概略構成を示すブロック図で
ある。
１１・°°可変増幅手段、１２・・・アナログ・スイッ
チ、１３・・・演算増幅器、１４・・・差動増幅手段、
１５・・・サンプルホールド手段、Ｃ，２Ｃ，〜２５６
Ｃ・・・キャパシタ、Ｖ ｉ ｎ・・・ゲインコントロ
ーラ入力信号、ＶＢ・・・可変増幅出力信号、ＶＤ・・
・差動増幅出力信号、Ｖｏｕｔ・・・ゲインコントロー
ラ出力信号。
代理人の氏名 弁理士 中 尾 敏 男 ほか１名第２
図
第 ３ 図
！FIG. 1 is a schematic block diagram showing an embodiment of the digital control gain controller according to the present invention, and FIG.
FIG. 3 is a block diagram showing a schematic configuration of a conventional digital control gain controller. 11.°° variable amplification means, 12.. analog switch, 13.. operational amplifier, 14.. differential amplification means,
15... Sample hold means, C, 2C, ~256
C... Capacitor, V in... Gain controller input signal, VB... Variable amplified output signal, VD...
- Differential amplification output signal, Vout...gain controller output signal. Name of agent: Patent attorney Toshio Nakao and 1 other person 2nd
Figure 3!
Claims (1)
力信号を増幅するための可変増幅手段と、その可変増幅
手段の出力信号と前記入力信号の差を増幅するための差
動増幅手段と、その差動増幅手段の出力信号を時間選択
的に選出し出力するためのサンプルホールド手段とを具
備し、前記各手段はアナログ・スイッチとキャパシタと
演算増幅器との組合わせ回路より成ることを特徴とする
ディジタル制御ゲインコントローラ。variable amplification means for amplifying an input signal with an amplification factor according to a control input signal supplied to a control terminal; and differential amplification means for amplifying a difference between an output signal of the variable amplification means and the input signal. , and sample and hold means for time-selectively selecting and outputting the output signal of the differential amplification means, each of said means being comprised of a combination circuit of an analog switch, a capacitor, and an operational amplifier. Digitally controlled gain controller.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP24877286A JPS63102506A (en) | 1986-10-20 | 1986-10-20 | Digital control gain controller |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP24877286A JPS63102506A (en) | 1986-10-20 | 1986-10-20 | Digital control gain controller |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS63102506A true JPS63102506A (en) | 1988-05-07 |
Family
ID=17183151
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP24877286A Pending JPS63102506A (en) | 1986-10-20 | 1986-10-20 | Digital control gain controller |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS63102506A (en) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US4898627A (en) * | 1988-03-25 | 1990-02-06 | Armco Advanced Materials Corporation | Ultra-rapid annealing of nonoriented electrical steel |
-
1986
- 1986-10-20 JP JP24877286A patent/JPS63102506A/en active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US4898627A (en) * | 1988-03-25 | 1990-02-06 | Armco Advanced Materials Corporation | Ultra-rapid annealing of nonoriented electrical steel |
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