JPS626195B2 - - Google Patents
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- JPS626195B2 JPS626195B2 JP49031768A JP3176874A JPS626195B2 JP S626195 B2 JPS626195 B2 JP S626195B2 JP 49031768 A JP49031768 A JP 49031768A JP 3176874 A JP3176874 A JP 3176874A JP S626195 B2 JPS626195 B2 JP S626195B2
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- Electric Clocks (AREA)
- Electromechanical Clocks (AREA)
Description
【発明の詳細な説明】
本発明は電池容量表示付電子時計に係り、特に
電源としての電池の容量変化を、時分秒表示の一
部を利用して表示すようにしたものに関する。DETAILED DESCRIPTION OF THE INVENTION The present invention relates to an electronic timepiece with a battery capacity display, and more particularly to one in which a change in the capacity of a battery serving as a power source is displayed using part of the hour, minute, and second display.
例えば、太陽電池を電源とする電子腕時計は、
太陽電池に十分な入射光を期待できない夜間等に
おいても電子腕時計としての機能を働かせる必要
性から、二次電池を併用して電源とする方式を採
用している。すなわち、入射光の強いときは、太
陽電池の出力により電子腕時計としての機能を働
らかせるとともに二次電池にも充電し、入射光の
ないときまたは太陽電池のみの出力では電子腕時
計としての機能を果せないとき、二次電池の出力
により電子腕時計としての機能を働らかせてい
る。しかしながら、二次電池の容量にはある一定
の限度があり、強い入射光の下で過充電しても、
入射光のない状態で長時間使用すると、二次電池
の容量が著しく低下し、電子腕時計としての機能
を停止させてしまうことがある。このような状態
を防止するには、二次電池の容量が低下したこと
を何らかの手段によつて表示し、強い入射光の下
で二次電池を充電するように使用者に知らせるこ
とが必要である。 For example, an electronic wristwatch powered by solar cells,
Because it is necessary to function as an electronic wristwatch even at night, when sufficient light is not expected to enter the solar cells, we have adopted a system that uses a secondary battery as a power source. In other words, when there is strong incident light, the output of the solar cell activates the function of an electronic wristwatch and also charges the secondary battery, while when there is no incident light or the output of only the solar cell, the function of the electronic wristwatch is activated. When things don't work out, it uses the output of the secondary battery to function as an electronic wristwatch. However, there is a certain limit to the capacity of secondary batteries, and even if they are overcharged under strong incident light,
If the watch is used for a long time without incident light, the capacity of the secondary battery will drop significantly and the watch may stop functioning as an electronic watch. To prevent this situation, it is necessary to use some means to indicate that the capacity of the secondary battery has decreased and to inform the user to charge the secondary battery under strong incident light. be.
本発明はこのような電池の容量変化の表示に時
分秒表示の一部を利用しようとするものである。
通常、デジタル表示式といわれる電子腕時計は、
時、分を数字で表示し、秒の表示を時と分の表示
の中間に配置したドツトの点滅で行なうようにし
ている。本発明はこの秒を表示するドツトを利用
して電池の容量変化を表示する。以下図面に従つ
て、秒を表示する２個のドツトを、二次電池の容
量が十分あるときはそれぞれのドツトを交互に点
滅し、二次電池の容量が低下してきて太陽電池に
よる充電が必要であることを表示するときには、
２個のドツトを同時に点滅するようにした実施例
について説明する。 The present invention attempts to utilize a part of the hours, minutes, and seconds display to display such changes in battery capacity.
Electronic watches, which are usually referred to as digital display types,
The hours and minutes are displayed in numbers, and the seconds are displayed by a blinking dot placed between the hours and minutes. The present invention uses this dot to display seconds to display changes in battery capacity. According to the drawing below, the two dots that indicate the second will blink alternately when the secondary battery has sufficient capacity, and when the secondary battery capacity has decreased, it will be necessary to charge it with solar cells. When displaying that
An embodiment in which two dots are made to blink at the same time will be described.
第１図において、基準信号発生器FGは水晶振
動子を含み32768KHzの発振信号を出力する。分
周器DVはこの発振信号を分周し１Hzの１秒信号
を出力するものである。分周器DVからの１秒信
号は60進のカウンタN1に加えられて分周され1/6
０Hzの１分信号を出力するとともに、また１分信
号は10進の第２のカウンタN2および６進の第３
カウンタN3に順次加えられて分周され1/3600Hz
の１時間信号を出力する。１時間信号は更に10進
の第４カウンタN4および２進の第５カウンタN5
に順次加えられて分周される。第２カウンタ
N2、第３カウンタN3および第４カウンタN4の計
数状態は４ビツトの２進コードで出力され、それ
ぞれ第２デコーダ回路D2と第２駆動回路K2、第
３デコーダ回路D3と第３駆動回路K3および第４
デコーダ回路D4と第４駆動回路K4を介してそれ
らの各計数結果を分桁の表示装置M1、10分桁の
表示装置M10および時間桁の表示装置H1により数
字表示する。第５カウンタN5の計数状態は１ビ
ツトの２進コードで出力されるが、これも同様に
して第５デコーダ回路D5と第５駆動回路K5を介
してその計数結果を10時間桁の表示装置H10に数
字表示する。 In FIG. 1, the reference signal generator FG includes a crystal oscillator and outputs an oscillation signal of 32768 KHz. The frequency divider DV divides the frequency of this oscillation signal and outputs a 1 Hz 1 second signal. The 1 second signal from the frequency divider DV is added to the sexagesimal counter N1 and divided into 1/6.
It outputs a 0Hz 1-minute signal, and the 1-minute signal is also output to the second decimal counter N2 and the third hexadecimal counter.
Sequentially added to counter N 3 and divided to 1/3600Hz
Outputs a signal for 1 hour. The 1-hour signal is further processed by a fourth decimal counter N4 and a fifth binary counter N5.
are sequentially added to and divided. 2nd counter
The counting states of N 2 , the third counter N 3 and the fourth counter N 4 are output as 4-bit binary codes, and the counting states of the second decoder circuit D 2 , the second drive circuit K 2 , and the third decoder circuit D 3 are outputted as 4-bit binary codes. Third drive circuit K3 and fourth
Via the decoder circuit D 4 and the fourth drive circuit K 4 , the respective counting results are numerically displayed on a minute digit display device M 1 , a ten minute digit display device M 10 and an hour digit display device H 1 . The counting state of the fifth counter N5 is output as a 1-bit binary code, and in the same way, the counting result is converted into 10 hour digits via the fifth decoder circuit D5 and the fifth drive circuit K5 . The numbers are displayed on the display device H10 .
秒の表示装置Ｓは10分桁の表示装置M10と時間
桁の表示装置H1の中間に配置された二つのドツ
トSaおよびSbにより構成される。これら二つの
ドツトSaおよびSbはそれぞれ第１駆動回路K1aお
よびK1bにより適宜駆動されて点滅表示するが、
第１駆動回路K1aおよびK1bと、基準信号発生器
FGおよび分周器DVより構成される秒の信号発生
回路１間に信号切換え回路２を挿入している。ダ
イオードＤを介して並列接続された太陽電池３と
二次電池４は電子腕時計の電源となるものであ
り、その配線は第１図では省略している。また、
二次電池４の両端には電池電圧チエツク回路５が
接続され、その出力を上述した信号切換え回路２
に加えるようにしている。 The second display S is composed of two dots Sa and Sb placed between the ten minute digit display M10 and the hour digit display H1 . These two dots Sa and Sb are appropriately driven by the first drive circuits K 1 a and K 1 b to display blinking, but
First drive circuit K 1 a and K 1 b and reference signal generator
A signal switching circuit 2 is inserted between a second signal generating circuit 1 consisting of an FG and a frequency divider DV. A solar cell 3 and a secondary battery 4 connected in parallel through a diode D serve as a power source for the electronic wristwatch, and their wiring is omitted in FIG. 1. Also,
A battery voltage check circuit 5 is connected to both ends of the secondary battery 4, and its output is transferred to the signal switching circuit 2 described above.
I try to add it to.
信号切換え回路２は、第１図に示されるよう
に、フリツプフロツプFF、ナントゲートG1，
G2，G3、アンドゲートG4，G5、およびインバー
タInから構成される。フリツプフロツプFFはそ
のＴ端子に秒の信号発生回路１からの出力を加
え、Ｑ端子出力および端子をそれぞれナンドゲ
ートG1およびG2の一方の入力端に加えるように
している。秒の信号発生回路１からの出力はまた
ナンドゲートG3の一方の入力端に加えられる。
電池電圧チエツク回路５の出力はナンドゲート
G1およびG2の他方の入力端に加えられるととも
に、インバータInを介してナンドゲートG3の他
方の入力端にも加えられる。ナンドゲートG1お
よびG2の出力はそれぞれアンドゲートG4および
G5の一方の入力端に加えられ、ナンドゲートG3
の出力はこれらのアンドゲートG4およびG5の他
方の入力端に共通して加えられる。アンドゲート
G4およびG5の出力は第１駆動回路K1aおよびK1b
にそれぞれ加えられその駆動を制御する。 As shown in FIG. 1, the signal switching circuit 2 includes a flip-flop FF, a Nant gate G 1 ,
It consists of G 2 , G 3 , AND gates G 4 , G 5 , and an inverter In. The flip-flop FF has its T terminal applied with the output from the second signal generating circuit 1, and its Q terminal output and terminal applied to one input terminal of NAND gates G1 and G2 , respectively. The output from the second signal generating circuit 1 is also applied to one input of the NAND gate G3 .
The output of battery voltage check circuit 5 is a NAND gate.
It is applied to the other input terminal of G 1 and G 2 , and also applied to the other input terminal of NAND gate G 3 via the inverter In. The outputs of NAND gates G 1 and G 2 are respectively AND gates G 4 and
added to one input end of G 5 , NAND gate G 3
The outputs of are commonly applied to the other input ends of these AND gates G 4 and G 5 . and gate
The outputs of G 4 and G 5 are connected to the first drive circuit K 1 a and K 1 b
are added to each to control their drive.
電池電圧チエツク回路５は第２図のように構成
される。この電池電圧チエツク回路５は基本的に
は二つのＣ−MOSマルチバイブレータ、すなわ
ち無安定マルチバイブレータAMと単安定マルチ
バイブレータMM、およびこれらの出力を比較す
る回路とから構成される。ノアゲートG6および
G7は無安定マルチバイブレータAMを形成し、そ
のパルス巾は二次電池４から得られらる供給電圧
VDDによつて変わる。一方、ノアゲートG8およ
びG9は立上りでトリガーされかつ供給電圧VDD
の多少の変化によつても比較的一定の出力パルス
巾を維持する単安定マルチバイブレータMMを形
成する。無安定マルチバイブレータAMの出力
QAは単安定マルチバイブレータMMをトリガー
するためコンデンサC1を介して加えられ、また
Ｄ型フリツプフロツプFFDのＤ（DATA）端子
にも加えられる。単安定マルチバイブレータMM
の出力QMはＤ型のフリツプフロツプFFDのＣ
（CLOCK）端子に加えられる。 The battery voltage check circuit 5 is constructed as shown in FIG. This battery voltage check circuit 5 basically consists of two C-MOS multivibrators, namely an astable multivibrator AM and a monostable multivibrator MM, and a circuit for comparing their outputs. Noah Gate G 6 and
G 7 forms an astable multivibrator AM, the pulse width of which is determined by the supply voltage obtained from the secondary battery 4.
Depends on VDD. On the other hand, NOR gates G 8 and G 9 are triggered on the rising edge and the supply voltage VDD
A monostable multivibrator MM is formed that maintains a relatively constant output pulse width even with slight changes in . Output of astable multivibrator AM
QA is applied via capacitor C1 to trigger the monostable multivibrator MM, and is also applied to the D(DATA) terminal of the D-type flip-flop FFD. Monostable multivibrator MM
The output QM of is the C of the D-type flip-flop FFD.
(CLOCK) terminal.
抵抗R1およびR2は、二次電池４の端子電圧VB
が設定されたトリツプ電圧Vtripになつたとき、
無安定マルチバイブレータAMのパルス巾が単安
定マルチバイブレータMMより大きくなるように
調節するものである。ダイオードD1および抵抗
R3は無安定マルチバイブレータAMおよび単安定
マルチバイブレータMMの出力パルス巾に関連し
て安全比を決定する。また、回路のヒステリシス
はトランジスタQ1をバイパスする抵抗R4の値に
比例して決定される。なお、第２図において、端
子t1には二次電池４の正極側が接続され、端子電
圧VBが印加される。端子t2はＤ型フリツプフロ
ツプFFDの端子に接続され、信号切換え回路
２への出力端となるものである。 Resistors R 1 and R 2 are connected to the terminal voltage VB of the secondary battery 4.
When reaches the set trip voltage Vtrip,
The pulse width of the astable multivibrator AM is adjusted to be larger than that of the monostable multivibrator MM. Diode D 1 and resistor
R 3 determines the safety ratio in relation to the output pulse width of the astable multivibrator AM and the monostable multivibrator MM. Also, the hysteresis of the circuit is determined in proportion to the value of the resistor R 4 that bypasses the transistor Q 1 . In FIG. 2, the positive electrode side of the secondary battery 4 is connected to the terminal t1 , and a terminal voltage VB is applied thereto. The terminal t2 is connected to the terminal of the D-type flip-flop FFD and serves as an output terminal to the signal switching circuit 2.
さて、ここで、二次電池４の容量が低下して、
充電する必要性が生じてくるときの二次電池４の
端子電圧VBをトリツプ電圧Vtripに等しいものと
する。第３図のタイムチヤートをも参照して説明
すると、第２図において、二次電池４の端子電圧
VBがトリツプ電圧Vtripより大きい場合、無安定
マルチバイブレータAMの出力パルス巾TAが減
少し、単安定マルチバイブレータMMからの出力
QBの立上り点がＤ型フリツプフロツプFFDのＣ
端子に加えられるとき、Ｄ端子はＬレベルでその
端子出力はＨレベルになる。二次電池４の端子
電圧VBがトリツプ電圧Vtripより低下すると、無
安定マルチバイブレータAMの出力パルス巾TA
は増加する。それ故、Ｄ型フリツプフロツプ
FFDのＤ端子は出力QBの立上り点がＤ型フリツ
プフロツプFFDのＣ端子に加えられるとき、ま
だＨレベルで、端子出力をＨレベルからＬレベ
ルに反転させる。 Now, the capacity of the secondary battery 4 has decreased,
It is assumed that the terminal voltage VB of the secondary battery 4 when the need for charging arises is equal to the trip voltage Vtrip. To explain with reference to the time chart in FIG. 3, in FIG. 2, the terminal voltage of the secondary battery 4 is
When VB is greater than the trip voltage Vtrip, the output pulse width TA of the astable multivibrator AM decreases and the output from the monostable multivibrator MM decreases.
The rising point of QB is C of the D-type flip-flop FFD
When applied to the terminal, the D terminal becomes L level and the terminal output becomes H level. When the terminal voltage VB of the secondary battery 4 drops below the trip voltage Vtrip, the output pulse width TA of the astable multivibrator AM
increases. Therefore, the D-type flip-flop
The D terminal of the FFD is still at the H level when the rising point of the output QB is applied to the C terminal of the D-type flip-flop FFD, inverting the terminal output from the H level to the L level.
このようにして、Ｄ型のフリツプフロツプ
FFDの端子出力は、そのレベルによつて二次
電池４の端子電圧VBがトリツプ電圧Vtripより大
きいか小さいかを表わす。 In this way, a D-type flip-flop
The terminal output of the FFD indicates whether the terminal voltage VB of the secondary battery 4 is larger or smaller than the trip voltage Vtrip depending on its level.
二次電池４の容量が十分あるときは、上述のよ
うにして電池電圧チエツク回路５からＨレベルを
出力する。このとき、第１図の信号切換え回路２
において、ナンドゲートG1およびG2の一方の入
力端はＨレベルになり、フリツプフロツプFFの
Ｑ端子出力および端子出力に従つて出力する。
フリツプフロツプFFは秒の信号発生回路１から
の１Hzの１秒信号によつてトリガーされ、ナンド
ゲートG1およびG2の出力は互いに逆極性の関係
となり、周期はそれぞれ２秒になる。また、電池
電圧チエツク回路５からのＨレベルの出力はイン
バータInにより反転されて、ナンドゲートG3の
一方の入力端にＬレベルとして加わり、秒信号の
如何んに関わらずＨレベルを出力する。従つて、
ナンドゲートG4およびG5からは互いに逆極性の
関係にある周期２秒の信号をそれぞれ出力し、第
１駆動回路K1aおよびK1bを駆動する。これによ
つてドツトSaおよびSbは交互に点滅する。それ
ぞれの点滅の周期は２秒である。 When the secondary battery 4 has sufficient capacity, the battery voltage check circuit 5 outputs an H level as described above. At this time, the signal switching circuit 2 in FIG.
At this time, one of the input terminals of NAND gates G1 and G2 becomes H level and outputs according to the Q terminal output and terminal output of flip-flop FF.
The flip-flop FF is triggered by a 1 Hz 1 second signal from the second signal generating circuit 1, and the outputs of the NAND gates G1 and G2 have opposite polarities, each having a period of 2 seconds. Further, the H level output from the battery voltage check circuit 5 is inverted by the inverter In, and is applied as an L level to one input terminal of the NAND gate G3 , so that it outputs an H level regardless of the second signal. Therefore,
The NAND gates G 4 and G 5 output signals having a cycle of 2 seconds and having opposite polarities to each other to drive the first drive circuits K 1 a and K 1 b. As a result, the dots Sa and Sb flash alternately. The period of each blink is 2 seconds.
二次電池４の容量が低下して端子電圧VBがト
リツプ電圧Vtrip以下になると、電池電圧チエツ
ク回路５はＬレベルを出力する。このＬレベルの
出力はナンドゲートG1およびG2の一方の入力端
に加わり、フリツプフロツプFFのそれぞれＱ端
子出力および端子出力の如何んに関わらず両者
ともＨレベルを出力させる。ナンドゲートG3の
一方の入力端にはインバータInにより反転された
Ｈレベルが加わり、秒の信号発生回路１からの秒
信号に従つて出力する。アンドゲートG4および
G5の出力はともにこのナンドゲートG3の出力に
従い、同信号をもつて第１駆動回路K1aおよび
K1bを駆動する。この場合、ドツトSaおよびSbは
同時に点滅し、その点滅の周期は１秒になる。 When the capacity of the secondary battery 4 decreases and the terminal voltage VB becomes lower than the trip voltage Vtrip, the battery voltage check circuit 5 outputs an L level. This L level output is applied to one input terminal of NAND gates G1 and G2 , causing both to output H level regardless of the respective Q terminal output and terminal output of the flip-flop FF. An H level inverted by an inverter In is applied to one input terminal of the NAND gate G3 , and output according to the second signal from the second signal generating circuit 1. ANDGATE G 4 and
The outputs of G5 both follow the output of this NAND gate G3 , and with the same signal are sent to the first drive circuits K1a and
Drive K 1 b. In this case, the dots Sa and Sb blink at the same time, and the blinking period is 1 second.
なお、電池電圧チエツク回路５を第２図に示し
たように構成すると、0.5μＡという小電流で目
的を達成できる利点があるが、第４図のような回
路でも実現可能である。第４図において、端子t1
に二次電池４の正極側が接続され、二次電池４の
端子電圧VBが印加される。トリツプ電圧Vtripの
調節は、端子t1とトランジスタQ2のベース間に定
電圧ダイオードZDとともに直列接続された抵抗
R5の値を調節することによつて行なわれる。信
号切換え回路２への出力はもう一つのトランジス
タQ3のコレクタに接続された端子t2から取出さ
れ、端子電圧VBがトリップ電圧Vtripより大きい
ときは、トランジスタQ2をON、トランジスタQ3
をOFFしてＨレベルを出力し、小さくなれば、
トランジスタQ2をOFF、トランジスタQ3をONし
てＬレベルを出力する。 It should be noted that if the battery voltage check circuit 5 is constructed as shown in FIG. 2, it has the advantage that the purpose can be achieved with a small current of 0.5 .mu.A, but it can also be implemented with a circuit as shown in FIG. 4. In Figure 4, terminal t 1
The positive electrode side of the secondary battery 4 is connected to the terminal voltage VB of the secondary battery 4. The trip voltage Vtrip can be adjusted by using a resistor connected in series with a constant voltage diode ZD between the terminal t 1 and the base of the transistor Q 2 .
This is done by adjusting the value of R5 . The output to the signal switching circuit 2 is taken from the terminal t2 connected to the collector of another transistor Q3 , and when the terminal voltage VB is greater than the trip voltage Vtrip, the transistor Q2 is turned on and the transistor Q3 is turned on.
Turn off and output H level, and if it becomes small,
Transistor Q2 is turned off, transistor Q3 is turned on, and L level is output.
以上の実施例では、二次電池４の容量が十分あ
るときは、それぞれのドツトSaおよびSbを交互
に点滅して秒を表示し、二次電池４の容量が低下
してきて太陽電池３による充電が必要であると
き、２個のドツトSaおよびSbを同時に点滅する
ようにしたが、以下のようにするものであつても
よい。二次電池４の容量が十分あるとき、２個の
ドツトSaおよびSbを同時に点滅して秒を表示
し、二次電池４の容量が低下してきたとき、それ
ぞれのドツトSaおよびSbを交互に点滅する。つ
まり、上述の実施例とは逆である。 In the above embodiment, when the capacity of the secondary battery 4 is sufficient, the dots Sa and Sb alternately flash to display the seconds, and when the capacity of the secondary battery 4 decreases, the solar battery 3 starts charging. When this is necessary, the two dots Sa and Sb are made to blink at the same time, but it may be done as follows. When the capacity of the secondary battery 4 is sufficient, the two dots Sa and Sb blink at the same time to display the seconds, and when the capacity of the secondary battery 4 decreases, the dots Sa and Sb blink alternately. do. That is, this is the opposite of the embodiment described above.
また本発明は二次電池と太陽電池を用いたもの
に限らず、一次電池を用いた電子腕時計におい
て、一次電池の容量が低下して一次電池の交換を
知らせる表示にも適用できる。 Furthermore, the present invention is not limited to those using secondary batteries and solar cells, but can also be applied to electronic wristwatches using primary batteries, where the capacity of the primary battery has decreased and a display indicating that the primary battery needs to be replaced is also applicable.
このように本発明によれば、秒を表示するドツ
トによりその表示様態を変えて電池の容量変化を
表示するものであるから、新たに電池の容量変化
を表示する装置が不要で電子腕時計の構成を簡単
にできるとともに、また、このドツト駆動回路と
秒の信号発生回路間に信号切換え回路を挿入し、
電池の容量変化を検出する電池電圧チエツク回路
の出力により、前記信号切換え回路を制御し前記
信号発生回路から前記駆動回路に加えられる信号
の様態を適宜異ならしめるものであるから、電池
電圧チエツク回路の付加により小量の電力を余計
に消費するだけで電池の寿命にはほとんど影響し
ないようにでき、更には秒の信号発生回路を電池
の容量変化の表示のための信号発生回路に兼用し
て秒の信号発生回路を有効にできる利点がある。 As described above, according to the present invention, changes in the battery capacity are displayed by changing the display mode of the dots that display seconds, so there is no need for a new device to display changes in battery capacity, and the configuration of the electronic wristwatch is improved. In addition, by inserting a signal switching circuit between this dot drive circuit and the second signal generation circuit,
The output of the battery voltage check circuit that detects a change in battery capacity controls the signal switching circuit and changes the mode of the signal applied from the signal generation circuit to the drive circuit as appropriate. By adding a small amount of power, the battery life is hardly affected by the addition of a small amount of power.Furthermore, the second signal generation circuit can also be used as a signal generation circuit for displaying changes in battery capacity. This has the advantage of making the signal generation circuit more effective.
また、信号切換回路によつて同時に、秒に関連
した点滅の周期も変えられ、表示様態の組合せ変
化と点滅周期の変化で、有効に電池容量の低下を
表示することができる。 Furthermore, the signal switching circuit simultaneously changes the blinking period related to seconds, and by changing the combination of display modes and changing the blinking period, it is possible to effectively display a decrease in battery capacity.
第１図は本発明の一実施例を示すブロツクダイ
ヤグラム、第２図は第１図の要部具体例を示す電
気回路図、第３図は第２図の具体例を説明するた
めのタイムチヤート、第４図は第２図と同部の他
の具体例を示す電気回路図である。
Ｓ……秒の表示装置、SaおよびSb……ドツ
ト、FG……基準信号発生器、DV……分周器、
K1aおよびK1b……第１駆動回路、１……秒の信
号発生回路、２……信号切換え回路、４……二次
電池、５……電池電圧チエツク回路。
Fig. 1 is a block diagram showing one embodiment of the present invention, Fig. 2 is an electric circuit diagram showing a specific example of the main parts of Fig. 1, and Fig. 3 is a time chart for explaining the specific example of Fig. 2. , FIG. 4 is an electric circuit diagram showing another specific example of the same part as FIG. 2. S... Second display device, Sa and Sb... Dot, FG... Reference signal generator, DV... Frequency divider,
K1a and K1b ...first drive circuit, 1...second signal generation circuit, 2...signal switching circuit, 4...secondary battery, 5...battery voltage check circuit.
Claims (1)
滅をもつて秒を表示するようにしたものにおい
て、このドツトの駆動回路と秒の信号発生回路間
に信号切換え回路を挿入し、電池の容量を検出す
る電池電圧のチエツク回路の出力により、上記２
個のドツトにおける交互点滅と同時点滅の組合せ
表示様態及び上記組合せ表示中の秒に関連した点
滅の周期を異ならしめるよう構成してなることを
特徴とする電池容量表示付電子時計。1. In a device that displays the seconds by blinking two dots placed between the hours and minutes, a signal switching circuit is inserted between the dot drive circuit and the seconds signal generation circuit, and the battery By the output of the battery voltage check circuit that detects the capacity of
1. An electronic timepiece with a battery capacity display, characterized in that the display mode is a combination of alternate blinking and simultaneous blinking in individual dots, and the period of blinking related to seconds in the combination display is made different.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP49031768A JPS626195B2 (en) | 1974-03-19 | 1974-03-19 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP49031768A JPS626195B2 (en) | 1974-03-19 | 1974-03-19 |
Related Child Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP56143504A Division JPS5917773B2 (en) | 1981-09-10 | 1981-09-10 | voltage detection circuit |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS50125772A JPS50125772A (en) | 1975-10-03 |
| JPS626195B2 true JPS626195B2 (en) | 1987-02-09 |
Family
ID=12340210
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP49031768A Expired JPS626195B2 (en) | 1974-03-19 | 1974-03-19 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS626195B2 (en) |
Families Citing this family (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS51131972U (en) * | 1975-04-17 | 1976-10-23 | ||
| JPS5279972U (en) * | 1975-12-11 | 1977-06-15 | ||
| JPS5832675B2 (en) * | 1977-06-22 | 1983-07-14 | セイコーインスツルメンツ株式会社 | electronic clock |
| JPS6237793U (en) * | 1985-08-22 | 1987-03-06 |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS4975178A (en) * | 1972-11-20 | 1974-07-19 |
-
1974
- 1974-03-19 JP JP49031768A patent/JPS626195B2/ja not_active Expired
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS4975178A (en) * | 1972-11-20 | 1974-07-19 |
Also Published As
| Publication number | Publication date |
|---|---|
| JPS50125772A (en) | 1975-10-03 |
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