JPS62250729A - ダイバ−シチ受信装置 - Google Patents
ダイバ−シチ受信装置Info
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- JPS62250729A JPS62250729A JP61095167A JP9516786A JPS62250729A JP S62250729 A JPS62250729 A JP S62250729A JP 61095167 A JP61095167 A JP 61095167A JP 9516786 A JP9516786 A JP 9516786A JP S62250729 A JPS62250729 A JP S62250729A
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- antenna
- switching
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- 230000001934 delay Effects 0.000 claims description 3
- 230000003111 delayed effect Effects 0.000 claims description 2
- 238000005562 fading Methods 0.000 abstract description 6
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- 206010011878 Deafness Diseases 0.000 abstract 1
- 238000001514 detection method Methods 0.000 description 9
- 238000010586 diagram Methods 0.000 description 5
- 230000007423 decrease Effects 0.000 description 4
- 230000000694 effects Effects 0.000 description 3
- 230000005684 electric field Effects 0.000 description 2
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Landscapes
- Radio Transmission System (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
(産業上の利用分野)
本発明は複数のアンテナ素子からの高周波信号を選択的
に切換受信して、フェージングによる影響を減少させ、
信頼性の高い通信を確保するダイバーシチ受信装置に関
する。
に切換受信して、フェージングによる影響を減少させ、
信頼性の高い通信を確保するダイバーシチ受信装置に関
する。
(従来の技術)
無線通信では、フェージングによって良質な通信が妨げ
られることから種々のダイバーシチ受信装置が開発され
ている。中でも2以上のアンテナを設置し、これを選択
的に切換受信する所謂スペースダイバーシチ受信方式は
回路構成が簡単なことからよく利用されている。このよ
うなスペースダイバーシチ受信方式を採用するダイバー
シチ受信装置としては第4図に示すようなものが知られ
ている。第4図において、IA及びIBは同一電波を受
信するアンテナであり、所定間隔、例えば到来電波のハ
波長の間隔をおいて設置される。また、アンテナIAs
LBはアンテナ切換回路2に接続されている。ここで第
4図に示すようにアンテナ切換回路2はアンテナ切換側
に切換えられており、アンテナIAからの受信信号のみ
がRF・IF回路3及び検波回路4で成る信号再生部に
与えられ、低周波信号に再生される。フェージングが発
生しアンテナIAの電界強度が低下すると、制御回路5
はRF・IF回路3からの出力低下を判別し、制御信号
をアンテナ切換回路2に送出してアンテナ切換回路2を
アンテナ切換側に切換え、アンテナLBによる受信信号
を信号再生部に与えることでフェージングによる影響を
低減するようにしている。
られることから種々のダイバーシチ受信装置が開発され
ている。中でも2以上のアンテナを設置し、これを選択
的に切換受信する所謂スペースダイバーシチ受信方式は
回路構成が簡単なことからよく利用されている。このよ
うなスペースダイバーシチ受信方式を採用するダイバー
シチ受信装置としては第4図に示すようなものが知られ
ている。第4図において、IA及びIBは同一電波を受
信するアンテナであり、所定間隔、例えば到来電波のハ
波長の間隔をおいて設置される。また、アンテナIAs
LBはアンテナ切換回路2に接続されている。ここで第
4図に示すようにアンテナ切換回路2はアンテナ切換側
に切換えられており、アンテナIAからの受信信号のみ
がRF・IF回路3及び検波回路4で成る信号再生部に
与えられ、低周波信号に再生される。フェージングが発
生しアンテナIAの電界強度が低下すると、制御回路5
はRF・IF回路3からの出力低下を判別し、制御信号
をアンテナ切換回路2に送出してアンテナ切換回路2を
アンテナ切換側に切換え、アンテナLBによる受信信号
を信号再生部に与えることでフェージングによる影響を
低減するようにしている。
(発明が解決しようとする問題点)
しかしながら、高周波信号を受信するアンテナの電界強
度は極めて低く、このような低レベルのアンテナ出力自
体を直接切換えることから、このアンテナ切換の際に受
信信号が瞬断され、復調出力に雑音を生じる。また、ア
ンテナの切換頻度が高くなる程アンテナ切換に伴う切換
雑音の影響が大きくなる。
度は極めて低く、このような低レベルのアンテナ出力自
体を直接切換えることから、このアンテナ切換の際に受
信信号が瞬断され、復調出力に雑音を生じる。また、ア
ンテナの切換頻度が高くなる程アンテナ切換に伴う切換
雑音の影響が大きくなる。
更には、ダイバーシチブランチとしての全てのアンテナ
IAflBの受信電界強度が設定値以下に低下すると、
アンテナ切換回路2が連続的に切換動作する、所謂ハン
ティング現象が発生し、良質な通信状態を確保すること
ができないという問題があった。
IAflBの受信電界強度が設定値以下に低下すると、
アンテナ切換回路2が連続的に切換動作する、所謂ハン
ティング現象が発生し、良質な通信状態を確保すること
ができないという問題があった。
(発明の目的)
本発明は上記問題点に鑑みてなされたもので、アンテナ
切換時に発生する雑音による受信感度の低下を防止し、
信頼性の高い通信を確保することのできるダイバーシチ
受信装置を提供することを目的とする。
切換時に発生する雑音による受信感度の低下を防止し、
信頼性の高い通信を確保することのできるダイバーシチ
受信装置を提供することを目的とする。
(問題点を解決するための手段)
前述した問題点を解決し上記目的を達成するため本発明
は、複数のアンテナ素子からの高周波信号をアンテナ切
換回路により選択的に受信し、この高周波信号を信号再
生部で低周波信号に再生するダイバーシテ受信装置にお
いて、信号再生部からの出力に基づいてアンテナ受M状
態を判別し該判別結果に応じて制御信号を出力する制御
回路と、信号再生部からの再生信号をディジタル信号に
変換するA / D変換回路と、とのA/D変換回路か
らの信号をスイッチング手段を介して入力し該信号をア
ナログ信号変換するD/A変換回路と、そのアナログ信
号を所定の遅延時間1dだけ遅延する遅延回路とを備え
、制御回路からの制御信号に基づいてスイッチング手段
を作動させ、時間Tdより短かい時間7bの間だけA/
D変換回路からの信号を遮断しつつ遅延回路からの遅延
出力をD/入変換回路に送出するようにしたものである
。
は、複数のアンテナ素子からの高周波信号をアンテナ切
換回路により選択的に受信し、この高周波信号を信号再
生部で低周波信号に再生するダイバーシテ受信装置にお
いて、信号再生部からの出力に基づいてアンテナ受M状
態を判別し該判別結果に応じて制御信号を出力する制御
回路と、信号再生部からの再生信号をディジタル信号に
変換するA / D変換回路と、とのA/D変換回路か
らの信号をスイッチング手段を介して入力し該信号をア
ナログ信号変換するD/A変換回路と、そのアナログ信
号を所定の遅延時間1dだけ遅延する遅延回路とを備え
、制御回路からの制御信号に基づいてスイッチング手段
を作動させ、時間Tdより短かい時間7bの間だけA/
D変換回路からの信号を遮断しつつ遅延回路からの遅延
出力をD/入変換回路に送出するようにしたものである
。
(実施例)
本発明の実施例を図面に基づいて説明する。
第1図は本発明の一実施例をFM受信用の受信装置を例
にとって示したブロック図である。まず構成を説明する
と、IA及びIBはアンテナであり、アンテナIA及び
IBは所定間隔、例えば到来電波のハ波長の間隔をおい
て設置される。各アンテナLA、IBの出力端はアンテ
ナ切換回路2に接続され、アンテナlA*IBにより受
信した高周波信号を後で説明する制御回路からの指令に
基づくアンテナ切換回路2の切換動作で選択される。こ
のように選択された高周波信号は信号再生部、叩ちRF
−IP’回路3及び検波回路4に与えられ、低周波信号
に再生される。信号再生部の構成を具体的に説明すると
、まずRF・工F回路3にはアンテナからの高周波信号
を増幅する高周波増幅回路と、所定周波数で発振する局
部発振器とを内蔵しており、高周波増幅回路で高周波増
幅された増幅信号と局部発振器よりの局部発振信号とを
ヘテロダイン検波し、その差の周波数をビートとして中
間周波数信号を形成している。また、検波回路4はRF
・IF回路3からの中間周波信号の振幅を一定の振幅に
そろえる振幅制限器と、弁別器とを内蔵しており、予め
設定した中心周波数からの周波数偏移に比例した信号を
出力することで中間周波信号から低周波信号を取り出す
ようkしている。5はアンテナ受信状態を判別する制御
回路であり、予め所定の閾値が設定され、RF・IF回
路3からの出力、例えばリミッタ−電流の値が閾値を下
回った場合には制御信号をアンテナ切換回路2及びスイ
ッチング手段7に送出する。
にとって示したブロック図である。まず構成を説明する
と、IA及びIBはアンテナであり、アンテナIA及び
IBは所定間隔、例えば到来電波のハ波長の間隔をおい
て設置される。各アンテナLA、IBの出力端はアンテ
ナ切換回路2に接続され、アンテナlA*IBにより受
信した高周波信号を後で説明する制御回路からの指令に
基づくアンテナ切換回路2の切換動作で選択される。こ
のように選択された高周波信号は信号再生部、叩ちRF
−IP’回路3及び検波回路4に与えられ、低周波信号
に再生される。信号再生部の構成を具体的に説明すると
、まずRF・工F回路3にはアンテナからの高周波信号
を増幅する高周波増幅回路と、所定周波数で発振する局
部発振器とを内蔵しており、高周波増幅回路で高周波増
幅された増幅信号と局部発振器よりの局部発振信号とを
ヘテロダイン検波し、その差の周波数をビートとして中
間周波数信号を形成している。また、検波回路4はRF
・IF回路3からの中間周波信号の振幅を一定の振幅に
そろえる振幅制限器と、弁別器とを内蔵しており、予め
設定した中心周波数からの周波数偏移に比例した信号を
出力することで中間周波信号から低周波信号を取り出す
ようkしている。5はアンテナ受信状態を判別する制御
回路であり、予め所定の閾値が設定され、RF・IF回
路3からの出力、例えばリミッタ−電流の値が閾値を下
回った場合には制御信号をアンテナ切換回路2及びスイ
ッチング手段7に送出する。
6は信号再生部、即ち検波回路4からの再生信号をディ
ジタル信号に変換するA / D変換回路であり、A/
D変換回路6からの信号はスイッチング手段7を介して
D/A変換回路8及び遅延回路9に与えられる。ここで
スイッチング手段7は第1図に示すように通常時はA
/ D変換回路6側に接続されており、制御回路5から
の制御信号を入力すると、第2図に示すようにRF・I
F回路3、検波回路4及びA / D変換回路6による
信号遅延時間τユ経過後遅延回路9側に切換わり、更に
所定時間τb経過後復旧する。この遅延回路9側に保持
する時間τbの値はアンテナ切換回路201回の切換動
作に伴なって発生する雑音の最大持続時間rn以上に設
定される。また、遅延回路9による遅延時間τdの値は
時間τb以上に設定される。D/A変換回路8からのD
/ A変換されたアナログ情報は他の装置、例えば音
響器等に送出される。
ジタル信号に変換するA / D変換回路であり、A/
D変換回路6からの信号はスイッチング手段7を介して
D/A変換回路8及び遅延回路9に与えられる。ここで
スイッチング手段7は第1図に示すように通常時はA
/ D変換回路6側に接続されており、制御回路5から
の制御信号を入力すると、第2図に示すようにRF・I
F回路3、検波回路4及びA / D変換回路6による
信号遅延時間τユ経過後遅延回路9側に切換わり、更に
所定時間τb経過後復旧する。この遅延回路9側に保持
する時間τbの値はアンテナ切換回路201回の切換動
作に伴なって発生する雑音の最大持続時間rn以上に設
定される。また、遅延回路9による遅延時間τdの値は
時間τb以上に設定される。D/A変換回路8からのD
/ A変換されたアナログ情報は他の装置、例えば音
響器等に送出される。
次に第2図を参照して第1図に示した実施例の動作を説
明する。第2図に示すように時刻t、においてフェージ
ングが発生したとすると、制御回路5が信号再生部にお
ける利得低下を判別し、制御信号をアンテナ切換回路2
及びスイッチング手段7に送出する。アンテナ切換回路
2は制御回路5からの制御信号により直ちに作動してア
ンテナ素子側に切換わり、アンテナIBからの出力端を
信号再生部に接続する。一方、スイッチング手段7は制
御回路5からの制御信号を入力すると、遅延時間τ、経
過後に遅延回路9側に切換わり、A / D変換回路6
からの信号入力を遮断すると同時に遅延回路9からの遅
延情報、即ちアンテナIAからの過去の情報をD /
A変換回路8に送出する。スイッチング手段7はこの状
態を時間τbのあいだ保持しており、時間τ5経過後復
旧して再びA / D変換回路6側に切換わる。従って
第2図に示すように時刻t2から時刻t、までのあいだ
はアンテナIAからの過去の情報を、また時刻t、以後
はアンテナIBからの現在情報をD / A変換回路8
に送出する。
明する。第2図に示すように時刻t、においてフェージ
ングが発生したとすると、制御回路5が信号再生部にお
ける利得低下を判別し、制御信号をアンテナ切換回路2
及びスイッチング手段7に送出する。アンテナ切換回路
2は制御回路5からの制御信号により直ちに作動してア
ンテナ素子側に切換わり、アンテナIBからの出力端を
信号再生部に接続する。一方、スイッチング手段7は制
御回路5からの制御信号を入力すると、遅延時間τ、経
過後に遅延回路9側に切換わり、A / D変換回路6
からの信号入力を遮断すると同時に遅延回路9からの遅
延情報、即ちアンテナIAからの過去の情報をD /
A変換回路8に送出する。スイッチング手段7はこの状
態を時間τbのあいだ保持しており、時間τ5経過後復
旧して再びA / D変換回路6側に切換わる。従って
第2図に示すように時刻t2から時刻t、までのあいだ
はアンテナIAからの過去の情報を、また時刻t、以後
はアンテナIBからの現在情報をD / A変換回路8
に送出する。
尚、第1図に示した実施例では制御回路5はRF−IF
回路3からの信号出力に基づ−いてアンテナ受信状態を
判別するように構成したが、適宜の信号再生部、例えば
検波回路4かもの信号出力に基づいて受信状態を判別す
るように構成してもよい。
回路3からの信号出力に基づ−いてアンテナ受信状態を
判別するように構成したが、適宜の信号再生部、例えば
検波回路4かもの信号出力に基づいて受信状態を判別す
るように構成してもよい。
第3図は本発明の他の実施例をAM受信用の受信装置を
例にとって示したブロック図である。第3図に示した実
施例では検波回路4に組み込まれる自動利得調整回路、
所謂AGC回路からのAGC電圧を制御回路5に与えて
おき、検波回路4からのAGC電圧に基づいてアンテナ
受信状態を判別するようにしたことを特徴とする。
例にとって示したブロック図である。第3図に示した実
施例では検波回路4に組み込まれる自動利得調整回路、
所謂AGC回路からのAGC電圧を制御回路5に与えて
おき、検波回路4からのAGC電圧に基づいてアンテナ
受信状態を判別するようにしたことを特徴とする。
尚、第1図及び第3図に示した実施例では、ダイバーシ
テブランチとして2個のアンテナ素子を用いた場合を例
にとって説明したが、本発明はこれを限定されることな
く、3以上の適宜の数のアンテナ素子を用いた場合にも
適用される。
テブランチとして2個のアンテナ素子を用いた場合を例
にとって説明したが、本発明はこれを限定されることな
く、3以上の適宜の数のアンテナ素子を用いた場合にも
適用される。
(発明の効果)
以上説明してきたように本発明によれば複数のアンテナ
素子からの高周波信号をアンテナ切換回路により選択的
に受信し、この高周波信号を信号再生部で低周波信号に
再生するダイバーシチ受信装置において、信号再生部か
らの出力に基づいてアンテナ受信状態を判別し該判別結
果に応じて制御信号を出力する制御回路と、信号再生部
からの再生信号をA/D変換するA/D変換回路と、こ
のA/D変換回路からの信号をスイッチング手段を介し
て入力し該信号をそれぞれD/A変換するD / A変
換回路及び所定の遅延時間τd遅延する遅延回路とを備
え、制御回路からの制御信号に基づいてスイッチング手
段を作動させ、時間7dより短かい時間r1:lのあい
だA / D変換回路からの信号を遮断しつつ、遅延回
路からの遅延出力をD / A変換回路に送出するよう
にしたことで、アンテナ切換時に発生する雑音による受
信利得の低下を防止し、品質の高い通信を確保すること
ができ、ダイバーシチ受信装置の信頼性が大幅に向上す
るという効果が得られる。
素子からの高周波信号をアンテナ切換回路により選択的
に受信し、この高周波信号を信号再生部で低周波信号に
再生するダイバーシチ受信装置において、信号再生部か
らの出力に基づいてアンテナ受信状態を判別し該判別結
果に応じて制御信号を出力する制御回路と、信号再生部
からの再生信号をA/D変換するA/D変換回路と、こ
のA/D変換回路からの信号をスイッチング手段を介し
て入力し該信号をそれぞれD/A変換するD / A変
換回路及び所定の遅延時間τd遅延する遅延回路とを備
え、制御回路からの制御信号に基づいてスイッチング手
段を作動させ、時間7dより短かい時間r1:lのあい
だA / D変換回路からの信号を遮断しつつ、遅延回
路からの遅延出力をD / A変換回路に送出するよう
にしたことで、アンテナ切換時に発生する雑音による受
信利得の低下を防止し、品質の高い通信を確保すること
ができ、ダイバーシチ受信装置の信頼性が大幅に向上す
るという効果が得られる。
第1図は本発明の一実施例を示したブロック図、第2図
は第1図の動作を示したタイミングチャート、第3図は
本発明の他の実施例を示したブロック図、第4図は従来
例を示したブロック図である。 LAslB・・・アンテナ、2・・・アンテナ切換回路
、3・・・RF・IF回路、4・・・検波回路、5・・
・制御回路、6・・・A / D変換回路、7・・・ス
イッチング手段、8・・・D/A変換回路、9・・・遅
延回路。 特許出願人 東洋通信機株式会社 代理人 弁理士 本 庄 伸 介 第1図 :*款の情祇; 1、 13 第2図 第3図 第4図
は第1図の動作を示したタイミングチャート、第3図は
本発明の他の実施例を示したブロック図、第4図は従来
例を示したブロック図である。 LAslB・・・アンテナ、2・・・アンテナ切換回路
、3・・・RF・IF回路、4・・・検波回路、5・・
・制御回路、6・・・A / D変換回路、7・・・ス
イッチング手段、8・・・D/A変換回路、9・・・遅
延回路。 特許出願人 東洋通信機株式会社 代理人 弁理士 本 庄 伸 介 第1図 :*款の情祇; 1、 13 第2図 第3図 第4図
Claims (1)
- 【特許請求の範囲】 複数のアンテナ素子からの高周波信号をアンテナ切換回
路により選択的に受信し、該高周波信号を信号再生部で
低周波信号に再生するダイバーシチ受信装置において、 前記信号再生部からの出力に基づいてアンテナ受信状態
を判別し該判別結果に応じて前記切換回路の切換制御信
号を出力する制御回路と、該信号再生部からの再生信号
をディジタル信号に変換するA/D変換回路と、該A/
D変換回路からの信号をスイッチング手段を介して入力
し該信号をアナログ信号に変換するD/A変換回路と、
前記ディジタル信号を所定の遅延時間^τdだけ遅延す
る遅延回路とを備え、 前記スイッチング手段は、前記制御回路からの前記制御
信号に基づいて作動し、時間^τdより短かい時間^τ
bの間だけ前記A/D変換回路からの信号を遮断して前
記遅延回路からの遅延出力を前記D/A変換回路に送出
するようにしたことを特徴とするダイバーシチ受信装置
。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP61095167A JPS62250729A (ja) | 1986-04-24 | 1986-04-24 | ダイバ−シチ受信装置 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP61095167A JPS62250729A (ja) | 1986-04-24 | 1986-04-24 | ダイバ−シチ受信装置 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS62250729A true JPS62250729A (ja) | 1987-10-31 |
Family
ID=14130204
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP61095167A Pending JPS62250729A (ja) | 1986-04-24 | 1986-04-24 | ダイバ−シチ受信装置 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS62250729A (ja) |
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS63129728A (ja) * | 1986-11-20 | 1988-06-02 | Matsushita Electric Works Ltd | ダイバ−シテイ受信機 |
US6226505B1 (en) | 1996-11-20 | 2001-05-01 | Nec Corporation | Automatic frequency correction apparatus and method for radio calling system |
Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS5549042A (en) * | 1978-10-04 | 1980-04-08 | Nippon Telegr & Teleph Corp <Ntt> | Sound momentary break interpolating receiver |
JPS60253333A (ja) * | 1984-05-30 | 1985-12-14 | Pioneer Electronic Corp | ダイバ−シテイ受信機 |
-
1986
- 1986-04-24 JP JP61095167A patent/JPS62250729A/ja active Pending
Patent Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS5549042A (en) * | 1978-10-04 | 1980-04-08 | Nippon Telegr & Teleph Corp <Ntt> | Sound momentary break interpolating receiver |
JPS60253333A (ja) * | 1984-05-30 | 1985-12-14 | Pioneer Electronic Corp | ダイバ−シテイ受信機 |
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS63129728A (ja) * | 1986-11-20 | 1988-06-02 | Matsushita Electric Works Ltd | ダイバ−シテイ受信機 |
US6226505B1 (en) | 1996-11-20 | 2001-05-01 | Nec Corporation | Automatic frequency correction apparatus and method for radio calling system |
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