JPS62187887A - El driving circuit - Google Patents
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- JPS62187887A JPS62187887A JP1500986A JP1500986A JPS62187887A JP S62187887 A JPS62187887 A JP S62187887A JP 1500986 A JP1500986 A JP 1500986A JP 1500986 A JP1500986 A JP 1500986A JP S62187887 A JPS62187887 A JP S62187887A
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- Control Of Indicators Other Than Cathode Ray Tubes (AREA)
- Control Of El Displays (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。(57) [Summary] This bulletin contains application data before electronic filing, so abstract data is not recorded.
Description
【発明の詳細な説明】
[技術分野]
本発明は、ドツトマトリクス型のEI7素子を交流駆動
するEl−駆動回路に関するものである。DETAILED DESCRIPTION OF THE INVENTION [Technical Field] The present invention relates to an El-drive circuit for AC driving a dot matrix type EI7 element.
[背景技術1
一般に、硫化亜鉛系の蛍光体に交番高電界を印加するこ
とによる発光現象を利用するこの種のEL素子は、蛍光
体薄膜を電極(一方が透明?!!極)にてサンドイッチ
してガラス基板上に形成され、大面積表示が可能で明る
い平面表示装置として期待されている。ところで、EL
素子の開発初期においては、輝度が低い上に寿命が短い
という問題があったが、最近になって改良型二重絶縁補
遺のZns:Muを発光層とした薄膜EL#:子が実用
性のあるものとして注目されるようになっている。しか
しながら、この種のEL索子は駆動電圧が比較的高く、
また容量性であるために駆動回路のIC化が困難で技術
的に6コスト的にも実用化の障害になっていた。ところ
が、近年の半導体技術の進歩によってE L索子を駆動
するのに適した相互コンダクタンスの高い高耐圧のMO
S −F E Th’fFl1発され、さらにこの高耐
圧M OS −F E ′rと論理回路を同一チップに
集積化した高耐圧MO8−ICが実現され、X−Yドツ
トマトリクス型のEL素子による平面表示装置が実m化
されるに至っている。この上うなEL索子を用いた平面
表示装置は、CR7表示装置に比べて動作電圧が低(、
小型、軽量であり、また、プラズマ表示装置に比べても
軽量で、破損の危険がないという利、αを有しており、
さらにまた、液晶表示装置に比べて応答速度が速く、動
作可能温度範囲が広く、さらに視角が広いなどの利、儂
を有している。[Background technology 1] In general, this type of EL device, which utilizes the luminescence phenomenon caused by applying an alternating high electric field to a zinc sulfide-based phosphor, sandwiches a thin phosphor film between electrodes (one of which is transparent?!!). It is expected to be a bright flat display device that can display large areas and is formed on a glass substrate. By the way, EL
In the early stages of device development, there were problems with low brightness and short lifespan, but recently thin-film EL# with improved double insulation supplement Zns:Mu as a light-emitting layer has become practical. It is starting to attract attention as something that exists. However, this type of EL probe has a relatively high driving voltage;
In addition, since it is capacitive, it is difficult to integrate the drive circuit into an IC, and the technical cost is also an obstacle to practical use. However, recent advances in semiconductor technology have made it possible to develop high-voltage MOs with high mutual conductance that are suitable for driving E-L probes.
S -F E Th'fFl1 was emitted, and a high-voltage MO8-IC was realized in which this high-voltage MOS -F E 'r and a logic circuit were integrated on the same chip. Flat display devices have now been commercialized. In addition, flat display devices using EL devices have lower operating voltages than CR7 display devices (
It has the advantage of being small and lightweight, and is also lighter than plasma display devices, and there is no risk of damage.
Furthermore, compared to liquid crystal display devices, they have advantages such as faster response speed, wider operating temperature range, and wider viewing angle.
しかしながら、このようなEl−素子には、製造条件l
二よるばらつきがあるので、同一の駆動条件で駆動した
場合にあっても輝度が異なり、複数のII−素子を並設
して表示装置を構成する場合には、F:L索子間の輝度
むらが生じて見栄えが悪くなるという問題があった。ま
た、従来のEL駆動回路は駆動条件が固定的になってい
たので、平面表示装置が組み込まれる応用製品の種類に
よって必要とする駆動条件(全ドツト数や1フイ一ルド
時間など)が異なる場合には、最適輝度の表示が行えず
、明るすぎる表示、あるいは暗すぎる表示になってしま
うという不都合があった。なお、各応用製品に対応して
それぞれ最適輝度が得られる駆動条件を実現させる専用
のEL駆動回路を用意することも可能であるが、EL駆
動回路の種類が多くなって商品管理が面倒になるととも
に、コストが高くなるという不都合があった。However, such an El-element requires manufacturing conditions l
Since there are variations due to There was a problem that unevenness occurred and the appearance deteriorated. In addition, since conventional EL drive circuits have fixed driving conditions, the required driving conditions (total number of dots, 1 field time, etc.) may differ depending on the type of application product in which the flat display device is incorporated. However, there was a problem in that the display could not be displayed at the optimum brightness, resulting in a display that was too bright or too dark. It is also possible to prepare a dedicated EL drive circuit that realizes drive conditions that provide optimal brightness for each application product, but the number of types of EL drive circuits increases, making product management troublesome. At the same time, there was an inconvenience that the cost increased.
[発明の目的J
本発明は上記の点に鑑みて為されたらのであり、その目
的とするところは、EL素子の輝度を容易に調整でき、
複数のE L素子を並設する場合における輝度むらの解
消や、応用製品に組み込む場合における輝度の′R適数
設定容易に行うことができるEL駆動回路を提供するこ
とにある。[Objective of the Invention J The present invention has been made in view of the above points, and its object is to easily adjust the brightness of an EL element,
It is an object of the present invention to provide an EL drive circuit that can eliminate uneven brightness when a plurality of EL elements are arranged in parallel, and can easily set an appropriate value for brightness when incorporated into an applied product.
[発明の開示]
(実施例1)
第1図乃至第3図は本発明一実施例を示すもので、第1
図は概略回路構成を示すブロック図であり、表示制御回
路4は、基準クロック回路10お上り分周回路11より
なるクロック発生手段と、す7にツシュバルス発生回路
12と、ストローブパルス発生回路13と、書込みパル
ス発生回路14と、電源ドライブ回路15と、行制御I
!信号発生回路16と、列制御信号発生回路17と、デ
ータ制御回路18とで形成され、EL索子1は表示制御
回路4から出力される制御<8号に基いて制御liされ
る行ドライバ2、列ドライバ3およびドライバ電源5に
よって駆動されるようになっている。第2図はドライバ
部分の具体回路例を示すものであり、32X32ドツト
の画素を有するEL素子1を!財勤する行ドライバ2I
土7オトカツプラよりなるアイソレータIsを介して制
御信号が人力される奇数行ドライバ(SN 75551
)2a+t2azお上tl (ffi 所行Wライt
((RN 7 !’; RR9)2b、、2k。[Disclosure of the Invention] (Example 1) Figures 1 to 3 show an example of the present invention.
The figure is a block diagram showing a schematic circuit configuration, and the display control circuit 4 includes a clock generation means consisting of a reference clock circuit 10 and an upstream frequency divider circuit 11, a pulse generation circuit 12, and a strobe pulse generation circuit 13. , write pulse generation circuit 14, power supply drive circuit 15, and row control I
! The EL element 1 is formed of a signal generation circuit 16, a column control signal generation circuit 17, and a data control circuit 18, and the row driver 2 is controlled based on control number 8 output from the display control circuit 4. , a column driver 3 and a driver power supply 5. FIG. 2 shows a specific circuit example of the driver section, and includes an EL element 1 having 32 x 32 dot pixels! Financial services driver 2I
An odd-numbered row driver (SN 75551) in which control signals are manually inputted via an isolator Is made of an Otokatsupla.
) 2a + t2az on top tl (ffi place W light t
((RN 7 !'; RR9) 2b,, 2k.
にて形成され、列ドライバ3は奇数列ドライバ(SN
75554)3a+t3a2および偶数列ドライバ(S
N 75553 )3b、、3b2にて形成され、ドラ
イバ電源L源5は入力端子A−Cに人力される第4図(
lc)〜(a)に示すような制御48号に対して第4図
(r)に示すようなコンボノット出力が得られるコンポ
シフト・ロウ・ドライブ回路にて形成されている。なお
、各ドライバ2a、・・・・・・・・・・・・2b2は
トーテムポール出力のラッチ付きシフトレノスタとなっ
ており、第4図(a)〜(「)は各回路の入出力信号を
示している。The column driver 3 is an odd column driver (SN
75554) 3a+t3a2 and even column driver (S
N75553) 3b, 3b2, and the driver power supply L source 5 is connected to the input terminals A-C as shown in FIG.
It is formed of a composite shift row drive circuit which can obtain a combo knot output as shown in FIG. 4(r) for control numbers 48 as shown in lc) to (a). In addition, each driver 2a, 2b2 is a shift renostar with a totem pole output latch, and FIG. It shows.
ここに、上記El−駆動回路は、線順次駆動方式の駆動
回路であり、EL素子1はリフレッシュパルス発生回路
12、ストローブパルス発生回路13および書込みパル
ス発生回路14の出力にてタイミングが設定される3−
〕のモードでドライブされるようになっている。すなわ
ち、Fslのモードはリフレッシュモードであり、書込
みパルスと逆極性のバイアスをEL′N子1の全画素に
印加することによりIEL発光層の分極を打ち消す。第
2のモードはストローブモードであり、電圧印加により
画素に蓄積された電荷を放電するため、1号し素子1の
全画素をゼロバイアスする。第3のモードは、任意の1
行に対して電圧を印加する書込みモードであり、光らせ
たい画素に対してしきい値電圧以上、光らせたくない画
素に対してはし島い値電圧以下の電圧が印加されるよう
にしておく。つまり、表示データは1行毎44列ドライ
バ:)へ1行号だけ送られて、データの有無(1,0)
が画素への印加電圧の大小に変換されるようになってい
る。Here, the El-drive circuit is a line-sequential drive type drive circuit, and the timing of the EL element 1 is set by the outputs of the refresh pulse generation circuit 12, the strobe pulse generation circuit 13, and the write pulse generation circuit 14. 3-
] mode. That is, the mode of Fsl is a refresh mode, and the polarization of the IEL light emitting layer is canceled by applying a bias having a polarity opposite to that of the write pulse to all pixels of the EL'N element 1. The second mode is a strobe mode, in which all pixels of the element 1 are biased to zero in order to discharge the charges accumulated in the pixels by applying a voltage. The third mode is any one
This is a write mode in which a voltage is applied to a row, and voltages above a threshold voltage are applied to pixels that are to be illuminated, and voltages below a threshold voltage are applied to pixels that are not to be illuminated. In other words, display data is sent to the 44-column driver for each row: ), and the display data is sent to the 44-column driver:
is converted into the magnitude of the voltage applied to the pixel.
このようにして1行が表示されると、次の行の表示デー
タが送られてδ込みモードが繰り返されて線順次駆動が
実現される。1ii!Ii面(1フイールド)の表示デ
ータの書込みが終了すると、リフレッシュモードにより
画面をリフレッシュした後、上述のストローブモードお
よび書込みモードの動作を繰り返して大の画面の表示に
移る。When one line is displayed in this manner, display data for the next line is sent and the δ-inclusive mode is repeated to realize line sequential driving. 1ii! When the writing of display data on the Ii surface (1 field) is completed, the screen is refreshed in the refresh mode, and then the above-described operations in the strobe mode and write mode are repeated to move to display on the large screen.
ところで、本実施例にあっては、各画素の発光時間を制
御して輝度を変化させる輝度調整手段6aは書込みパル
ス発生回路14内に設けられており、第3図に示すよう
に、輝度設定用のスイッチSa、〜Sd、と、プリセッ
タブルバイナリカウンタCO,と、インバータ回路I
Na、−I Nd、と、D−7リツプ70ツブFF、と
、ナンド回路NA、と、オア回路OR,とで形成されで
おり、各画素に画像データを書込む書込みパルスのパル
ス幅Lmを変化させて発光時間を制御し、輝度調整を行
うようになっている。By the way, in this embodiment, the brightness adjustment means 6a that controls the light emission time of each pixel to change the brightness is provided in the write pulse generation circuit 14, and as shown in FIG. switches Sa, ~Sd, presettable binary counter CO, and inverter circuit I
It is formed by Na, -I Nd, D-7 lip 70-tube FF, NAND circuit NA, and OR circuit OR, and the pulse width Lm of the write pulse for writing image data to each pixel is The light emission time is controlled by changing the brightness, and the brightness is adjusted.
以下、実施例の動作について説明する。第5図は書込み
パルスOaの発生動作を示すタイムチャートであり、Q
、は書込みパルスOaの印加開始タイミングを設定する
アクティブ”H”のタイミングパルス、φは基準クロッ
ク、PONはパワーオンリセット信号である。いま、Q
oが”L、 ”の間プリセッタブルバイナリカウンタC
O3の千−ドはロードモードになっており、スイッチS
al〜Sd+にて設定されたプリセットデータが初期値
としてロードされる。なお、図ではプリセットデータと
して10″(但し、10進数表示)が設定されている場
合を示している。次に、タイミングパルスQ。The operation of the embodiment will be described below. FIG. 5 is a time chart showing the operation of generating write pulse Oa, and Q
, is an active "H" timing pulse that sets the application start timing of the write pulse Oa, φ is a reference clock, and PON is a power-on reset signal. Now, Q
Presettable binary counter C while o is “L,”
The O3 sender is in load mode and the switch S
The preset data set in al to Sd+ is loaded as an initial value. Note that the figure shows a case where 10'' (displayed in decimal notation) is set as the preset data. Next, the timing pulse Q.
がH″になると、プリセッタブルバイナリカウンタCO
1は基準クロックφに同期してカフントを始め、このと
き同時にD−7リツプ70ツブF F、もデータを取り
込んでセットされるので、その出力Q1.t″H”とな
る。次に、カウントが進みプリセッタブルバイナリカウ
ンタCO+の出力QA+QatQc=QoがH″になる
と、ナンド回路N A I出力が”し”になる。このと
きD−7リツプ70ツブFF1はリセットされ、出力Q
は′L″となる。このようにして、D−7リツププロツ
プFF、の出力Q1すなわち書込みパルスOaはプリセ
ッタブルバイナリカウンタCO+のカウント数だ(すの
パルス幅(W(図示例では基準クロックφの5周M)を
もったパルスとなる。なお、書込みパルスOaが出力さ
れた後もタイミングパルスQ0が”H”の間はブリセン
タプルバイナリカウンタCO+のカウント動作が行なわ
れることになるが、D−7リツプ70ツブF F 、が
リセットされているので書込みパルスOaに対する影響
はない。When becomes H'', the presettable binary counter CO
1 starts to clock in synchronization with the reference clock φ, and at the same time, the D-7 lip FF also takes in data and is set, so its output Q1. t″H”. Next, as the count advances and the output QA+QatQc=Qo of the presettable binary counter CO+ becomes H'', the NAND circuit N A I output becomes ``ON''. At this time, the D-7 lip 70 tube FF1 is reset and the output Q
In this way, the output Q1 of the D-7 lip-prop FF, that is, the write pulse Oa, is the count number of the presettable binary counter CO+. This is a pulse with 5 cycles M).Note that even after the write pulse Oa is output, the counting operation of the bricenter binary counter CO+ is performed while the timing pulse Q0 is "H"; Since the -7 lip 70 knob FF has been reset, there is no effect on the write pulse Oa.
以上のようにして、書込みパルスOaのパルス幅Lmが
輝度調整手段6aのスイッチSa、〜Sd、にて任意に
設定され、EL索子1の各画素の発光時間が任意に制御
できるので、EL素子1の輝度の最適化(駆動条件の最
適化)が容易に行えるようになっている。したがって、
複数のEL索子1を並設する場合における輝度むらの解
消や、応用製品に組み込む場合における輝度の最適設定
を容易に行うことができる上、多種の応用製品に組み込
むEL駆動回路を共通化することができ、商品W浬が容
易になるとともに、低コスト化が図れるようになってい
る。As described above, the pulse width Lm of the write pulse Oa is arbitrarily set by the switches Sa, ~Sd of the brightness adjustment means 6a, and the light emitting time of each pixel of the EL element 1 can be arbitrarily controlled. Optimization of the brightness of the element 1 (optimization of driving conditions) can be easily performed. therefore,
It is possible to eliminate uneven brightness when multiple EL cables 1 are installed in parallel, and to easily set the optimum brightness when incorporating them into applied products, and it also makes it possible to standardize the EL drive circuit that is incorporated into various applied products. This makes it easier to manufacture products and reduces costs.
(実施例2)
fjtJG図は他の実施例を示すものであり、各画素を
リフレッシュするリフレッシュパルスO1)のパルス幅
し「を変化させることにより発光時間を制御するように
輝度?R整平手段bを形成したもので、輝度調整手段6
bはりフレッシュパルス発生回路12内に設けられてお
り、輝度設定用のスイッチSa2〜Sd2と、ブリセン
タプルバイナリカウンタC02と、インバータ回路r
Na2− I Nd2と、D−7リツプ70ツブFF2
と、ナンド回路NA2と、オア回路OR2とで形成され
ている。第7図は動作を示すタイムチャートであり)、
Ql、Q2は垂直同期用46号として分周回路11から
出力される分周パルスであり、D−7リツプ70ツブF
F 2のQ出ツバすなわちリフレッシュパルスobの
パルス幅設定動作は前記実施例1と全く同一であり、他
の構成および動作も実施例1と同様であるので説明を省
略する。(Example 2) The fjtJG diagram shows another example, in which the luminance ? b, and the brightness adjustment means 6
The b beam is provided in the fresh pulse generation circuit 12, and includes brightness setting switches Sa2 to Sd2, a fresh center pull binary counter C02, and an inverter circuit r.
Na2-I Nd2 and D-7 lip 70 tube FF2
, a NAND circuit NA2, and an OR circuit OR2. Figure 7 is a time chart showing the operation)
Ql and Q2 are frequency dividing pulses outputted from the frequency dividing circuit 11 as No. 46 for vertical synchronization, and are D-7 lip 70 tube F.
The Q output collar of F2, that is, the pulse width setting operation of the refresh pulse ob is exactly the same as in the first embodiment, and the other configurations and operations are also the same as in the first embodiment, so their explanation will be omitted.
(実施例3)
第8図はさらに他の実施例を示すものであり、す7レツ
シエパルスobの後に出力され、1Jフレツシユにより
全画素に¥1積された電荷を放電させるストローブパル
スOcのパルス幅tsを変化させて発光を制御するよう
に輝度11整手段6cを形成したものであり、輝度調整
手段6cはストローブパルス発生回路13内に設けられ
ており、輝度設定用のスイッチSa3〜Sd、と、プリ
セッタブルバイナリカウンタCO1と、インバータ回路
lNa3〜INd、と、D−7リツプ70ツブFF3.
FF、と、ナンド回路NA、と、インバータ回路IN、
とで形成されている。なお、他の構成および動作は実施
例1あるいは実施例2と同様である。(Embodiment 3) FIG. 8 shows still another embodiment, in which the pulse width of the strobe pulse Oc is output after the 7 lettuce pulse ob and discharges the charges accumulated by ¥1 in all pixels by the 1J refresh. The brightness adjustment means 6c is provided in the strobe pulse generation circuit 13, and includes brightness setting switches Sa3 to Sd. , presettable binary counter CO1, inverter circuits lNa3 to INd, and D-7 lip 70-tube FF3.
FF, NAND circuit NA, and inverter circuit IN,
It is formed by. Note that the other configurations and operations are the same as those in the first embodiment or the second embodiment.
以下、本実施例のストローブパルスOcの発生動作につ
いて説明する。第9図は動作を示すタイムチャートであ
り、いま、1ノフレツシユバルスObが出力されている
間はD−7リツプ70ツブFF、はリセットされ、その
出力IQi、t″+1−nになっている。このときD−
7リツププロツプFF、の出力2Qは前のサイクルでリ
セットされていて”L″である6次に、す7レツシエパ
ルスobが終了すると、この終了時点は基準クロックφ
の立ち下がりに同期しているため、D−7リフプ70フ
ブFF、の出力IQは′L″のままである。次に、基準
クロックφの半周期が経過して基準クロックφが立ち上
がる時点でD−7リツプ70γブFF。The operation of generating the strobe pulse Oc in this embodiment will be explained below. FIG. 9 is a time chart showing the operation, and while the 1-no-refresh pulse Ob is currently being output, the D-7 lip FF is reset and its output becomes IQi, t''+1-n. At this time, D-
The output 2Q of the 7 lip prop FF was reset in the previous cycle and is "L". 6 Next, when the 7 retsier pulse ob ends, this end point is the reference clock φ.
Since it is synchronized with the falling edge of D-7 lip 70γb FF.
の出力IQがH″′になる。すなわち、D−7リツプ7
0ツブFF、の出力IQの立ち上がり時点はリフレッシ
ュパルスobの立ち上がり時点よりも基準クロックφの
半周期だけ遅れることになる。The output IQ of D-7 becomes H''.
The rising point of the output IQ of the 0-tube FF is delayed by a half period of the reference clock φ than the rising point of the refresh pulse ob.
このようにしてD−7リツプ70ツブFF、の出力IQ
がH″になると、プリセッタブルバイナリカウンタCO
1のカウントが開始され、その出力Q A−Q o−Q
c、Q oが′H″になったときにD−7リツプ70
γブFF、はりセットされ、その出力2Qは”L″′に
戻り、スイッチSa3〜Sd、にて設定された最適駆動
条件のパルス幅ts(図示例では基準クロックφの5周
期)のストローブパルスOcが出力されるようになって
いる。In this way, the output IQ of the D-7 lip 70-tube FF is
When becomes H'', the presettable binary counter CO
A count of 1 is started and its output Q A-Q o-Q
c, Q When o becomes 'H', D-7 lip 70
The γ block FF is set, and its output 2Q returns to "L"', and a strobe pulse with a pulse width ts (in the illustrated example, 5 cycles of the reference clock φ) of the optimum driving condition set by the switches Sa3 to Sd is generated. Oc is now output.
[発明の効果]
本発明は上述のように、ドツト、マトリクス型ELi子
の行ドライバお上1列ドライバと、両ドライバを制御し
て各画素をアクセスするとともに画像データに基いた発
光すべき画素に所定のパルス電圧を印加せしめる表示制
御回路とよりなるE L駆動回路において、各画素の輝
度を変化させる輝度1!4整手段を表示制御回路に設け
たものであるので、E L素子の輝度なσ易に!A整で
き、W敗のEI−素子を並設する場合における輝度むら
の解消や、応用製品に組み込む場合における輝度の最適
設定を容易に行うことができるという効果があり、また
、発光時間を制御して輝度調整を行っているので、パル
ス電圧の電圧レベルを変化させて輝度を変化させる場合
に比較して輝度設定が容易に行えるという効果がある。[Effects of the Invention] As described above, the present invention provides a row driver and an upper column driver of a dot and matrix type ELi element, and accesses each pixel by controlling both drivers, and also controls the pixel to emit light based on image data. In an EL drive circuit consisting of a display control circuit that applies a predetermined pulse voltage to the EL element, the display control circuit is provided with a luminance 1!4 adjustment means that changes the luminance of each pixel, so that the luminance of the EL element is Easy! It has the effect of eliminating uneven brightness when EI elements with A and W losses are installed in parallel, and making it easy to optimally set brightness when incorporating into applied products.It also has the effect of controlling light emission time. Since the brightness is adjusted by changing the voltage level of the pulse voltage, the brightness can be easily set compared to the case where the brightness is changed by changing the voltage level of the pulse voltage.
第1図は本発明一実施例の概略構成を示すブロック回路
図、第2図および第3図は同上の要部回路図、第4図お
よび第5図は同上の動作説明図、第6図は他の実施例の
要部回路図、第7図は同上の動作説明図、第8図はさら
に他の実施例の要部回路図、第9図は同上の動作説明図
である。
1はEL素子、2は行ドライバ、3は列ドライバ、4は
表示制御回路、6a〜6Cは輝度調整手段である。
代理人 弁理士 石 1)艮 七
手続補正、8:(自発)
1.゛バ件の表示
昭和61年特許M第15009号
2、発明の名称
E L &、 rRJ回路
3、補正をする者 。
゛バ件との関係 特許出願人
イt 所 大阪府門真市大字門真1048番地名称(
583)松下電工株式会社
代表者 ノ俟 井 口 夫
4、代理人
郵便番号 530
5、?Ifi、正命令のIJJ付 自 発6、補正に
より増加する発明の数 なし7、補正の対象 図面
8、補正の内容
本願添付図中第3図およI/ rjr16図を別紙のよ
第3図
■FIG. 1 is a block circuit diagram showing a schematic configuration of an embodiment of the present invention, FIGS. 2 and 3 are main circuit diagrams of the same, FIGS. 4 and 5 are operation explanatory diagrams of the same, and FIG. 7 is a circuit diagram of a main part of another embodiment, FIG. 7 is an explanatory diagram of the same operation, FIG. 8 is a circuit diagram of a main part of another embodiment, and FIG. 9 is an explanatory diagram of the same operation. 1 is an EL element, 2 is a row driver, 3 is a column driver, 4 is a display control circuit, and 6a to 6C are brightness adjustment means. Agent Patent Attorney Ishi 1) Ai 7th Procedural Amendment, 8: (Voluntary) 1. 19861 Patent M No. 15009 2 Title of the invention EL & rRJ circuit 3 Person making the amendment. Relationship with the matter Patent applicant Location 1048 Kadoma, Kadoma City, Osaka Prefecture Name (
583) Matsushita Electric Works Co., Ltd. Representative Noma Iguchi 4, agent postal code 530 5,? Ifi, with IJJ of positive instructions Voluntary 6, Number of inventions increased by amendment None 7, Subject of amendment Drawing 8, Contents of amendment Figure 3 and I/rjr 16 of the attached drawings of this application are attached to Figure 3. ■
Claims (4)
列ドライバと、両ドライバを制御して各画素をアクセス
するとともに画像データに基いた発光すべき画素に所定
のパルス電圧を印加せしめる表示制御回路とよりなるE
L駆動回路において、各画素の輝度を変化させる輝度調
整手段を表示制御回路に設けたことを特徴とするEL駆
動回路。(1) A row driver and a column driver of a dot matrix type EL element, and a display control circuit that controls both drivers to access each pixel and apply a predetermined pulse voltage to the pixel to emit light based on image data. Naru E
An EL drive circuit characterized in that the display control circuit is provided with a brightness adjustment means for changing the brightness of each pixel in the L drive circuit.
ス幅を変化させて発光を制御するように輝度調整手段を
形成したことを特徴とする特許請求の範囲第1項記載の
EL駆動回路。(2) The EL drive circuit according to claim 1, further comprising a brightness adjustment means so as to control light emission by changing the pulse width of a write pulse for writing image data into each pixel.
パルス幅を変化させることにより発光を制御するように
輝度調整手段を形成したことを特徴とする特許請求の範
囲第1項記載のEL駆動回路。(3) The EL drive circuit according to claim 1, characterized in that a brightness adjustment means is formed to control light emission by changing the pulse width of a refresh pulse that refreshes each pixel.
させるストローブパルスのパルス幅を変化させて発光を
制御するように輝度調整手段を形成したことを特徴とす
る特許請求の範囲第1項記載のEL駆動回路。(4) The brightness adjustment means is formed to control light emission by changing the pulse width of a strobe pulse that discharges the charge accumulated in each pixel during refresh. EL drive circuit.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP1500986A JPS62187887A (en) | 1986-01-27 | 1986-01-27 | El driving circuit |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP1500986A JPS62187887A (en) | 1986-01-27 | 1986-01-27 | El driving circuit |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS62187887A true JPS62187887A (en) | 1987-08-17 |
Family
ID=11876882
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP1500986A Pending JPS62187887A (en) | 1986-01-27 | 1986-01-27 | El driving circuit |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS62187887A (en) |
Cited By (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2006119639A (en) * | 2004-10-25 | 2006-05-11 | Samsung Sdi Co Ltd | Light emitting display apparatus and driving method thereof |
US8040302B2 (en) | 2004-05-25 | 2011-10-18 | Samsung Mobile Display Co., Ltd. | Display with multiple pixels sharing a data line and driving method thereof |
US8395564B2 (en) | 2004-05-25 | 2013-03-12 | Samsung Display Co., Ltd. | Display, and display panel and driving method thereof |
-
1986
- 1986-01-27 JP JP1500986A patent/JPS62187887A/en active Pending
Cited By (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US8040302B2 (en) | 2004-05-25 | 2011-10-18 | Samsung Mobile Display Co., Ltd. | Display with multiple pixels sharing a data line and driving method thereof |
US8395564B2 (en) | 2004-05-25 | 2013-03-12 | Samsung Display Co., Ltd. | Display, and display panel and driving method thereof |
JP2006119639A (en) * | 2004-10-25 | 2006-05-11 | Samsung Sdi Co Ltd | Light emitting display apparatus and driving method thereof |
US7812787B2 (en) | 2004-10-25 | 2010-10-12 | Samsung Mobile Display Co., Ltd. | Light emitting display and driving method thereof |
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