JPS6139737A - Transmission and reception supervisory circuit - Google Patents
Transmission and reception supervisory circuitInfo
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- JPS6139737A JPS6139737A JP16086184A JP16086184A JPS6139737A JP S6139737 A JPS6139737 A JP S6139737A JP 16086184 A JP16086184 A JP 16086184A JP 16086184 A JP16086184 A JP 16086184A JP S6139737 A JPS6139737 A JP S6139737A
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- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04J—MULTIPLEX COMMUNICATION
- H04J3/00—Time-division multiplex systems
- H04J3/02—Details
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Abstract
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は１次群ｐｃＭ端局装置に関し、特に送信信号と
受信信号を監視する回路に関する。DETAILED DESCRIPTION OF THE INVENTION [Field of Industrial Application] The present invention relates to a primary group PCM terminal station device, and more particularly to a circuit for monitoring transmitted signals and received signals.
一般に、１次群ＰＣＭ端局装置における通話路の音声特
性の監視は、アナログ入力信号に対するアナログ出力信
号を測定することによって行なっていた。しかしながら
、近年ＰＣＭ端局装置とディジタル交換機との対向する
使用例が増えるに伴って、アナログ入力信号とアナログ
出力信号との間の監視が意味を持たなくなってきており
、アナログ入力信号対送信側ディジタル出力信号又は受
信側デ、イジタル入力信号対アナログ出力信号の監視の
必要が起きてきた。Generally, the voice characteristics of a communication path in a primary group PCM terminal station device have been monitored by measuring an analog output signal with respect to an analog input signal. However, as the number of cases in which PCM terminal equipment and digital exchanges are used opposite each other has increased in recent years, monitoring between analog input signals and analog output signals has become meaningless. A need has arisen to monitor the output signal or receiver side, the digital input signal versus the analog output signal.
第２図は従来の２．０４８Ｍｂ／Ｓ ３０ ｃｈの２Ｍ
系１次群ＰＣＭ１局装置の構成を示したブロック図であ
る。各通話路毎の送信側アナログ入力信号は。Figure 2 shows the conventional 2.048Mb/S 30ch 2M
FIG. 2 is a block diagram showing the configuration of a system primary group PCM 1 station device. The analog input signal on the transmitting side for each communication path is as follows.
アナログ入力端子１−、、１−２．・・・、 ’ ３０
より印加され、それぞれアナログ−ディジタル変換器２
−１．２−２．−、２下３゜により６４Ｋｂ／ｓディジ
タル信号（０次群ディジタル信号）に変換された後、送
信側多重化部３により送信側２．０４８Ｍｂ／ＳＰＣＭ
信号（１次群ディジタル信号）に変換され。Analog input terminals 1-, 1-2. ..., ' 30
analog-to-digital converter 2, respectively.
-1.2-2. -, 2 lower 3 degrees to a 64 Kb/s digital signal (0th order group digital signal), and then the transmitting side multiplexer 3 converts it into a 2.048 Mb/SPCM signal on the transmitting side.
It is converted into a signal (primary group digital signal).
ＰＣＭ出力端子４より出力される。It is output from the PCM output terminal 4.
一方２時分割多重化された受信側２．０４８Ｍｂ／ＳＰ
ＣＭ入力信号は、 ＰＣＭ入力端子５より入力され。On the other hand, 2.048 Mb/SP on the receiving side which is time division multiplexed.
The CM input signal is input from PCM input terminal 5.
受信側多重分離部６で各通話路毎の６４Ｋｂ／Ｓディジ
タル信号に分離された後、それぞれディジタル−アナロ
グ変換器７−１７−２・・・ ７−３８によりアナログ
信号に変換され、アナログ出力端子８−Ｉ Ｂ−２・
・・ ８−３０より出力される。After being separated into 64Kb/S digital signals for each channel by the receiving side demultiplexer 6, they are converted into analog signals by digital-to-analog converters 7-17-2...7-38, and sent to analog output terminals. 8-I B-2・
... Output from 8-30.
このような従来の装置でアナログ入力信号−送信側ディ
ジタル出力信号間の監視をする場合。When monitoring between an analog input signal and a transmitting side digital output signal using such a conventional device.
通常通話路入出力の端子は同道話路かをまとめて１つの
コネクタとしているだめ、試験用アナログ信号を例えば
第１の通話路のアナログ端子１−１に印加するためには
他の通話路のアナログ入力端子１〜ｍ（２≦ｍ≦６０）
も切断して印加し。Normally, the input/output terminals for the same channel are combined into one connector, so in order to apply a test analog signal to the analog terminal 1-1 of the first channel, for example, it is necessary to Analog input terminal 1 to m (2≦m≦60)
Also cut and apply.
２．０４８Ｍｂ／Ｓ ＰＣＭ伝送路に接続されているＰ
ＣＭ出力端子４を該伝送路から切り離して監視する。2.048Mb/S P connected to PCM transmission line
The CM output terminal 4 is separated from the transmission line and monitored.
一方、受信側ディジタル入力信号−アナログ出力信号間
の監視をする場合、 ２．０４８’Ｍｂ／Ｓ ＰＣＭ伝
送路に接続されているＰＣＭ入力端子５を該伝送路より
切り離して１例えば第１の通話路に対応するタイムスロ
ットに試験用ディジタル信号を挿入し、第１の通話路の
アナログ出力端子８−１ばかりでなく他の通話路のアナ
ログ出力端子８−ｍ（２≦ｍ≦６０）を切断して監視す
る。On the other hand, when monitoring between the digital input signal and the analog output signal on the receiving side, the PCM input terminal 5 connected to the 2.048'Mb/S PCM transmission line is disconnected from the transmission line. Insert the test digital signal into the time slot corresponding to the channel, and disconnect not only the analog output terminal 8-1 of the first channel but also the analog output terminal 8-m (2≦m≦60) of the other communication channel. and monitor.
以下余白
〔発明が解決しようとする問題点〕
このように、従来の構成では、特定通話路の信号を監視
しようとしても、送信側ディジタル出力信号及び受信側
ディジタくし入力信号は時分割多重化されたディジタル
信号であるため、該特定通話路以外の全通話路に対応す
るタイムスロットの送信側ディジタル出力信号又は受信
側ディンタル入力信号を犠牲にして、 ２．０４８Ｍｂ
／ＳＰＣＭ伝送路を通信サービスから切り離して監視す
ることが必要であり、そのような監視は、実際の通信回
線においては極めて難しいことである。Blank space below [Problems to be solved by the invention] As described above, in the conventional configuration, even if an attempt is made to monitor a signal on a specific channel, the transmitting side digital output signal and the receiving side digital comb input signal are time-division multiplexed. 2.048 Mb at the expense of the transmitting side digital output signal or receiving side digital input signal of the time slot corresponding to all communication paths other than the specific communication path.
It is necessary to monitor the /SPCM transmission line separately from the communication service, and such monitoring is extremely difficult in actual communication lines.
本発明による送信受信監視回路は、送信すべき複数のア
ナログ入力信号を各々０次群ディジタル信号に変換し、
該変換された各０次群ディジタル信号を１次群ディジタ
ル信号に時分割多重化して送信する送信部と、受信した
時分割多重化された１次群ディジタル信号を複数の０次
群ディジタル信号に多重分離し、該多重分離された各０
次群ディジタル信号を各々アナログ信号に変換する受信
部とを有する１次群ＰＣＭ端局装置において、前記送信
部にｌ＃Ｊ記送信すべき複数のアナログ入力信号の中の
１つのアナログ入力信号の代わりに試験用アナログ入力
信号を選択して入力させる手段と、前記時分割多重化さ
れた１次群ディジタル信号の中から前記試験用アナログ
入力信号に対応するタイムスロットのディジタル信号を
分岐する手段を設け、＠記受信部に、前記多重分離され
る１次群ディジタル信号の中の１つのタイムスロットの
ディジタル信号の代わりに試験用ディジタル入力信号を
挿入する手段と、前記変換された複数のアナログ出力信
号の中から前記試験用ディジタル入力信号に対応する１
つのアナログ出力信号を選択して取出す手段を設けるこ
とにより、特定通話路の送信側又は受信側を通信中の他
の通話路から分離して監視できるようにしたことを特徴
とする。The transmission/reception monitoring circuit according to the present invention converts each of a plurality of analog input signals to be transmitted into zero-order group digital signals,
a transmitting unit that time-division multiplexes each of the converted zero-order group digital signals into a first-order group digital signal and transmits the same; and a transmitter that converts the received time-division multiplexed first-order group digital signal into a plurality of zero-order group digital signals. demultiplex, and each demultiplexed 0
In a primary group PCM terminal station device having a receiving section that converts each of the next group digital signals into an analog signal, one analog input signal among a plurality of analog input signals to be transmitted to the transmitting section. Instead, means for selecting and inputting a test analog input signal, and means for branching a digital signal of a time slot corresponding to the test analog input signal from among the time division multiplexed primary group digital signals. means for inserting a test digital input signal into the receiving section in place of the digital signal of one time slot among the primary group digital signals to be demultiplexed; and the plurality of converted analog outputs. 1 corresponding to the test digital input signal from among the signals.
The present invention is characterized in that by providing means for selecting and extracting two analog output signals, the transmitting side or the receiving side of a specific communication path can be monitored separately from other communication paths in progress.
以下余白
〔実施例〕
以下９図面を参照して本発明の実施例について説明する
。DESCRIPTION OF THE PREFERRED EMBODIMENTS [Embodiments] Examples of the present invention will be described below with reference to nine drawings.
第１図は本発明による送信受信監視回路を２．０４８Ｍ
ｂ／Ｓ ３０ ｃｈの２Ｍ系１次群ＰＣＭ１局装置に適
用した一実施例の構成を示したブロック図であり、第２
゛図と同様の機能を有するものには同一符号を付しであ
る。次に、第１図を参照して、最初に通話路の送信側の
監視を行なう場合。Figure 1 shows a transmission/reception monitoring circuit of 2.048M according to the present invention.
FIG. 2 is a block diagram showing the configuration of an embodiment applied to a 2M system primary group PCM 1 station device of b/S 30 channels;
Components having the same functions as those in the figure are given the same reference numerals. Next, referring to FIG. 1, the case where the transmission side of the communication path is first monitored.
続いて通話路の受信側の監視を行なう場合について説明
する。Next, a case will be described in which the receiving side of the communication path is monitored.
送信切換え通話路バス回路９に試験用アナログ入力信号
を入力する。第ｎ（１≦ｎ≦３０）の通話路の送信側の
監視を行なう場合、送信アナログ通話路切換え回路１０
−ｎはアナログ入力端子１−ｎより印加される送信側ア
ナログ入力信号の代わりに試験用アナログ入力信号を入
力するように選択し、それ以外の送信アナログ通話路切
換え回路ＴＯ−ｉ （１≦ｉ≦３０．ｉへｎ）はアナロ
グ入力端子１−１より印加される送信側アナログ入力信
号をそのまま入力させるように選択する。A test analog input signal is input to the transmission switching channel bus circuit 9. When monitoring the transmission side of the n-th (1≦n≦30) communication path, the transmission analog communication path switching circuit 10
-n is selected to input the test analog input signal instead of the transmitting side analog input signal applied from the analog input terminal 1-n, and the other transmitting analog communication path switching circuit TO-i (1≦i ≦30.i to n) is selected so that the transmitting side analog input signal applied from the analog input terminal 1-1 is input as is.
送信アナログ通話路切換え回路１０−ｎを介して人力す
る試験用アナログ入力信号は、アナログ−ディジタル変
換器２−ｎにより６４ｋｂ／Ｓディジタル信号に変換さ
れ、アナログ入力端子１−ｎを除く他のアナログ入力端
子１−ｉより送信アナログ通話路切換え回路１Ｏ−ｉ−
’ｉｉ介して入力する送信側アナログ入力信号はアナロ
グ−ディジタル変換器２−ｉにより６４Ｋｂ／Ｓディジ
タル信号に変換される。The test analog input signal manually input via the transmission analog communication path switching circuit 10-n is converted into a 64 kb/S digital signal by the analog-digital converter 2-n, Transmission analog communication path switching circuit 1O-i- from input terminal 1-i
The transmitting side analog input signal inputted through 'ii is converted into a 64 Kb/S digital signal by the analog-to-digital converter 2-i.
これら変換された３０個の６’４Ｒｂ／Ｓディジタル信
号は送信側多重化部３で時分割多重化される。ここで９
時分割多重化された２、０４８Ｍｂ／Ｓディジタル信号
は、１フレームが３２個のタイムスロット（このうち２
つめタイムスロットはフレーム同期信号などに使用され
る）からカリ、１タイムスロツトが８ビツトの信号であ
る。従って、上記３０個の６４Ｋｂ／Ｓディジタル信号
は。These 30 converted 6'4Rb/S digital signals are time-division multiplexed by the transmitter multiplexer 3. here 9
A time division multiplexed 2,048 Mb/S digital signal consists of 32 time slots (of which 2
One time slot is an 8-bit signal. Therefore, the above 30 64Kb/S digital signals are.
フレーム同期信号用の２つのタイムスロットを除く３０
個のタイムスロットに、一対一に対応し七割シ当てられ
ている。30 excluding two time slots for frame synchronization signals
Seven time slots are allocated in one-to-one correspondence.
データ分岐送出回路１１では、上記時７分割多重化され
た２、０４８Ｍｂ／Ｓディジタル信号の中から。The data branching and sending circuit 11 selects the 2,048 Mb/S digital signal that has been time-division multiplexed.
１フレーム毎に、第ｎの通話路に対応するタイスト状に
取シ出し、乙４Ｋｂ／Ｓディジタル信号に：変換し、試
験用ディジタ〃州力端子１２より出力□又、送信側多重
化部３で時１分割−重化され！する。Each frame is taken out in a format corresponding to the n-th communication path, converted into a 4Kb/S digital signal, and outputted from the test digital output terminal 12. So time 1 division - overlapped! do.
２．０４８Ｍｂ／Ｓ ＰＣＭ信号は１通常の通信状態と
同様、 ＰＣＭ出力端子４を介して伝送路に送出され
゛る。従って、第ｎの通ｉ路をｉく全ての通話路の送信
側では１通常の通信す二ビ・が受けられる。他の通話路
の送信側の監視を行なう場合もヶ、、４□。ウケ９．。2.048Mb/S PCM signal is sent out to the transmission line via PCM output terminal 4, as in normal communication status.
It's true. Therefore, one normal communication can be received on the transmitting side of all communication paths that connect the n-th path i. Also when monitoring the transmitting side of other communication paths, 4□. Uke 9. .
、ゎ晶、二゛え゛□；同様である。, ゎ Crystal, 2゛E゛□; It's the same.
ついて説明する。試験用ディジタル入力端子１３より６
４Ｋｂ／Ｓ試験用ディジタル信号を印加する。explain about. Test digital input terminal 13 to 6
Apply a 4Kb/S test digital signal.
第ｎ（１≦ｎ≦３０）の通話路の受信側の監視を行なう
場合、データ受信挿入回路１４によすＰＣＭ入力端子５
より入力する時分割多重化された受信側２．０４８Ｍｂ
／Ｓ ＰＣＭ入力信号の中の第ｎの通話路に対応するタ
イムスロットのディジタル信号を２．０４８Ｍｂ／Ｓの
ビット速度に変換された上記６４Ｋｂ／Ｓ試験用デ゛イ
ゾタル隼号に置きかえる。When monitoring the receiving side of the n-th (1≦n≦30) communication path, the PCM input terminal 5 connected to the data reception insertion circuit 14
2.048Mb of time-division multiplexed receiver input
/S Replace the digital signal of the time slot corresponding to the nth channel in the PCM input signal with the above-mentioned 64 Kb/S test digital signal converted to a bit rate of 2.048 Mb/S.
・但し、それ以外のタイムスロットのディジタル信号に
は置き換えを行５なわない。これら２．０４８Ｍｂ／Ｓ
信号は受信側多重分離部６にて各通話路１毎の６’４Ｋ
ｂ／Ｓデイ１ビタ・ル信号に分離される。- However, the digital signals of other time slots are not replaced. These 2.048Mb/S
The signal is sent to the receiving side demultiplexer 6 into 6'4K for each communication path 1.
b/S day is separated into 1 bit signal.
こ？とき、第１６話路には受信側多重分離部６が正常に
動作している場合、上記６４Ｋｂ／Ｓｆ゛試験翔ディン
タル信号、が現われる。。child? At this time, if the receiving side demultiplexer 6 is operating normally, the 64 Kb/Sf test digital signal appears on the 16th channel. .
客通話路毎の上記６４Ｋｂ／Ｓディジタル信号は。The above 64Kb/S digital signal for each customer communication path is.
それぞれディジタ：しレーアナログ変換器７−１．７−
２゜・・・９．７−３０によりアナログ信号に変換され
る。Respectively digital: analog converter 7-1.7-
2°...Converted into an analog signal by 9.7-30.
受信アナログ通話路切換え回路１５−ｎは、ディジタル
−アナログ変換器７−ｎからのアナログ信号を受信切換
え通話路バス回路１６に送るように選択し、それ以外の
受信アナログ通話路切換え回路１５−ｉ（１≦ｉ≦３０
．ｉ”ｒｎ）は、デイジタル−アナログ変換器７−４か
らのアナログ信号をアナログ出力端子８−１に送るよう
に選択する。従って、第ｎの通話路を除く全ての通話路
の受信側では２通常の通信サービスが受けられる。他の
通話路の受信側の監視を行なう場合も同様である。The receiving analog channel switching circuit 15-n selects to send the analog signal from the digital-to-analog converter 7-n to the receiving switching channel bus circuit 16, and selects the receiving analog channel switching circuit 15-i to send the analog signal from the digital-to-analog converter 7-n to the receiving switching channel bus circuit 16. (1≦i≦30
．． i"rn) is selected to send the analog signal from the digital-to-analog converter 7-4 to the analog output terminal 8-1. Therefore, on the receiving side of all channels except the nth channel, 2 Normal communication services can be received.The same applies when monitoring the receiving side of other communication channels.
合について述べだが、他の１次群ＰＣＭ端局装置。As mentioned above, other primary group PCM terminal equipment.
例えば、 １．５４４Ｍｂ／Ｓ ２４ｃｈの伝送容量
をもつ１．５Ｍ系１次群ＰＣＭ端局装置にも適用できる
のは勿論である。For example, it is of course applicable to a 1.5M system primary group PCM terminal station device having a transmission capacity of 1.544Mb/S 24ch.
以上の説明で明らかな如く９本発明によると。 As is clear from the above description, according to the present invention.
通話路単位で送信側、受信側のそれぞれにおいて通信回
線がサービス中に他の通話路に影響を与えることなく監
視することが可能となる。It becomes possible to monitor communication lines on each of the transmitting and receiving sides for each communication path during service without affecting other communication paths.
第１図は本発明による送信受信監視回路を持つ２Ｍ系１
次群ＰＣＭ端局装置の一実施例の構成を示したブロック
図、第２図は従来の２Ｍ系１次群ＰＣＭ端局装置の構成
を示しだブロック図である。
１−１ １−２・・・ １−３０はアナログ入力端子。
２−１２−２ ・・・ ２−３０はアナログ−ディン
タル変換器、６は送信側多重化部、４ばＰＣＭ出力端子
。
５はＰＣＭ入力端子、６は受信側多重分離部。
７−１７−２ ・・・ ７−３０はディジタル−アナロ
グ変換器、 ｓ−１ｓ−２・・・ ８−３０はアナログ
出力端子。
９は送信切換え通話路バス回路、 １０−１１０−２
・・・ １０−３Ｑは送信アナログ通話路切換え回路。
１１はデータ分岐送出回路、１２は試験用ディジタル出
力端子、１３は試験用ディジタル入力端子。
１４はデータ受信挿入回路、 １５−１１５−２
・・・１５−３０は受信アナログ通話路切換え回路、］
６は受信切換え通話路バス回路をそれぞれあられしてい
る。Figure 1 shows a 2M system 1 having a transmission/reception monitoring circuit according to the present invention.
FIG. 2 is a block diagram showing the configuration of an embodiment of the next group PCM terminal equipment. FIG. 2 is a block diagram showing the configuration of a conventional 2M system primary group PCM terminal equipment. 1-1 1-2... 1-30 is an analog input terminal. 2-12-2... 2-30 is an analog-to-digital converter, 6 is a transmitting side multiplexing unit, and 4 is a PCM output terminal. 5 is a PCM input terminal, and 6 is a receiving side multiplexer/demultiplexer. 7-17-2... 7-30 is a digital-to-analog converter, s-1s-2... 8-30 is an analog output terminal. 9 is a transmission switching channel bus circuit, 10-110-2
... 10-3Q is a transmission analog communication path switching circuit. 11 is a data branch sending circuit, 12 is a test digital output terminal, and 13 is a test digital input terminal. 14 is a data reception insertion circuit, 15-115-2
...15-30 is a reception analog communication path switching circuit,]
Reference numeral 6 designates a reception switching communication path bus circuit.
Claims (1)
ィジタル信号に変換し、該変換された各０次群ディジタ
ル信号を１次群ディジタル信号に時分割多重化して送信
する送信部と、受信した時分割多重化された１次群ディ
ジタル信号を複数の０次群ディジタル信号に多重分離し
、該多重分離された各０次群ディジタル信号を各々アナ
ログ出力信号に変換する受信部とを有する１次群ＰＣＭ
端局装置において、前記送信部に、前記送信すべき複数
のアナログ入力信号の中の１つのアナログ入力信号の代
わりに試験用アナログ入力信号を選択して入力させる手
段と、前記時分割多重化された１次群ディジタル信号の
中から前記試験用アナログ入力信号に対応するタイムス
ロットのディジタル信号を分岐する手段を設け、前記受
信部に、前記多重分離される１次群ディジタル信号の中
の１つのタイムスロットのディジタル信号の代わりに試
験用ディジタル入力信号を挿入する手段と、前記変換さ
れた複数のアナログ出力信号の中から前記試験用ディジ
タル入力信号に対応する１つのアナログ出力信号を選択
して取出す手段を設けたことを特徴とする送信受信監視
回路。1. A transmitter that converts each of the plurality of analog input signals to be transmitted into a zero-order group digital signal, time-division multiplexes the converted zero-order group digital signals into a first-order group digital signal, and transmits the resultant signal, and a receiver; a receiving section that demultiplexes the time-division multiplexed first-order group digital signal into a plurality of zero-order group digital signals, and converts each of the demultiplexed zero-order group digital signals into analog output signals. Next group PCM
In the terminal device, means for causing the transmitter to select and input a test analog input signal instead of one analog input signal from among the plurality of analog input signals to be transmitted; means for branching a digital signal of a time slot corresponding to the test analog input signal from among the primary group digital signals to be demultiplexed; means for inserting a test digital input signal in place of the digital signal of the time slot; and selecting and extracting one analog output signal corresponding to the test digital input signal from the plurality of converted analog output signals. A transmission/reception monitoring circuit characterized by comprising means.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP16086184A JPS6139737A (en) | 1984-07-31 | 1984-07-31 | Transmission and reception supervisory circuit |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP16086184A JPS6139737A (en) | 1984-07-31 | 1984-07-31 | Transmission and reception supervisory circuit |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6139737A true JPS6139737A (en) | 1986-02-25 |
Family
ID=15723959
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP16086184A Pending JPS6139737A (en) | 1984-07-31 | 1984-07-31 | Transmission and reception supervisory circuit |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6139737A (en) |
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| Publication number | Priority date | Publication date | Assignee | Title |
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| KR101422983B1 (en) * | 2010-05-18 | 2014-07-23 | 미쓰비시덴키 가부시키가이샤 | Elevator controller |
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1984
- 1984-07-31 JP JP16086184A patent/JPS6139737A/en active Pending
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