JPS61166228A - 過負荷補償型ｄ／ａ変換回路 - Google Patents
過負荷補償型ｄ／ａ変換回路Info
- Publication number
- JPS61166228A JPS61166228A JP585785A JP585785A JPS61166228A JP S61166228 A JPS61166228 A JP S61166228A JP 585785 A JP585785 A JP 585785A JP 585785 A JP585785 A JP 585785A JP S61166228 A JPS61166228 A JP S61166228A
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- JP
- Japan
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- circuit
- waveform
- overload
- analog
- delay
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- Pending
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- Analogue/Digital Conversion (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は、ディジタルオーディオ機器などのＰＣＭ変調
方式の音声信号再生装置に関する。
方式の音声信号再生装置に関する。
ディジタルオーディオ機器などでは、ＰＣＭ変調方式で
音声信号の録音・再生を行なっている。
音声信号の録音・再生を行なっている。
ＰＣＭデータを再生する場合は、通常、そのままＤ／Ａ
変換を行ないアナログ信号を得ている。
変換を行ないアナログ信号を得ている。
しかし、使用者が録音できるような機器、ディジタルオ
ーディオテープなとでは、使用者が録音レベル設定をな
し、太刀信号がＡ／Ｄ変換器の動作レインジに入るよう
に調節する。これは一般の使用者にとっては難しく、時
々量子化レベル範囲を超えるアナログ信号を録音し、再
生時にオーバーフロー雑音（過負荷雑音）が発生する。
ーディオテープなとでは、使用者が録音レベル設定をな
し、太刀信号がＡ／Ｄ変換器の動作レインジに入るよう
に調節する。これは一般の使用者にとっては難しく、時
々量子化レベル範囲を超えるアナログ信号を録音し、再
生時にオーバーフロー雑音（過負荷雑音）が発生する。
本発明の目的は、上記の欠点を除去し、波形の一部が過
負荷状態でＡ／Ｄ変換された信号をアナログ変換すると
きに、正負のピーク値で波形が台形になった部分に、波
形的修正を加えて元の波形に近ずけ、過負荷雑音を除去
することにある。
負荷状態でＡ／Ｄ変換された信号をアナログ変換すると
きに、正負のピーク値で波形が台形になった部分に、波
形的修正を加えて元の波形に近ずけ、過負荷雑音を除去
することにある。
本発明のＤ／Ａ変換回路は、Ｄ／Ａ変換器・低域フィル
タによりアナログ波形に変換するアナログ変換回路と、
前記ディジタル信号の過負荷を検出し、その間一定出力
パルスを発生する過負荷検出回路と、前記一定出力パル
スを入力し定遅延を与える狭帯域低域フィルタと、前記
アナログ変換回路の出力と前記狭帯域低域フィルタの出
力とを合成する合成回路とを設け、前記の合成する再出
力の遅延時間を同一にすることによりアナログ波形を再
生するようにしたものである。
タによりアナログ波形に変換するアナログ変換回路と、
前記ディジタル信号の過負荷を検出し、その間一定出力
パルスを発生する過負荷検出回路と、前記一定出力パル
スを入力し定遅延を与える狭帯域低域フィルタと、前記
アナログ変換回路の出力と前記狭帯域低域フィルタの出
力とを合成する合成回路とを設け、前記の合成する再出
力の遅延時間を同一にすることによりアナログ波形を再
生するようにしたものである。
アナログ波をＡ／Ｄ変換するときに、量子化レベル範囲
を正・負において一部超えると、変換されたディジタル
信号はその範囲においてすべてのビットが”Ｈ″レベル
たは″Ｌ″レベルである状態がｍ続する。したがって再
生されたアナログ信号はクリップ波形になり、奇数次歪
成分が増大し、聴覚上質の低い音声になる。本発明では
、このクリップ波形の部分に、過負荷の時間間隔に相当
するパルス幅のパルス入力による狭帯域低域フィルタの
応答波形を重畳して、なだらかな波形としクリップ波形
を補正することで原波形に近似し、過負荷雑音が発生し
ないようにするものである。
を正・負において一部超えると、変換されたディジタル
信号はその範囲においてすべてのビットが”Ｈ″レベル
たは″Ｌ″レベルである状態がｍ続する。したがって再
生されたアナログ信号はクリップ波形になり、奇数次歪
成分が増大し、聴覚上質の低い音声になる。本発明では
、このクリップ波形の部分に、過負荷の時間間隔に相当
するパルス幅のパルス入力による狭帯域低域フィルタの
応答波形を重畳して、なだらかな波形としクリップ波形
を補正することで原波形に近似し、過負荷雑音が発生し
ないようにするものである。
以下、図面を参照して本発明の一実施例の説明を行なう
。第１図は実施例の回路ブロック図であり、第２図に回
路の各点の信号を図示している。
。第１図は実施例の回路ブロック図であり、第２図に回
路の各点の信号を図示している。
ＰＣＭ信号回路１からのＰＣＭ信号が、本発明の過負荷
補償型Ｄ／Ａ変換回路の入力であり、その正または負の
入力レベルの一部で過負荷状態でＡ／Ｄ変換されている
ものとする。このＰＣＭ信号はアナログ変換回路２を経
て、アナログ出力となり加算回路９のＢ点の信号となる
。アナログ変換回路２はＤ／Ａ変換器３．アパーチャ回
路４゜低域フィルタ５からなり、通常のＤ／Ａ変換回路
である。アナログ変換回路２の出力は第２図（Ｂ）に示
すようにその正・負のピークがクリップされた波形にな
る。またＡ点の入力信号に対しＴＡＮの時間遅れになる
。
補償型Ｄ／Ａ変換回路の入力であり、その正または負の
入力レベルの一部で過負荷状態でＡ／Ｄ変換されている
ものとする。このＰＣＭ信号はアナログ変換回路２を経
て、アナログ出力となり加算回路９のＢ点の信号となる
。アナログ変換回路２はＤ／Ａ変換器３．アパーチャ回
路４゜低域フィルタ５からなり、通常のＤ／Ａ変換回路
である。アナログ変換回路２の出力は第２図（Ｂ）に示
すようにその正・負のピークがクリップされた波形にな
る。またＡ点の入力信号に対しＴＡＮの時間遅れになる
。
一方、前記ＰＣＭ信号は過負荷検出回路６に入力する。
正の入力レベルで過負荷であれば、すべてのビットが１
″であることを回路６１で検出し、過負荷状態であるか
ぎりその間正のパルスを発生する。また負の入力レベル
で過負荷であればすべてのビットが“θ″であることを
回Ｂ６２で検出しその間食のパルスを発生する。
″であることを回路６１で検出し、過負荷状態であるか
ぎりその間正のパルスを発生する。また負の入力レベル
で過負荷であればすべてのビットが“θ″であることを
回Ｂ６２で検出しその間食のパルスを発生する。
上記パルスは過負荷継続時間に比例するパルス幅をもつ
一定振幅のパルスでＰ点、Ｎ点の波形は第２図（Ｐ）、
（Ｎ）に示すようになる。上記パルスはアナログ加
算回路７を介して狭帯域低域フィルタ８に入力する。こ
の狭帯域低域フィルタ８は直線位相性をもち一定の遅延
を与えるとともに狭帯域の特性を有し、第３図に示すよ
うなパルス応答特性を与えるものであればよい。例えば
第４図に示すようなｃｏｓ”ロールオフあるいはガウス
波形などの特性フィルタが用いられる。したがって狭帯
域低域フィルタ８の出力は０点で第２図（Ｃ）の波形に
なる。振幅は合成回路９内の減衰器ＡＴＴで適宜設定で
きる。そしてＡ点の入力信号に対し０点の信号はＴＡｃ
の時間遅れになる。
一定振幅のパルスでＰ点、Ｎ点の波形は第２図（Ｐ）、
（Ｎ）に示すようになる。上記パルスはアナログ加
算回路７を介して狭帯域低域フィルタ８に入力する。こ
の狭帯域低域フィルタ８は直線位相性をもち一定の遅延
を与えるとともに狭帯域の特性を有し、第３図に示すよ
うなパルス応答特性を与えるものであればよい。例えば
第４図に示すようなｃｏｓ”ロールオフあるいはガウス
波形などの特性フィルタが用いられる。したがって狭帯
域低域フィルタ８の出力は０点で第２図（Ｃ）の波形に
なる。振幅は合成回路９内の減衰器ＡＴＴで適宜設定で
きる。そしてＡ点の入力信号に対し０点の信号はＴＡｃ
の時間遅れになる。
合成回路９で信号Ｂ、倍信号とを合成するが、その際、
両者の位相が一致するように、ＴＡＲ。
両者の位相が一致するように、ＴＡＲ。
Ｔ’Ａｃの遅延時間を同一にする。それにはアナログ的
に位相を合わせる場合は、各フィルタ５．８の位相を調
節したり、あるいは合成回路９の減衰器ＡＴＴの部分で
行なう。ディジタル的に位相を合わせるにはＰＣＭ信号
処理回路１からの２分岐するディジタル伝送路のいずれ
か１つに遅延調節回路１１を挿入することによって行な
う。
に位相を合わせる場合は、各フィルタ５．８の位相を調
節したり、あるいは合成回路９の減衰器ＡＴＴの部分で
行なう。ディジタル的に位相を合わせるにはＰＣＭ信号
処理回路１からの２分岐するディジタル伝送路のいずれ
か１つに遅延調節回路１１を挿入することによって行な
う。
ＴＡｌｌ、ＴＡｃが同一であれば、第２図（Ｂ）のアナ
ログ変換回路２の出力のクリップされた部分に、第２図
（Ｃ）の波形が重畳し、同図（Ｄ）の波形となり、クリ
ップ状態が補償された波形を得ることができる。低域フ
ィルタ１０は上記合成過程で少し位相ずれがあった場合
にも、波形がなだらかにするためのものである。
ログ変換回路２の出力のクリップされた部分に、第２図
（Ｃ）の波形が重畳し、同図（Ｄ）の波形となり、クリ
ップ状態が補償された波形を得ることができる。低域フ
ィルタ１０は上記合成過程で少し位相ずれがあった場合
にも、波形がなだらかにするためのものである。
以上、詳しく説明したように、ＰＣＭ録音の際、量子化
レベルを超えるような信号に対しても、そのままＤ／Ａ
変換すればクリップされた波形になるところを、その部
分にクリップされた期間の時間幅をもつパルスの低域フ
ィルタ応答波を重畳して補償することで、クリップによ
る奇数次歪成分を減少できる。したがって過負荷の場合
にも、聴感特性を著しく改善することができる。本発明
は原波形の完全な再生ではないが、過負荷はしばしば発
生するものでないため、上記のような補償回路で十分に
対応できる。
レベルを超えるような信号に対しても、そのままＤ／Ａ
変換すればクリップされた波形になるところを、その部
分にクリップされた期間の時間幅をもつパルスの低域フ
ィルタ応答波を重畳して補償することで、クリップによ
る奇数次歪成分を減少できる。したがって過負荷の場合
にも、聴感特性を著しく改善することができる。本発明
は原波形の完全な再生ではないが、過負荷はしばしば発
生するものでないため、上記のような補償回路で十分に
対応できる。
第１図は本発明の一実施例の回路ブロック図、第２図は
第１図の各点の波形、第３図、第４図は狭帯域低域フィ
ルタの特性を示す図である。 １−Ｐ ＣＭ信号処理回路、２−アナログ変換回路、３
−Ｄ／Ａ変換器、 ４−アパーチャ回路、５−低域フィ
ルタ、 ６−過負荷検出回路、８−狭帯域低域フィルタ
、 ９−合成回路、１〇−低域フィルタ。 実用新案登録出願人 日本電気ホームエレクトロニクス株式会社代理人
弁理士 佐藤秋比古 乞２図 Ｌ３図
第１図の各点の波形、第３図、第４図は狭帯域低域フィ
ルタの特性を示す図である。 １−Ｐ ＣＭ信号処理回路、２−アナログ変換回路、３
−Ｄ／Ａ変換器、 ４−アパーチャ回路、５−低域フィ
ルタ、 ６−過負荷検出回路、８−狭帯域低域フィルタ
、 ９−合成回路、１〇−低域フィルタ。 実用新案登録出願人 日本電気ホームエレクトロニクス株式会社代理人
弁理士 佐藤秋比古 乞２図 Ｌ３図
Claims (1)
- アナログ波形の１部が過負荷状態でＡ／Ｄ変換されたデ
ィジタル信号について、前記ディジタル信号を入力し、
Ｄ／Ａ変換器・低域フィルタによりアナログ波形に変換
するアナログ変換回路と、前記ディジタル信号の過負荷
を検出し、その間一定出力パルスを発生する過負荷検出
回路と、前記一定出力パルスを入力し定遅延を与える狭
帯域低域フィルタと、前記アナログ変換回路の出力と前
記狭帯域低域フィルタの出力とを合成する合成回路とを
設け、前記の合成する両出力の遅延時間を同一にするこ
とによりアナログ波形を再生することを特徴とする過負
荷補償型Ｄ／Ａ変換回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP585785A JPS61166228A (ja) | 1985-01-18 | 1985-01-18 | 過負荷補償型ｄ／ａ変換回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP585785A JPS61166228A (ja) | 1985-01-18 | 1985-01-18 | 過負荷補償型ｄ／ａ変換回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS61166228A true JPS61166228A (ja) | 1986-07-26 |
Family
ID=11622645
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP585785A Pending JPS61166228A (ja) | 1985-01-18 | 1985-01-18 | 過負荷補償型ｄ／ａ変換回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS61166228A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH07142934A (ja) * | 1993-11-18 | 1995-06-02 | Japan Radio Co Ltd | 波形歪み補償方法並びにこれを用いた振幅変調方法及び回路 |
| JP2010518324A (ja) * | 2007-02-01 | 2010-05-27 | シャエフラー カーゲー | 軸受構造 |
-
1985
- 1985-01-18 JP JP585785A patent/JPS61166228A/ja active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH07142934A (ja) * | 1993-11-18 | 1995-06-02 | Japan Radio Co Ltd | 波形歪み補償方法並びにこれを用いた振幅変調方法及び回路 |
| JP2010518324A (ja) * | 2007-02-01 | 2010-05-27 | シャエフラー カーゲー | 軸受構造 |
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