JPS609278B2 - 薄膜ｅｌ素子の光消去回路 - Google Patents
薄膜ｅｌ素子の光消去回路Info
- Publication number
- JPS609278B2 JPS609278B2 JP52107424A JP10742477A JPS609278B2 JP S609278 B2 JPS609278 B2 JP S609278B2 JP 52107424 A JP52107424 A JP 52107424A JP 10742477 A JP10742477 A JP 10742477A JP S609278 B2 JPS609278 B2 JP S609278B2
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- JP
- Japan
- Prior art keywords
- voltage
- light
- erasing
- thin film
- brightness
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired
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- Control Of Indicators Other Than Cathode Ray Tubes (AREA)
- Control Of El Displays (AREA)
Description
【発明の詳細な説明】
本発明は発光輝度の対印加電圧特性に於いてヒステリシ
ス現象を呈する三層構造薄膜ＥＬ素子において、該素子
の表示パターンの光消去する際に用いる回路に関するも
のである。
ス現象を呈する三層構造薄膜ＥＬ素子において、該素子
の表示パターンの光消去する際に用いる回路に関するも
のである。
ＭｎをドープしたＺｎＳ，ＺｎＳｅ等の半導体発光薄膜
をＹ２０２，Ｓｉ３Ｎ４，Ｔｉ０２等の議電体薄膜でサ
ンドィッチした三層構造ＺｎＳ：Ｍｎ（又はＺｎＳｅ：
Ｍｎ）薄膜ＥＬ素子はＫＨＺのＡＣ電圧印加によって高
輝度発光し、しかも長寿命であるという特徴を有してい
る。
をＹ２０２，Ｓｉ３Ｎ４，Ｔｉ０２等の議電体薄膜でサ
ンドィッチした三層構造ＺｎＳ：Ｍｎ（又はＺｎＳｅ：
Ｍｎ）薄膜ＥＬ素子はＫＨＺのＡＣ電圧印加によって高
輝度発光し、しかも長寿命であるという特徴を有してい
る。
第１図は本発明の１実施例として使用するＺｎＳ薄膜Ｅ
Ｌ素子の構造を示す礎成図である。
Ｌ素子の構造を示す礎成図である。
通常、ガラス基板１上にｌｎ２０３又はＳｎ０２よりな
る下部電圧２、Ｙ２Ｑ，Ｓｊ３Ｎ４，又はＴｉＱよりな
る薄膜絶縁層３、Ｍｎがドープされ、発光層となる薄膜
ＺｎＳ層４，Ｙ２０３，Ｓｉ３Ｎ４，又はＴｉ０２より
なる上部薄膜絶縁層５、ＡＩ等の金属より成る背面電極
６が蒸着法スパッタリング法等により順次積層形成され
ている。透明電極２及び背面電極６はリード線で電源部
７に接続されている。またこの薄膜ＥＬ層の発光に関し
ては印加電圧を昇圧していく過程と高電圧側より降圧し
ていく過程で、同じ時印加電圧値に対して発光輝度が異
なるといったヒステリシス特性を有していることが発見
され、このヒステリシス特性を有するＥＬ素子に印加電
圧を昇圧する過程に於いて、光、電界、熱等が付与され
るとＥＬ素子はその強度に対応した発光輝度の状態に励
起され、光、電界、熱等を除去して元の状態に戻しても
発光輝度が高くなった状態に留まるといったメモリー現
象が存在することが知られている。そしてこのメモリー
現象を有効に活用してＥＬ素子をメモリー素子として利
用するＥＬ素子応用技術が現在産業界等で研究開発され
ている。薄膜ＥＬ素子の１例としてＭｎをドープしたＺ
ｎＳ：Ｍｎ薄膜ＥＬ素子の印加電圧に対する発光輝度特
性を第２図に示す。横軸は印加交流電圧パルスの振幅（
ピーク値）Ｖを、縦軸は発光輝度Ｂをあらわしている。
この第２図から明らかな様に、印加パルスの電圧を上昇
していくときのＥＬ素子の発光輝度（曲線１で示す）と
、電圧を降下していくときのＥＬ素子の発光輝度（曲線
Ｄで示す）との間には、顕著なヒステリシス現象が存在
する。又第３図は第２図に於ける薄膜ＥＬ素子に印加さ
れる印加交流電圧パルスの電圧波形を示すものである。
る下部電圧２、Ｙ２Ｑ，Ｓｊ３Ｎ４，又はＴｉＱよりな
る薄膜絶縁層３、Ｍｎがドープされ、発光層となる薄膜
ＺｎＳ層４，Ｙ２０３，Ｓｉ３Ｎ４，又はＴｉ０２より
なる上部薄膜絶縁層５、ＡＩ等の金属より成る背面電極
６が蒸着法スパッタリング法等により順次積層形成され
ている。透明電極２及び背面電極６はリード線で電源部
７に接続されている。またこの薄膜ＥＬ層の発光に関し
ては印加電圧を昇圧していく過程と高電圧側より降圧し
ていく過程で、同じ時印加電圧値に対して発光輝度が異
なるといったヒステリシス特性を有していることが発見
され、このヒステリシス特性を有するＥＬ素子に印加電
圧を昇圧する過程に於いて、光、電界、熱等が付与され
るとＥＬ素子はその強度に対応した発光輝度の状態に励
起され、光、電界、熱等を除去して元の状態に戻しても
発光輝度が高くなった状態に留まるといったメモリー現
象が存在することが知られている。そしてこのメモリー
現象を有効に活用してＥＬ素子をメモリー素子として利
用するＥＬ素子応用技術が現在産業界等で研究開発され
ている。薄膜ＥＬ素子の１例としてＭｎをドープしたＺ
ｎＳ：Ｍｎ薄膜ＥＬ素子の印加電圧に対する発光輝度特
性を第２図に示す。横軸は印加交流電圧パルスの振幅（
ピーク値）Ｖを、縦軸は発光輝度Ｂをあらわしている。
この第２図から明らかな様に、印加パルスの電圧を上昇
していくときのＥＬ素子の発光輝度（曲線１で示す）と
、電圧を降下していくときのＥＬ素子の発光輝度（曲線
Ｄで示す）との間には、顕著なヒステリシス現象が存在
する。又第３図は第２図に於ける薄膜ＥＬ素子に印加さ
れる印加交流電圧パルスの電圧波形を示すものである。
ある一定の電界を印加されたＥＬ素子に書き込み手段と
して光、熱、又は電界が照射あるいは印加されると、Ｚ
ｎＳ：Ｍｎ発光層中の電子トラック準位に掩護されてい
た電子が各強度に相当する数だけ伝導帯中に励起され伝
導電子となって、ＺｎＳ：Ｍｎ層を走行する。
して光、熱、又は電界が照射あるいは印加されると、Ｚ
ｎＳ：Ｍｎ発光層中の電子トラック準位に掩護されてい
た電子が各強度に相当する数だけ伝導帯中に励起され伝
導電子となって、ＺｎＳ：Ｍｎ層を走行する。
この途中でＭｎ発光センターを励起発光させる為ＥＬ素
子の発光輝度は増加する。従って、今、同一印加電圧値
に於いて電圧上昇時の発光輝度技と、電圧下降時の発光
輝度Ｂｗとの差が十分に大きい点の電圧値Ｖｓ（維持電
圧）を選び、第３図に示す如く、Ｖｓを振幅とする交流
パルス列Ｐｓで上記ＥＬ素子を駆動するときＥＬ素子は
発光輝度茂をこのパルス釘岬ｓに依って維持する。
子の発光輝度は増加する。従って、今、同一印加電圧値
に於いて電圧上昇時の発光輝度技と、電圧下降時の発光
輝度Ｂｗとの差が十分に大きい点の電圧値Ｖｓ（維持電
圧）を選び、第３図に示す如く、Ｖｓを振幅とする交流
パルス列Ｐｓで上記ＥＬ素子を駆動するときＥＬ素子は
発光輝度茂をこのパルス釘岬ｓに依って維持する。
次に、交流パルス列Ｐｓの振幅を第３図に示すように瞬
間的に変調して電圧値の高い書き込み電圧ＶｗをＥＬ素
子に印加すると、素子は書き込み電圧Ｖｗ‘こ対する発
光輝度即ち第２図に於けるＰ点の瞬間輝度Ｂｗで発光し
た後、次の交流維持パルスにて曲線０１こより書き込み
輝度Ｂｗの点Ｑで安定となり、この輝度Ｂｗを維持する
。一方、このようにして書き込み状態を維持している交
流維持パルス打蛇ｓの振幅をさらに変調して十分に低い
消去電圧ＶｅをＥＬ素子に印加すると、ＥＬ素子は瞬間
、消去輝度技の点Ｒを通過した後、次の交流維持パルス
打肥ｓにて消去輝度Ｂｅに落ちつき、この輝度Ｂｅを維
持して、消去及び消去状態を維持する。
間的に変調して電圧値の高い書き込み電圧ＶｗをＥＬ素
子に印加すると、素子は書き込み電圧Ｖｗ‘こ対する発
光輝度即ち第２図に於けるＰ点の瞬間輝度Ｂｗで発光し
た後、次の交流維持パルスにて曲線０１こより書き込み
輝度Ｂｗの点Ｑで安定となり、この輝度Ｂｗを維持する
。一方、このようにして書き込み状態を維持している交
流維持パルス打蛇ｓの振幅をさらに変調して十分に低い
消去電圧ＶｅをＥＬ素子に印加すると、ＥＬ素子は瞬間
、消去輝度技の点Ｒを通過した後、次の交流維持パルス
打肥ｓにて消去輝度Ｂｅに落ちつき、この輝度Ｂｅを維
持して、消去及び消去状態を維持する。
また上記書き込み、消去にあたって書き込み、あるいは
消去電圧Ｖｗ，Ｖｅを任意に選択すると、輝度Ｂｗ，Ｂ
ｅの間での上記電圧に対応した任意の中間調の輝度が得
られる。書き込み電圧Ｖｗ、消去電圧Ｖｅの印奴により
ＥＬ素子の発光輝度が書き込み輝度Ｂｗに維持され、あ
るいは書き込み輝度Ｂｗが消去される原因は次の理由に
よるものと考えられる。即ち、書き込み手段として照射
あるいは印加された光、熱、又は電界を除去してもＺｎ
Ｓ：Ｍｎ層の誘電体膜の界面近傍に掃引された伝導電子
は界面近傍の界面位に瓶議されており、次の維持パルス
印加によって界面準位より伝導帯に抜け出しＺｎＳ：Ｍ
ｎ層を走行して他方の界面に達する。その際ＺｎＳ：Ｍ
ｎ層中のもとの電子トラップ近傍を通過する伝導電子に
対してはもとのトラップ準位に再トラップされる確率よ
りも他方の界面に掃引される確率の方が高い。これは維
持パルスによる電界によって伝導電子が高速度となって
いるためである。このため発光輝度は元の状態に戻らず
メモリー現象を呈することとなる。次に消去電圧を印加
すると電子トラップ準位近傍を通過する伝導電子の掃引
速度が低くなり、印加電界によって他方の界面に掃引さ
れる確率よりもＺｎＳ：Ｍｎ層中のもとの電子トラップ
準位に再トラップされる確率が高くなる。
消去電圧Ｖｗ，Ｖｅを任意に選択すると、輝度Ｂｗ，Ｂ
ｅの間での上記電圧に対応した任意の中間調の輝度が得
られる。書き込み電圧Ｖｗ、消去電圧Ｖｅの印奴により
ＥＬ素子の発光輝度が書き込み輝度Ｂｗに維持され、あ
るいは書き込み輝度Ｂｗが消去される原因は次の理由に
よるものと考えられる。即ち、書き込み手段として照射
あるいは印加された光、熱、又は電界を除去してもＺｎ
Ｓ：Ｍｎ層の誘電体膜の界面近傍に掃引された伝導電子
は界面近傍の界面位に瓶議されており、次の維持パルス
印加によって界面準位より伝導帯に抜け出しＺｎＳ：Ｍ
ｎ層を走行して他方の界面に達する。その際ＺｎＳ：Ｍ
ｎ層中のもとの電子トラップ近傍を通過する伝導電子に
対してはもとのトラップ準位に再トラップされる確率よ
りも他方の界面に掃引される確率の方が高い。これは維
持パルスによる電界によって伝導電子が高速度となって
いるためである。このため発光輝度は元の状態に戻らず
メモリー現象を呈することとなる。次に消去電圧を印加
すると電子トラップ準位近傍を通過する伝導電子の掃引
速度が低くなり、印加電界によって他方の界面に掃引さ
れる確率よりもＺｎＳ：Ｍｎ層中のもとの電子トラップ
準位に再トラップされる確率が高くなる。
従ってメモリー消去が行なわれることになる。以上詳説
した事項は、従来薄膜ＥＬ素子の駆動方式に於いて一般
的に利用されているものであり上記万式によりＥＬ素子
をメモリー機能を有するＥＬ素子として応用することが
できる。
した事項は、従来薄膜ＥＬ素子の駆動方式に於いて一般
的に利用されているものであり上記万式によりＥＬ素子
をメモリー機能を有するＥＬ素子として応用することが
できる。
メモリー消去の方法として、光、又は電界による消去が
一般的であるが、本発明は光消去方式の際に用いられる
回路に関するものである。
一般的であるが、本発明は光消去方式の際に用いられる
回路に関するものである。
以下に詳細に本発明について述べる。本件出願の先に出
願した特願昭４９一１０３３１６号（特関昭５１−２９
８８７号）に記載した光消去方式は第３図に示すような
電気的タィミグで、即ち、ＥＬの両端電圧がｏのときに
光照射をしてメモリー消去を行なうものである。
願した特願昭４９一１０３３１６号（特関昭５１−２９
８８７号）に記載した光消去方式は第３図に示すような
電気的タィミグで、即ち、ＥＬの両端電圧がｏのときに
光照射をしてメモリー消去を行なうものである。
この場合、照射光強度が弱いと十分消去が出来ず、再び
維持パルス電圧を印加すると書き込みメモリー輝度と消
去輝度の中間のレベルでＥＬは発光してしまう。光照射
による消去は界面に蓄積された分極電荷をＺｎＳの光伝
導により緩和させることによりメモリー消去が行なわれ
るものである。
維持パルス電圧を印加すると書き込みメモリー輝度と消
去輝度の中間のレベルでＥＬは発光してしまう。光照射
による消去は界面に蓄積された分極電荷をＺｎＳの光伝
導により緩和させることによりメモリー消去が行なわれ
るものである。
従って、光が弱い場合、十分緩和されず、伝導電子は掃
引されず、ＺｎＳ：Ｍｎ層中のもとの電子トラップ準位
に再トラップされる確率が低くなる。これを解決するた
めに光照射だけでなく、同時にバイアス電圧を印加して
おき、伝導電子が加速されやすい状態の下で光緩和を行
い、伝導電子の掃引を早め、ひいては消去効果を向上さ
せる方法を本件出願人は昭和５２手６月３０日に出願し
た。
引されず、ＺｎＳ：Ｍｎ層中のもとの電子トラップ準位
に再トラップされる確率が低くなる。これを解決するた
めに光照射だけでなく、同時にバイアス電圧を印加して
おき、伝導電子が加速されやすい状態の下で光緩和を行
い、伝導電子の掃引を早め、ひいては消去効果を向上さ
せる方法を本件出願人は昭和５２手６月３０日に出願し
た。
特関昭５２一７８７１３ふ、侍閥昭６４−１２６７１号
公報参照。これは光消去をするタイミングのとき、バイ
アス電圧Ｖａを印加するものである。このバイアス電圧
は光照射に同期するパルス電圧でもよいが、直流電圧で
もよい。バイアス電圧Ｖａは１０Ｖ〜２００Ｖまでの範
囲で任意に選ぶことができる。このときの照射光は１回
加えるだけであり、３２００Ａ〜４８００Ａの波長にお
いて同じ程度に光消去することができる。またこのとき
の維持パルスはパルス幅２００仏ｓｅｃ、周波数１．１
ＫＨＺ維持電圧２３０Ｖである。この動作をヒステリシ
ス特性を用いて説明すると、今素子が第４図のａの状態
、即ち、維持電圧Ｖｓ，のパルス列が加えられ、発光輝
度がＢの高輝度発光状態にあるとする。この維持電圧Ｖ
ｓ，のパルス列が加えられている状態において、薄膜Ｅ
Ｌ素子の両端電圧が０のときに光照射しても、再び維持
電圧パルスを印加したときは点線で示す曲線上のｂ点と
なり、消去点Ｃにはならない。即ち光消去は不完全であ
る。そこで維持電圧Ｖｓ，をバイアス電圧Ｖａに切換え
ると、発光輝度はａの位置からｄの位置へ移る。
公報参照。これは光消去をするタイミングのとき、バイ
アス電圧Ｖａを印加するものである。このバイアス電圧
は光照射に同期するパルス電圧でもよいが、直流電圧で
もよい。バイアス電圧Ｖａは１０Ｖ〜２００Ｖまでの範
囲で任意に選ぶことができる。このときの照射光は１回
加えるだけであり、３２００Ａ〜４８００Ａの波長にお
いて同じ程度に光消去することができる。またこのとき
の維持パルスはパルス幅２００仏ｓｅｃ、周波数１．１
ＫＨＺ維持電圧２３０Ｖである。この動作をヒステリシ
ス特性を用いて説明すると、今素子が第４図のａの状態
、即ち、維持電圧Ｖｓ，のパルス列が加えられ、発光輝
度がＢの高輝度発光状態にあるとする。この維持電圧Ｖ
ｓ，のパルス列が加えられている状態において、薄膜Ｅ
Ｌ素子の両端電圧が０のときに光照射しても、再び維持
電圧パルスを印加したときは点線で示す曲線上のｂ点と
なり、消去点Ｃにはならない。即ち光消去は不完全であ
る。そこで維持電圧Ｖｓ，をバイアス電圧Ｖａに切換え
ると、発光輝度はａの位置からｄの位置へ移る。
このバイアス電圧ｙａを印加している状態で、同時に光
照射すると、ｄの位置からｃの位置に移る。即ち光消去
が完全に行われる。その後、維持電圧Ｖｓ，に戻すと、
光消去点の輝度はｅの状態からｃの状態に移る。このと
き光消去されなかった点はｄの状態からｆの状態に移る
。このように維持電圧ｙｓ，の休止期間に光消射して光
消去した場合は、光消去点と光消去をしなかった点との
輝度のレベル差はａ点とｂ点であり、差が４・さし、。
照射すると、ｄの位置からｃの位置に移る。即ち光消去
が完全に行われる。その後、維持電圧Ｖｓ，に戻すと、
光消去点の輝度はｅの状態からｃの状態に移る。このと
き光消去されなかった点はｄの状態からｆの状態に移る
。このように維持電圧ｙｓ，の休止期間に光消射して光
消去した場合は、光消去点と光消去をしなかった点との
輝度のレベル差はａ点とｂ点であり、差が４・さし、。
これに対してバイアス電圧Ｖａを印加して光消去した場
合は光消去点と光消去しなかっ点との輝度のレベル差は
ｆ点とｃ点であり、レベル差は大きい。本発明は以上に
鑑み、維持電圧Ｖｓとバイアス電圧Ｖａを切換えて印加
する回路に関するものである。
合は光消去点と光消去しなかっ点との輝度のレベル差は
ｆ点とｃ点であり、レベル差は大きい。本発明は以上に
鑑み、維持電圧Ｖｓとバイアス電圧Ｖａを切換えて印加
する回路に関するものである。
ここで維持電圧とバイアス電圧に切換える理由は、薄膜
重Ｌパネルの機能として、１電気的書込み、２電気的全
面消去、３電気的任意点消去、４電気的読出し、５光書
込み、６光消去があるが、上記機能中、１電気的書込み
、４電気的議出し、５光書込みは維持電圧が高い方が都
合がよく、３電気的任意′点消去、６光消去はバイアス
電圧とする方が都合がよいためである。
重Ｌパネルの機能として、１電気的書込み、２電気的全
面消去、３電気的任意点消去、４電気的読出し、５光書
込み、６光消去があるが、上記機能中、１電気的書込み
、４電気的議出し、５光書込みは維持電圧が高い方が都
合がよく、３電気的任意′点消去、６光消去はバイアス
電圧とする方が都合がよいためである。
そしてこのように維持電圧とバイアス電圧に切換えるこ
とにより多くの機能を十分に発揮させることができる。
第５図は本発明の一実施例の回路図を示し、点線で囲ん
だ部分が電圧切換回路である。線Ｌに加えられる電圧を
電源として、薄膜ＥＬ素子ＥＬの両端に後続した４つの
スイッチングトランジスタＴｒ，〜Ｔｒ４を、制御回路
Ｃより得られる制御信号Ｓ．〜Ｓ４でトランジスタＴｒ
，〜Ｔｒ２Ｔｒ３とＴｒ４を交互にオン・オフ制御して
交流パルスを印放する。
とにより多くの機能を十分に発揮させることができる。
第５図は本発明の一実施例の回路図を示し、点線で囲ん
だ部分が電圧切換回路である。線Ｌに加えられる電圧を
電源として、薄膜ＥＬ素子ＥＬの両端に後続した４つの
スイッチングトランジスタＴｒ，〜Ｔｒ４を、制御回路
Ｃより得られる制御信号Ｓ．〜Ｓ４でトランジスタＴｒ
，〜Ｔｒ２Ｔｒ３とＴｒ４を交互にオン・オフ制御して
交流パルスを印放する。
電源ラインＬ‘こ供給される電圧は制御トランジスタＴ
ｒによって制御される。トランジスタＴｒのベースコレ
クタ間に抵抗Ｒ３が接続され、ベースとアース間に電圧
設定用可変抵抗Ｒ，が接続されるとともに、並列にリレ
ースイッチＳｗと抵抗Ｒ２の直列回路が接続される。リ
レースイッチＳｗは制御回路Ｃによって制御される。従
って、スイッチＳｗがオフのときは、 Ｖ．：古島馬Ｖ。
ｒによって制御される。トランジスタＴｒのベースコレ
クタ間に抵抗Ｒ３が接続され、ベースとアース間に電圧
設定用可変抵抗Ｒ，が接続されるとともに、並列にリレ
ースイッチＳｗと抵抗Ｒ２の直列回路が接続される。リ
レースイッチＳｗは制御回路Ｃによって制御される。従
って、スイッチＳｗがオフのときは、 Ｖ．：古島馬Ｖ。
であり、スイッチＳＷがオンのときはｖ２＝申支ｖｏ，
Ｒ＝毒害をであり、ＲがＲになった分だけ電圧が低下す
る。ここでＶ，は維持電圧ｙｓに、Ｖ２はバイアス電圧
Ｖａに設定される。以上のように本発明によれば、簡単
な回路構成で維持電圧とバイアス電圧に切換えることが
できる。
Ｒ＝毒害をであり、ＲがＲになった分だけ電圧が低下す
る。ここでＶ，は維持電圧ｙｓに、Ｖ２はバイアス電圧
Ｖａに設定される。以上のように本発明によれば、簡単
な回路構成で維持電圧とバイアス電圧に切換えることが
できる。
第１図は三層構造薄膜ＥＬ素子の断面構成図、第２図は
薄膜ＥＬ素子の印加電圧に対する発光輝度を示すヒステ
リシス特性図、第３図は薄膜ＥＬ素子に印加される交流
パルス列の電圧波形図、、第４図は光消去を説明するた
めに用いた印加電圧に対する発光輝度特性図、第５図は
本発明による維持電圧バイアス電圧の切襖回路図を示す
。 Ｔｒは電圧制御用トランジスタ、Ｒ，〜Ｒ３は抵抗、Ｓ
ｗはリレースイッチ、Ｃは制御回路である。第１図 第２図 第３図 第４図 第５図
薄膜ＥＬ素子の印加電圧に対する発光輝度を示すヒステ
リシス特性図、第３図は薄膜ＥＬ素子に印加される交流
パルス列の電圧波形図、、第４図は光消去を説明するた
めに用いた印加電圧に対する発光輝度特性図、第５図は
本発明による維持電圧バイアス電圧の切襖回路図を示す
。 Ｔｒは電圧制御用トランジスタ、Ｒ，〜Ｒ３は抵抗、Ｓ
ｗはリレースイッチ、Ｃは制御回路である。第１図 第２図 第３図 第４図 第５図
Claims (1)
- １ 少くとも一方が透明な電極間に、少くも一方が透明
な薄膜誘電体で挟持された薄膜ＥＬ層を有し、印加電圧
に対する発光輝度特性にヒステリシス現象を呈する薄膜
ＥＬ素子において、電圧上昇時の発光輝度と電圧下降時
の発光輝度の差が大きい維持電圧パルスを前記薄膜ＥＬ
素子に印加する手段と、光消去する際に、前記維持電圧
パルスの電圧値を前記維持電圧より低い光消去用バイア
ス電圧に切換える手段とを備えてなることを特徴とする
薄膜ＥＬ素子の光消去回路。
Priority Applications (5)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP52107424A JPS609278B2 (ja) | 1977-09-06 | 1977-09-06 | 薄膜ｅｌ素子の光消去回路 |
| US05/925,973 US4210848A (en) | 1977-07-20 | 1978-07-19 | Thin-film EL display panel with light-activated write and erase means |
| FR7821430A FR2398358A1 (fr) | 1977-07-20 | 1978-07-19 | Panneau de visualisation electroluminescent a couche mince |
| DE2831788A DE2831788C3 (de) | 1977-07-20 | 1978-07-19 | Verfahren und Schaltungsanordnung zur Ansteuerung eines durch Lichteinwirkung erregbaren Dünnschicht-Elektrolumineszenz-Anzeigeelements |
| GB7830590A GB2003171B (en) | 1977-07-20 | 1978-07-20 | Thin-film el display panel with light-activated write and erase means |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP52107424A JPS609278B2 (ja) | 1977-09-06 | 1977-09-06 | 薄膜ｅｌ素子の光消去回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5440586A JPS5440586A (en) | 1979-03-30 |
| JPS609278B2 true JPS609278B2 (ja) | 1985-03-08 |
Family
ID=14458788
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP52107424A Expired JPS609278B2 (ja) | 1977-07-20 | 1977-09-06 | 薄膜ｅｌ素子の光消去回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS609278B2 (ja) |
Families Citing this family (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS58142686A (ja) * | 1982-02-18 | 1983-08-24 | Casio Comput Co Ltd | 液晶テレビジヨン受像機 |
| US4845489A (en) * | 1985-12-23 | 1989-07-04 | Chrysler Motors Corporation | Electroluminescent display drive circuitry |
-
1977
- 1977-09-06 JP JP52107424A patent/JPS609278B2/ja not_active Expired
Also Published As
| Publication number | Publication date |
|---|---|
| JPS5440586A (en) | 1979-03-30 |
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