JPS6057227U - パワ−オン・リセット回路 - Google Patents
パワ−オン・リセット回路Info
- Publication number
- JPS6057227U JPS6057227U JP15000183U JP15000183U JPS6057227U JP S6057227 U JPS6057227 U JP S6057227U JP 15000183 U JP15000183 U JP 15000183U JP 15000183 U JP15000183 U JP 15000183U JP S6057227 U JPS6057227 U JP S6057227U
- Authority
- JP
- Japan
- Prior art keywords
- power
- reset circuit
- negative logic
- logic circuit
- circuit
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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- Logic Circuits (AREA)
- Electronic Switches (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
第１図は本考案の一実施例を示す図、第２図はその動作
タイムチャートを示す図である。 １．２・・・否定論理回路、３・・・ダイオード。
タイムチャートを示す図である。 １．２・・・否定論理回路、３・・・ダイオード。
Claims (1)
- ダイオードを介して電源を供給される第１の否定論理回
路と、直接電源を供給される第２の否定論理回路とを有
し、前記第１の否定論理回路の出力を前記第２の否定論
理回路の入力に接続したことを特徴とするパワーオン・
リセット回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP15000183U JPS6057227U (ja) | 1983-09-28 | 1983-09-28 | パワ−オン・リセット回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP15000183U JPS6057227U (ja) | 1983-09-28 | 1983-09-28 | パワ−オン・リセット回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6057227U true JPS6057227U (ja) | 1985-04-22 |
Family
ID=30332810
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP15000183U Pending JPS6057227U (ja) | 1983-09-28 | 1983-09-28 | パワ−オン・リセット回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6057227U (ja) |
-
1983
- 1983-09-28 JP JP15000183U patent/JPS6057227U/ja active Pending
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