JPS6031395A - デ−タ伝送制御方式 - Google Patents
デ−タ伝送制御方式Info
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- JPS6031395A JPS6031395A JP14070883A JP14070883A JPS6031395A JP S6031395 A JPS6031395 A JP S6031395A JP 14070883 A JP14070883 A JP 14070883A JP 14070883 A JP14070883 A JP 14070883A JP S6031395 A JPS6031395 A JP S6031395A
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- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04M—TELEPHONIC COMMUNICATION
- H04M9/00—Arrangements for interconnection not involving centralised switching
- H04M9/002—Arrangements for interconnection not involving centralised switching with subscriber controlled access to a line, i.e. key telephone systems
- H04M9/003—Transmission of control signals from or to the key telephone set; signalling equipment at key telephone set, e.g. keyboard or display equipment
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- Sub-Exchange Stations And Push- Button Telephones (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
（本発明の技術分野）
本発明は電子式ボタン電話装置等における主装置と電話
機間で授受される制御データの伝送制御方式に係るもの
である。
機間で授受される制御データの伝送制御方式に係るもの
である。
（従来方式）
従来の主装置と電話機間で行われる制御データの交信方
式は大別すると次の２種類となる。
式は大別すると次の２種類となる。
第１の方式は、第１図に示すブロック図の−ごとく、主
装置部に対して、複数の電話機ＴＥＩ、 ｌ〜置ｎをい
わゆるスター状に配置し主装置ＭＥに電話機台数分の主
装置データ送受信回路ＭＤＴＲ１〜ＭＤＴＲｎ及び該デ
ータ送受信回路ＭＤＴＲ１−ＭＤＴＲｎの選択ゲートＤ
ＳＧｌ−ＤＳＧｎを設け、該選択ゲートＤＳＧ ｌ〜Ｄ
ＳＧｎの１つを閉成し、主装置マイクロノロセッサＭＣ
ＰＵと電話機マイクロプロセッサＴＣＰＵとが、主装置
データ送受信回路ＭＤＴＲと電話機データ送受信回路Ｔ
ＤＴＲとを介して制御データの交信を行う方式である。
装置部に対して、複数の電話機ＴＥＩ、 ｌ〜置ｎをい
わゆるスター状に配置し主装置ＭＥに電話機台数分の主
装置データ送受信回路ＭＤＴＲ１〜ＭＤＴＲｎ及び該デ
ータ送受信回路ＭＤＴＲ１−ＭＤＴＲｎの選択ゲートＤ
ＳＧｌ−ＤＳＧｎを設け、該選択ゲートＤＳＧ ｌ〜Ｄ
ＳＧｎの１つを閉成し、主装置マイクロノロセッサＭＣ
ＰＵと電話機マイクロプロセッサＴＣＰＵとが、主装置
データ送受信回路ＭＤＴＲと電話機データ送受信回路Ｔ
ＤＴＲとを介して制御データの交信を行う方式である。
第２の方式は第２図のブロック図のごとく、主装置部に
対して、電話装置 ｌ 〜置ｎをいわゆるマルチ状に配
置し、主装置部に１つの主装置データ送受信回路ＭＤＴ
Ｒを設け、主装置マイクロプロセッサＭＣＰＵから上記
主装置データ送受信回路ＭＤＴＲを介して、全電話装置
１〜置ｎに電話機選択信号をデータとして送出し、電
話機マイクロプロセッサＴＣＰＵは初期に設定しである
電話機番号設定スイッチＴＮＳＷの設定値と上記主装置
マイクロプロセッサＭＣＰＵより送出された電話機選択
信号を照合し一致した電話機マイクロプロセッサＴＣＰ
Ｕが、上記主装置データ送受信回路ＭＤＴＲと電話機デ
ータ送受信回路ＴＤＴＲを介して上記主装置マイクロプ
ロセッサＭＣＰＵとデータの交信を行う方式である。
対して、電話装置 ｌ 〜置ｎをいわゆるマルチ状に配
置し、主装置部に１つの主装置データ送受信回路ＭＤＴ
Ｒを設け、主装置マイクロプロセッサＭＣＰＵから上記
主装置データ送受信回路ＭＤＴＲを介して、全電話装置
１〜置ｎに電話機選択信号をデータとして送出し、電
話機マイクロプロセッサＴＣＰＵは初期に設定しである
電話機番号設定スイッチＴＮＳＷの設定値と上記主装置
マイクロプロセッサＭＣＰＵより送出された電話機選択
信号を照合し一致した電話機マイクロプロセッサＴＣＰ
Ｕが、上記主装置データ送受信回路ＭＤＴＲと電話機デ
ータ送受信回路ＴＤＴＲを介して上記主装置マイクロプ
ロセッサＭＣＰＵとデータの交信を行う方式である。
（従来方式の欠点）
前記第１の方式は主装置に電話機台数分の主装置データ
送受信回路が必要であシ経済的に不利である。
送受信回路が必要であシ経済的に不利である。
また、前記第２の方式は、主装置データ送受信回路は１
つになるが、すべての電話機に電話機番号設定スイッチ
等が必要で不経済である上、電話機マイクロプロセッサ
に於いて、毎回主装置よシ送出される電話機選択信号の
受信、照合を行う必要がちシミ詰機台数が増えた場合、
そのだめのデータ処理量が膨大となｐ他のデータの処理
効率が著しく低下する等の問題があった。
つになるが、すべての電話機に電話機番号設定スイッチ
等が必要で不経済である上、電話機マイクロプロセッサ
に於いて、毎回主装置よシ送出される電話機選択信号の
受信、照合を行う必要がちシミ詰機台数が増えた場合、
そのだめのデータ処理量が膨大となｐ他のデータの処理
効率が著しく低下する等の問題があった。
本発明は、以上に述べた従来の問題点′を解決すべく成
されたもので、主装置のデータ送受信回路を１つにし、
かつ電話機において番号設定を不要とすることができる
データ伝送制御方式を得ることを目的とする。
されたもので、主装置のデータ送受信回路を１つにし、
かつ電話機において番号設定を不要とすることができる
データ伝送制御方式を得ることを目的とする。
この目的を達成するために、本発明では、主装置と電話
機間で行われる制御データの交信は時分割で行なわれ、
電話機台数に係わらず必ず１台の電話機と主装置間で行
われている（１つのタイムスロットに於いて主装置と複
数の電話機間で制御データが同時に交信されることはな
い。）ことに着目して、主装置のデータ送受信回路と、
すべての電話機のデータ送受信回路間に切替ダートを設
は制御データの交信を行なおうとする電話機に対応する
上記切替ダートを順次閉成する事によシ、すべての電話
機と主装置とのデータ交信を行う様にした。
機間で行われる制御データの交信は時分割で行なわれ、
電話機台数に係わらず必ず１台の電話機と主装置間で行
われている（１つのタイムスロットに於いて主装置と複
数の電話機間で制御データが同時に交信されることはな
い。）ことに着目して、主装置のデータ送受信回路と、
すべての電話機のデータ送受信回路間に切替ダートを設
は制御データの交信を行なおうとする電話機に対応する
上記切替ダートを順次閉成する事によシ、すべての電話
機と主装置とのデータ交信を行う様にした。
（実施例の説明）
以下、第３図及び第４図によシ本発明の詳細な説明する
。第３図は本発明の実施例の回路構成を示すブロック図
、第４図は実施例の動作説明図である。第３図において
、ＭＥは主装置、置 １〜置ｎはそれぞれ電話機、Ｋ１
＋ Ｋ １１〜ＫＱ ｒ Ｋｎｎは主装置部と電話後
置 、 −置ｎとを接続するケーブル、ＭＰＯＷは電話
後置 Ｋ直流電源を供給する主装置電源回路、ＴＰＯＷ
は主装置電源回路ＭＰＯＷよシケーブルＫ １ ＋ Ｋ
１ｔ 〜Ｋｎ ｒ Ｋｎｎを通して、供給される電源
を電話後置 、〜置、、内で使用する電圧に変換する電
話機電源変換回路、ＭＣＨＩ〜ＭｃＨｎ及びＴＣＨはイ
ンダクタンス等によって直流インピーダンスが低く、交
流インピーダンスが高くなるように設定され、主装置Ｍ
Ｅから各電話後置 、〜置ｎＫ電源供給を行うも、デー
タパルスを減衰させないでケーブルＫＩ ＋ Ｋ ｌ□
〜ＫｎｌＫｎｎに供給できる様に構成したインピーダン
ス回路、ＭＣＰＵはストアードプログラムで動作する主
装置マイクロプロセッサ、ＴＣＰＵはストアードプログ
ラムで動作する電話機マイクロプロセッサ、ＭＤＴは主
装置マイクロプロセッサＭＣＰＵよ多制御される電話機
計装置ｎへのデータパルス送信回路、ＭＤＲは電話後置
１〜置ｎからのデータパルスを受信し、主装置マイク
ロプロセッサＭＣＰＵに入力するデータパルス受信回路
、ＴＤＴは電話機マイクロプロセッサＴＣＰＵよ多制御
される主装置部へのデータ・やルス送信回路、ＴＤＲは
主装置部からのデータパルスを受信し、電話機マイクロ
プロセッサＴＣＰＵに入力するデータパルス受信回路、
ＭＰＴ及びＴＰＴは、例えばパルストランスで構成され
、主装置部及び電話後置 、 〜置ｎのデータパルス送
信回路ＭＤＴ 、 ＴＤＴとデータ・やルス受信回路Ｍ
ＤＲ、ＴＤＲとの間で授受されるデータノぐルスをケー
ブルＫｌ ＋ Ｋｌｌ〜Ｋｎ・Ｋｎｎに中継するための
データ・やルス中継回路、ＭＣＩ 。
。第３図は本発明の実施例の回路構成を示すブロック図
、第４図は実施例の動作説明図である。第３図において
、ＭＥは主装置、置 １〜置ｎはそれぞれ電話機、Ｋ１
＋ Ｋ １１〜ＫＱ ｒ Ｋｎｎは主装置部と電話後
置 、 −置ｎとを接続するケーブル、ＭＰＯＷは電話
後置 Ｋ直流電源を供給する主装置電源回路、ＴＰＯＷ
は主装置電源回路ＭＰＯＷよシケーブルＫ １ ＋ Ｋ
１ｔ 〜Ｋｎ ｒ Ｋｎｎを通して、供給される電源
を電話後置 、〜置、、内で使用する電圧に変換する電
話機電源変換回路、ＭＣＨＩ〜ＭｃＨｎ及びＴＣＨはイ
ンダクタンス等によって直流インピーダンスが低く、交
流インピーダンスが高くなるように設定され、主装置Ｍ
Ｅから各電話後置 、〜置ｎＫ電源供給を行うも、デー
タパルスを減衰させないでケーブルＫＩ ＋ Ｋ ｌ□
〜ＫｎｌＫｎｎに供給できる様に構成したインピーダン
ス回路、ＭＣＰＵはストアードプログラムで動作する主
装置マイクロプロセッサ、ＴＣＰＵはストアードプログ
ラムで動作する電話機マイクロプロセッサ、ＭＤＴは主
装置マイクロプロセッサＭＣＰＵよ多制御される電話機
計装置ｎへのデータパルス送信回路、ＭＤＲは電話後置
１〜置ｎからのデータパルスを受信し、主装置マイク
ロプロセッサＭＣＰＵに入力するデータパルス受信回路
、ＴＤＴは電話機マイクロプロセッサＴＣＰＵよ多制御
される主装置部へのデータ・やルス送信回路、ＴＤＲは
主装置部からのデータパルスを受信し、電話機マイクロ
プロセッサＴＣＰＵに入力するデータパルス受信回路、
ＭＰＴ及びＴＰＴは、例えばパルストランスで構成され
、主装置部及び電話後置 、 〜置ｎのデータパルス送
信回路ＭＤＴ 、 ＴＤＴとデータ・やルス受信回路Ｍ
ＤＲ、ＴＤＲとの間で授受されるデータノぐルスをケー
ブルＫｌ ＋ Ｋｌｌ〜Ｋｎ・Ｋｎｎに中継するための
データ・やルス中継回路、ＭＣＩ 。
ＭＣ２、ＴＣＩ 、 Ｔｅ３はデータパルス中継回路Ｍ
ＰＴ 。
ＰＴ 。
ＴＰＴに、不要な直流電流が流入するのを防止し、デー
タパルスのみを通過させるだめの直流阻止コンデンサ、
ＰＨ１ｒ ＰＨ１１〜ＰＨｎｒ ＰＨＩｎは例えばフォ
トカプラで構成され、主装置部のパルス中継回路ＭＰＴ
と各電話後置 ｌ〜置ｎに対応するケープ／ｌ／ＫＩＩ
ＫＩ□〜ＫＨｒ Ｋｎｎ間を主装置マイクロプロセッサ
ＭＣＰＵによシ接続し、あるいは切断する時制御される
データパルスゲート回路、Ｓ！〜Ｓｎは上記データパル
スダート回路ＰＨ１、ＰＨ１１〜ＰＨｎｒＰＨｎｎを駆
動する主装置マイクロプロセッサＭＣＰＵからの制御線
、Ｒ１、Ｒ２はデータパルスゲート回路ＰＨ１＋ ＰＨ
１１”’−ＰＨＨ＋ ＰＨＨＩを駆動するだめの直流電
流制限用抵抗と直流回路形成用抵抗である。
タパルスのみを通過させるだめの直流阻止コンデンサ、
ＰＨ１ｒ ＰＨ１１〜ＰＨｎｒ ＰＨＩｎは例えばフォ
トカプラで構成され、主装置部のパルス中継回路ＭＰＴ
と各電話後置 ｌ〜置ｎに対応するケープ／ｌ／ＫＩＩ
ＫＩ□〜ＫＨｒ Ｋｎｎ間を主装置マイクロプロセッサ
ＭＣＰＵによシ接続し、あるいは切断する時制御される
データパルスゲート回路、Ｓ！〜Ｓｎは上記データパル
スダート回路ＰＨ１、ＰＨ１１〜ＰＨｎｒＰＨｎｎを駆
動する主装置マイクロプロセッサＭＣＰＵからの制御線
、Ｒ１、Ｒ２はデータパルスゲート回路ＰＨ１＋ ＰＨ
１１”’−ＰＨＨ＋ ＰＨＨＩを駆動するだめの直流電
流制限用抵抗と直流回路形成用抵抗である。
（１）平常状態の動作
平常状態では主装置マイクロプロセッサ八１ＣＰＵカラ
のデータパルスゲート回路ＰＨ１＋ ＰＨ１ｌ〜ＰＨｎ
ｒ ＰＨｎｎへの制御線Ｓ□〜Ｓｎはすべてハイレベル
（Ｈ）にあり、データノぐルスダート回路ＰＨ１。
のデータパルスゲート回路ＰＨ１＋ ＰＨ１ｌ〜ＰＨｎ
ｒ ＰＨｎｎへの制御線Ｓ□〜Ｓｎはすべてハイレベル
（Ｈ）にあり、データノぐルスダート回路ＰＨ１。
ＰＨ１，−ＰＨｎ、 ＰＨｎｎのフォトダイオード（発
光側素子）は発光状態になく、対応する各々のフォトト
ランジスタ（受光側素子）はオフとなっている。
光側素子）は発光状態になく、対応する各々のフォトト
ランジスタ（受光側素子）はオフとなっている。
従ってこの状態では、主装置ＭＥのデータパルス中継回
路ＭＰＴは、いずれの電話後置、 −置ｎのデータフ４
ルス中継回路ＴＰＴとも接続されていない。
路ＭＰＴは、いずれの電話後置、 −置ｎのデータフ４
ルス中継回路ＴＰＴとも接続されていない。
すなわち制御データの交信を主装置ＭＥ、電話機様装
１〜置ｎ間で行わない状態でアわ、この間はクロプロセ
ッサＴ ＣＰＵは各々独自にできる処理を行う。なお、
電話後置、 −置ｎへの電源供給はデータパルスダート
回路ＰＨ１ｒ ＰＨ１１〜ＰＨｎ＊ ＰＨｎｌのいかな
る状態においても、常時主装置電源回路ＭＰＯＷから主
装置インピーダンス回路ＭＣ）ｆ、〜ＭＣ）Ｉｎ％クー
グルに１ ｒ Ｋ ３１ ” Ｋｎｎ及び各電話機イン
ピーダンス回路ＴＣＨを介して電話機電源変換回路ＴＰ
ＯＷに給電される。
１〜置ｎ間で行わない状態でアわ、この間はクロプロセ
ッサＴ ＣＰＵは各々独自にできる処理を行う。なお、
電話後置、 −置ｎへの電源供給はデータパルスダート
回路ＰＨ１ｒ ＰＨ１１〜ＰＨｎ＊ ＰＨｎｌのいかな
る状態においても、常時主装置電源回路ＭＰＯＷから主
装置インピーダンス回路ＭＣ）ｆ、〜ＭＣ）Ｉｎ％クー
グルに１ ｒ Ｋ ３１ ” Ｋｎｎ及び各電話機イン
ピーダンス回路ＴＣＨを介して電話機電源変換回路ＴＰ
ＯＷに給電される。
（２）主装置風と電話後置 １ との間のデータ交信時
の動作 電話後置 夏 とのデータ交信の準備が完了すると、電
話後置 ｌ と主装置ＭＥとの間のデータ交信のために
設定されたタイムスロットｔｔａで主装置マイクロプロ
セッサＭＣＰＵが制御線Ｓ、をローレベル（Ｌ）とし、
■−電流制限抵抗Ｒ１−ＰＨＨ及びＰＨ。
の動作 電話後置 夏 とのデータ交信の準備が完了すると、電
話後置 ｌ と主装置ＭＥとの間のデータ交信のために
設定されたタイムスロットｔｔａで主装置マイクロプロ
セッサＭＣＰＵが制御線Ｓ、をローレベル（Ｌ）とし、
■−電流制限抵抗Ｒ１−ＰＨＨ及びＰＨ。
のフォトダイオード−制御線ｓ１−主装置マイクロプロ
セッサＭＣＰＵ （○）のルートでデータパルスダート
回路ＰＨＩＩＰＨＩＩのフォトダイオードが発光し、各
々の７オトトンンジスタをオンさせる。
セッサＭＣＰＵ （○）のルートでデータパルスダート
回路ＰＨＩＩＰＨＩＩのフォトダイオードが発光し、各
々の７オトトンンジスタをオンさせる。
このため主装置データパルス中継回路ＭＰＴはケーブル
に１ ＋ Ｋｌｌを介して電話後置 ｌのデータパルス
中継回路ＴＰＴと接続される。この状態で、主装置マイ
クロプロセッサＭＣＰＵからの送信パルスは主装置マイ
クロプロセッサＭＣＰＵ−主装置データパルス送信回路
ＭＤＴ−主装置データパルス中継回路■可−コンデンサ
ＭＣＩ 、 ＭＣ２−ｆ −タパルスｒ −ト回路ＰＨ
＋ ｒ ＰＨＨのフォトトランジスターケーブルＫｌ
＋ Ｋ１１−コンデンサＴＣＩ、ＴＣ２−電話機データ
ノ４ルス中継回路ＴＰＴ−電話機データパルス受信回路
ＴＤＲ−電話機マイクロプロセッサＴＣＰＵのルートで
電話機マイクロプロセッサＴＣＰＵに伝送される。
に１ ＋ Ｋｌｌを介して電話後置 ｌのデータパルス
中継回路ＴＰＴと接続される。この状態で、主装置マイ
クロプロセッサＭＣＰＵからの送信パルスは主装置マイ
クロプロセッサＭＣＰＵ−主装置データパルス送信回路
ＭＤＴ−主装置データパルス中継回路■可−コンデンサ
ＭＣＩ 、 ＭＣ２−ｆ −タパルスｒ −ト回路ＰＨ
＋ ｒ ＰＨＨのフォトトランジスターケーブルＫｌ
＋ Ｋ１１−コンデンサＴＣＩ、ＴＣ２−電話機データ
ノ４ルス中継回路ＴＰＴ−電話機データパルス受信回路
ＴＤＲ−電話機マイクロプロセッサＴＣＰＵのルートで
電話機マイクロプロセッサＴＣＰＵに伝送される。
一方、電話機マイクロプロセッサＴＣＰＵからの送信パ
ルスは電話機マイクロプロセッサＴＣＰＵ−電話機デー
タパルス送信回路ＴＤＴ−電話機データ・やルス中継回
路ＴＰＴ−コンデンサＴＣＩ、Ｔｅ３−ケーブルＫｌ
＋ ＫＩＩ−データパルスゲート回路ＰＨ，。
ルスは電話機マイクロプロセッサＴＣＰＵ−電話機デー
タパルス送信回路ＴＤＴ−電話機データ・やルス中継回
路ＴＰＴ−コンデンサＴＣＩ、Ｔｅ３−ケーブルＫｌ
＋ ＫＩＩ−データパルスゲート回路ＰＨ，。
ＰＨＨフォトトランジスターコンデンサＭｅ １ 、
ＭＣ２−主装置データ・ぐルス中継回路ＭＰＴ−主装置
データパルス受信回路ＭＤＲ−主装置マイクロプロセッ
サ−ＭＣＰＵのルートで主装置マイクロプロセッサＭＣ
ＰＵに伝送される。
ＭＣ２−主装置データ・ぐルス中継回路ＭＰＴ−主装置
データパルス受信回路ＭＤＲ−主装置マイクロプロセッ
サ−ＭＣＰＵのルートで主装置マイクロプロセッサＭＣ
ＰＵに伝送される。
なお、この間上記データノやルスグート回路ＰＨ。
及びＰＨ１ｌ以外のデータパルスゲート回路Ｐｌ（、。
ＰＨ２２〜ＰＩ（ｙｌ ＋ ＰＨｎＨはすべてオフであ
シ、上記主装置風と電話後置 、との間の交信データが
他の電話後置 ２〜置ｎに混入することは無い。
シ、上記主装置風と電話後置 、との間の交信データが
他の電話後置 ２〜置ｎに混入することは無い。
（３）主装置風と電話後置 、との間のデータ交信後の
動作 主装置１＆ｆｆＥと電話後置 ｌ との間のデータ交信
が所定のタイムスロットｔｌ＆で終了すると主装置マイ
クロプロセッサＭＣＰＵは制御ｍｓ＋をハイレベル（４
（）とし、主装置ＭＥ、電話機様装 １間の前記データ
交信ルートを切断する一方、前記データ交信で得られた
制御ｒ−夕によりデータ処理のため電話後置 、に設定
されたタイムスロットｔｌｂで必要な処理を行った後、
次の電話後置 ２ とのデータ交信の準備を行う。また
上記電話後置 、に於いても、電話機マイクロプロセッ
サＴＣＰＵが前記：ｙ”−夕交信によシ得られた制御デ
ータで次回のデータ交信時までの間、すなわち上記タイ
ムスロットｔ１ｂで必要な処理を進める。
動作 主装置１＆ｆｆＥと電話後置 ｌ との間のデータ交信
が所定のタイムスロットｔｌ＆で終了すると主装置マイ
クロプロセッサＭＣＰＵは制御ｍｓ＋をハイレベル（４
（）とし、主装置ＭＥ、電話機様装 １間の前記データ
交信ルートを切断する一方、前記データ交信で得られた
制御ｒ−夕によりデータ処理のため電話後置 、に設定
されたタイムスロットｔｌｂで必要な処理を行った後、
次の電話後置 ２ とのデータ交信の準備を行う。また
上記電話後置 、に於いても、電話機マイクロプロセッ
サＴＣＰＵが前記：ｙ”−夕交信によシ得られた制御デ
ータで次回のデータ交信時までの間、すなわち上記タイ
ムスロットｔ１ｂで必要な処理を進める。
（４） 主装置部と電話装置 ２〜置ｎとの間のデータ
交信時の動作 主装置マイクロプロセッサＭＣＰＵが電話装置 ２との
データ交信準備を完了すると、電話装置 ２と主装置Ｍ
Ｅとの間のデータ交信のために設定されたタイムスロッ
）ｔ２ａで制御線Ｓ２をローレベル（Ｌ）とし、前記電
話装置 ｌ と主装置部との間のデータ交信動作と同様
の方法でデータパルスゲート回路ＰＨ２＋ ＰＨ２２の
フォトトランジスタをオンさせ、電話装置 ２ と主装
置ＭＥとの間のデータ交信を行う。
交信時の動作 主装置マイクロプロセッサＭＣＰＵが電話装置 ２との
データ交信準備を完了すると、電話装置 ２と主装置Ｍ
Ｅとの間のデータ交信のために設定されたタイムスロッ
）ｔ２ａで制御線Ｓ２をローレベル（Ｌ）とし、前記電
話装置 ｌ と主装置部との間のデータ交信動作と同様
の方法でデータパルスゲート回路ＰＨ２＋ ＰＨ２２の
フォトトランジスタをオンさせ、電話装置 ２ と主装
置ＭＥとの間のデータ交信を行う。
以上の動作を電話装置 ３〜置ｎについて順次繰シ返す
ことによシ、主装置ＭＥと全電話装置 。
ことによシ、主装置ＭＥと全電話装置 。
〜置ｎとの間のデータ交信が一巡する。この後、タイム
スロットは再び電話装置 、に戻υ、以降以上の動作が
全電話装置 ｌ−置ｎについてサイクリックに行なわれ
る。
スロットは再び電話装置 、に戻υ、以降以上の動作が
全電話装置 ｌ−置ｎについてサイクリックに行なわれ
る。
（５） 主装置部と電話装置 ２〜置ｎとの閘のデータ
交信後の動作 電話装置 ２〜置ｎと主装置部間のデータ交信がタイム
スロッ） ｔｚａ〜ｔｎａでそれぞれ終了すると、各電
話装置 、〜置ｎ及び主装置部に於いて当該タイムスロ
ットｔ ２ａ％ｔ□に続くタイムスロッ）ｔ２ｂ−ｊｎ
ｂで必要な処理が前記（２）項と同様にして行なわれる
。
交信後の動作 電話装置 ２〜置ｎと主装置部間のデータ交信がタイム
スロッ） ｔｚａ〜ｔｎａでそれぞれ終了すると、各電
話装置 、〜置ｎ及び主装置部に於いて当該タイムスロ
ットｔ ２ａ％ｔ□に続くタイムスロッ）ｔ２ｂ−ｊｎ
ｂで必要な処理が前記（２）項と同様にして行なわれる
。
以上の実施例においては、データパルスゲート回路にフ
ォトカプラを使用した場合を述べたが他のスイッチ素子
によっても容易に構成し得る。
ォトカプラを使用した場合を述べたが他のスイッチ素子
によっても容易に構成し得る。
以上詳細に説明したように本発明は主装置データ送受信
回路（主装置データパルス送信回路ＭＤＴ。
回路（主装置データパルス送信回路ＭＤＴ。
主装置データパルス受信回路ＭＤＲ及び主装置パルス中
継回路ＭＰＴを指す。）と電話機データ送受信回路（電
話機データパルス送信回路ＴＤＴ 、電話機データパル
ス受信回路ＴＤＲ及び電話機パルス中継回路ＴＰＴを指
す。）の間に各電話機に対応し、電話機選択毎に動作す
るデータパルスゲート回路を設けることによって成され
たものであシ主装置データ送受信回路は主装置に１つ設
けるだけで制御データの伝送制御が実現でき電話機にお
いては、電話機番号設定スイッチが不要となる。
継回路ＭＰＴを指す。）と電話機データ送受信回路（電
話機データパルス送信回路ＴＤＴ 、電話機データパル
ス受信回路ＴＤＲ及び電話機パルス中継回路ＴＰＴを指
す。）の間に各電話機に対応し、電話機選択毎に動作す
るデータパルスゲート回路を設けることによって成され
たものであシ主装置データ送受信回路は主装置に１つ設
けるだけで制御データの伝送制御が実現でき電話機にお
いては、電話機番号設定スイッチが不要となる。
また、データパルスゲート回路はフォトカプラ等で容易
に構成でき回路構成が極めて安価にできる等、本発明は
極めて大きな効果を有するものである。
に構成でき回路構成が極めて安価にできる等、本発明は
極めて大きな効果を有するものである。
また、以上に説明した実施例は、本発明ラブタン電話装
置に実施した例であるが、本発明は通話機能以外の機能
を有し、各種のデータの授受が行なわれる電話装置に実
施可能である。このようなものとして、例えば構内交換
機（広い意味で、構内交換機も主装置である。）に収容
される機能ボタン付内線電話機等がある。
置に実施した例であるが、本発明は通話機能以外の機能
を有し、各種のデータの授受が行なわれる電話装置に実
施可能である。このようなものとして、例えば構内交換
機（広い意味で、構内交換機も主装置である。）に収容
される機能ボタン付内線電話機等がある。
第１図及び第２図は従来例を示すブロック図、第３図は
本発明の実施例の具体的な回路構成のブロック図、第４
図は本発明の実施例の動作説明図である。 （主な記号） ＭＣＰＵ・・・主装置マイクロプロセッサ、ＴＣＰＵ・
・・電話機マイクロ２プロセツサ、ＭＰＯＷ・・・主装
置電源回路、 ＴＰＯＷ・・・電話機電源変換回路、 ＭＣＨ１〜ＭＣＨｎ・・・主装置インピーダンス回路、
ＴＣＨ・・・電話機インピーダンス回路、ＭＤＴ・・・
主装置データｌ？）レス送信回路、ＭＤＲ・・・主装置
データＡルス受信回路、ＴＤＴ・・・電話機データフ４
ルス送信回路、ＴＤＲ・・・電話機デージノ９ルス受信
回路、ＭＰＴ・・・主装置・やルス中継回路、ＴＰＴ・
・・電話機パルス中継回路、 ＰＨＩ Ｉ ＰＨ４１〜ＰＨｎ＋ ＰＨｎｌ ”’デー
タパルスゲート回路。 手続補正書 昭和、タワ年７月／と日 特許庁長官志賀 学 殿 １ 事件の表示 ′１発明・名称 斤・シ硯雀しキ１１り胛勿祝３、補正
をする者 ４ｊ＋：件との関係 出 願 人 ４、代〕１人 住 所 東京都千代ｔＩ１区丸の内２丁目６番２号九の
内へ重ｄ１１ビル３３０１」− 補 正 書 本願明細書中下記事項を補正いたします。 記 １、第８頁７行目に 「ケーブルＫｌ ｌ ’Ｋｌｌ 〜Ｋｎｎ Ｊとらるを
［ケーブルに１ ＋ Ｋ１１〜Ｋｎ ｒ Ｋｎ、ｎ Ｊ
と訂正する。 ２、第９貞下から２行目に ｒＰＨｕフオトトラシジスター」とあるをｒＰＨｌｌの
フォトトランジスター」と訂正する。 ３、第１２頁７行目に 「前記（２）項−ｌとあるを 「前記（３）項」と訂正する。
本発明の実施例の具体的な回路構成のブロック図、第４
図は本発明の実施例の動作説明図である。 （主な記号） ＭＣＰＵ・・・主装置マイクロプロセッサ、ＴＣＰＵ・
・・電話機マイクロ２プロセツサ、ＭＰＯＷ・・・主装
置電源回路、 ＴＰＯＷ・・・電話機電源変換回路、 ＭＣＨ１〜ＭＣＨｎ・・・主装置インピーダンス回路、
ＴＣＨ・・・電話機インピーダンス回路、ＭＤＴ・・・
主装置データｌ？）レス送信回路、ＭＤＲ・・・主装置
データＡルス受信回路、ＴＤＴ・・・電話機データフ４
ルス送信回路、ＴＤＲ・・・電話機デージノ９ルス受信
回路、ＭＰＴ・・・主装置・やルス中継回路、ＴＰＴ・
・・電話機パルス中継回路、 ＰＨＩ Ｉ ＰＨ４１〜ＰＨｎ＋ ＰＨｎｌ ”’デー
タパルスゲート回路。 手続補正書 昭和、タワ年７月／と日 特許庁長官志賀 学 殿 １ 事件の表示 ′１発明・名称 斤・シ硯雀しキ１１り胛勿祝３、補正
をする者 ４ｊ＋：件との関係 出 願 人 ４、代〕１人 住 所 東京都千代ｔＩ１区丸の内２丁目６番２号九の
内へ重ｄ１１ビル３３０１」− 補 正 書 本願明細書中下記事項を補正いたします。 記 １、第８頁７行目に 「ケーブルＫｌ ｌ ’Ｋｌｌ 〜Ｋｎｎ Ｊとらるを
［ケーブルに１ ＋ Ｋ１１〜Ｋｎ ｒ Ｋｎ、ｎ Ｊ
と訂正する。 ２、第９貞下から２行目に ｒＰＨｕフオトトラシジスター」とあるをｒＰＨｌｌの
フォトトランジスター」と訂正する。 ３、第１２頁７行目に 「前記（２）項−ｌとあるを 「前記（３）項」と訂正する。
Claims (1)
- 主装置に複数の電話機を接続し、主装置と電話機とがそ
れらの間のデータの交信にょｐ制御される電話装置にお
いて、主装置及び電話機に各々１つのデータ送受信回路
を設けるとともに、主装置に電話機台数分のデータ切替
ダートをおき、上記主装置のデータ送受信回路と上記電
話機のデータ送受信回路とを上記データ切替ダートで結
合することによシ主装置と各電話機との間で順次データ
の交信を行うようにしたことを特徴とするデータ伝送制
御方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP14070883A JPS6031395A (ja) | 1983-08-01 | 1983-08-01 | デ−タ伝送制御方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP14070883A JPS6031395A (ja) | 1983-08-01 | 1983-08-01 | デ−タ伝送制御方式 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6031395A true JPS6031395A (ja) | 1985-02-18 |
Family
ID=15274871
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP14070883A Pending JPS6031395A (ja) | 1983-08-01 | 1983-08-01 | デ−タ伝送制御方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6031395A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH028275U (ja) * | 1988-06-30 | 1990-01-19 | ||
| US4972407A (en) * | 1988-10-03 | 1990-11-20 | Fujitsu Limited | Time-division switching circuit transforming data formats |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS4990953A (ja) * | 1972-12-28 | 1974-08-30 |
-
1983
- 1983-08-01 JP JP14070883A patent/JPS6031395A/ja active Pending
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS4990953A (ja) * | 1972-12-28 | 1974-08-30 |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH028275U (ja) * | 1988-06-30 | 1990-01-19 | ||
| US4972407A (en) * | 1988-10-03 | 1990-11-20 | Fujitsu Limited | Time-division switching circuit transforming data formats |
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