JPS60254280A - 画像処理装置 - Google Patents
画像処理装置Info
- Publication number
- JPS60254280A JPS60254280A JP59109957A JP10995784A JPS60254280A JP S60254280 A JPS60254280 A JP S60254280A JP 59109957 A JP59109957 A JP 59109957A JP 10995784 A JP10995784 A JP 10995784A JP S60254280 A JPS60254280 A JP S60254280A
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- JP
- Japan
- Prior art keywords
- data
- memory
- address
- circuit
- image processing
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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Classifications
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06T—IMAGE DATA PROCESSING OR GENERATION, IN GENERAL
- G06T9/00—Image coding
Landscapes
- Engineering & Computer Science (AREA)
- Multimedia (AREA)
- Physics & Mathematics (AREA)
- General Physics & Mathematics (AREA)
- Theoretical Computer Science (AREA)
- Image Processing (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
（ａ）発明の技術分野
本発明は中央処理装置（ＣＰＵ）より転送されてきた圧
縮画像データを能率的に画像処理が行えるようにした画
像処理装置に関する０ （ｂ）従来技術と問題点 従来より中央処理装［（ＣＰＵ）と画像処理装置の間で
圧縮画像データを処理する場合、ＣＰＵで圧縮画像デー
タを伸長し原画データとして画像処理装置に転送する方
式や、ＣＰＵの圧縮画像データをそのま〜の形で画像処
理装置に受け１画像処理装置側で伸長する２つの方式が
あるＯ前者は一般にＣＰＵが画像データを原画像に伸長
する特別な専用ハードを持たず、ソフトウェアにより行
われている◎そのためＣＰＵに負担がか振るとともに、
原画像という大量のデータ転送をしなければならず時間
的にも、能率的にもよくない０また後者はＣＰＵの圧縮
画像データを受取りながら伸長してメモリに格納する方
法とか、一旦メモリに圧縮画像データを格納した上、再
びその格納した圧縮画像データを読み出して伸長を行う
方法がある。ＣＰＵから送られてくる圧縮画像データの
データ長は可変長でかつ短かいが、画像処理装置側で伸
長するデータ長は一定長でかつ長いため１時間的変動が
ある。その伸長動作における時間的変動をインタフェー
スで吸収するためには問題があったり、又実際に画像処
理したい部分がＣＰＵから送られた圧縮画像データの一
部の限られた領域であっても、全て伸長しなければなら
ず時間的にも、メモリの資源にも無駄が生じる等の問題
がある。
縮画像データを能率的に画像処理が行えるようにした画
像処理装置に関する０ （ｂ）従来技術と問題点 従来より中央処理装［（ＣＰＵ）と画像処理装置の間で
圧縮画像データを処理する場合、ＣＰＵで圧縮画像デー
タを伸長し原画データとして画像処理装置に転送する方
式や、ＣＰＵの圧縮画像データをそのま〜の形で画像処
理装置に受け１画像処理装置側で伸長する２つの方式が
あるＯ前者は一般にＣＰＵが画像データを原画像に伸長
する特別な専用ハードを持たず、ソフトウェアにより行
われている◎そのためＣＰＵに負担がか振るとともに、
原画像という大量のデータ転送をしなければならず時間
的にも、能率的にもよくない０また後者はＣＰＵの圧縮
画像データを受取りながら伸長してメモリに格納する方
法とか、一旦メモリに圧縮画像データを格納した上、再
びその格納した圧縮画像データを読み出して伸長を行う
方法がある。ＣＰＵから送られてくる圧縮画像データの
データ長は可変長でかつ短かいが、画像処理装置側で伸
長するデータ長は一定長でかつ長いため１時間的変動が
ある。その伸長動作における時間的変動をインタフェー
スで吸収するためには問題があったり、又実際に画像処
理したい部分がＣＰＵから送られた圧縮画像データの一
部の限られた領域であっても、全て伸長しなければなら
ず時間的にも、メモリの資源にも無駄が生じる等の問題
がある。
（ｃ）発明の目的
本発明の目的はＣＰＵからの転送データを圧縮データと
してＣＰＵとのインタフェースの負担を少くするととも
に、画像処理装置側ではメモリが小さい容量ですむよう
に圧縮データのま〜メモリに格納し、さらに各スキャン
の先頭データを格納したアドレスを保持するテーブルを
作ることにより必要な部分の画像だけを伸長することで
能率的な画像処理が行えるようにした画像処理装置を提
供することにある。
してＣＰＵとのインタフェースの負担を少くするととも
に、画像処理装置側ではメモリが小さい容量ですむよう
に圧縮データのま〜メモリに格納し、さらに各スキャン
の先頭データを格納したアドレスを保持するテーブルを
作ることにより必要な部分の画像だけを伸長することで
能率的な画像処理が行えるようにした画像処理装置を提
供することにある。
（ｄ） 発明の構成
そしてこの目的は本発明によれば、中央処理装置に接続
されたインタフェース回路とメモリアドレス制御回路と
メモリと画像処理ユニッ１ｍする画像処理装置において
、前記中央処理装置より転送される圧縮画像データの伸
長を行わずに、前記メモリに格納するとともに、該圧縮
画像データのライン区切り信号を検出する検出回路と該
検出回路により検出されたラインの区切り記号のアドレ
スに対応した前記メモリへの格納アドレスを示すアドレ
ステーブルと該アドレステーブルの画像処理を行いたい
部分のテーブルアドレスより前記メモリのデータを引き
出し伸長する伸長回路とを備え、該伸長回路の原画像デ
ータを前記画像処理ユニ、トに出力することを特徴とす
る画像処理装置を提供することを特徴とする画像処理装
置を提供することにより達成する。
されたインタフェース回路とメモリアドレス制御回路と
メモリと画像処理ユニッ１ｍする画像処理装置において
、前記中央処理装置より転送される圧縮画像データの伸
長を行わずに、前記メモリに格納するとともに、該圧縮
画像データのライン区切り信号を検出する検出回路と該
検出回路により検出されたラインの区切り記号のアドレ
スに対応した前記メモリへの格納アドレスを示すアドレ
ステーブルと該アドレステーブルの画像処理を行いたい
部分のテーブルアドレスより前記メモリのデータを引き
出し伸長する伸長回路とを備え、該伸長回路の原画像デ
ータを前記画像処理ユニ、トに出力することを特徴とす
る画像処理装置を提供することを特徴とする画像処理装
置を提供することにより達成する。
（ｅ） 発明の実施例
以下本発明の実施例を図面により詳述する。
最近中央処理装置（ＣＰＵ）への画像入力装置としてフ
ァクシミリの利用が多くなってきており。
ァクシミリの利用が多くなってきており。
３−
その結果画像データはＭＨ圧縮方式等に基づいた圧縮デ
ータとなっていて、ＣＰＵはこの圧縮データを取り扱つ
様になっている。しかし画像に対する加工が、例えば紙
面に書かれた画像の移動、枠組、縮小、拡大等のように
複雑になると、その処理はソフトウェアでなく専用ハー
ドで行う方法がとられる・本発明ではその専用ハードと
なっている画像処理装置において、圧縮データを取扱う
ことを可能とした。
ータとなっていて、ＣＰＵはこの圧縮データを取り扱つ
様になっている。しかし画像に対する加工が、例えば紙
面に書かれた画像の移動、枠組、縮小、拡大等のように
複雑になると、その処理はソフトウェアでなく専用ハー
ドで行う方法がとられる・本発明ではその専用ハードと
なっている画像処理装置において、圧縮データを取扱う
ことを可能とした。
第１図は本発明の画像処理装置の一実施例の構成図を示
す〇 図において、ｌはＣＰＵ、２は画像処理装置、３はイン
タフェース回路、４はメモリ、５はＥＯＬ判定回路、６
はテーブルアドレス制御回路、７はアドレステーブル、
８はメモリアドレス制御回路。
す〇 図において、ｌはＣＰＵ、２は画像処理装置、３はイン
タフェース回路、４はメモリ、５はＥＯＬ判定回路、６
はテーブルアドレス制御回路、７はアドレステーブル、
８はメモリアドレス制御回路。
９は伸長回路、１０は画像処理ユニットを示す０ＣＰＵ
Ｉより圧縮画像データが転送され１画像処理装置２はこ
のデータをインタフェース回路３を通して受け取り、メ
モリ４に順次書き込んでいく０これと共にインタフェー
ス回路３が受け取り４− た圧縮データはＥＯＬ判定回路５に送られる０画像デー
タは圧縮データで、第２図に示すようになっていて、１
スキヤン目のデータ量ａ、２スキャン目のデータ量す、
３スキヤン目のデータ量Ｃ１・・・・・・・・で、ライ
ンの先頭を示す区切り記号Ｐがある。この区切り記号Ｐ
のＥＯＬパターンを検出する検出回路としてＥＯＬ判定
回路５がある。ＥＯＬ判定回路５はラインの区切り記号
Ｐを検出すると。
Ｉより圧縮画像データが転送され１画像処理装置２はこ
のデータをインタフェース回路３を通して受け取り、メ
モリ４に順次書き込んでいく０これと共にインタフェー
ス回路３が受け取り４− た圧縮データはＥＯＬ判定回路５に送られる０画像デー
タは圧縮データで、第２図に示すようになっていて、１
スキヤン目のデータ量ａ、２スキャン目のデータ量す、
３スキヤン目のデータ量Ｃ１・・・・・・・・で、ライ
ンの先頭を示す区切り記号Ｐがある。この区切り記号Ｐ
のＥＯＬパターンを検出する検出回路としてＥＯＬ判定
回路５がある。ＥＯＬ判定回路５はラインの区切り記号
Ｐを検出すると。
間
テーブルアドレス制御回路６により第３−に示すような
アドレステーブル７に今回切り記号Ｐの１ｉ１ｉ０Ｌを
メモリ４に書いているアドレスを書き込んでいく。この
メモリ４のアドレスＡはメモリアドレス制御回路８によ
って発生されるものであり。
アドレステーブル７に今回切り記号Ｐの１ｉ１ｉ０Ｌを
メモリ４に書いているアドレスを書き込んでいく。この
メモリ４のアドレスＡはメモリアドレス制御回路８によ
って発生されるものであり。
又テーブルアドレス制御回路６はメモリをアクセスする
回路からの信号でテーブルアドレスＢを更新していくも
のである。
回路からの信号でテーブルアドレスＢを更新していくも
のである。
圧縮データをメモリ４に書き終えると、アドレステーブ
ル７には各ラインのデータの先頭を示すテーブルが作ら
れる。そして伸長回路９は画像処理を行いたい部分の先
頭データが入っているメモリアドレスＡをアドレステー
ブル７より取り出し、そのアドレスよりメモリ４のデー
タを伸長することで必要な部分だけの原画像を得るＯそ
してこの原画像を画像処理ユニット１０に送り、処理を
行いメモリに結果を書き込むことで、圧縮画像データに
対して必要なエリアだけの画像を伸長しているので、時
間的、メモリ資源的に能率のよい画像処理が可能となる
。
ル７には各ラインのデータの先頭を示すテーブルが作ら
れる。そして伸長回路９は画像処理を行いたい部分の先
頭データが入っているメモリアドレスＡをアドレステー
ブル７より取り出し、そのアドレスよりメモリ４のデー
タを伸長することで必要な部分だけの原画像を得るＯそ
してこの原画像を画像処理ユニット１０に送り、処理を
行いメモリに結果を書き込むことで、圧縮画像データに
対して必要なエリアだけの画像を伸長しているので、時
間的、メモリ資源的に能率のよい画像処理が可能となる
。
（ｆ） 発明の効果
以上詳細に説明したように、本発明の画像処理装置はＣ
ＰＵより転送される圧縮画像データを伸長を行わずにメ
モリに格納するとともに、ラインの区切り記号を検出し
て各ラインの先頭データを格納したアドレステーブルを
作り、このアドレステーブルより画像処理を行いたい部
分の先頭ラインを見つけ、必要な部分だけを原画像に伸
長し画像処理を行うことにより、従来の画像処理装置の
ｊ ように転送される大量の原画像データを扱うとか、
或いは転送された圧縮画像データを全て伸長するという
こともないので、画像処理装置側のインクフェースでの
転送データ盪が少なくてすみ、かつ必要な部分だけの原
画像への復元を行うのみで。
ＰＵより転送される圧縮画像データを伸長を行わずにメ
モリに格納するとともに、ラインの区切り記号を検出し
て各ラインの先頭データを格納したアドレステーブルを
作り、このアドレステーブルより画像処理を行いたい部
分の先頭ラインを見つけ、必要な部分だけを原画像に伸
長し画像処理を行うことにより、従来の画像処理装置の
ｊ ように転送される大量の原画像データを扱うとか、
或いは転送された圧縮画像データを全て伸長するという
こともないので、画像処理装置側のインクフェースでの
転送データ盪が少なくてすみ、かつ必要な部分だけの原
画像への復元を行うのみで。
能率的な画像処理が可能となる。
第１図は本発明の画像処理装置の一実施例の構成図、第
２図は圧縮画像データのラインの区切り記号を説明する
ための図、第３図は本発明のアドレステーブルを示す図
である。 図において、ｌはＣＰＵ、２は画像処理装置、３はイン
タフェース回路、４はメモリ、５はＥＯＬ判定回路、６
はテーブルアドレス制御回路、７はアドレステーブル、
８はメモリアドレス制御回路。 ９は伸長回路、１０は画像処理ユニットを示す〇茶 １
圀 Ｖ：３ 目
２図は圧縮画像データのラインの区切り記号を説明する
ための図、第３図は本発明のアドレステーブルを示す図
である。 図において、ｌはＣＰＵ、２は画像処理装置、３はイン
タフェース回路、４はメモリ、５はＥＯＬ判定回路、６
はテーブルアドレス制御回路、７はアドレステーブル、
８はメモリアドレス制御回路。 ９は伸長回路、１０は画像処理ユニットを示す〇茶 １
圀 Ｖ：３ 目
Claims (1)
- 中央処理装置に接続されたインタフェース回路とメモリ
アドレス制御回路とメモリと画像処理ユニットを有する
画像処理装置において、前記中央処理装置より転送され
る圧縮画像データの伸長を行わずに、前記メモリに格納
するとともに、該圧縮画像データのラインの区切り記号
を検出する検出回路と該検出回路により検出されたライ
ンの区切り記号のアドレスに対応した前記メモリへの格
納アドレスを示すアドレステーブルと、該アドレステー
ブルの画像処理を行いたい部分のテーブルアドレスより
前記メモリのデータを引き出し伸長する伸長回路とを備
え、該伸長回路の原画像データを前記画像処理ユニット
に出力することを特徴とする画像処理装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59109957A JPS60254280A (ja) | 1984-05-30 | 1984-05-30 | 画像処理装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59109957A JPS60254280A (ja) | 1984-05-30 | 1984-05-30 | 画像処理装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS60254280A true JPS60254280A (ja) | 1985-12-14 |
Family
ID=14523419
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP59109957A Pending JPS60254280A (ja) | 1984-05-30 | 1984-05-30 | 画像処理装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS60254280A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5283840A (en) * | 1991-04-26 | 1994-02-01 | Dainippon Screen Mfg. Co., Ltd. | Method and apparatus for extracting image data |
-
1984
- 1984-05-30 JP JP59109957A patent/JPS60254280A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5283840A (en) * | 1991-04-26 | 1994-02-01 | Dainippon Screen Mfg. Co., Ltd. | Method and apparatus for extracting image data |
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