JPS60177406A - Digital signal reproducer - Google Patents
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- JPS60177406A JPS60177406A JP3451384A JP3451384A JPS60177406A JP S60177406 A JPS60177406 A JP S60177406A JP 3451384 A JP3451384 A JP 3451384A JP 3451384 A JP3451384 A JP 3451384A JP S60177406 A JPS60177406 A JP S60177406A
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- G11—INFORMATION STORAGE
- G11B—INFORMATION STORAGE BASED ON RELATIVE MOVEMENT BETWEEN RECORD CARRIER AND TRANSDUCER
- G11B20/00—Signal processing not specific to the method of recording or reproducing; Circuits therefor
- G11B20/10—Digital recording or reproducing
- G11B20/18—Error detection or correction; Testing, e.g. of drop-outs
- G11B20/1803—Error detection or correction; Testing, e.g. of drop-outs by redundancy in data representation
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- Signal Processing For Digital Recording And Reproducing (AREA)
Abstract
Description
【発明の詳細な説明】
[発明の技術分野J
この発明は、ディジタル信号再生装置に関し、特にたと
えば磁気テープ等の記録媒体に往復記録されたディジタ
ル信号を自動的に往復再生できるディジタル信号再生装
置に関する。Detailed Description of the Invention [Technical Field of the Invention J] The present invention relates to a digital signal reproducing device, and more particularly to a digital signal reproducing device that can automatically reciprocate and reproduce digital signals recorded reciprocally on a recording medium such as a magnetic tape. .
[従来技術]
従来、テープレコーダやビデオテープレコーダなどにお
いては、いわゆるオートリバース機構(自動反転機構)
を備えたものがあった。このオートリバース機構によれ
ば、磁気テープの走行方向を自動的に反転させることが
できるので、カセットテープを裏返したりオープンリー
ルのテープを掛は替えたりすることなく自動的に往復記
録および往復再生が行なえる。しかしながら、従来のオ
ートリバース機構では、反転走行に移行するとき、再び
記録または再生可能な正常な状態に戻るまでに数10ミ
リsec〜数100ミリsecの時間が必要であった。[Prior Art] Conventionally, in tape recorders, video tape recorders, etc., so-called auto-reverse mechanisms (automatic reversing mechanisms) have been used.
There was one equipped with With this auto-reverse mechanism, the running direction of the magnetic tape can be automatically reversed, so reciprocating recording and reciprocating playback can be performed automatically without flipping the cassette tape or changing the reel-to-reel tape. I can do it. However, in the conventional auto-reverse mechanism, when shifting to reverse running, it takes several tens of milliseconds to several hundred milliseconds to return to a normal state in which recording or reproduction is possible again.
そのため、走行反転部分で音切れや絵切れが生じるとい
う欠点があった。As a result, there was a drawback that the sound and picture were cut out at the part where the vehicle was reversed.
[発明の概要]
この発明は上記のような従来のものの欠点を除去するた
めになされたもので、予めディジタル信号が往復記録さ
れ反転記録部分では往路および復路に同じ情報が重複記
録された記録媒体を再生ずるにあたり、反転再生前後の
再生データを別々の記憶手段に蓄積し、その記憶手段か
らのデータの読出しを時間的にコントロールすることに
より、反転再生時のデータの欠落をなくし、かつデータ
の′a続性を損なうことなく再生を行なえるようなディ
ジタル信号再生装置を提供づ゛ることを目的としでいる
。[Summary of the Invention] This invention was made to eliminate the drawbacks of the conventional ones as described above, and provides a recording medium in which a digital signal is recorded in advance in a reciprocating manner, and the same information is recorded redundantly on the forward and backward paths in the reverse recording section. When reproducing the data, the reproduced data before and after the reverse playback is stored in separate storage means, and the readout of data from the storage means is temporally controlled. This eliminates data loss during the reverse playback and improves the quality of the data. The object of the present invention is to provide a digital signal reproducing device that can perform reproduction without impairing continuity.
この発明の上述の目的およびその他の目的と特徴は、回
向を参照して行なう以下の詳細な説明から一層明らかと
なろう。The above objects and other objects and features of the invention will become more apparent from the following detailed description with reference to the following.
[発明の実施例]
131図はこの発明の一実施例のテープレコーダにおけ
る記録系の構成を示すブロック図である。[Embodiment of the Invention] FIG. 131 is a block diagram showing the configuration of a recording system in a tape recorder according to an embodiment of the invention.
図において、入力端子1には、記録づべε信号、すなわ
ち連続したアナログ信号を標本化し量子化および符号化
したディジタル信号が与えられる。In the figure, an input terminal 1 is supplied with a recorded ε signal, that is, a digital signal obtained by sampling, quantizing, and encoding a continuous analog signal.
この入力端子1から入力されるディジタル信号はメモリ
2に与えられ記憶される。メモリ2の読出しおよび欝込
みはアドレス制御回路3によって制御される。このアド
レス制御回路3には、入力端子4からリバース指令信号
が与えられる。メモリ2から読出されたディジタル信号
は、変調回路5によって記録可能な信号に変調された後
、磁気ヘッド6に与えられ磁気テープ7上に記録される
。A digital signal input from this input terminal 1 is applied to a memory 2 and stored therein. Reading and filling of the memory 2 is controlled by an address control circuit 3. A reverse command signal is applied to this address control circuit 3 from an input terminal 4. The digital signal read from the memory 2 is modulated into a recordable signal by the modulation circuit 5, and then applied to the magnetic head 6 and recorded on the magnetic tape 7.
第2図は第1図に示すメモリ2への入力データ列とメモ
リ2から読出された出力データ列を示す図である。以下
、この第2図を参照して反転記録動作を説明する。FIG. 2 is a diagram showing an input data string to the memory 2 shown in FIG. 1 and an output data string read from the memory 2. The reversal recording operation will be explained below with reference to FIG.
第2図において、入力データ列における@〜Oの各ブロ
ックは、磁気チー17上に記録されるブロック完結型の
ディジタル信号群であり、複数トラックに分配され、フ
レーム同期信号やCRCなどが付加されて記録される。In FIG. 2, each block @ to O in the input data string is a block-contained digital signal group recorded on the magnetic chip 17, distributed over multiple tracks, and with frame synchronization signals, CRC, etc. added. recorded.
各ブロック内に示されている000〜111はメモリ2
への書込みアドレスを意味する。一方、メモリ2からの
出力データ列における[株]〜Oは読出されるディジタ
ル信号群の各ブロックを意味し、各ブロック内に示され
ているOOO〜111はメモリ2の読出アドレスを意味
する。また、第2図では、入力データ列と出力データ列
は上下関係においで、時系列的に一致した状態であるこ
とを示している。まず、通常の状態ではメモリ2への入
力データはアドレス制御回路3からの書込アドレスによ
り、OO〜゛11の2ビツトにて表現される領域に記憶
され°Cいる。一方、アドレス制御回路3からメモリ2
に与えられる続出アドレスは書込アドレスの後を湯うよ
うにセットされており、通常の状態では書込アドレスよ
り2ビツト分すなわら2ブロック分だけずらせである。000 to 111 shown in each block are memory 2
means the address to write to. On the other hand, [share]~O in the output data string from the memory 2 means each block of the digital signal group to be read, and OOO~111 shown in each block means the read address of the memory 2. Further, FIG. 2 shows that the input data string and the output data string match in time series in a vertical relationship. First, in a normal state, input data to the memory 2 is stored in an area expressed by 2 bits OO to 11 according to a write address from the address control circuit 3. On the other hand, from the address control circuit 3 to the memory 2
The subsequent address given to is set to follow the write address, and under normal conditions is shifted by 2 bits, or 2 blocks, from the write address.
このような状態より、リバース動作を行なうにあたり動
作が開始される数ブロツク前にメモリプリセット命令が
出力されると、メモリ領域を拡大すべく書込アドレスが
セットされ、000〜111の3ビツトにて表現される
領域に記憶されるようになる。一方、続出アドレスは、
リバース動作が開始されたことを検出すると、2ブロツ
ク以前のデータブロックより読出しをやり直し、以後続
出アドレスも拡大され000〜111の3ビツトにて表
現される領域からデータを出力する。以上説明した動作
により記録を行なうと、メモリ2から出力されたデータ
は、磁気テープ7上では第3図に示すごとく記録される
。In this situation, when a memory preset command is output several blocks before the reverse operation starts, the write address is set to expand the memory area, and the 3 bits from 000 to 111 are set. It becomes stored in the area where it is expressed. On the other hand, the following addresses are
When it is detected that the reverse operation has started, reading is redone from the data block two blocks earlier, and subsequent addresses are expanded and data is output from the area expressed by 3 bits from 000 to 111. When recording is performed by the operation described above, the data output from the memory 2 is recorded on the magnetic tape 7 as shown in FIG.
第3図に示すごとく、リバースすなわち反転記録が開始
される前後2ブロックには、往路および復路に同一のブ
ロックが記録されている。すし、反転記録時における時
間的ロスのために復路の最初のデータが一部欠落するこ
とは十分考えられる。As shown in FIG. 3, in the two blocks before and after the start of reverse recording, the same block is recorded in the forward and backward passes. However, it is quite conceivable that some of the first data on the return trip may be lost due to time loss during inversion recording.
第4図はこの発明の一実施例の再生系のブロック図であ
り、第3図に示すごとく往路と復路とに反転記録された
データをデータの欠落することなくしかも連続的に読出
せるものである。図において、再生ヘッド10によって
磁気テープ7から再生された信りは、増幅回路11に与
えられて増幅された復データ検出回路12に与えられて
完全な2値信号に変換される。データ検出回路12の出
力はam回路13に与えられて復調された後、第1メモ
リ14および第2メモリ15に与えられる。FIG. 4 is a block diagram of a reproduction system according to an embodiment of the present invention, and as shown in FIG. 3, data recorded in reverse on the forward and backward passes can be read out continuously without data loss. be. In the figure, the signal reproduced from a magnetic tape 7 by a reproducing head 10 is applied to an amplifier circuit 11, where it is amplified, and then applied to a recovered data detection circuit 12, where it is converted into a complete binary signal. The output of the data detection circuit 12 is applied to an am circuit 13 and demodulated, and then applied to a first memory 14 and a second memory 15.
第1メモリ14および第2メモリ15には、それぞれ、
続出アドレスコントロール回路16および17が接続さ
れそれぞれの読出アドレスがコントロールされる。第1
メモリ14から読出されたデータは、データ比較器18
の一方入力に与えられるとともに、セレクタ19の一方
入力に与えられる。II2メモリ15から読出されたデ
ータは、データ比較器18の他方入力に与えられるとと
もに、セレクタ1′9の他方入力に与えられる。データ
比較器18μ、第1メモリ14からのデータと第2メモ
リ′15からのデータとをブロックごとに比較し、一致
したか否かを検出づる。このデータ比較器18の検出結
果は、セレクタ19および続出アドレスコントロール回
路17に与えられる。一方、り八−ス制御回路8は、磁
気テープ7の走行方向の反転を制御するものである。ま
た、リバース制御回路8は、キャプスタン9の回転速度
すなわち磁気チー17の走行速度も制御する。このリバ
ース制御回路8には、リバース予き命令が与えられ、こ
のリバース予告命令から一定時間後にリバース動作を開
始する。また、リバース制御回Meはリバース動作を完
了するとリバース完了信号を出力し続出アドレスコント
ロール回路17に与える。The first memory 14 and the second memory 15 each include:
Successive address control circuits 16 and 17 are connected to control respective read addresses. 1st
The data read from the memory 14 is sent to the data comparator 18
is applied to one input of the selector 19, and also applied to one input of the selector 19. The data read from the II2 memory 15 is applied to the other input of the data comparator 18 and the other input of the selector 1'9. A data comparator 18μ compares the data from the first memory 14 and the data from the second memory '15 for each block and detects whether or not they match. The detection result of data comparator 18 is applied to selector 19 and successive address control circuit 17. On the other hand, the reverse control circuit 8 controls the reversal of the running direction of the magnetic tape 7. The reverse control circuit 8 also controls the rotational speed of the capstan 9, that is, the traveling speed of the magnetic tee 17. A reverse advance command is given to this reverse control circuit 8, and the reverse operation is started after a certain period of time from this reverse advance command. Further, when the reverse operation is completed, the reverse control circuit Me outputs a reverse completion signal and supplies it to the successive address control circuit 17.
読出アドレスコントロール回路17はこのリバース完了
信号が与えられてから所定時間後に第2メモリ15の読
出しを開始する。The read address control circuit 17 starts reading the second memory 15 a predetermined time after receiving the reverse completion signal.
第5図は第1メモリ14への書込データ列および第1メ
モリ14からの誘出データ列と、第2メモリ15への書
込データ列および第2メモリ15からの誘出データ列を
示す図である。なお、この第5図では図面の右側から左
方向へ時間l!通を示している。また図中、各ブロック
上段のOOO〜111はメモリへの書込アドレスまたは
読出アドレスを示し、各ブロックの下段の6〜28はデ
ータブロックの絶対番号を意味している。、以下、この
第5図を参照して第4図の再生系における反転再生時の
動作を説明する。FIG. 5 shows a write data string to the first memory 14 and an induced data string from the first memory 14, and a write data string to the second memory 15 and an induced data string from the second memory 15. It is a diagram. In addition, in this FIG. 5, time l! moves from the right side of the drawing to the left side. It shows the general information. Further, in the figure, OOO-111 at the top of each block indicates a write address or read address to the memory, and numbers 6-28 at the bottom of each block mean the absolute number of the data block. Hereinafter, with reference to FIG. 5, the operation of the reproducing system shown in FIG. 4 during reversal reproduction will be explained.
まず、磁気テープ7の往路にお6’=て、通常再生時は
APC(Auto phase Control)がか
けられており、磁気テープ7からの再生データブロック
は、読出アドレスコントロール回路16からの続出アド
レスと同期をとりながら第1メモリー4に書込まれてい
る。ここで、リバース動作を開始する数ブロツク前にリ
バース予告命令がリバーノ
ス制御回路8に与えられる。リバース制御回路8 ′は
このリバース予告命令に応答して、APCを解除し、テ
ープ送りスピードをコントロールしているキャプスタン
サーボに対してテープ送りスピードを上げるように命令
する。これによって、磁気テープ7の送りスピードが上
昇され、短時間で多くのデータが再生される。なお、こ
のとき磁気テープ7の送りスピードは、再生データを第
1メモ。First, APC (Auto phase Control) is applied to the outgoing path of the magnetic tape 7 at 6' during normal reproduction, and the reproduced data block from the magnetic tape 7 is matched with the successive address from the read address control circuit 16. The information is written to the first memory 4 in synchronization. Here, a reverse warning command is given to the reversal control circuit 8 several blocks before starting the reverse operation. In response to this reverse warning command, the reverse control circuit 8' cancels the APC and instructs the capstan servo controlling the tape feeding speed to increase the tape feeding speed. As a result, the feeding speed of the magnetic tape 7 is increased, and a large amount of data can be reproduced in a short time. At this time, the feeding speed of the magnetic tape 7 is the first memo of the reproduced data.
す14に履込むアドレスカウンタを生成するための再生
クロックを生成しているPLLのロックが外れない範囲
であり、かつ第1メモリー4でデータを記憶しておく領
域がオーバフローしない範囲内に選ばれる。また、リバ
ース予告命令に応答して、第1メモリー4の書込アドレ
スが2ビツトから3ビツトに拡大される。上述のごとく
して磁気テープ7の送りスピードが上昇された後、磁気
テープ7の往路における最後のデータが再生されると、
リバース制御回路8はリバース動作を開始する。このリ
バース動作によって、磁気テープ7の走行方向が反転さ
れ、また再生ヘッド10が回転されて磁気テープ7の復
路に記録されたデータを再生できるようにされる。この
ようなリバース動作が完了すると、リバース制御回路8
は磁気チー77を通常の再生時の送りスピードよりも速
い送りスピードで走行させる。このとき磁気テープ7か
ら再生されたデータは、第2メモリ15に書込まれる。The selection is made within a range in which the PLL that generates the reproduced clock for generating the address counter to be loaded into the first memory 4 does not become unlocked, and within a range in which the area for storing data in the first memory 4 does not overflow. . Further, in response to the reverse notice command, the write address of the first memory 4 is expanded from 2 bits to 3 bits. After the feeding speed of the magnetic tape 7 is increased as described above, when the last data on the outward path of the magnetic tape 7 is reproduced,
Reverse control circuit 8 starts reverse operation. This reverse operation reverses the running direction of the magnetic tape 7 and rotates the reproducing head 10 so that data recorded on the backward path of the magnetic tape 7 can be reproduced. When such a reverse operation is completed, the reverse control circuit 8
The magnetic chip 77 is run at a faster feed speed than the normal playback speed. At this time, the data reproduced from the magnetic tape 7 is written into the second memory 15.
一方、第1メモリ14からのデータの読出しは、磁気テ
ープ7の送りスピードの上昇にかかわらず、常に一定周
期でデータ順次に行なわれる。したがって、第1メモリ
14にjI後に書込まれたデータすなわち磁気テープ7
の往路における最終データの読出しは、リバース開始時
点からかなり遅れて行なわれる。このときセレクタ19
は第1メモリ14からのデータを選択して出力している
。一方、リバース動作が完了して1ブロツク目の再生デ
ータの書込み(第2メモリ15への書込み)が完了する
と、続出アドレスコントロール回路17は第1メモリ1
4でのデータの読出し周期に同期して第2メモリ15か
らのデータの読出しを開始する。On the other hand, reading of data from the first memory 14 is always performed sequentially at a constant cycle, regardless of an increase in the feeding speed of the magnetic tape 7. Therefore, the data written to the first memory 14 after jI, that is, the magnetic tape 7
The final data readout on the forward path is carried out quite late from the start of reverse. At this time, selector 19
selects and outputs data from the first memory 14. On the other hand, when the reverse operation is completed and writing of the first block of playback data (writing to the second memory 15) is completed, the successive address control circuit 17
Data reading from the second memory 15 is started in synchronization with the data reading cycle at step 4.
このとき、第1メモリ14からも磁気テープ7の往路の
データが読出されている。このような状態で、第1メモ
リ14および第2メモリ15の読出データがデータ比較
器18に与えられ、両方のデータが一致するか否かが検
出される。もし、データが不一致であれは、データ比較
器18から不一致出力が導出される。この不一致出力に
よって、セレクタ19は第1メモリ14からの出力を選
択した状態に保持される。また、この一致出力によって
、続出アドレスコントロール回路17から第2メモリ1
5へ与えられる読出アドレスの更新が停止される。した
がって、第2メモリ15からは同じデータブロックが繰
返し読出される。これに対し、第1メモリ14に与えら
れる読出アドレスは1ブロツクずつ進む。このような状
態でデータ比較器18はブロックごとにデータの比較を
行なう。以後、第1メモリ14の出力と第2メモリ1.
5の出力とが一致するまでこの状態が繰返される。At this time, data on the outward path of the magnetic tape 7 is also being read from the first memory 14. In this state, the read data of the first memory 14 and the second memory 15 is provided to the data comparator 18, and it is detected whether or not both data match. If the data do not match, a mismatch output is derived from the data comparator 18. This mismatch output causes the selector 19 to maintain the state in which the output from the first memory 14 is selected. Furthermore, this coincidence output causes the successive address control circuit 17 to send the second memory 1
Update of the read address given to 5 is stopped. Therefore, the same data block is repeatedly read from the second memory 15. In contrast, the read address given to the first memory 14 advances one block at a time. In this state, the data comparator 18 compares data block by block. Thereafter, the output of the first memory 14 and the output of the second memory 1.
This state is repeated until the output of No. 5 matches the output of No. 5.
但し、このとき第2メモリ15から繰返し読出されるデ
ータブロックは、磁気テープ7の反転記録部分に111
m記録したブロック(ブロック20または21)の1つ
であり、かつ反転記録によりデータの欠落が生じていな
い正常なデータブロックを選択しておく必要がある。こ
の実IM例では、磁気テープ7の復路の最初のデータブ
ロックに欠落が生じる可能性があるので、第2メモリ1
5から読出された最初のデータはデータ比較器18での
データ比較がキャンセルされ、2番目にV先出されたデ
ータからデータ比較器18でのデータ比較が開始される
。ここで、データ比較器18でデータの一致が検出され
ると、一致出力を導出する。この一致出力に応答して、
セレクタ19はそれまで第1メモリ14の出力を選択し
ていたのに代えて第2メモリ15からの出力を選択する
。また、読出アドレスコントロール回11117におけ
る読出アドレスの更新の停止が解1II8れる。したが
って、第2メモリ15からは逐次新しいブロックのデー
タが読出されてゆく。したがって、セレクタ19からは
データの欠落のないかつ連続性の失われないデータが出
力される。However, the data block repeatedly read from the second memory 15 at this time is 111 on the inverted recording portion of the magnetic tape 7.
It is necessary to select a normal data block that is one of the blocks (blocks 20 or 21) recorded m and in which no data is missing due to inversion recording. In this actual IM example, since there is a possibility that the first data block on the return path of the magnetic tape 7 will be missing, the second memory 1
The data comparison in the data comparator 18 is canceled for the first data read from the first data, and the data comparison in the data comparator 18 is started from the second data read out by V first. Here, when a data match is detected by the data comparator 18, a match output is derived. In response to this match output,
The selector 19 selects the output from the second memory 15 instead of selecting the output from the first memory 14. Further, the update of the read address in the read address control circuit 11117 is stopped. Therefore, new blocks of data are successively read from the second memory 15. Therefore, the selector 19 outputs data without any data loss or continuity.
なお、以上説明した実施例では、記録系と再生系とを両
方備えるものを示したが、この発明は再生系のみを備え
るようなものであってもよい。この場合、再生する磁気
テープには、第3図に示すような状態でディジタル信号
がa復記録されていることが条件となる。Note that although the embodiments described above have been shown as having both a recording system and a reproducing system, the present invention may be of the type having only a reproducing system. In this case, the condition is that the digital signal is re-recorded in the state shown in FIG. 3 on the magnetic tape to be reproduced.
また、上述の実施例では、磁気テープの上段と下段とを
2分割して往復再生するものを示したが、たとえばくし
形状のトラックフォーマットにおいてもこの発明は適用
することができる。Further, in the above-described embodiment, the upper and lower stages of the magnetic tape are divided into two parts and played back and forth, but the present invention can also be applied to, for example, a comb-shaped track format.
[発明の効果J
以上のように、この発明によれば、ディジタル信号が往
復記録された磁気テープから該ディジタル信号を再生す
るにあたり、記録媒体の走行方向を反転してもデータの
欠落がなくかつデータの連続性を失うことのないディジ
タル信号再生装置を得ることができる。[Effect of the Invention J As described above, according to the present invention, when reproducing digital signals from a magnetic tape on which digital signals have been recorded reciprocally, there is no data loss even if the running direction of the recording medium is reversed. A digital signal reproducing device that does not lose data continuity can be obtained.
第1図はこの発明の一実施例における記録系を示すブロ
ック図である。第2図は第1図に示すメモリ2への入力
データ列およびメモリ2からの出“カデータ列を示す図
である。第3図は第1図に示す記録系によって記録され
た磁気テープの反転記録部分における記録フt−マット
を示す図である。
第4図はこの発明の一実flvI例における再生系のブ
ロック図である。第5図は第4図に示1第1メモリ14
への回込データ列および第1メモリ14からの読出デー
タ列と、第2メモリ15への書込データ列および第2メ
モリ15からの読出データ列を時系列的に表わした図で
ある。
図において、2はメモリ、3はアドレス制御回路、5は
変調回路、6は記録ヘッド、7は磁気テープ、8はリバ
ース制御回路、9はキャプスタン、10は再生ヘッド、
11は増幅器、12はデータ検出回路、13は復調回路
、14は第1メモリ、15は第2メモリ、16および1
7は読出アドレスコントロール回路、18はデータ比較
器、19代 理 人 大 岩 増 維
h1図FIG. 1 is a block diagram showing a recording system in an embodiment of the present invention. FIG. 2 is a diagram showing an input data string to the memory 2 shown in FIG. 1 and an output data string from the memory 2. FIG. 3 shows an inversion of the magnetic tape recorded by the recording system shown in FIG. 4 is a diagram showing a recording frame in a recording section. FIG. 4 is a block diagram of a reproduction system in an example of an actual flvI of the present invention. FIG.
FIG. 2 is a diagram chronologically representing a data string passed to and a data string read from the first memory 14, a data string written to the second memory 15, and a data string read from the second memory 15. In the figure, 2 is a memory, 3 is an address control circuit, 5 is a modulation circuit, 6 is a recording head, 7 is a magnetic tape, 8 is a reverse control circuit, 9 is a capstan, 10 is a reproduction head,
11 is an amplifier, 12 is a data detection circuit, 13 is a demodulation circuit, 14 is a first memory, 15 is a second memory, 16 and 1
7 is a read address control circuit, 18 is a data comparator, 19th representative Masu Oiwa h1 diagram
Claims (1)
たディジタル信号が記録された記録媒体から該ディジタ
ル信号を再生するv4置であって、前記磁気テープは最
初!11の方、向に沿って前記ディジタル信号が記録さ
れ、途中でその記録方向が反転されて前記wX1の方向
とは反対のm2の方向に沿って前記ディジタル信号が記
録され、前記mlの記録方向の記録終端部と前記第2の
記録方向の記録始端部とには、同じデータが重複して記
録されており、 前記磁気テープの再生位置が前記第1の記録方向の記録
終端部にさしかかったとき、前記磁気テープの走行方向
を反転させる手段、 前記磁気テープの走行方向が反転される前の再生データ
を記憶する*iの記、憶手段、前記磁気テープの走行方
向が反転された後の再生データを記憶する第2の記憶手
段、 前記磁気テープの走行方向が反転される前後の前記磁気
テープの走行速度を通常再生時の走行速度よりも上昇さ
せる手段、 前記第1の記憶手段に記憶された再生データを一定の周
期でデータ順次に読出す第1の続出手段、前記第2の記
憶手段に記憶された再生データを前記一定の周期でデー
タ順次に読出す第2の読出手段、 前記第1の記憶手段から読出されたデータと前記第2の
記憶手段から読出されたデータが一致しているか否かを
検出する手段、 前記検出手段が前記データの不一致を検出したとき前記
wI2の読出手段から前記第2の記憶手段に与えられる
読出アドレスの更新を停止し、前記検出手段が前記デー
タの一致を検出したとき前記続出アドレスの停止を解除
する手段を備える、ディジタル!i号再生装置。[Claims] A V4 system for reproducing a digital signal obtained by sampling, m-digitizing, and encoding a continuous analog signal from a recording medium on which the digital signal is recorded, wherein the magnetic tape is the first! The digital signal is recorded along the direction of 11, the recording direction is reversed midway, and the digital signal is recorded along the direction of m2, which is opposite to the direction of wX1, and the recording direction of ml is The same data is recorded redundantly at the recording end of the magnetic tape and the recording start of the second recording direction, and the reproduction position of the magnetic tape approaches the recording end of the first recording direction. When the running direction of the magnetic tape is reversed, means for reversing the running direction of the magnetic tape, storage means for storing reproduced data before the running direction of the magnetic tape is reversed, and storage means for storing playback data before the running direction of the magnetic tape is reversed; a second storage means for storing reproduction data; a means for increasing the running speed of the magnetic tape before and after the running direction of the magnetic tape is reversed than the running speed during normal reproduction; and storage in the first storage means. a first successive reading means for sequentially reading out the reproduced data stored in the second storage means at a constant cycle; a second reading means for sequentially reading out the reproduced data stored in the second storage means at the constant cycle; means for detecting whether the data read from the first storage means and the data read from the second storage means match; reading the wI2 when the detection means detects a mismatch between the data; Digital! i playback device.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP3451384A JPS60177406A (en) | 1984-02-22 | 1984-02-22 | Digital signal reproducer |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP3451384A JPS60177406A (en) | 1984-02-22 | 1984-02-22 | Digital signal reproducer |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS60177406A true JPS60177406A (en) | 1985-09-11 |
Family
ID=12416339
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP3451384A Pending JPS60177406A (en) | 1984-02-22 | 1984-02-22 | Digital signal reproducer |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS60177406A (en) |
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2010135362A (en) * | 2008-12-02 | 2010-06-17 | Seiwa Electric Mfg Co Ltd | Electric apparatus |
JP2010182803A (en) * | 2009-02-04 | 2010-08-19 | Seiwa Electric Mfg Co Ltd | Light-emitting apparatus |
-
1984
- 1984-02-22 JP JP3451384A patent/JPS60177406A/en active Pending
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2010135362A (en) * | 2008-12-02 | 2010-06-17 | Seiwa Electric Mfg Co Ltd | Electric apparatus |
JP2010182803A (en) * | 2009-02-04 | 2010-08-19 | Seiwa Electric Mfg Co Ltd | Light-emitting apparatus |
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