JPS60140979A - 画信号符号化および復号化の並列処理装置 - Google Patents
画信号符号化および復号化の並列処理装置Info
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- JPS60140979A JPS60140979A JP25070383A JP25070383A JPS60140979A JP S60140979 A JPS60140979 A JP S60140979A JP 25070383 A JP25070383 A JP 25070383A JP 25070383 A JP25070383 A JP 25070383A JP S60140979 A JPS60140979 A JP S60140979A
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
産業上の利用分野
本発明は、画信号のＭＨ符号化および復号化において、
複数の符号化回路および復号化回路を設け、並列処理を
行い得る如くした符号化および復号化装置に関する。
複数の符号化回路および復号化回路を設け、並列処理を
行い得る如くした符号化および復号化装置に関する。
従来例の構成とその問題点
画信号の蓄積には大容量の記憶媒体が必要であり、従来
、何らかの符号化方式により画信号を圧縮して符号デー
タとして蓄積が行われている。このだめの蓄積媒体とし
ては、半導体メモリ、磁気ディスク、光ディスク等が用
いられており、蓄積媒体との符号データとの転送はファ
クシミリ通信３７° ′ （９・６にビット／秒程度）等に比して高速で行われる
。このため、画信号から符号データへの符号化および符
号データから画信号への復号化の処理の高速化が必要と
なる。
、何らかの符号化方式により画信号を圧縮して符号デー
タとして蓄積が行われている。このだめの蓄積媒体とし
ては、半導体メモリ、磁気ディスク、光ディスク等が用
いられており、蓄積媒体との符号データとの転送はファ
クシミリ通信３７° ′ （９・６にビット／秒程度）等に比して高速で行われる
。このため、画信号から符号データへの符号化および符
号データから画信号への復号化の処理の高速化が必要と
なる。
画信号の符号化方式としては、ＣＣＩＴＴ （国際電信
電話諮問委員会）によシ勧告されているＭＲ（モディフ
ァイド・ホフマン）符号化方式が代表的である０ ここで、上記ＭＨ符号化方式とは、画信号の変化点を検
出し、そのラン・レングスおよびランの黒、白の別に対
応するＭｌ符号を用いる方式であり、上記ＭＨ符号には
第１表に示すように０から６３までのラン・レングスに
対応するターミネーティング符号と、第２表に示す６４
から２６６゜までの６４ラン毎のラン・レングスに対応
するメークアップ符号とがある０また、ライン同期符号
（ＥＯＬ ：０００００００００００１）がｋＨ符号列
の１走査毎に挿入される。
電話諮問委員会）によシ勧告されているＭＲ（モディフ
ァイド・ホフマン）符号化方式が代表的である０ ここで、上記ＭＨ符号化方式とは、画信号の変化点を検
出し、そのラン・レングスおよびランの黒、白の別に対
応するＭｌ符号を用いる方式であり、上記ＭＨ符号には
第１表に示すように０から６３までのラン・レングスに
対応するターミネーティング符号と、第２表に示す６４
から２６６゜までの６４ラン毎のラン・レングスに対応
するメークアップ符号とがある０また、ライン同期符号
（ＥＯＬ ：０００００００００００１）がｋＨ符号列
の１走査毎に挿入される。
第１表
第２表
５１”゛
従来の画信号符号化および復号化装置において、前記記
憶媒体２１と前記ＭＨ符号と符号化および復号化する符
号化回路２２、復号化回路２３とは、一般に第１図に示
すようにパラレル・バス２４に接続されており、ＭＨ符
号データがパラレル・バスを通り符号化回路から記憶媒
体へ、また記憶媒体から復号化回路へ転送される。
憶媒体２１と前記ＭＨ符号と符号化および復号化する符
号化回路２２、復号化回路２３とは、一般に第１図に示
すようにパラレル・バス２４に接続されており、ＭＨ符
号データがパラレル・バスを通り符号化回路から記憶媒
体へ、また記憶媒体から復号化回路へ転送される。
このようにＭＨ符号データをパラレル・バスを通して転
送するようにした構成において、符号化および復号化処
理の高速化のだめに、複数の符号化回路および復号化回
路をパラレル・バスに接続して１走査毎に並列処理を行
おうとすると、第２図に示すＭＦ符号データ列のように
パラレル・バスのデータ幅単位とＭｌ（符号データ列上
の１走査の区切りとが一致しないため、パラレル・バス
上で各符号化回路から出力する１走査毎のＭＨ符号デー
タの合成および各復号化回路へ入力する１走査毎のＭ）
Ｉ符号データの分解ができないという問題点が生じる。
送するようにした構成において、符号化および復号化処
理の高速化のだめに、複数の符号化回路および復号化回
路をパラレル・バスに接続して１走査毎に並列処理を行
おうとすると、第２図に示すＭＦ符号データ列のように
パラレル・バスのデータ幅単位とＭｌ（符号データ列上
の１走査の区切りとが一致しないため、パラレル・バス
上で各符号化回路から出力する１走査毎のＭＨ符号デー
タの合成および各復号化回路へ入力する１走査毎のＭ）
Ｉ符号データの分解ができないという問題点が生じる。
これは、前記ＭＨ符号が可変長であるため、１６ ゛
走査分の符号データ長がパラレル・バスのデータ幅の整
数倍にならないことによる。
数倍にならないことによる。
発明の目的
本発明は、上記の問題点を解消するためになされたもの
で、複数のＭＨ符号化回路およびＭＨ復号化回路を、パ
ラレル・バス上で１走査毎に並列に動作させることので
きる画信号符号化および復号化の並列処理装置を提供す
ることを目的とする。
で、複数のＭＨ符号化回路およびＭＨ復号化回路を、パ
ラレル・バス上で１走査毎に並列に動作させることので
きる画信号符号化および復号化の並列処理装置を提供す
ることを目的とする。
発明の構成
本発明は、ＭＨ符号データ列上において前記ライン同期
符号も含めて連続する０符号は１４ビツト以下であるこ
とに着目し、例えば一般的なパラレル・バスのデータ幅
の８ビツト、１６ビツトでは、ＭＨ符号データ列上でバ
ス・データが全て０となることは、８ビツト・バスの場
合、連続しては存在せず、１６ビツト・バスの場合存在
しないことから、ＭＨ符号データ列の１走査の区切り（
ライン同期符号の前）に連続する０符号を８ビツト・バ
スの場合１２ピツト、１６ビツト・バスの場合２０ビツ
ト付加すると、バス・データが全７ ′ −゛ て０と彦る条件が８ビツト・バスの場合連続して２回、
１６ビツト・バスでは１回出現するので、この条件を検
出することによってパラレル・バス上で１走査毎のＭＩ
（符号データの区切りとし、上述の目的を達成せんとす
るものである。
符号も含めて連続する０符号は１４ビツト以下であるこ
とに着目し、例えば一般的なパラレル・バスのデータ幅
の８ビツト、１６ビツトでは、ＭＨ符号データ列上でバ
ス・データが全て０となることは、８ビツト・バスの場
合、連続しては存在せず、１６ビツト・バスの場合存在
しないことから、ＭＨ符号データ列の１走査の区切り（
ライン同期符号の前）に連続する０符号を８ビツト・バ
スの場合１２ピツト、１６ビツト・バスの場合２０ビツ
ト付加すると、バス・データが全７ ′ −゛ て０と彦る条件が８ビツト・バスの場合連続して２回、
１６ビツト・バスでは１回出現するので、この条件を検
出することによってパラレル・バス上で１走査毎のＭＩ
（符号データの区切りとし、上述の目的を達成せんとす
るものである。
すなわち、本発明の画信号符号化および復号化の並列処
理装置は、原画を走査して得られる画信号を入力端子よ
り入力して１走査毎に順次サイクリックにＭＨ符号化回
路に分配する画信号分配回路と、ライン・メモリとＭｕ
符号化処理回路と符号データ・バッファとから構成され
、前記分配された画信号をＭＨ符号データに変換する複
数のＭＨ符号化回路と、各ＭＨ符号化回路の符号データ
をバス・データ０検出回路の検出信号により１走査毎に
順次サイクリックに選択してパラレル・バスに出力する
符号データ選択回路と、ＭＨ符号データを転送するパラ
レル・バスと、バス・データの全て０を検出するバス・
データＯ検出回路と、゛パラレル・バスにより転送され
たＭｌ符号データ〉に蓄積する記憶媒体と、記憶媒体か
ら転送されるパラレル・バス上のＭＨ符号符号データを
バス・データ０検出回路の検出信号により１走査毎に順
次サイクリックに分配する符号データ分配回路と、ライ
ン・メモリとｋＨ復号化処理回路と符号データ・バッフ
ァとから構成され、前記分配されたＭＨ符号データを画
信号に復号する複数のＭ）１９号化回路と、各Ｂ＆Ｈ復
号化回路からの画信号を１走査毎に順次サイクリックに
選択して出力端子より出力する画信号選択回路とを備え
てなるものである。
理装置は、原画を走査して得られる画信号を入力端子よ
り入力して１走査毎に順次サイクリックにＭＨ符号化回
路に分配する画信号分配回路と、ライン・メモリとＭｕ
符号化処理回路と符号データ・バッファとから構成され
、前記分配された画信号をＭＨ符号データに変換する複
数のＭＨ符号化回路と、各ＭＨ符号化回路の符号データ
をバス・データ０検出回路の検出信号により１走査毎に
順次サイクリックに選択してパラレル・バスに出力する
符号データ選択回路と、ＭＨ符号データを転送するパラ
レル・バスと、バス・データの全て０を検出するバス・
データＯ検出回路と、゛パラレル・バスにより転送され
たＭｌ符号データ〉に蓄積する記憶媒体と、記憶媒体か
ら転送されるパラレル・バス上のＭＨ符号符号データを
バス・データ０検出回路の検出信号により１走査毎に順
次サイクリックに分配する符号データ分配回路と、ライ
ン・メモリとｋＨ復号化処理回路と符号データ・バッフ
ァとから構成され、前記分配されたＭＨ符号データを画
信号に復号する複数のＭ）１９号化回路と、各Ｂ＆Ｈ復
号化回路からの画信号を１走査毎に順次サイクリックに
選択して出力端子より出力する画信号選択回路とを備え
てなるものである。
そして、本発明装置による画信号符号化および復号化の
並列処理の動作は、前記Ｍｌ符号化回路において生成す
る符号データ列の１走査毎の区切りにパラレル・バスの
データ幅に対応した任意の長さの０符号を付加する過程
と、前記パラレル・バスのデータの全て０の判定により
符号データ列上の１走査の区切りを検出する過程と、符
号データ列上の１走査の区切り毎に前記複数のＭＨ符号
化回路もしくはＭＨ復号化回路のうち１つをパラレル・
バスへ順次サイクリックに接続する過程と、９べ゛り 前記複数のＭＨ符号化回路もしくはＭＷ復号化回路のう
ち１つと画信号を１走査毎に順次サイクリックに接続す
る過程とからなる。
並列処理の動作は、前記Ｍｌ符号化回路において生成す
る符号データ列の１走査毎の区切りにパラレル・バスの
データ幅に対応した任意の長さの０符号を付加する過程
と、前記パラレル・バスのデータの全て０の判定により
符号データ列上の１走査の区切りを検出する過程と、符
号データ列上の１走査の区切り毎に前記複数のＭＨ符号
化回路もしくはＭＨ復号化回路のうち１つをパラレル・
バスへ順次サイクリックに接続する過程と、９べ゛り 前記複数のＭＨ符号化回路もしくはＭＷ復号化回路のう
ち１つと画信号を１走査毎に順次サイクリックに接続す
る過程とからなる。
実施例の説明
第３図および第４図は、本発明の１実施例による画信号
の符号化処理装置および復号化処理装置を示すものであ
る。図中１は画信号を入力する入力端子、２は入力画信
号を１走査毎に順次サイクリックに分配する画信号分配
回路である。３は画信号分配回路２によ多分配された画
信号をＭＨ符号データに変換するＭＨ符号化回路で、ラ
イン・メモリ３ａとＭＨ符号イヒ処理回路３ｂと符号デ
ータ・バッファ３Ｃとから構成される。４，６も上記３
と同一のＭＨ符号化回路で、複数のＭＨ符号化回路３．
４．６が並列に配置される。６は各ＶＨ符号化回路の符
号データを１走査毎に順次サイクリックに選択して出力
する符号データ選択回路であシ、７はバス・データの全
てＯを検出して検出信号Ｓ１を発信するバス・データ０
検出回路、８はＭＨ符号データを転送するパラレル・バ
ス、１０・ｔご ９はパラレル・バス８により転送され〆ＭＨ符号データ
を蓄積する記憶媒体である。１ｏはパラレル・バス８上
のＭＨ符号データを１走査毎に順次サイクリックに分配
する符号データ分配回路である０１１は符号データ分配
回路により分配されたＭｌ符号データを画信号に復号す
るＭＨ復号化回路で、ライン・メモリ１１ａとＭＨ復号
化処理回路１１ｂと符号データ・バッファ１１０とから
構成される。１２．１３も上記１１と同一のＭＨ復号化
回路で、複数のＭＨ復号化回路１１，１２゜１３が並列
に配置される。１４は各Ｍｌ復号化回路からの画信号を
１走査毎に順次選択して出力する画信号選択回路、１５
は画信号を出力する出力端子である。
の符号化処理装置および復号化処理装置を示すものであ
る。図中１は画信号を入力する入力端子、２は入力画信
号を１走査毎に順次サイクリックに分配する画信号分配
回路である。３は画信号分配回路２によ多分配された画
信号をＭＨ符号データに変換するＭＨ符号化回路で、ラ
イン・メモリ３ａとＭＨ符号イヒ処理回路３ｂと符号デ
ータ・バッファ３Ｃとから構成される。４，６も上記３
と同一のＭＨ符号化回路で、複数のＭＨ符号化回路３．
４．６が並列に配置される。６は各ＶＨ符号化回路の符
号データを１走査毎に順次サイクリックに選択して出力
する符号データ選択回路であシ、７はバス・データの全
てＯを検出して検出信号Ｓ１を発信するバス・データ０
検出回路、８はＭＨ符号データを転送するパラレル・バ
ス、１０・ｔご ９はパラレル・バス８により転送され〆ＭＨ符号データ
を蓄積する記憶媒体である。１ｏはパラレル・バス８上
のＭＨ符号データを１走査毎に順次サイクリックに分配
する符号データ分配回路である０１１は符号データ分配
回路により分配されたＭｌ符号データを画信号に復号す
るＭＨ復号化回路で、ライン・メモリ１１ａとＭＨ復号
化処理回路１１ｂと符号データ・バッファ１１０とから
構成される。１２．１３も上記１１と同一のＭＨ復号化
回路で、複数のＭＨ復号化回路１１，１２゜１３が並列
に配置される。１４は各Ｍｌ復号化回路からの画信号を
１走査毎に順次選択して出力する画信号選択回路、１５
は画信号を出力する出力端子である。
次に、本装置における画信号符号化および復号化の並列
処理の動作について説明する。なお説明の便宜上、パラ
レル・バスのデータ幅は１６ビツト、ＭＨ符号化回路お
よびＭＨ復号化回路はそれぞれ３回路とする。
処理の動作について説明する。なお説明の便宜上、パラ
レル・バスのデータ幅は１６ビツト、ＭＨ符号化回路お
よびＭＨ復号化回路はそれぞれ３回路とする。
まず、符号化動作について第３図に従って説明１１
する。原画を走査して得られた画信号は、入力端子１を
通して画信号分配回路２へ入力される。回路２は画信号
の計数機能を有し、画信号を一定長の１走査毎に分割し
てＭＨ符号化回路３ｔ ４＋ ５に対して順次サイクリ
ックに出力する。回路３に入力された１走査分の画信号
はライン・メモリ３ａに入り、前記ＭＨ符号化方式に従
って符号化処理を行うＭ）！符号化処理回路３ｂにより
パラレルなＭＨ符号データに変換され、符号データ・バ
ッファ３Ｃに入力される。なお、ＭＨ符号化処理回路３
ｂは１走査の符号データ出力後、パラレル・バスのデー
タ幅１６ビツトに対応した０符号列２゜ビットを出力す
る機能を有する。回路４，５においても、入力された画
信号に対して上記と同様な動作が行われる。回路３．４
． ５のパラレルな符号データ出力は符号データ選択回
路６に入力される。回路６は、バス・データ０検出回路
７の検出信号Ｓ１がオンする毎に、回路３． ４． ５
の符号データ出力を順次サイクリックに選択してパラレ
ル・バス８に出力する。パラレル・バス８上に出力され
た符号データは、回路７に入力されるとともに記憶媒体
９に転送され蓄積される。バス・データ０検出回路７は
、パラレル・バスＢ上のバス・データの全て０を検出す
る機能を有しており、前記したようにＭＨ符号データ列
上ではＱ符号の連続は１４ビツト以上であるから、回路
７の検出信号Ｓ１がオンするのは１走査の符号データの
後に付加されたＯ符号がパラレル・バス８上に出力され
た時のみである。従って、記憶媒体９上には入力画信号
の走査順に対応して符号データが蓄積される。
通して画信号分配回路２へ入力される。回路２は画信号
の計数機能を有し、画信号を一定長の１走査毎に分割し
てＭＨ符号化回路３ｔ ４＋ ５に対して順次サイクリ
ックに出力する。回路３に入力された１走査分の画信号
はライン・メモリ３ａに入り、前記ＭＨ符号化方式に従
って符号化処理を行うＭ）！符号化処理回路３ｂにより
パラレルなＭＨ符号データに変換され、符号データ・バ
ッファ３Ｃに入力される。なお、ＭＨ符号化処理回路３
ｂは１走査の符号データ出力後、パラレル・バスのデー
タ幅１６ビツトに対応した０符号列２゜ビットを出力す
る機能を有する。回路４，５においても、入力された画
信号に対して上記と同様な動作が行われる。回路３．４
． ５のパラレルな符号データ出力は符号データ選択回
路６に入力される。回路６は、バス・データ０検出回路
７の検出信号Ｓ１がオンする毎に、回路３． ４． ５
の符号データ出力を順次サイクリックに選択してパラレ
ル・バス８に出力する。パラレル・バス８上に出力され
た符号データは、回路７に入力されるとともに記憶媒体
９に転送され蓄積される。バス・データ０検出回路７は
、パラレル・バスＢ上のバス・データの全て０を検出す
る機能を有しており、前記したようにＭＨ符号データ列
上ではＱ符号の連続は１４ビツト以上であるから、回路
７の検出信号Ｓ１がオンするのは１走査の符号データの
後に付加されたＯ符号がパラレル・バス８上に出力され
た時のみである。従って、記憶媒体９上には入力画信号
の走査順に対応して符号データが蓄積される。
次に、復号化動作について第４図に従って説明する。前
記符号化動作において説明したとおり、記憶媒体９には
符号データが走査順に、パラレル・バス８を全て０とす
る連続した０符号で区切られて蓄積されている。記憶媒
体９からパラレル・バス８上を転送された符号データは
、バス・データ０検出回路７に入力されるとともに符号
データ分配回路１０に入力される。回路１０は回路７の
検出信号Ｓ１がオンする毎に、すなわち１走査毎１３／
・ ・・ に符号データをＭＨ復号化回路１１，１２．１３に対し
て順次サイクリックに出力する。回路１１に入力した符
号データは、符号データ・バッファ１１Ｃ’ｉ経て、Ｍ
Ｈ符号化方式に従って復号化処理を行うＭＨ復号化処理
回路１１ｂにより復号され・画信号勺してライ′°メ１
す°に入力される。なお、ＭＨ復号化処理回路１１ｂで
はＭＨ符号データの後の連結する０符号はフィル（ＦＩ
ＬＬ） ・ビットとして無視し、次のライン同期符号か
ら次の走査分の復号化処理を再開する。回路１２．１３
においても、入力された符号データに対して同様な動作
が行われる。回路１１’＋ １２゜１３の画信号出力は
、画信号選択回路１４に入力される。回路１４は画信号
の計数機能を有し、一定長の１走査毎に回路１１・ １
２．１３の画信号出力を順次サイクリックに選択して画
信号出力端子１６へ出力する。従って、端子１５からの
画信号は、記憶媒体９上の１走査毎の符号データの順に
出力される。
記符号化動作において説明したとおり、記憶媒体９には
符号データが走査順に、パラレル・バス８を全て０とす
る連続した０符号で区切られて蓄積されている。記憶媒
体９からパラレル・バス８上を転送された符号データは
、バス・データ０検出回路７に入力されるとともに符号
データ分配回路１０に入力される。回路１０は回路７の
検出信号Ｓ１がオンする毎に、すなわち１走査毎１３／
・ ・・ に符号データをＭＨ復号化回路１１，１２．１３に対し
て順次サイクリックに出力する。回路１１に入力した符
号データは、符号データ・バッファ１１Ｃ’ｉ経て、Ｍ
Ｈ符号化方式に従って復号化処理を行うＭＨ復号化処理
回路１１ｂにより復号され・画信号勺してライ′°メ１
す°に入力される。なお、ＭＨ復号化処理回路１１ｂで
はＭＨ符号データの後の連結する０符号はフィル（ＦＩ
ＬＬ） ・ビットとして無視し、次のライン同期符号か
ら次の走査分の復号化処理を再開する。回路１２．１３
においても、入力された符号データに対して同様な動作
が行われる。回路１１’＋ １２゜１３の画信号出力は
、画信号選択回路１４に入力される。回路１４は画信号
の計数機能を有し、一定長の１走査毎に回路１１・ １
２．１３の画信号出力を順次サイクリックに選択して画
信号出力端子１６へ出力する。従って、端子１５からの
画信号は、記憶媒体９上の１走査毎の符号データの順に
出力される。
上記説明の理解を助けるため、第５図に符号化１４ °
゛ 動作における画信号、各１１Ｈ符号化回路の動作、パラ
レル・バス８上の符号データおよび信号Ｓ１のタイミン
グ図を示し、第６図に復号化動作におけるパラレル・バ
ス８上の符号データ、信号Ｓ１各ＭＨ復号化回路の動作
および画信号のタイミング図を示す。
゛ 動作における画信号、各１１Ｈ符号化回路の動作、パラ
レル・バス８上の符号データおよび信号Ｓ１のタイミン
グ図を示し、第６図に復号化動作におけるパラレル・バ
ス８上の符号データ、信号Ｓ１各ＭＨ復号化回路の動作
および画信号のタイミング図を示す。
発明の効果
本発明は上記の如く構成されたものであり、複数のＭＨ
符号化回路およびＭＨ復号化回路を画信号の１走査毎に
並列に動作させることができるので、連続した画信号に
おいて符号化および復号化の処理を高速化し得る効果が
アシ、画信号の蓄積装置へ有効に応用することができる
。
符号化回路およびＭＨ復号化回路を画信号の１走査毎に
並列に動作させることができるので、連続した画信号に
おいて符号化および復号化の処理を高速化し得る効果が
アシ、画信号の蓄積装置へ有効に応用することができる
。
第１図は従来のＭＨ符号化回路およびＭＨ復号化回路と
記憶媒体との接続状態を示す°ブロック図、第２図はＭ
Ｈ符号データとパラレル・バスのデータ幅との関係を説
明する図、第３図は本発明の一実施例による符号化装置
のブロック図、第４図は￥発明の一実施例にする復号化
装置０ブ°・り図・１５ ページ 第６図は符号化動作のタイミング図、第６図は復号化動
作のタイミング図である。 １・・・・・・画信号入力端子、２・・・・・・画信号
分配回路、３、 ４．５・・・・・・ＭＨ符号化回路、
６・・・・・・符号データ選択回路、ア・・・・・・バ
ス・データ○検出回路、８・・・・・・パラレル中バス
、９・・・・・・記憶’ＪＸ体、１０・・・・・・符号
データ分配回路、１４・・・・・・画信号選択回路、１
６・・・・・・画信号出力端子。 代理人の氏名 弁理士 中 尾 敏 男 ほか１名第１
図 Ｊ 第２図 ■ − 縫う 図 −一
記憶媒体との接続状態を示す°ブロック図、第２図はＭ
Ｈ符号データとパラレル・バスのデータ幅との関係を説
明する図、第３図は本発明の一実施例による符号化装置
のブロック図、第４図は￥発明の一実施例にする復号化
装置０ブ°・り図・１５ ページ 第６図は符号化動作のタイミング図、第６図は復号化動
作のタイミング図である。 １・・・・・・画信号入力端子、２・・・・・・画信号
分配回路、３、 ４．５・・・・・・ＭＨ符号化回路、
６・・・・・・符号データ選択回路、ア・・・・・・バ
ス・データ○検出回路、８・・・・・・パラレル中バス
、９・・・・・・記憶’ＪＸ体、１０・・・・・・符号
データ分配回路、１４・・・・・・画信号選択回路、１
６・・・・・・画信号出力端子。 代理人の氏名 弁理士 中 尾 敏 男 ほか１名第１
図 Ｊ 第２図 ■ − 縫う 図 −一
Claims (1)
- 【特許請求の範囲】 原画を走査して得られる画信号を入力端子よ多入力して
１走査毎に順次サイクリックにモディファイド・ホフマ
ン（以下ＭＨと記す）符号化回路に分配する画信号分配
回路と、前記分配された画信号をＭＨ符号データに変換
する複数のＭＨ符号化回路と、各ＭＨ符号化回路の符号
データをバス・データ０検出回路の検出信号により１走
査毎に順次サイクリックに選択してパラレル・バスに出
力する符号データ選択回路と、Ｍ）ｌ符号データを転送
するパラレル・バスと、バス・データの全てｏを検出す
るバス・データ０検出回路と、パラレル・バスによシ転
送されたＭ）ｌ符号データを蓄積する記憶媒体と、記憶
媒体から転送されるパラレル・バス上のＭｌ符号データ
をバス・データＯ検出回路の検出信号により１走査毎に
順次サイクリックに分配する符号データ分配回路と、ラ
イン・２ベコ゛ メモリとＭＨ復号化処理回路と符号データ・バッファと
から構成され、前記分配されたＭＨ符号データを画信号
に復号する複数のＭＨ復号化回路と、各ＭＨ復号化回路
からの画信号を１走査毎に順次サイクリックに選択して
出力端子より出力する画信号選択回路とを備えてなる画
信号符号化および復号化の並列処理装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP25070383A JPS60140979A (ja) | 1983-12-27 | 1983-12-27 | 画信号符号化および復号化の並列処理装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP25070383A JPS60140979A (ja) | 1983-12-27 | 1983-12-27 | 画信号符号化および復号化の並列処理装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS60140979A true JPS60140979A (ja) | 1985-07-25 |
| JPH033440B2 JPH033440B2 (ja) | 1991-01-18 |
Family
ID=17211784
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP25070383A Granted JPS60140979A (ja) | 1983-12-27 | 1983-12-27 | 画信号符号化および復号化の並列処理装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS60140979A (ja) |
Cited By (8)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS61284178A (ja) * | 1985-06-11 | 1986-12-15 | Nec Corp | １次元符号復号化回路 |
| JPS62266922A (ja) * | 1986-05-15 | 1987-11-19 | Nec Corp | イメ−ジ情報復号化装置 |
| JPS63109653A (ja) * | 1986-10-27 | 1988-05-14 | Sharp Corp | 情報登録検索装置 |
| JPS63115267A (ja) * | 1986-10-31 | 1988-05-19 | Nippon I C S Kk | 伝票等の記載事項復元処理装置 |
| JPS63157524A (ja) * | 1986-12-20 | 1988-06-30 | Fujitsu Ltd | デ−タ復号化処理方式 |
| JPS6482874A (en) * | 1987-09-25 | 1989-03-28 | Fujitsu Ltd | Parallel entropy decoding method |
| JPH01209819A (ja) * | 1988-02-18 | 1989-08-23 | Nippon Telegr & Teleph Corp <Ntt> | 可変長符号化復号化方式 |
| JPH11313037A (ja) * | 1998-01-27 | 1999-11-09 | Lucent Technol Inc | 信号を繰り返し復号化する装置と方法 |
-
1983
- 1983-12-27 JP JP25070383A patent/JPS60140979A/ja active Granted
Cited By (10)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS61284178A (ja) * | 1985-06-11 | 1986-12-15 | Nec Corp | １次元符号復号化回路 |
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| JPS63109653A (ja) * | 1986-10-27 | 1988-05-14 | Sharp Corp | 情報登録検索装置 |
| JPH0434345B2 (ja) * | 1986-10-27 | 1992-06-05 | Sharp Kk | |
| JPS63115267A (ja) * | 1986-10-31 | 1988-05-19 | Nippon I C S Kk | 伝票等の記載事項復元処理装置 |
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| JPS6482874A (en) * | 1987-09-25 | 1989-03-28 | Fujitsu Ltd | Parallel entropy decoding method |
| JPH01209819A (ja) * | 1988-02-18 | 1989-08-23 | Nippon Telegr & Teleph Corp <Ntt> | 可変長符号化復号化方式 |
| JPH11313037A (ja) * | 1998-01-27 | 1999-11-09 | Lucent Technol Inc | 信号を繰り返し復号化する装置と方法 |
| US6271772B1 (en) | 1998-01-27 | 2001-08-07 | Lucent Technologies Inc. | Method and apparatus for iterative decoding from a central pool |
Also Published As
| Publication number | Publication date |
|---|---|
| JPH033440B2 (ja) | 1991-01-18 |
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