JPS5934780A - Receiver of picture information - Google Patents
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- JPS5934780A JPS5934780A JP14591682A JP14591682A JPS5934780A JP S5934780 A JPS5934780 A JP S5934780A JP 14591682 A JP14591682 A JP 14591682A JP 14591682 A JP14591682 A JP 14591682A JP S5934780 A JPS5934780 A JP S5934780A
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- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
- H04N7/00—Television systems
- H04N7/24—Systems for the transmission of television signals using pulse code modulation
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- Television Systems (AREA)
Abstract
Description
【発明の詳細な説明】
この発明は画像情報信号の受信装置に関し、特に誤り訂
正可能な符号系で構成された画像情報信号の誤り率を減
少させるようにした受信装置に関する。DETAILED DESCRIPTION OF THE INVENTION The present invention relates to a receiving device for image information signals, and more particularly to a receiving device configured to reduce the error rate of image information signals configured with an error-correctable code system.
画像情報として、テレビ文字多重放送やキャブテンシス
ムがある。たとえばテレビ文字多重放送において、パタ
ーン方式による場合は制御符号などの一部の符号が、ま
たコード方式による場合はすべての符号が誤り検出可能
な符号系によって構成されている。Image information includes television teletext and cabten system. For example, in television teletext broadcasting, some codes such as control codes are constructed using a pattern system, and all codes are constructed using an error-detectable code system when a code system is used.
第１図は、従来のテレビ文字多重放送受信装置を示す概
略ブロック図である。構成において、復調器（図示せず
）に接続された比較器１は直並列変換器２および第１記
憶器３を介して誤り検出訂正回路４に接続される。誤り
検出訂正回路４は、第２記憶器５、読出回路６および映
像信号発生回路７を介してブラウン管８に接続される。FIG. 1 is a schematic block diagram showing a conventional television teletext receiving apparatus. In the configuration, a comparator 1 connected to a demodulator (not shown) is connected to an error detection and correction circuit 4 via a serial-to-parallel converter 2 and a first memory 3. The error detection and correction circuit 4 is connected to a cathode ray tube 8 via a second memory 5, a readout circuit 6, and a video signal generation circuit 7.
動作において、比較器１は復調器によって復調された画
像情報信号ａを受けてこれを特定の閾値で弁別して２値
化し、２値化画像情報信号すを出力する。この２値化画
像情報信号すを受けて、直並列変換器２はこれを一定語
長くたとえば８ビツト）の並列信号Ｃに変換する。第１
記憶器３は、この並列信号Ｃを記憶する。誤り検出訂正
回路４はこの記憶された並列信号Ｃを受けて、伝送系に
おける誤りを検出し訂正する。第２記憶器５は誤りの検
出訂正が行なわれた画像情報信号ｄを記憶する。この記
憶された画像情報信号ｄは、読出回路６によってブラウ
ン管８の画面掃引同期と同期して読出されて、映像信号
発生回路７に加えられる。映像信号発生回路７は、この
画像情報とブラウン管８に必要な同期信号とを合成して
、映像信号ｅを発生する。映像信号発生回路７によって
合成された映像信号ｅを受けて、ブラウン管８は画像情
報に対応した画像を表示する。In operation, the comparator 1 receives the image information signal a demodulated by the demodulator, discriminates it using a specific threshold value, binarizes it, and outputs the binarized image information signal S. Upon receiving this binarized image information signal, the serial/parallel converter 2 converts it into a parallel signal C of a certain length (for example, 8 bits). 1st
The storage device 3 stores this parallel signal C. The error detection and correction circuit 4 receives this stored parallel signal C, detects and corrects errors in the transmission system. The second storage device 5 stores the image information signal d that has been subjected to error detection and correction. The stored image information signal d is read out by the readout circuit 6 in synchronization with the screen sweep of the cathode ray tube 8, and is applied to the video signal generation circuit 7. The video signal generation circuit 7 synthesizes this image information and a synchronization signal necessary for the cathode ray tube 8 to generate a video signal e. Upon receiving the video signal e synthesized by the video signal generation circuit 7, the cathode ray tube 8 displays an image corresponding to the image information.
第２図は、第１図に示された比較器１に加えられる復調
された画像情報信号ａと、比較器１の閾値り、ｏとの関
係の一例を示す概略図である。図に示すように復調され
た画像情報信号ａは雑音が重畳されて歪んでおり、した
がってこれを２値化するための閾値は信号の歪に対応し
て変化されるのが望ましい。たとえば閾値がｈに固定さ
れていたとすると、たとえばローレベル（Ｌ’）とハイ
レベル（Ｈ）とを繰返している復調された画像情報信号
ａは、図示の場合にはＨ，Ｌ、Ｌ、Ｌ、Ｈ。FIG. 2 is a schematic diagram showing an example of the relationship between the demodulated image information signal a applied to the comparator 1 shown in FIG. 1 and the threshold value o of the comparator 1. As shown in the figure, the demodulated image information signal a is distorted due to superimposition of noise, and therefore, it is desirable that the threshold value for binarizing it is changed in accordance with the distortion of the signal. For example, if the threshold value is fixed to h, then the demodulated image information signal a, which repeats low level (L') and high level (H), is H, L, L, L in the case shown in the figure. ,H.
Ｌ、Ｌ、Ｌ、ｌ−１と２値化される。正しくはＨ，Ｌ。It is binarized as L, L, L, l-1. Correctly, H and L.
１−１．Ｌ、Ｈ，Ｌ、Ｈ，Ｌ、Ｈであるので、２ビツト
の誤りが発生することになる。図において容易に理解さ
れるように、この場合においては、閾値をＯに下げると
正確な２値化が実現される。しかし上）ホした従来の画
像情報信号受信装置においては閾値が成る一定の値に固
定されており、誤り率の増減に対応した閾値の最適化は
不可能である。1-1. Since the signals are L, H, L, H, L, H, a 2-bit error will occur. As can be easily understood from the figure, in this case, lowering the threshold value to O achieves accurate binarization. However, in the conventional image information signal receiving apparatus mentioned above, the threshold value is fixed at a constant value, and it is impossible to optimize the threshold value in response to an increase or decrease in the error rate.
このため従来装置においては、Ｓ／Ｎ比の悪い条件の下
において誤り検出訂正回路の誤り検出および訂正能力を
越える信号の誤りが発生することがあり、劣悪な画像が
提供されるという欠点があった。For this reason, in conventional devices, under conditions with a poor S/N ratio, signal errors that exceed the error detection and correction capabilities of the error detection and correction circuit may occur, resulting in poor images being provided. Ta.
それゆえにこの発明の目的は、従来装置の以上の欠点を
克服し、Ｓ／Ｎ比の悪い条件下においても良好な画像を
得ることができる画像情報信号の受信装ばを提供するこ
とである。SUMMARY OF THE INVENTION Therefore, an object of the present invention is to provide an image information signal receiving apparatus that overcomes the above-described drawbacks of conventional apparatuses and can obtain good images even under conditions of poor S/N ratio.
この発明は要約すれば、復調された画像情報信号を２値
化する場合の閾値を、信号の誤りの検出回数に応答して
その誤りを減少させるように変化させるものである。In summary, the present invention is to change a threshold value when binarizing a demodulated image information signal in response to the number of times errors in the signal are detected so as to reduce the errors.
この発明の上述の目的およびその他の目的と効果は、図
面を参照して行なう以下の詳細な説明により一層明らか
となろう。The above objects and other objects and effects of the present invention will become more apparent from the following detailed description with reference to the drawings.
第３図は、この発明の一実施例であるテレビ文字多重放
送受信装置を示す概略ブロック図である。FIG. 3 is a schematic block diagram showing a television teletext receiving apparatus which is an embodiment of the present invention.
構成において第１図に示す従来装置と異なるところは、
比較器１の代わりに閾値を変化することのできる閾値可
変比較器２１が用いられることおよび誤り検出訂正回路
４と閾値可変比較器２１との間に誤り検出訂正回路４の
誤り検出出力を受けて閾値可変比較器２１の閾値を変化
させる制御回路２２が設けられることである。The differences in configuration from the conventional device shown in Figure 1 are as follows:
A variable threshold comparator 21 whose threshold value can be changed is used instead of the comparator 1, and an error detection output of the error detection and correction circuit 4 is received between the error detection and correction circuit 4 and the variable threshold comparator 21. A control circuit 22 for changing the threshold of the variable threshold comparator 21 is provided.
動作において、ブラウン管８への画像の表示は従来装置
と同様に行なわれる。制御回路２２は誤り検出訂正回路
４の誤り検出出力［を受けＵ、誤り検出訂正回路４にお
ける誤りの検出回数が減少するように閾値制御出力りを
出力することによって閾値可変比較器２１の閾値を変化
させる。In operation, images are displayed on the cathode ray tube 8 in the same manner as in conventional devices. The control circuit 22 receives the error detection output of the error detection and correction circuit 4 and adjusts the threshold of the variable threshold comparator 21 by outputting a threshold control output so that the number of errors detected in the error detection and correction circuit 4 is reduced. change.
第４図は第３図に示す制御回路２２をより詳細に示すブ
ロック図である。構成において、誤り検出訂正回路４の
誤り検出出力側は時間ゲート回路４２が接続されて一定
時間ごとに前記誤り検出出力をカウントする計数回路４
１の入力側と接続され、計数回路４１の出力側はレジス
タ１４３の入力側と接続される。レジスタＩ４３の出力
側は比較器４５の一方の入力側と接続されるとともにレ
ジスタ１１４４の入力側と接続され、レジスタＩ［４４
の出力側は比較器４５の他方の入力側と接続される。比
較器４５の出力側は増減フラグ４７が接続されたパルス
幅増減回路４６の入力側と接続され、パルス幅増減回路
４６の出力側はパルス幅変調回路４８および積分回路４
９を介して第３図に示された閾値可変比較器２１の閾値
制御入力側と接続される。FIG. 4 is a block diagram showing the control circuit 22 shown in FIG. 3 in more detail. In the configuration, a time gate circuit 42 is connected to the error detection output side of the error detection and correction circuit 4, and a counting circuit 4 counts the error detection output at regular intervals.
1, and the output side of the counting circuit 41 is connected to the input side of the register 143. The output side of the register I43 is connected to one input side of the comparator 45 and also to the input side of the register 1144.
The output side of is connected to the other input side of comparator 45. The output side of the comparator 45 is connected to the input side of the pulse width increase/decrease circuit 46 to which the increase/decrease flag 47 is connected, and the output side of the pulse width increase/decrease circuit 46 is connected to the pulse width modulation circuit 48 and the integration circuit 4.
9 to the threshold control input side of the variable threshold comparator 21 shown in FIG.
動作において、誤り検出訂正回路４は画像情報信号の誤
りを検出するごとに、計数回路４１に対して誤り検出出
力ｆを出力する。計数回路４１はこの誤り検出出力ｒを
受Ｇ）で、時間ゲート回路４２によって予め定められる
一定時間内で誤り検出回数をカウントする。このカウン
ト数はレジスタ１４３に転送されると同時に、レジスタ
１４３内のその前のカウント数はレジスタＩ４４に転送
される。比較器４５は、レジスタ１４３の内容である最
新のカウント数とレジスタＩ［４４の内容であるその前
のカラン１へ数とを比較して、比較結果をパルス幅増減
回路４６に対して出力する。パルス幅増減回路４６はこ
の比較結果を受けて、増減フラグ４７に保持さむている
その前の閾値の変化の方向（増加または減少）に応じて
、パルス幅変調回路４８より出力されるパルスの幅を以
下のよ−うに制御することによって、第３図に示す＠値
可変比較器２１の閾値を制御する。In operation, the error detection and correction circuit 4 outputs an error detection output f to the counting circuit 41 every time it detects an error in the image information signal. A counting circuit 41 receives this error detection output r and counts the number of error detections within a predetermined period of time determined by a time gate circuit 42. This count number is transferred to register 143, while the previous count number in register 143 is transferred to register I44. The comparator 45 compares the latest count number, which is the content of the register 143, with the previous count number, which is the content of the register I [44], and outputs the comparison result to the pulse width increase/decrease circuit 46. . In response to this comparison result, the pulse width increase/decrease circuit 46 adjusts the width of the pulse output from the pulse width modulation circuit 48 according to the direction of change (increase or decrease) in the previous threshold held in the increase/decrease flag 47. The threshold value of the @value variable comparator 21 shown in FIG. 3 is controlled by controlling as follows.
比較器４５の出力結果は、レジスタＩの内容（Ｉ）−レ
ジスタ■の内容（Ｉ）の場合、 Ｉ＞Ｉｆの場合およ
びＩ＜１［の場合の３通りの場合があり、それぞれに対
応してパルス幅増減回路４６は以下のように動作する。The output result of the comparator 45 has three cases: the content (I) of register I - the content (I) of register ■, the case I>If, and the case I<1[. The pulse width increase/decrease circuit 46 operates as follows.
（１）Ｉ＝Ｉの場合
この場合は最新の誤りカウント数とその前の誤りカウン
ト数とが等しいことを意味する。誤り率が変化していな
いので閾値は変化されず、したがってパルス幅増減回路
４６は増減フラグ４７の内容にかかわらず現在のパルス
幅を維持するようにパルス幅変調回路４８を制御する。(1) When I=I In this case, it means that the latest error count number and the previous error count number are equal. Since the error rate has not changed, the threshold value is not changed, so the pulse width increase/decrease circuit 46 controls the pulse width modulation circuit 48 to maintain the current pulse width regardless of the contents of the increase/decrease flag 47.
また、増減フラグ４７の内容は、その前の状態のまま変
化されない。Further, the contents of the increase/decrease flag 47 remain unchanged in their previous state.
（２）■ノ■の場合
この場合は最新の誤りカウント数がその前の誤りカラ〕
／（−改よりも大きいことを示している。゛つまり誤り
率が増加したことを示しており、これを減少させるため
には閾値をその前の変化の方向とは逆の方向に変化させ
なければならない。したがってパルス幅増減回路４６は
、増減フラグ４７の内容が増加（つまりその前の閾値の
変化方向が増加）である場合にはパルス幅を減少させ（
゛閾値を減少させるように動作し、また増減フラグ４７
の内容が減少（つまりその前の閾値の変化方向が減少）
である場合にはパルス幅を増加させて閾値を増加させる
ようにパルス幅変調回路４８を制御する。(2) In the case of ■ノ■ In this case, the latest error count is the previous error color]
/(- This indicates that the error rate is greater than Therefore, if the content of the increase/decrease flag 47 is an increase (that is, the direction of change of the previous threshold value is an increase), the pulse width increase/decrease circuit 46 decreases the pulse width (
゛It operates to decrease the threshold value, and also sets the increase/decrease flag 47.
The content of decreases (that is, the direction of change of the previous threshold decreases)
If so, the pulse width modulation circuit 48 is controlled to increase the pulse width and increase the threshold value.
増減フラグ４７の内容は、その前の状態とは逆に変更さ
れる。The contents of the increase/decrease flag 47 are changed to be opposite to the previous state.
（３）Ｉ＜Ｈの場合
この場合は最新の誤りカラン１〜数がその前の誤りカウ
ント数よりも小さいことを示している。ｐより誤り率が
減少していることを示してｄ３す、したがって閾値の変
化の方向をそのｔまにしてｗＡ値を変化させればよい。(3) If I<H, this case indicates that the latest error count number is smaller than the previous error count number. d3 indicates that the error rate has decreased from p, so the wA value may be changed by changing the direction of the threshold value by t.
したかってパルス幅増減回路４６は、増減フラグ４７の
内容が増加である場合にはパルス幅を増加させて閾値を
増加させるように動作し、増減フラグ４７の内容が減少
である場合にはパルス幅を減少させて閾値を減少させる
ようにパルス幅変調回路４７を制御する。増減フラグ４
７の内容は、その前の状態のまま変化されない。Therefore, the pulse width increase/decrease circuit 46 operates to increase the pulse width and increase the threshold value when the content of the increase/decrease flag 47 is an increase, and operates to increase the threshold value by increasing the pulse width when the content of the increase/decrease flag 47 is a decrease. The pulse width modulation circuit 47 is controlled to decrease the threshold value by decreasing the threshold value. Increase/decrease flag 4
The contents of 7 remain unchanged in their previous state.
パルス幅変調回路４８は、上述したパルス幅増減回路４
６の制御出力を受けＣ１これに対応したパルス幅のパル
スを出ノ〕する。積分回路４９はこのパルス出力を受け
てこれをパルス幅に対応した電圧値に変換し、ａ ｉｆ
！制御出力Ｑとしで出力する。The pulse width modulation circuit 48 is the pulse width increase/decrease circuit 4 described above.
C1 outputs a pulse having a pulse width corresponding to the control output of C1. The integrating circuit 49 receives this pulse output and converts it into a voltage value corresponding to the pulse width, and a if
! Output as control output Q.
この閾値制御出力Ｑを受番ノで、第３図に示す四値可変
比較器２１の閾値は誤り検出訂正回路４の誤り検出率が
減少するように変化される。By receiving this threshold value control output Q, the threshold value of the four-value variable comparator 21 shown in FIG. 3 is changed so that the error detection rate of the error detection and correction circuit 4 is reduced.
第５図は、上述した誤りカウント数の比較動作およびそ
れに基づくパルス幅の制御をマイクＩココンピュータを
用いて行なう場合のノローチｔ−−１−である。先ずス
テップ＄１においてＩ−■であるか否かが判断され、Ｉ
＝ＩＩである場合にはパルス幅を変化する必要はなく動
作は終了する。増減７ラグ４７の内容の変更も行なわれ
ない。Ｉ＝］Ｉでない場合にはステップＳ２へ移行して
、Ｉ＞Ｈであるか否かが判断される。Ｉ＞ＩＩである場
合にはステップＳ３へ移行し、増減フラグ４７の内容が
増加であるか否かが判断される。増加である場合にはス
テップＳ５へ移行【ノでパルス幅が前３本のように減少
されるとともに、ステップＳ６へ移行して増減フラグ４
７の内容が減少に変更されて動作は終了する。一方ステ
ップＳ３において増加でない場合（つまり減少の場合）
は、ステップＳ７へ移行して、前述のようにパルス幅が
増加される。FIG. 5 shows Noroch t--1- when the above-described error count comparison operation and pulse width control based on the comparison operation are performed using the microphone I cocomputer. First, in step $1, it is determined whether I-■, and I
If =II, there is no need to change the pulse width and the operation ends. The contents of the increase/decrease 7 lag 47 are not changed either. If I=]I is not the case, the process moves to step S2, and it is determined whether I>H. If I>II, the process moves to step S3, and it is determined whether the content of the increase/decrease flag 47 is an increase. If it is an increase, the process moves to step S5 [in which the pulse width is decreased like the previous three pulses, and the process moves to step S6 to set the increase/decrease flag 4.
The content of 7 is changed to decrease and the operation ends. On the other hand, if there is no increase in step S3 (in other words, if there is a decrease)
Then, the process moves to step S7, and the pulse width is increased as described above.
その後ステップＳ８において増減フラグ４７の内容が増
加に変更され、動作は終了する。Thereafter, in step S8, the content of the increase/decrease flag 47 is changed to increase, and the operation ends.
またステップＳ２においてＩ＞ＩｔでないくつまりＩ＜
Ｉｆ）の場合は、ステップＳ４に移行して増減フラグ４
７の内容が増加であるか否かが判断される。増加の場合
にはステップＳ７へ移行して前述のようにパルス幅が増
加されるとともに、その後ステップＳ８へ移行して増減
フラグ４７の内容が増加にされて（もともと増加である
ので、実質的には変化しない。）動作は終了する。また
ステップＳ４において減少の場合には、ステップＳ５へ
移行して前述のようにパルス幅が減少され、さらにステ
ップＳ６へ移行して増減フラグ４７の内容が減少にされ
て（もともと増加であるので、実質的には変化しない。Also, in step S2, I>It does not hold, that is, I<
If), the process moves to step S4 and the increase/decrease flag 4 is set.
It is determined whether the content of 7 is an increase. In the case of an increase, the process moves to step S7, where the pulse width is increased as described above, and then the process moves to step S8, where the content of the increase/decrease flag 47 is set to increase (since it is originally an increase, it is essentially remains unchanged.) The operation ends. If the pulse width is decreased in step S4, the process goes to step S5, where the pulse width is decreased as described above, and the process goes to step S6, where the content of the increase/decrease flag 47 is decreased (since it is originally an increase, Substantially no change.
）動作は終了づる。) The operation ends.
以上のようにこの発明によれば、画像情報信号の誤り率
に応答して画像情報信号を２値化づるためのＩｌａｍを
変化することができ、Ｓ／Ｎ比の悪い条件下においても
良好な画像を得ることができる画像情報信号の受信装置
が得られるという効果がある。As described above, according to the present invention, Ilam for binarizing the image information signal can be changed in response to the error rate of the image information signal, and even under conditions of poor S/N ratio, it is possible to change the Ilam for binarizing the image information signal. This has the effect of providing an image information signal receiving device that can obtain images.
４、図面のｆｉｌ’ｉ １．Ｉな説明
第１図ＧＪ従来のラレビ文字多県放送受信装置を示づ概
略ブロック図、俯２図は惨調された画像情報４３号と閾
１１ｂどの１！１１係の一例を示す概略図、第３図はこ
の発１ｖＪの一実施例であるテレビ文字多重放送受信装
置を示ジ概略）′１）ツク図、第４図は第３図に示され
た制御回路２２をｉｌらＧに詳細に示づブロック図、第
５図は’Ｘ５／Ｉ図に示された制御回路の誤りカウント
数の比較動作お、」、びそれに対応するパルス幅制御動
作を示１フローチャートである。4. fil'i of the drawings 1. I Explanation Fig. 1 GJ A schematic block diagram showing a conventional Rarebi character multi-prefecture broadcasting receiving device, Fig. 2 is a schematic diagram showing an example of the 1! Fig. 3 schematically shows a television teletext receiving device which is an embodiment of the present invention. FIG. 5 is a flowchart showing the error count comparison operation of the control circuit shown in FIG.
図において１は比較器、２は直並列変換器、３は第１記
隨器、４は誤り検出訂正回路、５は第２記憶器、６は続
出回路、７は映像信号発生回路、８はブラウン管、２１
は閾値可変比較器、２２は制御回路、４１は計数回路、
４２は時間ゲート回路、４３はレジスタ１１４４はレジ
スタＢ１４５は比較器、４６はパルス幅増減回路、４７
は増減フラグ、４８はパルス幅変調回路、４９は積分回
路、ａは復調された画像情報信号、ｂは２値化された画
像情報信号、Ｃは並列信号に変換された画像情報信号、
ｄは誤り検出訂正後の画像情報信号、ｅは映像信号、ｆ
は誤り検出出力、Ｑは閾値制御出力をそれぞれ示す。In the figure, 1 is a comparator, 2 is a serial/parallel converter, 3 is a first memory, 4 is an error detection and correction circuit, 5 is a second memory, 6 is a continuation circuit, 7 is a video signal generation circuit, and 8 is a Braun tube, 21
is a variable threshold comparator, 22 is a control circuit, 41 is a counting circuit,
42 is a time gate circuit, 43 is a register 1144, register B 145 is a comparator, 46 is a pulse width increase/decrease circuit, 47
48 is an increase/decrease flag, 48 is a pulse width modulation circuit, 49 is an integration circuit, a is a demodulated image information signal, b is a binarized image information signal, C is an image information signal converted into a parallel signal,
d is the image information signal after error detection and correction, e is the video signal, f
denotes the error detection output, and Q denotes the threshold control output, respectively.
代理人 葛 野 信 −（外１名） 第１図 第３図 第２図Agent: Shin Kuzuno - (1 other person) Figure 1 Figure 3 Figure 2
Claims (3)
比較器を備え、 前記比較器の閾値は変化されることができ、前記画像情
報信号は誤り訂正可能な符号系によって全部または一部
が構成されており、前記２値化された画像情報信号の誤
りを検出する手段と、 前記検出手段の出力に応答して、前記比較器の閾値を前
記誤りが減少するように変化させる手段とをさらに備え
る画像情報信号受信装置。(1) A comparator is provided for threshold-discriminating and binarizing an image information signal, the threshold of the comparator can be changed, and the image information signal is completely or partially converted by an error-correctable code system. means for detecting an error in the binarized image information signal; and means for changing a threshold value of the comparator so as to reduce the error in response to an output of the detection means. An image information signal receiving device further comprising:
ントする手段と、 前３ｐ己カウント数がその前のカウント数よりも減少し
たときは前記閾値の変化の方向をそのままにして前記閾
値を予め定められる一定の値だけ変化させ、前記カウン
ト数がその前のカウント数よりも増加したときは前記閾
値の変化の方向を逆にして前記閾値を予め定められる一
定の値だけ変化させる手段とを備える、特許請求の範囲
第１項記載の画像情報信号受信装置。(2) The threshold value changing means includes means for counting the output of the error detection means for a predetermined period of time, and a means for counting the output of the error detection means for a predetermined period of time, and a means for determining the direction of change in the threshold value when the previous 3p count decreases from the previous count. The threshold value is changed by a predetermined constant value while remaining as it is, and when the count number increases than the previous count number, the direction of change of the threshold value is reversed and the threshold value is changed to a predetermined constant value. 2. The image information signal receiving apparatus according to claim 1, further comprising means for changing the image information signal.
けパルス幅を変化させるパルス幅変調手段を用いて行な
われる、特許請求の範囲第２項記載の画像情報信号受信
装Ｗ６(3) The image information signal receiving device W6 according to claim 2, wherein the threshold value is changed using a pulse width modulation means that changes the pulse width by a predetermined constant value.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP14591682A JPS5934780A (en) | 1982-08-21 | 1982-08-21 | Receiver of picture information |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP14591682A JPS5934780A (en) | 1982-08-21 | 1982-08-21 | Receiver of picture information |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS5934780A true JPS5934780A (en) | 1984-02-25 |
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ID=15396034
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP14591682A Pending JPS5934780A (en) | 1982-08-21 | 1982-08-21 | Receiver of picture information |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5934780A (en) |
Cited By (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS62152578U (en) * | 1986-03-20 | 1987-09-28 | ||
| JPS63215178A (en) * | 1987-03-03 | 1988-09-07 | Fujitsu General Ltd | Teletext receiver built in television |
| US5552030A (en) * | 1992-09-25 | 1996-09-03 | Nippon Piston Ring Co., Ltd. | Method of making a magnetic material in the form of a multilayer film by plating |
| US5806448A (en) * | 1995-03-29 | 1998-09-15 | Jaguar Co., Ltd. | Overlock sewing machine |
-
1982
- 1982-08-21 JP JP14591682A patent/JPS5934780A/en active Pending
Cited By (5)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS62152578U (en) * | 1986-03-20 | 1987-09-28 | ||
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| JPH0551232B2 (en) * | 1987-03-03 | 1993-08-02 | Fujitsu General Ltd | |
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