JPS59208590A - 表示装置の駆動回路 - Google Patents
表示装置の駆動回路Info
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- JPS59208590A JPS59208590A JP58082922A JP8292283A JPS59208590A JP S59208590 A JPS59208590 A JP S59208590A JP 58082922 A JP58082922 A JP 58082922A JP 8292283 A JP8292283 A JP 8292283A JP S59208590 A JPS59208590 A JP S59208590A
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
く技術分野〉
本発明は表示装置の駆動回路に関し、特に画素毎に表示
素子駆動用能動素子を設けて該能動素子を作動させるこ
とによって各種情報を表示するものである。
素子駆動用能動素子を設けて該能動素子を作動させるこ
とによって各種情報を表示するものである。
〈従来技術〉
１枚の基板上に表示画素数に等しい駆動回路を、薄膜技
術等を利用してマドリスク状に作製し、こ用いてデータ
を表示する表示装置が開発されている０ この種の表示装置において、表示素子自体がデータを自
己保持する能力を備えていない場合に、例えばテレビジ
ョンの複合映像信号のように時系列信号で入力される画
像のうち、一つの画面を静止画像としてマトリクス状の
画面に表示させようとすると、所望の画面に対応する信
号を記憶装置に一旦格納して保持させ、随時データを読
出して表示素子に供給することが必要になる。このよう
に画像の表示を維持させるだめに、表示素子自体の要素
の他に画素数に応じた容量をもつ記憶装置が必要となり
、装置を構成する部品点数が多くなるだけではなく、経
済性の面でも不利が伴うという欠点がある。
術等を利用してマドリスク状に作製し、こ用いてデータ
を表示する表示装置が開発されている０ この種の表示装置において、表示素子自体がデータを自
己保持する能力を備えていない場合に、例えばテレビジ
ョンの複合映像信号のように時系列信号で入力される画
像のうち、一つの画面を静止画像としてマトリクス状の
画面に表示させようとすると、所望の画面に対応する信
号を記憶装置に一旦格納して保持させ、随時データを読
出して表示素子に供給することが必要になる。このよう
に画像の表示を維持させるだめに、表示素子自体の要素
の他に画素数に応じた容量をもつ記憶装置が必要となり
、装置を構成する部品点数が多くなるだけではなく、経
済性の面でも不利が伴うという欠点がある。
一方各画素毎に駆動回路を設けて２次元の画像表示する
装置の駆動回路として第１図に示す回路が提案されてい
る。この駆動回路は、データを短時間保持する機能を有
する能動素子を用いて構成するもので、同図は一画素分
の駆動回路を示し、走査信号線１に与えられる信号によ
り書込みトランジスタ２がオン状態になって、映像信号
線３の電圧がコンデンサ４に一時的に保持され、この保
持された電圧が表示素子駆動トランジスタ６のゲを表示
動作させる。
装置の駆動回路として第１図に示す回路が提案されてい
る。この駆動回路は、データを短時間保持する機能を有
する能動素子を用いて構成するもので、同図は一画素分
の駆動回路を示し、走査信号線１に与えられる信号によ
り書込みトランジスタ２がオン状態になって、映像信号
線３の電圧がコンデンサ４に一時的に保持され、この保
持された電圧が表示素子駆動トランジスタ６のゲを表示
動作させる。
上記表示装置の駆動回路は、絶縁基板上に薄膜技術によ
って、或いは半導体基板を利用して、画素数に相当する
個数が一体的に作製されるが、表示装置が２次元の情報
を表示するためには、画素に対応して作製される駆動回
路がいずれも良好に動作するものでカければならない。
って、或いは半導体基板を利用して、画素数に相当する
個数が一体的に作製されるが、表示装置が２次元の情報
を表示するためには、画素に対応して作製される駆動回
路がいずれも良好に動作するものでカければならない。
このように駆動回路が良好に動作するか否かが、駆動回
路を表示素子側に結合する前の段階で性能テストするこ
とができれば、良品の基板のみを選び出して表示素子側
に結合することができるため表示装置としての歩留りは
著しく向上に、製造時の効率もすぐれたものになる。
路を表示素子側に結合する前の段階で性能テストするこ
とができれば、良品の基板のみを選び出して表示素子側
に結合することができるため表示装置としての歩留りは
著しく向上に、製造時の効率もすぐれたものになる。
しかし上記第１図に示した回路構成ではすべての組立て
を終え、表示素子と結合した状態でなければ駆動回路の
欠陥検査が行えない。このような不都合に対して、表示
素子と結合することなく駆動回路自体で欠陥検査し得る
駆動回路が特開昭５７−９９６８８号公報に提案されて
いる。
を終え、表示素子と結合した状態でなければ駆動回路の
欠陥検査が行えない。このような不都合に対して、表示
素子と結合することなく駆動回路自体で欠陥検査し得る
駆動回路が特開昭５７−９９６８８号公報に提案されて
いる。
即ち第２図に示す如く、映像信号線３と駆動トランジス
タ６間に読出しトランジスタ９を挿入し、該読出しトラ
ンジスタ９のゲートに入力する信号１００レベルによっ
て駆動トランジスタ６のドレイン電圧を信号線３に読出
すことが可能になり、表示素子８を接続することなく駆
動回路の欠陥検査を行うことができる。
タ６間に読出しトランジスタ９を挿入し、該読出しトラ
ンジスタ９のゲートに入力する信号１００レベルによっ
て駆動トランジスタ６のドレイン電圧を信号線３に読出
すことが可能になり、表示素子８を接続することなく駆
動回路の欠陥検査を行うことができる。
しかし第２図に示す駆動回路においても、マトリクス状
の一画面の映像を維持させようとすれば、やはりデータ
を保持する記憶装置が別途必要になるという欠点があっ
た。
の一画面の映像を維持させようとすれば、やはりデータ
を保持する記憶装置が別途必要になるという欠点があっ
た。
〈発明の目的〉
一一＝２＋
−本発明は上記従来装置の
欠点を除去し、表示素子の駆動電圧を読出すことが可能
な構成からなる表示駆動回路において、簡単な回路を付
加することにより、画像を維持させる場合に、各画素の
駆動回路を外来信号から切り離して、画素の駆動回路に
既に書込まれているデータを読出し、レベル調整して再
び駆動回路に入力することにより、所望の画像を維持さ
せ得る表示装置の駆動回路を提供する０ 〈実施例〉 ２値画像を点順次走査方式によって２次元画面に表示す
る場合を挙げて説明する。
な構成からなる表示駆動回路において、簡単な回路を付
加することにより、画像を維持させる場合に、各画素の
駆動回路を外来信号から切り離して、画素の駆動回路に
既に書込まれているデータを読出し、レベル調整して再
び駆動回路に入力することにより、所望の画像を維持さ
せ得る表示装置の駆動回路を提供する０ 〈実施例〉 ２値画像を点順次走査方式によって２次元画面に表示す
る場合を挙げて説明する。
第３図は、表示画素がマトリクス状に配列されてなる表
示装置の駆動回路を示すブロック図で、各画素に対応し
て単位画素のだめの駆動回路Ａｎ＋ＡＩ２・・・Ａｍｎ
が同一基板面上に薄膜トランジスタを形成することによ
って、或いは半導体基板を用いて形成されている０各年
位画素の駆動回路Ａ１ｊは、第４図に示すように、信号
線ｔｉに書込みトランジスタＴｒａ及び読出しトランジ
スタＴｒｃが共通に接続され、更に書込みトランジスタ
Ｔｒａを通過した信号がゲートに与えられた駆動トラン
ジスタＴｒｂが設けられ、該駆動トランジスタの一端と
上記読出しトランジスタＴｒｃの他端との結合点の信号
を表示素子Ｂｉｊに入力して構成される０同図において
駆動回路中の容量Ｃは書込まれたデータを一時に保持す
る役目を果たし、駆動トランジスタＴｒｂのＭＯＳゲー
ト容量が利用される。
示装置の駆動回路を示すブロック図で、各画素に対応し
て単位画素のだめの駆動回路Ａｎ＋ＡＩ２・・・Ａｍｎ
が同一基板面上に薄膜トランジスタを形成することによ
って、或いは半導体基板を用いて形成されている０各年
位画素の駆動回路Ａ１ｊは、第４図に示すように、信号
線ｔｉに書込みトランジスタＴｒａ及び読出しトランジ
スタＴｒｃが共通に接続され、更に書込みトランジスタ
Ｔｒａを通過した信号がゲートに与えられた駆動トラン
ジスタＴｒｂが設けられ、該駆動トランジスタの一端と
上記読出しトランジスタＴｒｃの他端との結合点の信号
を表示素子Ｂｉｊに入力して構成される０同図において
駆動回路中の容量Ｃは書込まれたデータを一時に保持す
る役目を果たし、駆動トランジスタＴｒｂのＭＯＳゲー
ト容量が利用される。
単位駆動回路の信号線Ａｊは列毎に共通に接続され、各
列の信号線ｔ１〜７ｍに対応して設けられた走査スイッ
チングトランジスタＳ】〜Ｓｍを介して共通に映像信号
入力端Ｓ。とじて導出される。
列の信号線ｔ１〜７ｍに対応して設けられた走査スイッ
チングトランジスタＳ】〜Ｓｍを介して共通に映像信号
入力端Ｓ。とじて導出される。
該入力端Ｓｏば、画素に映像信号Ｖｖを供給する端子と
しての役目を果す他、画像を維持する場合に、後述する
再生回路との間でデータを入出力するための端子ともな
る。
しての役目を果す他、画像を維持する場合に、後述する
再生回路との間でデータを入出力するための端子ともな
る。
上記走査スイッチングトランジスタ８１〜Ｓｍの各ゲー
トには水平走査回路Ｃから走査信号が与えられて画素の
水平方向走査が制御される。また画素の垂直方向走査は
、垂直走査回路りから、同一行に属する駆動回路の書込
みトランジスタＴｒａ。
トには水平走査回路Ｃから走査信号が与えられて画素の
水平方向走査が制御される。また画素の垂直方向走査は
、垂直走査回路りから、同一行に属する駆動回路の書込
みトランジスタＴｒａ。
或いは読出しトランジスタＴｒｃのゲートに、書込み或
いは読出し信号を与えることにより行われる。
いは読出し信号を与えることにより行われる。
即ち水平走査回路Ｃと垂直走査回路りにより映像信号Ｖ
ｖを書込む画素Ａｉｊを選択し、該画素に対応する駆動
回路の書込みトランジスタＴｒａを通して表示素子駆動
トランジスタＴｒｂをオン又はオフにして表示素子を駆
動する。
ｖを書込む画素Ａｉｊを選択し、該画素に対応する駆動
回路の書込みトランジスタＴｒａを通して表示素子駆動
トランジスタＴｒｂをオン又はオフにして表示素子を駆
動する。
次に画像維持のだめの再生回路Ｅを説明する。
上記走査スイッチングトランジスタ５ｘ−８ｒｎ群から
導出された入力端Ｓｏには、外部からの映像信号による
表示と、既に画素に書込まれているデータに基づく静止
画像表示のいずれによって表示素子を動作させるかを切
換えるだめの第１スイツチング素子が接続されている。
導出された入力端Ｓｏには、外部からの映像信号による
表示と、既に画素に書込まれているデータに基づく静止
画像表示のいずれによって表示素子を動作させるかを切
換えるだめの第１スイツチング素子が接続されている。
該第１スインチング素子は、他端が外来映像信号入力端
となるＭＯＳトランジスタＴｒ＋及びＭＯＳ）ランジス
タＴｒ＋ヲ備えゲートに入力きれた入力切換信号Ｖ１．
Ｖ工によって映像信号を取込むか、外来の信号を切り
離して画像を維持するかを切換える。上記ＭＯ８）ラン
ジスタＴｒ２の他端には、再生回路Ｅにおける画像信号
の読出しと書込みを切換えるための第２スイツチング素
子が接続されている。該第２スイツチング素子はＭＯＳ
）ランジスタＴｒ３及びＭＯＳトランジスタＴｒ４を備
え、ゲートに書込み読出し切替信号Ｒ／Ｗ、Ｒ／Ｗが入
力されて、再生回路Ｅにおける書込み、読出しを制御す
る。尚ＭＯ８）ランジスタＴｒ２とＭＯＳ）ランジスタ
Ｔｒ４との結合点には、画像信号読出し時のプル了ツブ
のためにＭＯＳ）ランジスタＴｒｓが接続されている０
上記第２スイツチング素子の一部であるＭＯＳ）ランジ
スタＴｒ４は、インバータを構成する一方のＭＯＳ）ラ
ンジスタＴｒ６のゲートに接続され、他方のＭＯＳ ）
ランジスタＴｒ７との結合点が上記ＭＯＳトランジスタ
Ｔｒ３の他端に接続されて、再生回路Ｅからの信号読出
し経路を形成する。
となるＭＯＳトランジスタＴｒ＋及びＭＯＳ）ランジス
タＴｒ＋ヲ備えゲートに入力きれた入力切換信号Ｖ１．
Ｖ工によって映像信号を取込むか、外来の信号を切り
離して画像を維持するかを切換える。上記ＭＯ８）ラン
ジスタＴｒ２の他端には、再生回路Ｅにおける画像信号
の読出しと書込みを切換えるための第２スイツチング素
子が接続されている。該第２スイツチング素子はＭＯＳ
）ランジスタＴｒ３及びＭＯＳトランジスタＴｒ４を備
え、ゲートに書込み読出し切替信号Ｒ／Ｗ、Ｒ／Ｗが入
力されて、再生回路Ｅにおける書込み、読出しを制御す
る。尚ＭＯ８）ランジスタＴｒ２とＭＯＳ）ランジスタ
Ｔｒ４との結合点には、画像信号読出し時のプル了ツブ
のためにＭＯＳ）ランジスタＴｒｓが接続されている０
上記第２スイツチング素子の一部であるＭＯＳ）ランジ
スタＴｒ４は、インバータを構成する一方のＭＯＳ）ラ
ンジスタＴｒ６のゲートに接続され、他方のＭＯＳ ）
ランジスタＴｒ７との結合点が上記ＭＯＳトランジスタ
Ｔｒ３の他端に接続されて、再生回路Ｅからの信号読出
し経路を形成する。
上記回路構成において、外部からの映像信号Ｖｖを得て
画像表示中に表示の継続をさせたい場合、入力切換信号
ＶＩによりＭＯＳ）ランジスタＴｒｌをオフにして外部
からの映像信号を遮断し、ＭＯＳトランジスタＴｒ２を
オン釦して映像信号入力端Ｓ。
画像表示中に表示の継続をさせたい場合、入力切換信号
ＶＩによりＭＯＳ）ランジスタＴｒｌをオフにして外部
からの映像信号を遮断し、ＭＯＳトランジスタＴｒ２を
オン釦して映像信号入力端Ｓ。
をデータ補正のためのインバータ側に接続する。
表示素子の各画素について駆動回路と再生回路は、順次
次の１）及び２）の動作を、表示素子中の蓄積容ｔＣ（
ＭＯＳ）ランジスタのゲート酸化膜容量）に蓄えられた
信号が、漏洩等によって消失する時間以内の周期で、全
画素について繰返す。
次の１）及び２）の動作を、表示素子中の蓄積容ｔＣ（
ＭＯＳ）ランジスタのゲート酸化膜容量）に蓄えられた
信号が、漏洩等によって消失する時間以内の周期で、全
画素について繰返す。
１） ｉ行ｊ列の画素の信号レベルを、Ｔｒｃ ＋
Ｔｒ２＋Ｔｒ４を通じて読出し、再生回路側の容量Ｃ′
に表示信号の反転信号として蓄積する。
Ｔｒ２＋Ｔｒ４を通じて読出し、再生回路側の容量Ｃ′
に表示信号の反転信号として蓄積する。
２）再生回路のＴｒ４をオフ、Ｔｒｓをオンにし、Ｔｒ
６ ＋ Ｔｒ７のインバータにより上記容量Ｃ′の信号
を再度反転してＴｒ＋ ＋ Ｔｒｚを通して表示素子側
のＴｒａを経て駆動回路に書込む。
６ ＋ Ｔｒ７のインバータにより上記容量Ｃ′の信号
を再度反転してＴｒ＋ ＋ Ｔｒｚを通して表示素子側
のＴｒａを経て駆動回路に書込む。
上記１） 、 ２）の動作を繰返すことにより、画像が
維持される。
維持される。
表示の維持を中断して再度外部から入力される画像を表
示する場合には、入力切替信号ＶＩによシ第１スイッチ
ング素子を反転し、即ちＴｒｌをオン、Ｔｒｚをオフに
して、外来映像信号Ｖｖを駆動回路側に入力することに
より表示駆動回路は再び映像信号を書込んで表示する。
示する場合には、入力切替信号ＶＩによシ第１スイッチ
ング素子を反転し、即ちＴｒｌをオン、Ｔｒｚをオフに
して、外来映像信号Ｖｖを駆動回路側に入力することに
より表示駆動回路は再び映像信号を書込んで表示する。
上記実施例は２値情報を表示する場合を挙げたが階調画
像を表示する場合は、再生回路におけるデータ補正のだ
めのインバータを、入力信号を適宜補正して出力する回
路を用いて構成する′ことにより同様に実施し得る。
像を表示する場合は、再生回路におけるデータ補正のだ
めのインバータを、入力信号を適宜補正して出力する回
路を用いて構成する′ことにより同様に実施し得る。
まだ再生回路は各画素の駆動回路と一体的に同一基板上
に作製することにより、工程及び部品点数を増やすこと
々〈実施し得る０ 〈効 果〉 以上本発明によれば、簡単な回路を付加するのみで、画
家を表示面に維持させることができ、表示装置の機能を
高め、その利用範囲を著しく拡大することができる。
に作製することにより、工程及び部品点数を増やすこと
々〈実施し得る０ 〈効 果〉 以上本発明によれば、簡単な回路を付加するのみで、画
家を表示面に維持させることができ、表示装置の機能を
高め、その利用範囲を著しく拡大することができる。
第１図及び第２図は従来の表示素子の駆動回路を示す図
、第３図は本発明による一実施例を示す電気回路図、第
４図は同実施例の要部電気回路図である。 Ｔｒａ ：書込みトランジスタ Ｔｒｂ ：表示駆動ト
ランジスタ Ｔｒｃ ：読出しトランジスタ Ｃ：容量
Ａｉｊ：表示素子駆動回路 Ｂｉｊ：表示素子ｔ１〜
ｔｍ：信号線 Ｓ１〜Ｓｍ：走査スイッチングトランジ
スタ Ｓｏ：映像信号入力端 Ｅ 再生回路 Ｔｒ＋
Ｔｒ２：第１スイツチング素子 Ｔｒ３Ｔｒ４：第２ス
イツチング素子 Ｔｒ６Ｔｒ７：インバータ回路
、第３図は本発明による一実施例を示す電気回路図、第
４図は同実施例の要部電気回路図である。 Ｔｒａ ：書込みトランジスタ Ｔｒｂ ：表示駆動ト
ランジスタ Ｔｒｃ ：読出しトランジスタ Ｃ：容量
Ａｉｊ：表示素子駆動回路 Ｂｉｊ：表示素子ｔ１〜
ｔｍ：信号線 Ｓ１〜Ｓｍ：走査スイッチングトランジ
スタ Ｓｏ：映像信号入力端 Ｅ 再生回路 Ｔｒ＋
Ｔｒ２：第１スイツチング素子 Ｔｒ３Ｔｒ４：第２ス
イツチング素子 Ｔｒ６Ｔｒ７：インバータ回路
Claims (1)
- 【特許請求の範囲】 １）入力された信号線のデータを、表示画素毎に設けら
れたデータ書込み素子を経てデータ保持素子に入力し、
各画素の表示素子を駆動すると共に、表示素子の駆動電
圧を上記信号線に読出すだめのデータ読出し素子を備え
てなる表示装置において、上記信号線に、信号線に読出
された表示素子の駆動電圧を再生して信号線に戻すデー
タ再生回路を付加してなることを特徴とする表示装置の
駆動回路。 ２）前記データ再生回路は、データの取込みを制御する
第１のスイッチング素子と、信号線を読出し又は書込み
に切換える第２のスイッチング素子と、第２スイツチン
グ素子を通して読出された信号線のデータを、レベル調
整して信号線に送り出すだめの補正回路とを含んでなる
ことを特徴とする特許請求の範囲第１項記載の表示装置
の駆動回路。
Priority Applications (6)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58082922A JPS59208590A (ja) | 1983-05-11 | 1983-05-11 | 表示装置の駆動回路 |
| EP83108891A EP0128238B1 (en) | 1983-05-11 | 1983-09-08 | Display circuit |
| DE3382770T DE3382770T2 (de) | 1983-05-11 | 1983-09-08 | Anzeigeeinrichtung. |
| US06/530,472 US4574315A (en) | 1983-05-11 | 1983-09-08 | Circuit for driving display apparatus |
| DE8383108891T DE3382034D1 (de) | 1983-05-11 | 1983-09-08 | Anzeigeeinrichtung. |
| EP90103731A EP0378249B1 (en) | 1983-05-11 | 1983-09-08 | Display circuit |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58082922A JPS59208590A (ja) | 1983-05-11 | 1983-05-11 | 表示装置の駆動回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS59208590A true JPS59208590A (ja) | 1984-11-26 |
Family
ID=13787728
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP58082922A Pending JPS59208590A (ja) | 1983-05-11 | 1983-05-11 | 表示装置の駆動回路 |
Country Status (4)
| Country | Link |
|---|---|
| US (1) | US4574315A (ja) |
| EP (2) | EP0128238B1 (ja) |
| JP (1) | JPS59208590A (ja) |
| DE (2) | DE3382770T2 (ja) |
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6310182A (ja) * | 1986-07-01 | 1988-01-16 | 日本電気株式会社 | アクテイブマトリクスアレイ |
| JP2004536347A (ja) * | 2001-07-14 | 2004-12-02 | コーニンクレッカ フィリップス エレクトロニクス エヌ ヴィ | アクティブマトリックスディスプレイ装置 |
| JP2010217902A (ja) * | 2004-12-24 | 2010-09-30 | Samsung Mobile Display Co Ltd | 発光表示装置の駆動方法 |
Families Citing this family (12)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US4701799A (en) * | 1984-03-13 | 1987-10-20 | Sharp Kabushiki Kaisha | Image display panel drive |
| US5070409A (en) * | 1989-06-13 | 1991-12-03 | Asahi Kogaku Kogyo Kabushiki Kaisha | Liquid crystal display device with display holding device |
| JP2582644B2 (ja) * | 1989-08-10 | 1997-02-19 | 富士写真フイルム株式会社 | 平面型画像表示装置 |
| JPH0758635B2 (ja) * | 1989-11-24 | 1995-06-21 | 富士ゼロックス株式会社 | Ｅｌ駆動回路 |
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