JPS5917894B2 - パルス幅信号変換器 - Google Patents
パルス幅信号変換器Info
- Publication number
- JPS5917894B2 JPS5917894B2 JP52143652A JP14365277A JPS5917894B2 JP S5917894 B2 JPS5917894 B2 JP S5917894B2 JP 52143652 A JP52143652 A JP 52143652A JP 14365277 A JP14365277 A JP 14365277A JP S5917894 B2 JPS5917894 B2 JP S5917894B2
- Authority
- JP
- Japan
- Prior art keywords
- circuit
- pulse width
- transformer
- width signal
- signal
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired
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- Analogue/Digital Conversion (AREA)
- Manipulation Of Pulses (AREA)
Description
【発明の詳細な説明】
本発明は、微少な入力直流信号を電気的に絶縁するとと
もに、この入力直流信号に対応するパルス幅信号を得る
パルス幅信号変換器に関するものである。
もに、この入力直流信号に対応するパルス幅信号を得る
パルス幅信号変換器に関するものである。
本発明の目的は、簡単な構成で微小な直流信号を電気的
に絶縁し、微小信号の大きさに関連した2種のパルス幅
信号を得ることのできる装置を実現しようとすることに
ある。
に絶縁し、微小信号の大きさに関連した2種のパルス幅
信号を得ることのできる装置を実現しようとすることに
ある。
第1図は本発明の一実施例を示す接続図である。
図において、lL12は入力直流信号Eiが印加される
入力端子、Cは入力端子11,12間に接続したコンデ
ンサ、Dl、D2は互に逆極性に並列接続したダイオー
ドで、これらは並列ダイオード回路りを構成している。
入力端子、Cは入力端子11,12間に接続したコンデ
ンサ、Dl、D2は互に逆極性に並列接続したダイオー
ドで、これらは並列ダイオード回路りを構成している。
TRは一次巻線n1゜二次巻線n2および三次巻線n3
を有するトランス、21.22は二次巻線n2の両端
に接続された出力端子、O8は三次巻線n3に接続され
たパルス発生器である。
を有するトランス、21.22は二次巻線n2の両端
に接続された出力端子、O8は三次巻線n3に接続され
たパルス発生器である。
トランスTRの一次巻線n1 は、並列ダイオード回路
りを介して入力端子11,12に接続され、これらは入
力回路を構成し、また二次巻線n2は出力回路を構成し
ている。
りを介して入力端子11,12に接続され、これらは入
力回路を構成し、また二次巻線n2は出力回路を構成し
ている。
第2図は並列ダイオード回路りの特性線図で、加わる電
圧e1 と流れる電流11 とは図示するように非
線形の関係をもっている。
圧e1 と流れる電流11 とは図示するように非
線形の関係をもっている。
このように構成した装置において、トランスTRの一次
巻線n1 と二次巻線n2 との巻数比を1=1とし
、三次巻線n3に正負対称のパルス信号i。
巻線n1 と二次巻線n2 との巻数比を1=1とし
、三次巻線n3に正負対称のパルス信号i。
を与えるものとすればその等価回路は第3図に示す通り
となる。
となる。
第3図の等価回路において、スイッチSはダイオードD
1.D2のスイッチング動作を表示したものであって、
パルス発生器O8から正極性のパルスが印加されると、
スイッチSが接点a側に接続され(ダイオードD1が導
通)、負極性のパルスが印加されるとスイッチSが接点
す側に接続される(ダイオードD2が導通)。
1.D2のスイッチング動作を表示したものであって、
パルス発生器O8から正極性のパルスが印加されると、
スイッチSが接点a側に接続され(ダイオードD1が導
通)、負極性のパルスが印加されるとスイッチSが接点
す側に接続される(ダイオードD2が導通)。
ダイオードD1゜D2は、いずれも順方向電圧Δで表わ
される。
される。
いま、パルス発生器O8から正極性のパルス+Io、が
印加されている状態では、スイッチSは接点aに接続さ
れたのと等価(ダイオードD1が導通)となり、トラン
スTRを代表するコイルのインダクタンスをLlそこを
流れる電流をiLとするとパルスの立上り時には(1)
式が成立する。
印加されている状態では、スイッチSは接点aに接続さ
れたのと等価(ダイオードD1が導通)となり、トラン
スTRを代表するコイルのインダクタンスをLlそこを
流れる電流をiLとするとパルスの立上り時には(1)
式が成立する。
同様に、パルス発生器O8から負極性のパルス−Ioが
印加されている状態では、スイッチSは接点すに接続さ
れたのと等価(ダイオードD2が導通)となり、パルス
の立下り時には(2)式が成立する。
印加されている状態では、スイッチSは接点すに接続さ
れたのと等価(ダイオードD2が導通)となり、パルス
の立下り時には(2)式が成立する。
(1)式において、iLが一■oから■。
に達するまでの時間t1 を求めると(3)式で表わす
ことができる。
ことができる。
また、(2)式において、iLか■。
から−Ioに達するまでの時間t2を求めると(4)式
で表わすことができる。
で表わすことができる。
したがって、二次巻線n2(出力回路)の出力端子21
,22間には、コイルを流れる電流(it、)が変化し
ている時間だけ電圧信号が生ずることとなり、この電圧
信号eは、(3)式、(4)式に示すような入力直流信
号Eiに関連したパルス幅(時間幅)tl、t2を有す
る2種のパルス幅信号となる。
,22間には、コイルを流れる電流(it、)が変化し
ている時間だけ電圧信号が生ずることとなり、この電圧
信号eは、(3)式、(4)式に示すような入力直流信
号Eiに関連したパルス幅(時間幅)tl、t2を有す
る2種のパルス幅信号となる。
第4図は、第3図回路の動作波形図である。
パルス発生器O8から、第4図イに示すようなIo、−
I。
I。
に変化するパルス信号を与えるものとすると、ダイオー
ド回路りと入力端子11゜12側の入力回路には、第4
図口に示すような電a11 .12がパルスの立上り時
、パルスの立下り時に流れ、また、インダクタンスLに
は第4図ハに示すような電流ILが流れる。
ド回路りと入力端子11゜12側の入力回路には、第4
図口に示すような電a11 .12がパルスの立上り時
、パルスの立下り時に流れ、また、インダクタンスLに
は第4図ハに示すような電流ILが流れる。
ここで、11゜12が零になるまでの時間t1.t2は
、(3)式および(4)式で表わされる。
、(3)式および(4)式で表わされる。
インダクタンスLに、第4図ハに示すような直線的に上
昇又は下降する電流iLが流れると、出力端子21,2
2間には、第4図二に示すようなパルス幅t1.t2の
信号eを得ることができる。
昇又は下降する電流iLが流れると、出力端子21,2
2間には、第4図二に示すようなパルス幅t1.t2の
信号eを得ることができる。
第5図および第6図は本発明の他の実施例を示す接続図
である。
である。
第5図の実施例は、複数個(ここでは2つの入力につい
てのみ示す)の入力直流信号Ei2. Ei2を並列的
にパルス幅信号に変換できるようにしたものであって、
各トランスTRの三次巻線n3を互に直列に接続し1.
これにパルス発生器O8から駆動用のパルス信号i。
てのみ示す)の入力直流信号Ei2. Ei2を並列的
にパルス幅信号に変換できるようにしたものであって、
各トランスTRの三次巻線n3を互に直列に接続し1.
これにパルス発生器O8から駆動用のパルス信号i。
を与えるようにしたものである。
ここで、パルス発生器O8は、矩形波発振器OSC,こ
の発振器からの出力信号を入力するダイオードブリッジ
回路、FETの定電流性を利用した定電流素子Qとを含
む正負極性定電流源C8で構成したものである。
の発振器からの出力信号を入力するダイオードブリッジ
回路、FETの定電流性を利用した定電流素子Qとを含
む正負極性定電流源C8で構成したものである。
第6図の実施例は、一次巻線n1.二次巻線n2を有す
るトランスTRを用い、パルス発生器O8を二次巻線n
2の両端に接続したものである。
るトランスTRを用い、パルス発生器O8を二次巻線n
2の両端に接続したものである。
この場合も動作は第1図回路と全く同様である。
なお、パルス発生器O8は一次巻線n1の両端A。
B間に接続するようにしてもよい。
第7図〜第9図は並列ダイオード回路りの他の例を示す
接続図である。
接続図である。
第7図は複数個のダイオードを直列に接続したものを並
列接続して構成したものである。
列接続して構成したものである。
直列に接続されるダイオードの数を変えることによって
順方向電圧Δを調整できる。
順方向電圧Δを調整できる。
第8図はトランジスタをダイオード接続し、これを逆極
性に互に並列接続して構成したものである。
性に互に並列接続して構成したものである。
第9図はツェナーダイオードを並列接続して構成したも
のである。
のである。
なお、上記の実施例において、トランスTRの一次巻線
n1 と二次巻線n2 との比は1:1でなくともよい
。
n1 と二次巻線n2 との比は1:1でなくともよい
。
また、入力端子11,12間に接続したコンデンサCは
なくともよい。
なくともよい。
以上に説明したように、本発明によれば、次に列挙する
ような種々の特長をもった微小信号を絶縁し、かつパル
ス幅信号に変換する機能をもったパルス幅信号変換器が
実現できる。
ような種々の特長をもった微小信号を絶縁し、かつパル
ス幅信号に変換する機能をもったパルス幅信号変換器が
実現できる。
(1)全体をトランス、ダイオード回路で実現できるの
で構成が簡単でかつ小形にできる。
で構成が簡単でかつ小形にできる。
(11)機械的接点をもたないので長寿命、高信頼性が
期待できる。
期待できる。
(曲トランスの三次巻線あるいは二次巻線側にパルス発
生器を接続すれば、一次巻線側に電源や制御信号等を必
要とせず、本質安全性が高い。
生器を接続すれば、一次巻線側に電源や制御信号等を必
要とせず、本質安全性が高い。
【図面の簡単な説明】
第1図は、本発明の一実施例を示す接続図、第2図は本
発明に用いられる並列ダイオード回路の特性線図、第3
図は第1図回路の等両回路、第4図はその動作波形図、
第5図および第6図は本発明の他の実施例を示す接続図
、第7図〜第9図は並列ダイオード回路の他の例を示す
接続図である。 11.12・・・入力端子、2L22・・・出力端子、
D・・・並列ダイオード回路、TR・・・トランス、n
l・・・一次巻線、n2・・・二次巻線、n3・・・三
次巻線、O8・・・パルス発生器、C・・・コンデンサ
。
発明に用いられる並列ダイオード回路の特性線図、第3
図は第1図回路の等両回路、第4図はその動作波形図、
第5図および第6図は本発明の他の実施例を示す接続図
、第7図〜第9図は並列ダイオード回路の他の例を示す
接続図である。 11.12・・・入力端子、2L22・・・出力端子、
D・・・並列ダイオード回路、TR・・・トランス、n
l・・・一次巻線、n2・・・二次巻線、n3・・・三
次巻線、O8・・・パルス発生器、C・・・コンデンサ
。
Claims (1)
- 【特許請求の範囲】 1 一次巻線、二次巻線を有するトランス、印加電圧が
所定値以上になると電流か流れ出すような非線形の電圧
対電流特性をもった非線形回路、入力直流信号を前記非
線形回路を介してトランスの一次巻線に与える回路手段
、トランスの一次巻線。 二次巻線、該トランスに設けた三次巻線のいずれかに矩
形波状のパルス信号を与える手段を具備し、前記トラン
スの二次巻線から前記入力直流信号に対応したパルス幅
信号を得るようにしたパルス幅信号変換器。 2 非線形回路としてダイオードを互に逆極性に並列接
続した回路を用いた特許請求の範囲第1項記載のパルス
幅信号変換器。 3 非線形回路としてトランジスタをダイオード接続し
たものを互に逆極性に並列接続した回路を用いた特許請
求の範囲第1項記載のパルス幅信号変換器。 4 非線形回路としてツェナーダイオードを互に逆極性
に並列接続した回路を用いた特許請求の範囲第1項記載
のパルス幅信号変換器。 5 矩形波状のパルス信号を与える手段を、矩形波発振
器と、この矩形波発振器からの出力信号を入力とするダ
イオードブリッジ回路と定電流素子とを含む正負極性定
電流源とで構成した特許請求の範囲第1項記載のパルス
幅信号変換器。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP52143652A JPS5917894B2 (ja) | 1977-11-30 | 1977-11-30 | パルス幅信号変換器 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP52143652A JPS5917894B2 (ja) | 1977-11-30 | 1977-11-30 | パルス幅信号変換器 |
Related Child Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP23006983A Division JPS5946132B2 (ja) | 1983-12-06 | 1983-12-06 | アナログデイジタル変換器 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS5476055A JPS5476055A (en) | 1979-06-18 |
JPS5917894B2 true JPS5917894B2 (ja) | 1984-04-24 |
Family
ID=15343760
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP52143652A Expired JPS5917894B2 (ja) | 1977-11-30 | 1977-11-30 | パルス幅信号変換器 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS5917894B2 (ja) |
Cited By (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US9052366B2 (en) | 2000-03-27 | 2015-06-09 | Midtronics, Inc. | Battery testers with secondary functionality |
US9201120B2 (en) | 2010-08-12 | 2015-12-01 | Midtronics, Inc. | Electronic battery tester for testing storage battery |
US9229062B2 (en) | 2010-05-27 | 2016-01-05 | Midtronics, Inc. | Electronic storage battery diagnostic system |
US10608353B2 (en) | 2016-06-28 | 2020-03-31 | Midtronics, Inc. | Battery clamp |
-
1977
- 1977-11-30 JP JP52143652A patent/JPS5917894B2/ja not_active Expired
Cited By (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US9052366B2 (en) | 2000-03-27 | 2015-06-09 | Midtronics, Inc. | Battery testers with secondary functionality |
US9229062B2 (en) | 2010-05-27 | 2016-01-05 | Midtronics, Inc. | Electronic storage battery diagnostic system |
US9201120B2 (en) | 2010-08-12 | 2015-12-01 | Midtronics, Inc. | Electronic battery tester for testing storage battery |
US10608353B2 (en) | 2016-06-28 | 2020-03-31 | Midtronics, Inc. | Battery clamp |
Also Published As
Publication number | Publication date |
---|---|
JPS5476055A (en) | 1979-06-18 |
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