JPS5917742A - 選択呼出受信装置 - Google Patents
選択呼出受信装置Info
- Publication number
- JPS5917742A JPS5917742A JP57126906A JP12690682A JPS5917742A JP S5917742 A JPS5917742 A JP S5917742A JP 57126906 A JP57126906 A JP 57126906A JP 12690682 A JP12690682 A JP 12690682A JP S5917742 A JPS5917742 A JP S5917742A
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- JP
- Japan
- Prior art keywords
- circuit
- signal
- frame
- frames
- frame number
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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Classifications
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04W—WIRELESS COMMUNICATION NETWORKS
- H04W84/00—Network topologies
Landscapes
- Engineering & Computer Science (AREA)
- Computer Networks & Wireless Communication (AREA)
- Signal Processing (AREA)
- Mobile Radio Communication Systems (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明は呼出し効率を改善した選択呼出受信装置に関す
るものである。
るものである。
第１図は従来のＮＲＺ送信送信信号−構成例であり、復
号器内のクロックと送信信号との位相調整をする為のタ
イミング信号ａ（以下プリアンプル信号と称する。）を
５７６ビツト、フレームのタイミングをとる信号ｂ（以
下同期信号と称する。）を３２ビツト、個別呼出信号と
メソセージ信号Ｃを各々３２ビツトで、計６４ビットを
１つのフレーム番号て８つのフレームで構成し、これを
１つのブ０ツクとしてその繰り返しを送信する。この場
合を例にとり、従来の復号器を第２図に従って説明する
。
号器内のクロックと送信信号との位相調整をする為のタ
イミング信号ａ（以下プリアンプル信号と称する。）を
５７６ビツト、フレームのタイミングをとる信号ｂ（以
下同期信号と称する。）を３２ビツト、個別呼出信号と
メソセージ信号Ｃを各々３２ビツトで、計６４ビットを
１つのフレーム番号て８つのフレームで構成し、これを
１つのブ０ツクとしてその繰り返しを送信する。この場
合を例にとり、従来の復号器を第２図に従って説明する
。
同図において、５はアンテナ、６は無線部、７はビット
同期回路、８は発振回路、９は分周回路、１０はタイε
フッ位相調整回路、１１は照合回路、１２はフレーム・
ビット・タイミング回路、１３はプリアンプル発生回路
、 °゛−場幽漬ｈ１４はプリアンプルフラグ回
路、１５は同期発生回路、１６はタイマー、１７はＡＮ
Ｄ回路、１８は同期フラグ回路、１９は番号信号発生回
路、２０は番号記憶回路、２１はＡＮＤ回路、２２は鳴
音発生回路、２３はスピーカー、２４は表示コントロー
ル回路、２５は表示素子、２６はフレーム識別回路であ
る。
同期回路、８は発振回路、９は分周回路、１０はタイε
フッ位相調整回路、１１は照合回路、１２はフレーム・
ビット・タイミング回路、１３はプリアンプル発生回路
、 °゛−場幽漬ｈ１４はプリアンプルフラグ回
路、１５は同期発生回路、１６はタイマー、１７はＡＮ
Ｄ回路、１８は同期フラグ回路、１９は番号信号発生回
路、２０は番号記憶回路、２１はＡＮＤ回路、２２は鳴
音発生回路、２３はスピーカー、２４は表示コントロー
ル回路、２５は表示素子、２６はフレーム識別回路であ
る。
次にこの復号器の動作を説明１゛る。
第１図に示した送信されたＮＲＺ信号ｄはアンブナ６を
介して無線部６て取り込まれ、変換・検波され、ヒント
同期回路７に人力きハる。一方、発振回路８２分周（ロ
）路９を通してクロックｅかタイミング・位相調整回路
１０に入力される。タイミンク・位相調整回路１０とヒ
／１・同期回路７においては復号器内の内部クロックｅ
とＮＲＺ信号ｄの位相調整を行なう為に補正パルスを出
して内部クロックを補正していく。
介して無線部６て取り込まれ、変換・検波され、ヒント
同期回路７に人力きハる。一方、発振回路８２分周（ロ
）路９を通してクロックｅかタイミング・位相調整回路
１０に入力される。タイミンク・位相調整回路１０とヒ
／１・同期回路７においては復号器内の内部クロックｅ
とＮＲＺ信号ｄの位相調整を行なう為に補正パルスを出
して内部クロックを補正していく。
ビット同期されたＮＲＺ信号は照合回路１１に順次送ら
れていく。タイミンク・位相調整回路１０よりビット同
期されたイ言号は、フレーム・ビットタイミング回路１
２に入力され、プリアンプル信号発生回路１３を、駆動
し、送信のグリア／グル信号パターント同一のパターン
を照合回路１１へ送出する。照合回路１１においてグリ
アンブルパターンが照合された時、プリアンプルフラグ
回路１４に「ＨＪ倍信号送出される。プリアンプルフラ
グ回路１４では、プリアンプル照合されると［ＨＪ信号
ヲ送出し、かつラッチし、フレームビットタイミング回
路１２を駆動することによって、送信の同期信号と同一
のパターンが格納されている同期信号発生Ｕ「ｖ、ｌ路
１５を駆動し、そのパターンを照合回路１１に送ると共
に、タイマー１６をスタートさせる。タイマー１６は、
プリアンフ゛ルイ菖号＋（同期信号＋８フレーム）×２
の長さ分だけをカランｌ−した後、プリアンプルフラグ
回路をリセットするＲ ｉ （８号、以下プリアンプル
ノラクＩ！７］回路がＪ’ ＨＪになっ−Ｃからプリア
ンプルフラグ回路をリセットする丑でをプリアンプル保
持と称する。）ＡＮＤ回路１７は２人力ＡＮＤゲートで
ありプリアンプル保持の条件下ではＡＮＤ回路１７の出
力か１−Ｈ」となる。もし、プリアンプル保持が終了し
ていると、同期照合がされていても以降の照合ｄ：全く
無意味である。次に、ＡＮＤ回路の出力１’−Ｈ」が同
期フラグ回路１８に入力されると、出力に「Ｈ」信号を
出力し、かつラッチする。その同期フラグ回路１８より
［ＨＪが出力されると、フレームビットタイミング回路
１２を駆動することによって、番号信号発生回路１９を
駆動する。
れていく。タイミンク・位相調整回路１０よりビット同
期されたイ言号は、フレーム・ビットタイミング回路１
２に入力され、プリアンプル信号発生回路１３を、駆動
し、送信のグリア／グル信号パターント同一のパターン
を照合回路１１へ送出する。照合回路１１においてグリ
アンブルパターンが照合された時、プリアンプルフラグ
回路１４に「ＨＪ倍信号送出される。プリアンプルフラ
グ回路１４では、プリアンプル照合されると［ＨＪ信号
ヲ送出し、かつラッチし、フレームビットタイミング回
路１２を駆動することによって、送信の同期信号と同一
のパターンが格納されている同期信号発生Ｕ「ｖ、ｌ路
１５を駆動し、そのパターンを照合回路１１に送ると共
に、タイマー１６をスタートさせる。タイマー１６は、
プリアンフ゛ルイ菖号＋（同期信号＋８フレーム）×２
の長さ分だけをカランｌ−した後、プリアンプルフラグ
回路をリセットするＲ ｉ （８号、以下プリアンプル
ノラクＩ！７］回路がＪ’ ＨＪになっ−Ｃからプリア
ンプルフラグ回路をリセットする丑でをプリアンプル保
持と称する。）ＡＮＤ回路１７は２人力ＡＮＤゲートで
ありプリアンプル保持の条件下ではＡＮＤ回路１７の出
力か１−Ｈ」となる。もし、プリアンプル保持が終了し
ていると、同期照合がされていても以降の照合ｄ：全く
無意味である。次に、ＡＮＤ回路の出力１’−Ｈ」が同
期フラグ回路１８に入力されると、出力に「Ｈ」信号を
出力し、かつラッチする。その同期フラグ回路１８より
［ＨＪが出力されると、フレームビットタイミング回路
１２を駆動することによって、番号信号発生回路１９を
駆動する。
番号信号発生回路１９が駆動されると、あらかじめポケ
ットベル固有に蓄えられた番号記憶回路２０（例えはＦ
ＲＯＭ ）を、駆動しかつ呼出番号を読み出し、照合回
路１１へ送出される。壕だ、同期フラグ回路１８のｒＨ
Ｊ出力はプリアンプル保持と同様に、タイマー回路を、
駆動し、（同期信号→−８フレーム）ｘ２の長さ分だけ
をカウントシた後、同期ノラク回路１８をリセットする
。（Ｒ２（言号。
ットベル固有に蓄えられた番号記憶回路２０（例えはＦ
ＲＯＭ ）を、駆動しかつ呼出番号を読み出し、照合回
路１１へ送出される。壕だ、同期フラグ回路１８のｒＨ
Ｊ出力はプリアンプル保持と同様に、タイマー回路を、
駆動し、（同期信号→−８フレーム）ｘ２の長さ分だけ
をカウントシた後、同期ノラク回路１８をリセットする
。（Ｒ２（言号。
以下同期フラグ回路が［ＨＪになってから同期ノラク回
路をリセットするまでを同期保持と称する。）呼出番号
が照合されると、ＡＮＤ２回路２１へ「Ｈ」が出力され
る。ＡＮＤ２回路２１は２人力ＡＮＤゲートであり、同
期保持の条件下では、ＡＮＤ２回路２１の出力か［ＨＪ
となり鳴音発生回路２２を駆動し、所定の鳴音パターン
で発音体２３（例えはスピーカ）を駆動する。この際、
例えは、マイコン等で構成される表示コントロール回路
２４゜表示素子２５等を設けることによって、各フレー
ムの後半３２ビツトに表示用データを設ける送信方式の
場合は、発音体２３による鳴音と共に表示素子２５によ
る表示（置番号、メノセ〜ジ）を行なうことも可である
。呼出番号かどのフレームに属するかは、あらかじめ番
号記憶回路２ｏの一一部に蓄えられていて、番号信号発
生回路１９は常に番号記憶回路２０の一部を駆動し、こ
れをフレーム識別回路２６で読み取り、フレームビット
タイミング回路１２に送り、どのフレームを電源トライ
ブするかを決定している。
路をリセットするまでを同期保持と称する。）呼出番号
が照合されると、ＡＮＤ２回路２１へ「Ｈ」が出力され
る。ＡＮＤ２回路２１は２人力ＡＮＤゲートであり、同
期保持の条件下では、ＡＮＤ２回路２１の出力か［ＨＪ
となり鳴音発生回路２２を駆動し、所定の鳴音パターン
で発音体２３（例えはスピーカ）を駆動する。この際、
例えは、マイコン等で構成される表示コントロール回路
２４゜表示素子２５等を設けることによって、各フレー
ムの後半３２ビツトに表示用データを設ける送信方式の
場合は、発音体２３による鳴音と共に表示素子２５によ
る表示（置番号、メノセ〜ジ）を行なうことも可である
。呼出番号かどのフレームに属するかは、あらかじめ番
号記憶回路２ｏの一一部に蓄えられていて、番号信号発
生回路１９は常に番号記憶回路２０の一部を駆動し、こ
れをフレーム識別回路２６で読み取り、フレームビット
タイミング回路１２に送り、どのフレームを電源トライ
ブするかを決定している。
即ち、従来の（ｇ号送出方式・復号方式であると、呼出
しのフレーム位置か一定であるため、た捷たま同一のフ
レームに呼出しが殺到すると、例えば８フレーム構成で
あれば、８フレームの一回の繰り返しに対し、同一フレ
ームは一回しか使用出来ないので、急には多数の呼出し
を処理できず待時間が多くな９呼出効率が悪くなる欠点
があった。
しのフレーム位置か一定であるため、た捷たま同一のフ
レームに呼出しが殺到すると、例えば８フレーム構成で
あれば、８フレームの一回の繰り返しに対し、同一フレ
ームは一回しか使用出来ないので、急には多数の呼出し
を処理できず待時間が多くな９呼出効率が悪くなる欠点
があった。
本発明は上記の従来の欠点を除去したものであって、以
１本発明をその一実施例によシ図面と共に説明する。第
４図において、２７はフレーム番号発生回路、２８は電
圧を抵抗でプルダウンしてスイッチを介して入力するだ
めのフレーム制御信号の入力端子である。他の第２図と
同様な符号は同一の名称を表わす。
１本発明をその一実施例によシ図面と共に説明する。第
４図において、２７はフレーム番号発生回路、２８は電
圧を抵抗でプルダウンしてスイッチを介して入力するだ
めのフレーム制御信号の入力端子である。他の第２図と
同様な符号は同一の名称を表わす。
次にこの実施例の動作を説明する。例えは第５図イに示
す様にフレームか８個（Ｆ１〜Ｆｓ）で構成されている
場合に、記憶回路２０（通常ＦＲＯＭ）には、個別番号
と共に、フレームの番号が３ビツトのレジスターにより
貯えられている。従って例えば第６番のフレームＦ５の
個別番号を選択するに当っては、先ず番号信号発生回路
１９より番号記憶回路２Ｑヘタイξング信号Ｐか発せら
れた時、前記フレームＦ５に相当する３ヒントのフレー
ムＮｏ信号「１ｏ１」ｑがフレーム識別（ロ）路２６へ
送出される。この時第６図に示すようにフレーム識別回
路２６を経由したフレームＮｏ信号イは、フレーム番号
発生回路２７を通して同図口のようにフレームＦ５の時
のみフレームビットタイミング回路１２にパルスが出力
され、このタイミングでのみ入力信号を受は付ける。し
かし、フレーム制御端子２８がｒＨＪ側に選択された場
合には第６図ハで示すように、フレーム番号発生回路２
７の出力は全タイミングで「ＨＪとなり、全てのフレー
ムを選択するようになる。
す様にフレームか８個（Ｆ１〜Ｆｓ）で構成されている
場合に、記憶回路２０（通常ＦＲＯＭ）には、個別番号
と共に、フレームの番号が３ビツトのレジスターにより
貯えられている。従って例えば第６番のフレームＦ５の
個別番号を選択するに当っては、先ず番号信号発生回路
１９より番号記憶回路２Ｑヘタイξング信号Ｐか発せら
れた時、前記フレームＦ５に相当する３ヒントのフレー
ムＮｏ信号「１ｏ１」ｑがフレーム識別（ロ）路２６へ
送出される。この時第６図に示すようにフレーム識別回
路２６を経由したフレームＮｏ信号イは、フレーム番号
発生回路２７を通して同図口のようにフレームＦ５の時
のみフレームビットタイミング回路１２にパルスが出力
され、このタイミングでのみ入力信号を受は付ける。し
かし、フレーム制御端子２８がｒＨＪ側に選択された場
合には第６図ハで示すように、フレーム番号発生回路２
７の出力は全タイミングで「ＨＪとなり、全てのフレー
ムを選択するようになる。
以上説明したように本発明によれば、フレーム制御信号
を入力すること傾より、全てのフレーム全照合でき、ま
た前記フレーム制御信号の無い場合には特定のフレーム
のみ照合するように切替えることができるので、特に呼
出トランイックの多い場合に用いて、はとんど回路的に
変更なく高効率の呼出しが行える利点を有し、その工業
的価値は犬である。
を入力すること傾より、全てのフレーム全照合でき、ま
た前記フレーム制御信号の無い場合には特定のフレーム
のみ照合するように切替えることができるので、特に呼
出トランイックの多い場合に用いて、はとんど回路的に
変更なく高効率の呼出しが行える利点を有し、その工業
的価値は犬である。
第１図は従来の選択呼出受信装置に用いる信号の構成を
示す説明図、第２図はその回路構成を示すブロック図、
第３図は本発明の一実施例による選択呼出受信装置に用
いる信号の構成を示す説明図、第４図はその回路構成を
示すブロック図、第５図、第６図はその動作説明のため
の信号構成例と波形図である。 １２・・・・・・フレームビットタイミング回路、２０
・・・・・・番号記憶回路、２６・・・・・フレーム識
別回路、２７・ ・フレーム番号発生回路、２８・・・
・フレーム制御信号入力端子。 代理人の氏名 弁理士 中 尾 敏 男 ほか１名２ 第６図 ｆハ→ θしヘシレ Ｏしヘフν ２４１−
示す説明図、第２図はその回路構成を示すブロック図、
第３図は本発明の一実施例による選択呼出受信装置に用
いる信号の構成を示す説明図、第４図はその回路構成を
示すブロック図、第５図、第６図はその動作説明のため
の信号構成例と波形図である。 １２・・・・・・フレームビットタイミング回路、２０
・・・・・・番号記憶回路、２６・・・・・フレーム識
別回路、２７・ ・フレーム番号発生回路、２８・・・
・フレーム制御信号入力端子。 代理人の氏名 弁理士 中 尾 敏 男 ほか１名２ 第６図 ｆハ→ θしヘシレ Ｏしヘフν ２４１−
Claims (1)
- プリアンプル信号と、同期信号と、複数個のフレームの
個別信号とからなる選択呼出信号を受信して復号器と、
前記復号器に固有の自己のフレーム番号を記憶する記憶
手段と、前記フレーム番号読出し時に前記フレーム番号
を識別するル−ム識別回路と、前記フレーム識別回路の
出力により自己のフレーム番号のタイピングに合せて選
択信号を出力するフレーム番号発生回路とを備え、前記
フレーム番号発生回路にフレーム制御信号を入力時に、
前記自己のフレーム番号を無視して全てのフレームを選
択することを特徴とする選択呼出受信装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57126906A JPS5917742A (ja) | 1982-07-20 | 1982-07-20 | 選択呼出受信装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57126906A JPS5917742A (ja) | 1982-07-20 | 1982-07-20 | 選択呼出受信装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS5917742A true JPS5917742A (ja) | 1984-01-30 |
Family
ID=14946816
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP57126906A Pending JPS5917742A (ja) | 1982-07-20 | 1982-07-20 | 選択呼出受信装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5917742A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| EP0219320A2 (en) | 1985-10-09 | 1987-04-22 | Westinghouse Electric Corporation | High-reliability fiber-optic repeater |
| JPS62143528A (ja) * | 1985-12-18 | 1987-06-26 | Nec Corp | 表示付無線選択呼出受信機 |
-
1982
- 1982-07-20 JP JP57126906A patent/JPS5917742A/ja active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| EP0219320A2 (en) | 1985-10-09 | 1987-04-22 | Westinghouse Electric Corporation | High-reliability fiber-optic repeater |
| JPS62143528A (ja) * | 1985-12-18 | 1987-06-26 | Nec Corp | 表示付無線選択呼出受信機 |
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