JPS59143439A - 等化方式 - Google Patents
等化方式Info
- Publication number
- JPS59143439A JPS59143439A JP1696083A JP1696083A JPS59143439A JP S59143439 A JPS59143439 A JP S59143439A JP 1696083 A JP1696083 A JP 1696083A JP 1696083 A JP1696083 A JP 1696083A JP S59143439 A JPS59143439 A JP S59143439A
- Authority
- JP
- Japan
- Prior art keywords
- frequency
- channel
- delay
- pulse
- amplitude
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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Classifications
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04K—SECRET COMMUNICATION; JAMMING OF COMMUNICATION
- H04K1/00—Secret communication
- H04K1/04—Secret communication by frequency scrambling, i.e. by transposing or inverting parts of the frequency band or by inverting the whole band
Landscapes
- Engineering & Computer Science (AREA)
- Computer Networks & Wireless Communication (AREA)
- Signal Processing (AREA)
- Cable Transmission Systems, Equalization Of Radio And Reduction Of Echo (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
（ａ） 発明の技術分野
本発明は周波数分割・周波数入替スクランブル方式の暗
号装置に係り、伝送路による歪を等化する等化方式に関
する。
号装置に係り、伝送路による歪を等化する等化方式に関
する。
（ｂ） 従来技術と問題点
第１図は従来例の周波数分割・周波数入替スクランブル
方式のアナログ暗号装置の構成を示すブロック図、第２
図は周波数入替の状況を示す図、第３図は伝送路の周波
数損失特性及び周波数遅延特性図、第４図は暗号受信部
のミキサの出力の各チャンネルの周波数損失特性及び周
波数遅延特性図である。
方式のアナログ暗号装置の構成を示すブロック図、第２
図は周波数入替の状況を示す図、第３図は伝送路の周波
数損失特性及び周波数遅延特性図、第４図は暗号受信部
のミキサの出力の各チャンネルの周波数損失特性及び周
波数遅延特性図である。
図中ｌＯは暗号送信部、２０は暗号受信部、３０は伝送
路、１，２はスイッチ回路、３，４はミキサ、１１〜Ｉ
ｎ、３１〜３ｎはフィルタ及び変調器、２１〜２ｎ、４
１〜４ｎは変調器を示す。
路、１，２はスイッチ回路、３，４はミキサ、１１〜Ｉ
ｎ、３１〜３ｎはフィルタ及び変調器、２１〜２ｎ、４
１〜４ｎは変調器を示す。
第１図第２図を用いて動作を説明すると、入力信号は、
フィルタ及び変調器１１〜１ｎに入カレ最大周波数ｆｍ
の１／ｎの帯域内で、ｆｍ／ｎ間隔でｎ個並べた１〜ｎ
チヤンネルのフィルタにて、第２図Ａに示す如く分割さ
れ、変調器にて、全てベースバンド周波数の信号にされ
、スイッチ回路２にてスクランブルをかけられ、変調器
２１〜２ｎに入力し、ｉ大周波数ｆｍの１７ｎの帯域内
の、ｆｍ ／ ｎの間隔でｎ個並んだ周波数配列の１〜
ｎチヤンネルのフィルタを通る信号に周波数変換され、
ミキサ３にて混合され伝送路３０に出方する。この場合
スクランブルのかけ方により、例えば第２図Ｂに示す如
“く、第２図Ａの第１チヤンネルは第２チヤンネルの周
波数の信号となり又第２チヤンネルは第１チヤンネルの
周波数の信号となり第３チヤンネルは第４チヤンネルの
周波数の信号となり第５チヤンネルは第３チヤンネルの
周波数の信号になる如く周波数が入れ替えらる。暗号受
信部２０では伝送路３０を経て送られてきた信号はフィ
シン及び変調器３１〜３ｎに入力し、フィルタの出力で
は第２図Ｃに示す如く、第２図Ｂと同じチャンネル配列
で周波数分割され変調器にて、全てベースバンド周波数
の信号にされ、スイッチ回路２にて逆のスクランブルを
かけられ、変調器４１〜４ｎに入力し、第２図りに示す
如く第２図Ａに示すチャンネル配列の信号となり、ミキ
サ４に入力し混合され出力される。しかし伝送路３ｏは
第３図に示す如く最大周波数ｆｍ及び周波数の低い方で
は遅延量及び損失の多い特性を有している。この為、第
２図のＢで第１チヤンネルとなった第２図への第２チヤ
ンネルの信号は、低周波では損失及び遅延量が多く又第
２−図Ｂで第２チヤンネルとなった第２図Ａの第１チヤ
ンネルの信号は次に損失及び遅延量が多く、第２図Ｂで
第３チヤンネルとなった第２図Ａの第５チヤンネルの信
号は次に損失及び遅延量が多く、これ等を元の第２図Ａ
と同じ第１．第２・・・第ｎチャンネルに配夕１ルだ第
２図りの信号は第４図に示す如く複雑な振巾及び遅延量
の特性となり等化を行うのは困難であり更に周波数の入
れ替えを時変で行なった場合は波形伝送そのものが困難
となる欠点がある。
フィルタ及び変調器１１〜１ｎに入カレ最大周波数ｆｍ
の１／ｎの帯域内で、ｆｍ／ｎ間隔でｎ個並べた１〜ｎ
チヤンネルのフィルタにて、第２図Ａに示す如く分割さ
れ、変調器にて、全てベースバンド周波数の信号にされ
、スイッチ回路２にてスクランブルをかけられ、変調器
２１〜２ｎに入力し、ｉ大周波数ｆｍの１７ｎの帯域内
の、ｆｍ ／ ｎの間隔でｎ個並んだ周波数配列の１〜
ｎチヤンネルのフィルタを通る信号に周波数変換され、
ミキサ３にて混合され伝送路３０に出方する。この場合
スクランブルのかけ方により、例えば第２図Ｂに示す如
“く、第２図Ａの第１チヤンネルは第２チヤンネルの周
波数の信号となり又第２チヤンネルは第１チヤンネルの
周波数の信号となり第３チヤンネルは第４チヤンネルの
周波数の信号となり第５チヤンネルは第３チヤンネルの
周波数の信号になる如く周波数が入れ替えらる。暗号受
信部２０では伝送路３０を経て送られてきた信号はフィ
シン及び変調器３１〜３ｎに入力し、フィルタの出力で
は第２図Ｃに示す如く、第２図Ｂと同じチャンネル配列
で周波数分割され変調器にて、全てベースバンド周波数
の信号にされ、スイッチ回路２にて逆のスクランブルを
かけられ、変調器４１〜４ｎに入力し、第２図りに示す
如く第２図Ａに示すチャンネル配列の信号となり、ミキ
サ４に入力し混合され出力される。しかし伝送路３ｏは
第３図に示す如く最大周波数ｆｍ及び周波数の低い方で
は遅延量及び損失の多い特性を有している。この為、第
２図のＢで第１チヤンネルとなった第２図への第２チヤ
ンネルの信号は、低周波では損失及び遅延量が多く又第
２−図Ｂで第２チヤンネルとなった第２図Ａの第１チヤ
ンネルの信号は次に損失及び遅延量が多く、第２図Ｂで
第３チヤンネルとなった第２図Ａの第５チヤンネルの信
号は次に損失及び遅延量が多く、これ等を元の第２図Ａ
と同じ第１．第２・・・第ｎチャンネルに配夕１ルだ第
２図りの信号は第４図に示す如く複雑な振巾及び遅延量
の特性となり等化を行うのは困難であり更に周波数の入
れ替えを時変で行なった場合は波形伝送そのものが困難
となる欠点がある。
（Ｃ） 発明の目的
本発明の目的は上記の欠点に鑑み、時間的な周波数の入
替えに伴う時変で複雑な振巾及び遅に量の周波数特性の
等化を簡単な方法で行うことが出来る等化方式の提供に
ある。
替えに伴う時変で複雑な振巾及び遅に量の周波数特性の
等化を簡単な方法で行うことが出来る等化方式の提供に
ある。
（ｄ） 発明の構成
本発明は上記の目的を達成するために、暗号送信部の出
力側にパルス中がｔ／ｆｍ（但しｆｒｎは使用最大周波
数）以下のテスト用パルス発生回路を設け、又暗号受信
部の周波数分割された各チャンネル毎に遅延調整回路及
び振ｒｌ］Ｆｌ！Ｉ整回路を設け、暗号装置の動作に先
立って、該テスト用パルス発生回路よりパルスを送信し
、該暗号受信部の各チャンネルの周波数入替前の出力ｆ
同じ振巾で同じ遅延となるよう該遅延調整回路及び振巾
調整回路を調整して伝送路の歪を等化することを特徴と
する。
力側にパルス中がｔ／ｆｍ（但しｆｒｎは使用最大周波
数）以下のテスト用パルス発生回路を設け、又暗号受信
部の周波数分割された各チャンネル毎に遅延調整回路及
び振ｒｌ］Ｆｌ！Ｉ整回路を設け、暗号装置の動作に先
立って、該テスト用パルス発生回路よりパルスを送信し
、該暗号受信部の各チャンネルの周波数入替前の出力ｆ
同じ振巾で同じ遅延となるよう該遅延調整回路及び振巾
調整回路を調整して伝送路の歪を等化することを特徴と
する。
（ｅ） 発明の実施例
以下本発明の１実施例につき図に従って説明する。槍５
図は本発明の実施例の暗号装置の構成を示すブロック図
、第６図はテストパルスを送（Ｍした場合の暗号受信部
の各チャンネルの周波数入替前の出力の振巾及び遅延特
性図である。
図は本発明の実施例の暗号装置の構成を示すブロック図
、第６図はテストパルスを送（Ｍした場合の暗号受信部
の各チャンネルの周波数入替前の出力の振巾及び遅延特
性図である。
第５図中第１図と同一機能のものは同一記号で示す。５
はテスト用パルス発生回路、５１〜５ｎは位相調整回路
（遅延調整回路）、６１〜６ｎは振巾調整回路、６は制
御回路、２０′は暗号受信部、ＳＷはスイッチを示す。
はテスト用パルス発生回路、５１〜５ｎは位相調整回路
（遅延調整回路）、６１〜６ｎは振巾調整回路、６は制
御回路、２０′は暗号受信部、ＳＷはスイッチを示す。
暗号装置を動作さす前にスイッチｓｗを実線側に切替え
、テスト用パルス発生回路５よりパルス中が１ ／ ｆ
ｍ （ｆｍは使用最大周波数）以下のパルスを伝送路３
０に送出する。このパルスはパルス中が１ ／ ｆｍ以
下であるので周波数ｆｍ迄のスペクトラムの周波数を含
み又周波数ｆｍ迄の同じ帯域中のフィルタにて受信した
場合の振巾は同じである。このパルスを暗号受信部２０
’のフィルタ及び変調器３１〜３ｎの出力で見ると第６
図に示す如く、第３図に示す伝送路の損失及び瀾延量に
従って各チャンネルの振巾及び遅延量は変化する。そこ
で制御回路６にて位相調整回路５１〜５ｎ及び振巾調整
回路６１〜６ｎを調整し、スイッチ回路２に入力する前
で各チャンネルの遅延量ｄ、 −ｄｎはチャンネルの最
大遅延量（第６図の場合はチャンネルｎの遅延量ａｎ）
に等しくなるよう又振巾ｈ１〜ｈｎは各チャンネルの平
均値となるよう調整する。
、テスト用パルス発生回路５よりパルス中が１ ／ ｆ
ｍ （ｆｍは使用最大周波数）以下のパルスを伝送路３
０に送出する。このパルスはパルス中が１ ／ ｆｍ以
下であるので周波数ｆｍ迄のスペクトラムの周波数を含
み又周波数ｆｍ迄の同じ帯域中のフィルタにて受信した
場合の振巾は同じである。このパルスを暗号受信部２０
’のフィルタ及び変調器３１〜３ｎの出力で見ると第６
図に示す如く、第３図に示す伝送路の損失及び瀾延量に
従って各チャンネルの振巾及び遅延量は変化する。そこ
で制御回路６にて位相調整回路５１〜５ｎ及び振巾調整
回路６１〜６ｎを調整し、スイッチ回路２に入力する前
で各チャンネルの遅延量ｄ、 −ｄｎはチャンネルの最
大遅延量（第６図の場合はチャンネルｎの遅延量ａｎ）
に等しくなるよう又振巾ｈ１〜ｈｎは各チャンネルの平
均値となるよう調整する。
次にスイッチＳＷを実線側に切替え暗号装置を動作さす
。このようにしておくことで、周波数分割単位に伝送路
の歪が等化されているので、これ等のチャンネル別の信
号を組合した合成信号は、周波数入替えが時変で行なわ
れたとしても、はぼ平坦な遅延量及び損失の周波数特性
を有する伝送路を通過した信号と等価になり、ミクサ４
の出力では歪の少ない波形の受信出力信号が得られる。
。このようにしておくことで、周波数分割単位に伝送路
の歪が等化されているので、これ等のチャンネル別の信
号を組合した合成信号は、周波数入替えが時変で行なわ
れたとしても、はぼ平坦な遅延量及び損失の周波数特性
を有する伝送路を通過した信号と等価になり、ミクサ４
の出力では歪の少ない波形の受信出力信号が得られる。
（ｆ） 発明の効果
以上詳細に説明せる如く本発明によれば、時間的な周波
数入替に伴う時変で複雑な周波数特性を簡単な方法上等
化出来る効果がある。
数入替に伴う時変で複雑な周波数特性を簡単な方法上等
化出来る効果がある。
第１図は従来例の周波数分割・周波数入替スクランブル
方式のアナログ暗号装置の構成を示すブロック図、第２
図は周波数入替の状況を示す図、第３図は伝送路の周波
数損失特性及び周波数遅延特性図、第４図は暗号受信部
のミキサの出力の各チャンネルの周波数振巾特性及び周
波数遅延特性図、第５図は本発明の実施例の睡号装置の
構成を示すブロック図、第６図はテストパルスを送信し
た場合の暗号受信部の各チャンネルの周波数入替前の出
力の振巾及び遅延特性図である。 図中１０は暗号送信部、２０．２０’は暗号受信部、３
０は伝送路、１，２はスイッチ回路、３゜４けミキサ、
５はテスト用パルス発生回路、６は制御回路、１１〜Ｉ
ｎ 、３１〜３ｎはフィルタ及び変調器、２１〜２ｎ、
４１〜４ｎは変調器、５１〜５ｎは位相調整回路、６−
１〜６ｎは振巾調整回路、ＳＷはスイッチを示す。 誉 ５ 図 ｂ）
方式のアナログ暗号装置の構成を示すブロック図、第２
図は周波数入替の状況を示す図、第３図は伝送路の周波
数損失特性及び周波数遅延特性図、第４図は暗号受信部
のミキサの出力の各チャンネルの周波数振巾特性及び周
波数遅延特性図、第５図は本発明の実施例の睡号装置の
構成を示すブロック図、第６図はテストパルスを送信し
た場合の暗号受信部の各チャンネルの周波数入替前の出
力の振巾及び遅延特性図である。 図中１０は暗号送信部、２０．２０’は暗号受信部、３
０は伝送路、１，２はスイッチ回路、３゜４けミキサ、
５はテスト用パルス発生回路、６は制御回路、１１〜Ｉ
ｎ 、３１〜３ｎはフィルタ及び変調器、２１〜２ｎ、
４１〜４ｎは変調器、５１〜５ｎは位相調整回路、６−
１〜６ｎは振巾調整回路、ＳＷはスイッチを示す。 誉 ５ 図 ｂ）
Claims (1)
- 周波数分割・周波数入替スクランブル方式の最大周波数
がｆｍのアナログ暗号装置において、暗号′ 送信
部の出力側にパルス巾が１／ｆｍ以下のテスト用パルス
発生回路を設け、又暗号受信部の周波数分割された各チ
ャンネル毎に遅延調整回路及び振巾調整回路を設け、該
暗号装置の動作に先立って、該テスト用パルス発生回路
よりパルスを送信し、該暗号受信部の各チャンネルの周
波数入替前の出力が同じ振巾で同じ遅延となるよう該遅
延調整回路及び振巾調整回路を調整して伝送路の歪を等
化することを特徴とする等化方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1696083A JPS59143439A (ja) | 1983-02-04 | 1983-02-04 | 等化方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1696083A JPS59143439A (ja) | 1983-02-04 | 1983-02-04 | 等化方式 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS59143439A true JPS59143439A (ja) | 1984-08-17 |
Family
ID=11930671
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1696083A Pending JPS59143439A (ja) | 1983-02-04 | 1983-02-04 | 等化方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS59143439A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US4981482A (en) * | 1987-08-20 | 1991-01-01 | Kazuo Ichikawa | Device for forming an inserting hole for an endoscope |
-
1983
- 1983-02-04 JP JP1696083A patent/JPS59143439A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US4981482A (en) * | 1987-08-20 | 1991-01-01 | Kazuo Ichikawa | Device for forming an inserting hole for an endoscope |
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