JPS5833568B2 - current mirror circuit - Google Patents
current mirror circuitInfo
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- JPS5833568B2 JPS5833568B2 JP56048864A JP4886481A JPS5833568B2 JP S5833568 B2 JPS5833568 B2 JP S5833568B2 JP 56048864 A JP56048864 A JP 56048864A JP 4886481 A JP4886481 A JP 4886481A JP S5833568 B2 JPS5833568 B2 JP S5833568B2
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- G05—CONTROLLING; REGULATING
- G05F—SYSTEMS FOR REGULATING ELECTRIC OR MAGNETIC VARIABLES
- G05F3/00—Non-retroactive systems for regulating electric variables by using an uncontrolled element, or an uncontrolled combination of elements, such element or such combination having self-regulating properties
- G05F3/02—Regulating voltage or current
- G05F3/08—Regulating voltage or current wherein the variable is dc
- G05F3/10—Regulating voltage or current wherein the variable is dc using uncontrolled devices with non-linear characteristics
- G05F3/16—Regulating voltage or current wherein the variable is dc using uncontrolled devices with non-linear characteristics being semiconductor devices
- G05F3/20—Regulating voltage or current wherein the variable is dc using uncontrolled devices with non-linear characteristics being semiconductor devices using diode- transistor combinations
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Description
【発明の詳細な説明】
本発明は電流ミラー回路に関し、外部よりの制御信号に
より電流ミラー比を可変にするものである。DETAILED DESCRIPTION OF THE INVENTION The present invention relates to a current mirror circuit in which the current mirror ratio is made variable by an external control signal.
一般に電流ミラー回路は、実質的にダイオードとして動
作するPN接合手段に抵抗R□を接続し、モしてPN接
合手段の入力電極にトランジスタのベースを接続すると
共に、そのエミッタ抵抗R2を接続して、トランジスタ
のベース・エミッタ間順方向電圧がPN接合手段と抵抗
R1との直列回路に流れる電流に依存するよう構成して
いる。Generally, a current mirror circuit is constructed by connecting a resistor R□ to a PN junction means that essentially operates as a diode, and then connecting the base of a transistor to the input electrode of the PN junction means and connecting its emitter resistor R2. , the forward voltage between the base and emitter of the transistor is configured to depend on the current flowing through the series circuit of the PN junction means and the resistor R1.
したがって電流ミラー比は、トランジスタ及びPN接合
手段の状況または、抵抗R0と抵抗R2の比によって変
わるのであるが、回路設計上これらの要因を決定してし
まうと、以後電流ミラー比を変えることは不可能であっ
た。Therefore, the current mirror ratio changes depending on the conditions of the transistor and the PN junction means, or the ratio of resistors R0 and R2, but once these factors are determined in the circuit design, it is impossible to change the current mirror ratio from now on. It was possible.
上記点に鑑み本発明は、回路動作上の状況に応じて電流
ミラー比を自由に制御可能な電流ミラー回路を提供する
もので、以下図面に基づき詳述するO
第1図は、本発明に依る電流ミラー回路の一実施例を示
し、同図に於いてNPN)ランジスタ1゜2は、夫々コ
レクタが抵抗R3及び抵抗R4を介して電源ラインV。In view of the above points, the present invention provides a current mirror circuit in which the current mirror ratio can be freely controlled according to the circuit operating situation. In the figure, NPN) transistors 1 and 2 have their collectors connected to the power supply line V through resistors R3 and R4, respectively.
0に接続され、各々エミッタは、抵抗R1及び抵抗R2
を介し接地され、ベースは互いに接続されており、且つ
トランジスタ1は、コレクタとベースが短絡されて実質
的にダイオードとして作用するもので、トランジスタ2
のエミッタと抵抗R2の接続地点にはトランジスタ3の
エミッタが抵抗R6を介し接続され、更にトランジスタ
3のベースとコレクタは、夫々制御信号入力端子4及び
電源ラインVccに夫々接続されている。0, and the emitters are connected to resistor R1 and resistor R2, respectively.
The transistor 1 has its collector and base short-circuited and acts as a diode, and the transistor 2 has its base connected to the ground through the transistor 2.
The emitter of the transistor 3 is connected to the connection point between the emitter of the transistor 3 and the resistor R2 via a resistor R6, and the base and collector of the transistor 3 are respectively connected to the control signal input terminal 4 and the power supply line Vcc.
かかる構成でトランジスタ1,2のベース・エミッタ間
順方向電圧は等しく、また本例では抵抗R1及びR2の
抵抗値は等しく、更にトランジスタ1.2のエミッタ面
積も等しく設定されている。With this configuration, the base-emitter forward voltages of transistors 1 and 2 are equal, and in this example, the resistance values of resistors R1 and R2 are equal, and the emitter areas of transistors 1 and 2 are also set to be equal.
いま電流ミラー比を制御するトランジスタ3が入力端子
4に制御信号が導入されておらず非導通であると、トラ
ンジスタ1,2のコレクタエミツタ間には、等しい電流
11が流れ電流ミラー比は1である。If transistor 3, which controls the current mirror ratio, is non-conducting because no control signal is introduced to its input terminal 4, an equal current 11 flows between the collectors and emitters of transistors 1 and 2, and the current mirror ratio is 1. It is.
しかして入力端子4に制御信号が導入されて、トランジ
スタ3が導通ずると、抵抗R2には電流12が供給され
るのであるが、このとき抵抗R1とR2は同電位に保持
されているため、トランジスタ2のコレクタ・エミッタ
間の電流は(1112)に減少し、電流ミラー比は1か
シ=−一に変動する。When a control signal is introduced to the input terminal 4 and the transistor 3 becomes conductive, a current of 12 is supplied to the resistor R2, but at this time, since the resistors R1 and R2 are held at the same potential, The collector-emitter current of transistor 2 decreases to (1112), and the current mirror ratio changes from 1 to -1.
したがって電流12を調整することで任意の電流ミラー
比に変化させることが可能となる。Therefore, by adjusting the current 12, it is possible to change the current mirror ratio to an arbitrary value.
第2図は、本発明に係る電流ミラー回路を定電圧回路に
応用した場合の実施例を示し、電流ミラー回路5のトラ
ンジスタ2のコレクタはトランジスタ6のコレクタに接
続されて、更にこの接続点にはトランジスタ3のベース
、即ち制御信号入力端子4が接続されている。FIG. 2 shows an embodiment in which the current mirror circuit according to the present invention is applied to a constant voltage circuit, in which the collector of transistor 2 of current mirror circuit 5 is connected to the collector of transistor 6, and further connected to this connection point. is connected to the base of the transistor 3, that is, the control signal input terminal 4.
そしてトランジスタ6はトランジスタγとベースが互い
に接続され、且つ互いのエミッタは抵抗R6を通して入
力電圧ラインVinに接続され、更にトランジスタ7の
ベース・コレクタは短絡されてコレクタにはツェナーダ
イオード8が接続されている。The transistor 6 has its base connected to the transistor γ, and its emitters connected to the input voltage line Vin through a resistor R6.The base and collector of the transistor 7 are short-circuited, and the Zener diode 8 is connected to the collector. There is.
したがってトランジスタ6と7は、電流ミラー比が固定
される通常の電流ミラー回路を構成して、ツェナー電圧
Vzで動作するものできる。Therefore, the transistors 6 and 7 constitute a normal current mirror circuit in which the current mirror ratio is fixed, and can be operated at the Zener voltage Vz.
また、ダーリントン接続されるトランジスタ9,10は
出力回路を構成しており、トランジスタ9のベースはト
ランジスタ2及びトランジスタ6の前記接続点に接続さ
れている。Further, transistors 9 and 10 connected in Darlington form an output circuit, and the base of transistor 9 is connected to the connection point of transistor 2 and transistor 6.
そして、入力電圧Vinを増加させたとき抵抗R7を流
れる電流i1とトランジスタ6及び7に流れる電流12
を第5図の特性を示すように設定されており、電流11
と電流12が交わる点(Vin = VA )までの動
作は、第3図の等回路に置換えられる。When the input voltage Vin is increased, a current i1 flows through the resistor R7 and a current 12 flows through the transistors 6 and 7.
is set to show the characteristics shown in Figure 5, and the current is 11
The operation up to the point where the current 12 intersects with the current 12 (Vin = VA) is replaced by the equal circuit shown in FIG.
第3図の回路で、入力電圧Vinが上昇するとトランジ
スタ1はベースとコレクタが短絡されていルタめ、Vi
nがVD (0−6〜0−7 V ) ニ達すると動作
しはじめ電流11が流れる。In the circuit shown in Fig. 3, when the input voltage Vin rises, transistor 1 has its base and collector short-circuited, and the input voltage Vin increases.
When n reaches VD (0-6 to 0-7 V), it starts to operate and current 11 flows.
トランジスタ7もベースとコレクタが短絡されており、
ツェナー電圧をVzとすると、入力電圧Vinが(Vz
+Vn)以上になると、トランジスタ7及び6が動作し
て、それぞれ電流12が流れ、トランジスタ2も動作し
て、トランジスタ1に流れる電流と同じ大きさの電流1
0を電流12より吸込もうとするが、第5図に示すごと
く電流i1は電流12よりも太きいためにトランジスタ
2に流れる電流i3は、電流11とP−Q−R間では等
しい。Transistor 7 also has its base and collector shorted,
When the Zener voltage is Vz, the input voltage Vin is (Vz
+Vn), transistors 7 and 6 operate, and current 12 flows through each, transistor 2 also operates, and current 1 of the same magnitude as the current flowing through transistor 1 flows.
0 from the current 12, but as shown in FIG. 5, the current i1 is thicker than the current 12, so the current i3 flowing through the transistor 2 is equal to the current 11 between P-QR.
そして入力電圧Vinが第1の所定入力電圧vA以上と
なって電流12が電流i。Then, the input voltage Vin becomes equal to or higher than the first predetermined input voltage vA, and the current 12 becomes the current i.
を上回ると、その差分がトランジスタ3及び9のベース
に流れて夫々動作する。When the difference exceeds , the difference flows to the bases of transistors 3 and 9, respectively, to operate them.
そしてA点の電位はツェナーダイオード8により、略V
zで一定であるから、トランジスタ9の動作にてトラン
ジスタ10より所定電圧■Tが供給される。The potential at point A is approximately V due to the Zener diode 8.
Since the voltage z is constant, the operation of the transistor 9 causes the transistor 10 to supply the predetermined voltage ■T.
また、トランジスタ3が動作したときの状態は、第4図
の等価回路で示され、A点の電位は一定のためにトラン
ジスタ3の動作は定電圧回路11で表わされ、抵抗R6
を通して抵抗R2には一定電流i4が供給される。Further, the state when the transistor 3 operates is shown by the equivalent circuit in FIG.
A constant current i4 is supplied to the resistor R2 through the resistor R2.
したがって電流ミラー回路5の電流ミラー比が変動し、
トランジスタ2に流れる電流13はST間で電流14の
分だけ減少した値となる。Therefore, the current mirror ratio of the current mirror circuit 5 changes,
The current 13 flowing through the transistor 2 has a value reduced by the current 14 between ST.
そして、入力電圧Vinが下降すると、第5図に示すご
とく電流12は電流i3と共にT−8−Q間で減少し、
第2の所定入力電圧vBに達するとトランジスタ2の吸
込電流i3は供給電流12より大きくなるために、再び
電流i3は電流i2とQ−P間で等しくなり、トランジ
スタ3及び9はベース電流が供給されず不動僅なる。Then, when the input voltage Vin decreases, the current 12 decreases between T-8-Q together with the current i3, as shown in FIG.
When the second predetermined input voltage vB is reached, the sink current i3 of the transistor 2 becomes larger than the supply current 12, so the current i3 becomes equal again between the current i2 and Q-P, and the transistors 3 and 9 are supplied with the base current. It is unmoving and immovable.
したがってトランジスタ10よりの出力電圧は「0」と
なり、またトランジスタ3の不動作にて抵抗R3を通し
て抵抗R2に供給される電流もなくなって、トランジス
タ2に流れる電流はi3からi2に変わり動作状態は第
3図の等価回路に復帰する。Therefore, the output voltage from the transistor 10 becomes "0", and the current supplied to the resistor R2 through the resistor R3 due to the non-operation of the transistor 3 also disappears, and the current flowing through the transistor 2 changes from i3 to i2, and the operating state is changed to the first state. Return to the equivalent circuit shown in Figure 3.
したがって上述した動作によりトランジスタ10よりの
出力電圧Voutは第6図に示すように、入力電圧Vi
nが上昇してvAに到達すると一定電圧■。Therefore, by the above-described operation, the output voltage Vout from the transistor 10 is changed to the input voltage Vi as shown in FIG.
When n increases and reaches vA, constant voltage ■.
を出力し、入力電圧Vinが下降してvBに到達すると
出力電圧Voutは0となり、ヒステリシス特性が具備
される。When the input voltage Vin decreases and reaches vB, the output voltage Vout becomes 0, and a hysteresis characteristic is provided.
このように、本発明に係る電流ミラー回路を利用するこ
とで安定な動作をし、且つヒステリシス特性を有した定
電圧回路が構成される。In this way, by using the current mirror circuit according to the present invention, a constant voltage circuit that operates stably and has hysteresis characteristics is constructed.
また、本発明に係る電流ミラー回路を利得制御回路に利
用することも可能である。Furthermore, it is also possible to utilize the current mirror circuit according to the present invention in a gain control circuit.
その場合はトランジスタ1のコレクタに制御すべき交流
入力を接続するもので、このときトランジスタ1及び2
には、交流入力に応じた変化した電流11 /が流れる
が、利得制御信号を入力端子4へ導入することでトラン
ジスタ2を流れる電流11′は減衰し利得制御が達成さ
れる。In that case, the AC input to be controlled is connected to the collector of transistor 1;
A current 11/ that changes according to the AC input flows through the transistor 2, but by introducing a gain control signal to the input terminal 4, the current 11' flowing through the transistor 2 is attenuated and gain control is achieved.
そして上記、利得制御回路を更にすすめると、ミューテ
ィング回路にも適用でき、トランジスタ3のベースにミ
ューティング信号を導入して犬なる電流12をトランジ
スタ3のエミッタから抵抗R2に流せばトランジスタ2
が不動作となって、ミューティングが図れる。Further advancing the gain control circuit described above, it can also be applied to a muting circuit, by introducing a muting signal to the base of the transistor 3 and causing a dog current 12 to flow from the emitter of the transistor 3 to the resistor R2.
becomes inoperable, allowing muting.
以上詳述した本発明は、外部よりの制御信号に応答して
電流ミラー比を可変できる電流ミラー回路を提供するも
ので、基本回路として種々の回路に応用できる。The present invention described in detail above provides a current mirror circuit that can vary the current mirror ratio in response to an external control signal, and can be applied as a basic circuit to various circuits.
第1図は、本発明に係る電流ミラー回路、第2図は定電
圧回路への応用例、第3図は定電圧回路のある動作状態
を示す等価回路、第4図は別の動作状態を示す等価回路
、第5図は定電圧回路の入力電圧−電流特性、第6図は
定電圧回路の入力電圧−出力電圧特性を示す。
1・・・・・・PN接合手段、R1・・・・・・第1抵
抗、2・・・・・・トランジスタ、R2・・・・・・第
2抵抗、3・・・・・・制御手段。Fig. 1 shows a current mirror circuit according to the present invention, Fig. 2 shows an example of application to a constant voltage circuit, Fig. 3 shows an equivalent circuit showing one operating state of the constant voltage circuit, and Fig. 4 shows another operating state. 5 shows the input voltage-current characteristics of the constant voltage circuit, and FIG. 6 shows the input voltage-output voltage characteristics of the constant voltage circuit. 1...PN junction means, R1...first resistor, 2...transistor, R2...second resistor, 3...control means.
Claims (1)
、該PN接合手段に接続される第1抵抗と、ベースが前
記PN接合手段の人力電極に接続されるトランジスタと
、該トランジスタのエミッタに接続される第2抵抗と、
該エミッタと前記第2抵抗との接続点に接続され、所定
の制御信号に応答して前記トランジスタのエミッタに流
れる電流を制御する制御手段とから成る電流ミラー回路
。1 a PN junction means that operates substantially as a diode, a first resistor connected to the PN junction means, a transistor whose base is connected to the human electrode of the PN junction means, and a transistor connected to the emitter of the transistor. a second resistor;
a current mirror circuit comprising a control means connected to a connection point between the emitter and the second resistor, and controlling a current flowing to the emitter of the transistor in response to a predetermined control signal.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP56048864A JPS5833568B2 (en) | 1981-03-31 | 1981-03-31 | current mirror circuit |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP56048864A JPS5833568B2 (en) | 1981-03-31 | 1981-03-31 | current mirror circuit |
Related Parent Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP4367074A Division JPS5743932B2 (en) | 1974-04-17 | 1974-04-17 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS56156006A JPS56156006A (en) | 1981-12-02 |
JPS5833568B2 true JPS5833568B2 (en) | 1983-07-20 |
Family
ID=12815138
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP56048864A Expired JPS5833568B2 (en) | 1981-03-31 | 1981-03-31 | current mirror circuit |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS5833568B2 (en) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS6180853U (en) * | 1984-10-30 | 1986-05-29 |
Families Citing this family (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS6020605A (en) * | 1983-07-15 | 1985-02-01 | Iwatsu Electric Co Ltd | Current amplifier |
-
1981
- 1981-03-31 JP JP56048864A patent/JPS5833568B2/en not_active Expired
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS6180853U (en) * | 1984-10-30 | 1986-05-29 |
Also Published As
Publication number | Publication date |
---|---|
JPS56156006A (en) | 1981-12-02 |
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