JPS5823432U - 雑音抑圧回路 - Google Patents
雑音抑圧回路Info
- Publication number
- JPS5823432U JPS5823432U JP11585681U JP11585681U JPS5823432U JP S5823432 U JPS5823432 U JP S5823432U JP 11585681 U JP11585681 U JP 11585681U JP 11585681 U JP11585681 U JP 11585681U JP S5823432 U JPS5823432 U JP S5823432U
- Authority
- JP
- Japan
- Prior art keywords
- noise suppression
- suppression circuit
- input binary
- binary signal
- signal
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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- Manipulation Of Pulses (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
第１図は本考案の一実施例を示す回路図、第２図ａ ”
ｃは第１図のタイムチャートを示す。 １１・・・・・・入力端子、１２・・・・・・出力端子
、２１〜．２Ｎ・・・・・・インバータ回路、３１・・
・・・・アンド回路。
ｃは第１図のタイムチャートを示す。 １１・・・・・・入力端子、１２・・・・・・出力端子
、２１〜．２Ｎ・・・・・・インバータ回路、３１・・
・・・・アンド回路。
Claims (1)
- 入力２値信号と、該入力２値信号を極性を変ええること
なく遅延させた信号との論理積を出力することを特徴と
する雑音抑圧回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP11585681U JPS5823432U (ja) | 1981-08-04 | 1981-08-04 | 雑音抑圧回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP11585681U JPS5823432U (ja) | 1981-08-04 | 1981-08-04 | 雑音抑圧回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS5823432U true JPS5823432U (ja) | 1983-02-14 |
Family
ID=29910106
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP11585681U Pending JPS5823432U (ja) | 1981-08-04 | 1981-08-04 | 雑音抑圧回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5823432U (ja) |
-
1981
- 1981-08-04 JP JP11585681U patent/JPS5823432U/ja active Pending
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