JPH114458A - 適応型コムフィルタ回路 - Google Patents
適応型コムフィルタ回路Info
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- JPH114458A JPH114458A JP15631797A JP15631797A JPH114458A JP H114458 A JPH114458 A JP H114458A JP 15631797 A JP15631797 A JP 15631797A JP 15631797 A JP15631797 A JP 15631797A JP H114458 A JPH114458 A JP H114458A
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Abstract
(57)【要約】
【課題】 本発明はテレビ受像機の適応型コムフィルタ
回路に関するもので、特に同一のサンプリングクロック
周波数でＰＡＬとＮＴＳＣの両方式に対応した適応型コ
ムフィルタ回路構成することを目的とする。 【解決手段】 相関検出回路の前後にＢＰＦを配置し、
後置するＢＰＦの周波数特性を変えてＰＡＬとＮＴＳＣ
の両方式のクロマ周波数帯域を切り替えることにより、
両方式に対応させることを特徴とする適応型コムフィル
タ回路。
回路に関するもので、特に同一のサンプリングクロック
周波数でＰＡＬとＮＴＳＣの両方式に対応した適応型コ
ムフィルタ回路構成することを目的とする。 【解決手段】 相関検出回路の前後にＢＰＦを配置し、
後置するＢＰＦの周波数特性を変えてＰＡＬとＮＴＳＣ
の両方式のクロマ周波数帯域を切り替えることにより、
両方式に対応させることを特徴とする適応型コムフィル
タ回路。
Description
【０００１】
【発明の属する技術分野】本発明は、テレビジョン受像
機のコムフィルタ回路（国際特許分類Ｈ０４Ｎ９／７
８）で特にラインメモリを用いて上下ラインの相関によ
り適応的にラインメモリを選択する適応型コムフィルタ
回路に関するものである。
機のコムフィルタ回路（国際特許分類Ｈ０４Ｎ９／７
８）で特にラインメモリを用いて上下ラインの相関によ
り適応的にラインメモリを選択する適応型コムフィルタ
回路に関するものである。
【０００２】
【従来の技術】従来のテレビジョン受像機の適応型コム
フィルタは、特に色信号の上下の境に発生するクロスル
ミナンスを軽減するために、ラインメモリを用いて上下
の相関を検出し相関の高いラインとコム動作をさせるこ
とでクロスルミナンスを軽減していた。従来の適応型コ
ムフィルタでは、特告平２−９７５５号公報に示すよう
に、２本のラインメモリを用いて上下の相関を検出し相
関の高いラインとコム動作をさせることでクロスルミナ
ンスを軽減していた。
フィルタは、特に色信号の上下の境に発生するクロスル
ミナンスを軽減するために、ラインメモリを用いて上下
の相関を検出し相関の高いラインとコム動作をさせるこ
とでクロスルミナンスを軽減していた。従来の適応型コ
ムフィルタでは、特告平２−９７５５号公報に示すよう
に、２本のラインメモリを用いて上下の相関を検出し相
関の高いラインとコム動作をさせることでクロスルミナ
ンスを軽減していた。
【０００３】従来のデジタルフィルタで構成した場合の
一例を図面を持って説明する。図２は、従来の適応型コ
ムフィルタの一例である。
一例を図面を持って説明する。図２は、従来の適応型コ
ムフィルタの一例である。
【０００４】図２において、デジタル符号化されたビデ
オ信号は第１のラインメモリ２１に入力する。前記第１
のラインメモリ２１の出力は第２のラインメモリ２２に
入力する。また、前記デジタル符号化されたビデオ信号
は第１のバンドパスフィルタ２３（以下、ＢＰＦと記
す）に入力する。前記第１のラインメモリ２１の出力は
第２のＢＰＦ２４に入力する。前記第２のラインメモリ
２２の出力は第３のＢＰＦ２５に入力する。前記第１の
ＢＰＦ２３の出力と前記第２のＢＰＦ２４の出力と前記
第３のＢＰＦ２５の出力をそれぞれ相関検出回路２６に
入力し、相関検出回路２６によって３つの入力の内相関
の高い２つの入力を選択しその２つの信号の差を取るこ
とで輝度信号を抑圧し、クロマ成分を抽出する。前記相
関検出回路２６の出力と前記第１のラインメモリ２１の
出力を加算回路２７に入力する。
オ信号は第１のラインメモリ２１に入力する。前記第１
のラインメモリ２１の出力は第２のラインメモリ２２に
入力する。また、前記デジタル符号化されたビデオ信号
は第１のバンドパスフィルタ２３（以下、ＢＰＦと記
す）に入力する。前記第１のラインメモリ２１の出力は
第２のＢＰＦ２４に入力する。前記第２のラインメモリ
２２の出力は第３のＢＰＦ２５に入力する。前記第１の
ＢＰＦ２３の出力と前記第２のＢＰＦ２４の出力と前記
第３のＢＰＦ２５の出力をそれぞれ相関検出回路２６に
入力し、相関検出回路２６によって３つの入力の内相関
の高い２つの入力を選択しその２つの信号の差を取るこ
とで輝度信号を抑圧し、クロマ成分を抽出する。前記相
関検出回路２６の出力と前記第１のラインメモリ２１の
出力を加算回路２７に入力する。
【０００５】以上の構成により、相関検出回路２６の出
力にクロマ信号が得られ、加算回路２７の出力には輝度
信号が得られる。
力にクロマ信号が得られ、加算回路２７の出力には輝度
信号が得られる。
【０００６】
【発明が解決しようとする課題】デジタル信号処理でこ
のような適応型コムフィルタを構成する場合には、その
サンプリング周波数はカラーサブキャリア周波数の整数
倍であるのが、色信号を取り扱う場合に回路の構成上有
利でありよく用いられてきた。しかし、ＰＡＬ，ＮＴＳ
Ｃの両方式を取り扱うテレビジョン受像機では、カラー
サブキャリア周波数が両方式で異なるため、方式を変え
る時にサンプリングクロックも切り替える必要があり、
クロック切替に特別な手順や保護回路が必要となり、回
路構成が煩雑であった。
のような適応型コムフィルタを構成する場合には、その
サンプリング周波数はカラーサブキャリア周波数の整数
倍であるのが、色信号を取り扱う場合に回路の構成上有
利でありよく用いられてきた。しかし、ＰＡＬ，ＮＴＳ
Ｃの両方式を取り扱うテレビジョン受像機では、カラー
サブキャリア周波数が両方式で異なるため、方式を変え
る時にサンプリングクロックも切り替える必要があり、
クロック切替に特別な手順や保護回路が必要となり、回
路構成が煩雑であった。
【０００７】一方、ＰＡＬ／ＮＴＳＣの方式に問わず、
同じシステムクロックで両方式を取り扱う方式も提案さ
れているが、この方式では、ＰＡＬ／ＮＴＳＣによって
システムクロックとサブキャリア周波数の比の違いによ
り、回路構成を変更する必要があり、回路規模が大きく
なるという弊害があった。
同じシステムクロックで両方式を取り扱う方式も提案さ
れているが、この方式では、ＰＡＬ／ＮＴＳＣによって
システムクロックとサブキャリア周波数の比の違いによ
り、回路構成を変更する必要があり、回路規模が大きく
なるという弊害があった。
【０００８】上記の例でのサンプリングクロックをカラ
ーサブキャリア周波数の整数倍以外のクロック周波数を
採用した場合に、ＢＰＦの中心周波数の変更がＰＡＬ／
ＮＴＳＣの方式により必要であり、ＢＰＦの構成を変え
る必要がある。上記の構成では、第１のＢＰＦ２３、第
２のＢＰＦ２４、第３のＢＰＦ２５のそれぞれのＢＰＦ
を方式に寄り切り変える必要があり、ハードウェア規模
が大きくなることがあった。
ーサブキャリア周波数の整数倍以外のクロック周波数を
採用した場合に、ＢＰＦの中心周波数の変更がＰＡＬ／
ＮＴＳＣの方式により必要であり、ＢＰＦの構成を変え
る必要がある。上記の構成では、第１のＢＰＦ２３、第
２のＢＰＦ２４、第３のＢＰＦ２５のそれぞれのＢＰＦ
を方式に寄り切り変える必要があり、ハードウェア規模
が大きくなることがあった。
【０００９】
【課題を解決するための手段】前記課題を解決するため
に、本発明の適応型コムフィルタ回路は、相関検出回路
の前の３つのＢＰＦと後ろに１つのＢＰＦを持ち、前置
する３つのＢＰＦはＰＡＬ／ＮＴＳＣのサブキャリア周
波数が共に通過するだけの広帯域の特性を持ち、これら
の３つのＢＰＦでＤＣ成分を遮断した後、相関検出回路
で相関処理を行い、後置するＢＰＦにクロマ信号を渡
す。後置したＢＰＦではＰＡＬ／ＮＴＳＣの方式により
中心周波数を切り換え、前置したＢＰＦと後置したＢＰ
Ｆの合成周波数が選択した方式の中心周波数になるよう
に構成する。
に、本発明の適応型コムフィルタ回路は、相関検出回路
の前の３つのＢＰＦと後ろに１つのＢＰＦを持ち、前置
する３つのＢＰＦはＰＡＬ／ＮＴＳＣのサブキャリア周
波数が共に通過するだけの広帯域の特性を持ち、これら
の３つのＢＰＦでＤＣ成分を遮断した後、相関検出回路
で相関処理を行い、後置するＢＰＦにクロマ信号を渡
す。後置したＢＰＦではＰＡＬ／ＮＴＳＣの方式により
中心周波数を切り換え、前置したＢＰＦと後置したＢＰ
Ｆの合成周波数が選択した方式の中心周波数になるよう
に構成する。
【００１０】本発明によれば、以上の構成により１つの
ＢＰＦの中心周波数を切り換えるだけでＰＡＬ／ＮＴＳ
Ｃ両方式に対応する適応型コムフィルタ回路を提供でき
る。
ＢＰＦの中心周波数を切り換えるだけでＰＡＬ／ＮＴＳ
Ｃ両方式に対応する適応型コムフィルタ回路を提供でき
る。
【００１１】以上のように本発明は、かかる構成によ
り、より少ない回路構成でＰＡＬとＮＴＳＣの両方式に
対応した適応型コムフィルタ回路を構成することが可能
となる。
り、より少ない回路構成でＰＡＬとＮＴＳＣの両方式に
対応した適応型コムフィルタ回路を構成することが可能
となる。
【００１２】
【発明の実施の形態】以下、本発明の実施の形態例につ
いて図面を用いて説明を行う。
いて図面を用いて説明を行う。
【００１３】請求項１に記載の発明は、デジタル信号処
理化されたテレビにおいてビデオ信号をラインメモリー
を用いてビデオ信号情報を遅延させライン間の相関を測
定して各ラインメモリー出力を選択的に切り換えるコム
フィルタにおいて、相関検出回路の前後にＢＰＦ部を設
け、ＰＡＬあるいはＮＴＳＣ方式の違いにより相関検出
回路に後置したＢＰＦ部の周波数特性を切り換えること
で、ＰＡＬ／ＮＴＳＣの両方式に対応する作用を有す
る。
理化されたテレビにおいてビデオ信号をラインメモリー
を用いてビデオ信号情報を遅延させライン間の相関を測
定して各ラインメモリー出力を選択的に切り換えるコム
フィルタにおいて、相関検出回路の前後にＢＰＦ部を設
け、ＰＡＬあるいはＮＴＳＣ方式の違いにより相関検出
回路に後置したＢＰＦ部の周波数特性を切り換えること
で、ＰＡＬ／ＮＴＳＣの両方式に対応する作用を有す
る。
【００１４】請求項２に記載の発明は、デジタル信号処
理化されたテレビにおいてデジタル符号化されたビデオ
信号が入力する第１のラインメモリと、前記第１のライ
ンメモリの出力を入力する第２のラインメモリと、前記
デジタル符号化されたビデオ信号を入力する第１のバン
ドパスフィルタ（以下、ＢＰＦと記す）と、前記第１の
ラインメモリの出力を入力する第２のＢＰＦと、前記第
２のラインメモリの出力を入力する第３のＢＰＦと、前
記第１のＢＰＦの出力と前記第２のＢＰＦの出力と前記
第３のＢＰＦの出力をそれぞれ入力し、相関検出回路に
よって３つの入力の内相関の高い２つの入力を選択する
相関検出回路と、前記相関検出回路の出力を入力し制御
信号によってその周波数特性を変えるようにした第４の
ＢＰＦと、前記第４のＢＰＦの出力と前記第１のライン
メモリの出力を入力した加算回路とよりなり、前記相関
検出回路に後置した第４のＢＰＦにおいて、ＰＡＬある
いはＮＴＳＣ方式の違いにより周波数特性を切り換える
ことによりＰＡＬ／ＮＴＳＣの両方式に対応させる作用
を有する。
理化されたテレビにおいてデジタル符号化されたビデオ
信号が入力する第１のラインメモリと、前記第１のライ
ンメモリの出力を入力する第２のラインメモリと、前記
デジタル符号化されたビデオ信号を入力する第１のバン
ドパスフィルタ（以下、ＢＰＦと記す）と、前記第１の
ラインメモリの出力を入力する第２のＢＰＦと、前記第
２のラインメモリの出力を入力する第３のＢＰＦと、前
記第１のＢＰＦの出力と前記第２のＢＰＦの出力と前記
第３のＢＰＦの出力をそれぞれ入力し、相関検出回路に
よって３つの入力の内相関の高い２つの入力を選択する
相関検出回路と、前記相関検出回路の出力を入力し制御
信号によってその周波数特性を変えるようにした第４の
ＢＰＦと、前記第４のＢＰＦの出力と前記第１のライン
メモリの出力を入力した加算回路とよりなり、前記相関
検出回路に後置した第４のＢＰＦにおいて、ＰＡＬある
いはＮＴＳＣ方式の違いにより周波数特性を切り換える
ことによりＰＡＬ／ＮＴＳＣの両方式に対応させる作用
を有する。
【００１５】以下発明の実施の形態について、図１を用
いて説明する。 （実施の形態１）図１は、本発明の請求項１に係わる適
応型コムフィルタ回路のブロック図を説明している。図
１において、デジタル信号処理化されたテレビにおいて
ビデオ信号はラインメモリー１１，１２に入力し、ビデ
オ信号情報を１Ｈあるいは２Ｈ遅延させる。ビデオ入力
信号およびラインメモリの出力はそれぞれ第１のバンド
パスフィルタ（以下、ＢＰＦ（１）と記す）１３，１
４，１５を通過した後、ライン間の相関を測定して各ラ
インメモリー出力を選択的に切り換える相関検出回路１
６に入力する。相関検出回路１６の出力は第２のバンド
パスフィルタ（以下、ＢＰＦ（２）と記す）１７に入力
し、ＰＡＬあるいはＮＴＳＣ方式の違いにより相関検出
回路に後置したＢＰＦ（２）１７の周波数特性を切り換
える。ＢＰＦ（２）１７出力は加算器１８でラインメモ
リを通過したビデオ信号と加算される。
いて説明する。 （実施の形態１）図１は、本発明の請求項１に係わる適
応型コムフィルタ回路のブロック図を説明している。図
１において、デジタル信号処理化されたテレビにおいて
ビデオ信号はラインメモリー１１，１２に入力し、ビデ
オ信号情報を１Ｈあるいは２Ｈ遅延させる。ビデオ入力
信号およびラインメモリの出力はそれぞれ第１のバンド
パスフィルタ（以下、ＢＰＦ（１）と記す）１３，１
４，１５を通過した後、ライン間の相関を測定して各ラ
インメモリー出力を選択的に切り換える相関検出回路１
６に入力する。相関検出回路１６の出力は第２のバンド
パスフィルタ（以下、ＢＰＦ（２）と記す）１７に入力
し、ＰＡＬあるいはＮＴＳＣ方式の違いにより相関検出
回路に後置したＢＰＦ（２）１７の周波数特性を切り換
える。ＢＰＦ（２）１７出力は加算器１８でラインメモ
リを通過したビデオ信号と加算される。
【００１６】次にその動作について述べる。図１におい
て、入力したビデオ信号はラインメモリで１Ｈあるいは
２Ｈ遅延した後、３つのＢＰＦ（１）１３，１４，１５
に入力し、クロマ信号帯域信号成分が通過する。それら
の出力は相関検出回路１６における相関検出により、上
下のラインで相関の高い信号が相関検出器より出力し、
ＢＰＦ（２）１７に入力する。ＢＰＦ（２）１７ではＰ
ＡＬ復調時とＮＴＳＣ復調時でフィルター構成を変える
ことで中心周波数を変更し、ＢＰＦ１とＢＰＦ２との総
合特性でそれぞれの方式復調時にそれぞれの中心周波数
がセンターに来るようにする。ＢＰＦ２の出力からクロ
マ信号が得られる。またそのクロマ信号を入力ビデオ信
号をラインメモリで遅延させて時間あわせを行ったビデ
オ信号と加算することにより、輝度信号を抜き取る。
て、入力したビデオ信号はラインメモリで１Ｈあるいは
２Ｈ遅延した後、３つのＢＰＦ（１）１３，１４，１５
に入力し、クロマ信号帯域信号成分が通過する。それら
の出力は相関検出回路１６における相関検出により、上
下のラインで相関の高い信号が相関検出器より出力し、
ＢＰＦ（２）１７に入力する。ＢＰＦ（２）１７ではＰ
ＡＬ復調時とＮＴＳＣ復調時でフィルター構成を変える
ことで中心周波数を変更し、ＢＰＦ１とＢＰＦ２との総
合特性でそれぞれの方式復調時にそれぞれの中心周波数
がセンターに来るようにする。ＢＰＦ２の出力からクロ
マ信号が得られる。またそのクロマ信号を入力ビデオ信
号をラインメモリで遅延させて時間あわせを行ったビデ
オ信号と加算することにより、輝度信号を抜き取る。
【００１７】以上の構成により、本発明はＰＡＬ／ＮＴ
ＳＣの両方式に対応させた適応型コムフィルタを構成す
ることが可能とするものである。
ＳＣの両方式に対応させた適応型コムフィルタを構成す
ることが可能とするものである。
【００１８】請求項２では、さらに詳細な適用型コムフ
ィルタの構成の一実施例について述べる。図１は、本発
明の請求項２に記載の一実施例のブロック図を示し、図
１においてデジタル符号化されたビデオ信号は第１のラ
インメモリ１１に入力する。前記第１のラインメモリ１
１の出力は第２のラインメモリ１２に入力する。また、
前記デジタル符号化されたビデオ信号は第１のバンドパ
スフィルタ１３（以下、ＢＰＦと記す）に入力する。前
記第１のラインメモリの出力は第２のＢＰＦ１４に入力
する。前記第２のラインメモリ１２の出力は第３のＢＰ
Ｆ１５に入力する。前記第１のＢＰＦ１３の出力と前記
第２のＢＰＦ１４の出力と前記第３のＢＰＦ１５の出力
をそれぞれ相関検出回路１６に入力し、相関検出回路１
６によって３つの入力の内相関の高い２つの入力を選択
しコム動作をおこなう。前記相関検出回路１６の出力は
制御信号によってその周波数特性を変えるようにした第
４のＢＰＦ１７に入力する。前記第４のＢＰＦ１７の出
力は前記第１のラインメモリ１１の出力と共に加算回路
２７に入力する。
ィルタの構成の一実施例について述べる。図１は、本発
明の請求項２に記載の一実施例のブロック図を示し、図
１においてデジタル符号化されたビデオ信号は第１のラ
インメモリ１１に入力する。前記第１のラインメモリ１
１の出力は第２のラインメモリ１２に入力する。また、
前記デジタル符号化されたビデオ信号は第１のバンドパ
スフィルタ１３（以下、ＢＰＦと記す）に入力する。前
記第１のラインメモリの出力は第２のＢＰＦ１４に入力
する。前記第２のラインメモリ１２の出力は第３のＢＰ
Ｆ１５に入力する。前記第１のＢＰＦ１３の出力と前記
第２のＢＰＦ１４の出力と前記第３のＢＰＦ１５の出力
をそれぞれ相関検出回路１６に入力し、相関検出回路１
６によって３つの入力の内相関の高い２つの入力を選択
しコム動作をおこなう。前記相関検出回路１６の出力は
制御信号によってその周波数特性を変えるようにした第
４のＢＰＦ１７に入力する。前記第４のＢＰＦ１７の出
力は前記第１のラインメモリ１１の出力と共に加算回路
２７に入力する。
【００１９】以上の構成により、相関検出回路２６の出
力にクロマ信号が得られ、加算回路２７の出力には輝度
信号が得られる。
力にクロマ信号が得られ、加算回路２７の出力には輝度
信号が得られる。
【００２０】（実施の形態２）請求項３では、請求項１
で述べたラインメモリのより具体的な構成で特にＰＡＬ
とＮＴＳＣの切り替えに適したラインメモリの一実施例
について述べる。図３は、本発明の請求項３の一実施例
のブロック図を示し、図３においてビデオ信号は第１の
ラインメモリ１１１に入力し１水平期間ビデオ信号を遅
延する。第１のラインメモリ１１１の出力は第２のライ
ンメモリ１１２に入力し１水平期間ビデオ信号を遅延す
る。第１のラインメモリ１１１と第２のラインメモリ１
１２の出力はセレクタ１１３にそれぞれ入力し外部制御
信号により切り換えられる。セレクタ１１３の出力は第
３のラインメモリ１２１に入力し１水平期間ビデオ信号
を遅延する。第３のラインメモリ１２１の出力は第４の
ラインメモリ１２２に入力し１水平期間ビデオ信号を遅
延する。第３のラインメモリ１２１と第４のラインメモ
リ１２２の出力はセレクタ１２３にそれぞれ入力し外部
制御信号により切り換えられる。
で述べたラインメモリのより具体的な構成で特にＰＡＬ
とＮＴＳＣの切り替えに適したラインメモリの一実施例
について述べる。図３は、本発明の請求項３の一実施例
のブロック図を示し、図３においてビデオ信号は第１の
ラインメモリ１１１に入力し１水平期間ビデオ信号を遅
延する。第１のラインメモリ１１１の出力は第２のライ
ンメモリ１１２に入力し１水平期間ビデオ信号を遅延す
る。第１のラインメモリ１１１と第２のラインメモリ１
１２の出力はセレクタ１１３にそれぞれ入力し外部制御
信号により切り換えられる。セレクタ１１３の出力は第
３のラインメモリ１２１に入力し１水平期間ビデオ信号
を遅延する。第３のラインメモリ１２１の出力は第４の
ラインメモリ１２２に入力し１水平期間ビデオ信号を遅
延する。第３のラインメモリ１２１と第４のラインメモ
リ１２２の出力はセレクタ１２３にそれぞれ入力し外部
制御信号により切り換えられる。
【００２１】以上のように構成したラインメモリを前記
第１の一実施例の第１のラインメモリ１１と第２のライ
ンメモリ１２とに置き換えることにより、ラインメモリ
はＮＴＳＣでは１Ｈ（水平期間）の長さを持ちＰＡＬで
は２Ｈの長さを持ち、方式により切り換えるようになし
た適応型コムフィルタ回路の構成が可能となる。
第１の一実施例の第１のラインメモリ１１と第２のライ
ンメモリ１２とに置き換えることにより、ラインメモリ
はＮＴＳＣでは１Ｈ（水平期間）の長さを持ちＰＡＬで
は２Ｈの長さを持ち、方式により切り換えるようになし
た適応型コムフィルタ回路の構成が可能となる。
【００２２】（実施の形態３）請求項４では、請求項１
および請求項２で述べたＢＰＦのより詳細な構成につい
て述べる。図４は、本発明の請求項４の一実施例のブロ
ック図を示す。図４において、クロマ信号は第１のラッ
チ回路４１に入力し一単位時間遅延する。第１のラッチ
回路４１の出力は第２のラッチ回路４２に入力し一単位
時間遅延する。第２のラッチ回路４２の出力は反転回路
４３に入力し論理を反転する。反転回路４３の出力は第
３のラッチ回路４４に入力し一単位時間遅延する。第３
のラッチ回路４４の出力と第１のラッチ回路４１への入
力信号は第１の加算器４５に入力し加算される。また、
第１のラッチ回路４１の出力と反転回路４３の出力は第
２の加算器４６に入力し加算される。第２の加算器４６
の出力は乗算器４７に入力しＰＡＬ復調時は１をＮＴＳ
Ｃ復調時は−０．５が乗算される。第１の加算器４５の
出力と乗算器４７の出力は第３の加算器に入力し加算さ
れる。上記の構成で第１のＢＰＦ４９が構成される。上
記第１のＢＰＦの出力は、第１のＢＰＦと全く構成の第
２のＢＰＦ５０に入力し、帯域制限を受ける。第２のＢ
ＰＦ５０の出力は乗算器５１に入力し、ＰＡＬ復調時は
２９／１０２４と、ＮＴＳＣ復調時は３００／１０２４
と乗算される。
および請求項２で述べたＢＰＦのより詳細な構成につい
て述べる。図４は、本発明の請求項４の一実施例のブロ
ック図を示す。図４において、クロマ信号は第１のラッ
チ回路４１に入力し一単位時間遅延する。第１のラッチ
回路４１の出力は第２のラッチ回路４２に入力し一単位
時間遅延する。第２のラッチ回路４２の出力は反転回路
４３に入力し論理を反転する。反転回路４３の出力は第
３のラッチ回路４４に入力し一単位時間遅延する。第３
のラッチ回路４４の出力と第１のラッチ回路４１への入
力信号は第１の加算器４５に入力し加算される。また、
第１のラッチ回路４１の出力と反転回路４３の出力は第
２の加算器４６に入力し加算される。第２の加算器４６
の出力は乗算器４７に入力しＰＡＬ復調時は１をＮＴＳ
Ｃ復調時は−０．５が乗算される。第１の加算器４５の
出力と乗算器４７の出力は第３の加算器に入力し加算さ
れる。上記の構成で第１のＢＰＦ４９が構成される。上
記第１のＢＰＦの出力は、第１のＢＰＦと全く構成の第
２のＢＰＦ５０に入力し、帯域制限を受ける。第２のＢ
ＰＦ５０の出力は乗算器５１に入力し、ＰＡＬ復調時は
２９／１０２４と、ＮＴＳＣ復調時は３００／１０２４
と乗算される。
【００２３】以上のように構成したＢＰＦは、
【００２４】
【数２】
【００２５】の伝達関数を持ち、係数ａの１と−０．５
の切り換えを第１のＢＰＦ４９と第２のＢＰＦ５０に内
蔵した第１の乗算器４７の係数を切り替えることによ
り、中心周波数を変えることを実現する。上記のＢＰＦ
を実施の形態１で説明した第４のＢＰＦ１７で使用する
ことにより、ＰＡＬとＮＴＳＣとで係数を切り替えるこ
とにより両方式に対応した適応型コムフィルタ回路を構
成することが可能となる。
の切り換えを第１のＢＰＦ４９と第２のＢＰＦ５０に内
蔵した第１の乗算器４７の係数を切り替えることによ
り、中心周波数を変えることを実現する。上記のＢＰＦ
を実施の形態１で説明した第４のＢＰＦ１７で使用する
ことにより、ＰＡＬとＮＴＳＣとで係数を切り替えるこ
とにより両方式に対応した適応型コムフィルタ回路を構
成することが可能となる。
【００２６】
【発明の効果】以上のように、本発明の適応型コムフィ
ルタ回路によれば、相関検出回路の前後にＢＰＦを配置
し、後置したＢＰＦの周波数特性を変更することによ
り、同一クロックでＰＡＬとＮＴＳＣの両方式に対応す
る適応型コムフィルタ回路を提供することが可能とな
る。
ルタ回路によれば、相関検出回路の前後にＢＰＦを配置
し、後置したＢＰＦの周波数特性を変更することによ
り、同一クロックでＰＡＬとＮＴＳＣの両方式に対応す
る適応型コムフィルタ回路を提供することが可能とな
る。
【図１】本発明の適応型コムフィルタ回路のに係わる発
明の構成を示すブロック図
明の構成を示すブロック図
【図２】従来例であるコムフィルタの構成を示すブロッ
ク図
ク図
【図３】本発明の請求項３に係わる発明の構成を示すブ
ロック図
ロック図
【図４】本発明の請求項４に係わる発明の構成を示すブ
ロック図
ロック図
１１、１２ ラインメモリ １３、１４、１５、１７ ＢＰＦ １６ 相関検出回路 １８ 加算器
Claims (4)
- 【請求項１】 ビデオ信号をラインメモリーを用いてビ
デオ信号情報を遅延させライン間の相関を測定して各ラ
インメモリー出力を選択的に切り換えるコムフィルタに
おいて、相関検出回路の前後にＢＰＦ部を設け、ＰＡＬ
あるいはＮＴＳＣ方式の違いにより相関検出回路に後置
したＢＰＦ部の周波数特性を切り換えることによりＰＡ
Ｌ／ＮＴＳＣの両方式に対応させることを特徴とする適
応型コムフィルタ回路。 - 【請求項２】 ビデオ信号が入力する第１のラインメモ
リと、前記第１のラインメモリの出力を入力する第２の
ラインメモリと、前記デジタル符号化されたビデオ信号
を入力する第１のバンドパスフィルタ（以下、ＢＰＦと
記述する）と、前記第１のラインメモリの出力を入力す
る第２のＢＰＦと、前記第２のラインメモリの出力を入
力する第３のＢＰＦと、前記第１のＢＰＦの出力と前記
第２のＢＰＦの出力と前記第３のＢＰＦの出力をそれぞ
れ入力し、相関検出回路によって３つの入力の内相関の
高い２つの入力を選択する相関検出回路と、前記相関検
出回路の出力を入力し制御信号によってその周波数特性
を変えるようにした第４のＢＰＦと、前記第４のＢＰＦ
の出力と前記第１のラインメモリの出力を入力した加算
回路とよりなり、前記相関検出回路に後置した第４のＢ
ＰＦにおいて、ＰＡＬあるいはＮＴＳＣ方式の違いによ
り周波数特性を切り換えることによりＰＡＬ／ＮＴＳＣ
の両方式に対応させることを特徴とする適応型コムフィ
ルタ回路。 - 【請求項３】 ラインメモリはＮＴＳＣ方式では１Ｈ
（水平期間）の長さを持ちＰＡＬ方式では２Ｈの長さを
持ち、これらの方式により切り換える請求項２記載の適
応型コムフィルタ回路。 - 【請求項４】 第４のＢＰＦは、 【数１】 の伝達関数を持ち係数ａを１と−０．５とを切り換える
ことで中心周波数を変える請求項２記載の適応型コムフ
ィルタ回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP15631797A JPH114458A (ja) | 1997-06-13 | 1997-06-13 | 適応型コムフィルタ回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP15631797A JPH114458A (ja) | 1997-06-13 | 1997-06-13 | 適応型コムフィルタ回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH114458A true JPH114458A (ja) | 1999-01-06 |
Family
ID=15625165
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP15631797A Pending JPH114458A (ja) | 1997-06-13 | 1997-06-13 | 適応型コムフィルタ回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH114458A (ja) |
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2002058043A (ja) * | 2000-08-08 | 2002-02-22 | Nec Corp | Ｐａｌ信号の位相歪み補正回路、方法及びｐａｌ信号のｙ／ｃ分離回路、方法 |
| WO2007026259A2 (en) * | 2005-08-04 | 2007-03-08 | Dibcom | Receiver for analog tv signals |
| US7773157B2 (en) | 2005-01-13 | 2010-08-10 | Samsung Electronics Co., Ltd. | Digital video signal processing apparatus and method for adaptive Y/C separation |
-
1997
- 1997-06-13 JP JP15631797A patent/JPH114458A/ja active Pending
Cited By (5)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2002058043A (ja) * | 2000-08-08 | 2002-02-22 | Nec Corp | Ｐａｌ信号の位相歪み補正回路、方法及びｐａｌ信号のｙ／ｃ分離回路、方法 |
| JP4531217B2 (ja) * | 2000-08-08 | 2010-08-25 | ルネサスエレクトロニクス株式会社 | Ｐａｌ信号の位相歪み補正回路、方法及びｐａｌ信号のｙ／ｃ分離回路、方法 |
| US7773157B2 (en) | 2005-01-13 | 2010-08-10 | Samsung Electronics Co., Ltd. | Digital video signal processing apparatus and method for adaptive Y/C separation |
| WO2007026259A2 (en) * | 2005-08-04 | 2007-03-08 | Dibcom | Receiver for analog tv signals |
| WO2007026259A3 (en) * | 2005-08-04 | 2007-08-30 | Dibcom | Receiver for analog tv signals |
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