JPH08317556A - Rush current prevention circuit - Google Patents
Rush current prevention circuitInfo
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- JPH08317556A JPH08317556A JP7122225A JP12222595A JPH08317556A JP H08317556 A JPH08317556 A JP H08317556A JP 7122225 A JP7122225 A JP 7122225A JP 12222595 A JP12222595 A JP 12222595A JP H08317556 A JPH08317556 A JP H08317556A
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Abstract
Description
【０００１】[0001]
【産業上の利用分野】本発明は、突入電流防止回路に係
わり、特に電源投入状態で電子回路パッケージを挿入す
る（活線挿入）場合に発生する突入電流を防止する突入
電流防止回路に関するものである。BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to an inrush current prevention circuit, and more particularly to an inrush current prevention circuit for preventing an inrush current generated when an electronic circuit package is inserted (hot line insertion) in a power-on state. is there.
【０００２】[0002]
【従来の技術】従来、突入電流を防止する回路として
は、例えば特開昭６３−２５７４２０号公報および特開
昭６３−１５４０１８号公報にて提案されたトランジス
タのエミッタ・コレクタ端子間を緩やかに導通させて突
入電流を防ぐ方法または特開平５−３２７２４４号公報
にて提案された電子回路パッケージの電源端子の長さを
変えて長ピン側に抵抗を入れて緩やかに充電した後に最
終的に短ピンで長ピン側の回路を短絡する方法が行われ
てきた。2. Description of the Related Art Conventionally, as a circuit for preventing an inrush current, for example, gently conducting between an emitter and a collector terminal of a transistor proposed in JP-A-63-257420 and JP-A-63-154018. Or a method of preventing inrush current or changing the length of the power supply terminal of the electronic circuit package proposed in Japanese Unexamined Patent Publication No. 5-327244 to put a resistor on the long pin side and slowly charge, and finally the short pin. The method of short-circuiting the circuit on the long pin side has been performed.
【０００３】[0003]
【発明が解決しようとする課題】しかしながら、このよ
うに構成された突入電流防止回路において、前者の構成
では、トランジスタのエミッタ・コレクタ間を介して電
子回路パッケージ内に常時消費電流を供給するため、エ
ミッタ・コレクタ間のオン電圧分が電源供給側の電圧か
ら低減されてしまうため、電子回路パッケージ内の素子
の電源端子電圧の精度が低下し、極端な場合には素子の
電源電圧許容範囲を超えてしまうという問題があった。
また、トランジスタも常時発熱するため、熱抵抗が低
く、電流容量の大きいトランジスタを使用する必要があ
り、素子形状が大きくなるとともにコストアップになる
という問題があった。However, in the inrush current prevention circuit configured as described above, in the former configuration, current consumption is always supplied into the electronic circuit package through the emitter-collector of the transistor. Since the ON voltage between the emitter and collector is reduced from the voltage on the power supply side, the accuracy of the power supply terminal voltage of the element in the electronic circuit package decreases, and in extreme cases, the power supply voltage range of the element is exceeded. There was a problem that it would end up.
Further, since the transistor also constantly generates heat, it is necessary to use a transistor having a low thermal resistance and a large current capacity, which causes a problem that the device shape becomes large and the cost increases.
【０００４】また、後者の構成では、突入電流の流れる
時間を決める抵抗を２段とし、かつ負荷側の電圧を検出
して２段目の抵抗をスイッチにより接続しているので、
電圧検出回路およびスイッチなどを用いることからコス
トアップとなり、かつ実装するための基板床面積が大き
くなるなどの問題があった。Further, in the latter configuration, the resistance that determines the time for which the rush current flows is two stages, and the second stage resistance is connected by the switch by detecting the voltage on the load side.
The use of the voltage detection circuit, the switch, and the like causes problems such as an increase in cost and an increase in the board floor area for mounting.
【０００５】したがって本発明は、前述した従来の課題
を解決するためになされたものであり、その目的は、電
子回路パッケージを活線挿入する場合に生じる突入電流
を防止し、コネクタ接続点を保護するとともに電源供給
側の電圧降下を防止するようにした突入電流防止回路を
提供することにある。Therefore, the present invention has been made to solve the above-mentioned conventional problems, and an object thereof is to prevent an inrush current generated when an electronic circuit package is hot-plugged and to protect a connector connection point. Another object of the present invention is to provide an inrush current prevention circuit that prevents a voltage drop on the power supply side.
【０００６】[0006]
【課題を解決するための手段】このような目的を達成す
るために本発明による突入電流防止回路は、一対の電源
入力端子と、負荷となる電子回路との間に接続され、か
つエミッタが電源入力端子の第１の正極側端子に接続さ
れ、コレクタが電子回路の電源入力端子に接続されると
ともに電源入力端子の第１の正極側と同一電圧の第２の
正極側端子に接続されたＰＮＰトランジスタと、このＰ
ＮＰトランジスタのベースとグランドのとの間に接続さ
れた第１の抵抗器と、ＰＮＰトランジスタのエミッタと
ベースとの間に接続された第２の抵抗とコンデンサとか
らなる並列回路とを備え、第１の正極側端子と第２の正
極側端子とが時間差をもって電源供給端子に接続される
ように構成したものである。In order to achieve such an object, an inrush current prevention circuit according to the present invention is connected between a pair of power supply input terminals and an electronic circuit as a load, and an emitter is a power supply. A PNP connected to a first positive electrode side terminal of the input terminal, a collector connected to a power source input terminal of the electronic circuit, and a second positive electrode side terminal having the same voltage as the first positive electrode side of the power source input terminal. Transistor and this P
A first resistor connected between the base of the NP transistor and ground; and a parallel circuit comprising a second resistor and a capacitor connected between the emitter and base of the PNP transistor. The first positive electrode side terminal and the second positive electrode side terminal are connected to the power supply terminal with a time difference.
【０００７】[0007]
【作用】本発明においては、電源供給端子に同時接続さ
れる際に第１の正極側端子が第２の正極側端子よりも先
に接続されることになる。In the present invention, the first positive electrode side terminal is connected before the second positive electrode side terminal when simultaneously connected to the power supply terminals.
【０００８】[0008]
【実施例】以下、図面を用いて本発明の実施例を詳細に
説明する。図１は、本発明による突入電流防止回路の一
実施例による構成を示す回路図である。図１において、
ＰＮＰトランジスタ１は、そのコレクタが電源供給ライ
ンＬの正極電圧Ｖｃｃが供給される正極側端子ＴV1と接
続される電源入力端子Ｔｃに接続され、そのエミッタが
電源供給ラインＬの正極電圧Ｖｃｃが供給される正極側
端子ＴV2と接続される電源入力端子Ｔｅに接続されてい
る。なお、電源供給ラインＬの正極側端子ＴV1と正極側
端子ＴV2とには同一電圧が供給されているものとなって
いる。Embodiments of the present invention will now be described in detail with reference to the drawings. FIG. 1 is a circuit diagram showing the configuration of an embodiment of an inrush current prevention circuit according to the present invention. In FIG.
The PNP transistor 1 has its collector connected to a power supply input terminal Tc connected to a positive electrode side terminal TV1 to which the positive voltage Vcc of the power supply line L is supplied, and its emitter supplied with the positive voltage Vcc of the power supply line L. Is connected to a power input terminal Te connected to the positive terminal TV2. The same voltage is supplied to the positive terminal TV1 and the positive terminal TV2 of the power supply line L.
【０００９】また、このＰＮＰトランジスタ１には、ベ
ースとエミッタとの間にコンデンサ２と抵抗３とを並列
接続させた並列回路が接続され、さらにこのベースには
グランドとの間に抵抗４が接続され、このグランドには
電源供給ラインＬの負極側端子ＴE と接続されるグラン
ド側電源入力端子Ｔｂが接続されている。Further, the PNP transistor 1 is connected with a parallel circuit in which a capacitor 2 and a resistor 3 are connected in parallel between a base and an emitter, and a resistor 4 is connected between the base and the ground. The ground side power input terminal Tb connected to the negative terminal TE of the power supply line L is connected to this ground.
【００１０】この場合、ＰＮＰトランジスタ１のコレク
タ側に接続される電源入力端子Ｔｃは、他のエミッタ側
電源入力端子Ｔｅおよびグランド側電源入力端子Ｔｂの
端子長（長ピン構造）よりもその端子の長さが短い短ピ
ン構造を有して形成されている。また、このＰＮＰトラ
ンジスタ１のコレクタとグランドとの間にはバイパスコ
ンデンサ５が接続されて突入電流防止回路が構成されて
いる。In this case, the power source input terminal Tc connected to the collector side of the PNP transistor 1 has a terminal length (long pin structure) larger than that of the other emitter side power source input terminal Te and the ground side power source input terminal Tb. It has a short pin structure with a short length. Further, a bypass capacitor 5 is connected between the collector of the PNP transistor 1 and the ground to form an inrush current prevention circuit.
【００１１】なお、前述した突入電流防止回路側の短ピ
ン構造を有するコレクタ側電源入力端子Ｔｃと、長ピン
構造を有するエミッタ側電源入力端子Ｔｅおよびグラン
ド側電源入力端子Ｔｂとは、図示したように突入電流防
止回路用のコネクタＣC 内に所定の配列で収納配置され
る構造となっている。The collector side power source input terminal Tc having the short pin structure on the side of the inrush current prevention circuit and the emitter side power source input terminal Te and the ground side power source input terminal Tb having the long pin structure are as shown in the drawing. In addition, it has a structure in which it is housed and arranged in a predetermined arrangement in the connector CC for the inrush current prevention circuit.
【００１２】また、このように構成された突入電流防止
回路には、トランジスタ１のコレクタとグランドとの間
にバイパスコンデンサ５と並列に負荷回路としての電子
回路６が接続される。そして、これらの突入電流防止回
路および電子回路６は、図示しないが同一基板上に搭載
されて電子回路パッケージが構成される構造となってい
る。Further, in the rush current prevention circuit thus constructed, an electronic circuit 6 as a load circuit is connected in parallel with the bypass capacitor 5 between the collector of the transistor 1 and the ground. Although not shown, the inrush current prevention circuit and the electronic circuit 6 are mounted on the same substrate to form an electronic circuit package.
【００１３】なお、前述した電源供給ラインＬの正極側
端子ＴV1，正極側端子ＴV2および負極側端子ＴE は、図
示したように電源供給用コネクタＣP 内に所定の配列で
収納配置される構造となっている。The positive terminal TV1, the positive terminal TV2 and the negative terminal TE of the power supply line L described above are arranged in a predetermined arrangement in the power supply connector CP as shown in the figure. ing.
【００１４】また、このように構成された突入電流防止
回路は、電子回路６が接続された電子回路パッケージの
コネクタＣC を電源供給ラインＬのコネクタＣP に挿入
する場合には、ＰＮＰトランジスタ１のエミッタ側電源
入力端子Ｔｅおよびグランド側電源入力端子Ｔｂとコレ
クタ側電源入力端子Ｔｃとが端子長が異なる分時間差を
もって電源供給ラインＬの正極側端子ＴV2および負極側
端子ＴEと正極側端子ＴV1 とにそれぞれ接続される構造
となっている。Further, in the rush current prevention circuit thus constructed, when the connector CC of the electronic circuit package to which the electronic circuit 6 is connected is inserted into the connector CP of the power supply line L, the emitter of the PNP transistor 1 Side power supply input terminal Te and ground side power supply input terminal Tb and collector side power supply input terminal Tc have different terminal lengths, so that there is a time difference between positive side terminal TV2 and negative side terminal TE and positive side terminal TV1 of power supply line L, respectively. It is connected.
【００１５】次にこのように構成された突入電流防止回
路の動作について図２を用いて説明する。電子回路パッ
ケージ用のコネクタＣC が電源供給ラインＬのコネクタ
ＣP に挿入されると、まず、図１に示す長ピン構造を有
するエミッタ側電源入力端子Ｔｅおよびグランド側電源
入力端子Ｔｂを介して電子回路パッケージに電源供給ラ
インＬから電源電圧Ｖｃｃが供給される。Next, the operation of the inrush current prevention circuit configured as described above will be described with reference to FIG. When the connector CC for the electronic circuit package is inserted into the connector CP of the power supply line L, first, the electronic circuit is first passed through the emitter side power source input terminal Te and the ground side power source input terminal Tb having the long pin structure shown in FIG. The power supply voltage Vcc is supplied to the package from the power supply line L.
【００１６】ここで、ＰＮＰトランジスタ１は、ベース
電流が瞬時には供給されず、コンデンサ２が抵抗４によ
り充電され、図２（ａ）に示すようにベース・エミッタ
間電圧ＶBEが約０．６〜０．７Ｖになったところではじ
めてベース電流ＩB が流れる。ここまでの時間ｔｄの間
に電子回路パッケージ用コネクタＣC 内の長ピン構造を
有するエミッタ側電源入力端子Ｔｅおよびグランド側電
源入力端子Ｔｂは、電源供給用コネクタＣP 内のそれぞ
れ正極側端子ＴV2と負極側端子ＴE とに嵌合される。In the PNP transistor 1, the base current is not instantaneously supplied, the capacitor 2 is charged by the resistor 4, and the base-emitter voltage VBE is about 0.6 as shown in FIG. 2 (a). The base current IB flows only when the voltage reaches to 0.7V. The emitter side power source input terminal Te and the ground side power source input terminal Tb having a long pin structure in the electronic circuit package connector CC during the time td so far are respectively the positive electrode side terminal TV2 and the negative electrode in the power source supply connector CP. It is fitted to the side terminal TE.
【００１７】次にＰＮＰトランジスタ１は、図２（ｂ）
に示すようにコレクタ・エミッタ間の電圧ＶCEが急速に
低下し、コンデンサ５を充電する。この充電時間をｔｃ
とする。ここで、ＰＮＰトランジスタ１が導通する速さ
は、エミッタ・ベース間のコンデンサ２によって緩やか
になるため、図２（ｃ）に示すようにコレクタ電流Ｉｃ
の流れ出す傾きも緩やかになる。Next, the PNP transistor 1 is shown in FIG.
As shown in FIG. 5, the collector-emitter voltage VCE rapidly decreases, and the capacitor 5 is charged. This charging time is tc
And Here, since the speed at which the PNP transistor 1 conducts is moderated by the capacitor 2 between the emitter and the base, the collector current Ic as shown in FIG.
The inclination of the flowing out becomes gentle.
【００１８】さらに時間が経過して時間ｔｐ（長ピンと
短ピンとの接続時間差）経た後、短ピン構造を有するコ
レクタ側電源入力端子Ｔｃが正極側端子ＴV1に嵌合によ
り接続され、ＰＮＰトランジスタ１のエミッタ・コレク
タ間が短絡される。このとき、ＰＮＰトランジスタ１の
エミッタ・コレクタ間の電圧ＶCEは、飽和電圧まで低下
する。After a further time elapses and a time tp (the difference in connection time between the long pin and the short pin), the collector side power supply input terminal Tc having the short pin structure is connected to the positive side terminal TV1 by fitting, and the PNP transistor 1 is connected. The emitter and collector are short-circuited. At this time, the emitter-collector voltage VCE of the PNP transistor 1 drops to the saturation voltage.
【００１９】この短ピン構造のコレクタ側電源入力端子
Ｔｃによる正極側端子ＴV1への接続により電子回路６
は、定常時の電力供給を受けることになる。このような
構成によれば、長ピン構造のエミッタ側電源入力端子Ｔ
ｅおよびグランド側電源入力端子Ｔｂの接続時，ＰＮＰ
トランジスタ１の接続時および短ピン構造のコレクタ側
電源入力端子Ｔｃの接続時の各時点における電流変化が
極めて少なくなる。By connecting the collector side power source input terminal Tc of this short pin structure to the positive side terminal TV1, the electronic circuit 6 is connected.
Will be supplied with power in the steady state. According to such a configuration, the emitter-side power input terminal T having the long pin structure
When connecting e and ground side power input terminal Tb, PNP
When the transistor 1 is connected and when the collector-side power supply input terminal Tc having the short pin structure is connected, the change in current at each time is extremely small.
【００２０】[0020]
【発明の効果】以上、説明したように本発明によれば、
突入電流を防ぐことができるので、端子接続点の損傷お
よび電源供給側の電圧降下を防止することができるとい
う効果が得られる。また、本発明によれば、トランジス
タは電源供給時（コネクタ接続時）のみに動作するの
で、従来構成のようにトランジスタの損失が常にあるこ
とはなく、小型のトランジスタを選定でき、コストダウ
ンできるという効果が得られる。また、本発明によれ
ば、従来構成のように電圧検出回路，２段の抵抗構成お
よびスイッチなどを用いる必要がなくなるので、回路構
成が簡素化され、コストダウン効果とともに信頼性向上
効果が得られる。As described above, according to the present invention,
Since an inrush current can be prevented, it is possible to obtain an effect that damage to the terminal connection point and a voltage drop on the power supply side can be prevented. Further, according to the present invention, since the transistor operates only when power is supplied (when the connector is connected), there is no loss of transistor as in the conventional configuration, a small transistor can be selected, and cost can be reduced. The effect is obtained. Further, according to the present invention, it is not necessary to use a voltage detection circuit, a two-stage resistance configuration, a switch and the like as in the conventional configuration, so that the circuit configuration is simplified, and a cost reduction effect and a reliability improvement effect can be obtained. .
【図１】 本発明による突入電流防止回路の一実施例に
よる構成を示す回路図である。FIG. 1 is a circuit diagram showing a configuration of an embodiment of an inrush current prevention circuit according to the present invention.
【図２】 図１の回路各部における電圧および電流波形
を示す図である。FIG. 2 is a diagram showing voltage and current waveforms in various parts of the circuit of FIG.
１…ＰＮＰトランジスタ、２…コンデンサ、３，４…抵
抗、５…コンデンサ、６…電子回路、Ｌ…電源供給ライ
ン、ＴV1，ＴV2…正極側端子、ＴE …負極側端子、ＣP
…電源供給用コネクタ、ＣC …電子回路パッケージ用コ
ネクタ、Ｔｅ…エミッタ側電源入力端子、Ｔｃ…コレク
タ側電源入力端子、Ｔｂ…グランド側電源入力端子。1 ... PNP transistor, 2 ... Capacitor, 3, 4 ... Resistor, 5 ... Capacitor, 6 ... Electronic circuit, L ... Power supply line, TV1, TV2 ... Positive terminal, TE ... Negative terminal, CP
... Power supply connector, CC ... Electronic circuit package connector, Te ... Emitter side power input terminal, Tc ... Collector side power input terminal, Tb ... Ground side power input terminal.
Claims (2)
回路との間に接続され、かつエミッタが前記電源入力端
子の第１の正極側端子に接続され、コレクタが前記電子
回路の電源入力端に接続されるとともに前記電源入力端
子の第１の正極側と同一電圧の第２の正極側端子に接続
されたＰＮＰトランジスタと、 前記ＰＮＰトランジスタのベースとグランドのとの間に
接続された第１の抵抗器と、 前記ＰＮＰトランジスタのエミッタとベースとの間に接
続された第２の抵抗とコンデンサとからなる並列回路
と、を備え、 前記第１の正極側端子と前記第２の正極側端子とが時間
差をもって電源供給端子に接続されることを特徴とする
突入電流防止回路。1. A power supply input terminal of the electronic circuit, which is connected between a pair of power supply input terminals and an electronic circuit serving as a load, an emitter of which is connected to a first positive electrode side terminal of the power supply input terminal. A PNP transistor connected to an end and connected to a second positive electrode side terminal having the same voltage as the first positive electrode side of the power supply input terminal, and a PNP transistor connected between the base and the ground of the PNP transistor. 1 resistor and a parallel circuit including a second resistor and a capacitor connected between the emitter and the base of the PNP transistor, and the first positive electrode side terminal and the second positive electrode side. An inrush current prevention circuit characterized in that the terminals are connected to the power supply terminal with a time difference.
子が前記第２の正極側端子よりも端子長を長くしたこと
を特徴とする突入電流防止回路。2. The inrush current prevention circuit according to claim 1, wherein the first positive electrode side terminal has a terminal length longer than that of the second positive electrode side terminal.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7122225A JPH08317556A (en) | 1995-05-22 | 1995-05-22 | Rush current prevention circuit |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7122225A JPH08317556A (en) | 1995-05-22 | 1995-05-22 | Rush current prevention circuit |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH08317556A true JPH08317556A (en) | 1996-11-29 |
Family
ID=14830668
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP7122225A Pending JPH08317556A (en) | 1995-05-22 | 1995-05-22 | Rush current prevention circuit |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH08317556A (en) |
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| EP1376835A1 (en) * | 2002-06-21 | 2004-01-02 | Varel Srl | Capacitor module for power factor correction equipments |
| JP2009516489A (en) * | 2005-11-15 | 2009-04-16 | テレフオンアクチーボラゲット エル エム エリクソン（パブル） | Switched hot swap controller |
| JP2009225540A (en) * | 2008-03-14 | 2009-10-01 | Nec Computertechno Ltd | Power supply apparatus and its control method |
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-
1995
- 1995-05-22 JP JP7122225A patent/JPH08317556A/en active Pending
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