JPH077375B2 - バス制御方式 - Google Patents
バス制御方式Info
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- JPH077375B2 JPH077375B2 JP1154320A JP15432089A JPH077375B2 JP H077375 B2 JPH077375 B2 JP H077375B2 JP 1154320 A JP1154320 A JP 1154320A JP 15432089 A JP15432089 A JP 15432089A JP H077375 B2 JPH077375 B2 JP H077375B2
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- JP
- Japan
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- signal
- information transfer
- information
- transfer
- flop
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- Expired - Lifetime
Links
- 238000000034 method Methods 0.000 title claims description 9
- 230000004044 response Effects 0.000 claims description 17
- 230000000873 masking effect Effects 0.000 claims description 2
- 239000003999 initiator Substances 0.000 description 19
- 230000001360 synchronised effect Effects 0.000 description 5
- 230000004913 activation Effects 0.000 description 3
- 230000007704 transition Effects 0.000 description 3
- 238000007796 conventional method Methods 0.000 description 2
- 230000003213 activating effect Effects 0.000 description 1
- 230000000694 effects Effects 0.000 description 1
- 230000000415 inactivating effect Effects 0.000 description 1
- 230000002093 peripheral effect Effects 0.000 description 1
Classifications
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F13/00—Interconnection of, or transfer of information or other signals between, memories, input/output devices or central processing units
- G06F13/38—Information transfer, e.g. on bus
- G06F13/42—Bus transfer protocol, e.g. handshake; Synchronisation
- G06F13/4204—Bus transfer protocol, e.g. handshake; Synchronisation on a parallel bus
- G06F13/4221—Bus transfer protocol, e.g. handshake; Synchronisation on a parallel bus being an input/output bus, e.g. ISA bus, EISA bus, PCI bus, SCSI bus
- G06F13/4226—Bus transfer protocol, e.g. handshake; Synchronisation on a parallel bus being an input/output bus, e.g. ISA bus, EISA bus, PCI bus, SCSI bus with asynchronous protocol
Landscapes
- Engineering & Computer Science (AREA)
- Theoretical Computer Science (AREA)
- Physics & Mathematics (AREA)
- General Engineering & Computer Science (AREA)
- General Physics & Mathematics (AREA)
- Information Transfer Systems (AREA)
Description
【発明の詳細な説明】 〔産業上の利用分野〕 本発明は中、小型コンピュータ周辺機器間のインターフ
ェースであるスモール・コンピュータ・システム・イン
タフェース(以下、SCSIと略記する)のバス制御方式、
特にSCSIバスとの情報の送受信時にファースト・イン・
ファースト・アウト型メモリ(以下FIFOと略記する)を
使用する場合のSCSIバス制御方式に関する。
ェースであるスモール・コンピュータ・システム・イン
タフェース(以下、SCSIと略記する)のバス制御方式、
特にSCSIバスとの情報の送受信時にファースト・イン・
ファースト・アウト型メモリ(以下FIFOと略記する)を
使用する場合のSCSIバス制御方式に関する。
〔従来の技術〕 SCSIにおける情報転送には、ターゲットがトライブする
転送要求信号(以下、▲▼信号と略記する)とイ
ニシエータがドライブする転送応答信号(以下、▲
▼信号と略記する)の完全なハンドシェークで情報転
送を行う非同期転送と▲▼信号の応答がなくても
▲▼信号の先送りができる同期転送がある。非同
期転送のタイミングチャート(ターゲットからイニシエ
ータに情報転送)を第3図に、同期転送のタイミングチ
ャート(ターゲットからイニシエータに情報転送)を第
4図に示す。
転送要求信号(以下、▲▼信号と略記する)とイ
ニシエータがドライブする転送応答信号(以下、▲
▼信号と略記する)の完全なハンドシェークで情報転
送を行う非同期転送と▲▼信号の応答がなくても
▲▼信号の先送りができる同期転送がある。非同
期転送のタイミングチャート(ターゲットからイニシエ
ータに情報転送)を第3図に、同期転送のタイミングチ
ャート(ターゲットからイニシエータに情報転送)を第
4図に示す。
従来のSCSIバス制御方式では、情報を受信しているイニ
シエータが最終情報の転送に対する▲▼信号をイ
ンアクティブにする動作を、SCSIバスとの情報の送受信
を行うFIFOが空であることのチェックを行わずに実行
し、その後FICOからのデータの読みだしが終了してFIFO
が空になると転送系回路の初期化を行っていた。
シエータが最終情報の転送に対する▲▼信号をイ
ンアクティブにする動作を、SCSIバスとの情報の送受信
を行うFIFOが空であることのチェックを行わずに実行
し、その後FICOからのデータの読みだしが終了してFIFO
が空になると転送系回路の初期化を行っていた。
情報をイニシエータに転送しているターゲットは最終情
報転送に対するイニシエータの▲▼信号がインア
クティブになった時点でその転送フェーズの終了を確認
し次のフェーズへ移行する。そのため従来のSCSIバス制
御方式でターゲットからイニシエータへの情報転送を制
御していると、特にイニシエータがFIFOを持っている場
合には、FIFOにまだ情報が残っている状態でターゲット
がフェーズを変えてしまう可能性があった。この時続け
て、同期転送でのターゲットからイニシエータへの情報
転送フェーズが始まると、イニシエータはFIFOの中にま
だ前のフェーズの情報が残っているにも関わらずこの情
報の引き取りを行う必要がある。このためFIFOの中に残
っている前のフェーズの情報の読みだしが終了しても、
すでに次のフェーズのデータがFIFO中に存在するため転
送系回路の初期化ができず不都合が生じていた。
報転送に対するイニシエータの▲▼信号がインア
クティブになった時点でその転送フェーズの終了を確認
し次のフェーズへ移行する。そのため従来のSCSIバス制
御方式でターゲットからイニシエータへの情報転送を制
御していると、特にイニシエータがFIFOを持っている場
合には、FIFOにまだ情報が残っている状態でターゲット
がフェーズを変えてしまう可能性があった。この時続け
て、同期転送でのターゲットからイニシエータへの情報
転送フェーズが始まると、イニシエータはFIFOの中にま
だ前のフェーズの情報が残っているにも関わらずこの情
報の引き取りを行う必要がある。このためFIFOの中に残
っている前のフェーズの情報の読みだしが終了しても、
すでに次のフェーズのデータがFIFO中に存在するため転
送系回路の初期化ができず不都合が生じていた。
本発明のスモール・コンピュータ・システム・インター
フェース制御方式は、データ転送時に情報転送要求信号
と情報転送応答信号のハンドシェークを制御する第一の
手段と、データバスに対し情報の送受信を行うファース
ト・イン・ファースト・アウト型メモリと、情報転送回
数をカウントすることにより設定された情報転送回数よ
り1回少ない回数の情報転送が終了したことを検出する
カウンタと、前記カウンタが、設定された情報転送回数
より1回少ない回数の情報転送が終了したことを検出し
た後に、前記第一の手段が最終バイトに対する情報応答
信号をアクティブにするとセットされるフリップフロッ
プと、前記フリップフロップの出力により、情報応答信
号をアクティブ側にマスクする第二の手段とを有し、イ
ニシエータが情報を受信している場合に、前記カウンタ
が設定された情報転送の回数より1回少ない回数の情報
転送が終了したことを検出した後に、前記第一の手段が
最終バイトに対する情報応答信号をアクティブにする
と、前記フリップフロップがセットされて、前記第二の
手段により情報応答信号がアクティブに保持されるた
め、前記第一の手段が情報応答信号をインアクティブに
しても、前記FIFOの中のデータがすべて読み出されて、
前記フリップフロップがセットされるまで情報応答信号
がアクティブに保持されることを特徴とする。
フェース制御方式は、データ転送時に情報転送要求信号
と情報転送応答信号のハンドシェークを制御する第一の
手段と、データバスに対し情報の送受信を行うファース
ト・イン・ファースト・アウト型メモリと、情報転送回
数をカウントすることにより設定された情報転送回数よ
り1回少ない回数の情報転送が終了したことを検出する
カウンタと、前記カウンタが、設定された情報転送回数
より1回少ない回数の情報転送が終了したことを検出し
た後に、前記第一の手段が最終バイトに対する情報応答
信号をアクティブにするとセットされるフリップフロッ
プと、前記フリップフロップの出力により、情報応答信
号をアクティブ側にマスクする第二の手段とを有し、イ
ニシエータが情報を受信している場合に、前記カウンタ
が設定された情報転送の回数より1回少ない回数の情報
転送が終了したことを検出した後に、前記第一の手段が
最終バイトに対する情報応答信号をアクティブにする
と、前記フリップフロップがセットされて、前記第二の
手段により情報応答信号がアクティブに保持されるた
め、前記第一の手段が情報応答信号をインアクティブに
しても、前記FIFOの中のデータがすべて読み出されて、
前記フリップフロップがセットされるまで情報応答信号
がアクティブに保持されることを特徴とする。
すなわち、本発明のSCSIバス制御方式の特徴は、イニシ
エータが情報を受信している場合には、SCSIバスからFI
FOに引き取った全ての情報が読み出されるまで、最終情
報の転送に対する▲▼信号をアクティブに保持す
ることによりターゲットの次フェーズへの遷移を遅らせ
ることにある。
エータが情報を受信している場合には、SCSIバスからFI
FOに引き取った全ての情報が読み出されるまで、最終情
報の転送に対する▲▼信号をアクティブに保持す
ることによりターゲットの次フェーズへの遷移を遅らせ
ることにある。
次に、本発明について図面を参照して説明する。
第1図は本発明の第一の実施例である。01はCPU、02
は、情報転送時にSCSIバスの▲▼信号と▲
▼信号のハンドシェークを制御する▲▼/▲
▼ハンドシェーク制御回路、03は、SCSIバスとデータ
の送受を行うFIFO、04は、情報転送数をカウントする転
送カウンタ、05はD型フリップフロップ、06,07は、AND
ゲート、08,09,10は、インバータゲート、 信号101はSCSIバス、信号102は情報転送応答信号である
▲▼信号のSCSIバスへの出力、信号103は情報転
送要求信号である▲▼信号のSCSIバスからの入
力、信号104は▲▼/▲▼ハンシェーク制
御回路02が出力する元▲▼信号、信号105は元▲
▼信号104をマスクする信号、信号106は、FIFO03
へのデータ書き込み信号、信号107は、設定された回数
より1回少ない回数の情報転送が終了したことを示す転
送終了準備信号、信号108は、▲▼/▲▼
ハンドシェーク制御回路02の起動信号、信号109は、設
定した転送回数分の転送が終了したことを示す転送終了
信号、信号110は、イニシエータでは情報受信を行って
いることを示す信号、信号111は、FIFO03が空であるこ
とを示すFIFOエンプティ信号、信号112は、情報のSCSI
バスからの入力、信号113はDMAコントローラ等からのFI
FO読みだし信号である。
は、情報転送時にSCSIバスの▲▼信号と▲
▼信号のハンドシェークを制御する▲▼/▲
▼ハンドシェーク制御回路、03は、SCSIバスとデータ
の送受を行うFIFO、04は、情報転送数をカウントする転
送カウンタ、05はD型フリップフロップ、06,07は、AND
ゲート、08,09,10は、インバータゲート、 信号101はSCSIバス、信号102は情報転送応答信号である
▲▼信号のSCSIバスへの出力、信号103は情報転
送要求信号である▲▼信号のSCSIバスからの入
力、信号104は▲▼/▲▼ハンシェーク制
御回路02が出力する元▲▼信号、信号105は元▲
▼信号104をマスクする信号、信号106は、FIFO03
へのデータ書き込み信号、信号107は、設定された回数
より1回少ない回数の情報転送が終了したことを示す転
送終了準備信号、信号108は、▲▼/▲▼
ハンドシェーク制御回路02の起動信号、信号109は、設
定した転送回数分の転送が終了したことを示す転送終了
信号、信号110は、イニシエータでは情報受信を行って
いることを示す信号、信号111は、FIFO03が空であるこ
とを示すFIFOエンプティ信号、信号112は、情報のSCSI
バスからの入力、信号113はDMAコントローラ等からのFI
FO読みだし信号である。
ただし、第1図ではイニシエータでの情報受信時に必要
な信号のみを記してある。
な信号のみを記してある。
また第5図に第一の実施例における非同期転送のタイミ
ングチャート、第6図に同期転送のタイミングチャート
を示す。
ングチャート、第6図に同期転送のタイミングチャート
を示す。
次に第1図,第5図,第6図を参照して本実施例の動作
の詳細な説明を行う。
の詳細な説明を行う。
情報転送はターゲットが▲▼信号103をアクティ
ブにすることにより開始される。これを検知したCPU01
はまず信号110をアクティブにし、次に転送カウンタ04
に転送回数を設定してから▲▼/▲▼ハン
ドシェーク制御回路02に対する起動信号108をアクティ
ブにする。
ブにすることにより開始される。これを検知したCPU01
はまず信号110をアクティブにし、次に転送カウンタ04
に転送回数を設定してから▲▼/▲▼ハン
ドシェーク制御回路02に対する起動信号108をアクティ
ブにする。
▲▼/▲▼ハンドシェーク制御回路02は、
▲▼信号入力103がアクティブになるごとにFIFO0
3へ書き込み信号106を出力し、また起動信号108がアク
ティブになるとSCSIバス上の▲▼信号入力103に
対する元▲▼信号104のハンドシェーク動作を開
始する。通常の状態では、元▲▼信号104はその
まま▲▼信号出力102としてSCSIバスへ出力され
る。
▲▼信号入力103がアクティブになるごとにFIFO0
3へ書き込み信号106を出力し、また起動信号108がアク
ティブになるとSCSIバス上の▲▼信号入力103に
対する元▲▼信号104のハンドシェーク動作を開
始する。通常の状態では、元▲▼信号104はその
まま▲▼信号出力102としてSCSIバスへ出力され
る。
FIFO03は、書き込み信号106が入力されるごとにSCSIバ
スからの情報入力112を内部に取り込み、読みだし信号1
13が入力されるごとに早く取り込んだものから順に出力
する。書き込み信号106と読みだし信号113は通常まった
く非同期の信号である。
スからの情報入力112を内部に取り込み、読みだし信号1
13が入力されるごとに早く取り込んだものから順に出力
する。書き込み信号106と読みだし信号113は通常まった
く非同期の信号である。
転送カウンタ04は、元▲▼信号104により転送回
数をカウントしており、設定された転送回数より1少な
いカウントを終了すると転送終了準備信号107を、設定
された転送回数分のカウントを終了すると転送終了信号
109をアクティブにする。
数をカウントしており、設定された転送回数より1少な
いカウントを終了すると転送終了準備信号107を、設定
された転送回数分のカウントを終了すると転送終了信号
109をアクティブにする。
さて、情報転送が進んで設定された情報転送回数より1
少ない転送が終了すると、転送カウンタ04により転送準
備信号107がアクティブにされる。その後に▲▼
/▲▼ハンドシェーク制御回路02が最終バイトに
対する元▲▼信号104をアクティブにすると、AND
ゲート06の出力が1になるためD型フリップフロップ05
がセットされ、このためマスク信号105がアクティブに
なる。従って、この後▲▼信号入力103がインア
クティブになって元▲▼信号104が▲▼/
▲▼ハンドシェーク制御回路02によってインアク
ティブにされても、マスク信号105がアクティブなためS
CSIバスへの▲▼信号出力102はアクティブに保持
される。このためこの情報転送フェーズはまだ終了しな
い。
少ない転送が終了すると、転送カウンタ04により転送準
備信号107がアクティブにされる。その後に▲▼
/▲▼ハンドシェーク制御回路02が最終バイトに
対する元▲▼信号104をアクティブにすると、AND
ゲート06の出力が1になるためD型フリップフロップ05
がセットされ、このためマスク信号105がアクティブに
なる。従って、この後▲▼信号入力103がインア
クティブになって元▲▼信号104が▲▼/
▲▼ハンドシェーク制御回路02によってインアク
ティブにされても、マスク信号105がアクティブなためS
CSIバスへの▲▼信号出力102はアクティブに保持
される。このためこの情報転送フェーズはまだ終了しな
い。
一方、転送カウンタ04は元▲▼信号104をカウン
トしているため、まだ▲▼信号出力102がアクテ
ィブに保持されている間に、設定された情報転送回数の
カウントアップを終了し、転送終了信号10をアクティブ
にする。
トしているため、まだ▲▼信号出力102がアクテ
ィブに保持されている間に、設定された情報転送回数の
カウントアップを終了し、転送終了信号10をアクティブ
にする。
CPU01は転送終了信号109がアクティブになると、FIFOエ
ンプティ信号111をチェックし、もしFIFOが空であれば
直ちに、空でなければ空になるまで待ってから信号110
をインアクティブにする。
ンプティ信号111をチェックし、もしFIFOが空であれば
直ちに、空でなければ空になるまで待ってから信号110
をインアクティブにする。
信号110がインアクティブになると、D型フリップフロ
ップ05にリセットがかかるためマスク信号105がインア
クティブになり、▲▼信号出力102もインアクテ
ィブになってこの情報転送フェーズは終了する。
ップ05にリセットがかかるためマスク信号105がインア
クティブになり、▲▼信号出力102もインアクテ
ィブになってこの情報転送フェーズは終了する。
このようにして本実施例では、ターゲットからイニシエ
ータへの情報転送フェーズではイニシエータのFIFOが空
になるまでターゲットによるフェーズの遷移が行われな
いため、従来方式での問題点を解決することができる。
ータへの情報転送フェーズではイニシエータのFIFOが空
になるまでターゲットによるフェーズの遷移が行われな
いため、従来方式での問題点を解決することができる。
第2図は本発明の第二の実施例である。21はCPU、22
は、情報転送時にSCSIバスの▲▼信号と▲
▼信号のハンドシェークを制御する▲▼/▲
▼ハンドシェーク制御回路、23は、SCSIバスとデータ
の送受を行うFIFO、24は、情報転送数をカウントする転
送カウンタ、25はD型フリップフロップ、26,27は、AND
ゲート、28,29,30はインバータゲート、 信号201はSCSIバス、信号202は情報転送応答信号である
▲▼信号のSCSIバスへの出力、信号203は情報転
送要求信号である▲▼信号のSCSIバスからの入
力、信号204は▲▼/▲▼ハンドシェーク
制御回路22が出力する元▲▼信号、信号205は元
▲▼信号204をマスクする信号、信号206は、FIFO
23へのデータ書き込み信号、信号207は、設定された回
数より1回少ない回数の情報転送が終了したことを示す
転送終了準備信号、信号208は、▲▼/▲
▼ハンドシェーク制御回路22の起動信号、信号209は、
設定した転送回数分の転送が終了したことを示す転送終
了信号、信号210は、イニシエータでの情報受信を行っ
ていることを示す信号、信号211は、FIFO23が空である
ことを示すFIFOエンプティ信号、信号212は、情報のSCS
Iバスからの入力、信号213はDMAコントローラ等かのFIF
O読みだし信号である。
は、情報転送時にSCSIバスの▲▼信号と▲
▼信号のハンドシェークを制御する▲▼/▲
▼ハンドシェーク制御回路、23は、SCSIバスとデータ
の送受を行うFIFO、24は、情報転送数をカウントする転
送カウンタ、25はD型フリップフロップ、26,27は、AND
ゲート、28,29,30はインバータゲート、 信号201はSCSIバス、信号202は情報転送応答信号である
▲▼信号のSCSIバスへの出力、信号203は情報転
送要求信号である▲▼信号のSCSIバスからの入
力、信号204は▲▼/▲▼ハンドシェーク
制御回路22が出力する元▲▼信号、信号205は元
▲▼信号204をマスクする信号、信号206は、FIFO
23へのデータ書き込み信号、信号207は、設定された回
数より1回少ない回数の情報転送が終了したことを示す
転送終了準備信号、信号208は、▲▼/▲
▼ハンドシェーク制御回路22の起動信号、信号209は、
設定した転送回数分の転送が終了したことを示す転送終
了信号、信号210は、イニシエータでの情報受信を行っ
ていることを示す信号、信号211は、FIFO23が空である
ことを示すFIFOエンプティ信号、信号212は、情報のSCS
Iバスからの入力、信号213はDMAコントローラ等かのFIF
O読みだし信号である。
ただし、第2図でも第1図と同様にイニシエータでの情
報受信時に必要な信号のみを記してある。
報受信時に必要な信号のみを記してある。
第一の実施例との相違点はフリップフロップとしてD型
ではなくRS型を用いた点である。
ではなくRS型を用いた点である。
RS型フリップフロップのセット入力がアクティブになる
時には、イニシエータでは情報受信を行っていることを
示す信号210がアクティブであるからリセット入力は必
ずインアクティブである。
時には、イニシエータでは情報受信を行っていることを
示す信号210がアクティブであるからリセット入力は必
ずインアクティブである。
また、RS型フリップフロップのリセット入力がアクティ
ブになる時は、信号210がインアクティブになる時であ
るためセット力は必ずインアクティブになる。
ブになる時は、信号210がインアクティブになる時であ
るためセット力は必ずインアクティブになる。
従って、この部分のフリップフロップとしてはRS型を使
用することができ、本実施例を用いても第一の実施例と
同じように、従来の方式での問題点を解決することがで
きる。
用することができ、本実施例を用いても第一の実施例と
同じように、従来の方式での問題点を解決することがで
きる。
以上述べたように本実施例では、イニシエータが情報を
受信しているときには最終情報の転送に対する▲
▼信号をFIFOが空になるまで保持して、相手ターゲット
のフェーズ遷移を遅らせることにより、従来の方式での
問題点を解決することができる。
受信しているときには最終情報の転送に対する▲
▼信号をFIFOが空になるまで保持して、相手ターゲット
のフェーズ遷移を遅らせることにより、従来の方式での
問題点を解決することができる。
第1図は本発明の第1の実施例図、第2図は第2の実施
例図、第3図はSCSIの非同期転送のタイミングチャー
ト、第4図はSCSIの同期転送のタイミングチャート、第
5図および第6図は夫々第1図の動作を示すタイミング
チャートである。 01,21……CPU、02,22……▲▼/▲▼ハン
ドシェーク制御回路、03,23……FIFO、04,24……転送カ
ウンタ、05……D型フリップフロップ、25……RS型フリ
ップフロップ、06,07,26,27……ANDゲート、08,09,10,2
8,29,30……インバータゲート、101,201……SCSIバス、
102,202……▲▼信号出力、103,203……▲
▼信号入力、104,204……元▲▼、105,205……マ
スク信号、106,206……FIFOへのデータ書き込み信号、1
07,207……転送終了準備信号、108,208……▲▼
/▲▼ハンドシェーク回路起動信号、109,209…
…転送終了信号、110,210……イニシエータ受信信号、1
11,211……FIFOエンプティ信号、112,212……SCSIバス
からの情報入力を示す。
例図、第3図はSCSIの非同期転送のタイミングチャー
ト、第4図はSCSIの同期転送のタイミングチャート、第
5図および第6図は夫々第1図の動作を示すタイミング
チャートである。 01,21……CPU、02,22……▲▼/▲▼ハン
ドシェーク制御回路、03,23……FIFO、04,24……転送カ
ウンタ、05……D型フリップフロップ、25……RS型フリ
ップフロップ、06,07,26,27……ANDゲート、08,09,10,2
8,29,30……インバータゲート、101,201……SCSIバス、
102,202……▲▼信号出力、103,203……▲
▼信号入力、104,204……元▲▼、105,205……マ
スク信号、106,206……FIFOへのデータ書き込み信号、1
07,207……転送終了準備信号、108,208……▲▼
/▲▼ハンドシェーク回路起動信号、109,209…
…転送終了信号、110,210……イニシエータ受信信号、1
11,211……FIFOエンプティ信号、112,212……SCSIバス
からの情報入力を示す。
Claims (1)
- 【請求項1】データ転送時に情報転送要求信号と情報転
送応答信号のハンドシェークを制御する第一の手段と、
データバスに対し情報の送受信を行うファースト・イン
・ファースト・アウト型メモリと、情報転送回数をカウ
ントすることにより設定された情報転送回数より1回少
ない回数の情報転送が終了したことおよび設定された回
数分の情報転送が終了したことを検出するカウンタと、
前記カウンタが、設定された情報転送回数より1回少な
い回数の情報転送が終了したことを検出し、かつ前記第
一の手段が最終バイトに対する情報転送応答信号をアク
ティブにするとセットされるフリップフロップと、前記
フリップフロップのセット出力に応答して、実際に出力
する情報転送応答信号をアクティブ側にマスクする第二
の手段と、前記カウンタが設定された回数分の情報転送
が終了したことを検出した後、前記ファースト・イン・
ファースト・アウト型メモリが空になると、前記フリッ
プフロップをリセットする第三の手段とを有し、前記第
二の手段は前記フリップフロップのリセット出力に応答
して前記実際に出力する情報転送応答信号をインアクテ
ィブにすることを特徴とするバス制御方式。
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP14970388 | 1988-06-17 | ||
JP63-149703 | 1988-06-17 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPH0277863A JPH0277863A (ja) | 1990-03-16 |
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