JPH0716196U - Pulse counter device - Google Patents
Pulse counter deviceInfo
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- JPH0716196U JPH0716196U JP5116993U JP5116993U JPH0716196U JP H0716196 U JPH0716196 U JP H0716196U JP 5116993 U JP5116993 U JP 5116993U JP 5116993 U JP5116993 U JP 5116993U JP H0716196 U JPH0716196 U JP H0716196U
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- power failure
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Abstract
(57)【要約】
【目的】 停電中のバックアップ電源を備えたパルスカ
ウンタ装置でもバックアップ電源が劣化していたような
場合、停電中のカウント値が異常値となり、停電以降の
出力データが異常値となる。これを防止する。
【構成】 復電時にバックアップ電源電圧を検出する手
段と、検出した電圧が所定電圧以下であれば停電中のカ
ウント値をリセットする手段とを備えた。
(57) [Summary] [Purpose] Even if the backup power supply is deteriorated even with a pulse counter device equipped with a backup power supply during a power failure, the count value during a power failure becomes an abnormal value, and the output data after the power failure is an abnormal value. Becomes Prevent this. [Structure] A means for detecting a backup power supply voltage at the time of power recovery and a means for resetting a count value during a power failure if the detected voltage is a predetermined voltage or less are provided.
Description
【０００１】[0001]
本考案はパルスカウンタ装置、さらに詳しくは外部からパルスを入力してカウ ントするパルスカウンタ装置における異常データ出力の防止に関する。 The present invention relates to a pulse counter device, and more particularly, to prevention of abnormal data output in a pulse counter device that receives an external pulse and counts it.
【０００２】[0002]
パルスカウンタ装置のうちには、停電などによる不意の電源遮断時においても 動作を停止させないようにするためバックアップ電源、すなわち停電補償用蓄電 池を内蔵した装置があり、このような装置では停電中もパルスカウントを継続し 、復電時もそのままカウント値を積算するような構成になっている。 Among pulse counter devices, there is a device with a built-in backup power supply, that is, a battery for power failure compensation, to prevent the operation from stopping even if the power is cut off unexpectedly due to a power failure. It is configured to continue pulse counting and integrate the count value when power is restored.
【０００３】[0003]
従来の停電補償用蓄電池を内蔵するパルスカウンタ装置では、停電などによる 電源遮断時においてもその動作が停止しないように構成されているが、例えば内 蔵した蓄電池が経年劣化などにより所定電圧を保持していなかったり、電池切れ を起こしているような場合には、カウンタ自体が正常にカウントできず、停電時 以降の出力データが不正確になりこのデータを利用している周辺装置に悪影響を 及ぼすという問題点があった。 The conventional pulse counter device with a built-in storage battery for power failure compensation is configured so that its operation does not stop even when the power is cut off due to a power failure or the like.For example, the built-in storage battery holds a predetermined voltage due to deterioration over time. If it is not, or if the battery has run out, the counter itself cannot count properly, and the output data after a power failure will be inaccurate, which will adversely affect peripheral devices that use this data. There was a problem.
【０００４】 本考案はかかる問題点を解決するためになされたものであり、停電補償用蓄電 池の劣化などによる電圧値異常でカウンタが誤動作するのを防止したパルスカウ ンタ装置を提供することを目的としている。The present invention has been made to solve the above problems, and an object of the present invention is to provide a pulse counter device in which the counter is prevented from malfunctioning due to an abnormal voltage value due to deterioration of a battery for power failure compensation. I am trying.
【０００５】[0005]
本考案に係わるパルスカウンタ装置は、復電時に復電を検出する手段と、復電 時に充電電源を遮断しながらバックアップ用蓄電池の電圧を検出する手段と、バ ックアップ用蓄電池の電圧が所定電圧以上であれば停電中のカウント値は正常値 であると判断してそのままカウントを継続し、バックアップ用蓄電池の電圧が所 定電圧以下であれば停電中のカウント値は異常値であると判断してカウンタ回路 をリセットする手段とを備えたものである。 The pulse counter device according to the present invention includes means for detecting power recovery when power is restored, means for detecting the voltage of the backup storage battery while shutting off the charging power source when power is restored, and the voltage of the backup storage battery being above a predetermined voltage. If so, it is determined that the count value during a power failure is a normal value and counting continues, and if the voltage of the backup storage battery is less than or equal to the specified voltage, it is determined that the count value during a power failure is an abnormal value. And a means for resetting the counter circuit.
【０００６】[0006]
本考案のパルスカウンタ装置は上述の構成とすることにより、バックアップ用 蓄電池が劣化したり電池切れを起こしているような場合でも、異常データが出力 されることを防止できる。 By configuring the pulse counter device of the present invention as described above, abnormal data can be prevented from being output even when the backup storage battery is deteriorated or the battery is dead.
【０００７】[0007]
以下、本考案の実施例を図面を用いて説明する。図１は、本考案の一実施例を 示すブロック図であり、図において、１はＣＰＵ、２は電圧検出回路、３はカウ ンタ回路、４はＲＡＭ、５は停電補償用蓄電池、６は充電電源ＯＮ／ＯＦＦ回路 である。 Embodiments of the present invention will be described below with reference to the drawings. FIG. 1 is a block diagram showing an embodiment of the present invention, in which 1 is a CPU, 2 is a voltage detection circuit, 3 is a counter circuit, 4 is RAM, 5 is a storage battery for power failure compensation, and 6 is charging. Power ON / OFF circuit.
【０００８】 次に動作について説明する。通常はＣＰＵ１，カウンタ回路３，ＲＡＭ４，停 電補償用蓄電池５へは商用電源から電源が供給され（図示せず）、また、カウン タ回路３へは外部からパルスが入力されていて、入力したパルスをカウンタ回路 ３でカウントしており、カウント値が逐次ＲＡＭ４に書き換えられている。 ここで停電等により商用電源からの通電が遮断された場合、ＣＰＵ１は動作を 停止するが、カウンタ回路３，ＲＡＭ４へは停電補償用蓄電池５からバックアッ プ電源が供給され、カウンタ回路３は停電中も継続してパルスをカウントするが 、ＲＡＭ４には停電前のカウント値がそのまま保持される。Next, the operation will be described. Normally, the CPU 1, the counter circuit 3, the RAM 4, and the storage battery 5 for power stop compensation are supplied with power from a commercial power supply (not shown), and the counter circuit 3 is supplied with pulses from the outside. The pulse is counted by the counter circuit 3, and the count value is sequentially rewritten in the RAM 4. Here, when the power supply from the commercial power source is cut off due to a power failure or the like, the CPU 1 stops operating, but the counter circuit 3 and the RAM 4 are supplied with backup power from the power failure compensation storage battery 5, and the counter circuit 3 is under power failure. The pulse value is continuously counted, but the count value before the power failure is retained in the RAM 4 as it is.
【０００９】 そして復電時には、従来の装置の場合、停電中のカウンタ回路３のカウント値 が、自動的にＲＡＭ４に書き込まれ、書き込まれた値が現時点までのカウント値 としてそのままカウント動作が継続される。従って停電補償用蓄電池５が劣化し ていたり、電池切れを起こしているような場合には、停電中のカウンタ回路３が 誤動作して誤った値をカウントし、この異常値が現時点までのカウント値として ＲＡＭ４に書き込まれるため、以降の出力データは誤った値となり、このデータ を利用する周辺装置に悪影響を及ぼすことになる。 従って本考案では停電補償用蓄電池５からのバックアップ電源が所定電圧以上 を維持しているか否かを検出する手段を設けて、電圧低下によりカウンタ回路３ のカウント値が異常値になる可能性がある場合にはカウンタ回路３をリセットす ることとした。At the time of power recovery, in the case of the conventional device, the count value of the counter circuit 3 during the power failure is automatically written in the RAM 4, and the written value is continued as the count value up to the present time. It Therefore, when the power failure compensation storage battery 5 has deteriorated or the battery has run out, the counter circuit 3 during a power failure malfunctions and counts an incorrect value, and this abnormal value is the count value up to the present time. Since this is written in the RAM 4, the subsequent output data will have an incorrect value, which will adversely affect the peripheral device that uses this data. Therefore, in the present invention, there is a possibility that the count value of the counter circuit 3 becomes an abnormal value due to the voltage drop by providing means for detecting whether or not the backup power supply from the power failure compensation storage battery 5 maintains a predetermined voltage or higher. In that case, the counter circuit 3 is reset.
【００１０】 すなわち本実施例の装置では、復電時にＣＰＵ１から充電制御信号を出力して 充電ＯＮ／ＯＦＦ回路６を動作させて停電補償用蓄電池５への充電電源を遮断し 、電圧検出回路２で停電補償用蓄電池５の電圧を調べ、この電圧が所定値以上で あれば停電中のカウンタ回路３のカウント値は正常にカウントされたものと判断 して、停電中のカウント値をＲＡＭ４に現時点のカウント値として書き込み、カ ウント動作を継続するが、停電補償用蓄電池５の電圧が所定値以下の場合には停 電中のカウント値は異常値である可能性が高いと判断し、ＣＰＵ１よりリセット 信号を送出してカウンタ回路３をリセットする。 以上のようにして本考案ではバックアップ電源の電圧低下による停電中の異常 値をそのままカウント値として動作が継続されることを防止し、異常データ値が 出力されることによる周辺機器の誤動作を防止することとした。That is, in the device of the present embodiment, at the time of power recovery, the CPU 1 outputs a charge control signal to operate the charge ON / OFF circuit 6 to shut off the charge power source to the power failure compensation storage battery 5, and to detect the voltage detection circuit 2. Check the voltage of the storage battery 5 for power failure compensation with, and if this voltage is above a predetermined value, it is judged that the count value of the counter circuit 3 during power failure has been counted normally, and the count value during power failure is stored in the RAM 4 However, if the voltage of the power storage battery 5 for power outage compensation is less than or equal to a predetermined value, it is determined that the stopped count value is likely to be an abnormal value, and A reset signal is sent to reset the counter circuit 3. As described above, in the present invention, the abnormal value during a power failure due to the voltage drop of the backup power supply is used as the count value to prevent the continuation of the operation, and the malfunction of the peripheral device due to the output of the abnormal data value is prevented. I decided.
【００１１】[0011]
本考案のパルスカウンタ装置は以上説明したように、停電中の誤動作による異 常値がデータとして出力されるのを防止し、周辺装置へ悪影響を防止できるとい う効果がある。 As described above, the pulse counter device of the present invention has the effect of preventing abnormal values from being output as data due to a malfunction during a power failure, and preventing adverse effects on peripheral devices.
【図１】本考案の一実施例を示すブロック図である。FIG. 1 is a block diagram showing an embodiment of the present invention.
１ ＣＰＵ ２ 電圧検出回路 ３ カウンタ回路 ４ ＲＡＭ ５ 停電補償用蓄電池 ６ 充電ＯＮ／ＯＦＦ回路 1 CPU 2 Voltage detection circuit 3 Counter circuit 4 RAM 5 Storage battery for power failure compensation 6 Charging ON / OFF circuit
───────────────────────────────────────────────────── フロントページの続き (72)考案者 島田 啓史 東京都三鷹市下連雀５丁目１番１号 日本 無線株式会社内 ─────────────────────────────────────────────────── ─── Continuation of the front page (72) Creator Hiroshi Shimada 5-1-1 Shimorenjaku, Mitaka City, Tokyo Japan Radio Co., Ltd.
Claims (1)
ＡＭ）とバックアップ用蓄電池とを有し、停電等により
電源が遮断された場合でもバックアップ用蓄電池からの
バックアップ電源でカウンタ回路がパルスカウントを継
続し、復電時に停電中継続してカウントした値でカウン
ト値記憶回路の記憶内容を書き換えるパルスカウンタ装
置において、 復電時に復電を検出する手段と、 復電時に充電電源を遮断しながら上記バックアップ用蓄
電池の電圧を検出する手段と、 上記手段により検出した電圧が所定電圧以上であれば停
電中のカウント値は正常値であると判断して上記カウン
ト値記憶回路の内容を書き換えてそのままカウントを継
続し、検出した電圧が所定電圧以下であれば停電中のカ
ウント値は異常値である可能性が高いと判断してカウン
タ回路をリセットする手段とを備えたことを特徴とする
パルスカウンタ装置。1. A counter circuit and a count value storage circuit (R
AM) and a backup storage battery, the counter circuit continues pulse counting with the backup power supply from the backup storage battery even when the power is cut off due to a power failure, etc. In a pulse counter device that rewrites the stored contents of the count value storage circuit, means for detecting power recovery at power recovery, means for detecting the voltage of the backup storage battery while shutting off the charging power supply at power recovery, and detection by the means If the measured voltage is equal to or higher than the predetermined voltage, the count value during a power failure is determined to be a normal value, the contents of the count value storage circuit are rewritten, and counting continues as is. It is characterized by including a means for resetting the counter circuit when it judges that the inside count value is highly likely to be an abnormal value. Pulse counter device that.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5116993U JPH0716196U (en) | 1993-08-27 | 1993-08-27 | Pulse counter device |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5116993U JPH0716196U (en) | 1993-08-27 | 1993-08-27 | Pulse counter device |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0716196U true JPH0716196U (en) | 1995-03-17 |
Family
ID=12879329
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP5116993U Pending JPH0716196U (en) | 1993-08-27 | 1993-08-27 | Pulse counter device |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0716196U (en) |
Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5569086A (en) * | 1978-11-17 | 1980-05-24 | Matsushita Electric Ind Co Ltd | Timer circuit |
| JPS6459096A (en) * | 1987-08-28 | 1989-03-06 | Matsushita Electric Ind Co Ltd | Timepiece device |
-
1993
- 1993-08-27 JP JP5116993U patent/JPH0716196U/en active Pending
Patent Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5569086A (en) * | 1978-11-17 | 1980-05-24 | Matsushita Electric Ind Co Ltd | Timer circuit |
| JPS6459096A (en) * | 1987-08-28 | 1989-03-06 | Matsushita Electric Ind Co Ltd | Timepiece device |
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