JPH0715268A - 群遅延等化回路 - Google Patents
群遅延等化回路Info
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- JPH0715268A JPH0715268A JP19665193A JP19665193A JPH0715268A JP H0715268 A JPH0715268 A JP H0715268A JP 19665193 A JP19665193 A JP 19665193A JP 19665193 A JP19665193 A JP 19665193A JP H0715268 A JPH0715268 A JP H0715268A
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Abstract
(57)【要約】
【目的】 本発明はハイブリッドと共振回路を有する群
遅延等化回路に関し、群遅延等化機能のオン、オフの切
り換えを行うスイッチ回路の切り換えに拘らず、通過損
失と振幅周波数特性が変化しないようにする群遅延等化
回路を実現することを目的とする。 【構成】 スイッチ回路４が端子ａに接続されたとき
は、共振回路３がスイッチ回路４を介してハイブリッド
２に接続されるため、入力信号はハイブリッド２を介し
て共振回路３により反射された後再びハイブリッド２で
合成されて、群遅延特性が付与される。一方、スイッチ
回路４が端子ｂに接続されたときは、地気がスイッチ回
路４を介してハイブリッド２に接続されるため、入力信
号はハイブリッド２を介して群遅延特性を付与されるこ
となく出力される。従って、いずれの場合も入力信号は
ハイブリッド２を通過するようにできる。
遅延等化回路に関し、群遅延等化機能のオン、オフの切
り換えを行うスイッチ回路の切り換えに拘らず、通過損
失と振幅周波数特性が変化しないようにする群遅延等化
回路を実現することを目的とする。 【構成】 スイッチ回路４が端子ａに接続されたとき
は、共振回路３がスイッチ回路４を介してハイブリッド
２に接続されるため、入力信号はハイブリッド２を介し
て共振回路３により反射された後再びハイブリッド２で
合成されて、群遅延特性が付与される。一方、スイッチ
回路４が端子ｂに接続されたときは、地気がスイッチ回
路４を介してハイブリッド２に接続されるため、入力信
号はハイブリッド２を介して群遅延特性を付与されるこ
となく出力される。従って、いずれの場合も入力信号は
ハイブリッド２を通過するようにできる。
Description
【０００１】
【産業上の利用分野】本発明は群遅延等化回路に係り、
特にハイブリッドと共振回路とを有する群遅延等化回路
に関する。
特にハイブリッドと共振回路とを有する群遅延等化回路
に関する。
【０００２】
【従来の技術】信号伝送系においては、所定の振幅周波
数特性を有する回路をユーザの選択または必要に応じ
て、上記の回路の入力側と出力側にそれぞれ設けたスイ
ッチを切り換えることにより、上記の回路を信号伝送系
に接続して使用するか、開放して不使用とすることがし
ばしば行われる（例えば、関根訳，ＶＨＦ／ＵＨＦ Ｍ
ＡＮＵＡＬ日本語版，７１頁図６，昭和６０年４月３０
日発行，ＣＱ出版株式会社）。従って、群遅延等化回路
にこの技術を応用すると、図４に示す如き構成となる。
数特性を有する回路をユーザの選択または必要に応じ
て、上記の回路の入力側と出力側にそれぞれ設けたスイ
ッチを切り換えることにより、上記の回路を信号伝送系
に接続して使用するか、開放して不使用とすることがし
ばしば行われる（例えば、関根訳，ＶＨＦ／ＵＨＦ Ｍ
ＡＮＵＡＬ日本語版，７１頁図６，昭和６０年４月３０
日発行，ＣＱ出版株式会社）。従って、群遅延等化回路
にこの技術を応用すると、図４に示す如き構成となる。
【０００３】同図中、群遅延等化回路１はハイブリッド
２と共振回路３とよりなり、入力信号をスイッチ回路５
でハイブリッド２またはスイッチ回路６に選択入力し、
スイッチ回路６がハイブリッド２とスイッチ回路５の出
力信号の一方を選択出力する構成である。共振回路３の
共振周波数とＱは、入力信号の周波数などから決定され
る。また、共振周波数は、必要とする群遅延時間により
決定される。
２と共振回路３とよりなり、入力信号をスイッチ回路５
でハイブリッド２またはスイッチ回路６に選択入力し、
スイッチ回路６がハイブリッド２とスイッチ回路５の出
力信号の一方を選択出力する構成である。共振回路３の
共振周波数とＱは、入力信号の周波数などから決定され
る。また、共振周波数は、必要とする群遅延時間により
決定される。
【０００４】次に、この従来回路の動作について説明す
る。スイッチ回路５に入力された入力信号（例えば、受
信機の中間周波信号（ＩＦ信号））は、スイッチ回路５
が端子ａ側に接続されている場合はハイブリッド２に入
力される。ハイブリッド２は共振回路３に接続されてお
り、上記の入力ＩＦ信号はこの共振回路３での反射によ
り遅延されてハイブリッド２で再び合成される。
る。スイッチ回路５に入力された入力信号（例えば、受
信機の中間周波信号（ＩＦ信号））は、スイッチ回路５
が端子ａ側に接続されている場合はハイブリッド２に入
力される。ハイブリッド２は共振回路３に接続されてお
り、上記の入力ＩＦ信号はこの共振回路３での反射によ
り遅延されてハイブリッド２で再び合成される。
【０００５】すなわち、入力ＩＦ信号はこの群遅延等化
回路１により周波数に応じて所定の群遅延特性が付与さ
れ、ハイブリッド２より取り出されてスイッチ回路６に
入力される。このスイッチ回路６は、スイッチ回路５が
端子ａに接続されるときは端子ａ側に連動して接続さ
れ、またスイッチ回路５が端子ｂに接続されるときは端
子ｂ側に連動して切り換え接続される。
回路１により周波数に応じて所定の群遅延特性が付与さ
れ、ハイブリッド２より取り出されてスイッチ回路６に
入力される。このスイッチ回路６は、スイッチ回路５が
端子ａに接続されるときは端子ａ側に連動して接続さ
れ、またスイッチ回路５が端子ｂに接続されるときは端
子ｂ側に連動して切り換え接続される。
【０００６】ここではスイッチ回路５は端子ａに接続さ
れているため、スイッチ回路６も端子ａ側に接続されて
おり、これにより、ハイブリッド２から取り出されたＩ
Ｆ信号は、スイッチ回路６を通して出力される。このよ
うに、スイッチ回路５と６が端子ａ側に接続されている
ときには、入力ＩＦ信号はこの群遅延等化回路１におい
て所定の群遅延等化特性を付与されて出力される。
れているため、スイッチ回路６も端子ａ側に接続されて
おり、これにより、ハイブリッド２から取り出されたＩ
Ｆ信号は、スイッチ回路６を通して出力される。このよ
うに、スイッチ回路５と６が端子ａ側に接続されている
ときには、入力ＩＦ信号はこの群遅延等化回路１におい
て所定の群遅延等化特性を付与されて出力される。
【０００７】一方、群遅延等化回路１による群遅延等化
特性の付与を行わない場合は、スイッチ回路５と６は端
子ｂ側に接続される。これにより、スイッチ回路５の入
力ＩＦ信号は、群遅延等化回路１をバイパスしてスイッ
チ回路６を通してそのまま出力される。
特性の付与を行わない場合は、スイッチ回路５と６は端
子ｂ側に接続される。これにより、スイッチ回路５の入
力ＩＦ信号は、群遅延等化回路１をバイパスしてスイッ
チ回路６を通してそのまま出力される。
【０００８】
【発明が解決しようとする課題】しかるに、上記の従来
の群遅延等化回路では、群遅延等化機能のオン、オフは
ルートを切り換え、群遅延等化回路１を信号伝送系に接
続するか、バイパスするかによって行っているため、切
り換えにより通過損失が変化し、出力信号のレベルが変
化するという問題がある。また、群遅延等化回路１はあ
る振幅周波数特性を有しているため、上記の従来回路で
は、群遅延等化機能のオン、オフにより振幅周波数特性
が変化するという問題もある。
の群遅延等化回路では、群遅延等化機能のオン、オフは
ルートを切り換え、群遅延等化回路１を信号伝送系に接
続するか、バイパスするかによって行っているため、切
り換えにより通過損失が変化し、出力信号のレベルが変
化するという問題がある。また、群遅延等化回路１はあ
る振幅周波数特性を有しているため、上記の従来回路で
は、群遅延等化機能のオン、オフにより振幅周波数特性
が変化するという問題もある。
【０００９】本発明は上記の点に鑑みなされたもので、
群遅延等化機能のオン、オフを群遅延等化回路内で行う
ことにより、上記の課題を解決した群遅延等化回路を提
供することを目的とする。
群遅延等化機能のオン、オフを群遅延等化回路内で行う
ことにより、上記の課題を解決した群遅延等化回路を提
供することを目的とする。
【００１０】
【課題を解決するための手段】上記の目的を達成するた
め、本発明は、第１の入力端子に入力信号が入力される
ハイブリッドと、所定の共振周波数で共振する共振回路
と、上記ハイブリッドの第２の入力端子に、前記共振回
路の一端と地気のいずれか一方を選択的に接続するスイ
ッチ回路とを有する構成としたものである。
め、本発明は、第１の入力端子に入力信号が入力される
ハイブリッドと、所定の共振周波数で共振する共振回路
と、上記ハイブリッドの第２の入力端子に、前記共振回
路の一端と地気のいずれか一方を選択的に接続するスイ
ッチ回路とを有する構成としたものである。
【００１１】
【作用】本発明では、前記スイッチ回路を介して前記共
振回路の一端が前記ハイブリッドの第２の入力端子に接
続されたときには、ハイブリッドに入力された前記入力
信号は、共振回路で反射されてハイブリッドで再び合成
されることにより、群遅延等化特性が付与されてこのハ
イブリッドの出力端子より出力される。
振回路の一端が前記ハイブリッドの第２の入力端子に接
続されたときには、ハイブリッドに入力された前記入力
信号は、共振回路で反射されてハイブリッドで再び合成
されることにより、群遅延等化特性が付与されてこのハ
イブリッドの出力端子より出力される。
【００１２】他方、前記スイッチ回路を介して地気が前
記ハイブリッドの第２の入力端子に接続されたときに
は、ハイブリッドの第１の入力端子に入力された前記入
力信号は反射されることなく、そのままハイブリッドを
通過して群遅延等化特性が付与されることなく出力され
る。従って、スイッチ回路の切り換えにより、群遅延等
化機能のオン、オフの切り換えができ、またスイッチ回
路の切り換えに拘らず、いずれの場合も入力信号はハイ
ブリッドを通過するようにできる。
記ハイブリッドの第２の入力端子に接続されたときに
は、ハイブリッドの第１の入力端子に入力された前記入
力信号は反射されることなく、そのままハイブリッドを
通過して群遅延等化特性が付与されることなく出力され
る。従って、スイッチ回路の切り換えにより、群遅延等
化機能のオン、オフの切り換えができ、またスイッチ回
路の切り換えに拘らず、いずれの場合も入力信号はハイ
ブリッドを通過するようにできる。
【００１３】
【実施例】図１は本発明の一実施例の構成図を示す。同
図中、図４と同一構成部分には同一符号を付してある。
図１において、群遅延等化回路１０はハイブリッド２
と、共振回路３とスイッチ回路４とより構成されてい
る。ハイブリッド２は第１の入力端子に入力信号が入力
され、第２の入力端子がスイッチ回路４の共通端子に接
続されている。
図中、図４と同一構成部分には同一符号を付してある。
図１において、群遅延等化回路１０はハイブリッド２
と、共振回路３とスイッチ回路４とより構成されてい
る。ハイブリッド２は第１の入力端子に入力信号が入力
され、第２の入力端子がスイッチ回路４の共通端子に接
続されている。
【００１４】スイッチ回路４は端子ａ及びｂのいずれか
一方と共通端子との間を接続する構成で、端子ａは共振
回路３の非接地側の一端に接続され、また端子ｂは地気
に接続されている。また共振回路３は、一端が前記スイ
ッチ回路４に接続され、他端が接地されたＬＣ並列共振
回路である。
一方と共通端子との間を接続する構成で、端子ａは共振
回路３の非接地側の一端に接続され、また端子ｂは地気
に接続されている。また共振回路３は、一端が前記スイ
ッチ回路４に接続され、他端が接地されたＬＣ並列共振
回路である。
【００１５】次に本実施例の動作について説明する。入
力信号に対して群遅延等化特性を付与するときは、スイ
ッチ回路４は端子ａ側に接続される。このときハイブリ
ッド２の第１の入力端子に入力された入力信号、例えば
前記ＩＦ信号は、ハイブリッド２の第２の入力端子にス
イッチ回路４を介して接続された共振回路３の共振周波
数で共振し、またＱが設定された後再びハイブリッド２
で合成される。このとき、群遅延等化特性が入力信号に
付与される。この様にして群遅延等化特性が付与された
入力ＩＦ信号は、ハイブリッド２の出力端子より外部へ
出力される。
力信号に対して群遅延等化特性を付与するときは、スイ
ッチ回路４は端子ａ側に接続される。このときハイブリ
ッド２の第１の入力端子に入力された入力信号、例えば
前記ＩＦ信号は、ハイブリッド２の第２の入力端子にス
イッチ回路４を介して接続された共振回路３の共振周波
数で共振し、またＱが設定された後再びハイブリッド２
で合成される。このとき、群遅延等化特性が入力信号に
付与される。この様にして群遅延等化特性が付与された
入力ＩＦ信号は、ハイブリッド２の出力端子より外部へ
出力される。
【００１６】図２はこのときの群遅延等化回路１０の特
性図を示す。同図中、ＤONは群遅延特性を示し、共振回
路３の共振周波数ｆ0付近で大なる遅延時間を示す。ま
た、ＦONは振幅周波数特性を示し、略平坦な特性であ
る。
性図を示す。同図中、ＤONは群遅延特性を示し、共振回
路３の共振周波数ｆ0付近で大なる遅延時間を示す。ま
た、ＦONは振幅周波数特性を示し、略平坦な特性であ
る。
【００１７】一方、群遅延等化特性を入力信号に付与し
ないとき、例えばこの群遅延等化回路１０が多段に縦続
接続されている場合に、各段毎に特性の調整をするよう
な場合は、調整する１段以外の他の群遅延等化回路は群
遅延等化特性を付与しない様にされる。また、それぞれ
群遅延等化特性が異なる様にされた群遅延等化回路１０
を複数個並列に設け、入力信号周波数などに応じてどれ
か一つの群遅延等化回路を切り換え使用するような場合
にも、使用しない群遅延等化回路は群遅延等化特性を付
与しない様にされる。
ないとき、例えばこの群遅延等化回路１０が多段に縦続
接続されている場合に、各段毎に特性の調整をするよう
な場合は、調整する１段以外の他の群遅延等化回路は群
遅延等化特性を付与しない様にされる。また、それぞれ
群遅延等化特性が異なる様にされた群遅延等化回路１０
を複数個並列に設け、入力信号周波数などに応じてどれ
か一つの群遅延等化回路を切り換え使用するような場合
にも、使用しない群遅延等化回路は群遅延等化特性を付
与しない様にされる。
【００１８】このような群遅延等化特性を付与しない場
合、本実施例ではスイッチ回路４が端子ｂ側に切り換え
接続される。これにより、ハイブリッド２に入力された
ＩＦ信号は、ハイブリッド２の第２の入力端子がスイッ
チ回路４を介して地気に接続されているため、共振され
ることなくそのまま出力端子へ出力される。従って、こ
の場合は入力ＩＦ信号は群遅延等化特性が付与されな
い。
合、本実施例ではスイッチ回路４が端子ｂ側に切り換え
接続される。これにより、ハイブリッド２に入力された
ＩＦ信号は、ハイブリッド２の第２の入力端子がスイッ
チ回路４を介して地気に接続されているため、共振され
ることなくそのまま出力端子へ出力される。従って、こ
の場合は入力ＩＦ信号は群遅延等化特性が付与されな
い。
【００１９】図３はこのときの群遅延等化回路１０の特
性図を示す。同図中、ＤOFFは群遅延特性を示し、共振
回路３に接続されていないので各周波数で略同一の遅延
時間を示す。また、ＦOFFは振幅周波数特性を示し、前
記振幅周波数特性Ｆ ONと同じ略平坦な特性である。
性図を示す。同図中、ＤOFFは群遅延特性を示し、共振
回路３に接続されていないので各周波数で略同一の遅延
時間を示す。また、ＦOFFは振幅周波数特性を示し、前
記振幅周波数特性Ｆ ONと同じ略平坦な特性である。
【００２０】すなわち、群遅延等化特性を付与しない場
合も入力ＩＦ信号はハイブリッド２を通過するから、前
記の群遅延等化機能のオン時と同様の通過損失を受ける
こととなり、またハイブリッド２による図２のＦONと同
じ振幅周波数特性ＦOFFを受け、振幅周波数特性は変化
しないようにすることができる。更に、群遅延等化特性
は前記図２のＤONと異なる所望の特性ＤOFFを得ること
ができる。従って、本実施例によれば、群遅延等化機能
をオンとオフの一方から他方に切り換えても、出力信号
レベルが変化しないようにすることができる。
合も入力ＩＦ信号はハイブリッド２を通過するから、前
記の群遅延等化機能のオン時と同様の通過損失を受ける
こととなり、またハイブリッド２による図２のＦONと同
じ振幅周波数特性ＦOFFを受け、振幅周波数特性は変化
しないようにすることができる。更に、群遅延等化特性
は前記図２のＤONと異なる所望の特性ＤOFFを得ること
ができる。従って、本実施例によれば、群遅延等化機能
をオンとオフの一方から他方に切り換えても、出力信号
レベルが変化しないようにすることができる。
【００２１】また、本実施例では、切り換え用のスイッ
チ回路４が群遅延等化回路１０内にあり、従来の群遅延
等化回路の入力と出力とを切り換える構成ではないた
め、スイッチ回路の個数を半分にすることができると共
に、バイパスルートを不要にすることができるため、回
路を従来よりも簡素化することができると共に、空間的
にも小型化ができる。
チ回路４が群遅延等化回路１０内にあり、従来の群遅延
等化回路の入力と出力とを切り換える構成ではないた
め、スイッチ回路の個数を半分にすることができると共
に、バイパスルートを不要にすることができるため、回
路を従来よりも簡素化することができると共に、空間的
にも小型化ができる。
【００２２】なお、本発明は上記の実施例に限定される
ものではなく、例えば共振回路３はＬＣ並列共振回路と
して説明したが、集中定数インピーダンスを用いた他の
構成の共振回路は勿論のこと、同軸共振回路などの共振
回路でも良い。
ものではなく、例えば共振回路３はＬＣ並列共振回路と
して説明したが、集中定数インピーダンスを用いた他の
構成の共振回路は勿論のこと、同軸共振回路などの共振
回路でも良い。
【００２３】
【発明の効果】以上説明したように、本発明によれば、
群遅延等化機能のオン、オフの切り換えを行うスイッチ
回路の切り換えに拘らず、いずれの場合も入力信号はハ
イブリッドを通過するようにできるため、通過損失と振
幅周波数特性が上記の切り換えにより変化しないように
でき、従って群遅延等化機能をオンとオフの一方から他
方に切り換えても、出力信号レベルが変化しないように
することができる。
群遅延等化機能のオン、オフの切り換えを行うスイッチ
回路の切り換えに拘らず、いずれの場合も入力信号はハ
イブリッドを通過するようにできるため、通過損失と振
幅周波数特性が上記の切り換えにより変化しないように
でき、従って群遅延等化機能をオンとオフの一方から他
方に切り換えても、出力信号レベルが変化しないように
することができる。
【図１】本発明の一実施例の構成図である。
【図２】図１の共振回路接続時の特性図である。
【図３】図１の共振回路非接続時の特性図である。
【図４】従来の一例の構成図である。
２ ハイブリッド ３ 共振回路 ４ スイッチ回路 １０ 群遅延等化回路
Claims (2)
- 【請求項１】 第１及び第２の入力端子と一つの出力端
子とを有し、該第１の入力端子に入力信号が入力される
ハイブリッドと、 所定の共振周波数で共振する共振回路と、 前記ハイブリッドの第２の入力端子に、前記共振回路の
一端と地気のいずれか一方を選択的に接続するスイッチ
回路とを有し、該スイッチ回路を介して前記共振回路の
一端が前記ハイブリッドの第２の入力端子に接続された
ときに、前記入力信号に群遅延等化特性を付与して前記
ハイブリッドの出力端子より出力することを特徴とする
群遅延等化回路。 - 【請求項２】 前記共振回路は、一端が前記スイッチ回
路に接続され、他端が接地されたＬＣ並列共振回路であ
ることを特徴とする請求項１記載の群遅延等化回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP19665193A JPH0715268A (ja) | 1993-06-21 | 1993-06-21 | 群遅延等化回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP19665193A JPH0715268A (ja) | 1993-06-21 | 1993-06-21 | 群遅延等化回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0715268A true JPH0715268A (ja) | 1995-01-17 |
Family
ID=16361328
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP19665193A Pending JPH0715268A (ja) | 1993-06-21 | 1993-06-21 | 群遅延等化回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0715268A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| WO2016158953A1 (ja) * | 2015-03-30 | 2016-10-06 | 株式会社村田製作所 | 高周波フィルタ、フロントエンド回路、および通信機器 |
-
1993
- 1993-06-21 JP JP19665193A patent/JPH0715268A/ja active Pending
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| WO2016158953A1 (ja) * | 2015-03-30 | 2016-10-06 | 株式会社村田製作所 | 高周波フィルタ、フロントエンド回路、および通信機器 |
| JPWO2016158953A1 (ja) * | 2015-03-30 | 2017-12-07 | 株式会社村田製作所 | 高周波フィルタ、フロントエンド回路、および通信機器 |
| US10200012B2 (en) | 2015-03-30 | 2019-02-05 | Murata Manufacturing Co., Ltd. | High-frequency filter, front-end circuit, and communication apparatus |
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