JPH07104711A - ポータブルターミナルにおけるｌｃｄ電源制御回 路 - Google Patents
ポータブルターミナルにおけるｌｃｄ電源制御回 路Info
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- JPH07104711A JPH07104711A JP25204393A JP25204393A JPH07104711A JP H07104711 A JPH07104711 A JP H07104711A JP 25204393 A JP25204393 A JP 25204393A JP 25204393 A JP25204393 A JP 25204393A JP H07104711 A JPH07104711 A JP H07104711A
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Abstract
(57)【要約】
【目的】ＬＣＤを備えたポータブルターミナルにおける
ＬＣＤ電源の制御において、装置電流のオン／オフ時に
ロジック系とＬＣＤ系両電源の立上り／立下りのシーケ
ンスをソフトウェア設定により制御し、ＬＣＤの品質劣
化とオフ時のＬＣＤ縞模様表示とを抑止する。 【構成】ロジック系の電源制御部及びＬＣＤ系の電源制
御部に、外部ＣＰＵの制御のもとにソフトウェアにて時
間設定可能な遅延回路部としてのタイマ１５と、電源立
下り時間を短縮化する電源短絡回路部としてのＦＥＴ１
Ｄ，Ｒ８とを設け、これらにより装置電源オン／オフ時
のロジック系及びＬＣＤ系の電源のシーケンスをＬＣＤ
系の電源Ｖｅｅがロジック系の電源Ｖｃｃよりも遅れて
立ち上りかつ早く立ち下るように制御し、またパワーオ
フ信号１５２がアクティブ（ハイレベル）になるタイミ
ングでＦＥＴ１Ｄをオンとしてリップル除去用のコンデ
ンサ１Ｃの電荷を急速放電させ、ＬＣＤ系の電源Ｖｅｅ
の立下りを短縮させる。
ＬＣＤ電源の制御において、装置電流のオン／オフ時に
ロジック系とＬＣＤ系両電源の立上り／立下りのシーケ
ンスをソフトウェア設定により制御し、ＬＣＤの品質劣
化とオフ時のＬＣＤ縞模様表示とを抑止する。 【構成】ロジック系の電源制御部及びＬＣＤ系の電源制
御部に、外部ＣＰＵの制御のもとにソフトウェアにて時
間設定可能な遅延回路部としてのタイマ１５と、電源立
下り時間を短縮化する電源短絡回路部としてのＦＥＴ１
Ｄ，Ｒ８とを設け、これらにより装置電源オン／オフ時
のロジック系及びＬＣＤ系の電源のシーケンスをＬＣＤ
系の電源Ｖｅｅがロジック系の電源Ｖｃｃよりも遅れて
立ち上りかつ早く立ち下るように制御し、またパワーオ
フ信号１５２がアクティブ（ハイレベル）になるタイミ
ングでＦＥＴ１Ｄをオンとしてリップル除去用のコンデ
ンサ１Ｃの電荷を急速放電させ、ＬＣＤ系の電源Ｖｅｅ
の立下りを短縮させる。
Description
【０００１】
【産業上の利用分野】本発明はポータブルターミナルに
おけるＬＣＤ（Ｌｉｑｕｉｄ Ｃｒｙｓｔａｌ Ｄｉｓ
ｐｌａｙ）電源制御回路に関し、特にＬＣＤを備えたポ
ータブルターミナルにおいて、ソフトウェア設定により
制御可能としたポータブルターミナルにおけるＬＣＤ電
源制御回路に関する。
おけるＬＣＤ（Ｌｉｑｕｉｄ Ｃｒｙｓｔａｌ Ｄｉｓ
ｐｌａｙ）電源制御回路に関し、特にＬＣＤを備えたポ
ータブルターミナルにおいて、ソフトウェア設定により
制御可能としたポータブルターミナルにおけるＬＣＤ電
源制御回路に関する。
【０００２】
【従来の技術】従来のＬＣＤ電源制御回路について、図
３及び図４を用いて説明する。
３及び図４を用いて説明する。
【０００３】図３は従来のＬＣＤ電源制御回路の構成図
であり、図４は図３の主要信号のタイミングチャートで
ある。図３において、符号４１は電池，４２は電源スイ
ッチングトランジスタ、４３は電源制御ＩＣ、４４はロ
ジック系のＤＣ／ＤＣコンバータ、４５はインバータ、
４６はＬＣＤ電源前段スイッチングトランジスタ、４７
はＬＣＤ電源後段スイッチングトランジスタ、４８はＬ
ＣＤ系のＤＣ／ＤＣコンバータ、４９はリップル除去用
のコンデンサ、４Ａは装置ロジック部、４ＢはＬＣＤパ
ネル部である。
であり、図４は図３の主要信号のタイミングチャートで
ある。図３において、符号４１は電池，４２は電源スイ
ッチングトランジスタ、４３は電源制御ＩＣ、４４はロ
ジック系のＤＣ／ＤＣコンバータ、４５はインバータ、
４６はＬＣＤ電源前段スイッチングトランジスタ、４７
はＬＣＤ電源後段スイッチングトランジスタ、４８はＬ
ＣＤ系のＤＣ／ＤＣコンバータ、４９はリップル除去用
のコンデンサ、４Ａは装置ロジック部、４ＢはＬＣＤパ
ネル部である。
【０００４】装置電源オン時は、パワーオン信号４３１
がアクティブハイ（ＨＩＧＨ）となり電源制御ＩＣ４３
に入力され、電源制御ＩＣ４３は、抵抗Ｒ１を介して電
源スイッチングトランジスタ４２をオン状態に制御して
電池４１をＤＣ／ＤＣコンバータ４４に供給し、装置ロ
ジック部４Ａに電圧レベルを管理された電源Ｖｃｃが供
給される。またこの時、パワーオフ信号４３２がインア
クティブロウ（ＬＯＷ）の為、インバータ４５、抵抗Ｒ
２，Ｒ３を介してＬＣＤ電源前段トランジスタ４６及び
ＬＣＤ電源後段トランジスタ４７の各スイッチングトラ
ンジスタをオンとし、ＤＣ／ＤＣコンバータ４８に電池
４１による電源が電源スイッチングトランジスタ４２を
介して供給され、ＬＣＤパネル部４Ｂに電源Ｖｅｅが供
給され、結果としてＶｃｃとＶｅｅは図４に示すように
パワーオン信号４３１に同期して両方とも立ち上ること
になる。
がアクティブハイ（ＨＩＧＨ）となり電源制御ＩＣ４３
に入力され、電源制御ＩＣ４３は、抵抗Ｒ１を介して電
源スイッチングトランジスタ４２をオン状態に制御して
電池４１をＤＣ／ＤＣコンバータ４４に供給し、装置ロ
ジック部４Ａに電圧レベルを管理された電源Ｖｃｃが供
給される。またこの時、パワーオフ信号４３２がインア
クティブロウ（ＬＯＷ）の為、インバータ４５、抵抗Ｒ
２，Ｒ３を介してＬＣＤ電源前段トランジスタ４６及び
ＬＣＤ電源後段トランジスタ４７の各スイッチングトラ
ンジスタをオンとし、ＤＣ／ＤＣコンバータ４８に電池
４１による電源が電源スイッチングトランジスタ４２を
介して供給され、ＬＣＤパネル部４Ｂに電源Ｖｅｅが供
給され、結果としてＶｃｃとＶｅｅは図４に示すように
パワーオン信号４３１に同期して両方とも立ち上ること
になる。
【０００５】次に、装置電源オフ時は、パワーオフ信号
４３２がアクティブハイとなって電源制御ＩＣ４３に入
力され、電源制御ＩＣ４３は電源スイッチングトランジ
スタ４２をオフ状態に制御して装置ロジック部４Ａに対
するＶｃｃの供給が遮断される。またパワーオフ信号４
３２は、インバータ４５を介してＬＣＤ電源前段トラン
ジスタ４６及びＬＣＤ電源後段トランジスタ４７をオフ
制御する為、電源スイッチングトランジスタ４２のオフ
またはＬＣＤ電源後段スイッチングトランジスタ４７の
オフのいずれか早い動作タイミングでＤＣ／ＤＣコンバ
ータ４８に対する電池４１による電源が遮断され、結果
としてＶｃｃとＶｅｅは図４に示すようにパワーオフ信
号４３２の変化タイミングに同期して両方とも立ち下り
始める。しかしながら、コンデンサ４９に蓄積された電
荷によりＶｅｅは立下り時間がＶｃｃより長くなり、図
４のＣで示すようにＶｃｃ＝ＯＶ後もＶｅｅの電圧レベ
ルが０とならない期間が存在する。
４３２がアクティブハイとなって電源制御ＩＣ４３に入
力され、電源制御ＩＣ４３は電源スイッチングトランジ
スタ４２をオフ状態に制御して装置ロジック部４Ａに対
するＶｃｃの供給が遮断される。またパワーオフ信号４
３２は、インバータ４５を介してＬＣＤ電源前段トラン
ジスタ４６及びＬＣＤ電源後段トランジスタ４７をオフ
制御する為、電源スイッチングトランジスタ４２のオフ
またはＬＣＤ電源後段スイッチングトランジスタ４７の
オフのいずれか早い動作タイミングでＤＣ／ＤＣコンバ
ータ４８に対する電池４１による電源が遮断され、結果
としてＶｃｃとＶｅｅは図４に示すようにパワーオフ信
号４３２の変化タイミングに同期して両方とも立ち下り
始める。しかしながら、コンデンサ４９に蓄積された電
荷によりＶｅｅは立下り時間がＶｃｃより長くなり、図
４のＣで示すようにＶｃｃ＝ＯＶ後もＶｅｅの電圧レベ
ルが０とならない期間が存在する。
【０００６】以上説明したように、従来のＬＣＤ電源制
御回路では、装置電源オン時はＶｅｅはＶｃｃと同期し
て立ち上り、装置電源オフ時はＶｅｅとＶｃｃは同期し
て立ち下がるが、Ｖｅｅの方が立ち下がり時間が長いシ
ーケンスとなっていた。
御回路では、装置電源オン時はＶｅｅはＶｃｃと同期し
て立ち上り、装置電源オフ時はＶｅｅとＶｃｃは同期し
て立ち下がるが、Ｖｅｅの方が立ち下がり時間が長いシ
ーケンスとなっていた。
【０００７】
【発明が解決しようとする課題】この従来のＬＣＤ電源
制御回路には、以下に述べる（１），（２）及び（３）
の問題点が存在していた。
制御回路には、以下に述べる（１），（２）及び（３）
の問題点が存在していた。
【０００８】（１）装置電源オン時に、ロジック系の電
源ＶｃｃとＬＣＤ系の電源Ｖｅｅとが同期したタイミン
グで立ち上る為に突入電流が大きくなり、電源及びその
周辺回路への負荷が大きく、容量確保の為これらのハー
ドウェアの大型化の誘因となっていた。
源ＶｃｃとＬＣＤ系の電源Ｖｅｅとが同期したタイミン
グで立ち上る為に突入電流が大きくなり、電源及びその
周辺回路への負荷が大きく、容量確保の為これらのハー
ドウェアの大型化の誘因となっていた。
【０００９】（２）Ｖｃｃがオン状態の条件下で、Ｖｅ
ｅをオン／オフ制御するというＬＣＤパネル部側の要求
タイミング仕様を満足させることができない為、ＬＣＤ
パネル部への負荷が大きく、信頼性の低下の原因となっ
ていた。
ｅをオン／オフ制御するというＬＣＤパネル部側の要求
タイミング仕様を満足させることができない為、ＬＣＤ
パネル部への負荷が大きく、信頼性の低下の原因となっ
ていた。
【００１０】（３）Ｖｃｃがグランドレベルとなった後
もＶｅｅにリップル除去コンデンサによる残留電位が存
在する為、装置電源オフ時にＬＣＤ画面に縞模様が発生
したいた。
もＶｅｅにリップル除去コンデンサによる残留電位が存
在する為、装置電源オフ時にＬＣＤ画面に縞模様が発生
したいた。
【００１１】本発明の目的は上述した問題点を解決し、
装置電源オン時の突入電流を抑圧してハードウェアの大
型化を抑止し、ロジック系の電源Ｖｃｃがオン状態でも
Ｖｅｅをオン／オフ制御可能としてＬＣＤパネル部に対
する負荷を軽減して信頼性を向上させ、かつＶｃｃがグ
ランドレベルとなった後にＶｅｅの残留電位の存在を排
除してＬＣＤ画面に縞模様を発生することを抑止したポ
ータブルターミナルにおけるＬＣＤ電源制御回路を提供
することにある。
装置電源オン時の突入電流を抑圧してハードウェアの大
型化を抑止し、ロジック系の電源Ｖｃｃがオン状態でも
Ｖｅｅをオン／オフ制御可能としてＬＣＤパネル部に対
する負荷を軽減して信頼性を向上させ、かつＶｃｃがグ
ランドレベルとなった後にＶｅｅの残留電位の存在を排
除してＬＣＤ画面に縞模様を発生することを抑止したポ
ータブルターミナルにおけるＬＣＤ電源制御回路を提供
することにある。
【００１２】
【課題を解決するための手段】本発明の回路は、ＬＣＤ
を有するポータブルターミナルにおけるＬＣＤ電源のオ
ン／オフを制御するポータブルターミナルにおけるＬＣ
Ｄ電源制御回路であって、前記ポータブルターミナルに
対する装置電源のオン及びオフ時に前記ポータブルター
ミナルのロジック系の電源の立上り及び立下りと前記ポ
ータブルターミナルのＬＣＤ系の電源の立上り及び立下
りとの間にタイミング差を設けかつ前記タイミング差を
ソフトウェアで設定可能なタイミング差生成手段と、前
記ＬＣＤ系の電源の立下り時間を短縮する立下り時間短
縮手段とを備える。
を有するポータブルターミナルにおけるＬＣＤ電源のオ
ン／オフを制御するポータブルターミナルにおけるＬＣ
Ｄ電源制御回路であって、前記ポータブルターミナルに
対する装置電源のオン及びオフ時に前記ポータブルター
ミナルのロジック系の電源の立上り及び立下りと前記ポ
ータブルターミナルのＬＣＤ系の電源の立上り及び立下
りとの間にタイミング差を設けかつ前記タイミング差を
ソフトウェアで設定可能なタイミング差生成手段と、前
記ＬＣＤ系の電源の立下り時間を短縮する立下り時間短
縮手段とを備える。
【００１３】また本発明の回路は、前記タイミング差生
成手段における前記ロジック系の電源の立上り及び立下
りと前記ＬＣＤ系の電源の立上りと立下りとの間のタイ
ミング差が、前記ＬＣＤ系の電源が前記ロジック系の電
源よりも遅れて立ち上りかつ前記ＬＣＤ系の電源が前記
ロジック系の電源よりも早期に立ち下る構成を有する。
成手段における前記ロジック系の電源の立上り及び立下
りと前記ＬＣＤ系の電源の立上りと立下りとの間のタイ
ミング差が、前記ＬＣＤ系の電源が前記ロジック系の電
源よりも遅れて立ち上りかつ前記ＬＣＤ系の電源が前記
ロジック系の電源よりも早期に立ち下る構成を有する。
【００１４】さらに本発明の回路は、前記立下り時間短
縮手段が、前記ＬＣＤの電源回路を前記装置電源のオフ
のタイミングと同期して短絡することによって立下り時
間の短縮を確保する構成を有する。
縮手段が、前記ＬＣＤの電源回路を前記装置電源のオフ
のタイミングと同期して短絡することによって立下り時
間の短縮を確保する構成を有する。
【００１５】
【実施例】次に、本発明について図面を参照して説明す
る。図１は本発明の一実施例の構成図、図２は図１の主
要信号のタイミングチャートである。図１において、符
号１１は電池、１２は電源スイッチングトランジスタ、
栄１３は電源制御ＩＣ、１４はロジック系のＤＣ／ＤＣ
コンバータ、１５はパワーオフ信号遅延用のタイマ、１
６はインバータ、１７はＡＮＤゲート、１８はＬＣＤ電
源スイッチング後段トランジスタ、１９はＬＣＤ電源ス
イッチング前段トランジスタ、１Ａは遅延素子、１Ｂは
ＬＣＤ系のＤＣ−ＤＣコンバータ、１Ｃはリップル除去
用のコンデンサ、１ＤはＬＣＤ電源短絡用のＦＥＴ、１
Ｅは装置ロジック部、１ＦはＬＣＤパネル部であり、図
１にはなお抵抗Ｒ４，Ｒ５，Ｒ６，Ｒ７およびＲ８を併
記する。
る。図１は本発明の一実施例の構成図、図２は図１の主
要信号のタイミングチャートである。図１において、符
号１１は電池、１２は電源スイッチングトランジスタ、
栄１３は電源制御ＩＣ、１４はロジック系のＤＣ／ＤＣ
コンバータ、１５はパワーオフ信号遅延用のタイマ、１
６はインバータ、１７はＡＮＤゲート、１８はＬＣＤ電
源スイッチング後段トランジスタ、１９はＬＣＤ電源ス
イッチング前段トランジスタ、１Ａは遅延素子、１Ｂは
ＬＣＤ系のＤＣ−ＤＣコンバータ、１Ｃはリップル除去
用のコンデンサ、１ＤはＬＣＤ電源短絡用のＦＥＴ、１
Ｅは装置ロジック部、１ＦはＬＣＤパネル部であり、図
１にはなお抵抗Ｒ４，Ｒ５，Ｒ６，Ｒ７およびＲ８を併
記する。
【００１６】まず装置電源のオン／オフ制御について説
明する。装置電源のオン／オフは、電源制御ＩＣ１３が
電源スイッチングトランジスタ１２を抵抗Ｒ４を介して
オン／オフ制御し、ロジック系のＤＣ／ＤＣコンバータ
１４に電池１１の電源の供給をオン／オフすることによ
り実現される。電源制御ＩＣ１３を起動するトリガ信号
は、電源オン制御起動としてはハイアクティブのパワー
オン信号１３１であり、電源オフ制御起動としてはハイ
アクティブのパワーオフ信号１５２であり、いずれも電
源制御ＩＣ１３に入力される。
明する。装置電源のオン／オフは、電源制御ＩＣ１３が
電源スイッチングトランジスタ１２を抵抗Ｒ４を介して
オン／オフ制御し、ロジック系のＤＣ／ＤＣコンバータ
１４に電池１１の電源の供給をオン／オフすることによ
り実現される。電源制御ＩＣ１３を起動するトリガ信号
は、電源オン制御起動としてはハイアクティブのパワー
オン信号１３１であり、電源オフ制御起動としてはハイ
アクティブのパワーオフ信号１５２であり、いずれも電
源制御ＩＣ１３に入力される。
【００１７】次に、本発明のソフトウェアによるＬＣＤ
電源の制御動作について説明する。ＬＣＤの電源のオン
／オフは、装置ロジック部１Ｅに電源が供給され、電源
スイッチングトランジスタ１２がオン状態の条件下で、
ＬＣＤ電源後段トランジスタ１８及びＬＣＤ電源前段ト
ランジスタ１９をオン／オフ制御し、ＬＣＤ系のＤＣ／
ＤＣコンバータ１Ｂに電池１１の電源を供給／停止する
ことにより実現される。ここでＬＣＤ電源オン起動時の
条件としては、電源スイッチングトランジスタ１２がオ
ンであり、かつＬＣＤ電源後段トランジスタ１８がオン
となる必要があり、このためにはＡＮＤゲート１７の出
力がハイレベルとなる必要がある。ＡＮＤゲート１７の
出力は、パワーオフ信号１５２がインアクティブ状態な
のでインバータ１６を介してＡＮＤゲート１７の片方の
入力条件としてハイレベルを供給していることにより、
遅延素子１Ａ側の入力が内蔵コンデンサに電荷が蓄積さ
れてロウ→ハイのレベル移行時にハイレベルとなる。結
果としてＬＣＤパネル部１Ｆの電源Ｖｅｅは図２のＡで
示す遅延時間を確保してロジック系の電源Ｖｃｃよりも
遅れて立ち上ることになる。
電源の制御動作について説明する。ＬＣＤの電源のオン
／オフは、装置ロジック部１Ｅに電源が供給され、電源
スイッチングトランジスタ１２がオン状態の条件下で、
ＬＣＤ電源後段トランジスタ１８及びＬＣＤ電源前段ト
ランジスタ１９をオン／オフ制御し、ＬＣＤ系のＤＣ／
ＤＣコンバータ１Ｂに電池１１の電源を供給／停止する
ことにより実現される。ここでＬＣＤ電源オン起動時の
条件としては、電源スイッチングトランジスタ１２がオ
ンであり、かつＬＣＤ電源後段トランジスタ１８がオン
となる必要があり、このためにはＡＮＤゲート１７の出
力がハイレベルとなる必要がある。ＡＮＤゲート１７の
出力は、パワーオフ信号１５２がインアクティブ状態な
のでインバータ１６を介してＡＮＤゲート１７の片方の
入力条件としてハイレベルを供給していることにより、
遅延素子１Ａ側の入力が内蔵コンデンサに電荷が蓄積さ
れてロウ→ハイのレベル移行時にハイレベルとなる。結
果としてＬＣＤパネル部１Ｆの電源Ｖｅｅは図２のＡで
示す遅延時間を確保してロジック系の電源Ｖｃｃよりも
遅れて立ち上ることになる。
【００１８】次に、ＬＣＤ電源オフ起動の条件として
は、ＬＣＤ電源後段トランジスタ１８がオフとなる必要
があり、ＡＮＤゲート１７の出力がロウレベルとなる必
要がある。ここで、ＡＮＤゲート１７の入力条件とし
て、遅延素子１Ａは電源オン後定常状態となりハイレベ
ルを供給しているので、パワーオフ信号１５２がアクテ
ィブとなってインバータ１６を介してＡＮＤゲート１７
にロウレベルを供給するタイミングでＡＮＤゲート１７
の出力がロウレベルとなる。結果として、ＬＣＤのパネ
ル部１Ｆの電源Ｖｅｅは図２に示すようにパワーオフ信
号１５２の変化と同期して立ち下ることとなる。またＬ
ＣＤ電源前段トランジスタ１９がオフ時は、ＦＥＴ１Ｄ
がオン状態に移行する為、ＬＣＤ電源後段トランジスタ
１８がオフ後はリップル除去用のコンデンサ１Ｃに蓄積
された電荷を速やかにグランドに流す役目を果たし、電
源Ｖｅｅの立ち下がり時間は立ち上り時間と同等に短か
くなる。
は、ＬＣＤ電源後段トランジスタ１８がオフとなる必要
があり、ＡＮＤゲート１７の出力がロウレベルとなる必
要がある。ここで、ＡＮＤゲート１７の入力条件とし
て、遅延素子１Ａは電源オン後定常状態となりハイレベ
ルを供給しているので、パワーオフ信号１５２がアクテ
ィブとなってインバータ１６を介してＡＮＤゲート１７
にロウレベルを供給するタイミングでＡＮＤゲート１７
の出力がロウレベルとなる。結果として、ＬＣＤのパネ
ル部１Ｆの電源Ｖｅｅは図２に示すようにパワーオフ信
号１５２の変化と同期して立ち下ることとなる。またＬ
ＣＤ電源前段トランジスタ１９がオフ時は、ＦＥＴ１Ｄ
がオン状態に移行する為、ＬＣＤ電源後段トランジスタ
１８がオフ後はリップル除去用のコンデンサ１Ｃに蓄積
された電荷を速やかにグランドに流す役目を果たし、電
源Ｖｅｅの立ち下がり時間は立ち上り時間と同等に短か
くなる。
【００１９】また、ロジック系の電源Ｖｃｃは、パワー
オフ信号１５２がアクティブ状態に移行する時、同信号
がタイマ１５を介して電源制御ＩＣ１３に入力されてい
る為に、タイマ１５で設定された遅延時間を経過してか
ら立ち下がることになる。ここでタイマ１５は、コント
ローラ中枢として７１０５４相当のタイマ制御ＬＳＩを
使用し、図示しないＣＰＵの制御のもとに提供されるア
ドレスバス制御信号１５１及びデータバス１５３による
各種信号を入力することによりパワーオフ信号１５２を
遅延させる時間をソフトウェアで任意に設定可能な機能
を有する。結果として、装置電流オフ時は、図２に示す
ようにロジック系の電源ＶｃｃはＬＣＤの電源Ｖｅｅが
立ち下ってからソフトウェアによって設定された遅延時
間Ｂの後に立ち下がることになる。
オフ信号１５２がアクティブ状態に移行する時、同信号
がタイマ１５を介して電源制御ＩＣ１３に入力されてい
る為に、タイマ１５で設定された遅延時間を経過してか
ら立ち下がることになる。ここでタイマ１５は、コント
ローラ中枢として７１０５４相当のタイマ制御ＬＳＩを
使用し、図示しないＣＰＵの制御のもとに提供されるア
ドレスバス制御信号１５１及びデータバス１５３による
各種信号を入力することによりパワーオフ信号１５２を
遅延させる時間をソフトウェアで任意に設定可能な機能
を有する。結果として、装置電流オフ時は、図２に示す
ようにロジック系の電源ＶｃｃはＬＣＤの電源Ｖｅｅが
立ち下ってからソフトウェアによって設定された遅延時
間Ｂの後に立ち下がることになる。
【００２０】以上のようにして、装置電源オン時はロジ
ック系の電源ＶｃｃよりＡだけ遅れてＬＣＤ系の電源Ｖ
ｅｅが立ち上り、装置電源オフ時は、Ｖｅｅがソフトウ
ェア設定可能なＢだけＶｃｃより早く立ち下るタイミン
グシーケンスを実現することができる。
ック系の電源ＶｃｃよりＡだけ遅れてＬＣＤ系の電源Ｖ
ｅｅが立ち上り、装置電源オフ時は、Ｖｅｅがソフトウ
ェア設定可能なＢだけＶｃｃより早く立ち下るタイミン
グシーケンスを実現することができる。
【００２１】
【発明の効果】以上説明したように本発明は、ＬＣＤを
備えたポータブルターミナルにおける装置電源オン／オ
フ時のロジック系の電源ＶｃｃとＬＣＤ系の電源Ｖｅｅ
との立上り／立下りのタイミング差をソフトウェアによ
って設定し生成し、かつＬＣＤ系の電源Ｖｅｅの立下り
を短縮可能とすることにより、次の（１）〜（４）の効
果を有する。
備えたポータブルターミナルにおける装置電源オン／オ
フ時のロジック系の電源ＶｃｃとＬＣＤ系の電源Ｖｅｅ
との立上り／立下りのタイミング差をソフトウェアによ
って設定し生成し、かつＬＣＤ系の電源Ｖｅｅの立下り
を短縮可能とすることにより、次の（１）〜（４）の効
果を有する。
【００２２】（１）装置電源オン時にロジック系の電源
ＶｃｃとＬＣＤ系の電源Ｖｅｅとが別タイミングにて立
ち上がる為突入電流を小さく抑えることができ、電源及
び周辺回路部の余裕度を確保し易く小型化設計を容易と
する。
ＶｃｃとＬＣＤ系の電源Ｖｅｅとが別タイミングにて立
ち上がる為突入電流を小さく抑えることができ、電源及
び周辺回路部の余裕度を確保し易く小型化設計を容易と
する。
【００２３】（２）必ずロジック系の電源Ｖｃｃがオン
状態の条件を確保してＬＣＤ系の電源Ｖｅｅをオン／オ
フする為、ＬＣＤパネル側の要求タイミング仕様を満足
し信頼性が向上する。
状態の条件を確保してＬＣＤ系の電源Ｖｅｅをオン／オ
フする為、ＬＣＤパネル側の要求タイミング仕様を満足
し信頼性が向上する。
【００２４】（３）ＬＣＤ系の電源Ｖｅｅが急峻に立ち
下がる為、Ｖｃｃオフ後のＶｅｅ残留電位が原因となっ
て生ずる電源オフ時のＬＣＤの縞模様が発生しない。
下がる為、Ｖｃｃオフ後のＶｅｅ残留電位が原因となっ
て生ずる電源オフ時のＬＣＤの縞模様が発生しない。
【００２５】（４）ＬＣＤ系の電源Ｖｅｅとロジック系
の電源Ｖｃｃの立上り／立下りの遅延時間関係をソフト
ウェアにて設定可能な為、回路設計余裕度が大きい。
の電源Ｖｃｃの立上り／立下りの遅延時間関係をソフト
ウェアにて設定可能な為、回路設計余裕度が大きい。
【図１】本発明の一実施例の構成図である。
【図２】図１の主要信号のタイミングチャートである。
【図３】従来のＬＣＤ電流制御回路の構成図である。
【図４】図３の主要信号のタイミングチャートである。
１１ 電池 １２ 電源スイッチングトランジスタ １３ 電源制御ＩＣ １４ ＤＣ／ＤＣコンバータ １５ タイマ １６ インバータ １７ ＡＮＤゲート １８ ＬＣＤ電源スイッチング後段トランジスタ １９ ＬＣＤ電源スイッチング前段トランジスタ １Ａ 遅延素子 １Ｂ ＤＣ／ＤＣコンバータ １Ｃ コンデンサ １Ｄ ＦＥＴ １Ｅ 装置ロジック部 １Ｆ ＬＣＤパネル部
Claims (3)
- 【請求項１】 ＬＣＤを有するポータブルターミナルに
おけるＬＣＤ電源のオン／オフを制御するポータブルタ
ーミナルにおけるＬＣＤ電源制御回路であって、前記ポ
ータブルターミナルに対する装置電源のオン及びオフ時
に前記ポータブルターミナルのロジック系の電源の立上
り及び立下りと前記ポータブルターミナルのＬＣＤ系の
電源の立上り及び立下りとの間にタイミング差を設けか
つ前記タイミング差をソフトウェアで設定可能なタイミ
ング差生成手段と、前記ＬＣＤ系の電源の立下り時間を
短縮する立下り時間短縮手段とを備えることを特徴とす
るポータブルターミナルにおけるＬＣＤ電源制御回路。 - 【請求項２】 前記タイミング差生成手段における前記
ロジック系の電源の立上り及び立下りと前記ＬＣＤ系の
電源の立上りと立下りとの間のタイミング差が、前記Ｌ
ＣＤ系の電源が前記ロジック系の電源よりも遅れて立ち
上りかつ前記ＬＣＤ系の電源が前記ロジック系の電源よ
りも早期に立ち下ることを特徴とする請求項１記載のポ
ータブルターミナルにおけるＬＣＤ電源制御回路。 - 【請求項３】 前記立下り時間短縮手段が、前記ＬＣＤ
の電源回路を前記装置電源のオフのタイミングと同期し
て短絡することによって立下り時間の短縮を確保するこ
とを特徴とする請求項１または２記載のポータブルター
ミナルにおけるＬＣＤ電源制御回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP25204393A JPH07104711A (ja) | 1993-10-08 | 1993-10-08 | ポータブルターミナルにおけるｌｃｄ電源制御回 路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP25204393A JPH07104711A (ja) | 1993-10-08 | 1993-10-08 | ポータブルターミナルにおけるｌｃｄ電源制御回 路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH07104711A true JPH07104711A (ja) | 1995-04-21 |
Family
ID=17231785
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP25204393A Pending JPH07104711A (ja) | 1993-10-08 | 1993-10-08 | ポータブルターミナルにおけるｌｃｄ電源制御回 路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH07104711A (ja) |
Cited By (9)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US6304256B1 (en) | 1998-01-29 | 2001-10-16 | Oki Electric Industry Co., Ltd. | Display unit |
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-
1993
- 1993-10-08 JP JP25204393A patent/JPH07104711A/ja active Pending
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| Date | Code | Title | Description |
|---|---|---|---|
| A02 | Decision of refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A02 Effective date: 20000404 |