JPH0666797B2 - Catv加入者端末伝送制御 - Google Patents
Catv加入者端末伝送制御Info
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- JPH0666797B2 JPH0666797B2 JP63275989A JP27598988A JPH0666797B2 JP H0666797 B2 JPH0666797 B2 JP H0666797B2 JP 63275989 A JP63275989 A JP 63275989A JP 27598988 A JP27598988 A JP 27598988A JP H0666797 B2 JPH0666797 B2 JP H0666797B2
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Description
【発明の詳細な説明】
[産業上の利用分野]
本発明は、2方向ケーブル伝送システムに関し、より詳
しくは、多くの加入者局がヘッドエンドに上りのデータ
信号を伝送することができる伝送システムに関する。 [従来の技術及び発明が解決しようとする課題] ケーブル伝送システムは典型的には、ブランチに接続さ
れるスプリッタを介してドロップ回線に接続される加入
者端末を有し、トランクから主トランクとブランチを含
むトリータイプのネットワークにおいて、種々の下りの
テレビジョン信号を伝送する。典型的なネットワーク
は、上記信号を予め決められた最小レベルの上側に配置
することを維持するために、ネットワークに沿って間隔
をおいて設けられた中継増幅器を有する同軸ケーブルか
ら構成される。 プログラムの選択及びポーリングの応答などのために、
サービスの要求に応じてヘッドエンドへの上りの伝送の
ために、信号を加入者端末から出力させることを可能に
することが目的とされてきた。しかしながら、以下に記
述する種々のプログラムはサービスの提供を成功させる
ことを妨げ、これによって、信号が加入者端末から出力
されネットワークを介してヘッドエンドへ上り方向で通
過する。従って、そのようなシステムは、例えば電話シ
ステム又は単に疑似会話型システムのような分離した伝
送ネットワークを利用し、これらのシステムにおいて
は、すべてのプログラム又は情報信号が加入者端末に入
力され、上記プログラム又は情報が、上記端末で選択さ
れる。両方の場合において加入者端末から出力される信
号は、上記システムの上り回線を通過しないようになっ
ている。 2つの非常に重要な問題点が同一のCATVネットワー
クを介して2方向通信を成功させることを妨げていた。
同一の周波数帯域内で上りの伝送の可能性を有する典型
的に何千の加入者端末が存在するとき、いくつかの端末
が同時に送信を行う可能性が大きい。その結果、ヘッド
エンドにおいて、1つの加入者端末から受信される信号
が、同時に送信する他の加入者端末から受信される信号
によって汚損を受ける。ヘッドエンドから種々の異なっ
た線路長(伝送距離)に位置する種々の加入者端末から
信号が送信されるシステム内における種々の時間遅延の
存在によって、この問題が一層悪化される。 第2の問題点は雑音集合の問題である。種々のブランチ
から1つのトランクに送出される多数の上り回線の雑音
が集合し、この雑音はしばしば1つの加入者端末によっ
て伝送される信号レベルよりも極めて高くなる可能性が
あることが認識されるであろう。上り方向で増幅が試み
られる際に上記システムにおける2方向増幅器の入力に
例えば雑音などのどんな信号が入力されても増幅が行な
われるために、上記2方向増幅器を用いたことによって
上記問題点が増大する。そのような増幅器は典型的に
は、最少の信号の時間において最大の利得で動作する自
動利得制御を用いるので、すべてのブランチから上記増
幅器に出力される最大の雑音が収集されて出力される。 [課題を解決するための手段] 本発明は、種々の加入者端末からヘッドエンドに同時に
到達する信号間の衝突の問題を実質的に減少又は除去さ
せるケーブル伝送システムである。雑音集合の問題点を
実質的に減少又は除去させるための手段がまた開示され
る。 本発明のケーブルシステムにおけるヘッドエンドは、通
常のCATVシステムにおけるテレビジョン信号を提供
するのみならず、分離した下りのデータチャネルにおい
てデータ信号を伝送する。データチャネルにおける信号
はタイムスロットに分割されたパケットで伝送され、こ
こで、上記タイムスロットはここで状態バイトとして参
照されるデータの特別なバイトによって分離される。上
記状態バイトは、ここで“ビジービット”として参照さ
れる複数のビットで形成される。 下りのデータ信号は独立したチャネルを用いて上記テレ
ビジョン信号と周波数多重され、ネットワークを介して
加入者端末に下り方向で伝送される。加入者端末はそれ
ぞれ、ビジービットを検出し複号化した後、ネットワー
クがアイドル状態又はビジー状態であるか、もしくは衝
突が生じているか、もし所望されるならば優先レベルが
存在するかを決定する。もし各加入者端末が伝送すべき
データを有しているならば、各加入者端末はある確率係
数でヘッドエンドに上記データを送り戻す。端末が連続
的に受信するビジービットが衝突を示す(これは、もう
1つの加入者端末が伝送を行い、そのデータ信号を汚損
していることを示す。)か否かに存在して、上記確率係
数が修正される。もし衝突が検出されるならば、上記確
率係数が変化され、加入者端末は、確率係数に従属な時
間で汚損されたタイムスロットからデータを再び伝送す
る。 伝送を行う加入者端末はまた、衝突と、すなわちビジー
ビットで示された衝突の数を計数する。もし、衝突の数
が予め決められたしきい値を越えたならば、該加入者端
末は上記確率係数を再び利用し、新しい確率係数で制御
される時間で全体のデータシーケンスを再び伝送する。 もし任意の加入者端末が受信するビジービットがネット
ワークが上り方向でビジーであることを示しているなら
ば、上記任意の加入者端末は伝送することを抑制され
る。従って、衝突の効果は、ビジービットが上りのデー
タチャネルがアイドル状態であることを示す次の時間で
生じ、加入者端末が上りのチャネルが捕捉されすなわち
ビジ−であることを示すヘッドエンドからのビジービッ
トを受信する時間の前に、1つ以上の加入者端末によっ
てデータの伝送が開始される。このように、衝突の効果
は、典型的には、チャネルがアイドル状態であるとき、
1つ以上の加入者端末によって新しい伝送を開始する初
期において生じ、トラフィック量が増加するとき、上記
衝突の効果が増大する。 伝送係数の確率は、システム内の種々の加入者端末から
伝送される信号に対する異なった時間遅延の可能性と関
連させた乱数発生器を用いて変化され、もし確率係数が
各加入者端末において同一の方法で変化されるときに比
べて、1つ以上の加入者端末が同時に伝送を行う可能性
を減少させている。さらに、衝突の数は1つの加入者端
末が伝送を可能にする減少された確率を生じさせるの
で、トラフィック量が大きくなるにつれて、加入者端末
が伝送するためのより長いランダムな時間だけ待機する
ことを自動的に生じさせる可能性が大きくなる。従っ
て、上記システムは増加するトラフィック量を自動的に
補償しかつ調整している。 雑音集合の問題点は実質的には、ネットワークの各ブラ
ンチの上り方向において、各加入者端末に対して間隔が
置かれた2つの周波数で変調を行う周波数偏移変調を用
いてそのデータを伝送させ、かつ2つの周波数を通過さ
せるのにちょうど十分な2つの通過帯域を有する狭帯域
通過フィルタを用いることによって、解決される。下り
のデータ信号は影響を受けない。従って、フィルタは、
上り回線からヘッドエンドに通過する2つの狭い通過帯
域における少量の雑音を除くすべての雑音を事実上遮断
する。上記フィルタは好ましくは、信号を通過させるた
めに又は上りの信号の受信に応答してフィルタを制御可
能に切り換えるように、遠隔でアドレス割り当て可能で
ある。この構成は、雑音集合をうまく防止することがわ
かった。 従って、2方向ケーブルシステムにおける上り信号の衝
突と雑音集合の従来技術の問題が実質的に解決される。 簡潔に言えば、本発明、ヘッドエンドと、上記ヘッドエ
ンドに接続され上記ヘッドエンドから複数の加入者局に
下りの信号を伝送するためであって加入者局からヘッド
エンドに上りのデータ信号を伝送するための2方向伝送
ネットワークを備えた方向性ケーブル通信システムであ
る。上記ヘッドエンドにおける回路は、加入者局から受
信される信号間の衝突を検出して衝突信号を発生し、上
記ヘッドエンドにおける別の回路は、伝送システムの下
り回線に衝突を示すデータ信号の状態バイトを伝送し、
加入者局によるその検出に応答して、伝送を終了するこ
とを可能にすることができる。 好ましくはヘッドエンドの衝突検出器はまた信号が任意
の加入者局から受信されたか否かを検出するためであっ
てそれぞれビジー又はアイドル状態バイト信号を発生す
るための装置を含み、上記バイト伝送回路は、衝突状
態、アイドル状態、又はビジー状態を示すデータ信号の
バイトを発生する。 データの状態バイトは下りのデータ信号のタイムスロッ
トと分離して伝送すべきことがまた好ましく、ここで、
下りと上りの両方向でネットワークの最長の遅延された
エンドに対する伝送ループにおけるすべての構成要素の
遅延時間の和である最大往復伝搬遅延時間は、少なくと
も上記伝搬遅延時間と同様の長さであるべき連続する状
態バイト間の時間周期を定義している。 本発明はまた、信号の衝突、ビジー又はアイドル及び好
ましくは優先を含むネットワークの状態を示す状態バイ
トを備えた2方向伝送ネットワークからデータ信号を繰
り返し受信するための装置と、上記ネットワークを介し
てヘッドエンドに伝送すべきデータ信号を定式化し記憶
するための装置と、上記ネットワークを介してヘッドエ
ンドにデータ信号を伝送するための装置と、上記伝送す
るための装置を制御するための装置を備えた2方向ケー
ブル通信システムにおいて用いるための加入者端末であ
って、上記制御するための装置は、上記状態バイトを受
信するためであって予め決められた確率Pでデータ信号
の伝送を可能にするための装置と、受信された信号衝突
状態信号の数を計数するためであってこれに応答して確
率Pを調整するための装置を備える。 上記制御するための装置は、もし受信された信号衝突状
態信号の数がある予め決められた最大数を越えるならば
時間周期の間伝送を禁止し、これに応答して完了データ
信号の再伝送を再び初期化することが好ましい。 [実施例] 第1図は本発明による2方向ケーブル通信ネットワーク
を図示している。しかしながら、本発明は、星型ネット
ワーク、ローカルエリアネットワーク、又はその他の種
類のネットワークにおいて用いることができる。本実施
例において、システムは、複数の加入者端末3を有する
例えば同軸ケーブルのような広帯域通信媒体を介して通
信を行うヘッドエンド1を備える。上記端末とヘッドエ
ンド1は、例えば公知のトリー型ネットワークのような
あるネットワークを介して通信を行うが、もう1つの形
式の非ループネットワークであることが可能である。ト
リー型ネットワークは、加入者端末へのドロップ回線
(図示せず。)を介して接続された2方向増幅器4とス
プリッタ5を備える。上記ネットワークは公知の方法で
整合用インピーダンス6で終端される。 記述の簡単化のために、ただ1個の加入者端末3が示さ
れている。しかしながら、加入者端末を、公知の方法で
ネットワークに沿って分配されて設けられるスプリッタ
に接続することが可能であることは明らかである。 従来のネットワークにおいて、増幅器4は下り方向の1
方向性を有し、これによって、増幅器4は複数のテレビ
ジョンチャネルを伝送する。しかしながら、本発明は、
またデータ信号を伝送する種類のネットワークに注意が
払われている。そのような信号は、コンピュータで発生
された画像、コンピュータプログラム、デスクランブラ
のための制御信号などに再構成すべきデータ信号を伝送
するネットワークにおいて提供されてきた。そのような
データ信号は時々テレビジョンチャネルの垂直インター
バルにおいて伝送されるが、本発明においては、上記デ
ータ信号が独立した高速度データチャネルを用いて伝送
される。従って、上記増幅器4は、下り方向でデータチ
ャネルを伝送する能力を有すべきである。 特定のサービスを提供するために、加入者端末3は典型
的には、信号を発生させ、結局、上りの回線を介してヘ
ッドエンドに伝送すべきコマンド又は他のデータ信号を
発生させるキーボードを有する。幾つかの問題点は、こ
の上りの伝送によって特徴づけられ、その結果、もし任
意のそのような実際のシステムが存在するならば、ほと
んどの問題点が特徴づけられない。本発明は、多数の加
入者端末から上りのデータを確実に伝送するための手段
を提供する。しかしながら、2方向増幅器4はまた上り
方向で加入者端末から受信されたデータ信号を伝送する
能力を有すべきことを言うべきである。そのような増幅
器4が存在し、本発明は、明確にそれらに注意を払って
いない。 上りの伝送と関連する問題は、雑音集合とデータ衝突を
含む。雑音集合は、すべての雑音がシステムの主トラン
ク又はポートに出力される、例えばトリー型ネットワー
クの多数のブランチから雑音が発生することを意味す
る。この雑音は各増幅器によって増幅され、その結果、
ヘッドエンドにおいて過度の雑音レベルが生じる。 1つ以上の加入者端末が、ヘッドエンドにおいてやがて
重畳されて到達する上り方向のデータ信号を伝送すると
き、データの衝突が存在する。これによって、明らか
に、重畳するすべてのデータ信号の改変が生じる。 雑音集合を防止する問題に対する解決が、本発明の目的
ではない。本発明において、衝突の問題は、ヘッドエン
ドから下り回線を介して加入者端末に伝送されるいわゆ
る“ビジービット”の使用によって、解決される。2ビ
ットのビジービットのバイトは、ビジー又はアイドルで
あるチャネルの性質を定義している。もちろん、2ビッ
トは、4つの異なった状態、すなわち、アイドル、ビジ
ー、衝突、並びに優先指示又は他の情報として用いるこ
とが可能な第4の状態を定義することができる。しかし
ながら、もし所望されるならば、他の数のビジービット
を用いることができる。 一般に、上記ヘッドエンドは、好ましくはクーリエ(cou
rier)の振幅変調を用いてアイドルチャネルを示すビジ
ービットを規則的な基礎をおいて伝送する。もしヘッド
エンドがデータ信号を受信するならば、ヘッドエンドは
ビジー状態を定義するためにビジービットのキャラクタ
を変化させる。データの解析において、ヘッドエンドは
受信されたデータ信号間の衝突を検出し、もしそのよう
な衝突を検出するならば、ヘッドエンドは衝突状態を示
すためにビジービットを変化させる。 一方、加入者端末は、上りのデータを好ましくは(例え
ばMSKなどの)周波数偏移変調の形式で伝送する。加
入者端末は、絶えず下りのビジービットをモニタし、チ
ャネルがアイドル状態であると示されるとき(伝送すべ
きいくつかのデータが存在すると仮定する。)、伝送を
行う。もし伝送中において加入者端末がビジービット間
の衝突を検出したならば、伝送を停止し、後述されるよ
うにある時間周期の間待機を行った後、信号を再び伝送
する。 トランクにおける雑音を最少化するために、フィルタ7
は分配ネットワークの種々のブランチと直列に接続さ
れ、各フィルタは、上りの周波数偏移データのための鋭
い特性を有する狭い通過帯域を有し、各フィルタは伝送
の上り方向に接続される。これによって、フィルタの帯
域幅の雑音を除いて、すべての上りの雑音を減少させ
る。上りのデータの伝送特性を改善するために、好まし
くは、フィルタがフィルタの実際の帯域幅において上り
の搬送波信号の存在を検出するまで遮断状態のままであ
るフィルタが用いられ、上記上りの搬送波信号の検出す
るのに応答して、フィルタは例えば数マイクロ秒以内の
高速で開放状態となり、上りのデータ信号を通過させる
ことを可能にする。さらに、上記フィルタは、ネットワ
ークの保守の目的のために、ヘッドエンドから開放又は
閉鎖状態にアドレス割り当てされることが可能である。
上記フィルタは下り方向でトランスペアレントであり、
すなわち、テレビジョン信号及び下りのデータ信号が下
り方向でこれらのフィルタを通過する。 ヘッドエンド内において、テレビジョン信号の信号源が
変調器8に接続され、この変調器8は、チャネルフィル
タ9を介して同軸ケーブルに接続される出力を有する。
このように、テレビジョン信号は、従来技術と同様にネ
ットワークに印加される。 受信帯域通過フィルタ10は同軸ケーブル2に接続され
る入力と、データ復調器11に接続される出力を有す
る。従って、加入者端末3から伝送される周波数変調さ
れたデータが復調器11から出力される。 また、衝突検出器12はフィルタ10の出力に接続され
る。衝突検出器12は、好ましくは包絡線検波の手段に
よって重畳するビットの存在を検出する。そのタイプの
衝突検出は非常に高速であるので、上記衝突検出は好ま
しくは広帯域でなされる。 衝突検出器12内のロジックはまた、上述で参照された
4つの状態、すなわちアイドル、ビジー、衝突並びに優
先又は未定義を示すビジービットとしてここで参照され
たビットの組みを提供する。IEC又はチャネル状態指
示子として示されたこれらのビットは、通信コントロー
ラ13に印加される。ここで、ビジービットは変調器8
に印加される下りのデータ列にインターリーブ(多重
化)される。変調器8は結合されたデータ列を高速度デ
ータチャネルに印加し、そのチャネルの出力は、上述し
たようにテレビジョン信号源として参照されて取り扱わ
れる。 ビジービットは好ましくは、時間に対する下りのデータ
列を図示する第2図で示されるように、各タイムスロッ
トの最初において、周期的に1秒当たり4Mビットで下
りのチャネルを介して送信される。従って、矢印18に
よって図示されたビジービットは、各タイムスロットの
時間周期を示している。例えばそれぞれ128ビット、
256ビット、512ビット、1024ビットを含む上
記タイムスロットを、ヘッドエンドでプログラムするこ
とができ、例えばビット周期は好ましくは0.25マイ
クロ秒である。上記タイムスロット内で送信される下り
のデータは、参照番号19として示される。 通信コントローラはまた、下りのデータパケットがネッ
トワークのビジー又は衝突状態中において伝送されない
ことを確実にしている。もし送信機が長い周期にわたっ
て送信しているならば、例えばもし予め決められた最大
のパケットの大きさにわたって送信しているならば、通
信コントローラはまた送信機をオフに切り換える。この
ように、送信機はロック状態になりタイムアウト状態に
なる。 ビジービットの連続する組みの伝送を区分する時間の周
期は、ネットワークの最大往復伝搬遅延時間に等しいか
又は長くすべきことが重要である。この遅延時間は、両
方向においてネットワークの最長に遅延されたエンドに
最初に到達する最大ケーブル長を有する伝送ループを構
成するすべての構成要素の遅延時間の和である。 ヘッドエンドから送信される各データパケットは好まし
くは、1個のタイムスロットの周期に等しいか又は長く
すべきである。典型的なパケットフォーマットが第3図
において図式的に示される。この典型的なパケットフォ
ーマットは例えば、次のように構成される。すなわち、
2ないし7バイトのプリアンブル、これに続いて1バイ
トのスタートフレームデリミタ、これに続いて4バイト
の目的地アドレス、これに続いて4バイトのソースアド
レス、これに続いて2バイトのフレーム長指示子、これ
に続いて伝送されるべきデータを含む制限された数のバ
イト、これに続いて(もし必要であるならば)制限され
た数のパディングバイト、これに続いて2バイトのフレ
ームチェックシーケンスの順序で構成される。 第4図は、第1図で示された加入者端末3の好ましい形
式のブロック図を図示している。ネットワークに接続さ
れる同軸ケーブル2は、(フィルタ9と同様である)下
りの帯域通過フィルタ22と上りの帯域通過フィルタ2
3の両方に接続され、後者の上りのフィルタ23は、加
入者端末で発生すべき周波数偏移変調された出力信号の
2つの周波数を通過させるのにちょうど十分な2つの狭
い通過帯域を形成することが可能である。 フィルタ22の出力はスプリッタ23Aを介してテレビ
ジョンチューナ/アナログ回路24に伝送される。回路
24は、同調可能なダウンコンバータとペイテレビジョ
ンデスクランブラ又はその他の同種類のものから構成し
てもよい。回路24の出力は、テレビジョンセット26
に印加するために変調器25に印加される。 フィルタ22の出力はまたスプリッタ23Aを介してデ
ジタル復調器27の入力に接続され、該復調器27はデ
ジタルチャネルにおけるデータ列を復調する。デジタル
復調器27は、公知の方法で対応する出力ライン上にデ
ータ及びクロック出力信号を出力する。これらの信号
は、公知の方法でパラレル信号に変換されるCAD回路
を介して印加され、さらに中央プロセッサ/メモリ回路
29のデータ及びクロック入力に印加される。データ及
びアドレスバス30は上記中央プロセッシング装置/メ
モリ回路29と通信を行う。加入者端末と関連する他の
周辺デジタル回路31はまた、例えばビデオディスプレ
イジェネレータを制御するために、またアラーム回路を
モニタするなどのために、中央プロセッシング装置/メ
モリ回路29に接続される。 デジタル復調器におけるデータ及びクロックライン出力
はまた、ビジービット(IEC)抽出論理回路32の対
応する入力に接続され、またこの対応する入力はバス3
0に接続される。N分配回路33はクロックラインに接
続され、その出力はクロック信号C1である。従って、
N分配回路はクロックラインから内部クロック信号C1
を発生し、このように下りのデータ信号からクロック信
号の発生が所望される。 ヘッドエンドに伝送するためのプロセッサ回路29から
データ信号を受信するために、バッファ34がバス30
に接続される。バッファ34から出力される出力信号を
上りのデータチャネルの通過帯域内で周波数偏移変調信
号に変調するために、バッファ34の出力が、周波数偏
移変調器35に接続される。変調器35の出力は、上り
の信号の伝送間隔を制御するタイムアウト回路36を介
して印加される。タイムアウト回路36の出力は、上り
の帯域通過フィルタ23に印加され、上記フィルタ23
の出力は、ヘッドエンドに伝送するために同軸ケーブル
2に印加される。 媒体アクセス管理伝送論理回路37(以下、MAC回路
という。)(制御手段)はバス30に接続され、ビジー
ビットを受信するために抽出論理回路32に接続される
他の入力を有する。MAC回路はまたバッファ34の制
御入力並びにタイムアウト回路36の制御入力/出力に
接続される。このMAC回路の目的は、ビジービットを
モニタすることによってネットワークのビジー、アイド
ル、又は衝突状態を検出することと、バッファ34に蓄
積された信号をヘッドエンドに伝送することとこの伝送
のタイミングを制御することにある。 デジタルチャネル信号がヘッドエンドからケーブル2を
介して受信され、フィルタ22においてろ波された後、
デジタル復調器27に印加される。復調後に得られるデ
ータ及びクロック信号はプロセッサ29に印加される。
他のデジタル回路31を介して動作するキーパッド又は
他の手段は、他のデジタル回路31に対してヘッドエン
ドに伝送するためのデータ信号を定式化させるためにプ
ロセッサ29を通信を行う。CPU/メモリにおいてこ
れらの信号を定式化するための機構は当業者に公知であ
る技術を用いることができるので、本発明の目的ではな
い。信号が定式化されたとき、信号は、バス30を介し
て信号が蓄積されるバッファ34の入力に通過されると
いえば、十分である。 IEC抽出論理回路32は、復調器27の出力のデータ
及びクロックライン上のビジービットを検出する。ビジ
ービットはMAC回路37に出力される。 MAC回路37は、後述される内部アルゴリズムを用い
て動作する。もしMAC回路がビジーチャネル又は衝突
示すビジービットを受信したとき、次のビジービットが
到着するまで待機し、ビジービットの状態を連続してモ
ニタする。もしビジービットがチャネルが空き状態であ
ることを示しているならば、MAC回路は、確率Pで伝
送することを決定し、もしくは確率(1−P)で伝送し
ないことを決定した後、次のビジービットの組みが到着
するまで待機し、次いで、伝送調整アルゴリズムの確率
で動作するであろう。 MAC回路が伝送を行うことを決定したとき、制御信号
をバッファ34に印加し、これによってバッファ34に
対してその蓄積されたパケットを出力することを開始さ
せる。同時にMAC回路はビジービットをモニタする。
上記回路が伝送中においてもし衝突を示すビジービット
が受信されるならば、これは同一の時間周期において1
局以上の他の送信機が伝送中であることを意味し、上記
MAC回路は、その伝送を停止すべくバッファ34をす
ぐに制御する。上記MAC回路内の衝突カウンタはまた
インクリメントされる。 もし衝突カウンタで示される衝突数がある予め決められ
た最大数を越えているならば、全体のパケット伝送プロ
セスが停止される。上記パケットはバッファ34に戻さ
れ、ここで、MAC回路によって制御される再伝送の前
に、該パケットはある時間周期だけ待機状態となる。 もしすでに生じた衝突の数が最大数よりも大さければ、
パケットの伝送確率Pは、係数Kで(ここで、P=P/
K)、最少再伝送確率値に約分される。このとき、上記
MAC回路は、次の組みのビジービットまで待機状態と
なり、さらに、次の組みのビジービットの検査を繰り返
す。 もし次の組みのビジービットが衝突を示していないなら
ば、加入者局自身は伝送中であるので、上記次の組みの
ビジービットは必ずビジー状態を示すであろう。このこ
とは、ローカルの加入者端末が単にチャネルを捕捉して
いることを意味する。伝送が再び初期化され、パケット
の最後まで連続的に伝送が行なわれた後、チャネルが空
き状態になったことが宣言されるであろう。このとき、
衝突カウンタはゼロに初期化され、その伝送確率Pが1
にされる。 第4図の抽出論理回路32とMAC回路37が詳細後述
される。第5図に、ビジービット抽出論理回路32のブ
ロック図が図示される。データ及びクロックラインは、
もし下りのデータ信号がスクランブルされて受信される
ならば必要に応じてデスクランブルするためのデスクラ
ンブラ回路40に接続される。デスクランブラ40は、
通信コントローラ13(第1図)の一部として含まれる
ことが可能であるヘッドエンドのスクランブラのミラー
イメージ回路である。デスクランブラ40の出力信号
は、ビットカウンタ41のデータ及びクロック入力に印
加されるクロック及びデータ信号である。ビットカウン
タ41のカウンタ出力は、カウンタ41の内容からパケ
ットの始まりを決定するとともに受信されたデータパケ
ットの始まりの存在を示すパルス又はパルスの立ち上が
りエッジをIND出力に出力するフラグ決定回路42に
接続される。 ビットカウンタ41のデータ及びクロック出力はゼロ抽
出回路43に接続される。この回路43は、すべて1か
ら構成される長いバイトの値を区別するためにヘッドエ
ンドにおける通信コントローラ13で挿入されるゼロを
取り除くために公知の方法で用いられる。従って、ゼロ
抽出回路43は元のデータを再構成する。この訂正され
たデータは、状態バイト抽出回路44に印加される。 上記訂正されたデータ信号はまたカウンタ及びインター
バル制御回路45に印加され、該回路45はアドレスバ
スADDR及びデータバスD0−D7を介してバス30
に接続される。 バス30は上述されたようにプロセッサ29に接続され
る。上記タイムスロットの間隔はCPUによって決定さ
れてそのメモリにおいて記憶され、このデータはバス3
0を介して回路45に送信され、このデータはとって代
わって抽出回路44のCTRLライン上の制御信号とな
る。上記タイムスロットは、受信されたパケットのチェ
ックサムがマッチング状態となるまで抽出回路における
間隔を変化することによって見つけることができる。従
って、プログラマブルレジスタであることが可能な抽出
回路44は、タイムスロット内のデータを受信し、ビジ
ー又は状態ビットの時間に関連したビットをその出力端
子に出力することができる。これらの出力端子は、ビジ
ービットを複号化するための2ビットのデコーダである
デコードIEC回路46に接続される。従って、デコー
ドIEC回路46の4個の出力端子は、ビジー又は状態
ビットを構成し、すなわちアイドル、ビジー、衝突状態
並びに優先又は他の第4の状態を構成する2ビットの4
個の状態を表し、上記端子は第5図に示すように対応づ
けてラベルづけされる。これらの端子に接続されるライ
ンはMAC回路37に接続される。 第6図においては、ブロック図の点線内に媒体アクセス
回路37が示され、またともに付加回路の詳細が示され
ている。第4図から再び図示されるデジタル復調器27
の出力に接続されるデータ及びクロック入力を有するビ
ジービット抽出回路32が示される。その出力線アイド
ル、ビジー、衝突及び優先は、送信機制御回路51の入
力に接続される。ビジービット抽出回路32へのクロッ
ク入力はまた、送信機制御回路51の入力に接続され
る。バス30のアドレス及び制御線は、アドレスデコー
ダ52に接続され、デコーダ52の複号化された出力は
送信機制御回路51に接続される。バス30のデータ線
D0−D7は、送信機制御回路51と同様にビジービッ
ト抽出回路32に接続される。送信機制御回路は、公知
の方法で中央プロセッサに接続される割り込み出力と、
リストア回路53に接続される送信完了線(TR.O
K)と、リストア回路からの入力と、衝突カウンタ回路
54に接続されるインクリメント衝突カウンタ出力IN
C.COLと、衝突制御回路の出力からのCOLL.E
XC入力と、レディRDY入力と、送信許可PERMI
SSION TX入力と、並びに、IECLIV(ビジ
ービット指示子)出力線と、送信オン−オフTRON/
TROFF(出力)と、VID入力と、クロックC1入
力と、INSZERO入力と、TIMEOUT入力とを
含む。送信機制御回路の詳細は第7A図及び第7B図に
ブロック図の形式で図示される。 リストア回路53は、マイクロプロセッサからのリセッ
ト入力RSTと、衝突カウンタ54の入力とバックオフ
係数回路55の入力に接続される出力とを有する。アド
レスデコーダ52、及び衝突カウンタ54の出力並び
に、インクリメント衝突カウンタ線INCCOLは、バ
ックオフ係数回路55の出力に接続される。バックオフ
係数回路55の出力はレディ線RDYを介して送信機制
御回路51に接続されるとともに、SHIFT CLO
CK線を介して確率レジスタ56の入力に接続される。
衝突カウンタとバックオフ係数回路に接続されるリスト
ア回路53の出力はまた、確率レジスタ56の入力に接
続される。 乱数発生器57はラッチ58に接続される出力を有し、
ラッチ58は、送信機制御回路51からビジービットア
イドル線を介して接続されるラッチイネーブル入力を有
する。同一の線が、コンパレータ60の比較イネーブル
入力に接続され、コンパレータ60は、ラッチ58の出
力と確率レジスタ56にそれぞれ接続される2組みの入
力を有する。コンパレータ60の出力は、送信許可線P
ERMISSION TXである。 (第4図から再び図示される)バッファ34はバス30
のアドレス及びデータ線に接続される。パラレルデータ
線34Aから構成されるバッファ34の出力は、第4図
の変調器35の一部として考えられる信号コンバータ回
路35Aの入力に接続される。回路35Aの出力はFS
K変調器35の入力に接続され、FSK変調器35の出
力はタイムアウト制御回路36に接続され、タイムアウ
ト制御回路36はフィルタ23に接続される出力線59
を有する。送信機制御回路51のTR ON/TR O
FF出力は信号コンバータ回路35A及びタイムアウト
制御回路36に接続される。ゼロが挿入されたことを示
す指示子を伝送するための線INSZEROは回路35
Aから送信機制御回路51に接続される。(第4図から
再び図示される)クロック分配器33は、変調器35、
回路35A及び制御回路51の各クロックC1入力に接
続されるとともに、同様に、8分配回路33Aを介して
バッファ34のバイトクロック入力に接続される出力を
有する。 上述された回路の動作は以下の通りである。中央プロセ
ッサは、ヘッドエンド(仮定可能フラグ、CRC及びも
し必要であればゼロ挿入のデータを除いて)並びにPR
BS変換器に送信すべきデータのパケットを形成する。
次いで、上記パケットがマイクロプロセッサからバス3
0を介してバッファ34にロードされる。送信機制御回
路51は、ロードされたバッファの一部を示すパケット
が伝送のために準備完了状態であることがバスを介して
通知される。 送信機制御回路は、ビジービット抽出回路32から受信
されるビジービットをモニタする。もしビジービットが
アイドル状態を示しているならば、乱数発生器57の出
力信号をラッチ58に出力することを停止するために、
送信機制御回路は、ラッチ58に接続されるビジービッ
トアイドル線上にコマンドを送信する。ラッチ58の出
力は、受信された数を確率レジスタ56の出力信号と比
較するコンパレータ60によって、受信される。 もし確率レジスタの数が乱数発生器の数よりも大きいな
らば、このとき伝送を可能にするためにイネーブル信号
が送信許可線PERMISSION TXに印加され
る。(ランダム発生器の出力信号を確率レジスタの出力
信号と比較することを用いることよりはむしろ、幾何学
的分配器を用いることができる。そのような分配器は、
例えばX個のタイムスロットの後に1を禁止することを
送信のスケジュールに組み込むことができ、ここで、X
は、幾何学的分配アルゴリズムを用いて確率レジスタの
値に従って発生される。) 送信許可イネーブル信号が受信されたとき(PERMI
SSION TXがオンとなったとき)、送信機制御回
路51は送信イネーブル信号をTRON/TROFF線
に印加し、また信号コンバータ回路35Aを介してデー
タを送信し始めることをバスを介してバッファ34に通
知する。 回路35Aはバッファ34から出力されるパラレル入力
信号をシリアル信号に変換し、PRBSシーケンスに変
換されたパケットに公知の方法でプリアンブル、フラ
グ、複数ビットのゼロ、フレームチェックシーケンス
(CRC)を挿入し、データを、データが最少周波数偏
移変調される変調器35を介して、さらにタイムアウト
制御回路36及び線59を介して狭いFSK信号通過帯
域フィルタ24に送信され、該フィルタ23からデータ
が同軸ケーブル2に印加される。(第4図)その間、送
信機制御回路は受信されたビジービットをモニタする。
もし送信機制御回路がビジー又はアイドルのいずれかを
検出したならば、連続して伝送を可能にする。しかしな
がら、もし送信機制御回路が衝突ビジービット信号を検
出したならば、TRON/TROFF信号が、タイムア
ウト制御回路36を停止させるとともにバッファに対し
て次の送信を始めから開始すべく再び初期化させる“禁
止”に変化させる。送信機制御回路はまた衝突カウンタ
54をインクリメントするための信号を送出する。衝突
カウンタ54の衝突の数が予め決められた衝突の最大数
(例えば16)を越えているか否かの比較を行う。もし
衝突の数がこの最大数を越えているならば、送信機制御
回路はTRCOLL線にリストア回路53に印加される
“送信衝突”信号を送出する。これに応答してリストア
回路はバックアップ係数回路55を初期化し、衝突カウ
ンタ54に0をセットするとともに確率レジスタ56に
1をセットする。またリストア回路は現在の状態を送信
機制御回路51に書き込むための信号を送信機制御回路
51に出力し、マイクロプロセッサに対して送信機制御
回路51における状態を蓄積するレジスタを読み出させ
るために、マイクロプロセッサに割り込みをかける。こ
のとき、マイクロプロセッサは、送信機制御回路51に
対して、再送信するか、待機するかなどの制御を行う。 もし衝突の数が衝突の最大数を越えていないならば、確
率レジスタ56は、衝突カウンタ56の制御のもとでバ
ックアップ係数回路55から供給されここでバックオフ
係数として参照される係数Kでデクリメントされる。確
率レジスタはバックオフ係数(例えば1、2又は3)だ
けシフトされ、レディRDY信号が、(非常に高速で1
ナノ秒以下で)送信機制御回路51に送り戻される。こ
のとき送信機制御回路51は次の組みのアイドルビジー
ビットを待機しこのプロセスを繰り返す。 上記確率の変更は伝送の可能性を減少させる。従って、
ネットワークにおけるトラフィック量が増加していると
き衝突が増大し、任意の加入者局による伝送の確率が減
少され、自動的にトラフィックを制御することができ
る。衝突を生じさせるある最大数を越えてネットワーク
にアクセスを試みる加入者局が増加すると、ネットワー
クに対する各局のアクセス速度がさらに減少する。 送信機制御回路の詳細な動作について、図式的な構造を
図示する第7A図及び第7B図を参照して以下に説明を
行う。マイクロプロセッサからフリップフロップ65の
D入力に接続されるRQTRAM入力線は、フレームが
バッファ34にロードされていることを示すためにマイ
クロプロセッサによってオンにセットされ、送信の準備
完了状態となる。アイドル線がビジービット抽出回路3
2からパルスを受信するとき、該パルスは、アンドゲー
ト66の第2の入力に接続されるRDY線がオンである
という条件のもとでアンドゲート66をイネーブルす
る。RDY線は、衝突カウンタのインクリメントの時間
中を除いてバックオフ係数回路55によってオンに保持
され、衝突の検出に続いて、確率のバックオフのプロセ
スが行なわれる。 その結果アンドゲート66から出力される出力パルス
が、(コンパレータ58から出力される送信許可線から
の入力PERMTXがオフであると仮定しているとき)
オアゲート67を通過し、フリップフロップ65を動作
状態にさせる。フリップフロップ65のQ出力はフリッ
プフロップ68のD入力に接続され、フリップフロップ
68がまた動作状態とされる。その結果、ビジービット
アイドル線をオンにセットする。このビジービットアイ
ドル線がラッチ58及びコンパレータ60の各イネーブ
ル入力に接続されているので、乱数発生器57の出力が
ラッチされ、レジスタ56から出力される確率値と比較
される。もし乱数発生器の出力が確率レジスタにおける
伝送値の確率よりも小さいか又は等しいならば、許可送
信線PERMTXがオンにセットされる。 もし許可送信線PERMTXがオンであるならば、これ
によって信号がオアゲート67を通過することを妨げ、
アイドル線上の任意の別の動作の信号がアンドゲート6
6を通過することを妨げる。しかしながら、許可送信線
PERMTXがオンとなるとき、TRON/TROFF
線とフリップフロップ70のデータ入力に接続されるQ
入力を有するフリップフロップ69を動作状態とさせ
る。従って、フリップフロップ69のQ出力は、送信を
開始させるための、TRON/TROFF線上の送信オ
ン又は送信オフ信号を確立させる。 フリップフロップ68の出力はアンドゲート71を介
してフリップフロップ65をリセットするために用いら
れる。 もし乱数発生器の出力信号が確率レジスタの値の数より
も大きいならば、このとき送信許可線PERMTX信号
がオフのままとなり、アイドル線上の次のビジービット
アイドル信号がアンドゲート66を通過することを可能
にさせる。 もし上述のプロセスの結果TRON線上の信号がオンと
なるならば(フリップフロップ69のQ出力がオンとな
るならば)、このときTRON信号が信号コンバータ回
路35A及びタイムアウト制御回路36に印加されると
ともに同様にバッファ34に印加されているので、送信
可能状態となる。その間、もしビジービット抽出回路3
2からの衝突線COLL上の信号が衝突が生じていない
ことを示しているならば、バッファにおける最後のバイ
トが送信されるまで伝送が続けられる。これに続いて、
バッファ34から入力されるVID線上の信号がオンと
なり、この信号は最後のビットがタイムアウト回路36
からネットワークに立ち去ることを可能とするための計
数プロセスを開始させる。VID線は、オアゲート73
を介してカウンタ72の入力に接続されるため、フリッ
プフロップ70の線を介してモジュロ32カウンタ7
2をイネーブルする。上記計数動作に続いて、カウンタ
72はフリップフロップ73Aを動作状態とさせ、該フ
リップフロップ73AはTROK線上の信号をハイにセ
ットさせ、このハイ信号がフリップフロップ74のクロ
ック入力に印加され、従ってその状態が保持される。T
ROK線はまたノアゲート75の1つの入力に接続さ
れ、ノアゲート75の出力はフリップフロップ69のリ
セット入力に接続される。従って、フリップフロップ6
9がリセットされたとき、TROFF線を、信号コンバ
ータ回路35A、タイムアウト制御回路36及びバッフ
ァ回路をリセットする状態に、変化させる。もし衝突が
生じたとき、ビジービット抽出回路32から接続される
COLL線はハイとなる。このCOLL線はノアゲート
75の他の入力に接続されるので、COLL線がハイと
なるとき、フリップフロップ69の状態が変化し、該フ
リップフロップ69のQ出力がオフとなる。これによっ
て、TRON/TROFF線がオフとなり、このオフ信
号は再び信号コンバータ回路35A、タイムアウト制御
回路36及びバッファ34をリセットする。さらに、イ
ンクリメント衝突信号が、アンドゲート76の1つの入
力に印加されるCOLL信号によってINCCOLL線
上に発生され、(もし送信中であるならば、フリップフ
ロップ69のQ出力はハイとなる。)ここで、フリップ
フロップ69のQ出力がアンドゲート76の他の入力に
接続される。INCCOLL線は第6図において参照さ
れる衝突カウンタ54に接続される。従って、衝突カウ
ンタはインクリメントされる。INCCOLL線はRD
Y線上のRDY信号をオフにさせる。このRDY線はア
ンドゲート66の第2の入力に接続される。その結果、
生じた衝突の数のチェックが行なわれるまで、ビジービ
ットアイドル線上の任意の信号レベルが抑制され、もし
衝突の数が上記最大数を越えていないならば、確率レジ
スタのシフトによって確率係数がバックオフされる。こ
のプロセスが完了したとき、RDY信号がオンにセット
され、IDLE線上のアイドルビジービットの到着に応
答してビジービットアイドル線が能動状態になることが
可能になる。もし衝突の数が上記最大数を越えていない
ならば、この状態は、後述されるように送信機制御レジ
スタR5において保持される。 衝突カウンタ54(第7B図)から出力されるCOLL
EXC線はフリップフロップ77のクロック入力に接続
される。フリップフロップ74及び77のQ出力はとも
にオアゲート78の入力に接続され、該オアゲート78
の出力は割り込み線INTRである。従って、もしTR
OK線上において衝突状態とならず伝送が完了するなら
ば、もしくは衝突の数がCOLLEX線上において越え
るならば、割り込み信号がゲート78を介してINTR
線に現れる。マイクロプロセッサにおけるこの割り込み
線はCPUに対して送信機制御回路の状態をチェックさ
せる。INTROK線によって示されているフリップフ
ロップ74のQ出力と、INTREXC線によって示さ
れているフリップフロップ77のQ出力を、マイクロプ
ロセッサによるチェックを行うためのレジスタに接続す
ることが可能である。INTREXC線上のオン信号は
衝突数が予め決められた値を越えたことを示しており、
INTROK線上の信号は伝送が衝突なしに完了したこ
とを示している。ノアゲート81は、カウンタ72とフ
リップフロップ70のリセット入力に接続される出力を
有するとともに、COLL線に接続される1つの入力
と、インバータ80に接続されるもう1つの入力を有
し、ここで、インバータ80がRSTO線とアンドゲー
ト71の1つの入力に接続される入力を有する。このこ
とは、フリップフロップ70とカウンタ72が、COL
L信号がハイ又はRSTO上のリセット信号がハイとな
ったときにリセットされないことを確立している。 上記回路への他の入力線は、オア回路73に接続される
クロックC1、オアゲート73に接続されるINSZE
RO線、並びに(マイクロプロセッサから接続される)
RST線からオアゲート79を介してフリップフロップ
74及び77のリセット入力に接続されるリセット線、
及びバスから接続されるLRCTRL線である。リセッ
トクロック及び挿入ゼロ入力は、上述の記述を理解する
当業者によって理解され、さらに説明を行う必要はな
い。 従って、上記回路は明らかに、ヘッドエンドからすべて
の加入者端末に出力されるビジービットを受信するのに
応答して、ヘッドエンドへの出力信号の伝送における加
入者端末の動作を制御する。この制御はまた明らかに、
伝送の前に、ネットワークによって伝送されるトラフィ
ック密度を制御する待機時間を確立する。トラフィック
密度が制御され、ネットワークを捕捉して受信機からデ
ータ信号を信頼して受信することが確実になったとき、
信頼できる上りの伝送を行うことができることがわかっ
た。 上述の記述を理解する当業者はここで記述された原理を
用いて設計における変形例を考えるかもしれない。すべ
ては、上述した特許請求の範囲において定義される発明
の範囲内であると考えられる。 [発明の効果] 以上詳述したように、本発明によれば、2方向伝送ネッ
トワークを備えた2方向ケーブル通信システムにおい
て、各加入者局から送信される信号間で衝突が生じたと
しても、当該衝突をヘッドエンドで検出して、衝突を示
す衝突信号を上記各加入者局に送信することができ、こ
れによって、上記各加入者局は送信を停止し再送信のタ
イミングを調整することができる。
しくは、多くの加入者局がヘッドエンドに上りのデータ
信号を伝送することができる伝送システムに関する。 [従来の技術及び発明が解決しようとする課題] ケーブル伝送システムは典型的には、ブランチに接続さ
れるスプリッタを介してドロップ回線に接続される加入
者端末を有し、トランクから主トランクとブランチを含
むトリータイプのネットワークにおいて、種々の下りの
テレビジョン信号を伝送する。典型的なネットワーク
は、上記信号を予め決められた最小レベルの上側に配置
することを維持するために、ネットワークに沿って間隔
をおいて設けられた中継増幅器を有する同軸ケーブルか
ら構成される。 プログラムの選択及びポーリングの応答などのために、
サービスの要求に応じてヘッドエンドへの上りの伝送の
ために、信号を加入者端末から出力させることを可能に
することが目的とされてきた。しかしながら、以下に記
述する種々のプログラムはサービスの提供を成功させる
ことを妨げ、これによって、信号が加入者端末から出力
されネットワークを介してヘッドエンドへ上り方向で通
過する。従って、そのようなシステムは、例えば電話シ
ステム又は単に疑似会話型システムのような分離した伝
送ネットワークを利用し、これらのシステムにおいて
は、すべてのプログラム又は情報信号が加入者端末に入
力され、上記プログラム又は情報が、上記端末で選択さ
れる。両方の場合において加入者端末から出力される信
号は、上記システムの上り回線を通過しないようになっ
ている。 2つの非常に重要な問題点が同一のCATVネットワー
クを介して2方向通信を成功させることを妨げていた。
同一の周波数帯域内で上りの伝送の可能性を有する典型
的に何千の加入者端末が存在するとき、いくつかの端末
が同時に送信を行う可能性が大きい。その結果、ヘッド
エンドにおいて、1つの加入者端末から受信される信号
が、同時に送信する他の加入者端末から受信される信号
によって汚損を受ける。ヘッドエンドから種々の異なっ
た線路長(伝送距離)に位置する種々の加入者端末から
信号が送信されるシステム内における種々の時間遅延の
存在によって、この問題が一層悪化される。 第2の問題点は雑音集合の問題である。種々のブランチ
から1つのトランクに送出される多数の上り回線の雑音
が集合し、この雑音はしばしば1つの加入者端末によっ
て伝送される信号レベルよりも極めて高くなる可能性が
あることが認識されるであろう。上り方向で増幅が試み
られる際に上記システムにおける2方向増幅器の入力に
例えば雑音などのどんな信号が入力されても増幅が行な
われるために、上記2方向増幅器を用いたことによって
上記問題点が増大する。そのような増幅器は典型的に
は、最少の信号の時間において最大の利得で動作する自
動利得制御を用いるので、すべてのブランチから上記増
幅器に出力される最大の雑音が収集されて出力される。 [課題を解決するための手段] 本発明は、種々の加入者端末からヘッドエンドに同時に
到達する信号間の衝突の問題を実質的に減少又は除去さ
せるケーブル伝送システムである。雑音集合の問題点を
実質的に減少又は除去させるための手段がまた開示され
る。 本発明のケーブルシステムにおけるヘッドエンドは、通
常のCATVシステムにおけるテレビジョン信号を提供
するのみならず、分離した下りのデータチャネルにおい
てデータ信号を伝送する。データチャネルにおける信号
はタイムスロットに分割されたパケットで伝送され、こ
こで、上記タイムスロットはここで状態バイトとして参
照されるデータの特別なバイトによって分離される。上
記状態バイトは、ここで“ビジービット”として参照さ
れる複数のビットで形成される。 下りのデータ信号は独立したチャネルを用いて上記テレ
ビジョン信号と周波数多重され、ネットワークを介して
加入者端末に下り方向で伝送される。加入者端末はそれ
ぞれ、ビジービットを検出し複号化した後、ネットワー
クがアイドル状態又はビジー状態であるか、もしくは衝
突が生じているか、もし所望されるならば優先レベルが
存在するかを決定する。もし各加入者端末が伝送すべき
データを有しているならば、各加入者端末はある確率係
数でヘッドエンドに上記データを送り戻す。端末が連続
的に受信するビジービットが衝突を示す(これは、もう
1つの加入者端末が伝送を行い、そのデータ信号を汚損
していることを示す。)か否かに存在して、上記確率係
数が修正される。もし衝突が検出されるならば、上記確
率係数が変化され、加入者端末は、確率係数に従属な時
間で汚損されたタイムスロットからデータを再び伝送す
る。 伝送を行う加入者端末はまた、衝突と、すなわちビジー
ビットで示された衝突の数を計数する。もし、衝突の数
が予め決められたしきい値を越えたならば、該加入者端
末は上記確率係数を再び利用し、新しい確率係数で制御
される時間で全体のデータシーケンスを再び伝送する。 もし任意の加入者端末が受信するビジービットがネット
ワークが上り方向でビジーであることを示しているなら
ば、上記任意の加入者端末は伝送することを抑制され
る。従って、衝突の効果は、ビジービットが上りのデー
タチャネルがアイドル状態であることを示す次の時間で
生じ、加入者端末が上りのチャネルが捕捉されすなわち
ビジ−であることを示すヘッドエンドからのビジービッ
トを受信する時間の前に、1つ以上の加入者端末によっ
てデータの伝送が開始される。このように、衝突の効果
は、典型的には、チャネルがアイドル状態であるとき、
1つ以上の加入者端末によって新しい伝送を開始する初
期において生じ、トラフィック量が増加するとき、上記
衝突の効果が増大する。 伝送係数の確率は、システム内の種々の加入者端末から
伝送される信号に対する異なった時間遅延の可能性と関
連させた乱数発生器を用いて変化され、もし確率係数が
各加入者端末において同一の方法で変化されるときに比
べて、1つ以上の加入者端末が同時に伝送を行う可能性
を減少させている。さらに、衝突の数は1つの加入者端
末が伝送を可能にする減少された確率を生じさせるの
で、トラフィック量が大きくなるにつれて、加入者端末
が伝送するためのより長いランダムな時間だけ待機する
ことを自動的に生じさせる可能性が大きくなる。従っ
て、上記システムは増加するトラフィック量を自動的に
補償しかつ調整している。 雑音集合の問題点は実質的には、ネットワークの各ブラ
ンチの上り方向において、各加入者端末に対して間隔が
置かれた2つの周波数で変調を行う周波数偏移変調を用
いてそのデータを伝送させ、かつ2つの周波数を通過さ
せるのにちょうど十分な2つの通過帯域を有する狭帯域
通過フィルタを用いることによって、解決される。下り
のデータ信号は影響を受けない。従って、フィルタは、
上り回線からヘッドエンドに通過する2つの狭い通過帯
域における少量の雑音を除くすべての雑音を事実上遮断
する。上記フィルタは好ましくは、信号を通過させるた
めに又は上りの信号の受信に応答してフィルタを制御可
能に切り換えるように、遠隔でアドレス割り当て可能で
ある。この構成は、雑音集合をうまく防止することがわ
かった。 従って、2方向ケーブルシステムにおける上り信号の衝
突と雑音集合の従来技術の問題が実質的に解決される。 簡潔に言えば、本発明、ヘッドエンドと、上記ヘッドエ
ンドに接続され上記ヘッドエンドから複数の加入者局に
下りの信号を伝送するためであって加入者局からヘッド
エンドに上りのデータ信号を伝送するための2方向伝送
ネットワークを備えた方向性ケーブル通信システムであ
る。上記ヘッドエンドにおける回路は、加入者局から受
信される信号間の衝突を検出して衝突信号を発生し、上
記ヘッドエンドにおける別の回路は、伝送システムの下
り回線に衝突を示すデータ信号の状態バイトを伝送し、
加入者局によるその検出に応答して、伝送を終了するこ
とを可能にすることができる。 好ましくはヘッドエンドの衝突検出器はまた信号が任意
の加入者局から受信されたか否かを検出するためであっ
てそれぞれビジー又はアイドル状態バイト信号を発生す
るための装置を含み、上記バイト伝送回路は、衝突状
態、アイドル状態、又はビジー状態を示すデータ信号の
バイトを発生する。 データの状態バイトは下りのデータ信号のタイムスロッ
トと分離して伝送すべきことがまた好ましく、ここで、
下りと上りの両方向でネットワークの最長の遅延された
エンドに対する伝送ループにおけるすべての構成要素の
遅延時間の和である最大往復伝搬遅延時間は、少なくと
も上記伝搬遅延時間と同様の長さであるべき連続する状
態バイト間の時間周期を定義している。 本発明はまた、信号の衝突、ビジー又はアイドル及び好
ましくは優先を含むネットワークの状態を示す状態バイ
トを備えた2方向伝送ネットワークからデータ信号を繰
り返し受信するための装置と、上記ネットワークを介し
てヘッドエンドに伝送すべきデータ信号を定式化し記憶
するための装置と、上記ネットワークを介してヘッドエ
ンドにデータ信号を伝送するための装置と、上記伝送す
るための装置を制御するための装置を備えた2方向ケー
ブル通信システムにおいて用いるための加入者端末であ
って、上記制御するための装置は、上記状態バイトを受
信するためであって予め決められた確率Pでデータ信号
の伝送を可能にするための装置と、受信された信号衝突
状態信号の数を計数するためであってこれに応答して確
率Pを調整するための装置を備える。 上記制御するための装置は、もし受信された信号衝突状
態信号の数がある予め決められた最大数を越えるならば
時間周期の間伝送を禁止し、これに応答して完了データ
信号の再伝送を再び初期化することが好ましい。 [実施例] 第1図は本発明による2方向ケーブル通信ネットワーク
を図示している。しかしながら、本発明は、星型ネット
ワーク、ローカルエリアネットワーク、又はその他の種
類のネットワークにおいて用いることができる。本実施
例において、システムは、複数の加入者端末3を有する
例えば同軸ケーブルのような広帯域通信媒体を介して通
信を行うヘッドエンド1を備える。上記端末とヘッドエ
ンド1は、例えば公知のトリー型ネットワークのような
あるネットワークを介して通信を行うが、もう1つの形
式の非ループネットワークであることが可能である。ト
リー型ネットワークは、加入者端末へのドロップ回線
(図示せず。)を介して接続された2方向増幅器4とス
プリッタ5を備える。上記ネットワークは公知の方法で
整合用インピーダンス6で終端される。 記述の簡単化のために、ただ1個の加入者端末3が示さ
れている。しかしながら、加入者端末を、公知の方法で
ネットワークに沿って分配されて設けられるスプリッタ
に接続することが可能であることは明らかである。 従来のネットワークにおいて、増幅器4は下り方向の1
方向性を有し、これによって、増幅器4は複数のテレビ
ジョンチャネルを伝送する。しかしながら、本発明は、
またデータ信号を伝送する種類のネットワークに注意が
払われている。そのような信号は、コンピュータで発生
された画像、コンピュータプログラム、デスクランブラ
のための制御信号などに再構成すべきデータ信号を伝送
するネットワークにおいて提供されてきた。そのような
データ信号は時々テレビジョンチャネルの垂直インター
バルにおいて伝送されるが、本発明においては、上記デ
ータ信号が独立した高速度データチャネルを用いて伝送
される。従って、上記増幅器4は、下り方向でデータチ
ャネルを伝送する能力を有すべきである。 特定のサービスを提供するために、加入者端末3は典型
的には、信号を発生させ、結局、上りの回線を介してヘ
ッドエンドに伝送すべきコマンド又は他のデータ信号を
発生させるキーボードを有する。幾つかの問題点は、こ
の上りの伝送によって特徴づけられ、その結果、もし任
意のそのような実際のシステムが存在するならば、ほと
んどの問題点が特徴づけられない。本発明は、多数の加
入者端末から上りのデータを確実に伝送するための手段
を提供する。しかしながら、2方向増幅器4はまた上り
方向で加入者端末から受信されたデータ信号を伝送する
能力を有すべきことを言うべきである。そのような増幅
器4が存在し、本発明は、明確にそれらに注意を払って
いない。 上りの伝送と関連する問題は、雑音集合とデータ衝突を
含む。雑音集合は、すべての雑音がシステムの主トラン
ク又はポートに出力される、例えばトリー型ネットワー
クの多数のブランチから雑音が発生することを意味す
る。この雑音は各増幅器によって増幅され、その結果、
ヘッドエンドにおいて過度の雑音レベルが生じる。 1つ以上の加入者端末が、ヘッドエンドにおいてやがて
重畳されて到達する上り方向のデータ信号を伝送すると
き、データの衝突が存在する。これによって、明らか
に、重畳するすべてのデータ信号の改変が生じる。 雑音集合を防止する問題に対する解決が、本発明の目的
ではない。本発明において、衝突の問題は、ヘッドエン
ドから下り回線を介して加入者端末に伝送されるいわゆ
る“ビジービット”の使用によって、解決される。2ビ
ットのビジービットのバイトは、ビジー又はアイドルで
あるチャネルの性質を定義している。もちろん、2ビッ
トは、4つの異なった状態、すなわち、アイドル、ビジ
ー、衝突、並びに優先指示又は他の情報として用いるこ
とが可能な第4の状態を定義することができる。しかし
ながら、もし所望されるならば、他の数のビジービット
を用いることができる。 一般に、上記ヘッドエンドは、好ましくはクーリエ(cou
rier)の振幅変調を用いてアイドルチャネルを示すビジ
ービットを規則的な基礎をおいて伝送する。もしヘッド
エンドがデータ信号を受信するならば、ヘッドエンドは
ビジー状態を定義するためにビジービットのキャラクタ
を変化させる。データの解析において、ヘッドエンドは
受信されたデータ信号間の衝突を検出し、もしそのよう
な衝突を検出するならば、ヘッドエンドは衝突状態を示
すためにビジービットを変化させる。 一方、加入者端末は、上りのデータを好ましくは(例え
ばMSKなどの)周波数偏移変調の形式で伝送する。加
入者端末は、絶えず下りのビジービットをモニタし、チ
ャネルがアイドル状態であると示されるとき(伝送すべ
きいくつかのデータが存在すると仮定する。)、伝送を
行う。もし伝送中において加入者端末がビジービット間
の衝突を検出したならば、伝送を停止し、後述されるよ
うにある時間周期の間待機を行った後、信号を再び伝送
する。 トランクにおける雑音を最少化するために、フィルタ7
は分配ネットワークの種々のブランチと直列に接続さ
れ、各フィルタは、上りの周波数偏移データのための鋭
い特性を有する狭い通過帯域を有し、各フィルタは伝送
の上り方向に接続される。これによって、フィルタの帯
域幅の雑音を除いて、すべての上りの雑音を減少させ
る。上りのデータの伝送特性を改善するために、好まし
くは、フィルタがフィルタの実際の帯域幅において上り
の搬送波信号の存在を検出するまで遮断状態のままであ
るフィルタが用いられ、上記上りの搬送波信号の検出す
るのに応答して、フィルタは例えば数マイクロ秒以内の
高速で開放状態となり、上りのデータ信号を通過させる
ことを可能にする。さらに、上記フィルタは、ネットワ
ークの保守の目的のために、ヘッドエンドから開放又は
閉鎖状態にアドレス割り当てされることが可能である。
上記フィルタは下り方向でトランスペアレントであり、
すなわち、テレビジョン信号及び下りのデータ信号が下
り方向でこれらのフィルタを通過する。 ヘッドエンド内において、テレビジョン信号の信号源が
変調器8に接続され、この変調器8は、チャネルフィル
タ9を介して同軸ケーブルに接続される出力を有する。
このように、テレビジョン信号は、従来技術と同様にネ
ットワークに印加される。 受信帯域通過フィルタ10は同軸ケーブル2に接続され
る入力と、データ復調器11に接続される出力を有す
る。従って、加入者端末3から伝送される周波数変調さ
れたデータが復調器11から出力される。 また、衝突検出器12はフィルタ10の出力に接続され
る。衝突検出器12は、好ましくは包絡線検波の手段に
よって重畳するビットの存在を検出する。そのタイプの
衝突検出は非常に高速であるので、上記衝突検出は好ま
しくは広帯域でなされる。 衝突検出器12内のロジックはまた、上述で参照された
4つの状態、すなわちアイドル、ビジー、衝突並びに優
先又は未定義を示すビジービットとしてここで参照され
たビットの組みを提供する。IEC又はチャネル状態指
示子として示されたこれらのビットは、通信コントロー
ラ13に印加される。ここで、ビジービットは変調器8
に印加される下りのデータ列にインターリーブ(多重
化)される。変調器8は結合されたデータ列を高速度デ
ータチャネルに印加し、そのチャネルの出力は、上述し
たようにテレビジョン信号源として参照されて取り扱わ
れる。 ビジービットは好ましくは、時間に対する下りのデータ
列を図示する第2図で示されるように、各タイムスロッ
トの最初において、周期的に1秒当たり4Mビットで下
りのチャネルを介して送信される。従って、矢印18に
よって図示されたビジービットは、各タイムスロットの
時間周期を示している。例えばそれぞれ128ビット、
256ビット、512ビット、1024ビットを含む上
記タイムスロットを、ヘッドエンドでプログラムするこ
とができ、例えばビット周期は好ましくは0.25マイ
クロ秒である。上記タイムスロット内で送信される下り
のデータは、参照番号19として示される。 通信コントローラはまた、下りのデータパケットがネッ
トワークのビジー又は衝突状態中において伝送されない
ことを確実にしている。もし送信機が長い周期にわたっ
て送信しているならば、例えばもし予め決められた最大
のパケットの大きさにわたって送信しているならば、通
信コントローラはまた送信機をオフに切り換える。この
ように、送信機はロック状態になりタイムアウト状態に
なる。 ビジービットの連続する組みの伝送を区分する時間の周
期は、ネットワークの最大往復伝搬遅延時間に等しいか
又は長くすべきことが重要である。この遅延時間は、両
方向においてネットワークの最長に遅延されたエンドに
最初に到達する最大ケーブル長を有する伝送ループを構
成するすべての構成要素の遅延時間の和である。 ヘッドエンドから送信される各データパケットは好まし
くは、1個のタイムスロットの周期に等しいか又は長く
すべきである。典型的なパケットフォーマットが第3図
において図式的に示される。この典型的なパケットフォ
ーマットは例えば、次のように構成される。すなわち、
2ないし7バイトのプリアンブル、これに続いて1バイ
トのスタートフレームデリミタ、これに続いて4バイト
の目的地アドレス、これに続いて4バイトのソースアド
レス、これに続いて2バイトのフレーム長指示子、これ
に続いて伝送されるべきデータを含む制限された数のバ
イト、これに続いて(もし必要であるならば)制限され
た数のパディングバイト、これに続いて2バイトのフレ
ームチェックシーケンスの順序で構成される。 第4図は、第1図で示された加入者端末3の好ましい形
式のブロック図を図示している。ネットワークに接続さ
れる同軸ケーブル2は、(フィルタ9と同様である)下
りの帯域通過フィルタ22と上りの帯域通過フィルタ2
3の両方に接続され、後者の上りのフィルタ23は、加
入者端末で発生すべき周波数偏移変調された出力信号の
2つの周波数を通過させるのにちょうど十分な2つの狭
い通過帯域を形成することが可能である。 フィルタ22の出力はスプリッタ23Aを介してテレビ
ジョンチューナ/アナログ回路24に伝送される。回路
24は、同調可能なダウンコンバータとペイテレビジョ
ンデスクランブラ又はその他の同種類のものから構成し
てもよい。回路24の出力は、テレビジョンセット26
に印加するために変調器25に印加される。 フィルタ22の出力はまたスプリッタ23Aを介してデ
ジタル復調器27の入力に接続され、該復調器27はデ
ジタルチャネルにおけるデータ列を復調する。デジタル
復調器27は、公知の方法で対応する出力ライン上にデ
ータ及びクロック出力信号を出力する。これらの信号
は、公知の方法でパラレル信号に変換されるCAD回路
を介して印加され、さらに中央プロセッサ/メモリ回路
29のデータ及びクロック入力に印加される。データ及
びアドレスバス30は上記中央プロセッシング装置/メ
モリ回路29と通信を行う。加入者端末と関連する他の
周辺デジタル回路31はまた、例えばビデオディスプレ
イジェネレータを制御するために、またアラーム回路を
モニタするなどのために、中央プロセッシング装置/メ
モリ回路29に接続される。 デジタル復調器におけるデータ及びクロックライン出力
はまた、ビジービット(IEC)抽出論理回路32の対
応する入力に接続され、またこの対応する入力はバス3
0に接続される。N分配回路33はクロックラインに接
続され、その出力はクロック信号C1である。従って、
N分配回路はクロックラインから内部クロック信号C1
を発生し、このように下りのデータ信号からクロック信
号の発生が所望される。 ヘッドエンドに伝送するためのプロセッサ回路29から
データ信号を受信するために、バッファ34がバス30
に接続される。バッファ34から出力される出力信号を
上りのデータチャネルの通過帯域内で周波数偏移変調信
号に変調するために、バッファ34の出力が、周波数偏
移変調器35に接続される。変調器35の出力は、上り
の信号の伝送間隔を制御するタイムアウト回路36を介
して印加される。タイムアウト回路36の出力は、上り
の帯域通過フィルタ23に印加され、上記フィルタ23
の出力は、ヘッドエンドに伝送するために同軸ケーブル
2に印加される。 媒体アクセス管理伝送論理回路37(以下、MAC回路
という。)(制御手段)はバス30に接続され、ビジー
ビットを受信するために抽出論理回路32に接続される
他の入力を有する。MAC回路はまたバッファ34の制
御入力並びにタイムアウト回路36の制御入力/出力に
接続される。このMAC回路の目的は、ビジービットを
モニタすることによってネットワークのビジー、アイド
ル、又は衝突状態を検出することと、バッファ34に蓄
積された信号をヘッドエンドに伝送することとこの伝送
のタイミングを制御することにある。 デジタルチャネル信号がヘッドエンドからケーブル2を
介して受信され、フィルタ22においてろ波された後、
デジタル復調器27に印加される。復調後に得られるデ
ータ及びクロック信号はプロセッサ29に印加される。
他のデジタル回路31を介して動作するキーパッド又は
他の手段は、他のデジタル回路31に対してヘッドエン
ドに伝送するためのデータ信号を定式化させるためにプ
ロセッサ29を通信を行う。CPU/メモリにおいてこ
れらの信号を定式化するための機構は当業者に公知であ
る技術を用いることができるので、本発明の目的ではな
い。信号が定式化されたとき、信号は、バス30を介し
て信号が蓄積されるバッファ34の入力に通過されると
いえば、十分である。 IEC抽出論理回路32は、復調器27の出力のデータ
及びクロックライン上のビジービットを検出する。ビジ
ービットはMAC回路37に出力される。 MAC回路37は、後述される内部アルゴリズムを用い
て動作する。もしMAC回路がビジーチャネル又は衝突
示すビジービットを受信したとき、次のビジービットが
到着するまで待機し、ビジービットの状態を連続してモ
ニタする。もしビジービットがチャネルが空き状態であ
ることを示しているならば、MAC回路は、確率Pで伝
送することを決定し、もしくは確率(1−P)で伝送し
ないことを決定した後、次のビジービットの組みが到着
するまで待機し、次いで、伝送調整アルゴリズムの確率
で動作するであろう。 MAC回路が伝送を行うことを決定したとき、制御信号
をバッファ34に印加し、これによってバッファ34に
対してその蓄積されたパケットを出力することを開始さ
せる。同時にMAC回路はビジービットをモニタする。
上記回路が伝送中においてもし衝突を示すビジービット
が受信されるならば、これは同一の時間周期において1
局以上の他の送信機が伝送中であることを意味し、上記
MAC回路は、その伝送を停止すべくバッファ34をす
ぐに制御する。上記MAC回路内の衝突カウンタはまた
インクリメントされる。 もし衝突カウンタで示される衝突数がある予め決められ
た最大数を越えているならば、全体のパケット伝送プロ
セスが停止される。上記パケットはバッファ34に戻さ
れ、ここで、MAC回路によって制御される再伝送の前
に、該パケットはある時間周期だけ待機状態となる。 もしすでに生じた衝突の数が最大数よりも大さければ、
パケットの伝送確率Pは、係数Kで(ここで、P=P/
K)、最少再伝送確率値に約分される。このとき、上記
MAC回路は、次の組みのビジービットまで待機状態と
なり、さらに、次の組みのビジービットの検査を繰り返
す。 もし次の組みのビジービットが衝突を示していないなら
ば、加入者局自身は伝送中であるので、上記次の組みの
ビジービットは必ずビジー状態を示すであろう。このこ
とは、ローカルの加入者端末が単にチャネルを捕捉して
いることを意味する。伝送が再び初期化され、パケット
の最後まで連続的に伝送が行なわれた後、チャネルが空
き状態になったことが宣言されるであろう。このとき、
衝突カウンタはゼロに初期化され、その伝送確率Pが1
にされる。 第4図の抽出論理回路32とMAC回路37が詳細後述
される。第5図に、ビジービット抽出論理回路32のブ
ロック図が図示される。データ及びクロックラインは、
もし下りのデータ信号がスクランブルされて受信される
ならば必要に応じてデスクランブルするためのデスクラ
ンブラ回路40に接続される。デスクランブラ40は、
通信コントローラ13(第1図)の一部として含まれる
ことが可能であるヘッドエンドのスクランブラのミラー
イメージ回路である。デスクランブラ40の出力信号
は、ビットカウンタ41のデータ及びクロック入力に印
加されるクロック及びデータ信号である。ビットカウン
タ41のカウンタ出力は、カウンタ41の内容からパケ
ットの始まりを決定するとともに受信されたデータパケ
ットの始まりの存在を示すパルス又はパルスの立ち上が
りエッジをIND出力に出力するフラグ決定回路42に
接続される。 ビットカウンタ41のデータ及びクロック出力はゼロ抽
出回路43に接続される。この回路43は、すべて1か
ら構成される長いバイトの値を区別するためにヘッドエ
ンドにおける通信コントローラ13で挿入されるゼロを
取り除くために公知の方法で用いられる。従って、ゼロ
抽出回路43は元のデータを再構成する。この訂正され
たデータは、状態バイト抽出回路44に印加される。 上記訂正されたデータ信号はまたカウンタ及びインター
バル制御回路45に印加され、該回路45はアドレスバ
スADDR及びデータバスD0−D7を介してバス30
に接続される。 バス30は上述されたようにプロセッサ29に接続され
る。上記タイムスロットの間隔はCPUによって決定さ
れてそのメモリにおいて記憶され、このデータはバス3
0を介して回路45に送信され、このデータはとって代
わって抽出回路44のCTRLライン上の制御信号とな
る。上記タイムスロットは、受信されたパケットのチェ
ックサムがマッチング状態となるまで抽出回路における
間隔を変化することによって見つけることができる。従
って、プログラマブルレジスタであることが可能な抽出
回路44は、タイムスロット内のデータを受信し、ビジ
ー又は状態ビットの時間に関連したビットをその出力端
子に出力することができる。これらの出力端子は、ビジ
ービットを複号化するための2ビットのデコーダである
デコードIEC回路46に接続される。従って、デコー
ドIEC回路46の4個の出力端子は、ビジー又は状態
ビットを構成し、すなわちアイドル、ビジー、衝突状態
並びに優先又は他の第4の状態を構成する2ビットの4
個の状態を表し、上記端子は第5図に示すように対応づ
けてラベルづけされる。これらの端子に接続されるライ
ンはMAC回路37に接続される。 第6図においては、ブロック図の点線内に媒体アクセス
回路37が示され、またともに付加回路の詳細が示され
ている。第4図から再び図示されるデジタル復調器27
の出力に接続されるデータ及びクロック入力を有するビ
ジービット抽出回路32が示される。その出力線アイド
ル、ビジー、衝突及び優先は、送信機制御回路51の入
力に接続される。ビジービット抽出回路32へのクロッ
ク入力はまた、送信機制御回路51の入力に接続され
る。バス30のアドレス及び制御線は、アドレスデコー
ダ52に接続され、デコーダ52の複号化された出力は
送信機制御回路51に接続される。バス30のデータ線
D0−D7は、送信機制御回路51と同様にビジービッ
ト抽出回路32に接続される。送信機制御回路は、公知
の方法で中央プロセッサに接続される割り込み出力と、
リストア回路53に接続される送信完了線(TR.O
K)と、リストア回路からの入力と、衝突カウンタ回路
54に接続されるインクリメント衝突カウンタ出力IN
C.COLと、衝突制御回路の出力からのCOLL.E
XC入力と、レディRDY入力と、送信許可PERMI
SSION TX入力と、並びに、IECLIV(ビジ
ービット指示子)出力線と、送信オン−オフTRON/
TROFF(出力)と、VID入力と、クロックC1入
力と、INSZERO入力と、TIMEOUT入力とを
含む。送信機制御回路の詳細は第7A図及び第7B図に
ブロック図の形式で図示される。 リストア回路53は、マイクロプロセッサからのリセッ
ト入力RSTと、衝突カウンタ54の入力とバックオフ
係数回路55の入力に接続される出力とを有する。アド
レスデコーダ52、及び衝突カウンタ54の出力並び
に、インクリメント衝突カウンタ線INCCOLは、バ
ックオフ係数回路55の出力に接続される。バックオフ
係数回路55の出力はレディ線RDYを介して送信機制
御回路51に接続されるとともに、SHIFT CLO
CK線を介して確率レジスタ56の入力に接続される。
衝突カウンタとバックオフ係数回路に接続されるリスト
ア回路53の出力はまた、確率レジスタ56の入力に接
続される。 乱数発生器57はラッチ58に接続される出力を有し、
ラッチ58は、送信機制御回路51からビジービットア
イドル線を介して接続されるラッチイネーブル入力を有
する。同一の線が、コンパレータ60の比較イネーブル
入力に接続され、コンパレータ60は、ラッチ58の出
力と確率レジスタ56にそれぞれ接続される2組みの入
力を有する。コンパレータ60の出力は、送信許可線P
ERMISSION TXである。 (第4図から再び図示される)バッファ34はバス30
のアドレス及びデータ線に接続される。パラレルデータ
線34Aから構成されるバッファ34の出力は、第4図
の変調器35の一部として考えられる信号コンバータ回
路35Aの入力に接続される。回路35Aの出力はFS
K変調器35の入力に接続され、FSK変調器35の出
力はタイムアウト制御回路36に接続され、タイムアウ
ト制御回路36はフィルタ23に接続される出力線59
を有する。送信機制御回路51のTR ON/TR O
FF出力は信号コンバータ回路35A及びタイムアウト
制御回路36に接続される。ゼロが挿入されたことを示
す指示子を伝送するための線INSZEROは回路35
Aから送信機制御回路51に接続される。(第4図から
再び図示される)クロック分配器33は、変調器35、
回路35A及び制御回路51の各クロックC1入力に接
続されるとともに、同様に、8分配回路33Aを介して
バッファ34のバイトクロック入力に接続される出力を
有する。 上述された回路の動作は以下の通りである。中央プロセ
ッサは、ヘッドエンド(仮定可能フラグ、CRC及びも
し必要であればゼロ挿入のデータを除いて)並びにPR
BS変換器に送信すべきデータのパケットを形成する。
次いで、上記パケットがマイクロプロセッサからバス3
0を介してバッファ34にロードされる。送信機制御回
路51は、ロードされたバッファの一部を示すパケット
が伝送のために準備完了状態であることがバスを介して
通知される。 送信機制御回路は、ビジービット抽出回路32から受信
されるビジービットをモニタする。もしビジービットが
アイドル状態を示しているならば、乱数発生器57の出
力信号をラッチ58に出力することを停止するために、
送信機制御回路は、ラッチ58に接続されるビジービッ
トアイドル線上にコマンドを送信する。ラッチ58の出
力は、受信された数を確率レジスタ56の出力信号と比
較するコンパレータ60によって、受信される。 もし確率レジスタの数が乱数発生器の数よりも大きいな
らば、このとき伝送を可能にするためにイネーブル信号
が送信許可線PERMISSION TXに印加され
る。(ランダム発生器の出力信号を確率レジスタの出力
信号と比較することを用いることよりはむしろ、幾何学
的分配器を用いることができる。そのような分配器は、
例えばX個のタイムスロットの後に1を禁止することを
送信のスケジュールに組み込むことができ、ここで、X
は、幾何学的分配アルゴリズムを用いて確率レジスタの
値に従って発生される。) 送信許可イネーブル信号が受信されたとき(PERMI
SSION TXがオンとなったとき)、送信機制御回
路51は送信イネーブル信号をTRON/TROFF線
に印加し、また信号コンバータ回路35Aを介してデー
タを送信し始めることをバスを介してバッファ34に通
知する。 回路35Aはバッファ34から出力されるパラレル入力
信号をシリアル信号に変換し、PRBSシーケンスに変
換されたパケットに公知の方法でプリアンブル、フラ
グ、複数ビットのゼロ、フレームチェックシーケンス
(CRC)を挿入し、データを、データが最少周波数偏
移変調される変調器35を介して、さらにタイムアウト
制御回路36及び線59を介して狭いFSK信号通過帯
域フィルタ24に送信され、該フィルタ23からデータ
が同軸ケーブル2に印加される。(第4図)その間、送
信機制御回路は受信されたビジービットをモニタする。
もし送信機制御回路がビジー又はアイドルのいずれかを
検出したならば、連続して伝送を可能にする。しかしな
がら、もし送信機制御回路が衝突ビジービット信号を検
出したならば、TRON/TROFF信号が、タイムア
ウト制御回路36を停止させるとともにバッファに対し
て次の送信を始めから開始すべく再び初期化させる“禁
止”に変化させる。送信機制御回路はまた衝突カウンタ
54をインクリメントするための信号を送出する。衝突
カウンタ54の衝突の数が予め決められた衝突の最大数
(例えば16)を越えているか否かの比較を行う。もし
衝突の数がこの最大数を越えているならば、送信機制御
回路はTRCOLL線にリストア回路53に印加される
“送信衝突”信号を送出する。これに応答してリストア
回路はバックアップ係数回路55を初期化し、衝突カウ
ンタ54に0をセットするとともに確率レジスタ56に
1をセットする。またリストア回路は現在の状態を送信
機制御回路51に書き込むための信号を送信機制御回路
51に出力し、マイクロプロセッサに対して送信機制御
回路51における状態を蓄積するレジスタを読み出させ
るために、マイクロプロセッサに割り込みをかける。こ
のとき、マイクロプロセッサは、送信機制御回路51に
対して、再送信するか、待機するかなどの制御を行う。 もし衝突の数が衝突の最大数を越えていないならば、確
率レジスタ56は、衝突カウンタ56の制御のもとでバ
ックアップ係数回路55から供給されここでバックオフ
係数として参照される係数Kでデクリメントされる。確
率レジスタはバックオフ係数(例えば1、2又は3)だ
けシフトされ、レディRDY信号が、(非常に高速で1
ナノ秒以下で)送信機制御回路51に送り戻される。こ
のとき送信機制御回路51は次の組みのアイドルビジー
ビットを待機しこのプロセスを繰り返す。 上記確率の変更は伝送の可能性を減少させる。従って、
ネットワークにおけるトラフィック量が増加していると
き衝突が増大し、任意の加入者局による伝送の確率が減
少され、自動的にトラフィックを制御することができ
る。衝突を生じさせるある最大数を越えてネットワーク
にアクセスを試みる加入者局が増加すると、ネットワー
クに対する各局のアクセス速度がさらに減少する。 送信機制御回路の詳細な動作について、図式的な構造を
図示する第7A図及び第7B図を参照して以下に説明を
行う。マイクロプロセッサからフリップフロップ65の
D入力に接続されるRQTRAM入力線は、フレームが
バッファ34にロードされていることを示すためにマイ
クロプロセッサによってオンにセットされ、送信の準備
完了状態となる。アイドル線がビジービット抽出回路3
2からパルスを受信するとき、該パルスは、アンドゲー
ト66の第2の入力に接続されるRDY線がオンである
という条件のもとでアンドゲート66をイネーブルす
る。RDY線は、衝突カウンタのインクリメントの時間
中を除いてバックオフ係数回路55によってオンに保持
され、衝突の検出に続いて、確率のバックオフのプロセ
スが行なわれる。 その結果アンドゲート66から出力される出力パルス
が、(コンパレータ58から出力される送信許可線から
の入力PERMTXがオフであると仮定しているとき)
オアゲート67を通過し、フリップフロップ65を動作
状態にさせる。フリップフロップ65のQ出力はフリッ
プフロップ68のD入力に接続され、フリップフロップ
68がまた動作状態とされる。その結果、ビジービット
アイドル線をオンにセットする。このビジービットアイ
ドル線がラッチ58及びコンパレータ60の各イネーブ
ル入力に接続されているので、乱数発生器57の出力が
ラッチされ、レジスタ56から出力される確率値と比較
される。もし乱数発生器の出力が確率レジスタにおける
伝送値の確率よりも小さいか又は等しいならば、許可送
信線PERMTXがオンにセットされる。 もし許可送信線PERMTXがオンであるならば、これ
によって信号がオアゲート67を通過することを妨げ、
アイドル線上の任意の別の動作の信号がアンドゲート6
6を通過することを妨げる。しかしながら、許可送信線
PERMTXがオンとなるとき、TRON/TROFF
線とフリップフロップ70のデータ入力に接続されるQ
入力を有するフリップフロップ69を動作状態とさせ
る。従って、フリップフロップ69のQ出力は、送信を
開始させるための、TRON/TROFF線上の送信オ
ン又は送信オフ信号を確立させる。 フリップフロップ68の出力はアンドゲート71を介
してフリップフロップ65をリセットするために用いら
れる。 もし乱数発生器の出力信号が確率レジスタの値の数より
も大きいならば、このとき送信許可線PERMTX信号
がオフのままとなり、アイドル線上の次のビジービット
アイドル信号がアンドゲート66を通過することを可能
にさせる。 もし上述のプロセスの結果TRON線上の信号がオンと
なるならば(フリップフロップ69のQ出力がオンとな
るならば)、このときTRON信号が信号コンバータ回
路35A及びタイムアウト制御回路36に印加されると
ともに同様にバッファ34に印加されているので、送信
可能状態となる。その間、もしビジービット抽出回路3
2からの衝突線COLL上の信号が衝突が生じていない
ことを示しているならば、バッファにおける最後のバイ
トが送信されるまで伝送が続けられる。これに続いて、
バッファ34から入力されるVID線上の信号がオンと
なり、この信号は最後のビットがタイムアウト回路36
からネットワークに立ち去ることを可能とするための計
数プロセスを開始させる。VID線は、オアゲート73
を介してカウンタ72の入力に接続されるため、フリッ
プフロップ70の線を介してモジュロ32カウンタ7
2をイネーブルする。上記計数動作に続いて、カウンタ
72はフリップフロップ73Aを動作状態とさせ、該フ
リップフロップ73AはTROK線上の信号をハイにセ
ットさせ、このハイ信号がフリップフロップ74のクロ
ック入力に印加され、従ってその状態が保持される。T
ROK線はまたノアゲート75の1つの入力に接続さ
れ、ノアゲート75の出力はフリップフロップ69のリ
セット入力に接続される。従って、フリップフロップ6
9がリセットされたとき、TROFF線を、信号コンバ
ータ回路35A、タイムアウト制御回路36及びバッフ
ァ回路をリセットする状態に、変化させる。もし衝突が
生じたとき、ビジービット抽出回路32から接続される
COLL線はハイとなる。このCOLL線はノアゲート
75の他の入力に接続されるので、COLL線がハイと
なるとき、フリップフロップ69の状態が変化し、該フ
リップフロップ69のQ出力がオフとなる。これによっ
て、TRON/TROFF線がオフとなり、このオフ信
号は再び信号コンバータ回路35A、タイムアウト制御
回路36及びバッファ34をリセットする。さらに、イ
ンクリメント衝突信号が、アンドゲート76の1つの入
力に印加されるCOLL信号によってINCCOLL線
上に発生され、(もし送信中であるならば、フリップフ
ロップ69のQ出力はハイとなる。)ここで、フリップ
フロップ69のQ出力がアンドゲート76の他の入力に
接続される。INCCOLL線は第6図において参照さ
れる衝突カウンタ54に接続される。従って、衝突カウ
ンタはインクリメントされる。INCCOLL線はRD
Y線上のRDY信号をオフにさせる。このRDY線はア
ンドゲート66の第2の入力に接続される。その結果、
生じた衝突の数のチェックが行なわれるまで、ビジービ
ットアイドル線上の任意の信号レベルが抑制され、もし
衝突の数が上記最大数を越えていないならば、確率レジ
スタのシフトによって確率係数がバックオフされる。こ
のプロセスが完了したとき、RDY信号がオンにセット
され、IDLE線上のアイドルビジービットの到着に応
答してビジービットアイドル線が能動状態になることが
可能になる。もし衝突の数が上記最大数を越えていない
ならば、この状態は、後述されるように送信機制御レジ
スタR5において保持される。 衝突カウンタ54(第7B図)から出力されるCOLL
EXC線はフリップフロップ77のクロック入力に接続
される。フリップフロップ74及び77のQ出力はとも
にオアゲート78の入力に接続され、該オアゲート78
の出力は割り込み線INTRである。従って、もしTR
OK線上において衝突状態とならず伝送が完了するなら
ば、もしくは衝突の数がCOLLEX線上において越え
るならば、割り込み信号がゲート78を介してINTR
線に現れる。マイクロプロセッサにおけるこの割り込み
線はCPUに対して送信機制御回路の状態をチェックさ
せる。INTROK線によって示されているフリップフ
ロップ74のQ出力と、INTREXC線によって示さ
れているフリップフロップ77のQ出力を、マイクロプ
ロセッサによるチェックを行うためのレジスタに接続す
ることが可能である。INTREXC線上のオン信号は
衝突数が予め決められた値を越えたことを示しており、
INTROK線上の信号は伝送が衝突なしに完了したこ
とを示している。ノアゲート81は、カウンタ72とフ
リップフロップ70のリセット入力に接続される出力を
有するとともに、COLL線に接続される1つの入力
と、インバータ80に接続されるもう1つの入力を有
し、ここで、インバータ80がRSTO線とアンドゲー
ト71の1つの入力に接続される入力を有する。このこ
とは、フリップフロップ70とカウンタ72が、COL
L信号がハイ又はRSTO上のリセット信号がハイとな
ったときにリセットされないことを確立している。 上記回路への他の入力線は、オア回路73に接続される
クロックC1、オアゲート73に接続されるINSZE
RO線、並びに(マイクロプロセッサから接続される)
RST線からオアゲート79を介してフリップフロップ
74及び77のリセット入力に接続されるリセット線、
及びバスから接続されるLRCTRL線である。リセッ
トクロック及び挿入ゼロ入力は、上述の記述を理解する
当業者によって理解され、さらに説明を行う必要はな
い。 従って、上記回路は明らかに、ヘッドエンドからすべて
の加入者端末に出力されるビジービットを受信するのに
応答して、ヘッドエンドへの出力信号の伝送における加
入者端末の動作を制御する。この制御はまた明らかに、
伝送の前に、ネットワークによって伝送されるトラフィ
ック密度を制御する待機時間を確立する。トラフィック
密度が制御され、ネットワークを捕捉して受信機からデ
ータ信号を信頼して受信することが確実になったとき、
信頼できる上りの伝送を行うことができることがわかっ
た。 上述の記述を理解する当業者はここで記述された原理を
用いて設計における変形例を考えるかもしれない。すべ
ては、上述した特許請求の範囲において定義される発明
の範囲内であると考えられる。 [発明の効果] 以上詳述したように、本発明によれば、2方向伝送ネッ
トワークを備えた2方向ケーブル通信システムにおい
て、各加入者局から送信される信号間で衝突が生じたと
しても、当該衝突をヘッドエンドで検出して、衝突を示
す衝突信号を上記各加入者局に送信することができ、こ
れによって、上記各加入者局は送信を停止し再送信のタ
イミングを調整することができる。
【図面の簡単な説明】
第1図は本発明による2方向ケーブル通信ネットワーク
のブロック図であり、 第2図は時間に対する下りのデータ列を図示し、 第3図は時間に対するデータパケットを図示し、 第4図は本発明による加入者端末のブロック図であり、 第5図は第4図で図示された抽出論理回路のブロック図
であり、 第6図は第4図で図示された媒体アクセス回路のブロッ
ク図であり、 第7A図及び第7B図は加入者端末における送信機制御
回路のブロック図である。 1…ヘッドエンド、 2…同軸ケーブル、 3…加入者端末、 4…中継増幅器、 5…スプリッタ、 6…終端器、 7,9,10…フィルタ、 8…変調器、 11…復調器、 12…衝突検出器、 13…通信コントローラ、 22,23…フィルタ、 24…テレビジョンチューナ/アナログ回路、 25…変調器、 26…テレビジョンセット、 27…デジタル復調器、 29…プロセッサ、 30…バス、 31…他のデジタル回路、 32…IEC抽出論理回路、 33…N分配器、 34…バッファ、 35…変調器、 35A…信号コンバータ回路、 36…タイムアウト回路、 37…媒体アクセス回路、 40…デスクランブラ、 41…ビットカウンタ、 42…決定フラグ回路、 43…ゼロ抽出回路、 44…IEC抽出回路、 45…カウンタ及びインターバル制御抽出回路、 46…デコードIEC回路、 51…送信機制御回路、 52…アドレスデコーダ、 53…リストア回路、 54…衝突カウンタ、 55…バックオフ係数回路、 56…確率レジスタ、 57…乱数発生器、 58…ラッチ、 60…コンパレータ。
のブロック図であり、 第2図は時間に対する下りのデータ列を図示し、 第3図は時間に対するデータパケットを図示し、 第4図は本発明による加入者端末のブロック図であり、 第5図は第4図で図示された抽出論理回路のブロック図
であり、 第6図は第4図で図示された媒体アクセス回路のブロッ
ク図であり、 第7A図及び第7B図は加入者端末における送信機制御
回路のブロック図である。 1…ヘッドエンド、 2…同軸ケーブル、 3…加入者端末、 4…中継増幅器、 5…スプリッタ、 6…終端器、 7,9,10…フィルタ、 8…変調器、 11…復調器、 12…衝突検出器、 13…通信コントローラ、 22,23…フィルタ、 24…テレビジョンチューナ/アナログ回路、 25…変調器、 26…テレビジョンセット、 27…デジタル復調器、 29…プロセッサ、 30…バス、 31…他のデジタル回路、 32…IEC抽出論理回路、 33…N分配器、 34…バッファ、 35…変調器、 35A…信号コンバータ回路、 36…タイムアウト回路、 37…媒体アクセス回路、 40…デスクランブラ、 41…ビットカウンタ、 42…決定フラグ回路、 43…ゼロ抽出回路、 44…IEC抽出回路、 45…カウンタ及びインターバル制御抽出回路、 46…デコードIEC回路、 51…送信機制御回路、 52…アドレスデコーダ、 53…リストア回路、 54…衝突カウンタ、 55…バックオフ係数回路、 56…確率レジスタ、 57…乱数発生器、 58…ラッチ、 60…コンパレータ。
─────────────────────────────────────────────────────
フロントページの続き
(72)発明者 デイブ・グレゴリー
カナダ国 ブリテッシュ・コロンビア ピ
ー2ジェイ 5エイチ1、カルガリー、レ
イク・プラシッド・ドライブ 1104番
(72)発明者 ジーン―ポール・シャンペン
カナダ国 ケベック ジェイ4ゼット 2
ケイ5、ブロサード、ルー・バーシアー
6180番
(72)発明者 アレイン・テッシャー
カナダ国 ケベック ジェイ0アール 1
アール0、パイドモント、チェイミン・デ
ス・ピンズ 316番
(72)発明者 ピエール・スコット
カナダ国 ケベック エイチ1ビー 1ピ
ー9、モントリオール、ルー・ディモンチ
グニー 12209番
(72)発明者 フランコイス・メソット
カナダ国 ケベック エイチ1ワイ 2ケ
イ8、モントリオール、アベニュー・ロウ
ズモント 9イー 6535番
Claims (1)
- 【特許請求の範囲】 【請求項1】ヘッドエンドと、 複数の加入者局と、 上記ヘッドエンド及び上記複数の加入者局との間に接続
され、上記ヘッドエンドから上記複数の加入者局に下り
のデータ信号を伝送しかつ上記複数の加入者局から上記
ヘッドエンドに上りのデータ信号を伝送するための2方
向伝送ネットワークとを備えた2方向ケーブル通信シス
テムにおいて、 上記ヘッドエンドは、 上記複数の加入者局から受信される信号を受信し、上記
受信した複数の信号間の衝突を検出し、上記衝突を検出
したとき衝突信号を発生して出力する衝突検出手段と、 上記衝突検出手段から出力される衝突信号に基づいて、
上記衝突を示すデータ信号の状態ビットを、上記下りの
データ信号を用いて、上記2方向伝送ネットワークを介
して上記複数の加入者局に送信する送信手段とを備え、 上記複数の加入者局の各々は、 上記ヘッドエンドから送信された上記下りのデータ信号
に含まれる、上記衝突を示すデータ信号の状態ビットに
基づいて、上記ヘッドエンドへのデータ信号の送信を停
止する停止手段とを備えたことを特徴とする2方向ケー
ブル通信システム。 【請求項2】上記衝突検出手段は、任意の加入者局から
信号が受信されたか否かを検出しかつそれぞれビジー又
はアイドル状態信号を発生する手段を含み、上記送信手
段は、上記衝突、上記アイドル、又は上記ビジー状態を
示すデータ信号の状態ビットを発生して送信する手段を
含むことを特徴とする請求項第1項記載のシステム。 【請求項3】上記送信手段は、上記データの状態ビット
が下りのデータ信号の分割されたタイムスロットで繰り
返し送信することを特徴とする請求項第2項記載のシス
テム。 【請求項4】最大往復伝搬遅延時間が、下りと上りの両
方向でネットワークの最長に遅延されたエンドに対する
伝送ループにおけるすべての構成要素の遅延時間の和に
よって定義され、状態ビットの連続するグループ間の時
間周期が少なくとも上記伝搬遅延時間と同一の長さであ
ることを特徴とする請求項第3項記載のシステム。 【請求項5】上記各加入者局からの上りデータ信号が同
一の周波数帯域内にあることを特徴とする請求項第2
項、第3項、又は第4項記載のシステム。 【請求項6】上記各加入者局からの上りのデータ信号が
同一の周波数で周波数偏移変調されることを特徴とする
請求項第2項、第3項又は第4項記載のシステム。 【請求項7】上記各加入者局からの上りのデータ信号が
同一の周波数帯域内にあり、さらに上りのデータの周波
数帯域の通過帯域と同様の通過帯域を有し下りの信号を
通過させることを可能にしつつ上記2方向伝送ネットワ
ークの各ブランチにおける上りの伝送方向で接続される
狭帯域フィルタを備えることを特徴とする請求項第2
項、第3項又は第4項記載のシステム。 【請求項8】上記各加入者局からの上りのデータ信号が
同一の周波数で周波数偏移変調され、さらに上記周波数
偏移の周波数を含む通過帯域を有し下りの信号を通過さ
せることを可能にしつつ上記2方向伝送ネットワークの
各ブランチにおける上りの伝送方向で接続される複数の
狭帯域フィルタを備えることを特徴とする請求項第2
項、第3項又は第4項記載のシステム。 【請求項9】上記各加入者局から受信される信号が同様
の周波数で周波数偏移変調され、上記周波数を含む狭い
帯域通過周波数を有し上記2方向伝送ネットワークのブ
ランチに接続される上りのフィルタをさらに含むことを
特徴とする請求項第1項、第2項又は第4項記載のシス
テム。 【請求項10】ヘッドエンドと、 複数の加入者局と、 上記ヘッドエンド及び上記複数の加入者局との間に接続
され、上記ヘッドエンドから上記複数の加入者局に下り
のデータ信号を伝送しかつ上記複数の加入者局から上記
ヘッドエンドに上りのデータ信号を伝送するための2方
向伝送ネットワークとを備えた2方向ケーブル通信シス
テムにおいて、上記複数の加入者局にそれぞれ設けられ
る加入者端末であって、 上記ヘッドエンドは、 上記複数の加入者局から受信される信号を受信し、上記
受信した複数の信号間の衝突を検出し、上記衝突を検出
したとき衝突信号を発生して出力する衝突検出手段と、 上記衝突検出手段から出力される衝突信号に基づいて、
上記衝突を示すデータ信号の状態ビットを、上記下りの
データ信号を用いて、上記2方向伝送ネットワークを介
して上記複数の加入者局に送信する送信手段とを備え、 上記衝突検出手段は、任意の加入者局から信号が受信さ
れたか否かを検出しかつそれぞれビジー又はアイドル状
態信号を発生する手段を含み、上記送信手段は、上記衝
突、上記アイドル、又は上記ビジー状態を示すデータ信
号の状態ビットを発生して送信する手段を含み、 上記加入者端末は、 上記ヘッドエンドから上記2方向伝送ネットワークを介
して、信号の衝突、ビジー又はアイドルを含む上記2方
向伝送ネットワークの状態を示す状態ビットを含むデー
タ信号を繰り返し受信する受信手段と、 上記受信手段によって受信されたデータ信号に含まれ
る、上記衝突を示すデータ信号の状態ビットに基づい
て、上記ヘッドエンドへのデータ信号の送信を停止する
停止手段と、 上記2方向伝送ネットワークを介して上記ヘッドエンド
に送信すべきデータ信号を所定のフォーマットで定式化
しかつ蓄積する蓄積手段と、 上記蓄積手段によって蓄積されたデータ信号を、上記2
方向伝送ネットワークを介して上記ヘッドエンドにデー
タ信号を送信する加入者送信手段と、 上記加入者送信手段の動作を制御する制御手段とを備
え、 上記制御手段は、上記受信手段によって受信されたデー
タ信号に含まれる状態ビットを受信し、上記ヘッドエン
ドに送信すべきデータ信号を予め決められた確率Pで送
信するように上記加入者送信手段を制御し、上記受信し
た信号衝突の状態ビットの信号の数を計数し、上記計数
した信号衝突の状態ビットの信号の数に基づいて上記確
率Pを調整する手段を含むことを特徴とする加入者端
末。 【請求項11】上記確率Pが係数Kの約分によって調整
され、ここでP=P/Kであることを特徴とする請求項
第10項記載の端末。 【請求項12】上記制御手段は、もし受信された信号衝
突状態信号の数が予め決められた最大数を越えるならば
ある時間周期の間、上記ヘッドエンドへの送信を抑制
し、これに応答して全体のデータ信号の再送信を再初期
化する手段を含むことを特徴とする請求項第11項記載
の端末。 【請求項13】上記完了信号の送信に続いて確率Pを1
にリセットすることを特徴とする請求項第12項記載の
端末。 【請求項14】上記制御手段は、連続するタイムスロッ
トにおいてデータ信号からビットの連続する状態グルー
プを繰り返し抽出し、状態グループのビットを複号化
し、上記加入者送信手段の動作のために対応するライン
に復号化の結果として生じる衝突、ビジー及びアイドル
信号を出力する手段を含むことを特徴とする請求項第1
0項記載の端末。 【請求項15】2方向CATV通信システムにおいて用
いるためのヘッドエンドであって、 (a)下りのデータ信号を受信しかつ上記下りのデータ信
号を含むマスタデータ信号を発生する通信コントローラ
と、 (b)種々のテレビジョン信号及び上記マスタデータ信号
を受信しかつそれらの信号を同軸ケーブルに接続される
上りのエンドに対して予め決められたチャネルで印加す
る変調器と、 (c)上記同軸ケーブルに接続される上りのエンドからの
もう1つの予め決められたチャネルで上りのデータ信号
を受信しかつ別の処理のために復調されたデータ信号を
出力する復調器とを備えたヘッドエンドにおいて、 (d)上記同軸ケーブルに接続された上りのエンドからの
上記もう1つの予め決められたチャネルで上記データ信
号を受信し、上記データ信号における監視信号を検出
し、上記同軸ケーブルに接続される下りの複数の信号源
から受信される信号間の衝突を検出し、信号間の衝突を
検出したとき上記通信コントローラに対して上記衝突を
示す信号を出力しかつ監視信号を発生して上記監視信号
を上記通信コントローラに出力する衝突検出器とを備
え、 (e)上記通信コントローラは、上記衝突検出器から出力
された監視信号に基づいて、上記マスタデータ信号の一
部として衝突を示す監視信号を発生する手段を含み、こ
れによって、上記衝突を示す監視信号を上記同軸ケーブ
ルを介して上記下りの信号源に対して送信することを特
徴とするヘッドエンド。 【請求項16】上記同軸ケーブルに接続される上りのエ
ンドに印加される監視信号が、少なくともビジー、アイ
ドル及び衝突の状態を示し、上りのデータ信号を送信す
るための上記もう1つの予め決められたチャネルがビジ
ー、アイドルであること、もしくは複数の信号が同時に
受信されて汚損されることを示すための状態データビッ
トから構成され、上記状態ビットが、上記同軸ケーブル
の上りのエンドから上記監視信号を検出することに応答
して上記衝突検出器によって発生されることを特徴とす
る請求項第15項記載のヘッドエンド。 【請求項17】上記衝突検出器が上記衝突を広帯域で検
出する手段を含むことを特徴とする請求項第16項記載
のヘッドエンド。 【請求項18】上記通信コントローラが、状態ビットの
バイトと下りのデータ信号とを、高速度のタイムスロッ
トに分割されたデータチャネルに出力し、上記状態ビッ
トのバイトが各タイムスロットの最初に出力されるよう
に出力する手段を備え、上記状態ビットのバイト間の時
間間隔が少なくともCATV通信システム内の最大往復
伝搬遅延時間と同じ長さであることを特徴とする請求項
第16項記載のヘッドエンド。 【請求項19】同軸ケーブルネットワークが、上りのエ
ンドを有し上記ヘッドエンドと複数の加入者端末に接続
され、上記各加入者端末は、 (i)上記上りデータチャネルのビジー、アイドル又は衝
突を示す上記状態ビットのバイトを含む上記マスタデー
タ信号を受信する受信手段と、 (ii)上記ネットワークを介して上記ヘッドエンドに送信
すべきデータ信号を定式化しかつ蓄積する蓄積手段と、 (iii)上記ネットワークを介して上記ヘッドエンドにデ
ータ信号を送信する送信手段と、 (iv)上記送信手段を制御する制御手段とを備え、 (v)上記制御手段は、状態ビットを受信しかつ予め決め
られた確率Pで上記データ信号の送信を行うように上記
送信手段を制御する送信制御手段と、受信された信号衝
突状態信号の数を計数しかつ上記計数した数に基づいて
上記確率Pを調整する手段を備えたことを特徴とする請
求項第16項、第17項、又は第18項記載のヘッドエ
ンドとの組合せ装置。 【請求項20】上記確率Pが係数Kの約分によって調整
され、ここでP=P/Kであることを特徴とする請求項
第19項記載の端末。 【請求項21】上記制御手段は、もし受信された信号衝
突状態信号の数が予め決められた最大数を越えるならば
ある時間周期の間送信を抑制しこれに応答して全体のデ
ータ信号の再送信を再び初期化する手段を含むことを特
徴とする請求項第20項記載の端末。 【請求項22】上記全体の完了データ信号の送信に続い
て、上記確率Pが1にリセットされることを特徴とする
請求項第21項記載の端末。 【請求項23】上記制御手段は、連続するタイムスロッ
トにおけるデータ信号から連続するビットの状態グルー
プを繰り返し抽出し、上記ビットの状態グループを復号
化し、復号化の結果生じる上記送信制御手段の動作のた
めに対応するライン上に復号化の結果生じる衝突、ビジ
ー、及びアイドル信号を出力する手段を含むことを特徴
とする請求項第19項記載の端末。 【請求項24】(i)データバスと、 (ii)上記データ信号のパケットを定式化するための手段
がプロセッサとその制御入力を備え、上記蓄積するため
の手段がバッファメモリを備え、上記プロセッサとバッ
ファメモリがともにデータバスを介して接続され、これ
によって上記プロセッサがバッファメモリに送信すべき
データのパケットを通過させ、 (iii)上記バッファメモリの出力に接続される入力を有
し上記定式化されたデータ信号を受信する変調器と、 (iv)上記変調器から上記変調された信号を受信するため
にデータ信号の送信間隔を制御し、上記制御手段からの
制御入力を有し、上記ネットワーク上に上りのデータ信
号を送信するタイムアウト回路を備え、 (v)上記バッファメモリがまた上記制御手段からの制御
入力を含み、 これによって、状態ビットと上記確率Pを受信する結果
として、データ信号のパケットの受信と上記ネットワー
ク上の上記信号の送信が上記コントローラによって制御
されることを特徴とする請求項第10項記載の端末。 【請求項25】上記ネットワークによって伝送される他
の信号から上記データ信号を分離するフィルタ手段と、
上記データ信号を復調するデジタル復調器と、上記デー
タ信号から状態ビットを抽出しかつ上記状態ビットを上
記制御手段に印加する状態ビット抽出回路を含むことを
特徴とする請求項第24項記載の端末。 【請求項26】上記制御手段は、上記伝送ネットワーク
から衝突状態ビットを受信するとき、データ信号の送信
中又は前に送信を抑制する手段を備えたことを特徴とす
る請求項第10項、第24項、又は第25項記載の端
末。 【請求項27項】上記制御手段は、上記伝送ネットワー
クから衝突状態ビットを受信するときデータ信号の送信
中又は前に送信を抑制し、衝突カウンタをインクリメン
トし、上記衝突カウンタによって蓄積された計数値が予
め決められた最大数以下であるとき上記確率Pをより小
さい値に調整し、上記衝突計数値が上記予め決められた
最大数を越えたとき上記確率Pを予め決められた小さな
値又は小さな値のランダムな数のいずれかである値にリ
セットする手段を備えたことを特徴とする請求項第10
項、第24項、又は第25項記載の端末。 【請求項28】上記制御手段は、上記伝送ネットワーク
から衝突状態ビットを受信するときデータ信号の送信中
又は前に送信を抑制し、衝突カウンタをインクリメント
し、上記衝突カウンタによって蓄積された計数値が予め
決められた最大数以下であるとき上記確率Pをより小さ
い値に調整し、上記衝突計数値が上記予め決められた最
大数を越えたとき上記確率Pを予め決められた小さな値
又は小さな値の乱数のいずれかである値にリセットし、
データ信号のパケットの送信に続いて衝突カウンタを0
にかつ上記送信確率Pを1に初期化する手段を備えたこ
とを特徴とする請求項第10項、第24項、又は第25
項記載の端末。 【請求項29】上記制御手段は、上記状態ビットを受信
する手段と、乱数発生器と、上記乱数発生器の出力をラ
ッチするラッチと、送信機制御回路に接続され状態ビッ
トによって示される衝突の数を計数する衝突カウンタ
と、上記衝突カウンタに接続される入力を有する計数計
算回路と、上記確率レジスタの出力を受信する確率レジ
スタを備え、増加された衝突計数値を用いて上記係数計
算回路によってインクリメントされるとき上記確率レジ
スタに格納された確率信号の値が減少され、上記制御手
段はまた、上記状態ビットがアイドルチャネルを示すと
き上記ラッチにおける値をそのまま凍結させるための手
段と、上記ラッチにおける信号のデータ値を上記確率レ
ジスタにおけるデータ値と比較するコンパレータを含
み、上記確率レジスタにおける値が上記ラッチにおける
値よりも大きいとき上記データ信号をネットワークに送
信することを可能にすることを特徴とする請求項第10
項、第24項、又は第25項記載の端末。 【請求項30】上記制御手段は、上記状態ビットを受信
する手段と、乱数発生器と、上記乱数発生器の出力をラ
ッチするラッチと、送信制御回路に接続され状態ビット
によって示される衝突の数を計数する衝突カウンタと、
上記衝突カウンタに接続される入力を有する計数計算回
路と、上記確率レジスタの出力を受信する確率レジスタ
を備え、これによって増加された衝突計数値を用いて上
記係数計算回路によってインクリメントされるとき上記
確率レジスタに格納された確率信号の値が減少され、上
記制御手段はまた、上記状態ビットがアイドルチャネル
を示すとき上記ラッチにおける値をそのまま凍結させる
ための手段と、上記ラッチにおける信号のデータ値を上
記確率レジスタにおけるデータ値と比較するコンパレー
タを含み、上記確率レジスタにおける値が上記ラッチに
おける値よりも大きいとき上記データ信号をネットワー
クに送信することを可能にし、続いて衝突状態ビットを
受信したとき送信を抑制し、全体のデータ信号の最初か
ら全体のデータ信号の送信を可能にし、上記衝突カウン
タをインクリメントし、上記確率レジスタをデクリメン
トさせるとともに、上記コンパレータにおいてその値の
比較を行わせ、もし上記確率レジスタにおける値が上記
ラッチにおける値を越えるならばアイドル状態ビットの
受信に続いて上記送信を可能にし、もし衝突の数が予め
決められた最大数を越えるならば、衝突カウンタを0に
セットし、上記係数計算回路を初期化するとともに、確
率レジスタを1に初期化し、次いで、初期の小さな送信
確率で再送信するまで送信が抑制されることを特徴とす
る請求項第10項、第24項、又は第25項記載の端
末。
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
CA000550764A CA1317667C (en) | 1987-11-02 | 1987-11-02 | Catv subscriber terminal transmission control |
CA550764 | 1987-11-02 |
Publications (2)
Publication Number | Publication Date |
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