JPH06311519A - High luminance coloring prevention circuit - Google Patents
High luminance coloring prevention circuitInfo
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- JPH06311519A JPH06311519A JP5120516A JP12051693A JPH06311519A JP H06311519 A JPH06311519 A JP H06311519A JP 5120516 A JP5120516 A JP 5120516A JP 12051693 A JP12051693 A JP 12051693A JP H06311519 A JPH06311519 A JP H06311519A
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Abstract
Description
【０００１】[0001]
【産業上の利用分野】本発明は、高輝度の光学像を撮影
した際に、この光学像に対応する色信号の信号レベルが
飽和する事態を確実に防止する事ができる高輝度着色防
止回路に関する。BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention, when a high-brightness optical image is taken, is capable of reliably preventing a situation in which the signal level of a color signal corresponding to the optical image is saturated. Regarding
【０００２】[0002]
【従来の技術】ビデオカメラを用いて撮影を行う場合、
撮影対象である光学像の輝度が略一定の範囲に納まる場
合、光学像の色を忠実に示す色信号が得られる。しか
し、高輝度の光学像が存在した場合、この光学像に対応
する色信号が飽和してしまう。色信号が飽和すると、こ
の光学像及びその周囲の色を示す色信号が実際の光学像
の色とは異なる異常な色を示す、いわゆる異常着色が発
生する。2. Description of the Related Art When shooting with a video camera,
When the brightness of the optical image to be captured falls within a substantially constant range, a color signal that faithfully represents the color of the optical image is obtained. However, when a high-brightness optical image exists, the color signal corresponding to this optical image is saturated. When the color signal is saturated, so-called abnormal coloring occurs in which the color signal indicating the color of the optical image and its surroundings shows an abnormal color different from the color of the actual optical image.
【０００３】この異常着色を防止する目的で、近年のビ
デオカメラには、高輝度の光学像を検出して色信号を抑
圧する高輝度着色防止回路が搭載されている。In order to prevent this abnormal coloring, recent video cameras are equipped with a high-brightness coloring prevention circuit that detects a high-brightness optical image and suppresses color signals.
【０００４】図２に、従来の高輝度着色防止回路のブロ
ック図を示す。図に示した高輝度着色防止回路１は、例
えば単板式の撮像素子から出力されるライン信号を基に
輝度信号及び色差信号（色信号）を生成する、色差順次
方式に適用されるもので、輝度・色信号処理回路２と、
第１及び第２の遅延回路３，４と、加算回路５と共に利
用される。FIG. 2 shows a block diagram of a conventional high brightness coloring prevention circuit. The high-brightness coloring prevention circuit 1 shown in the figure is applied to a color-difference sequential system that generates a luminance signal and a color-difference signal (color signal) based on a line signal output from, for example, a single-plate image sensor, A luminance / color signal processing circuit 2,
It is used together with the first and second delay circuits 3 and 4 and the adder circuit 5.
【０００５】第１の遅延回路３は、例えばＣＣＤ(Charg
e Coupled Device)等の撮像素子から出力されるライン
信号（基本ライン信号）Ｌ0を、１Ｈ遅延させて第１の
遅延ライン信号Ｌ1として出力する回路である。第２の
遅延回路４は、第１の遅延ライン信号Ｌ1を、１Ｈ遅延
させて第２の遅延ライン信号Ｌ2として出力する回路で
ある。加算回路５は、基本ライン信号Ｌ0と第２の遅延
ライン信号Ｌ2との加算演算を行い、加算ライン信号Ｌa
を出力する回路である。輝度・色信号処理回路２は、第
１の遅延ライン信号Ｌ1及び加算ライン信号Ｌaを受け入
れて、輝度信号及び色差信号（色信号）を生成する回路
である。The first delay circuit 3 is, for example, a CCD (Charg
This is a circuit that delays a line signal (basic line signal) L 0 output from an image pickup device such as an e-coupled device) by 1H and outputs it as a first delay line signal L 1 . The second delay circuit 4 is a circuit which delays the first delay line signal L 1 by 1H and outputs it as a second delay line signal L 2 . The adder circuit 5 performs an addition operation on the basic line signal L 0 and the second delay line signal L 2 to obtain an added line signal L a.
Is a circuit for outputting. Luminance and color signal processing circuit 2 accepts the first delay line signals L 1 and the addition line signal L a, is a circuit for generating a luminance signal and color difference signals (color signals).
【０００６】高輝度着色防止回路１は、比較器６と抑圧
制御回路７とを備えている。比較器６には、第１の遅延
ライン信号Ｌ1と基準信号Ｓとが入力している。この比
較器６は、第１の遅延ライン信号Ｌ1の信号レベルが基
準信号Ｓの信号レベルを上回った場合、出力が有効にな
る回路である。なお、基準信号Ｓは、輝度・色信号処理
回路２が生成する色信号が飽和する信号レベル（高輝度
の光学像に対応する信号レベル）を持つ第１の遅延ライ
ン信号Ｌ1を特定する信号レベルが予め設定された信号
である。抑圧制御回路７は、比較器６の出力が有効に設
定された場合、輝度・色信号処理回路２が生成する色信
号の信号レベルを抑圧する制御を行う回路である。The high brightness coloring prevention circuit 1 includes a comparator 6 and a suppression control circuit 7. The first delay line signal L 1 and the reference signal S are input to the comparator 6. The comparator 6 is a circuit whose output becomes valid when the signal level of the first delay line signal L 1 exceeds the signal level of the reference signal S. The reference signal S is a signal that specifies the first delay line signal L 1 having a signal level at which the color signal generated by the luminance / color signal processing circuit 2 is saturated (a signal level corresponding to a high-luminance optical image). It is a signal whose level is preset. The suppression control circuit 7 is a circuit that performs control for suppressing the signal level of the color signal generated by the luminance / color signal processing circuit 2 when the output of the comparator 6 is set to be valid.
【０００７】以上の構成の高輝度着色防止回路１におい
て、第１の遅延ライン信号Ｌ1が高輝度の信号レベルを
含む場合、比較器６の出力が有効に設定され、抑圧制御
回路７が動作する。抑圧制御回路７が動作すると、輝度
・色信号処理回路２において生成される色信号の信号レ
ベルが抑圧される。色信号の信号レベルが抑圧される
と、この信号レベルが飽和する事態を回避することがで
き、結果として高輝度の光学像に対応する色信号に異常
着色が発生する事態を防止できる。In the high-brightness coloring prevention circuit 1 having the above-described structure, when the first delay line signal L 1 includes a high-brightness signal level, the output of the comparator 6 is effectively set and the suppression control circuit 7 operates. To do. When the suppression control circuit 7 operates, the signal level of the color signal generated in the luminance / color signal processing circuit 2 is suppressed. When the signal level of the color signal is suppressed, it is possible to avoid a situation in which the signal level is saturated, and as a result, it is possible to prevent abnormal coloring from occurring in the color signal corresponding to the high-luminance optical image.
【０００８】[0008]
【発明が解決しようとする課題】さて、従来の高輝度着
色防止回路１は、第１の遅延ライン信号Ｌ1についての
み基準信号Ｓとの比較を実施していた。このため、基本
ライン信号Ｌ0及び第２の遅延ライン信号Ｌ2が高輝度の
信号レベルを含んでいても、抑圧制御回路７が動作しな
い事態が発生する。従って、第１の遅延ライン信号Ｌ1
以外のライン信号、即ち基本ライン信号Ｌ0、第２の遅
延ライン信号Ｌ2が高輝度の信号レベルを含む場合、輝
度・色信号処理回路２において生成する色信号が飽和
し、結果として高輝度の光学像に対応する色信号に異常
着色が発生するという問題が生じていた。The conventional high-brightness coloring prevention circuit 1 compares the first delay line signal L 1 with the reference signal S only. Therefore, even if the basic line signal L 0 and the second delay line signal L 2 include high-brightness signal levels, the suppression control circuit 7 may not operate. Therefore, the first delay line signal L 1
When the line signals other than the above, that is, the basic line signal L 0 and the second delay line signal L 2 include high luminance signal levels, the color signals generated in the luminance / color signal processing circuit 2 are saturated, and as a result, high luminance However, there is a problem that abnormal coloration occurs in the color signal corresponding to the optical image.
【０００９】[0009]
【本発明の目的及び概要】本発明の目的は、高輝度の信
号レベルを含むライン信号が存在する間は、確実に色信
号の抑圧制御を実現する高輝度着色防止回路を提供す
る。OBJECT AND SUMMARY OF THE INVENTION An object of the present invention is to provide a high-intensity coloring prevention circuit which surely realizes color signal suppression control while a line signal including a high-intensity signal level is present.
【００１０】本発明の高輝度着色防止回路は、単板式の
撮像素子と、前記撮像素子から出力される基本ライン信
号を遅延させて第１の遅延ライン信号を出力する第１の
遅延回路と、前記第１の遅延ライン信号を遅延させて、
第２の遅延ライン信号を出力する第２の遅延回路と、別
途入力する基準信号と前記基本ライン信号とを比較し、
当該基本ライン信号の信号レベルが当該基準信号の信号
レベルを超える場合、第１の有効信号を出力する第１の
比較器と、前記基準信号と前記第１の遅延ライン信号と
を比較し、当該第１の遅延ライン信号の信号レベルが当
該基準信号の信号レベルを超える場合、第２の有効信号
を出力する第２の比較器と、前記基準信号と前記第２の
遅延ライン信号とを比較し、当該第２の遅延ライン信号
の信号レベルが当該基準信号の信号レベルを超える場
合、第３の有効信号を出力する第３の比較器と、前記第
１乃至第３の有効信号の論理和を演算し、当該演算の結
果に基づいて前記第１乃至第３の有効信号の何れかを出
力して色信号を抑圧する抑圧制御回路を動作させる論理
和回路とを備えたものである。The high-luminance coloration preventing circuit of the present invention comprises a single-plate type image pickup device, a first delay circuit for delaying a basic line signal output from the image pickup device and outputting a first delay line signal, Delaying the first delay line signal,
A second delay circuit that outputs a second delay line signal, a reference signal that is input separately, and the basic line signal are compared;
When the signal level of the basic line signal exceeds the signal level of the reference signal, a first comparator that outputs a first valid signal is compared with the reference signal and the first delay line signal, When the signal level of the first delay line signal exceeds the signal level of the reference signal, a second comparator that outputs a second valid signal is compared with the reference signal and the second delay line signal. When the signal level of the second delay line signal exceeds the signal level of the reference signal, a logical sum of the third comparator that outputs a third valid signal and the first to third valid signals is calculated. And a logical sum circuit for operating a suppression control circuit for performing a calculation and outputting any of the first to third effective signals based on the result of the calculation to suppress a color signal.
【００１１】以上の構成の高輝度着色防止回路は、第１
の遅延回路の入力側及び出力側、そして第２の遅延回路
の出力側に高輝度の信号レベルを含むライン信号が存在
する間は、色信号の抑圧を制御する抑圧制御回路を動作
させ、確実に色信号の抑圧を実現する。The high-brightness coloring prevention circuit having the above-mentioned configuration is the first
While a line signal including a high-brightness signal level is present on the input side and output side of the second delay circuit and on the output side of the second delay circuit, the suppression control circuit that controls the suppression of the color signal is operated to ensure Realizes the suppression of color signals.
【００１２】[0012]
【実施例】図１に、本発明の高輝度着色防止回路のブロ
ック図を示す。図中、図２と重複する構成には同一符号
を付し、重複する説明は省略する。図１において、第１
の比較器１２の一方の入力は、第１の遅延回路３の入力
に接続されている。第２の比較器１３の一方の入力は、
第１の遅延回路３の出力（第２の遅延回路４の入力）に
接続されている。第３の比較器１４の一方の入力は、第
２の遅延回路４の出力に接続されている。第１乃至第３
の比較器１２〜１４の他方の入力には、基準信号Ｓが供
給され、さらに各々の出力は、論理和回路１５の入力に
接続されている。論理和回路１５の出力は、抑圧制御回
路７に接続されている。DESCRIPTION OF THE PREFERRED EMBODIMENTS FIG. 1 shows a block diagram of a high-luminance coloring prevention circuit of the present invention. In the figure, the same components as those in FIG. 2 are designated by the same reference numerals, and the duplicate description will be omitted. In FIG. 1, the first
One input of the comparator 12 is connected to the input of the first delay circuit 3. One input of the second comparator 13 is
It is connected to the output of the first delay circuit 3 (the input of the second delay circuit 4). One input of the third comparator 14 is connected to the output of the second delay circuit 4. First to third
The reference signal S is supplied to the other inputs of the comparators 12 to 14, and the respective outputs are connected to the inputs of the OR circuit 15. The output of the OR circuit 15 is connected to the suppression control circuit 7.
【００１３】第１の比較器１２は、基本ライン信号Ｌ0
と基準信号Ｓとを比較する回路で、基本ライン信号Ｌ0
に基準信号Ｓの信号レベルを上回る信号レベルが含れて
いた場合、第１の有効信号（ハイレベル）を出力する回
路である。第２の比較器１３は、第１の遅延ライン信号
Ｌ1と基準信号Ｓとを比較する回路で、第１の遅延ライ
ン信号Ｌ1に基準信号Ｓの信号レベルを上回る信号レベ
ルが含まれていた場合、第２の有効信号（ハイレベル）
を出力する回路である。第３の比較器１４は、第２のラ
イン信号Ｌ2と基準信号Ｓとを比較する回路で、第２の
ライン信号Ｌ2に基準信号Ｓの信号レベルを上回る信号
レベルが含まれていた場合、第３の有効信号（ハイレベ
ル）を出力する回路である。なお、第１乃至第３の比較
器１２〜１４は、各ライン信号に基準信号Ｓの信号レベ
ルを上回る信号レベルが含まれない場合、それぞれ無効
信号（ロウレベル）を出力する。論理和回路１５は、第
１乃至第３の比較器１２〜１４の出力の論理和（ＯＲ）
を演算する回路である。即ち、第１乃至第３の比較器１
２〜１４の何れかが有効信号を出力すれば、論理和回路
１５の出力も有効（ハイレベル）に設定され、抑圧制御
回路７を動作させる。The first comparator 12 has a basic line signal L 0.
In the circuit for comparing the reference line S with the basic line signal L 0
Is a circuit that outputs a first valid signal (high level) when the signal level exceeds the signal level of the reference signal S. The second comparator 13 is a circuit for comparing the first delay line signal L 1 and the reference signal S, and the first delay line signal L 1 includes a signal level higher than the signal level of the reference signal S. If the second valid signal (high level)
Is a circuit for outputting. The third comparator 14 is a circuit for comparing the second line signal L 2 and the reference signal S, and when the second line signal L 2 includes a signal level higher than the signal level of the reference signal S. , A circuit for outputting a third valid signal (high level). The first to third comparators 12 to 14 output invalid signals (low level) when the line signals do not include a signal level higher than the signal level of the reference signal S. The logical sum circuit 15 is a logical sum (OR) of the outputs of the first to third comparators 12 to 14.
Is a circuit for calculating. That is, the first to third comparators 1
If any of 2 to 14 outputs a valid signal, the output of the OR circuit 15 is also set to valid (high level), and the suppression control circuit 7 is operated.
【００１４】以上の構成の高輝度着色防止回路１１にお
いて、基本ライン信号Ｌ0が高輝度の信号レベルを含む
場合、第１の比較器１２が第１の有効信号を出力する。
このため、例えば第２及び第３の比較器１３，１４が無
効信号を出力しても論理和回路１５の出力が有効に設定
され、抑圧制御回路７が動作する。そして、第１の遅延
ライン信号Ｌ1が高輝度の信号レベルを含む場合、第２
の比較器１３が第２の有効信号を出力する。このため、
例えば第１及び第３の比較器１２，１４が無効信号を出
力しても論理和回路１５の出力が有効に設定され、抑圧
制御回路７が動作する。さらに、第２の遅延ライン信号
Ｌ2が高輝度の信号レベルを含む場合、第３の比較器１
３が第３の有効信号を出力する。このため、例えば第１
及び第２の比較器１２，１３が無効信号を出力しても論
理和回路１５の出力が有効に設定され、抑圧制御回路７
が動作する。In the high-brightness coloring prevention circuit 11 having the above-described structure, when the basic line signal L 0 includes a high-brightness signal level, the first comparator 12 outputs the first effective signal.
Therefore, for example, even if the second and third comparators 13 and 14 output invalid signals, the output of the OR circuit 15 is set valid and the suppression control circuit 7 operates. If the first delay line signal L 1 includes a high brightness signal level, the second delay line signal L 1
Comparator 13 outputs the second valid signal. For this reason,
For example, even if the first and third comparators 12 and 14 output invalid signals, the output of the OR circuit 15 is set valid and the suppression control circuit 7 operates. Further, when the second delay line signal L 2 includes a high-brightness signal level, the third comparator 1
3 outputs a third valid signal. Therefore, for example, the first
Even if the second comparators 12 and 13 output an invalid signal, the output of the OR circuit 15 is set to be valid, and the suppression control circuit 7
Works.
【００１５】抑圧制御回路７が動作すると、輝度・色信
号処理回路２において生成される色信号の信号レベルが
抑圧される。従って、本発明の高輝度着色防止回路１１
は、基本ライン信号Ｌ0、第１の遅延ライン信号Ｌ1また
は第２の遅延ライン信号Ｌ2の何れかが高輝度の信号レ
ベルを含む場合、確実に抑圧制御回路７が動作し、色信
号の信号レベルの飽和による異常着色の発生を防止する
ことができる。When the suppression control circuit 7 operates, the signal level of the color signal generated in the luminance / color signal processing circuit 2 is suppressed. Therefore, the high brightness coloring prevention circuit 11 of the present invention
Means that if any of the basic line signal L 0 , the first delay line signal L 1 or the second delay line signal L 2 contains a high luminance signal level, the suppression control circuit 7 operates reliably and the color signal It is possible to prevent the occurrence of abnormal coloring due to saturation of the signal level of.
【００１６】本発明は以上の実施例に限定されない。実
施例では、単板式の撮像素子の出力を基に色差順次方式
を実現する構成を例に説明したが、単板式の撮像素子の
出力を基に輝度信号及び色信号を生成する構成ならば、
例えばＲＧＢ方式等の如何なる方式にも本発明を適用す
ることができる。The present invention is not limited to the above embodiments. In the embodiment, the configuration that realizes the color difference sequential method based on the output of the single-plate type image pickup element has been described as an example, but if the configuration generates the luminance signal and the color signal based on the output of the single-plate type image pickup element,
The present invention can be applied to any system such as the RGB system.
【００１７】[0017]
【発明の効果】以上の構成の本発明の高輝度着色防止回
路は、輝度・色信号処理回路における輝度信号及び色信
号の生成に係る基本ライン信号、第１の遅延ライン信号
または第２のライン信号の内、何れかが高輝度の信号レ
ベルを含む場合、確実に色信号の抑圧を実現する。従っ
て、高輝度の信号レベルによる異常着色を、確実に防止
することができる。The high-brightness coloring prevention circuit of the present invention having the above-described structure has the basic line signal, the first delay line signal or the second line relating to the generation of the luminance signal and the color signal in the luminance / color signal processing circuit. When any of the signals includes a high-brightness signal level, color signal suppression is surely realized. Therefore, it is possible to reliably prevent abnormal coloring due to the high brightness signal level.
【図１】本発明の高輝度着色防止回路のブロック図であ
る。FIG. 1 is a block diagram of a high-luminance coloring prevention circuit of the present invention.
【図２】従来の高輝度着色防止回路のブロック図であ
る。FIG. 2 is a block diagram of a conventional high brightness coloring prevention circuit.
【符号の説明】 ３ 第１の遅延回路 ４ 第２の遅延回路 ５ 加算回路 ７ 抑圧制御回路 １２ 第１の比較器 １３ 第２の比較器 １４ 第３の比較器 １５ 論理和回路 Ｌ0 基本ライン信号 Ｌ1 第１の遅延ライン信号 Ｌ2 第２の遅延ライン信号 Ｌa 加算ライン信号[Description of Reference Signs] 3 first delay circuit 4 second delay circuit 5 adder circuit 7 suppression control circuit 12 first comparator 13 second comparator 14 third comparator 15 logical sum circuit L 0 basic line Signal L 1 First delay line signal L 2 Second delay line signal L a Summing line signal
Claims (1)
て第１の遅延ライン信号を出力する第１の遅延回路と、 前記第１の遅延ライン信号を遅延させて、第２の遅延ラ
イン信号を出力する第２の遅延回路と、 別途入力する基準信号と前記基本ライン信号とを比較
し、当該基本ライン信号の信号レベルが当該基準信号の
信号レベルを超える場合、第１の有効信号を出力する第
１の比較器と、 前記基準信号と前記第１の遅延ライン信号とを比較し、
当該第１の遅延ライン信号の信号レベルが当該基準信号
の信号レベルを超える場合、第２の有効信号を出力する
第２の比較器と、 前記基準信号と前記第２の遅延ライン信号とを比較し、
当該第２の遅延ライン信号の信号レベルが当該基準信号
の信号レベルを超える場合、第３の有効信号を出力する
第３の比較器と、 前記第１乃至第３の有効信号の論理和を演算し、当該演
算の結果に基づいて前記第１乃至第３の有効信号の何れ
かを出力して色信号を抑圧する抑圧制御回路を動作させ
る論理和回路とを備えたことを特徴とする高輝度着色防
止回路。1. A single-plate type image pickup device, a first delay circuit for delaying a basic line signal output from the image pickup device to output a first delay line signal, and the first delay line signal A second delay circuit that delays and outputs a second delay line signal is compared with a separately input reference signal and the basic line signal, and the signal level of the basic line signal is compared with the signal level of the reference signal. If it exceeds, a first comparator that outputs a first valid signal is compared with the reference signal and the first delay line signal,
When the signal level of the first delay line signal exceeds the signal level of the reference signal, a second comparator that outputs a second valid signal is compared with the reference signal and the second delay line signal. Then
When the signal level of the second delay line signal exceeds the signal level of the reference signal, a third comparator that outputs a third valid signal and a logical sum of the first to third valid signals are calculated. And a logical sum circuit for operating a suppression control circuit for suppressing any color signal by outputting any one of the first to third effective signals based on the result of the calculation. Color prevention circuit.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5120516A JPH06311519A (en) | 1993-04-23 | 1993-04-23 | High luminance coloring prevention circuit |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5120516A JPH06311519A (en) | 1993-04-23 | 1993-04-23 | High luminance coloring prevention circuit |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH06311519A true JPH06311519A (en) | 1994-11-04 |
Family
ID=14788169
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP5120516A Withdrawn JPH06311519A (en) | 1993-04-23 | 1993-04-23 | High luminance coloring prevention circuit |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH06311519A (en) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US7494710B2 (en) | 2001-03-30 | 2009-02-24 | Jgc Catalysts And Chemicals Ltd. | Fine metal particles suitable for forming a conductive coating film |
-
1993
- 1993-04-23 JP JP5120516A patent/JPH06311519A/en not_active Withdrawn
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US7494710B2 (en) | 2001-03-30 | 2009-02-24 | Jgc Catalysts And Chemicals Ltd. | Fine metal particles suitable for forming a conductive coating film |
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