JPH06224763A - Ａ／ｄ変換回路 - Google Patents
Ａ／ｄ変換回路Info
- Publication number
- JPH06224763A JPH06224763A JP961493A JP961493A JPH06224763A JP H06224763 A JPH06224763 A JP H06224763A JP 961493 A JP961493 A JP 961493A JP 961493 A JP961493 A JP 961493A JP H06224763 A JPH06224763 A JP H06224763A
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- JP
- Japan
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- converter
- resolution
- signal
- input
- input signal
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- Pending
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Abstract
(57)【要約】
【目的】 予め決まった分解能を持つＡ／Ｄ変換器を用
いて、それよりも高い分解能を容易に得られるようにす
る。 【構成】 所定の分解能を持つＡ／Ｄ変換器２の前段に
は、入力信号に三角波やのこぎり波などの微小な交流信
号を加算する加算器１を設ける一方、Ａ／Ｄ変換器２の
後段には積分器３を設け、この積分器３を介してＡ／Ｄ
変換器２の出力を平均化することにより、実質的に分解
能を向上させる。
いて、それよりも高い分解能を容易に得られるようにす
る。 【構成】 所定の分解能を持つＡ／Ｄ変換器２の前段に
は、入力信号に三角波やのこぎり波などの微小な交流信
号を加算する加算器１を設ける一方、Ａ／Ｄ変換器２の
後段には積分器３を設け、この積分器３を介してＡ／Ｄ
変換器２の出力を平均化することにより、実質的に分解
能を向上させる。
Description
【０００１】
【産業上の利用分野】この発明は、分解能を上げること
が可能なＡ／Ｄ（アナログ／ディジタル）変換回路に関
する。
が可能なＡ／Ｄ（アナログ／ディジタル）変換回路に関
する。
【０００２】
【従来の技術】従来、この種のＡ／Ｄ変換器は固有の分
解能を有しており、例えば８ビット変換器，１０ビット
変換器のようにそのビット数が予め決められているのが
一般的である。
解能を有しており、例えば８ビット変換器，１０ビット
変換器のようにそのビット数が予め決められているのが
一般的である。
【０００３】
【発明が解決しようとする課題】このため、高い分解能
を必要とするときは、ビット数の多い変換器を用いなけ
ればならないことから、一般にコスト高になるという問
題がある。したがって、この発明の課題は予め決まった
ビット数のＡ／Ｄ変換器を用いて、それよりも高い分解
能を得ることができるＡ／Ｄ変換回路を提供することに
ある。
を必要とするときは、ビット数の多い変換器を用いなけ
ればならないことから、一般にコスト高になるという問
題がある。したがって、この発明の課題は予め決まった
ビット数のＡ／Ｄ変換器を用いて、それよりも高い分解
能を得ることができるＡ／Ｄ変換回路を提供することに
ある。
【０００４】
【課題を解決するための手段】このような課題を解決す
るため、この発明では、Ａ／Ｄ（アナログ／ディジタ
ル）変換器の入力側には入力信号に三角波，のこぎり波
を含む微小な交流信号を加算する加算器を設ける一方、
Ａ／Ｄ変換器の出力側には変換器出力を平均化する積分
器を設けたことを特徴としている。
るため、この発明では、Ａ／Ｄ（アナログ／ディジタ
ル）変換器の入力側には入力信号に三角波，のこぎり波
を含む微小な交流信号を加算する加算器を設ける一方、
Ａ／Ｄ変換器の出力側には変換器出力を平均化する積分
器を設けたことを特徴としている。
【０００５】
【作用】或る一定の分解能を持つＡ／Ｄ変換器の入力信
号に、三角波，のこぎり波を含む微小な交流信号を重畳
し、Ａ／Ｄ変換器の出力を平均化するだけの簡単な構成
により、Ａ／Ｄ変換器の分解能を向上させる。
号に、三角波，のこぎり波を含む微小な交流信号を重畳
し、Ａ／Ｄ変換器の出力を平均化するだけの簡単な構成
により、Ａ／Ｄ変換器の分解能を向上させる。
【０００６】
【実施例】図１はこの発明の実施例を示すブロック図
で、１は演算増幅器（オペアンプ）ＯＰおよび抵抗Ｒ１
〜Ｒ３などからなる加算器、２は低分解能のＡ／Ｄ変換
器、３は積分器である。Ｔ１は信号入力端子、Ｔ２は付
加信号の入力端子をそれぞれ示している。すなわち、或
る一定の分解能を持つＡ／Ｄ変換器２の入力側には加算
器１を、またその出力側には積分器３をそれぞれ付加
し、加算器１により入力信号に図のような三角波Ｐ１を
重畳して、Ａ／Ｄ変換器２でＡ／Ｄ変換を行なわせ、し
かる後積分器３によりその出力を平均化する。このと
き、積分器３はディジタル信号を積分することから、マ
イコン等のソフト処理によって積分機能を持たせるよう
にしたものが用いられる。
で、１は演算増幅器（オペアンプ）ＯＰおよび抵抗Ｒ１
〜Ｒ３などからなる加算器、２は低分解能のＡ／Ｄ変換
器、３は積分器である。Ｔ１は信号入力端子、Ｔ２は付
加信号の入力端子をそれぞれ示している。すなわち、或
る一定の分解能を持つＡ／Ｄ変換器２の入力側には加算
器１を、またその出力側には積分器３をそれぞれ付加
し、加算器１により入力信号に図のような三角波Ｐ１を
重畳して、Ａ／Ｄ変換器２でＡ／Ｄ変換を行なわせ、し
かる後積分器３によりその出力を平均化する。このと
き、積分器３はディジタル信号を積分することから、マ
イコン等のソフト処理によって積分機能を持たせるよう
にしたものが用いられる。
【０００７】このようにすれば、例えば図２にＡで示す
ような信号の入力時にＢの如き信号を重畳すれば、Ａ／
Ｄ変換器２としてはこれを分解能の上のレベルＬｔまた
は下のレベルＬｂのいずれかとして読む確率を高くする
ことができ、その確率は入力信号の大きさによって変わ
る。例えば、図示のように入力信号が丁度中間のレベル
にあるときは、上のレベルＬｔとして読む確率，または
下のレベルＬｂとして読む確率はそれぞれ５０％ずつと
いうことになる。したがって、Ａ／Ｄ変換器２で読み込
んだ値を平均化することにより、使用しているＡ／Ｄ変
換器２の分解能以上の分解能を得ることが可能となる。
ような信号の入力時にＢの如き信号を重畳すれば、Ａ／
Ｄ変換器２としてはこれを分解能の上のレベルＬｔまた
は下のレベルＬｂのいずれかとして読む確率を高くする
ことができ、その確率は入力信号の大きさによって変わ
る。例えば、図示のように入力信号が丁度中間のレベル
にあるときは、上のレベルＬｔとして読む確率，または
下のレベルＬｂとして読む確率はそれぞれ５０％ずつと
いうことになる。したがって、Ａ／Ｄ変換器２で読み込
んだ値を平均化することにより、使用しているＡ／Ｄ変
換器２の分解能以上の分解能を得ることが可能となる。
【０００８】図３はＡ／Ｄ変換器の入力回路例を示す回
路図である。これは、端子Ｔ１に入力される入力信号に
対し、端子Ｔ２からスイッチング素子ＴＲを介してＰ２
の如きパルス信号を与えるようにしたものである。な
お、入力信号に重畳する微小信号（付加または重畳信
号）としては、この外にのこぎり波や台形波なども考え
られる。また、Ｖｃｃは電源電圧、端子Ｔ３，Ｔ４はＡ
／Ｄ変換器の接続端子をそれぞれ示している。
路図である。これは、端子Ｔ１に入力される入力信号に
対し、端子Ｔ２からスイッチング素子ＴＲを介してＰ２
の如きパルス信号を与えるようにしたものである。な
お、入力信号に重畳する微小信号（付加または重畳信
号）としては、この外にのこぎり波や台形波なども考え
られる。また、Ｖｃｃは電源電圧、端子Ｔ３，Ｔ４はＡ
／Ｄ変換器の接続端子をそれぞれ示している。
【０００９】
【発明の効果】この発明によれば、ある一定の分解能を
持つＡ／Ｄ変換器の入力信号に、三角波，のこぎり波を
含む微小な交流信号を重畳し、Ａ／Ｄ変換器の出力を平
均化するだけの簡単，かつ安価な構成で、容易にＡ／Ｄ
変換器の分解能を上げられるという利点が得られる。
持つＡ／Ｄ変換器の入力信号に、三角波，のこぎり波を
含む微小な交流信号を重畳し、Ａ／Ｄ変換器の出力を平
均化するだけの簡単，かつ安価な構成で、容易にＡ／Ｄ
変換器の分解能を上げられるという利点が得られる。
【図１】この発明の実施例を示すブロック図である。
【図２】この発明の作用を説明するための説明図であ
る。
る。
【図３】図１における入力回路の別の例を示す回路図で
ある。
ある。
１…加算器、２…Ａ／Ｄ変換器、３…積分器、ＯＰ…演
算増幅器（オペアンプ）、Ｐ１，Ｐ２…付加（重畳）信
号、ＴＲ…スイッチング素子、Ｔ１〜Ｔ３…端子、Ｖｃ
ｃ…電源電圧。
算増幅器（オペアンプ）、Ｐ１，Ｐ２…付加（重畳）信
号、ＴＲ…スイッチング素子、Ｔ１〜Ｔ３…端子、Ｖｃ
ｃ…電源電圧。
Claims (1)
- 【請求項１】 Ａ／Ｄ（アナログ／ディジタル）変換器
の入力側には入力信号に三角波，のこぎり波を含む微小
な交流信号を加算する加算器を設ける一方、Ａ／Ｄ変換
器の出力側には変換器出力を平均化する積分器を設けた
ことを特徴とするＡ／Ｄ変換回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP961493A JPH06224763A (ja) | 1993-01-25 | 1993-01-25 | Ａ／ｄ変換回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP961493A JPH06224763A (ja) | 1993-01-25 | 1993-01-25 | Ａ／ｄ変換回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH06224763A true JPH06224763A (ja) | 1994-08-12 |
Family
ID=11725175
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP961493A Pending JPH06224763A (ja) | 1993-01-25 | 1993-01-25 | Ａ／ｄ変換回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH06224763A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2003525436A (ja) * | 2000-03-01 | 2003-08-26 | レイセオン・カンパニー | 改良された光ファイバジャイロスコープ |
-
1993
- 1993-01-25 JP JP961493A patent/JPH06224763A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2003525436A (ja) * | 2000-03-01 | 2003-08-26 | レイセオン・カンパニー | 改良された光ファイバジャイロスコープ |
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