JPH0583847A - Alarm detector power supply unit - Google Patents
Alarm detector power supply unitInfo
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- JPH0583847A JPH0583847A JP3241963A JP24196391A JPH0583847A JP H0583847 A JPH0583847 A JP H0583847A JP 3241963 A JP3241963 A JP 3241963A JP 24196391 A JP24196391 A JP 24196391A JP H0583847 A JPH0583847 A JP H0583847A
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Abstract
Description
【０００１】[0001]
【産業上の利用分野】本発明は電源ユニットのアラーム
検出装置に係り、特に電源ユニットが故障した場合にア
ラーム検出を行なうアラーム検出装置に関する。BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to an alarm detecting device for a power supply unit, and more particularly to an alarm detecting device for detecting an alarm when the power supply unit fails.
【０００２】近年の情報処理装置等の電子機器では、処
理するデータ量の増大によって所定電力量が増加したの
に伴い、電源ユニットを並列運転して大容量、高信頼性
化を図ることが多くなってきた。In recent years, in electronic devices such as information processing devices, as the amount of data to be processed has increased a predetermined amount of electric power, the power supply units are often operated in parallel to achieve a large capacity and high reliability. It's coming.
【０００３】図５は、本発明者が先に特願平３−１１９
３４６号にて提案した電源ユニットの並列運転方式の一
例の構成図を示す。同図中、同一構成の３台の電源ユニ
ット１，２及び３の各出力端子＋ＯＵＴ、−ＯＵＴ間に
は共通の負荷抵抗Ｒが接続され、また電流バランス端子
ＣＢが共通線ＬＮを介して接続されている。FIG. 5 shows that the present inventor has previously proposed Japanese Patent Application No. 3-119.
The block diagram of an example of the parallel operation system of the power supply unit proposed by No. 346 is shown. In the figure, a common load resistor R is connected between the output terminals + OUT and -OUT of three power supply units 1, 2 and 3 having the same configuration, and a current balance terminal CB is connected via a common line LN. Has been done.
【０００４】また、電源ユニット１，２及び３の夫々は
基準電圧出力端子ＶＢＯと基準電圧入力端子ＶＢＩとを
有し、各基準電圧入力端子ＶＢＩがマスタとなる電源ユ
ニット１の基準電圧出力端子ＶＢＯに共通接続されてい
る。これにより、スレーブとなる電源ユニット２及び３
はマスタ電源ユニット１と同一の基準電圧で決定される
出力電圧ＶＯ２，ＶＯ３を発生する。電源ユニット１は
出力電圧ＶＯ１を出力する。Further, each of the power supply units 1, 2 and 3 has a reference voltage output terminal VBO and a reference voltage input terminal VBI, and each reference voltage input terminal VBI serves as a master, the reference voltage output terminal VBO of the power supply unit 1. Commonly connected to. As a result, the power supply units 2 and 3 which are slaves
Generates output voltages VO2 and VO3 determined by the same reference voltage as that of the master power supply unit 1. The power supply unit 1 outputs the output voltage VO1.
【０００５】かかる接続構成とすることにより、マスタ
電源ユニット１の基準電圧を調整するだけで、同時にス
レーブ電源ユニット２及び３の基準電圧も調整すること
ができることとなり、操作性を向上することできる。With such a connection configuration, the reference voltage of the slave power supply units 2 and 3 can be adjusted at the same time by adjusting the reference voltage of the master power supply unit 1, and the operability can be improved.
【０００６】このような構成の電源ユニット１〜３の各
々は、故障した場合にその出力電圧ＶＯ１〜ＶＯ３の低
下又は上昇をある範囲内に抑えることにより、システム
ダウンさせないようにしているが、故障した電源ユニッ
トの保守交換を行なって装置の信頼度を増すために、故
障した装置からアラーム検出信号を取り出すことが必要
とされる。Each of the power supply units 1 to 3 having the above-mentioned structure prevents the system from going down by suppressing the decrease or increase of the output voltages VO1 to VO3 within a certain range when a failure occurs. In order to perform maintenance replacement of the power supply unit and increase the reliability of the device, it is necessary to take out the alarm detection signal from the failed device.
【０００７】[0007]
【従来の技術】図６は本発明者が前記した電源ユニット
の並列運転方式で提案した電源ユニットの一例の回路図
を示す。なお、電源ユニットには電流バランス回路も存
在するが、電源ユニット１〜３の出力電源がバランスし
ているときは各電源ユニット１〜３はＣＢ端子を接続し
ていないときと同じ動作（電流バランス回路が存在しな
いとき同じ動作）を行なうため、また、出力電流のバラ
ンスに関しては本発明と関係がないため、電源ユニット
１〜３の出力電流がバランスしているものとし、電流バ
ランス回路の図示は省略してある。2. Description of the Related Art FIG. 6 shows a circuit diagram of an example of a power supply unit proposed by the present inventor in the parallel operation method of power supply units. Although there is a current balance circuit in the power supply unit, when the output power of the power supply units 1 to 3 is balanced, each power supply unit 1 to 3 operates in the same manner as when the CB terminals are not connected (current balance circuit). Since the same operation is performed when a circuit does not exist) and the output current balance is not related to the present invention, it is assumed that the output currents of the power supply units 1 to 3 are balanced. Omitted.
【０００８】図６において、電源ユニットは大別して基
準電圧発生回路５、上限リミッタ回路６、下限リミッタ
回路７、演算増幅器８、出力電圧検出回路９、ＰＷＭ／
ＦＭ制御回路１０及びその他周辺回路（図示せず）より
なる。In FIG. 6, the power supply units are roughly classified into a reference voltage generation circuit 5, an upper limit limiter circuit 6, a lower limit limiter circuit 7, an operational amplifier 8, an output voltage detection circuit 9, and a PWM /
It is composed of the FM control circuit 10 and other peripheral circuits (not shown).
【０００９】基準電圧発生回路５はレベル調整可能な基
準電圧源５１の正側端子が基準電圧出力端子ＶＢＯに接
続され、更にこの電源ユニットがマスタ電源ユニットの
場合は、基準電圧出力端子ＶＢＯが基準電圧入力端子Ｖ
ＢＩを介して演算増幅器ＭＲの非反転入力端子に接続さ
れている。演算増幅器ＭＲの出力端子は抵抗ＲR を介し
て演算増幅器８の非反転入力端子に接続されている。こ
の基準電圧発生回路５は基準電圧ＶR （例えば２．５
Ｖ）を発生する。In the reference voltage generating circuit 5, the positive terminal of the reference voltage source 51 whose level can be adjusted is connected to the reference voltage output terminal VBO, and when this power supply unit is the master power supply unit, the reference voltage output terminal VBO is the reference. Voltage input terminal V
It is connected to the non-inverting input terminal of the operational amplifier MR via BI. The output terminal of the operational amplifier MR is connected to the non-inverting input terminal of the operational amplifier 8 via the resistor R R. The reference voltage generating circuit 5 has a reference voltage V R (for example, 2.5 V).
V) is generated.
【００１０】上限リミッタ回路６は基準電圧ＶR の上限
を制御するための回路で、電圧ＶU （例えば２．６Ｖ）
を発生する電圧源６１と、演算増幅器ＭＵ、ダイオード
ＤU 及び抵抗ＲU からなる。演算増幅器ＭＵは非反転入
力端子に電圧源６１の正側端子が接続され、出力端子が
ダイオードＤU のカソード、アノード及び抵抗ＲU を介
して反転入力端子に接続された構成とされている。The upper limit limiter circuit 6 is a circuit for controlling the upper limit of the reference voltage V R , and has a voltage V U (for example, 2.6 V).
It comprises a voltage source 61 for generating, an operational amplifier MU, a diode D U and a resistor R U. The operational amplifier MU is configured such that the non-inverting input terminal is connected to the positive terminal of the voltage source 61, and the output terminal is connected to the inverting input terminal via the cathode and anode of the diode D U and the resistor R U.
【００１１】下限リミッタ回路７は基準電圧ＶR の下限
を制限するための回路で、電圧ＶD （例えば２．４Ｖ）
を発生する電圧源７１と、演算増幅器ＭＤ、ダイオード
ＤD 及び抵抗ＲD からなる。演算増幅器ＭＤは非反転入
力端子に電圧源７１の正側端子が接続され、出力端子が
ダイオードＤD のアノード、カソード及び抵抗ＲD を介
して反転入力端子に接続されている。The lower limit limiter circuit 7 is a circuit for limiting the lower limit of the reference voltage V R , and has a voltage V D (for example, 2.4 V).
It is composed of a voltage source 71 for generating the voltage, an operational amplifier MD, a diode D D and a resistor R D. The non-inverting input terminal of the operational amplifier MD is connected to the positive terminal of the voltage source 71, and the output terminal thereof is connected to the inverting input terminal via the anode and cathode of the diode D D and the resistor R D.
【００１２】演算増幅器８は出力電圧検出回路９の出力
電圧（例えば５Ｖ）を、夫々抵抗値が例えば１０ｋΩで
ある抵抗Ｒ1 及びＲ2 で分圧した電圧と、前記演算増幅
器ＭＲ，ＭＵ及びＭＤの各反転入力端子と抵抗ＲR ，Ｒ
U 及びＲD との接続点から取り出される基準電圧Ｖref
とを差動増幅する回路で、その出力電圧をＰＷＭ／ＦＭ
制御回路１０へ出力する。The operational amplifier 8 divides the output voltage (for example, 5 V) of the output voltage detection circuit 9 by resistors R 1 and R 2 each having a resistance value of, for example, 10 kΩ, and the operational amplifiers MR, MU and MD. Each inverting input terminal and resistance R R , R
Reference voltage V ref taken from the connection point with U and R D
Is a circuit that differentially amplifies the output voltage of PWM / FM
Output to the control circuit 10.
【００１３】ＰＷＭ／ＦＭ制御回路１０は入力電圧レベ
ルに応じて出力パルス幅変調（ＰＷＭ）信号のパルス幅
又は出力周波数変調（ＦＭ）信号の周波数を可変して、
図示しないスイッチングトランジスタのスイッチング速
度を制御することにより、そのスイッチングトランジス
タのコレクタ側に接続されたトランス（図示せず）の出
力レベルを制御し、出力電圧検出回路９で検出される出
力電圧を一定とするよう作用する。The PWM / FM control circuit 10 varies the pulse width of the output pulse width modulation (PWM) signal or the frequency of the output frequency modulation (FM) signal according to the input voltage level,
By controlling the switching speed of the switching transistor (not shown), the output level of the transformer (not shown) connected to the collector side of the switching transistor is controlled, and the output voltage detected by the output voltage detection circuit 9 is kept constant. Act to do.
【００１４】かかる構成の電源ユニットにおいて、基準
電圧発生回路５の基準電圧源５１から正規の値（例えば
２．５Ｖ）の基準電圧ＶR が取り出されるときは、ボル
テージフォロワを構成する演算増幅器ＭＲの出力電圧も
ＶR となる。一方、演算増幅器ＭＵの出力電圧はＶ
U で、ＶR ＜ＶU であるためダイオードＤU がオフとさ
れる。また、演算増幅器ＭＤの出力電圧は電圧源７１か
らの電圧ＶD で、これはＶ R ＞ＶD の関係にあるため、
ダイオードＤD がオフとされる。In the power supply unit having such a configuration, the reference
From the reference voltage source 51 of the voltage generation circuit 5, a normal value (for example,
2.5V) reference voltage VRWhen the
Also the output voltage of the operational amplifier MR that constitutes the stage follower
VRBecomes On the other hand, the output voltage of the operational amplifier MU is V
UAnd VR<VUTherefore, diode DUIs off
Be done. The output voltage of the operational amplifier MD is the voltage source 71.
Voltage VDSo this is V R> VDBecause of the relationship
Diode DDIs turned off.
【００１５】従って、基準電圧発生回路５から正規の値
の基準電圧ＶR が取り出されたときは、演算増幅器８の
非反転入力端子に供給される電圧Ｖref は基準電圧ＶR
と等しくなる。Therefore, when the reference voltage V R having a normal value is taken out from the reference voltage generating circuit 5, the voltage V ref supplied to the non-inverting input terminal of the operational amplifier 8 is the reference voltage V R.
Is equal to
【００１６】一方、基準電圧発生回路５などの故障によ
り、基準電圧発生回路５から正規の基準電圧ＶR が取り
出されず、例えば下限リミッタ回路７の電圧源７１の電
圧Ｖ D より小となる電圧が基準電圧発生回路５より取り
出されるときは、演算増幅器ＭＵの出力電圧ＶU は電圧
ＶR より大であるため、正常時と同様にダイオードＤ U
がオフであるが、演算増幅器ＭＤの出力電圧ＶD が電圧
ＶR より小であるため、正常時と異なりダイオードＤD
がオンとなる。On the other hand, a failure of the reference voltage generating circuit 5, etc.
From the reference voltage generation circuit 5 to the regular reference voltage VRTake
Is not output, for example, the voltage of the voltage source 71 of the lower limit limiter circuit 7
Pressure V DThe smaller voltage is taken from the reference voltage generation circuit 5.
When output, the output voltage V of the operational amplifier MUUIs the voltage
VRSince it is larger, the diode D is U
Is off, but the output voltage V of the operational amplifier MDDIs the voltage
VRSince it is smaller than normal, diode DD
Turns on.
【００１７】これにより、演算増幅器８の非反転入力端
子の入力電圧Ｖref は略ＶD に等しくなり、ＶD より小
なる基準電圧の低下が補償される。これにより、出力電
圧検出回路９で検出される出力電圧は、正常時の５Ｖに
比し、４．８Ｖ程度とされ、それ以下の低下は阻止され
る。As a result, the input voltage V ref at the non-inverting input terminal of the operational amplifier 8 becomes substantially equal to V D , and the drop of the reference voltage smaller than V D is compensated. As a result, the output voltage detected by the output voltage detection circuit 9 is set to about 4.8 V, which is lower than 5 V in the normal state, and a decrease below that is prevented.
【００１８】また、基準電圧発生回路５から上限リミッ
タ回路６の電圧源６１の電圧ＶU より大なる電圧が取り
出されるような異常発生時は、上記の説明から明らかに
類推できるように、ダイオードＤU 及びＤD のうちＤU
がオンとなり、演算増幅器８の非反転入力端子の入力電
圧Ｖref が略ＶU となり、ＶU より大なる基準電圧の異
常上昇を補償することができる。このときの出力電圧は
例えば５．２Ｖ程度となる。Further, when an abnormality occurs in which a voltage higher than the voltage V U of the voltage source 61 of the upper limit limiter circuit 6 is taken out from the reference voltage generating circuit 5, as can be clearly inferred from the above description, the diode D D U out of U and D D
Is turned on, the input voltage V ref of the non-inverting input terminal of the operational amplifier 8 becomes approximately V U , and it is possible to compensate for an abnormal rise in the reference voltage higher than V U. The output voltage at this time is, for example, about 5.2V.
【００１９】[0019]
【発明が解決しようとする課題】このように、上記の電
源ユニットでは基準電圧が変動しても所定の電圧範囲内
に基準電圧及び出力電圧が収まるよう制御されるため、
従来の電源ユニットに取り付けられているような低電圧
検出回路や過電圧保護回路では、この基準電圧の低下や
上昇を検出できず、よってアラーム信号を出力すること
ができない。As described above, in the above power supply unit, the reference voltage and the output voltage are controlled so as to be within the predetermined voltage range even if the reference voltage fluctuates.
The low voltage detection circuit and the overvoltage protection circuit, which are attached to the conventional power supply unit, cannot detect the decrease or increase of the reference voltage, and therefore cannot output the alarm signal.
【００２０】また、上記の低電圧検出回路や、過電圧保
護回路の検出レベル（閾値）を変えることによってアラ
ーム信号を発生するようにすることはできるが、上記の
低電圧検出回路や過電圧保護回路で検出レベルと比較さ
れる出力電圧は、正常時と異常時とで例えば０．２Ｖ程
度の微小な差しかないため、ノイズなどにより正常であ
るにも拘らず異常としてアラーム信号が出力されるよう
な誤動作を引き起こすことが多い。Although the alarm signal can be generated by changing the detection level (threshold value) of the low voltage detection circuit or the overvoltage protection circuit, the low voltage detection circuit or the overvoltage protection circuit can be used. The output voltage compared with the detection level has a small difference of, for example, about 0.2 V between a normal time and an abnormal time, and thus a malfunction in which an alarm signal is output as an abnormal though it is normal due to noise or the like. Often cause.
【００２１】本発明は以上の点に鑑みなされたもので、
基準電圧を上限及び下限値に制限する回路を利用してア
ラーム検出を行なうことにより、上記の課題を解決した
電源ユニットのアラーム検出装置を提供することを目的
とする。The present invention has been made in view of the above points,
It is an object of the present invention to provide an alarm detection device for a power supply unit that solves the above problems by performing alarm detection using a circuit that limits a reference voltage to an upper limit and a lower limit.
【００２２】[0022]
【課題を解決するための手段】図１は本発明の原理ブロ
ック図を示す。本発明は基準電圧発生回路よりの基準電
圧と出力電圧とを比較し、両者の差に応じて出力電圧を
一定とするスイッチング制御を行なう電源ユニットにお
いて、電圧制限回路１１とアラーム信号出力回路１２と
を具備するようにしたものである。FIG. 1 shows a block diagram of the principle of the present invention. The present invention compares a reference voltage from a reference voltage generation circuit with an output voltage, and in a power supply unit that performs switching control to keep the output voltage constant according to the difference between the two, a voltage limiting circuit 11 and an alarm signal output circuit 12 are provided. It is equipped with.
【００２３】ここで、電圧制限回路１１は前記基準電圧
が設定値を越えたことを検出したとき、予め設定した値
の電圧を基準電圧として出力する。また、アラーム信号
出力回路１２は、電圧制限回路１１が前記基準電圧が前
記設定値を越えたことを検出したときの検出信号を、前
記基準電圧の異常を示すアラーム信号として出力する。Here, when the voltage limiting circuit 11 detects that the reference voltage exceeds the set value, it outputs a voltage having a preset value as the reference voltage. Further, the alarm signal output circuit 12 outputs a detection signal when the voltage limiting circuit 11 detects that the reference voltage exceeds the set value as an alarm signal indicating an abnormality of the reference voltage.
【００２４】[0024]
【作用】本発明では、電圧制御回路１１により基準電圧
が設定値を越えたとき、予め設定した値の電圧を基準電
圧としているため、基準電圧により決定される電源ユニ
ットの出力電圧は、基準電圧が大きく変化してもそれほ
ど変化しない。In the present invention, when the reference voltage exceeds the set value by the voltage control circuit 11, the voltage of the preset value is used as the reference voltage. Therefore, the output voltage of the power supply unit determined by the reference voltage is the reference voltage. Does not change so much even if changes greatly.
【００２５】一方、電圧制限回路１１において基準電圧
が設定値を越えたことを検出したときの検出信号は、検
出していないときの信号に比し、ロジック的にレベルが
大きく変化する。そこで、本発明では電圧制限回路１１
の検出信号をアラーム信号出力回路１２により波形整形
して、基準電圧が異常であることを知らせるためのアラ
ーム信号を出力するようにしたものである。On the other hand, the detection signal when the voltage limiter circuit 11 detects that the reference voltage exceeds the set value has a logically large level change as compared with the signal when it is not detected. Therefore, in the present invention, the voltage limiting circuit 11
The alarm signal output circuit 12 shapes the waveform of the detection signal of (1) to output an alarm signal for notifying that the reference voltage is abnormal.
【００２６】[0026]
【実施例】図２は本発明の一実施例の回路図を示す。同
図中、図６と同一構成部分には同一符号を付してある。
図２において、１１ａ及び１１ｂは夫々電圧制限回路
で、前記電圧制限回路１１に相当する。電圧制限回路１
１ａは図６の上限リミッタ回路６と同一回路構成で、電
圧源６１と、第１の比較回路を構成する演算増幅器ＭＵ
と、第１のダイオードを構成するダイオードＤU と抵抗
ＲU とからなる。2 is a circuit diagram of an embodiment of the present invention. In the figure, the same components as those in FIG. 6 are designated by the same reference numerals.
In FIG. 2, 11 a and 11 b are voltage limiting circuits, which correspond to the voltage limiting circuit 11. Voltage limiting circuit 1
1a has the same circuit configuration as the upper limiter circuit 6 of FIG.
And a resistor R U and a diode D U forming a first diode.
【００２７】電圧制限回路１１ｂは図６の下限リミッタ
回路７と同一回路構成で、電圧源７１と、第２の比較回
路を構成する演算増幅器ＭＤと、第２のダイオードを構
成するダイオードＤD と抵抗ＲD とからなる。The voltage limiting circuit 11b has the same circuit configuration as the lower limit limiter circuit 7 of FIG. 6, and includes a voltage source 71, an operational amplifier MD which constitutes a second comparison circuit, and a diode D D which constitutes a second diode. It consists of a resistor R D.
【００２８】また、１２ａ及び１２ｂは夫々アラーム信
号出力回路で、前記したアラーム信号出力回路１２に相
当する。アラーム信号出力回路１２ａは演算増幅器ＭＵ
の出力端子とダイオードＤU のカソードとの接続点に一
端が接続された抵抗Ｒ1 と、抵抗Ｒ1 の他端と接地間に
接続されたコンデンサＣ1 と、抵抗Ｒ1 及びコンデンサ
Ｃ1 の接続点に入力端子が接続された反転増幅器２１と
よりなる。Reference numerals 12a and 12b are alarm signal output circuits, which correspond to the alarm signal output circuit 12 described above. The alarm signal output circuit 12a is an operational amplifier MU.
Of the resistor R 1 whose one end is connected to the connection point between the output terminal of the resistor and the cathode of the diode D U , the capacitor C 1 connected between the other end of the resistor R 1 and the ground, and the resistor R 1 and the capacitor C 1 . The inverting amplifier 21 has an input terminal connected to the connection point.
【００２９】もう一方のアラーム信号出力回路１２は演
算増幅器ＭＤの出力端子とダイオードＤD のアノードと
の接続点に一端が接続された抵抗Ｒ2 と、抵抗Ｒ2 の他
端と接地間に接続されたコンデンサＣ2 と、抵抗Ｒ2 及
びコンデンサＣ2 の接続点に入力端子が接続された非反
転増幅器２２とよりなる。The other alarm signal output circuit 12 is connected between a resistor R 2 having one end connected to the connection point between the output terminal of the operational amplifier MD and the anode of the diode D D , and the other end of the resistor R 2 and the ground. a capacitor C 2, which is an input terminal to a connection point of the resistor R 2 and capacitor C 2 is further a non-inverting amplifier 22 connected.
【００３０】ここで、アラーム信号出力回路１２ａ，１
２ｂにおいて、反転増幅器２１は例えば１個のインバー
タで構成され、また非反転増幅器２２は例えば２個のイ
ンバータの縦続接続で構成され、入力電圧が所定の閾値
以上のときハイレベル、閾値未満のときローレベルの２
値の出力信号を出力する構成とされている。Here, the alarm signal output circuits 12a, 1
In 2b, the inverting amplifier 21 is composed of, for example, one inverter, and the non-inverting amplifier 22 is composed of, for example, a cascade connection of two inverters. Low level 2
It is configured to output a value output signal.
【００３１】また、抵抗Ｒ1 及びコンデンサＣ1 と抵抗
Ｒ2 及びコンデンサＣ2 は夫々積分回路を構成してお
り、ノイズ等による瞬間的なレベル変動によって反転増
幅器２１及び非反転増幅器２２が誤動作しないように設
けられている。Further, the resistor R 1 and the capacitor C 1 and the resistor R 2 and the capacitor C 2 respectively form an integrating circuit, and the inverting amplifier 21 and the non-inverting amplifier 22 do not malfunction due to an instantaneous level change due to noise or the like. Is provided.
【００３２】次に本実施例の動作について説明する。基
準電圧発生回路５から正規の電圧値２．５Ｖが出力され
る正常時には、図６と共に説明したように、ダイオード
ＤU 及びＤD は夫々オフであり、演算増幅器８の非反転
入力端子に印加される基準電圧Ｖref は、基準電圧発生
回路５の出力基準電圧ＶR と等しい２．５Ｖである。ま
た、この正常時には演算増幅器ＭＵの出力電圧ＶMUはハ
イレベルであり、よってこれを反転増幅する反転増幅器
２１の出力電圧ＶUAはローレベルである。一方、正常時
には演算増幅器ＭＤの出力電圧ＶMDはローレベルであ
り、よってこれを増幅する非反転増幅器２２の出力電圧
ＶDAはローレベルである。上記の出力電圧ＶUA，ＶUDが
共にローレベルであることにより、基準電圧発生回路５
の出力基準電圧が正常であることがわかる。Next, the operation of this embodiment will be described. When the normal voltage value of 2.5 V is output from the reference voltage generation circuit 5, the diodes D U and D D are off and applied to the non-inverting input terminal of the operational amplifier 8 as described with reference to FIG. The applied reference voltage V ref is 2.5 V which is equal to the output reference voltage V R of the reference voltage generation circuit 5. Further, in this normal state, the output voltage V MU of the operational amplifier MU is at a high level, and thus the output voltage V UA of the inverting amplifier 21 that inverts and amplifies the output voltage V MU is at a low level. On the other hand, in a normal state, the output voltage V MD of the operational amplifier MD is at a low level, and thus the output voltage V DA of the non-inverting amplifier 22 that amplifies the output voltage V MD is at a low level. Since the output voltages V UA and V UD are both low level, the reference voltage generation circuit 5
It can be seen that the output reference voltage of is normal.
【００３３】次に、基準電圧発生回路５の故障等によ
り、基準電圧発生回路５より取り出される基準電圧ＶR
が図３に示す如く異常上昇して時刻ｔ1 で２．６Ｖより
大なる値に変化したものとすると、演算増幅器ＭＵの反
転入力端子の入力電圧が非反転入力端子の入力電圧ＶU
（＝２．６Ｖ）より大となるので、演算増幅器ＭＵの出
力電圧ＶMUは図３に示す如くハイレベル（Ｈ）からロー
レベル（Ｌ）へと大きく変化する。Next, the reference voltage V R taken out from the reference voltage generation circuit 5 due to a failure of the reference voltage generation circuit 5 or the like.
Is abnormally increased as shown in FIG. 3 and changes to a value larger than 2.6 V at time t 1 , the input voltage of the inverting input terminal of the operational amplifier MU is the input voltage V U of the non-inverting input terminal.
Since it is higher than (= 2.6V), the output voltage V MU of the operational amplifier MU greatly changes from the high level (H) to the low level (L) as shown in FIG.
【００３４】一方、演算増幅器ＭＤの反転入力端子への
入力電圧は、正常時と同様にその非反転入力端子の入力
電圧ＶD （＝２．４Ｖ）より大であるため、演算増幅器
ＭＤの出力電圧ＶMDは図３に示す如く時刻ｔ1以降も引
続きローレベルのままであり、ダイオードＤD はオフで
ある。On the other hand, since the input voltage to the inverting input terminal of the operational amplifier MD is larger than the input voltage V D (= 2.4 V) of its non-inverting input terminal as in the normal state, the output of the operational amplifier MD is output. The voltage V MD remains low level after time t 1 as shown in FIG. 3, and the diode D D is off.
【００３５】従って、基準電圧ＶR が２．６Ｖより高く
上昇した場合は、ダイオードＤU がオンとなり、基準電
圧Ｖref は図３に示すように、ＶR が２．６Ｖより高く
ても演算増幅器ＭＵの出力端子よりダイオードＤU 及び
抵抗ＲU を介して取り出される電圧ＶU （＝２．６Ｖ）
に制限される。これにより、出力電圧検出回路９で検出
される電源ユニットの出力電圧ＶOUT は、図３に示すよ
うに、正常時の５．０Ｖから５．２Ｖに上昇するだけで
あり、電源ユニットとしては、基準電圧ＶR の異常上昇
に拘らず、正常に動作することができる。Therefore, when the reference voltage V R rises higher than 2.6 V, the diode D U is turned on and the reference voltage V ref is calculated even if V R is higher than 2.6 V as shown in FIG. Voltage V U (= 2.6 V) extracted from the output terminal of the amplifier MU via the diode D U and the resistor R U
Limited to. As a result, the output voltage V OUT of the power supply unit detected by the output voltage detection circuit 9 only rises from 5.0 V at the normal time to 5.2 V, as shown in FIG. It is possible to operate normally regardless of the abnormal rise in the reference voltage V R.
【００３６】一方、時刻ｔ1 で電圧ＶMUがハイレベルか
らローレベルに変化すると、電圧Ｖ MUは抵抗Ｒ1 及びコ
ンデンサＣ1 による積分回路により積分された後、反転
増幅器２１に供給されるため、反転増幅器２１からは図
３に示すように、積分回路の出力電圧が反転増幅器２１
の閾値以上となった時刻ｔ2 でハイレベルに変化する電
圧ＶUAが取り出される。このハイレベルの電圧ＶUAは基
準電圧発生回路５よりの基準電圧ＶR が異常上昇したこ
とを外部へ報知するアラーム信号として出力される。On the other hand, time t1At voltage VMUIs high level
Changes to low level, the voltage V MUIs resistance R1And
C Densa C1Inverted after being integrated by the integrating circuit
Since it is supplied to the amplifier 21, the inverting amplifier 21
As shown in FIG. 3, the output voltage of the integrating circuit is the inverting amplifier 21.
Time t when the threshold is equal to or more than2Change to high level with
Pressure VUAIs taken out. This high level voltage VUAIs based
Reference voltage V from the quasi-voltage generating circuit 5RHas risen abnormally
Is output as an alarm signal for notifying the outside.
【００３７】なお、時刻ｔ1 で電圧ＶMUがハイレベルか
らローレベルへ変化しても、前述したように電圧ＶMDは
変化しないから、非反転増幅器２２の出力電圧ＶDAは図
３に示す如く時刻ｔ1 以降も引続きローレベルのままで
ある。Even if the voltage V MU changes from the high level to the low level at the time t 1 , the voltage V MD does not change as described above. Therefore, the output voltage V DA of the non-inverting amplifier 22 is shown in FIG. As described above, the low level continues to be maintained after time t 1 .
【００３８】次に、基準電圧ＶR の異常低下時の動作に
ついて説明する。基準電圧発生回路５より取り出される
基準電圧ＶR が、何らかの原因により図４に示す如く時
刻ｔ 11で２．４Ｖより小なる値に低下したものとする
と、演算増幅器ＭＵの反転入力端子と非反転入力端子の
各入力電圧の相対レベル関係は正常時と同じく非反転入
力端子の入力電圧ＶU の方が高いので、演算増幅器ＭＵ
の出力電圧ＶMUは図４に示すように、時刻ｔ11以降も正
常時と同じハイレベルのままであり、よってダイオード
ＤU も正常時と同様に逆バイアスされてオフとされてい
る。Next, the reference voltage VRFor operation when abnormally low
explain about. Taken out from the reference voltage generation circuit 5
Reference voltage VRBut,For some reason, as shown in Fig. 4,
Tick t 11Is assumed to have dropped to a value less than 2.4V at
And the inverting and non-inverting input terminals of the operational amplifier MU
The relative level relationship of each input voltage is the same as in the normal state.
Input voltage V of input terminalUIs higher, so the operational amplifier MU
Output voltage VMUAs shown in FIG.11Positive after that
It stays at the same high level as it always has, and therefore the diode
DUIs also reverse biased and turned off as in normal operation.
It
【００３９】これに対し、演算増幅器ＭＤの反転入力端
子の入力電圧が非反転入力端子の入力電圧ＶD （＝２．
４Ｖ）より低下するので、演算増幅器ＭＤの出力電圧Ｖ
MDは図４に示す如く、時刻ｔ11でローレベルからハイレ
ベルへ大きく変化する。On the other hand, the input voltage of the inverting input terminal of the operational amplifier MD is the input voltage V D (= 2.
4 V), the output voltage V of the operational amplifier MD
As shown in FIG. 4, MD changes greatly from low level to high level at time t 11 .
【００４０】これにより、ダイオードＤD がオンとな
り、上記電圧ＶMDがダイオードＤD 及び抵抗ＲD を通し
て基準電圧Ｖref として演算増幅器８の非反転入力端子
に入力される。このときの電圧ＶMDは電圧源７１の出力
電圧ＶD と同じ２．４Ｖである。従って、図４に示すよ
うに、基準電圧Ｖref は時刻ｔ11以降２．４Ｖとなり、
出力電圧検出回路９で検出される出力電圧ＶOUT は時刻
ｔ11以降４．８Ｖとなる。As a result, the diode D D is turned on, and the voltage V MD is input to the non-inverting input terminal of the operational amplifier 8 as the reference voltage V ref through the diode D D and the resistor R D. The voltage V MD at this time is 2.4 V, which is the same as the output voltage V D of the voltage source 71. Therefore, as shown in FIG. 4, the reference voltage V ref becomes 2.4 V after time t 11 ,
The output voltage V OUT detected by the output voltage detection circuit 9 becomes 4.8 V after time t 11 .
【００４１】従って、基準電圧ＶR が２．４Ｖより小な
る値に異常低下しても、基準電圧Ｖ ref の低下が２．４
Ｖに制限されるので、出力電圧ＶOUT は正常時の５．０
Ｖから４．８Ｖに低下するだけであり、電源ユニットと
しては基準電圧の異常低下に拘らず、正常に動作するこ
とができる。Therefore, the reference voltage VRIs less than 2.4V
Reference voltage V refDecrease of 2.4
Since it is limited to V, the output voltage VOUTIs 5.0 when normal
It only drops from V to 4.8V,
Can operate normally regardless of the abnormal decrease in the reference voltage.
You can
【００４２】一方、時刻ｔ11以降も演算増幅器ＭＤの出
力電圧ＶMUはハイレベルで時刻ｔ11以前と同一であるの
で、反転増幅器２１の出力電圧ＶUAは図４に示す如く正
常時と同じローレベルのままで変化はない。On the other hand, after the time t 11, the output voltage V MU of the operational amplifier MD is at the high level and is the same as that before the time t 11 , so the output voltage V UA of the inverting amplifier 21 is the same as in the normal state as shown in FIG. There is no change at low level.
【００４３】これに対し、時刻ｔ11でローレベルからハ
イレベルへ変化する演算増幅器ＭＤの出力電圧ＶMDは、
抵抗Ｒ2 及びコンデンサＣ2 による積分回路で積分され
た後、非反転増幅器２２に供給される。非反転増幅器２
２は時刻ｔ11から立上がる入力積分電圧が所定の閾値以
上となった時刻ｔ12で、図４に示す如くローレベルから
ハイレベルへ変化する電圧ＶDAを出力する。このハイレ
ベルの出力電圧ＶDAは基準電圧ＶR の異常低下を外部へ
知らせるアラーム信号として出力される。On the other hand, the output voltage V MD of the operational amplifier MD changing from the low level to the high level at time t 11 is
It is supplied to the non-inverting amplifier 22 after being integrated by an integrating circuit composed of the resistor R 2 and the capacitor C 2 . Non-inverting amplifier 2
2 is a time t 12 when the input integrated voltage rising from the time t 11 becomes equal to or higher than a predetermined threshold value, and the voltage V DA changing from the low level to the high level is output as shown in FIG. This high-level output voltage V DA is output as an alarm signal for notifying an abnormal decrease in the reference voltage V R to the outside.
【００４４】このように、本実施例によれば、基準電圧
ＶR が異常上昇したときはハイレベルの電圧ＶUAがアラ
ーム検出信号として取り出され、また基準電圧ＶR の異
常低下時はハイレベルの電圧ＶDAがアラーム検出信号と
して取り出されるため、基準電圧ＶR の異常の有無及び
その異常が電圧上昇によるものか電圧低下によるものか
が、即座にわかる。As described above, according to this embodiment, when the reference voltage V R abnormally rises, the high level voltage V UA is taken out as an alarm detection signal, and when the reference voltage V R abnormally drops, the high level voltage V UA is taken out. since the voltage V DA of is taken out as an alarm detection signal, or not abnormality presence or absence and the abnormal reference voltage V R is according to whether the voltage drop due to the voltage increase is seen immediately.
【００４５】また、本実施例ではレベル変化の大きな演
算増幅器ＭＵ，ＭＤの出力電圧からアラーム信号を生成
するようにしているため、電源ユニットの出力電圧から
アラーム信号を生成するよりもノイズマージンを十分に
大きくとれる。そして、アラーム信号の送出によって、
適当な時期に電源ユニットの保守交換を促すことがで
き、装置の信頼性を向上させることができる。Further, in this embodiment, since the alarm signal is generated from the output voltage of the operational amplifiers MU and MD having a large level change, the noise margin is sufficient as compared with the case where the alarm signal is generated from the output voltage of the power supply unit. Can be taken to And by sending the alarm signal,
Maintenance and replacement of the power supply unit can be promoted at an appropriate time, and the reliability of the device can be improved.
【００４６】なお、本発明は上記の実施例に限定される
ものではなく、上限リミッタ回路６及び下限リミッタ回
路７のいずれか一方の回路を備えた電源ユニットにも本
発明を適用することができ、また更には本発明者が提案
した電源ユニット以外の公知の電源ユニットにも適用す
ることができるものである。The present invention is not limited to the above-described embodiment, and the present invention can be applied to a power supply unit equipped with either one of the upper limit limiter circuit 6 and the lower limit limiter circuit 7. Furthermore, the present invention can be applied to known power supply units other than the power supply unit proposed by the present inventor.
【００４７】[0047]
【発明の効果】上述の如く、本発明によれば、基準電圧
が正常時と異常時とでレベル変化の大きな電圧制限回路
の検出信号に基づいてアラーム信号を生成出力するよう
にしているため、ノイズマージンを十分にとったアラー
ム信号を出力することができ、これにより電源ユニット
が正常に動作していても基準電圧発生回路の異常を外部
に報知することができるため、適当な時期に電源ユニッ
トの保守交換を促すことができ、よって電源ユニットの
信頼性向上に寄与するところ大である等の特長を有する
ものである。As described above, according to the present invention, the alarm signal is generated and output based on the detection signal of the voltage limiting circuit in which the reference voltage has a large level change between the normal state and the abnormal state. It is possible to output an alarm signal with a sufficient noise margin, which allows the abnormality of the reference voltage generating circuit to be notified to the outside even when the power supply unit is operating normally. It is possible to promote the maintenance and replacement of the power supply unit, and thus contributes to the improvement of the reliability of the power supply unit.
【図１】本発明の原理ブロック図である。FIG. 1 is a principle block diagram of the present invention.
【図２】本発明の一実施例の回路図である。FIG. 2 is a circuit diagram of an embodiment of the present invention.
【図３】基準電圧異常上昇時の図２の動作説明用タイム
チャートである。FIG. 3 is a time chart for explaining the operation of FIG. 2 when the reference voltage rises abnormally.
【図４】基準電圧異常低下時の図２の動作説明用タイム
チャートである。FIG. 4 is a time chart for explaining the operation of FIG. 2 when the reference voltage abnormally drops.
【図５】本発明者が先に提案した並列運転方式の一例の
構成図である。FIG. 5 is a configuration diagram of an example of a parallel operation method previously proposed by the present inventor.
【図６】本発明者が先に提案した電源ユニットの一例の
回路図である。FIG. 6 is a circuit diagram of an example of a power supply unit previously proposed by the present inventor.
５ 基準電圧発生回路 １１，１１ａ，１１ｂ 電圧制限回路 １２，１２ａ，１２ｂ アラーム信号出力回路 ２１ 反転増幅器 ２２ 非反転増幅器 ＭＵ，ＭＤ 演算増幅器 ＤU ，ＤD ダイオード Ｒ1 ，Ｒ2 抵抗 Ｃ1 ，Ｃ2 コンデンサ5 reference voltage generating circuit 11, 11a, 11b voltage-limiting circuit 12, 12a, 12b alarm signal output circuit 21 inverting amplifier 22 the non-inverting amplifier MU, MD operational amplifier D U, D D diodes R 1, R 2 resistor C 1, C 2 capacitors
Claims (3)
と出力電圧とを比較し、両者の差に応じて該出力電圧を
一定とする制御を行なう電源ユニットにおいて、 前記基準電圧が設定値を越えたことを検出したとき、予
め設定した値の電圧を前記基準電圧として出力する電圧
制限回路（１１）と、 該電圧制限回路（１１）が前記基準電圧が前記設定値を
越えたことを検出したときの検出信号を、前記基準電圧
の異常を示すアラーム信号として出力するアラーム信号
出力回路（１２）とを具備したことを特徴とする電源ユ
ニットのアラーム検出装置。1. A power supply unit for comparing a reference voltage from a reference voltage generation circuit (5) with an output voltage, and controlling the output voltage to be constant according to a difference between the two, wherein the reference voltage is a set value. A voltage limiting circuit (11) that outputs a voltage having a preset value as the reference voltage when it detects that the reference voltage exceeds the preset value. An alarm detection device for a power supply unit, comprising an alarm signal output circuit (12) for outputting a detection signal when it is detected as an alarm signal indicating an abnormality of the reference voltage.
電圧発生回路（５）よりの基準電圧と前記設定値に相当
する上限電圧値とを比較する第１の比較回路（ＭU ）
と、該基準電圧が該上限電圧値より大なるときのみ該第
１の比較回路（ＭU ）の出力信号によりオンとなり、該
第１の比較回路（ＭU ）の出力信号を前記予め設定した
値の電圧として出力する第１のダイオード（ＤU ）とよ
りなり、 前記アラーム信号出力回路（１２）は前記第１の比較回
路（ＭU ）と前記第１のダイオード（ＤU ）との接続点
より該第１のダイオード（ＤU ）がオンのときに取り出
される信号を波形整形してアラーム信号として出力する
構成としたことを特徴とする請求項１記載の電源ユニッ
トのアラーム検出装置。2. A first comparison circuit (M U ) for comparing the reference voltage from the reference voltage generation circuit (5) with an upper limit voltage value corresponding to the set value, the voltage limiting circuit (11).
And only when the reference voltage is higher than the upper limit voltage value, it is turned on by the output signal of the first comparison circuit (M U ) and the output signal of the first comparison circuit (M U ) is set in advance. A first diode (D U ) that outputs a voltage having a value, and the alarm signal output circuit (12) connects the first comparison circuit (M U ) and the first diode (D U ). 2. The alarm detecting device for a power supply unit according to claim 1, wherein the signal taken out when the first diode (D U ) is turned on is waveform-shaped and output as an alarm signal.
電圧発生回路（５）よりの基準電圧と前記設定値に相当
する下限電圧値とを比較する第２の比較回路（ＭD ）
と、該基準電圧が該下限電圧値より小なるときのみ該第
２の比較回路（ＭD ）の出力信号によりオンとなり、該
第２の比較回路（ＭD ）の出力信号を前記予め設定した
値の電圧として出力する第２のダイオード（ＤD ）とよ
りなり、 前記アラーム信号出力回路（１２）は前記第２の比較回
路（ＭD ）と前記第２のダイオード（ＤD ）との接続点
より該第２のダイオード（ＤD ）がオンのときに取り出
される信号を波形整形してアラーム信号として出力する
構成としたことを特徴とする請求項１記載の電源ユニッ
トのアラーム検出装置。3. A second comparison circuit (M D ) for comparing the reference voltage from the reference voltage generating circuit (5) with a lower limit voltage value corresponding to the set value, in the voltage limiting circuit (11).
And when the reference voltage is smaller than the lower limit voltage value, the second comparison circuit (M D ) is turned on by the output signal, and the output signal of the second comparison circuit (M D ) is set in advance. A second diode (D D ) that outputs a voltage having a value, and the alarm signal output circuit (12) connects the second comparison circuit (M D ) and the second diode (D D ). 2. The alarm detecting device for the power supply unit according to claim 1, wherein the signal taken out when the second diode (D D ) is turned on is shaped into waveforms and output as an alarm signal.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3241963A JPH0583847A (en) | 1991-09-20 | 1991-09-20 | Alarm detector power supply unit |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3241963A JPH0583847A (en) | 1991-09-20 | 1991-09-20 | Alarm detector power supply unit |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0583847A true JPH0583847A (en) | 1993-04-02 |
Family
ID=17082184
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP3241963A Withdrawn JPH0583847A (en) | 1991-09-20 | 1991-09-20 | Alarm detector power supply unit |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0583847A (en) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US8122316B2 (en) | 2006-10-27 | 2012-02-21 | Fujitsu Ten Limited | Error detector and error detection method |
-
1991
- 1991-09-20 JP JP3241963A patent/JPH0583847A/en not_active Withdrawn
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US8122316B2 (en) | 2006-10-27 | 2012-02-21 | Fujitsu Ten Limited | Error detector and error detection method |
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|---|---|---|---|
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