JPH0567957B2 - - Google Patents
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- JPH0567957B2 JPH0567957B2 JP834583A JP458383A JPH0567957B2 JP H0567957 B2 JPH0567957 B2 JP H0567957B2 JP 834583 A JP834583 A JP 834583A JP 458383 A JP458383 A JP 458383A JP H0567957 B2 JPH0567957 B2 JP H0567957B2
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Description
【発明の詳細な説明】
本発明はメロデイ自動演奏集積回路（以下メロ
デイICと称する）に於いて音響信号に付加する
エンベロープ波形のデイジタル制御に効果的なエ
ンベロープ波形制御回路に関するものである。DETAILED DESCRIPTION OF THE INVENTION The present invention relates to an envelope waveform control circuit that is effective for digitally controlling an envelope waveform added to an acoustic signal in an automatic melody performance integrated circuit (hereinafter referred to as melody IC).
メロデイICに於けるデイジタル技術による従
来のエンベロープ波形制御方式は、エンベロープ
波形の時間を分解能とした各サンプル点の電圧
を、デイジタルアナログ変換器（以下DA変換器
と称する）により得られる電圧で近似し、前記電
圧を得るためのDA変換器を制御するデータをリ
ードオンリーメモリー（以下ROMと称する）に
予め記憶させておきメロデイ演奏の際にはROM
データに従つてDA変換器が制御され所定の電圧
が順次出力され、再びエンベロープ波形を合成す
る構成になつていた。 The conventional envelope waveform control method using digital technology in Melody IC approximates the voltage at each sample point with time resolution of the envelope waveform by the voltage obtained by a digital-to-analog converter (hereinafter referred to as a DA converter). , data for controlling the DA converter to obtain the voltage is stored in advance in a read-only memory (hereinafter referred to as ROM), and when playing a melody, the data is stored in the ROM.
The DA converter was controlled according to the data, and predetermined voltages were sequentially output, and the envelope waveform was synthesized again.
第２図は従来のエンベロープ波形制御方式の一
例を示すもので、メロデイ演奏の際メインROM
１１の出力データにより曲のテンポを決定するテ
ンポカウンター１２の分周比が選択され前記メイ
ンROM１１に記憶されている曲のテンポに対応
した周波数のテンポ信号Ｔが出力される。テンポ
信号ＴはメインROM１１の出力データにより音
符長を決定するリズムカウンター１３へ入力され
る。前記リズムカウンター１３の出力信号Ｒはメ
インROM１１の出力データにより音程を決定す
るスケールカウンター１４へ入力され、ここで１
つの音符の音程と音符長が決定される。なお前記
リズムカウンター１３の出力信号Ｒはメイン
ROM１１のアドレスカウンターも入力され、１
音符進むごとに次の音符のデータを選択する。 Figure 2 shows an example of the conventional envelope waveform control method, in which the main ROM is used when playing a melody.
The frequency division ratio of the tempo counter 12 that determines the tempo of the song is selected based on the output data of the main ROM 11, and a tempo signal T having a frequency corresponding to the tempo of the song stored in the main ROM 11 is output. The tempo signal T is input to the rhythm counter 13 which determines the note length based on the output data of the main ROM 11. The output signal R of the rhythm counter 13 is input to the scale counter 14 which determines the pitch based on the output data of the main ROM 11.
The pitch and length of the two notes are determined. Note that the output signal R of the rhythm counter 13 is the main
The address counter of ROM11 is also input, and 1
Select the data for the next note each time the note advances.
また、テンポカウンター１２の出力信号Ｔはエ
ンベロープ波形制御回路１５のアドレスカウンタ
ー１６へ入力され、ROM１７のデータを順次読
み出しDA変換器１８を制御して、エンベロープ
波形を合成し信号Ｅを得ている。アドレスカウン
タ１６にはスケールカウンタ１４の出力信号Ｓが
加えられ、同期をとつて合成されたエンベロープ
波形の電圧が変化した際に異音を発生しないよう
にしている。前記記号Ｅと信号Ｓは乗算器１９へ
入力されて音響信号となる。ここで第６図に示す
波形を合成する場合を例にとると、時間ｔがt0か
らt1、t2、……t11と進むにつれ、V1とV2、V2と
V3、……V10とV11というように電圧の差が縮ま
り、精度良く原波形に近似させて合成するために
は非常に細かな電圧の制御をする必要があり、こ
のことはROM容量の増大、DA変換器の構成素
子数の増加につながりIC化を考えた場合に不都
合があつた。また、ROM容量及びDA変換器の
構成素子数を減らすために、時間間隔を長くとり
サンプリングを粗すこると電圧変化が大きくな
り、前記電圧変化が異音として聞こえてしまい具
合が良くない。またエンベロープメモリを使用し
ない例としては、特開昭55−159182号公報がある
が、エンベロープを抵抗値によつて決定するため
に、抵抗値を厳密に決定する必要があり、実際に
所望のエンベロープを得ることは難しい。 The output signal T of the tempo counter 12 is input to the address counter 16 of the envelope waveform control circuit 15, and the data in the ROM 17 is sequentially read out and the DA converter 18 is controlled to synthesize the envelope waveforms and obtain the signal E. The output signal S of the scale counter 14 is applied to the address counter 16 to prevent abnormal noise from occurring when the voltage of the synchronously synthesized envelope waveform changes. The symbol E and the signal S are input to a multiplier 19 to become an acoustic signal. Taking as an example the case where the waveforms shown in FIG .
V 3 ,...V 10 and V 11 , the difference in voltage is reduced, and in order to accurately approximate and synthesize the original waveform, it is necessary to perform very fine voltage control, and this requires ROM capacity. This led to an increase in the number of components of the DA converter, which was inconvenient when considering IC implementation. Furthermore, if the time interval is lengthened to reduce the number of constituent elements of the DA converter, the voltage change will increase, and the voltage change will be heard as abnormal noise, which is not good. Furthermore, as an example of not using envelope memory, there is Japanese Patent Application Laid-Open No. 159182/1982, but in order to determine the envelope based on the resistance value, it is necessary to determine the resistance value strictly, and it is necessary to is difficult to obtain.
本発明はかかる欠点を除去したもので、電圧の
間隔を一定にしてサンプリングを行ない、時間制
御をすることによりエンベロープ波形を合成し前
記時間制御をカウンター及びデコーダによつて行
なうことによりROMを不用とし構成素子数の減
少のできるエンベロープ波形制御回路を提供する
ものである。 The present invention eliminates such drawbacks by performing sampling at constant voltage intervals, synthesizing envelope waveforms by controlling time, and eliminating the need for ROM by controlling the time using a counter and a decoder. The present invention provides an envelope waveform control circuit that can reduce the number of constituent elements.
第１図は本発明のエンベロープ波形制御回路の
一例で、メインROM１の出力データにより曲の
テンポを決定するテンポカウンター２の分周比が
選択され、曲のテンポに対応した周波数のテンポ
信号Ｔが出力される。前記テンポ信号Ｔはメイン
ROM１の出力データにより音符長を決定するリ
ズムカウンター３へ入力され曲のテンポ及び音符
長に対応した信号Ｒが出力される。前記リズムカ
ウンター３の出力信号ＲはメインROM１の出力
データにより音程を決定するスケールカウンター
４へ入力され、ここで１つの音符の音程と音符長
が決定される。なおリズムカウンターの出力信号
ＲはメインROM１のアドレスカウンターへ入力
され１音符進むごとに次の音符のデータを選択す
る。 FIG. 1 shows an example of the envelope waveform control circuit of the present invention, in which the division ratio of a tempo counter 2 that determines the tempo of a song is selected based on the output data of the main ROM 1, and a tempo signal T having a frequency corresponding to the tempo of the song is generated. Output. The tempo signal T is the main
The output data of the ROM 1 is input to a rhythm counter 3 which determines the note length, and a signal R corresponding to the tempo and note length of the song is output. The output signal R of the rhythm counter 3 is input to the scale counter 4 which determines the pitch based on the output data of the main ROM 1, and here the pitch and note length of one note are determined. The output signal R of the rhythm counter is input to the address counter of the main ROM 1, and the data of the next note is selected every time the rhythm counter advances by one note.
また、前記テンポカウンター２の出力信号Ｔは
エンベロープ波形制御回路５のカウンター６へ入
力され分周される。この分周された信号をデコー
ダ７により順次選択しデコーダ７の内部信号Ｆを
得る。デコーダ７では前記内部信号Ｆをもとに
DA変換器８の制御信号を作り出している。 Further, the output signal T of the tempo counter 2 is input to the counter 6 of the envelope waveform control circuit 5 and frequency-divided. The frequency-divided signals are sequentially selected by the decoder 7 to obtain the internal signal F of the decoder 7. In the decoder 7, based on the internal signal F,
It generates a control signal for the DA converter 8.
デコーダ７で作られた制御信号によりDA変換
器８は制御されエンベロープ波形を合成し、信号
Ｅとして乗算器９へ入力され、スケールカウンタ
ー４の出力信号Ｓと合成されて音響信号となる。
また、デコーダ７にはスケールカウンター４の出
力信号Ｓが入力され同期をとつて異音を発生しな
いようにしている。 The DA converter 8 is controlled by the control signal generated by the decoder 7, synthesizes the envelope waveform, is inputted as a signal E to the multiplier 9, and is synthesized with the output signal S of the scale counter 4 to become an acoustic signal.
Further, the output signal S of the scale counter 4 is inputted to the decoder 7, and the decoder 7 is synchronized to prevent abnormal noise from occurring.
第２図は前記カウンター６、デコーダ７、DA
変換器８の回路構成の一例である。カウンター６
は４段のフリツプフロツプF0〜F3で構成され、
F3の出力の出力である。カウンター６へ第３
図のタイム・チヤートのＴで示す信号が入力され
た場合、各フリツプフロツプF0，F1，F2，F3の
出力波形は第３図中のFQ0，FQ1，FQ2，Q3の如く
それぞれ前段の周波数の1/2になつている。前記
信号FQ0，FQ1，FQ2，Q1はデコーダ７のNAND
ゲート、NA１〜NA４へそれぞれ入力される。
第３図のアタツク信号Ａが“Ｈ”レベルになると
第２図中で全てのフリツプフロツプはリセツトさ
れる。 Figure 2 shows the counter 6, decoder 7, and DA.
This is an example of a circuit configuration of the converter 8. counter 6
is composed of four stages of flip-flops F0 to F3 ,
This is the output of the output of F3 . 3rd to counter 6
When the signal indicated by T in the time chart in the figure is input, the output waveforms of each flip-flop F 0 , F 1 , F 2 , F 3 are as shown in F Q0 , F Q1 , F Q2 , Q3 in Figure 3. Each frequency is 1/2 of the frequency of the previous stage. The signals F Q0 , F Q1 , F Q2 , Q1 are NAND of the decoder 7
The signals are input to the gates and NA1 to NA4, respectively.
When the attack signal A in FIG. 3 goes to the "H" level, all flip-flops in FIG. 2 are reset.
従つてデコーダ７のNORゲートNR１の出力
が“Ｈ”レベルとなりNA１へ入力されている信
号FQ0が選択される。次に前記アタツク信号Ａが
“Ｌ”レベルになるとカウンター６は動作を開始
し前記信号Ｔを分周する。デコーダ７の初段のフ
リツプフロツプのクロツクとして前記スケールカ
ウンター４の出力Ｓを入力し、音程を決定する信
号との同期をとつて異音を発生しないようにして
いる。フリツプフロツプF0の出力FQ0が４クロツ
ク出力されるとフリツプフロツプF7の出力FQ7が
“Ｈ”レベルとなりNORゲートNR１の出力は
“Ｌ”レベルとなりNANDゲートNA１の出力は
禁止される。このときNORゲートNR２の出力
は“Ｈ”レベルとなりNANDゲートNA２へ入
力されている信号FQ1が選択される。FQ1が４クロ
ツク出力されるとフリツプフロツプF7の出力FQ7
は“Ｌ”レベル、フリツプフロツプF8の出力FQ8
は“Ｈ”レベルとなりNORゲートNR２の出力
は“Ｌ”レベルとなりNORゲートNR３の出力
は“Ｈ”レベルとなりNANDゲートNA２の出
力は禁止され、NANDゲートNA３へ入力され
ている信号FQ2が選択される。同様にして、FQ2が
４クロツク出力されると、FQ3が選択される。信
号Ｓの周波数は信号Ｔの周波数と比較して十分に
高いのでNANDゲートNA０の出力とフリツプ
フロツプF4の出力FQ4との差はほとんどない。従
つて第３図のタイム・チヤートのFQ4で示される
波形が得られる。 Therefore, the output of the NOR gate NR1 of the decoder 7 becomes "H" level, and the signal F Q0 inputted to NA1 is selected. Next, when the attack signal A becomes "L" level, the counter 6 starts operating and divides the frequency of the signal T. The output S of the scale counter 4 is inputted as a clock to the flip-flop at the first stage of the decoder 7, and is synchronized with a signal that determines the pitch to prevent abnormal noise from occurring. When the output FQ0 of the flip-flop F0 is outputted for four clocks, the output FQ7 of the flip-flop F7 becomes "H" level, the output of the NOR gate NR1 becomes "L" level, and the output of the NAND gate NA1 is inhibited. At this time, the output of the NOR gate NR2 becomes "H" level, and the signal F Q1 inputted to the NAND gate NA2 is selected. When F Q1 is output for 4 clocks, the output of flip-flop F7 is F Q7.
is “ L” level, flip-flop F8 output FQ8
becomes "H" level, the output of NOR gate NR2 becomes "L" level, the output of NOR gate NR3 becomes "H" level, the output of NAND gate NA2 is prohibited, and the signal F Q2 input to NAND gate NA3 is selected. be done. Similarly, when F Q2 is output for four clocks, F Q3 is selected. Since the frequency of the signal S is sufficiently high compared to the frequency of the signal T, there is almost no difference between the output of the NAND gate NA0 and the output FQ4 of the flip-flop F4. Therefore, the waveform shown by F Q4 in the time chart of FIG. 3 is obtained.
一方DA変換器８の力電圧は次式で示すことが
できる。デイズツトbnが“Ｈ”レベルのときbn
＝１、bn＝０デイジツトbnが“Ｌ”レベルのと
きbn＝０、bn＝１とすると、DA変換器８はＲ−
2R型のDA変換器であるので、電圧Ｖは
Ｖ＝（１−4・2-1−3・2-2−2・2-3−1
・2-4−0・2-5）×VDD
となる。 On the other hand, the force voltage of the DA converter 8 can be expressed by the following equation. When dayzt bn is at “H” level, bn
= 1, bn = 0 When digit bn is at “L” level, bn = 0, bn = 1, the DA converter 8 is R-
Since it is a 2R type DA converter, the voltage V is V = (1- 4・2 -1 − 3・2 -2 − 2・2 -3 − 1
・2 -4 − 0・2 -5 )×V DD .
アタツク信号Ａが入力された場合デユーダ７の
全フリツプフロツプはリセツトされるため出力は
“Ｌ”レベルとなる。このときDA変換器８の出
力電圧は1/32VDDとなる。各フリツプフロツプF4
〜F8の出力レベルとDA変換器８の出力電圧波形
Ｅとの関係を示したものが第４図である。 When the attack signal A is input, all the flip-flops of the deducer 7 are reset, so that the output becomes "L" level. At this time, the output voltage of the DA converter 8 becomes 1/32V DD . Each flip-flop F 4
FIG. 4 shows the relationship between the output level of ~ F8 and the output voltage waveform E of the DA converter 8.
以上のように構成されたエンベロープ波形制御
回路はクロツク（テンポ信号Ｔ）を分周した信号
を選択してDA変換器を制御しているため、デコ
ーダによつてエンベロープの基本波形が決定さ
れ、回路構成が簡単である。またエンベロープ波
形を従来のように抵抗値を厳密に制御して設定す
る必要がなくなり、自然なエンベロープ波形を容
易に得ることができる。またクロツク（信号Ｔ）
の周波数を音響信号の音符長に合わせて変えるこ
とにより、音響信号の音符に合わせてエンベロー
プを変えることができるので、メロデイICとか
電子オルゴールのエンベロープ波形制御回路とし
て応用することができる。 The envelope waveform control circuit configured as described above selects a signal obtained by dividing the clock (tempo signal T) to control the DA converter, so the basic waveform of the envelope is determined by the decoder, and the circuit Easy to configure. Further, it is no longer necessary to set the envelope waveform by strictly controlling the resistance value as in the conventional method, and a natural envelope waveform can be easily obtained. Also clock (signal T)
By changing the frequency according to the note length of the acoustic signal, the envelope can be changed according to the note length of the acoustic signal, so it can be applied as an envelope waveform control circuit for melody ICs and electronic music boxes.
以上説明したように本願発明によれば、曲の速
さを決定するテンポ信号に基づきエンベロープ信
号を制御するために、曲の速さに適したエンベロ
ープ信号を得ることができ、心地よいメロテイー
を奏でることができるという効果を奏する。 As explained above, according to the present invention, since the envelope signal is controlled based on the tempo signal that determines the speed of the song, an envelope signal suitable for the speed of the song can be obtained, and a pleasant melody can be played. It has the effect of being able to.
第１図は本発明の一実施例を示すブロツク構成
図、第２図はその一部詳細図、第３図は第２図の
動作を示すタイムチヤート、第４図は第２図によ
る動作により得られるエンベロープ波形の一例、
第５図は従来のエンベロープ波形制御方式による
ブロツク構成図、第６図は第５図を説明するエン
ベロープ波形を示す図である。
１……メインROM、２……テンポカウンタ
ー、３……リズムカウンター、４……スケールカ
ウンター、５……エンベロープ波形制御回路、６
……カウンター、７……デコーダ、８……DA変
換器、９……乗算器、１１……メインROM、１
２……テンポカウンター、１３……リズムカウン
ター、１４……スケールカウンター、１５……エ
ンベロープカウンター、１６……アドレスカウン
ター、１７……ROM、１８……DA変換器、１
９……乗算器。
FIG. 1 is a block configuration diagram showing one embodiment of the present invention, FIG. 2 is a detailed view of a part thereof, FIG. 3 is a time chart showing the operation of FIG. 2, and FIG. 4 is a block diagram showing the operation according to FIG. 2. An example of the envelope waveform obtained,
FIG. 5 is a block diagram of a conventional envelope waveform control method, and FIG. 6 is a diagram showing an envelope waveform for explaining FIG. 1... Main ROM, 2... Tempo counter, 3... Rhythm counter, 4... Scale counter, 5... Envelope waveform control circuit, 6
... Counter, 7 ... Decoder, 8 ... DA converter, 9 ... Multiplier, 11 ... Main ROM, 1
2... Tempo counter, 13... Rhythm counter, 14... Scale counter, 15... Envelope counter, 16... Address counter, 17... ROM, 18... DA converter, 1
9... Multiplier.
Claims (1)
ログ変換器と、前記デイジタルアナログ変換器を
制御する制御信号を出力する制御回路と、前記デ
イジタルアナログ変換器の出力する前記エンベロ
ープ波形と音響信号を合成する合成手段とを備え
たエンベロープ波形制御回路において、 前記制御回路は前記音響信号に同期した曲の速
さを決定するテンポ信号をカウントするカウンタ
と、前記カウンタの出力をデコードし前記デイジ
タルアナログ変換器を制御する前記制御信号を出
力するデコーダとから構成されてなることを特徴
とするエンベロープ波形制御回路。[Scope of Claims] 1. A digital-to-analog converter that generates an envelope waveform, a control circuit that outputs a control signal that controls the digital-to-analog converter, and a control circuit that outputs the envelope waveform and acoustic signal output from the digital-to-analog converter. an envelope waveform control circuit comprising a synthesis means for synthesizing, the control circuit comprising: a counter for counting a tempo signal that determines the speed of a song synchronized with the acoustic signal; and an envelope waveform control circuit for decoding the output of the counter and performing the digital-to-analog conversion. and a decoder that outputs the control signal for controlling the envelope waveform control circuit.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58004583A JPS59128596A (en) | 1983-01-14 | 1983-01-14 | Envelope waveform control circuit |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58004583A JPS59128596A (en) | 1983-01-14 | 1983-01-14 | Envelope waveform control circuit |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS59128596A JPS59128596A (en) | 1984-07-24 |
| JPH0567957B2 true JPH0567957B2 (en) | 1993-09-27 |
Family
ID=11588056
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP58004583A Granted JPS59128596A (en) | 1983-01-14 | 1983-01-14 | Envelope waveform control circuit |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS59128596A (en) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP4955955B2 (en) * | 2005-08-01 | 2012-06-20 | 株式会社東芝 | Control rod drive mechanism |
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1983
- 1983-01-14 JP JP58004583A patent/JPS59128596A/en active Granted
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Also Published As
| Publication number | Publication date |
|---|---|
| JPS59128596A (en) | 1984-07-24 |
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