JPH0547833A - Tabチツプの搭載用基板 - Google Patents
Tabチツプの搭載用基板Info
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- JPH0547833A JPH0547833A JP20167491A JP20167491A JPH0547833A JP H0547833 A JPH0547833 A JP H0547833A JP 20167491 A JP20167491 A JP 20167491A JP 20167491 A JP20167491 A JP 20167491A JP H0547833 A JPH0547833 A JP H0547833A
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- Japan
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- leads
- substrate
- electrode parts
- electrode
- parts
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- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/10—Bump connectors; Manufacturing methods related thereto
- H01L2224/1012—Auxiliary members for bump connectors, e.g. spacers
- H01L2224/10152—Auxiliary members for bump connectors, e.g. spacers being formed on an item to be connected not being a semiconductor or solid-state body
- H01L2224/10165—Alignment aids
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/10—Bump connectors; Manufacturing methods related thereto
- H01L2224/15—Structure, shape, material or disposition of the bump connectors after the connecting process
- H01L2224/16—Structure, shape, material or disposition of the bump connectors after the connecting process of an individual bump connector
- H01L2224/161—Disposition
- H01L2224/16151—Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
- H01L2224/16221—Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
- H01L2224/16225—Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/80—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected
- H01L2224/81—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a bump connector
- H01L2224/8112—Aligning
- H01L2224/81136—Aligning involving guiding structures, e.g. spacers or supporting members
- H01L2224/81138—Aligning involving guiding structures, e.g. spacers or supporting members the guiding structures being at least partially left in the finished device
- H01L2224/8114—Guiding structures outside the body
-
- H—ELECTRICITY
- H05—ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
- H05K—PRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
- H05K3/00—Apparatus or processes for manufacturing printed circuits
- H05K3/30—Assembling printed circuits with electric components, e.g. with resistor
- H05K3/303—Surface mounted components, e.g. affixing before soldering, aligning means, spacing means
-
- H—ELECTRICITY
- H05—ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
- H05K—PRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
- H05K3/00—Apparatus or processes for manufacturing printed circuits
- H05K3/30—Assembling printed circuits with electric components, e.g. with resistor
- H05K3/32—Assembling printed circuits with electric components, e.g. with resistor electrically connecting electric components or wires to printed circuits
- H05K3/34—Assembling printed circuits with electric components, e.g. with resistor electrically connecting electric components or wires to printed circuits by soldering
- H05K3/341—Surface mounted components
- H05K3/3421—Leaded components
Landscapes
- Wire Bonding (AREA)
Abstract
(57)【要約】
【目的】 TABチップのリードを電極部に良好にボン
ディングできる基板を提供する。 【構成】 基板1の電極部2の近傍に、熱圧着子13の
下降限度を規制するスペーサ5を突設した。
ディングできる基板を提供する。 【構成】 基板1の電極部2の近傍に、熱圧着子13の
下降限度を規制するスペーサ5を突設した。
Description
【0001】
【産業上の利用分野】本発明はTABチップの搭載用基
板に係り、詳しくは、TABチップのリードを基板の電
極部に確実にボンディングできる基板の構造に関する。
板に係り、詳しくは、TABチップのリードを基板の電
極部に確実にボンディングできる基板の構造に関する。
【0002】
【従来の技術】合成樹脂から成るフィルムキャリヤに半
導体チップをボンディングし、次いでフィルムキャリヤ
のリード部を打抜き装置により打抜いてデバイスを得る
ことは、TAB法として知られている。
導体チップをボンディングし、次いでフィルムキャリヤ
のリード部を打抜き装置により打抜いてデバイスを得る
ことは、TAB法として知られている。
【0003】図3及び図4は、TAB法により製造され
たデバイス(TABチップ)を、従来の基板に搭載して
いる様子を示している。図中、1は基板であり、その上
面には電極部2が形成されている。図4に示すように、
この電極部2は、基板1の上面に銅エッチング手段など
により回路パターン3を形成し、この回路パターン3上
に半田部4を半田レベラ手段などにより積層して形成さ
れている。
たデバイス(TABチップ)を、従来の基板に搭載して
いる様子を示している。図中、1は基板であり、その上
面には電極部2が形成されている。図4に示すように、
この電極部2は、基板1の上面に銅エッチング手段など
により回路パターン3を形成し、この回路パターン3上
に半田部4を半田レベラ手段などにより積層して形成さ
れている。
【0004】11はボンディングヘッドであって、TA
BチップPを吸着するノズル12と、TABチップPの
リードLを電極部2に押し付けて熱圧着する熱圧着子1
3を備えている。上述のように、このリードLはフィル
ムキャリヤを打抜いて形成されたものである。
BチップPを吸着するノズル12と、TABチップPの
リードLを電極部2に押し付けて熱圧着する熱圧着子1
3を備えている。上述のように、このリードLはフィル
ムキャリヤを打抜いて形成されたものである。
【0005】ボンディングを行うにあたっては、リード
Lと電極部2をマッチングさせて、リードLを電極部2
上に着地させ、次いで熱圧着子13を下降させて、リー
ドLを電極部2に押し付け、熱溶着する。
Lと電極部2をマッチングさせて、リードLを電極部2
上に着地させ、次いで熱圧着子13を下降させて、リー
ドLを電極部2に押し付け、熱溶着する。
【0006】この場合、熱圧着子13の押し付け力が過
小であると、リードLは電極部2に溶着されず、ボンデ
ィング不良となる。また押し付け力が過大であると、図
4鎖線に示すように、この過大な押し付け力のために、
リードLは電極部2に溶着される前にこれから滑り落
ち、ボンディング不良となる。殊に半田部4の形状は、
図示するように一般にかまぼこ状であるので、リードL
は滑り落ちやすいものである。更にこの場合、半田部4
に熱圧着子13が過度に押し付けられる結果、溶融した
半田が側方へはみ出し、このはみ出し半田4aにより電
極部2と電極部2が短絡してしまう問題点があった。
小であると、リードLは電極部2に溶着されず、ボンデ
ィング不良となる。また押し付け力が過大であると、図
4鎖線に示すように、この過大な押し付け力のために、
リードLは電極部2に溶着される前にこれから滑り落
ち、ボンディング不良となる。殊に半田部4の形状は、
図示するように一般にかまぼこ状であるので、リードL
は滑り落ちやすいものである。更にこの場合、半田部4
に熱圧着子13が過度に押し付けられる結果、溶融した
半田が側方へはみ出し、このはみ出し半田4aにより電
極部2と電極部2が短絡してしまう問題点があった。
【0007】したがって本発明は、上記従来の問題点を
解消できる手段を提供することを目的とする。
解消できる手段を提供することを目的とする。
【0008】
【課題を解決するための手段】このために本発明は、基
板の電極部の近傍に、熱圧着子の下降限度を規制するス
ペーサを突設したものである。
板の電極部の近傍に、熱圧着子の下降限度を規制するス
ペーサを突設したものである。
【0009】
【作用】上記構成によれば、熱圧着子の下降限度はスペ
ーサにより規制されることから、適度の押し付け力でリ
ードを電極部に押し付けて良好にボンディングできる。
ーサにより規制されることから、適度の押し付け力でリ
ードを電極部に押し付けて良好にボンディングできる。
【0010】
【実施例】次に、図面を参照しながら本発明の実施例を
説明する。
説明する。
【0011】図1は基板の斜視図である。この基板1
は、上記従来の基板1と同構造であるが、電極部2の近
傍のコーナー部にスペーサ5を突設している点が相違し
ている。このスペーサ5の形成方法は任意であって、例
えば回路パターン3と一緒にエッチング手段により形成
してもよく、あるいは回路パターン3とは別途に形成し
てもよい。
は、上記従来の基板1と同構造であるが、電極部2の近
傍のコーナー部にスペーサ5を突設している点が相違し
ている。このスペーサ5の形成方法は任意であって、例
えば回路パターン3と一緒にエッチング手段により形成
してもよく、あるいは回路パターン3とは別途に形成し
てもよい。
【0012】図2に示すように、このスペーサ5の高さ
は、電極部2の高さよりもわずかに高く、この電極部2
上にボンディングされるリードLの高さと同高若しくは
略同高になっている。
は、電極部2の高さよりもわずかに高く、この電極部2
上にボンディングされるリードLの高さと同高若しくは
略同高になっている。
【0013】リードLのボンディングは、図3に示す従
来手段と同様に行われる。すなわち、リードLと電極部
2をマッチングさせて、リードLを電極部2上に着地さ
せ、次いで熱圧着子13を下降させて、リードLを電極
部2に押し付け、熱溶着する。
来手段と同様に行われる。すなわち、リードLと電極部
2をマッチングさせて、リードLを電極部2上に着地さ
せ、次いで熱圧着子13を下降させて、リードLを電極
部2に押し付け、熱溶着する。
【0014】この場合、熱圧着子13の下降限度はスペ
ーサ5により規制され、リードLは半田部4から滑り落
ちることなく適度の力で電極部2に押し付けられてボン
ディングされ、また上述したような過大な押し付け力に
よる半田のはみ出しも解消できる。また半田部4は厚さ
のばらつきがあるが、本手段によれば、すべての半田部
4の高さが同一になるようにレベリングでき、しかもボ
ンディング後の半田部4の厚さが所定厚さになるよう
に、スペーサ5の高さを設定することも可能である。
ーサ5により規制され、リードLは半田部4から滑り落
ちることなく適度の力で電極部2に押し付けられてボン
ディングされ、また上述したような過大な押し付け力に
よる半田のはみ出しも解消できる。また半田部4は厚さ
のばらつきがあるが、本手段によれば、すべての半田部
4の高さが同一になるようにレベリングでき、しかもボ
ンディング後の半田部4の厚さが所定厚さになるよう
に、スペーサ5の高さを設定することも可能である。
【0015】
【発明の効果】以上説明したように本発明は、基板の電
極部の近傍に、熱圧着子の下降限度を規制するスペーサ
を突設しているので、ボンディング中にリードが半田部
から滑り落ちることはなく、適度の押し付け力で良好に
ボンディングすることができ、また半田部の厚さのばら
つきを吸収して、すべての半田部の高さが同一になるよ
うにレベリングでき、しかもボンディング後の半田部の
厚さが所定厚さになるように設定することも可能とな
る。
極部の近傍に、熱圧着子の下降限度を規制するスペーサ
を突設しているので、ボンディング中にリードが半田部
から滑り落ちることはなく、適度の押し付け力で良好に
ボンディングすることができ、また半田部の厚さのばら
つきを吸収して、すべての半田部の高さが同一になるよ
うにレベリングでき、しかもボンディング後の半田部の
厚さが所定厚さになるように設定することも可能とな
る。
【図1】本発明に係る基板の斜視図
【図2】本発明に係るボンディング中の正面図
【図3】従来手段のボンディング中の斜視図
【図4】従来手段のボンディング中の正面図
1 基板 2 電極部 3 回路パターン 4 半田部 5 スペーサ 13 熱圧着子
Claims (1)
- 【請求項1】回路パターン上に半田部を積層して形成さ
れた電極部の近傍に、熱圧着子の下降限度を規制するス
ペーサを突設したことを特徴とするTABチップの搭載
用基板。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP20167491A JPH0547833A (ja) | 1991-08-12 | 1991-08-12 | Tabチツプの搭載用基板 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP20167491A JPH0547833A (ja) | 1991-08-12 | 1991-08-12 | Tabチツプの搭載用基板 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH0547833A true JPH0547833A (ja) | 1993-02-26 |
Family
ID=16445022
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP20167491A Pending JPH0547833A (ja) | 1991-08-12 | 1991-08-12 | Tabチツプの搭載用基板 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH0547833A (ja) |
Cited By (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH07235566A (ja) * | 1994-02-22 | 1995-09-05 | Nec Corp | 光素子の実装構造 |
US5666332A (en) * | 1995-06-09 | 1997-09-09 | Sharp Kabushiki Kaisha | Magneto-optical recording medium permitting an initializing magnetic field smaller than a recording magnetic field, and method of recording there on |
US5724630A (en) * | 1995-03-06 | 1998-03-03 | Sharp Kabushiki Kaisha | Image forming apparatus with standby temperature control of thermal fixing |
JP2010146411A (ja) * | 2008-12-19 | 2010-07-01 | Toshiba Corp | インレットの製造方法及びこの製造方法によって製造されるインレット |
JP2011240007A (ja) * | 2010-05-20 | 2011-12-01 | Hitachi Aloka Medical Ltd | 超音波探触子及び超音波探触子の製造方法 |
-
1991
- 1991-08-12 JP JP20167491A patent/JPH0547833A/ja active Pending
Cited By (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH07235566A (ja) * | 1994-02-22 | 1995-09-05 | Nec Corp | 光素子の実装構造 |
US5724630A (en) * | 1995-03-06 | 1998-03-03 | Sharp Kabushiki Kaisha | Image forming apparatus with standby temperature control of thermal fixing |
US5666332A (en) * | 1995-06-09 | 1997-09-09 | Sharp Kabushiki Kaisha | Magneto-optical recording medium permitting an initializing magnetic field smaller than a recording magnetic field, and method of recording there on |
JP2010146411A (ja) * | 2008-12-19 | 2010-07-01 | Toshiba Corp | インレットの製造方法及びこの製造方法によって製造されるインレット |
JP2011240007A (ja) * | 2010-05-20 | 2011-12-01 | Hitachi Aloka Medical Ltd | 超音波探触子及び超音波探触子の製造方法 |
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