JPH05244345A - Picture reader - Google Patents
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- JPH05244345A JPH05244345A JP4075280A JP7528092A JPH05244345A JP H05244345 A JPH05244345 A JP H05244345A JP 4075280 A JP4075280 A JP 4075280A JP 7528092 A JP7528092 A JP 7528092A JP H05244345 A JPH05244345 A JP H05244345A
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Abstract
Description
【0001】[0001]
【産業上の利用分野】本発明は、原稿等の画像上を手動
で走査して、その画像を読み取る画像読取装置に関す
る。BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to an image reading device for manually scanning an image of a document or the like to read the image.
【0002】[0002]
【従来の技術】従来の手動操作型の画像読取装置(以
下、スキャナと称す)は、原稿上に光を照射する光源
と、原稿上のイメージを撮像するCCD等からなる撮像
手段と、スキャナの移動速度に応じたパルスを発生する
エンコーダを有している。2. Description of the Related Art A conventional manually operated image reading apparatus (hereinafter referred to as a scanner) includes a light source for irradiating an original with light, an image pickup means including a CCD for picking up an image on the original, and a scanner. It has an encoder that generates a pulse according to the moving speed.
【0003】エンコーダは、図5にローラ1と、ローラ
1と同期して回転する、多数のスリット2aを円周方向
に配したロータリーエンコーダ2と、ロータリーエンコ
ーダ2のスリット2aに対向する位置に設けられたフォ
トインタラプタ3からなり、フォトインタラプタ3はス
リット2aの有無に応じたタイミングパルスを出力す
る。The encoder is provided in FIG. 5 with a roller 1, a rotary encoder 2 rotating in synchronization with the roller 1 and having a number of slits 2a arranged in the circumferential direction, and a position facing the slit 2a of the rotary encoder 2. The photo interrupter 3 outputs a timing pulse according to the presence or absence of the slit 2a.
【0004】従って、スキャナが原稿上を移動するとそ
の移動速度に応じた回転速度でロータリーエンコーダ2
が回転するので、この回転速度に同期したタイミングパ
ルスがフォトインタラプタ3から得られ、各タイミング
パルスの発生タイミングに応じて1ライン分の画像が撮
像手段から画像信号として得られる。Therefore, when the scanner moves on the document, the rotary encoder 2 is rotated at a rotational speed corresponding to the moving speed.
, The timing pulse synchronized with this rotation speed is obtained from the photo interrupter 3, and an image for one line is obtained as an image signal from the image pickup means in accordance with the generation timing of each timing pulse.
【0005】ところで従来のスキャナにおいて解像度を
向上させるためには、タイミングパルスの発生周期を短
くすることが必要であるが、そのためにはロータリーエ
ンコーダ2の1回転当たりのスリット2aの数を増やす
か、あるいは減速ギアを用いてローラ1の回転速度より
も速い回転速度をロータリーエンコーダ2に与えること
が考えられる。By the way, in order to improve the resolution in the conventional scanner, it is necessary to shorten the generation period of the timing pulse. For that purpose, the number of slits 2a per one rotation of the rotary encoder 2 is increased, or Alternatively, it is conceivable to use a reduction gear to give the rotary encoder 2 a rotation speed higher than that of the roller 1.
【0006】[0006]
【発明が解決しようとする課題】しかしながらロータリ
ーエンコーダ2の1回転当たりのスリット2aの数を増
やすためにはロータリーエンコーダ2の径を大きくしな
ければならず、また減速ギアを用いる場合にも減速比率
を向上させるためには多数の減速ギアを用いたり、ギア
比の大きな減速ギアを用いる必要があり、いずれにして
も装置の大型化や組立の複雑化は避けられない。However, in order to increase the number of slits 2a per one rotation of the rotary encoder 2, the diameter of the rotary encoder 2 must be increased, and when the reduction gear is used, the reduction ratio is also reduced. In order to improve the above, it is necessary to use a large number of reduction gears or a reduction gear having a large gear ratio, and in any case, it is inevitable that the device becomes large and the assembly becomes complicated.
【0007】本発明はロータリーエンコーダ2のスリッ
トの数を増やしたり、あるいはロータリーエンコーダ2
の回転速度を上げることなく、読取画像の解像度を向上
することのできる画像読取装置を提供することを目的と
する。In the present invention, the number of slits of the rotary encoder 2 is increased, or the rotary encoder 2
It is an object of the present invention to provide an image reading apparatus capable of improving the resolution of a read image without increasing the rotation speed of the.
【0008】[0008]
【課題を解決するための手段】本発明の画像読取装置
は、画像上を走査して画像を読み取る画像読取装置であ
って、所定周期のクロック信号を発生するクロック信号
発生手段としてのクロックジェネレータ85と、クロッ
ク信号に応じて1ライン分の画像を撮像し、これを画像
信号として出力する撮像手段としてのCCD7と、画像
信号を複数ラインにわたり記憶する記憶手段としてのメ
モリ83と、画像上を走査する走査速度に応じたパルス
を発生するエンコーダとしてのロータリーエンコーダ2
と、パルスの発生タイミングに応じてメモリ83に記憶
された複数の画像信号のうちの少なくとも1つを選択し
て出力する選択手段としての選択回路86を備えたこと
を特徴とする。An image reading apparatus of the present invention is an image reading apparatus which scans an image to read the image, and is a clock generator 85 as a clock signal generating means for generating a clock signal of a predetermined cycle. A CCD 7 as an image pickup means for picking up an image of one line according to a clock signal and outputting it as an image signal, a memory 83 as a storage means for storing the image signal over a plurality of lines, and scanning on the image. Rotary encoder 2 as an encoder for generating pulses according to the scanning speed
And a selection circuit 86 as selection means for selecting and outputting at least one of the plurality of image signals stored in the memory 83 in accordance with the pulse generation timing.
【0009】[0009]
【作用】上記構成の画像読取装置においては、CCD7
はクロックジェネレータ85から所定周期で供給される
クロック信号に応じて1ライン分の画像を画像信号とし
て出力し、各ラインの画像信号は2値化されてメモリ8
3に記憶される。エンコーダ2は走査速度に応じたパル
スを発生する。In the image reading apparatus having the above structure, the CCD 7
Outputs an image of one line as an image signal in accordance with a clock signal supplied from the clock generator 85 in a predetermined cycle, and the image signal of each line is binarized and stored in the memory 8
3 is stored. The encoder 2 generates a pulse according to the scanning speed.
【0010】クロックジェネレータ85のクロック周期
は、手動走査による走査速度においてエンコーダ2が発
生するパルスの周期よりも十分に短い周期に設定されて
いる。従ってエンコーダ2が発生するパルスの1周期内
に、複数の画像信号がメモリ83に記憶される。The clock cycle of the clock generator 85 is set to a cycle sufficiently shorter than the cycle of the pulse generated by the encoder 2 at the scanning speed of manual scanning. Therefore, a plurality of image signals are stored in the memory 83 within one cycle of the pulse generated by the encoder 2.
【0011】選択回路86はエンコーダ2の発生するパ
ルスの発生タイミングに応じてメモリ83に記憶された
複数ラインの画像信号のうちの少なくとも1つ(例えば
4つ)を選択する。The selection circuit 86 selects at least one (for example, four) of the image signals of a plurality of lines stored in the memory 83 according to the generation timing of the pulse generated by the encoder 2.
【0012】これによりエンコーダ2の発生するパルス
の数よりも多いラインの画像信号を出力することがで
き、解像度を向上させることができる。As a result, it is possible to output image signals of more lines than the number of pulses generated by the encoder 2, and it is possible to improve the resolution.
【0013】[0013]
【実施例】以下、本発明の実施例を図面を参照して説明
する。Embodiments of the present invention will be described below with reference to the drawings.
【0014】図1は手動操作型のスキャナの一実施例の
構成を示す断面図であり、本体4は原稿面10上を走査
可能になされており、内部にはランプ等の光源5と、原
稿面10で反射された光を撮像手段としてのCCD7に
導くためのミラー6が設けられている。FIG. 1 is a sectional view showing the construction of an embodiment of a manually operated scanner, in which a main body 4 is capable of scanning a document surface 10 and a light source 5 such as a lamp and a document are provided inside. A mirror 6 is provided for guiding the light reflected by the surface 10 to a CCD 7 as an image pickup means.
【0015】CCD7は反射光のレベル、分布等を撮像
して画像信号とするものであり、画像信号は信号処理回
路8に供給されている。The CCD 7 picks up the level, distribution, etc. of the reflected light to obtain an image signal, and the image signal is supplied to the signal processing circuit 8.
【0016】信号処理回路8は読み取られた画像を処理
した後、ケーブル9を介して外部のパソコン等に画像信
号を供給する。The signal processing circuit 8 processes the read image and then supplies the image signal to an external personal computer or the like via the cable 9.
【0017】本体4の原稿面と対向する位置に、ローラ
1が原稿面を転動自在に設けられており、ローラ1の回
転量は減速ギア11a,11bを介してエンコーダ2に
伝達されるようになされている。この減速ギア11a,
11bは特に減速比の大きなものや、あるいはその数を
増やす必要はなく、従来から用いられているものであ
る。A roller 1 is provided rotatably on the document surface of the main body 4 at a position facing the document surface, and the rotation amount of the roller 1 is transmitted to the encoder 2 via reduction gears 11a and 11b. Has been done. This reduction gear 11a,
No. 11b has a particularly large reduction gear ratio, or it is not necessary to increase the number thereof, and it has been conventionally used.
【0018】エンコーダ2からの出力パルスもまた信号
処理回路8に供給される。The output pulse from the encoder 2 is also supplied to the signal processing circuit 8.
【0019】本体4には外部のパソコン等との信号伝達
を図るためのケーブル9が接続されている。A cable 9 for connecting a signal to an external personal computer or the like is connected to the main body 4.
【0020】図2は信号処理回路8の一実施例の構成を
示すブロック図であり、CCD7には所定周期のクロッ
ク信号発生手段としてのクロックジェネレータ85が発
生するクロックSTが供給されており、CCD7は各ク
ロックST毎に1ライン分の画像信号を出力する。FIG. 2 is a block diagram showing the configuration of an embodiment of the signal processing circuit 8. The CCD 7 is supplied with a clock ST generated by a clock generator 85 as a clock signal generating means of a predetermined cycle. Outputs an image signal for one line for each clock ST.
【0021】クロックジェネレータ85の発生するクロ
ックSTの周期は、一般的な手動走査による走査速度に
おいてロータリーエンコーダ2が発生するパルスKSの
周期よりも十分に短い周期に設定されている。The cycle of the clock ST generated by the clock generator 85 is set to be sufficiently shorter than the cycle of the pulse KS generated by the rotary encoder 2 at the scanning speed of general manual scanning.
【0022】CCD7で読み取られた画像信号は増幅器
81で増幅された後、A/D変換器等の2値化回路84
にて輝度レベルや色信号に応じた2値信号VDに変換さ
れ、メモリ83に記憶される。The image signal read by the CCD 7 is amplified by an amplifier 81 and then binarized circuit 84 such as an A / D converter.
Is converted into a binary signal VD according to the luminance level and the color signal and stored in the memory 83.
【0023】クロックジェネレータ85の発生するクロ
ックSTは選択手段としての選択回路86、及びタイミ
ング一致回路87にも供給されており、タイミング一致
回路87にはさらにロータリーエンコーダ2が発生する
パルスKSが供給されている。The clock ST generated by the clock generator 85 is also supplied to the selection circuit 86 as the selection means and the timing matching circuit 87, and the timing matching circuit 87 is further supplied with the pulse KS generated by the rotary encoder 2. ing.
【0024】タイミング一致回路87は入力される両パ
ルスST,KSのタイミングを一致させるためのもので
あり、例えば図3に示すようにロータリーエンコーダ2
の発生するパルスKSによりセットされ、クロックST
によりリセットされるRSフリップフロップ20と、R
Sフリップフロップ21のQ出力を所定時間d遅延する
遅延回路21と、遅延回路21の出力とクロックSTの
論理積を得るアンドゲート22とから構成され、アンド
ゲート22の出力がタイミング信号YSとなる。タイミ
ング信号YSは選択回路86に供給される。The timing matching circuit 87 is for matching the timings of both pulses ST and KS to be inputted, and for example, as shown in FIG.
Is set by the pulse KS generated by the clock ST
RS flip-flop 20 reset by
The delay circuit 21 delays the Q output of the S flip-flop 21 by a predetermined time d, and the AND gate 22 that obtains the logical product of the output of the delay circuit 21 and the clock ST. The output of the AND gate 22 becomes the timing signal YS. .. The timing signal YS is supplied to the selection circuit 86.
【0025】選択回路86はタイミング信号YSが発生
した時点においてリセットされ、クロックSTによりカ
ウントアップるカウンタを内蔵し、タイミング信号YS
の1周期においてメモリ83に記憶されるライン数を監
視できるようになされているとともに、タイミング信号
YSの発生に応じてでメモリ83に記憶されている複数
ラインのうちの例えば4ライン分を選択してこれを読出
し、インターフェース84に供給する。The selection circuit 86 has a built-in counter that is reset when the timing signal YS is generated and counts up with the clock ST.
The number of lines stored in the memory 83 can be monitored in one cycle of, and, for example, four lines among a plurality of lines stored in the memory 83 are selected in response to the generation of the timing signal YS. This is read out and supplied to the interface 84.
【0026】インターフェース84はケーブル9を介し
て接続される外部のパソコンなどとのデータの整合を図
るものである。The interface 84 is for matching data with an external personal computer or the like connected via the cable 9.
【0027】次に図2の信号処理回路の動作を図4のタ
イミングチャートを参照して説明する。Next, the operation of the signal processing circuit of FIG. 2 will be described with reference to the timing chart of FIG.
【0028】クロックSTは所定周期で発生し、このク
ロックSTの発生タイミングに応じてCCD7が1ライ
ン分の画像信号VDを出力する。各ラインの画像信号V
Dはメモリ83に記憶される。The clock ST is generated in a predetermined cycle, and the CCD 7 outputs the image signal VD for one line in accordance with the generation timing of the clock ST. Image signal V of each line
D is stored in the memory 83.
【0029】エンコーダ2から任意のタイミングで発生
するパルスKSがタイミング一致回路87におけるRS
フリップフロップ20のセット入力端子に供給されるの
で、パルスKSの立ち上がりエッジに同期してRSフリ
ップフロップ20のQ出力端子から高レベルの信号Q1
が出力される。The pulse KS generated from the encoder 2 at an arbitrary timing is RS in the timing matching circuit 87.
Since it is supplied to the set input terminal of the flip-flop 20, the high-level signal Q1 from the Q output terminal of the RS flip-flop 20 is synchronized with the rising edge of the pulse KS.
Is output.
【0030】信号Q1 は遅延回路21によって所定時間
dだけ遅延され、信号Q2 が得られる。The signal Q1 is delayed by the delay circuit 21 for a predetermined time d to obtain the signal Q2.
【0031】パルスKSの発生直後の最初のクロックS
TによってRSフリップフロップ20がリセットされ、
Q出力は低レベルとなる。First clock S immediately after generation of pulse KS
RS flip-flop 20 is reset by T,
The Q output goes low.
【0032】従ってアンドゲート22の出力は、パルス
KSの発生直後の最初のクロックSTの発生タイミング
に一致したタイミング信号YSとなり、これは換言すれ
ばパルスKSのタイミングをクロックSTに一致させる
作用を有する。Therefore, the output of the AND gate 22 becomes the timing signal YS which coincides with the generation timing of the first clock ST immediately after the generation of the pulse KS, which in other words has the action of matching the timing of the pulse KS with the clock ST. ..
【0033】選択回路86はタイミング信号YSの発生
タイミングに応じて、それまでメモリ83に記憶されて
いた複数ラインの画像信号のうちの、たとえば4ライン
分を選択して読み出す。The selection circuit 86 selects and reads, for example, four lines of the image signals of a plurality of lines stored in the memory 83 until then according to the generation timing of the timing signal YS.
【0034】図4においては時刻Bにおいて、直前のタ
イミング信号YSの後に5ライン分の画像信号VDがメ
モリ83に記憶されているので、選択回路86はこの中
から4ライン分の画像信号VDを選択する。In FIG. 4, at time B, since the image signal VD for 5 lines is stored in the memory 83 after the timing signal YS immediately before, the selection circuit 86 selects the image signal VD for 4 lines from this. select.
【0035】選択回路86が選択する画像信号VDは、
最新の画像信号VDを選択するようにしてもよいが、タ
イミング信号YSの1周期の期間に記憶された画像信号
VDのライン数を監視しているので、複数ラインの画像
信号VDのうち、できるだけ均等な間隔のラインの画像
信号VDを選択するようにすることが好ましい。すなわ
ち、タイミング信号YSの1周期の間に7ラインの画像
信号VDが記憶されている場合には、1,3,5,7ラ
インの画像信号VDを選択する。The image signal VD selected by the selection circuit 86 is
The latest image signal VD may be selected, but the number of lines of the image signal VD stored in the period of one cycle of the timing signal YS is monitored. It is preferable to select the image signals VD of lines with equal intervals. That is, when the image signals VD of 7 lines are stored during one cycle of the timing signal YS, the image signals VD of 1, 3, 5, 7 lines are selected.
【0036】従って、従来はパルスKSの発生毎に1ラ
イン分の画像信号が読み取られていたものに対して、4
倍の解像度を得ることができる。Therefore, in contrast to the conventional case where the image signal for one line is read every time the pulse KS is generated,
Double resolution can be obtained.
【0037】なお上記実施例においては選択回路86が
選択するライン数を4ラインとして説明したが、これに
限られることはなく、必要な解像度、クロックSTの周
波数、メモリ83の容量等を考慮して、2ライン、8ラ
イン等の適当なライン数に設定することもできる。Although the number of lines selected by the selection circuit 86 is four in the above embodiment, the number of lines is not limited to this, and the necessary resolution, the frequency of the clock ST, the capacity of the memory 83, etc. are taken into consideration. Therefore, it is possible to set an appropriate number of lines such as 2 lines and 8 lines.
【0038】[0038]
【発明の効果】以上のように本発明の画像読取装置によ
れば、クロック発生手段の発生するクロックSTに応じ
て1ラインの画像信号を出力する撮像手段と、複数ライ
ンの画像信号を記憶する記憶手段と、走査速度に応じた
パルスを発生するエンコーダと、パルスに応じてメモリ
に記憶された複数の画像信号のうちの少なくとも1つを
選択する選択手段とを備えたので、従来のエンコーダを
用いた場合においても読取画像の解像度を向上させるこ
とができる。 また減速ギアの数を減らしたり、あるい
はロータリーエンコーダの径を小型化させることが可能
となる。As described above, according to the image reading apparatus of the present invention, the image pickup means for outputting the image signal of one line in response to the clock ST generated by the clock generation means and the image signals of a plurality of lines are stored. Since the storage means, the encoder that generates a pulse according to the scanning speed, and the selection means that selects at least one of the plurality of image signals stored in the memory according to the pulse are provided, the conventional encoder is used. Even when used, the resolution of the read image can be improved. It is also possible to reduce the number of reduction gears or reduce the diameter of the rotary encoder.
【図1】本発明の画像読取装置の一実施例の構成を示す
断面図FIG. 1 is a sectional view showing a configuration of an embodiment of an image reading apparatus of the present invention.
【図2】図1の信号処理回路8の一実施例の構成を示す
ブロック図FIG. 2 is a block diagram showing the configuration of an embodiment of the signal processing circuit 8 of FIG.
【図3】図2のタイミング一致回路の一実施例の構成を
示すブロック図FIG. 3 is a block diagram showing the configuration of an embodiment of the timing matching circuit of FIG.
【図4】図2の信号処理回路8の各部の信号波形を示す
タイミングチャート4 is a timing chart showing signal waveforms of various parts of the signal processing circuit 8 of FIG.
【図5】従来のエンコーダの一例の構成を示すブロック
図FIG. 5 is a block diagram showing a configuration of an example of a conventional encoder.
1 ローラ 2 ロータリーエンコーダ(エンコーダ) 3 フォトインタラプタ 4 本体 5 光源 6 ミラー 7 CCD(撮像手段) 8 信号処理回路 81 増幅器 82 2値化回路 83 メモリ(記憶手段) 84 インターフェイス 85 クロックジェネレータ(クロック信号発生手段) 86 選択回路(選択手段) 87 タイミング一致回路 DESCRIPTION OF SYMBOLS 1 roller 2 rotary encoder (encoder) 3 photo interrupter 4 main body 5 light source 6 mirror 7 CCD (imaging means) 8 signal processing circuit 81 amplifier 82 binarization circuit 83 memory (storing means) 84 interface 85 clock generator (clock signal generating means) ) 86 selection circuit (selection means) 87 timing coincidence circuit
Claims (1)
取装置であって、 所定周期のクロック信号を発生するクロック信号発生手
段と、 前記クロック信号に応じて1ライン分の画像を撮像し、
これを画像信号として出力する撮像手段と、 前記画像信号を複数ラインにわたり記憶する記憶手段
と、 前記画像上を走査する走査速度に応じたパルスを発生す
るエンコーダと、 前記パルスの発生タイミングに応じて前記記憶手段に記
憶された複数の画像信号のうちの少なくとも1つを選択
して出力する選択手段と、 を備えたことを特徴とする画像読取装置。1. An image reading apparatus for scanning an image to read the image, comprising: a clock signal generating means for generating a clock signal having a predetermined cycle; and an image for one line is picked up according to the clock signal.
An image pickup unit that outputs the image signal as an image signal, a storage unit that stores the image signal over a plurality of lines, an encoder that generates a pulse according to a scanning speed for scanning the image, and a generation timing of the pulse. An image reading apparatus comprising: a selection unit that selects and outputs at least one of a plurality of image signals stored in the storage unit.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP4075280A JPH05244345A (en) | 1992-02-26 | 1992-02-26 | Picture reader |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP4075280A JPH05244345A (en) | 1992-02-26 | 1992-02-26 | Picture reader |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH05244345A true JPH05244345A (en) | 1993-09-21 |
Family
ID=13571664
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP4075280A Withdrawn JPH05244345A (en) | 1992-02-26 | 1992-02-26 | Picture reader |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH05244345A (en) |
-
1992
- 1992-02-26 JP JP4075280A patent/JPH05244345A/en not_active Withdrawn
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Legal Events
Date | Code | Title | Description |
---|---|---|---|
A300 | Withdrawal of application because of no request for examination |
Free format text: JAPANESE INTERMEDIATE CODE: A300 Effective date: 19990518 |