JPH05122257A - Msk modulation communication system - Google Patents
Msk modulation communication systemInfo
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- JPH05122257A JPH05122257A JP27570291A JP27570291A JPH05122257A JP H05122257 A JPH05122257 A JP H05122257A JP 27570291 A JP27570291 A JP 27570291A JP 27570291 A JP27570291 A JP 27570291A JP H05122257 A JPH05122257 A JP H05122257A
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- conversion circuit
- serial
- parallel
- demodulator
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Landscapes
- Error Detection And Correction (AREA)
- Digital Transmission Methods That Use Modulated Carrier Waves (AREA)
Abstract
Description
【0001】[0001]
【産業上の利用分野】本発明はMSK変復調器とビタビ
復号法とを組み合わせたMSK変調通信システムに関す
る。BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to an MSK modulation communication system combining an MSK modulator / demodulator and a Viterbi decoding method.
【0002】[0002]
【従来の技術】衛星通信における直交変復調器としてQ
PSK(Quadrature Phase Shift Keying :4相位相変
調)が広く用いられているが、MSK(Minimum Phase
ShiftKeying)変復調器は、特に非線形回路が適用され
るシステムにおいてQPSKに対して優れた特性を示す
ことが良く知られている。Q is used as an orthogonal modulator / demodulator in satellite communication.
PSK (Quadrature Phase Shift Keying) is widely used, but MSK (Minimum Phase)
It is well known that the Shift Keying modulator / demodulator exhibits excellent characteristics with respect to QPSK particularly in a system to which a non-linear circuit is applied.
【0003】まず、図3ないし図5を参照してMSK変
復調器の概要を説明する。First, an outline of the MSK modulator / demodulator will be described with reference to FIGS.
【0004】図3はMSK変復調器の基本構成を示すブ
ロック図で、1,2,4,5,8,9は乗算器、3,1
4はフリップフロップ、6は合成器、7は分配器、1
0,11はA/D変換器、12,13は排他的論理和ゲ
ート、TXI,TXQは夫々ビットレートがfsの送信
データ系列である。FIG. 3 is a block diagram showing the basic configuration of the MSK modulator / demodulator. Reference numerals 1, 2, 4, 5, 8, 9 are multipliers, and 3, 1
4 is a flip-flop, 6 is a synthesizer, 7 is a distributor, 1
Reference numerals 0 and 11 are A / D converters, 12 and 13 are exclusive OR gates, and TXI and TXQ are transmission data sequences each having a bit rate of fs.
【0005】また、図4(a)〜(d)は夫々図2の構
成のMSK変復調器のA〜D点におけるデータ系列のタ
イムチャートであり、説明の便宜上全て矩形波で表して
いる。図5(a)は図2の構成のMSK変復調方式の乗
算器1,2のデータと正弦波及び余弦波との位相関係、
(b)は排他的論理和ゲート12,13のデータと正弦
波状及び余弦波状クロックとの位相関係を示す図であ
る。Further, FIGS. 4A to 4D are time charts of data series at points A to D of the MSK modulator / demodulator having the configuration of FIG. 2, respectively, and are all represented by rectangular waves for convenience of explanation. FIG. 5A is a phase relationship between the data of the MSK modulator / demodulator multipliers 1 and 2 having the configuration of FIG. 2 and a sine wave and a cosine wave,
(B) is a diagram showing the phase relationship between the data of the exclusive OR gates 12 and 13 and the sine-wave and cosine-wave clocks.
【0006】まず、図3を参照すると、TXI,TXQ
のうち、TXIは、そのまま乗算器1に供給され、周波
数fs/2の余弦波と掛け合わされる。一方、TXQは
フリップフロップ3にて半ビット遅延された後に乗算器
2に供給され、周波数fs/2の正弦波と掛け合わされ
る。First, referring to FIG. 3, TXI, TXQ
Among them, TXI is directly supplied to the multiplier 1 and is multiplied by the cosine wave of the frequency fs / 2. On the other hand, TXQ is delayed by half a bit in the flip-flop 3 and then supplied to the multiplier 2 to be multiplied by the sine wave having the frequency fs / 2.
【0007】以下、各乗算器1,2の出力を夫々TXI
I,TXQQと表す。TXII,TXQQは、その後、
QPSKと同様に乗算器4,5で直交変調される。これ
により生成されたMSK変調波は合成器6を介して直交
変復調伝送路に出力される。以上がMSK変調器の主要
動作である。Below, the outputs of the multipliers 1 and 2 are respectively set to TXI.
Represented as I, TXQQ. TXII and TXQQ are then
Quadrature modulation is performed by the multipliers 4 and 5 similarly to QPSK. The MSK modulated wave generated by this is output to the orthogonal modulation / demodulation transmission line via the combiner 6. The above is the main operation of the MSK modulator.
【0008】一方、直交変復調伝送路のMSK変調波を
分配器7を介して受信したMSK復調器では、まず、乗
算器8,9でQPSKと同じように直交復調した後、A
/D変換器10,11でA/D変換して図4(c)に示
すような復調デジタルデータRXII,RXQQを得
る。On the other hand, in the MSK demodulator which receives the MSK modulated wave of the quadrature modulation / demodulation transmission line through the distributor 7, first, the multipliers 8 and 9 perform quadrature demodulation in the same manner as QPSK, and then A
The A / D converters 10 and 11 perform A / D conversion to obtain demodulated digital data RXII and RXQQ as shown in FIG.
【0009】ここで乗算器8,9に予め入力されている
正弦波、余弦波には位相角αが付加されている点に注意
を要する。これは、直交同期検波の際に生じる周知の再
生搬送波の位相曖昧度による効果であり、0、π/2、
π、−π/2のいずれかの値となる。αの値によって得
られるデータ系列は4通りになる。これらデータ系列を
図4(c)に示す。It should be noted that the sine wave and the cosine wave that are input in advance to the multipliers 8 and 9 are added with the phase angle α. This is an effect due to the well-known phase ambiguity of the reproduced carrier that occurs at the time of quadrature synchronous detection, and is 0, π / 2,
It has a value of either π or -π / 2. There are four types of data series obtained according to the value of α. These data series are shown in FIG.
【0010】RXII,RXQQは、夫々排他的論理和
ゲート12,13に導かれ、送信側(MSK変調器)と
同様に正弦波,余弦波と掛け合わされる。なお、RXI
I,RXQQは、既にデジタル信号となっているので、
乗算器は排他的論理和ゲート12,13で、正弦波,余
弦波は周波数fs/2のクロックで代用している。排他
的論理和ゲート12,13におけるデータ系列と正弦
波、余弦波の位相関係については図5(b)に示してあ
る。RXII and RXQQ are guided to exclusive OR gates 12 and 13, respectively, and are multiplied by a sine wave and a cosine wave as in the transmission side (MSK modulator). In addition, RXI
Since I and RXQQ are already digital signals,
The multipliers are exclusive OR gates 12 and 13, and a sine wave and a cosine wave are substituted by a clock having a frequency fs / 2. The phase relationship between the data series and the sine wave and cosine wave in the exclusive OR gates 12 and 13 is shown in FIG.
【0011】送信側(MSK変調器)のフリップフロッ
プ3ではQチャンネル側のデータ系列が半ビット分だけ
遅延されていたので、復調側では逆にRXIIをフリッ
プフロップ14で半ビット分遅延させ、RXIとして出
力する。一方、RXQQは、そのまま何の操作もされ
ず、RXQとして出力される。従って、RXQQとRX
Qとは同じデータ系列となる。RXI,RXQの出力タ
イミングを図5(d)に示す。以上がMSK復調器の動
作である。In the flip-flop 3 on the transmission side (MSK modulator), the data sequence on the Q-channel side is delayed by half a bit. Therefore, on the demodulation side, RXII is delayed by a half-bit by the flip-flop 14, and RXI is delayed. Output as. On the other hand, RXQQ is output as RXQ without any operation. Therefore, RXQQ and RX
Q has the same data series. The output timing of RXI and RXQ is shown in FIG. The above is the operation of the MSK demodulator.
【0012】ところで、畳み込み符号の持つ繰り返し構
造を利用して最ゆう復号を効率的に実行する復号法とし
てビタビ復号法がある。このビタビ復号法を例えば符号
化率R=1/2として上記MSK変復調器に付加するよ
うなMSK変調通信システムを構築する場合、MSK変
調器と畳み込み符号化器、MSK復調器とビタビ復号器
とのデータインターフェースの数は、夫々2本となる。
ビタビ復号器を軟判定量子化した場合はこの数は更に増
える。By the way, there is a Viterbi decoding method as a decoding method for efficiently performing maximum likelihood decoding by utilizing the iterative structure of a convolutional code. When constructing an MSK modulation communication system in which the Viterbi decoding method is added to the MSK modulator / demodulator with a coding rate R = 1/2, for example, an MSK modulator and a convolutional encoder, an MSK demodulator and a Viterbi decoder are used. There are two data interfaces for each.
This number is further increased when the Viterbi decoder is soft-decision quantized.
【0013】ビタビ復号器の軟判定量子化として現在良
く用いられているのは、直交復調された各チャンネルに
対して3ビット量子化であるから、この場合、MSK復
調器とビタビ復号器との間のデータインターフェースの
数は6本となる。即ち、MSK変調器と符号化器とで2
本、MSK復調器とビタビ復号器とで6本、計8本のデ
ータインターフェースが必要となる。The most commonly used soft-decision quantization of the Viterbi decoder is 3-bit quantization for each channel subjected to orthogonal demodulation. Therefore, in this case, the MSK demodulator and the Viterbi decoder are combined. There are six data interfaces between them. That is, the MSK modulator and the encoder are 2
A total of eight data interfaces are required, six for the MSK demodulator and the Viterbi decoder.
【0014】[0014]
【発明が解決しようとする課題】しかしながら、MSK
変調通信システムを構成する際、MSK変復調器とデジ
タル回路である畳み込み符号化器、ビタビ復号器とが夫
々物理的に別性質の装置である場合が良くある。このよ
うな場合、システムの信頼性を高めるためにもデータイ
ンターフェースの数は極力少なくするのが望ましい。[Problems to be Solved by the Invention] However, MSK
When constructing a modulation communication system, it is often the case that the MSK modulator / demodulator and the digital circuit, ie, the convolutional encoder and the Viterbi decoder, are physically different devices. In such a case, it is desirable to reduce the number of data interfaces as much as possible in order to improve the reliability of the system.
【0015】このインターフェースの数を削減する目的
で、MSK変調器と符号化器との間、及び、MSK復調
器とビタビ復号器との間に、夫々、データ系列の並直変
換を行うパラレル/シリアル変換回路とこの並直変換さ
れたデータ系列の直並再変換を行うシリアル/パラレル
変換回路とを対向挿入することが考えられるが、従来の
システムでは採用されていなかった。なぜならば良く知
られているように、パラレル/シリアル変換回路の出力
は一意に決定できるが、シリアル/パラレル変換回路の
出力には二通りの曖昧度が生じ、信頼性に欠けるからで
ある。For the purpose of reducing the number of interfaces, a parallel / parallel conversion is performed for parallel conversion of a data sequence between the MSK modulator and the encoder and between the MSK demodulator and the Viterbi decoder. It is conceivable to insert a serial conversion circuit and a serial / parallel conversion circuit that performs serial-parallel conversion of the data series that has undergone parallel-serial conversion, but this has not been adopted in the conventional system. This is because, as is well known, the output of the parallel / serial conversion circuit can be uniquely determined, but the output of the serial / parallel conversion circuit has two kinds of ambiguity and lacks reliability.
【0016】本発明はかかる背景のもとになされたもの
で、その目的とするところは、MSK変復調器にビタビ
復号法を組み合わせた場合にデータインターフェースの
数を削減し得るMSK変調通信システムを提供すること
にある。The present invention has been made under such a background, and an object thereof is to provide an MSK modulation communication system capable of reducing the number of data interfaces when a Viterbi decoding method is combined with an MSK modulator / demodulator. To do.
【0017】[0017]
【課題を解決するための手段】本発明のMSK変調通信
システムは、MSK変調波を直交変復調伝送路に送信す
る送信装置と、この直交変復調伝送路からMSK変調波
を受信して復号する受信装置とからなるMSK変調通信
システムであって、前記送信装置は、畳み込み符号化器
と、この畳み込み符号化器の出力データをMSK変調波
に変換するMSK変調器とを少なくとも有してなり、前
記受信装置は、前記MSK変調波を復調するMSK復調
器と、このMSK復調器で搬送波再生を行う際の位相曖
昧度を除去して特定位相のデータ系列に修正する位相曖
昧度除去器と、この位相曖昧度除去器の出力に基づいて
最ゆう復号を行うビタビ復号器とを少なくとも有してな
り、且つ、前記MSK復調器と前記位相曖昧度除去器と
の間には、データ系列の並直変換を行うパラレル/シリ
アル変換回路とこの並直変換されたデータ系列の直並再
変換を行うシリアル/パラレル変換回路とが対向挿入さ
れたものである。The MSK modulation communication system of the present invention includes a transmitter for transmitting an MSK modulation wave to an orthogonal modulation / demodulation transmission line, and a reception device for receiving and decoding the MSK modulation wave from the orthogonal modulation / demodulation transmission line. And a MSK modulator for converting output data of the convolutional encoder into an MSK modulated wave. The apparatus includes an MSK demodulator that demodulates the MSK modulated wave, a phase ambiguity remover that removes a phase ambiguity when a carrier is reproduced by the MSK demodulator and corrects a data sequence of a specific phase, and the phase ambiguity remover. A Viterbi decoder for performing maximum likelihood decoding based on the output of the disambiguator, and data between the MSK demodulator and the phase disambiguator. A serial / parallel conversion circuit for performing serial-parallel reconversion parallel / serial conversion circuit and the parallel-serial converted data series for performing parallel-serial conversion of the column is one that is opposed inserted.
【0018】本発明のMSK変調通信システムは、上記
構成に加え、更に前記畳み込み符号化器と前記MSK変
調器との間にも前記パラレル/シリアル変換回路と前記
シリアル/パラレル変換回路とが対向挿入されたもので
ある。In the MSK modulation communication system of the present invention, in addition to the above configuration, the parallel / serial conversion circuit and the serial / parallel conversion circuit are oppositely inserted between the convolutional encoder and the MSK modulator. It was done.
【0019】[0019]
【実施例】以下、図1及び図2を参照して本発明の実施
例を説明する。なお、本実施例は上記MSK変復調器を
基本構成とするので、必要に応じ、図3〜図5をも併せ
て参照する。Embodiments of the present invention will be described below with reference to FIGS. Since this embodiment has the above-mentioned MSK modulator / demodulator as a basic configuration, FIGS. 3 to 5 will also be referred to as necessary.
【0020】図1は本発明の一実施例に係るMSK変調
通信システムのブロック構成図であり、20は符号化
器、21は第一のパラレル/シリアル変換回路、22は
第一のシリアル/パラレル変換回路、23はMSK変復
調器、24は第二のパラレル/シリアル変換回路、25
は第二のシリアル/パラレル変換回路、26は位相曖昧
度除去器、27はビタビ復号器を示す。MSK変復調器
23はMSK変調器(送信側)と直交変復調伝送路とM
SK復調器(受信側)とから成る。FIG. 1 is a block diagram of an MSK modulation communication system according to an embodiment of the present invention, in which 20 is an encoder, 21 is a first parallel / serial conversion circuit, and 22 is a first serial / parallel. Conversion circuit, 23 is an MSK modulator / demodulator, 24 is a second parallel / serial conversion circuit, 25
Is a second serial / parallel conversion circuit, 26 is a phase ambiguity remover, and 27 is a Viterbi decoder. The MSK modulator / demodulator 23 includes an MSK modulator (transmission side), an orthogonal modulator / demodulator transmission line, and M
SK demodulator (reception side).
【0021】また、図2(a),(b),(c)は夫々
図1におけるシリアルデータTXD,パラレルデータT
XI,TXQを示す。2A, 2B, and 2C are serial data TXD and parallel data T in FIG. 1, respectively.
XI and TXQ are shown.
【0022】まず、図1に示す第一のパラレル/シリア
ル変換回路21と第一のシリアル/パラレル変換回路2
2との関係について説明する。なお、第一のパラレル/
シリアル変換回路21については、前述のように、その
出力が一意に決定されるので説明を省略する。First, the first parallel / serial conversion circuit 21 and the first serial / parallel conversion circuit 2 shown in FIG.
The relationship with 2 will be described. The first parallel /
Since the output of the serial conversion circuit 21 is uniquely determined as described above, the description thereof will be omitted.
【0023】TXI,TXQは、図2(b),(c)に
示すように2通りの出力を生じる。図2(b)の出力を
生じた場合は、MSK変復調器23の入力データは図4
(a)のデータと同一になるので、MSK変復調器23
の出力は図4(d)に示すような4通りのデータ系列を
出力する。一方、図2(c)のような出力を生じた場
合、このデータ系列は図4(d)(4)に一致してい
る。この事実に着目してMSK変復調器23の出力を求
めてみると、α=0のときは図4(d)(4)、α=π
/2のときは図4(d)(3)、α=πのときは図4
(d)(2)、α=−π/2のときは図4(d)(1)
になる。TXI and TXQ generate two kinds of outputs as shown in FIGS. 2 (b) and 2 (c). When the output of FIG. 2B is generated, the input data of the MSK modulator / demodulator 23 is as shown in FIG.
Since it is the same as the data in (a), the MSK modulator / demodulator 23
Is output as four types of data series as shown in FIG. 4 (d). On the other hand, when the output as shown in FIG. 2 (c) is generated, this data series matches FIG. 4 (d) (4). Focusing on this fact, the output of the MSK modulator / demodulator 23 is calculated. When α = 0, FIG. 4 (d) (4), α = π
4 (d) (3) when / 2, and FIG. 4 when α = π
4 (d) (1) when (d) (2) and α = −π / 2
become.
【0024】即ち、TXI,TXQが図2(b),
(c)のいずれのデータ系列であってもMSK復調器の
出力は、図4(d)の4通りになることがわかる。That is, TXI and TXQ are shown in FIG.
It can be seen that the output of the MSK demodulator in any of the data sequences in (c) is four types in FIG. 4 (d).
【0025】第二のパラレル/シリアル変換回路24と
第二のシリアル/パラレル変換回路25の場合も同様の
関係となり、第二のシリアル/パラレル変換回路25の
出力は図4(d)の4通りとなる。The same relationship is obtained in the case of the second parallel / serial conversion circuit 24 and the second serial / parallel conversion circuit 25, and the output of the second serial / parallel conversion circuit 25 is four kinds as shown in FIG. 4 (d). Becomes
【0026】このような構成にしてデータインターフェ
ースの数を少なくしても、QPSKのときと同様に、別
途設けられる同期回路からの制御に従い、図4(d)
(1)〜(4)のデータ系列を位相曖昧度除去器26で
図4(d)(1)のデータ系列に修正してビタビ復号器
27に入力することにより、信頼性を損ねることなくM
SK変調通信が可能となる。Even if the number of data interfaces is reduced in this structure, as in the case of QPSK, according to the control from the separately provided synchronizing circuit, FIG.
The phase ambiguity remover 26 modifies the data series of (1) to (4) into the data series of (d) (1) of FIG. 4 and inputs the modified data series to the Viterbi decoder 27.
SK modulation communication becomes possible.
【0027】なお、本実施例では、パラレル/シリアル
変換回路とシリアル/パラレル変換回路を、畳み込み符
号化器20とMSK変復調器23間、及び、MSK変復
調器23と位相曖昧度除去器26間の双方に対向挿入し
た構成について説明したが、MSK変復調器23と位相
曖昧度除去器26間にのみ対向挿入する構成にしても良
い。In this embodiment, a parallel / serial conversion circuit and a serial / parallel conversion circuit are provided between the convolutional encoder 20 and the MSK modulator / demodulator 23, and between the MSK modulator / demodulator 23 and the phase ambiguity remover 26. Although the configuration in which they are inserted oppositely to each other has been described, the configuration in which they are oppositely inserted only between the MSK modulator / demodulator 23 and the phase ambiguity remover 26 may be adopted.
【0028】[0028]
【発明の効果】以上説明してきたように、本発明のMS
K変調通信システムでは、ビタビ復号器の前段に搬送波
再生の際の位相曖昧度除去器を設け、異なる位相の複数
のデータ系列を特定の位相のデータ系列に修正し得るよ
うにしたので、畳み込み符号化器とMSK変復調器間、
及び、MSK変復調器と位相曖昧度除去器間に、パラレ
ル/シリアル変換回路とシリアル/パラレル変換回路を
対向挿入することができ、データインターフェースの数
が少なくなる効果を有する。As described above, the MS of the present invention
In the K-modulation communication system, a phase ambiguity remover at the time of carrier recovery is provided in front of the Viterbi decoder so that a plurality of data sequences of different phases can be modified into a data sequence of a specific phase. Between the converter and the MSK modulator / demodulator,
In addition, a parallel / serial conversion circuit and a serial / parallel conversion circuit can be inserted between the MSK modulator / demodulator and the phase ambiguity remover so that the number of data interfaces can be reduced.
【0029】これにより、MSK変復調器とデジタル回
路である畳み込み符号化器、ビタビ復号器とが夫々物理
的に別物の装置であっても高信頼性のMSK変調通信が
可能となる。As a result, highly reliable MSK modulation communication is possible even if the MSK modulator / demodulator and the digital circuit, the convolutional encoder and the Viterbi decoder, are physically separate devices.
【図1】本発明の一実施例に係るMSK変調通信システ
ムのブロック構成図である。FIG. 1 is a block configuration diagram of an MSK modulation communication system according to an embodiment of the present invention.
【図2】図1のa点、b点におけるデータ系列のタイム
チャートである。FIG. 2 is a time chart of a data series at points a and b in FIG.
【図3】本発明が適用されるMSK変復調器の基本構成
図である。FIG. 3 is a basic configuration diagram of an MSK modulator / demodulator to which the present invention is applied.
【図4】図3の各部におけるデータ系列のタイムチャー
トであり、(a)はA点、(b)はB点、(c)はC
点、(d)はD点に対応するものである。4 is a time chart of a data series in each part of FIG. 3, where (a) is point A, (b) is point B, and (c) is point C.
Point (d) corresponds to point D.
【図5】図3の各部における位相関係図であり、(a)
は乗算器1、2のデータと正弦波、余弦波との位相関
係、(b)は排他的論理和ゲート12、13のデータと
正弦波、余弦波との位相関係を夫々表す図である。FIG. 5 is a phase relationship diagram in each part of FIG. 3, (a)
2B is a diagram showing the phase relationship between the data of the multipliers 1 and 2 and the sine wave and the cosine wave, and FIG. 9B is a diagram showing the phase relationship between the data of the exclusive OR gates 12 and 13 and the sine wave and the cosine wave.
1、2、4、5、8、9 乗算器 3、14 フリップフロップ 6 合成器 7 分配器 10、11 A/D変換器 12、13 排他的論理和ゲート 20 畳み込み符号化器 21、24 パラレル/シリアル変換回路 22、25 シリアル/パラレル変換回路 23 MSK変復調器 26 位相曖昧度除去器 27 ビタビ復号器 1, 2, 4, 5, 8, 9 Multiplier 3, 14 Flip-flop 6 Combiner 7 Distributor 10, 11 A / D converter 12, 13 Exclusive OR gate 20 Convolutional encoder 21, 24 Parallel / Serial conversion circuit 22, 25 Serial / parallel conversion circuit 23 MSK modulator / demodulator 26 Phase ambiguity remover 27 Viterbi decoder
Claims (2)
する送信装置と、この直交変復調伝送路からMSK変調
波を受信して復号する受信装置とからなるMSK変調通
信システムであって、前記送信装置は、畳み込み符号化
器と、この畳み込み符号化器の出力データをMSK変調
波に変換するMSK変調器とを少なくとも有し、前記受
信装置は、前記MSK変調波を復調するMSK復調器
と、このMSK復調器で搬送波再生を行う際の位相曖昧
度を除去して特定位相のデータ系列に修正する位相曖昧
度除去器と、この位相曖昧度除去器の出力に基づいて最
ゆう復号を行うビタビ復号器とを少なくとも有し、且
つ、前記MSK復調器と前記位相曖昧度除去器との間に
は、データ系列の並直変換を行うパラレル/シリアル変
換回路とこの並直変換されたデータ系列の直並再変換を
行うシリアル/パラレル変換回路とが対向挿入されてい
ることを特徴とするMSK変調通信システム。1. An MSK modulation communication system comprising: a transmitter for transmitting an MSK modulated wave to an orthogonal modulation / demodulation transmission line; and a receiver for receiving and decoding the MSK modulated wave from the orthogonal modulation / demodulation transmission line, the transmission comprising: The apparatus includes at least a convolutional encoder and an MSK modulator that converts output data of the convolutional encoder into an MSK modulated wave, and the reception apparatus includes an MSK demodulator that demodulates the MSK modulated wave. A phase ambiguity remover that removes the phase ambiguity when a carrier is reproduced by this MSK demodulator and corrects a data sequence of a specific phase, and Viterbi that performs maximum likelihood decoding based on the output of this phase ambiguity remover. A parallel / serial conversion circuit having at least a decoder, and performing parallel conversion of a data sequence between the MSK demodulator and the phase ambiguity remover and the parallel conversion circuit. An MSK modulation communication system in which a serial / parallel conversion circuit that performs serial-parallel reconversion of the selected data series is inserted oppositely.
において、前記畳み込み符号化器と前記MSK変調器と
の間にも前記パラレル/シリアル変換回路と前記シリア
ル/パラレル変換回路とが対向挿入されていることを特
徴とするMSK変調通信システム。2. The MSK modulation communication system according to claim 1, wherein the parallel / serial conversion circuit and the serial / parallel conversion circuit are oppositely inserted between the convolutional encoder and the MSK modulator. An MSK modulation communication system characterized in that
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP27570291A JPH05122257A (en) | 1991-10-23 | 1991-10-23 | Msk modulation communication system |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP27570291A JPH05122257A (en) | 1991-10-23 | 1991-10-23 | Msk modulation communication system |
Publications (1)
Publication Number | Publication Date |
---|---|
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ID=17559175
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Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP27570291A Withdrawn JPH05122257A (en) | 1991-10-23 | 1991-10-23 | Msk modulation communication system |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH05122257A (en) |
-
1991
- 1991-10-23 JP JP27570291A patent/JPH05122257A/en not_active Withdrawn
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Legal Events
Date | Code | Title | Description |
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A300 | Withdrawal of application because of no request for examination |
Free format text: JAPANESE INTERMEDIATE CODE: A300 Effective date: 19990107 |