JPH0486324U - - Google Patents

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JPH0486324U
JPH0486324U JP13010190U JP13010190U JPH0486324U JP H0486324 U JPH0486324 U JP H0486324U JP 13010190 U JP13010190 U JP 13010190U JP 13010190 U JP13010190 U JP 13010190U JP H0486324 U JPH0486324 U JP H0486324U
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JP
Japan
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graphic equalizer
electronic graphic
memory number
circuit
memory
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  • Tone Control, Compression And Expansion, Limiting Amplitude (AREA)

Description

【図面の簡単な説明】
第１図は本考案に係る電子グラフイツクイコラ
イザの一実施例を概略的に示した構成図、第２図
は制御回路のＣＰＵの動作を示したフローチヤー
ト、第３図は従来の従来の電子グラフイツクイコ
ライザの一例を概略的に示した構成図である。 １０……表示器、３０……操作スイツチ回路、
３１……操作スイツチ、４０……電子グラフイツ
クイコライザ回路、５０……制御回路、５１……
ＣＰＵ（入力処理手段）、５２……ＲＯＭ（メモ
リ手段）、５３……ＲＡＭ（メモリ手段）。

Claims (1)

    【実用新案登録請求の範囲】
  1. 電子グラフイツクイコライザ回路と、該電子グ
    ラフイツクイコライザ回路の設定パターンがメモ
    リ番号毎にメモリされるメモリ手段及び入出力処
    理手段を備えた制御回路と、前記メモリ番号を切
    り換えるための操作スイツチを備えた操作スイツ
    チ回路と、電子グラフイツクイコライザ回路の設
    定状態等を表示する表示器とを備えた電子グラフ
    イツクイコライザにおいて、メモリモードのとき
    に、既に書き換え済みのパターンがメモリされて
    いるメモリ番号と、イニシヤル状態のパターンが
    メモリされているメモリ番号とが異なる表示形態
    で表示されるように構成されていることを特徴と
    する電子グラフイツクイコライザ。
JP13010190U 1990-11-30 1990-11-30 Pending JPH0486324U (ja)

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JPH0486324U true JPH0486324U (ja) 1992-07-27

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