JPH0447760U - - Google Patents

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JPH0447760U
JPH0447760U JP8993590U JP8993590U JPH0447760U JP H0447760 U JPH0447760 U JP H0447760U JP 8993590 U JP8993590 U JP 8993590U JP 8993590 U JP8993590 U JP 8993590U JP H0447760 U JPH0447760 U JP H0447760U
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memory
control
circuit
signal
dma controller
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JP8993590U
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【図面の簡単な説明】
第1図は本考案のメモリ制御回路の一実施例を
示すブロツク図、第2図はDMAコントローラを
主とする信号状態の一例を示すタイムチヤートで
ある。 1……中央処理装置、2……DMAコントロー
ラ、3……実メモリ、4……拡張メモリ、11…
…ラツチ回路、12……読取制御部、13……書
込制御部、20……切替制御回路。

Claims (1)

  1. 【実用新案登録請求の範囲】 1 汎用中央処理装置がプログラムの実行のため
    実メモリ外に、プログラムおよびデータの待避を
    行う場合のメモリ制御回路において、プラグラム
    およびデータの少くとも一方を格納する拡張メモ
    リと、実メモリおよびおよび拡張メモリ間でのデ
    ータ転送を直接制御するDMAコントローラと、
    中央処理装置およびDMAコントローラの動作タ
    イミングに合わせてDMAコントローラが出力す
    る読取信号および書込信号を、実メモリ側および
    拡張メモリの何れか一方に切替設定する切替制御
    回路と、実メモリから拡張メモリへ、および拡張
    メモリから実メモリへのデータ転送方向を何れか
    一方に指定するあらかじめ設定したプログラムに
    よつてタイミング動作を指定する転送方向制御用
    ラツチ回路とを有することを特徴とするメモリ制
    御回路。 2 請求項1記載の切替制御回路が、DMAコン
    トローラからリード信号・ライト信号をそれぞれ
    入力する二つの否定回路と、転送方向制御用ラツ
    チ回路から読取用および書込用の二つの制御信号
    をそれぞれ入力する二つの制御用否定回路と、前
    記否定回路を介して出力したリード信号およびラ
    イト信号のそれぞれ、並びに前記制御信号の読取
    用および書込用それぞれを入力し、それぞれの出
    力をリード信号およびライト信号として実メモリ
    へ出力する二つの実メモリ用否定論理積回路と、
    前記否定回路を介して出力したリード信号および
    ライト信号のそれぞれ、並びに前記制御用否定回
    路の読取用および書込用それぞれを入力し、それ
    ぞれの出力をリード信号およびライト信号として
    拡張メモリへ出力する二つの拡張メモリ用否定論
    理積回路との論理回路構成を有することを特徴と
    する請求項1記載のメモリ制御回路。
JP8993590U 1990-08-28 1990-08-28 Pending JPH0447760U (ja)

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JP8993590U JPH0447760U (ja) 1990-08-28 1990-08-28

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JP8993590U JPH0447760U (ja) 1990-08-28 1990-08-28

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JPH0447760U true JPH0447760U (ja) 1992-04-23

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