JPH04227195A - テレビ受像機 - Google Patents
テレビ受像機Info
- Publication number
- JPH04227195A JPH04227195A JP2417560A JP41756090A JPH04227195A JP H04227195 A JPH04227195 A JP H04227195A JP 2417560 A JP2417560 A JP 2417560A JP 41756090 A JP41756090 A JP 41756090A JP H04227195 A JPH04227195 A JP H04227195A
- Authority
- JP
- Japan
- Prior art keywords
- signal
- signals
- conversion circuit
- interlace
- interlaced
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
- 238000006243 chemical reaction Methods 0.000 claims abstract description 49
- 239000011159 matrix material Substances 0.000 claims description 6
- 238000010586 diagram Methods 0.000 description 15
- 230000006866 deterioration Effects 0.000 description 1
Landscapes
- Color Television Systems (AREA)
- Television Systems (AREA)
- Controls And Circuits For Display Device (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【０００１】
【産業上の利用分野】クリアビション等倍速走査変換を
必要とするテレビ受像機の文字放送を表示する際のＲ，
Ｇ，Ｂ信号のノンインタレース走査変換に関する。
必要とするテレビ受像機の文字放送を表示する際のＲ，
Ｇ，Ｂ信号のノンインタレース走査変換に関する。
【０００２】
【従来技術】図７に従来の走査変換回路を示し、図８お
よび図９に従来の走査線補間構造図を示す。入力映像信
号１１のＡ／Ｄ変換器１、輝度信号Ｙおよび色差信号Ｒ
−Ｙ，Ｂ−Ｙを出力するディジタル信号処理回路２、水
平走査周波数の倍速変換回路３からなる映像信号系の走
査変換回路とＲ，Ｇ，Ｂ信号を色差信号Ｒ−Ｙ，Ｂ−Ｙ
および輝度信号Ｙに変換する逆マトリクス回路６、Ａ／
Ｄ変換器１ａ、２度書きにより走査線補間をする倍速変
換回路３ａからなるスーパーインポーズ等の文字信号系
の走査変換回路とを文字放送時の制御信号Ｙｓ により
切り換え出力する回路構成からなる。
よび図９に従来の走査線補間構造図を示す。入力映像信
号１１のＡ／Ｄ変換器１、輝度信号Ｙおよび色差信号Ｒ
−Ｙ，Ｂ−Ｙを出力するディジタル信号処理回路２、水
平走査周波数の倍速変換回路３からなる映像信号系の走
査変換回路とＲ，Ｇ，Ｂ信号を色差信号Ｒ−Ｙ，Ｂ−Ｙ
および輝度信号Ｙに変換する逆マトリクス回路６、Ａ／
Ｄ変換器１ａ、２度書きにより走査線補間をする倍速変
換回路３ａからなるスーパーインポーズ等の文字信号系
の走査変換回路とを文字放送時の制御信号Ｙｓ により
切り換え出力する回路構成からなる。
【０００３】図８に示す奇数（ｏｄｄ ）フィールドお
よび偶数（ｅｖｅｎ）フィールドの走査線補間構造図に
おいて、入力Ｒ，Ｇ，Ｂ信号が全画面文字等のノンイン
タレース信号の場合、入力信号（ａ）図に対する走査線
補間後の倍速変換回路３ａ出力信号は２度書きにより（
ｂ）図の矢印となり、画面の見かけ上の明るさは（ｃ）
図のようにフリッカのない画像が得られる。しかし、図
９に示す入力Ｒ，Ｇ，Ｂ信号が文字スーパーインポーズ
等のインタレース信号の場合は、入力信号（ｄ）図に対
する走査線補間後の倍速変換回路３ａ出力信号は２度書
きの（ｅ）図の矢印となり、画面の見かけ上の明るさは
（ｆ）図のようにフリッカＦのある画質を損ねた画像と
なる。以上のように、ライン２度書き等のフィールド内
補間だけではアナログ処理によるテレビ受像機以下にフ
リッカを軽減することができない。
よび偶数（ｅｖｅｎ）フィールドの走査線補間構造図に
おいて、入力Ｒ，Ｇ，Ｂ信号が全画面文字等のノンイン
タレース信号の場合、入力信号（ａ）図に対する走査線
補間後の倍速変換回路３ａ出力信号は２度書きにより（
ｂ）図の矢印となり、画面の見かけ上の明るさは（ｃ）
図のようにフリッカのない画像が得られる。しかし、図
９に示す入力Ｒ，Ｇ，Ｂ信号が文字スーパーインポーズ
等のインタレース信号の場合は、入力信号（ｄ）図に対
する走査線補間後の倍速変換回路３ａ出力信号は２度書
きの（ｅ）図の矢印となり、画面の見かけ上の明るさは
（ｆ）図のようにフリッカＦのある画質を損ねた画像と
なる。以上のように、ライン２度書き等のフィールド内
補間だけではアナログ処理によるテレビ受像機以下にフ
リッカを軽減することができない。
【０００４】
【発明が解決しようとする課題】本発明は上記従来例に
鑑みてなされたもので、入力Ｒ，Ｇ，Ｂ信号が文字スー
パーインポーズ等のインタレース信号の場合においても
、全画面文字等のノンインタレース信号の場合と同様に
フリッカのない画像を得ることを目的とする。
鑑みてなされたもので、入力Ｒ，Ｇ，Ｂ信号が文字スー
パーインポーズ等のインタレース信号の場合においても
、全画面文字等のノンインタレース信号の場合と同様に
フリッカのない画像を得ることを目的とする。
【０００５】
【課題を解決するための手段】本発明は、インタレース
信号およびノンインタレース信号に関わらず、フレーム
メモリおよびセレクタ等による１フィールド間引きのフ
ィールド２度読みにより、入力Ｒ，Ｇ，Ｂ信号を常時ノ
ンインタレース信号に変換し、続く倍速変換回路で２度
書きすることで、フリッカによる画質の劣化を改善する
ことに特徴がある。
信号およびノンインタレース信号に関わらず、フレーム
メモリおよびセレクタ等による１フィールド間引きのフ
ィールド２度読みにより、入力Ｒ，Ｇ，Ｂ信号を常時ノ
ンインタレース信号に変換し、続く倍速変換回路で２度
書きすることで、フリッカによる画質の劣化を改善する
ことに特徴がある。
【０００６】
【作用】図１に示すように、Ａ／Ｄ変換器１、輝度信号
Ｙおよび色差信号Ｒ−Ｙ，Ｂ−Ｙを出力するディジタル
信号処理回路２、倍速変換回路３からなる映像信号系の
走査変換回路と、Ｒ，Ｇ，Ｂ信号を色差信号Ｒ−Ｙ，Ｂ
−Ｙおよび輝度信号Ｙに変換する逆マトリクス回路６、
Ａ／Ｄ変換器１ａ、フィールドメモリおよびセレクタ等
からなるノンインタレース変換回路８、倍速変換回路３
ａからなるスーパーインポーズ等の文字信号系の走査変
換回路と、遅延回路９、ノンインタレース変換回路８ａ
、倍速変換回路３ｂからなる文字放送時の制御用信号Ｙ
ｓ による切り換え回路との構成からなる。
Ｙおよび色差信号Ｒ−Ｙ，Ｂ−Ｙを出力するディジタル
信号処理回路２、倍速変換回路３からなる映像信号系の
走査変換回路と、Ｒ，Ｇ，Ｂ信号を色差信号Ｒ−Ｙ，Ｂ
−Ｙおよび輝度信号Ｙに変換する逆マトリクス回路６、
Ａ／Ｄ変換器１ａ、フィールドメモリおよびセレクタ等
からなるノンインタレース変換回路８、倍速変換回路３
ａからなるスーパーインポーズ等の文字信号系の走査変
換回路と、遅延回路９、ノンインタレース変換回路８ａ
、倍速変換回路３ｂからなる文字放送時の制御用信号Ｙ
ｓ による切り換え回路との構成からなる。
【０００７】入力Ｒ，Ｇ，Ｂ信号を輝度信号Ｙおよび色
差信号Ｒ−Ｙ，Ｂ−Ｙに変換し、ノンインタレース変換
回路８において入力文字信号のインタレース、ノンイン
タレースに関わらずフィールドメモリ等により１フィー
ルド間引きのフィールド２度読みによりフリッカの認め
られないノンインタレース信号に常時変換し、倍速変換
回路３ａで２度書き出力する。
差信号Ｒ−Ｙ，Ｂ−Ｙに変換し、ノンインタレース変換
回路８において入力文字信号のインタレース、ノンイン
タレースに関わらずフィールドメモリ等により１フィー
ルド間引きのフィールド２度読みによりフリッカの認め
られないノンインタレース信号に常時変換し、倍速変換
回路３ａで２度書き出力する。
【０００８】
【実施例】図１の１は映像信号１１のＡ／Ｄ変換器、２
は輝度信号Ｙおよび色差信号Ｒ−Ｙ，Ｂ−Ｙを出力する
ディジタル信号処理回路、３は水平走査周波数の倍速変
換回路、６は文字信号等のＲ，Ｇ，Ｂ信号を前記映像信
号１１の処理に合わせるため、輝度信号Ｙおよび色差信
号Ｒ−Ｙ，Ｂ−Ｙに変換する逆マトリクス回路、１ａは
同逆マトリクス回路６出力のＡ／Ｄ変換器、８は入力Ｒ
，Ｇ，Ｂ信号のインタレース、ノンインタレースに関わ
らず、図２に示すフィールドメモリ１０とセレクタ１５
とからなる前記Ａ／Ｄ変換器１ａ出力データＡの１フィ
ールド間引きのフィールド２度読み出しによるノンイン
タレース変換回路、３ａは同ノンインタレース変換回路
８出力データＤの２度書きによる水平走査周波数の倍速
変換回路、９は信号系にタイミングを合わせるための文
字信号切り換え用同期信号Ｙｓ の遅延回路、８ａは同
同期信号Ｙｓ のノンインタレース変換回路、３ｂは水
平走査周波数の倍速変換回路、４は前記倍速変換回路３
出力の映像信号データと同倍速変換回路３ｂ出力の文字
信号データとを文字信号用切り換え信号１６のタイミン
グにより、映像信号、文字スーパーインポーズ画面信号
、全画面文字信号等を選択出力するスイッチ回路、５は
輝度信号Ｙ，色差信号Ｒ−Ｙ，Ｂ−Ｙのアナログ信号１
７を出力するＤ／Ａ変換器である。
は輝度信号Ｙおよび色差信号Ｒ−Ｙ，Ｂ−Ｙを出力する
ディジタル信号処理回路、３は水平走査周波数の倍速変
換回路、６は文字信号等のＲ，Ｇ，Ｂ信号を前記映像信
号１１の処理に合わせるため、輝度信号Ｙおよび色差信
号Ｒ−Ｙ，Ｂ−Ｙに変換する逆マトリクス回路、１ａは
同逆マトリクス回路６出力のＡ／Ｄ変換器、８は入力Ｒ
，Ｇ，Ｂ信号のインタレース、ノンインタレースに関わ
らず、図２に示すフィールドメモリ１０とセレクタ１５
とからなる前記Ａ／Ｄ変換器１ａ出力データＡの１フィ
ールド間引きのフィールド２度読み出しによるノンイン
タレース変換回路、３ａは同ノンインタレース変換回路
８出力データＤの２度書きによる水平走査周波数の倍速
変換回路、９は信号系にタイミングを合わせるための文
字信号切り換え用同期信号Ｙｓ の遅延回路、８ａは同
同期信号Ｙｓ のノンインタレース変換回路、３ｂは水
平走査周波数の倍速変換回路、４は前記倍速変換回路３
出力の映像信号データと同倍速変換回路３ｂ出力の文字
信号データとを文字信号用切り換え信号１６のタイミン
グにより、映像信号、文字スーパーインポーズ画面信号
、全画面文字信号等を選択出力するスイッチ回路、５は
輝度信号Ｙ，色差信号Ｒ−Ｙ，Ｂ−Ｙのアナログ信号１
７を出力するＤ／Ａ変換器である。
【０００９】図４に図２のノンインタレース変換回路８
の詳細回路図を示し、図３に同ノンインタレース変換回
路８のタイミング図を示す。Ａ／Ｄ変換器１ａ出力デー
タＡをフィールドパルスＣのＬレベル（ＷＥ）期間（Ｖ
）で奇数（ｏｄｄ ）フィールドデータのみをフィール
ドメモリ１０に書き込む。また、フィールドメモリ１０
から垂直同期パルスＢのタイミングで奇数フィールドデ
ータを２度読みし、奇数フィールドのみを読み出すこと
でノンインタレース化した出力信号Ｄとする。セレクタ
回路１５はフィールドパルスＣをセレクト信号としフィ
ールドパルスＣのＬレベル（ＷＥ）で現フィールドデー
タ（Ａ０，Ｂ０，─）を選択して出力（Ａ，Ｂ，Ｃ─）
し、また、フィールドパルスＣのＨレベルでフィールド
メモリ１０のデータ（Ａ１，Ｂ１，─）を選択して出力
（Ａ，Ｂ，Ｃ─）する。即ち、奇数フィールド入力時は
フィールドメモリ１０に書き込むと同時に、奇数フィー
ルドデータを倍速変換回路３ａに出力し、また、偶数（
ｅｖｅｎ）フィールド入力時はフィールドメモリ１０に
書き込まずにセレクタ１５によりフィールドメモリ１０
から奇数フィールドデータを読み出す。従って、偶数フ
ィールドデータは間引かれて奇数フィールドデータの２
度読みによりノンインタレース変換する。
の詳細回路図を示し、図３に同ノンインタレース変換回
路８のタイミング図を示す。Ａ／Ｄ変換器１ａ出力デー
タＡをフィールドパルスＣのＬレベル（ＷＥ）期間（Ｖ
）で奇数（ｏｄｄ ）フィールドデータのみをフィール
ドメモリ１０に書き込む。また、フィールドメモリ１０
から垂直同期パルスＢのタイミングで奇数フィールドデ
ータを２度読みし、奇数フィールドのみを読み出すこと
でノンインタレース化した出力信号Ｄとする。セレクタ
回路１５はフィールドパルスＣをセレクト信号としフィ
ールドパルスＣのＬレベル（ＷＥ）で現フィールドデー
タ（Ａ０，Ｂ０，─）を選択して出力（Ａ，Ｂ，Ｃ─）
し、また、フィールドパルスＣのＨレベルでフィールド
メモリ１０のデータ（Ａ１，Ｂ１，─）を選択して出力
（Ａ，Ｂ，Ｃ─）する。即ち、奇数フィールド入力時は
フィールドメモリ１０に書き込むと同時に、奇数フィー
ルドデータを倍速変換回路３ａに出力し、また、偶数（
ｅｖｅｎ）フィールド入力時はフィールドメモリ１０に
書き込まずにセレクタ１５によりフィールドメモリ１０
から奇数フィールドデータを読み出す。従って、偶数フ
ィールドデータは間引かれて奇数フィールドデータの２
度読みによりノンインタレース変換する。
【００１０】図５に示す走査線補間構造図において、入
力Ｒ，Ｇ，Ｂ信号が全画面文字等のノンインタレース信
号の場合、入力信号（ａ）図に対する走査線補間後の倍
速変換回路３ａ出力信号は２度書きにより（ｂ）図の矢
印となり、画面の見かけ上の明るさは（ｃ）図のように
フリッカのない画像となり、同様に、図６の走査線補間
構造図に示す入力Ｒ，Ｇ，Ｂ信号が文字スーパーインポ
ーズ等のインタレース信号の場合も、入力信号（ｄ）図
に対する走査線補間後の倍速変換回路３ａ出力信号は２
度書きの（ｅ）図の矢印となり、画面の見かけ上の明る
さは（ｆ）図のようにフリッカのない画像となる。
力Ｒ，Ｇ，Ｂ信号が全画面文字等のノンインタレース信
号の場合、入力信号（ａ）図に対する走査線補間後の倍
速変換回路３ａ出力信号は２度書きにより（ｂ）図の矢
印となり、画面の見かけ上の明るさは（ｃ）図のように
フリッカのない画像となり、同様に、図６の走査線補間
構造図に示す入力Ｒ，Ｇ，Ｂ信号が文字スーパーインポ
ーズ等のインタレース信号の場合も、入力信号（ｄ）図
に対する走査線補間後の倍速変換回路３ａ出力信号は２
度書きの（ｅ）図の矢印となり、画面の見かけ上の明る
さは（ｆ）図のようにフリッカのない画像となる。
【００１１】
【発明の効果】以上のように本発明は、インタレース信
号およびノンインタレース信号に関わらず、１フィール
ド間引きのフィールド２度読みにより、入力Ｒ，Ｇ，Ｂ
信号を常時ノンインタレース信号に変換し、続く倍速変
換回路で２度書きすることで、入力Ｒ，Ｇ，Ｂ信号が文
字スーパーインポーズ等のインタレース信号の場合にお
いても、全画面文字等のノンインタレース信号の場合と
同様にフリッカのない画像を得ることができる。
号およびノンインタレース信号に関わらず、１フィール
ド間引きのフィールド２度読みにより、入力Ｒ，Ｇ，Ｂ
信号を常時ノンインタレース信号に変換し、続く倍速変
換回路で２度書きすることで、入力Ｒ，Ｇ，Ｂ信号が文
字スーパーインポーズ等のインタレース信号の場合にお
いても、全画面文字等のノンインタレース信号の場合と
同様にフリッカのない画像を得ることができる。
【図１】走査変換回路のブロック図を示す。
【図２】図１の走査変換回路ブロック図におけるノンイ
ンタレース変換回路のブロック図を示す。
ンタレース変換回路のブロック図を示す。
【図３】図２のノンインタレース変換回路のタイミング
図である。
図である。
【図４】図２のノンインタレース変換回路の詳細回路図
である。
である。
【図５】ノンインタレース信号に対する走査線補間構造
図である。
図である。
【図６】インタレース信号に対する走査線補間構造図で
ある。
ある。
【図７】従来の走査変換回路のブロック図を示す。
【図８】図７のノンインタレース信号に対する走査線補
間構造図である。
間構造図である。
【図９】図７のインタレース信号に対する走査線補間構
造図である。
造図である。
２ ディジタル信号処理回路
３ 倍速変換回路
３ａ 倍速変換回路
３ｂ 倍速変換回路
６ 逆マトリクス回路
８ ノンインタレース変換回路
８ａ ノンインタレース変換回路
９ タイミング合わせの遅延回路
１０ フィールドメモリ
１５ セレクタ
Claims (1)
- 【請求項１】 クリアビション等倍速走査変換を必要
とするテレビ受像機の文字放送を表示する際のＲ，Ｇ，
Ｂ信号の走査変換回路において、Ｒ，Ｇ，Ｂ信号を色差
信号Ｒ−Ｙ，Ｂ−Ｙおよび輝度信号Ｙに変換する逆マト
リクス回路と、フィールドメモリとセレクタとからなる
ノンインタレース変換回路と、ラインメモリからなる水
平走査周波数の倍速変換回路とを具備してなるノンイン
タレース型走査変換を特徴とするテレビ受像機。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2417560A JPH04227195A (ja) | 1990-12-28 | 1990-12-28 | テレビ受像機 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2417560A JPH04227195A (ja) | 1990-12-28 | 1990-12-28 | テレビ受像機 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH04227195A true JPH04227195A (ja) | 1992-08-17 |
Family
ID=18525649
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2417560A Pending JPH04227195A (ja) | 1990-12-28 | 1990-12-28 | テレビ受像機 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH04227195A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR100241443B1 (ko) * | 1997-02-25 | 2000-02-01 | 구자홍 | 격행주사 모드-순차주사 모드 변환회로 |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0214689A (ja) * | 1988-07-01 | 1990-01-18 | Hitachi Ltd | 信号処理回路 |
-
1990
- 1990-12-28 JP JP2417560A patent/JPH04227195A/ja active Pending
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0214689A (ja) * | 1988-07-01 | 1990-01-18 | Hitachi Ltd | 信号処理回路 |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR100241443B1 (ko) * | 1997-02-25 | 2000-02-01 | 구자홍 | 격행주사 모드-순차주사 모드 변환회로 |
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