JPH04207470A - 画像処理装置 - Google Patents
画像処理装置Info
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- JPH04207470A JPH04207470A JP2330885A JP33088590A JPH04207470A JP H04207470 A JPH04207470 A JP H04207470A JP 2330885 A JP2330885 A JP 2330885A JP 33088590 A JP33088590 A JP 33088590A JP H04207470 A JPH04207470 A JP H04207470A
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- 238000009792 diffusion process Methods 0.000 claims description 2
- 239000011159 matrix material Substances 0.000 claims 1
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- 238000000034 method Methods 0.000 description 6
- 230000003111 delayed effect Effects 0.000 description 3
- 230000000694 effects Effects 0.000 description 2
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
［産業上の利用分野］
本発明は画像処理装置に関し、例えば多値の画像データ
を２ｎ値データに量子化する画像処理装置に関する。
を２ｎ値データに量子化する画像処理装置に関する。
従来、この種の装置においては、濃淡画像を２値表示す
る方式に網点法やデイザ法、そして誤差拡散法等が使用
されている。最近、３値以上の階調が出せる出力装置の
ために、これら２値化手法が３値以上に対応できるよう
拡張されている。
る方式に網点法やデイザ法、そして誤差拡散法等が使用
されている。最近、３値以上の階調が出せる出力装置の
ために、これら２値化手法が３値以上に対応できるよう
拡張されている。
［発明が解決しようとしている課題］
しかしながら、上記従来例では、これらの方法で量子化
を行った場合、画像のゆるやかな階調変化の部分に疑似
輪郭が発生する。また、処理が複雑になり、ハード規模
が増大するという欠点があった。
を行った場合、画像のゆるやかな階調変化の部分に疑似
輪郭が発生する。また、処理が複雑になり、ハード規模
が増大するという欠点があった。
本発明は、上述した従来例の欠点に鑑みてなされたもの
であり その目的とするところは、画像の疑似輪郭の発
生を押え、安価なハードウェアで構成できる画像処理装
置を提供する点にある。
であり その目的とするところは、画像の疑似輪郭の発
生を押え、安価なハードウェアで構成できる画像処理装
置を提供する点にある。
［課題を解決するための手段〕
上述した課題を解決し、目的を達成するため、本発明に
係る画像処理装置は、画素単位に画像データを入力する
入力手段と、前記入力手段で入力した画像データをｎ個
（ｎ≧２）の画像データに分割する分割手段と、前記分
割手段で分割した各データを２値化する２値化手段と、
前記２値化手段で２値化したｎ個の画像データから２１
値のデータを算出する算出手段とを備えることを特徴と
する。
係る画像処理装置は、画素単位に画像データを入力する
入力手段と、前記入力手段で入力した画像データをｎ個
（ｎ≧２）の画像データに分割する分割手段と、前記分
割手段で分割した各データを２値化する２値化手段と、
前記２値化手段で２値化したｎ個の画像データから２１
値のデータを算出する算出手段とを備えることを特徴と
する。
［作用コ
かかる構成によれば、入力手段は画素単位に画像データ
を入力し、分割手段は入力手段で入力した画像データを
ｎ個（ｎ≧２）の画像データに分割し、２値化手段は分
割手段で分割した各データを２値化し、算出手段は２値
化手段で２値化したｎ個の画像データから２′′値のデ
ータを算出する。
を入力し、分割手段は入力手段で入力した画像データを
ｎ個（ｎ≧２）の画像データに分割し、２値化手段は分
割手段で分割した各データを２値化し、算出手段は２値
化手段で２値化したｎ個の画像データから２′′値のデ
ータを算出する。
［実施例］
以下に添付図面を参照して、本発明の好適な実施例を詳
細に説明する。
細に説明する。
く第１実施例〉
第１図は本発明に係る画像処理装置の第１実施例を示す
ブロック図である。同図において、１０１は入力センサ
部、１０２はアナログ／デジタル（Ａ／Ｄ）変換部、１
０３は補正回路、１０４は変換テーブル、１０５ａ、１
０５ｂ、１０５ｃ。
ブロック図である。同図において、１０１は入力センサ
部、１０２はアナログ／デジタル（Ａ／Ｄ）変換部、１
０３は補正回路、１０４は変換テーブル、１０５ａ、１
０５ｂ、１０５ｃ。
１０５ｄは２値化回路、１０６は演算回路、１０７はプ
リンタを示している。
リンタを示している。
ここで、第５図は第１実施例の変換テーブル１０４によ
る入出力特性を説明する図である。
る入出力特性を説明する図である。
動作として、入力センサ部１０１はＣＣＤ等の光電変換
素子及びこれを走査する駆動装置より構成され、原稿の
読み取り走査を行う。入力センサ部１０１で読み取られ
た原稿の画像データは、逐次Ａ／Ｄ変換器１０２に送ら
れる。ここで、各画素のデータを８ビツト（Ｏ〜２５５
）のデジタルデータ５ａ（ｉ、ｊ）に量子化する。次に
補正回路１０３において、ＣＣＤセンサの感度ムラや照
明光源による照度ムラを補正するためのシェーディング
補正等をデジタル演算処理で行う。この補正処理済のデ
ータは、変換テーブル１０４に入力される。変換テーブ
ル１０４は、５ｏ（ｉ、＋）の値に応じて、４つの８ビ
ツトデジタルデータＳ＋（ｉ、ｊｌ。
素子及びこれを走査する駆動装置より構成され、原稿の
読み取り走査を行う。入力センサ部１０１で読み取られ
た原稿の画像データは、逐次Ａ／Ｄ変換器１０２に送ら
れる。ここで、各画素のデータを８ビツト（Ｏ〜２５５
）のデジタルデータ５ａ（ｉ、ｊ）に量子化する。次に
補正回路１０３において、ＣＣＤセンサの感度ムラや照
明光源による照度ムラを補正するためのシェーディング
補正等をデジタル演算処理で行う。この補正処理済のデ
ータは、変換テーブル１０４に入力される。変換テーブ
ル１０４は、５ｏ（ｉ、＋）の値に応じて、４つの８ビ
ツトデジタルデータＳ＋（ｉ、ｊｌ。
Ｓ ２ｆｉ、ｊ）、 Ｓ ｓ（ｉ、ｊ）、 Ｓ ４（ｉ
、ｊ）に分割して出力する。
、ｊ）に分割して出力する。
この変換テーブルは１０４、第５図に示すようなテーブ
ルに従って値を出力する。入力データと出力データの間
には、次式（］）の関係が成り立つ。即ち、 Ｓｏ（１，ｊ）＝□・Ｓ ＋（ｉ、ｊＤ□・５ｚ（ｉ、
ｊ１＋□・５ｓ（ｉ、、＋）”□・５４（ｉ、ｊ）・・
・（１） となり、この関係を保つように変換テーブルが作成され
ている。
ルに従って値を出力する。入力データと出力データの間
には、次式（］）の関係が成り立つ。即ち、 Ｓｏ（１，ｊ）＝□・Ｓ ＋（ｉ、ｊＤ□・５ｚ（ｉ、
ｊ１＋□・５ｓ（ｉ、、＋）”□・５４（ｉ、ｊ）・・
・（１） となり、この関係を保つように変換テーブルが作成され
ている。
変換テーブル１０４から出力された信号Ｓ＋（ｉ。
ｊ）＋ Ｓ ｔＤ、ｊ）＋ Ｓ ａ（ｉ、ｊ）、 Ｓ
＜（ｉ、ｊ）はそれぞれ２値化回路１０５ａ、１０５ｂ
、１０５ｃ、１０５ｄに入力される。
＜（ｉ、ｊ）はそれぞれ２値化回路１０５ａ、１０５ｂ
、１０５ｃ、１０５ｄに入力される。
２値化回路１０５ａはＳ＋（ｔ９．＋）を２値化した１
ビット信号Ｂｌ（１，Ｊ）を出力する。同様に、２値化
回路の１０５ｂはＢ ２（ｉ、ｊ＞、 １０５ ｃば
Ｂｓ（ｘ、＋）、 １０５ ｄｉｉＢｉ（ｉ、ｊ）を
出力する。１０５ａ〜１０５ｄまでの２値化回路の詳細
については後述する。
ビット信号Ｂｌ（１，Ｊ）を出力する。同様に、２値化
回路の１０５ｂはＢ ２（ｉ、ｊ＞、 １０５ ｃば
Ｂｓ（ｘ、＋）、 １０５ ｄｉｉＢｉ（ｉ、ｊ）を
出力する。１０５ａ〜１０５ｄまでの２値化回路の詳細
については後述する。
そして、１ビツトの信号Ｂ ＋（ｉ＋ｊ）＋ Ｂ ２（
１，Ｊ）。
１，Ｊ）。
Ｂ ３（ｉ、ｊＬ Ｂ ４（ｉ、ｊ）は、演算回路１０
６に入力される。演算回路１０６はＢｌ（Ｌ、Ｊ）の値
を下位１ビツト目に、Ｂ２（１，Ｊ）の値を下位２ビツ
ト目に、ＢＳ （ｉ、 ｊ）の値を３ビツト目に、Ｂ４
（ｉ、ｊ）の値を４ビツト目にそれぞれ代入した４ビツ
トデータＢｏ（ｉ。
６に入力される。演算回路１０６はＢｌ（Ｌ、Ｊ）の値
を下位１ビツト目に、Ｂ２（１，Ｊ）の値を下位２ビツ
ト目に、ＢＳ （ｉ、 ｊ）の値を３ビツト目に、Ｂ４
（ｉ、ｊ）の値を４ビツト目にそれぞれ代入した４ビツ
トデータＢｏ（ｉ。
ｊ）を出力する。プリンタ１０７は１画素で０〜１５ま
での１６階調の濃度表現が可能で、演算回路１０６から
送られて（る４ビツトデータに基づき画像を記録上に再
現する。
での１６階調の濃度表現が可能で、演算回路１０６から
送られて（る４ビツトデータに基づき画像を記録上に再
現する。
第２図は第１図の２値化回路の代表である２値化回路１
０５ａの構成を示すブロック図である。
０５ａの構成を示すブロック図である。
なお、２値化回路１０５ｂ〜１０５ｄも以下に説明する
２値化回路１０５ａと同じ構成である。
２値化回路１０５ａと同じ構成である。
第２図において、２０１，２０２は２値化処理された２
値画像データを１ライン分記憶する遅延ＲＡＭ、２０３
〜２１２，２１６は画像データを１画素遅延させるため
のＤＦ／Ｆ（フリップフロップ）、２１３は注目画素周
辺の２値画像データから所定領域に重み付け演算を行う
ＣＰＵ、２１３ａはＣＰＵ２１３を動作させるプログラ
ムを格納したＲＯＭ、２１３ｂはＲＯＭ２１３ａのプロ
グラムのワークエリアとして用いるＲＡＭ、２１４は２
１３から出力される重み付け平均値と注目画素の多値デ
ータとの差を演算する減算器、２１５は２１３から出力
される重み付け平均値と注目画素多値データを比較・２
値化する比較器、２１７は変換テーブル１０４かも送ら
れてきた多値画像データと誤差ＲＯＭ２１８と誤差メモ
リ２１９から出力された誤差データを加算する加算器、
２１８は減算器２１４から送られてくる注目画素の多値
データと閾値の差に基づき誤差データを演算する誤差Ｒ
ＯＭ、２１９は誤差データを１ライン分記憶する誤差メ
モリである。
値画像データを１ライン分記憶する遅延ＲＡＭ、２０３
〜２１２，２１６は画像データを１画素遅延させるため
のＤＦ／Ｆ（フリップフロップ）、２１３は注目画素周
辺の２値画像データから所定領域に重み付け演算を行う
ＣＰＵ、２１３ａはＣＰＵ２１３を動作させるプログラ
ムを格納したＲＯＭ、２１３ｂはＲＯＭ２１３ａのプロ
グラムのワークエリアとして用いるＲＡＭ、２１４は２
１３から出力される重み付け平均値と注目画素の多値デ
ータとの差を演算する減算器、２１５は２１３から出力
される重み付け平均値と注目画素多値データを比較・２
値化する比較器、２１７は変換テーブル１０４かも送ら
れてきた多値画像データと誤差ＲＯＭ２１８と誤差メモ
リ２１９から出力された誤差データを加算する加算器、
２１８は減算器２１４から送られてくる注目画素の多値
データと閾値の差に基づき誤差データを演算する誤差Ｒ
ＯＭ、２１９は誤差データを１ライン分記憶する誤差メ
モリである。
上記構成において、比較器２１は次式（２）に基づいて
２値化したデータＢｉ（ｉ、、＋）を出力する。
２値化したデータＢｉ（ｉ、、＋）を出力する。
すなわち、
となり、この２値データはライン毎に遅延させるための
ＲＡＭ２０２，２０１に入力゛され、ＲＡＭ２０２によ
り１ライン遅延させた２値データＢ。
ＲＡＭ２０２，２０１に入力゛され、ＲＡＭ２０２によ
り１ライン遅延させた２値データＢ。
（１−１１Ｊ”２）が、ＲＡＭ２０１により２ライン分
遅延させた２値データＢ ＋ （ｉ−２，ｊ＋２）が出
力される。
遅延させた２値データＢ ＋ （ｉ−２，ｊ＋２）が出
力される。
さらに、ＤＦ／Ｆ２Ｏ３はＢ＋（ｉ−２，ｊ＋１）、
ＤＦ／Ｆ２０４はＢ １（ｉ−２ｊ）、 ＤＦ／Ｆ ２
０５はＢ ＋ （ｉ−２，ｊ−１）、 ＤＦ／Ｆ ２０
６はＢ 、（ｉ−２，ｊ−２）、 ＤＦ／Ｆ ２０７は
Ｂ ＋（ｉ−１，ｊ”ｌ）、 ＤＦ／Ｆ ２０８ばＢ
＋ （ｉ−１，ｊ）、ＤＦ／Ｆ ２０９はＢ ＋（ｉ−
１，ｊ−１）、 ＤＦ／Ｆ ２１０はＢｌ（ｉ−１，ｊ
−２）、ＤＦ／Ｆ２１１はＢ 、（ｉ、ｊ−１）、 Ｄ
Ｆ／Ｆ ２１２はＢｌ（１，Ｊ−２＋を出力する。
ＤＦ／Ｆ２０４はＢ １（ｉ−２ｊ）、 ＤＦ／Ｆ ２
０５はＢ ＋ （ｉ−２，ｊ−１）、 ＤＦ／Ｆ ２０
６はＢ 、（ｉ−２，ｊ−２）、 ＤＦ／Ｆ ２０７は
Ｂ ＋（ｉ−１，ｊ”ｌ）、 ＤＦ／Ｆ ２０８ばＢ
＋ （ｉ−１，ｊ）、ＤＦ／Ｆ ２０９はＢ ＋（ｉ−
１，ｊ−１）、 ＤＦ／Ｆ ２１０はＢｌ（ｉ−１，ｊ
−２）、ＤＦ／Ｆ２１１はＢ 、（ｉ、ｊ−１）、 Ｄ
Ｆ／Ｆ ２１２はＢｌ（１，Ｊ−２＋を出力する。
これらの２値画像データは、演算装置２１３に人力され
、次式（３）に従って重み付き平均値を求める。すなわ
ち、 ・・・（３） となり、Ｒ（ｘ、ｙ）は注目画素近傍における２値画像
の重み付き平均値ｍ（ｉ、ｌを求める重みマスクである
。
、次式（３）に従って重み付き平均値を求める。すなわ
ち、 ・・・（３） となり、Ｒ（ｘ、ｙ）は注目画素近傍における２値画像
の重み付き平均値ｍ（ｉ、ｌを求める重みマスクである
。
この平均値ｍ （ｉ、ｌを閾値として出力する。閾値ｍ
（ｉ、ｊ）とＤＦ／Ｆ２１６より出力された５ｌ（１
１ｊ） ＋ Ｅ （ｉ、 ｊ）は減算器２１４及び比較
器２１５に入力される。減算器２１４は２つの入力の差
、Ｓ＋（ｉ、ｊ）＋ Ｅ （ｉ、ｊ） −ｍ ｆｉ、ｊ
）を演算する。また比較器２１５は２つの入力Ｓ ＋
（ｉ、 Ｊ） ＋ Ｅ ｂ、 ｊ）とｍ（ｉ、ｊｌを比
較して２値データＢ＋（ｉ、ｊ）を出力する。
（ｉ、ｊ）とＤＦ／Ｆ２１６より出力された５ｌ（１
１ｊ） ＋ Ｅ （ｉ、 ｊ）は減算器２１４及び比較
器２１５に入力される。減算器２１４は２つの入力の差
、Ｓ＋（ｉ、ｊ）＋ Ｅ （ｉ、ｊ） −ｍ ｆｉ、ｊ
）を演算する。また比較器２１５は２つの入力Ｓ ＋
（ｉ、 Ｊ） ＋ Ｅ ｂ、 ｊ）とｍ（ｉ、ｊｌを比
較して２値データＢ＋（ｉ、ｊ）を出力する。
減算器２１４から出力される注目画素の多値データＳ
＋ （ｉ、ｊ） ＋ Ｅ （ｉ、ｊ）と閾値ｍ（ｉ、ｊ
）との差は誤差ＲＯＭ２１８に入力される。誤ｆｉＲＯ
Ｍ２１８は次式（４）に従ってＥ ２ （ｉ、、 ＋ｊ
＋１）を出力する。すなわち、 Ｅ ｚ（ｉ、ｊ＋ｌｌ＝ （Ｓ ＋（ｉ、ｊ）＋ Ｅ
（ｉ、ｊ）−ｍ （ｉ、ｊ） ） ／ ２ ・・・（４） となる。このＥａ（ｉ、ｊ＋ｌｌは加算器２１７に入力
すると共に、誤差メモリ′２１９に入力する。誤差メモ
リ２１９は１ライン分の誤差を記憶しておき、Ｅｘ（ｉ
９ｊ”ｌ）の値を改めてＥ＋（ｉ＋１．１）として出力
される。
＋ （ｉ、ｊ） ＋ Ｅ （ｉ、ｊ）と閾値ｍ（ｉ、ｊ
）との差は誤差ＲＯＭ２１８に入力される。誤ｆｉＲＯ
Ｍ２１８は次式（４）に従ってＥ ２ （ｉ、、 ＋ｊ
＋１）を出力する。すなわち、 Ｅ ｚ（ｉ、ｊ＋ｌｌ＝ （Ｓ ＋（ｉ、ｊ）＋ Ｅ
（ｉ、ｊ）−ｍ （ｉ、ｊ） ） ／ ２ ・・・（４） となる。このＥａ（ｉ、ｊ＋ｌｌは加算器２１７に入力
すると共に、誤差メモリ′２１９に入力する。誤差メモ
リ２１９は１ライン分の誤差を記憶しておき、Ｅｘ（ｉ
９ｊ”ｌ）の値を改めてＥ＋（ｉ＋１．１）として出力
される。
この２つの誤差の和、Ｅ （ｉ、 ｊ＋１） ＝ Ｅ
＋ （ｉ、 ｊ＋ｌ）十Ｅ ｚ（ｉ、ｊ＋１）は、次に
２値される誤差Ｓ ｌ（ｉ、ｊ＋ｉ）に加算器２１９に
よって加えられ、ＤＦ／Ｆ２１６は加算値Ｓ ＋（ｉ、
ｊ＋１）＋ Ｅ （ｉ、ｊ＋１）をデータ１クロツク期
間遅延する。
＋ （ｉ、 ｊ＋ｌ）十Ｅ ｚ（ｉ、ｊ＋１）は、次に
２値される誤差Ｓ ｌ（ｉ、ｊ＋ｉ）に加算器２１９に
よって加えられ、ＤＦ／Ｆ２１６は加算値Ｓ ＋（ｉ、
ｊ＋１）＋ Ｅ （ｉ、ｊ＋１）をデータ１クロツク期
間遅延する。
第１実施例は、以上説明した低コストで階調表現力のあ
る２値化処理を各ビットごとに使用することにより、階
調性及び解像度、共に優れた画像を簡単で安価なハード
ウェア構成で得ることが出来、疑似輪郭の発生しない高
品位な画像出力が得られる。
る２値化処理を各ビットごとに使用することにより、階
調性及び解像度、共に優れた画像を簡単で安価なハード
ウェア構成で得ることが出来、疑似輪郭の発生しない高
品位な画像出力が得られる。
さて、上記第１実施例では、注目画素周辺の２値画像デ
ータから所定領域に重み付け演算を行うために、ＣＰＵ
２１３．ＲＯＭ２１３ａ、ＲＡＭ２１３ｂを用いたが、
本発明はこれに限るものではなく、上記演算を実現する
ハードウェアを用いても良い。
ータから所定領域に重み付け演算を行うために、ＣＰＵ
２１３．ＲＯＭ２１３ａ、ＲＡＭ２１３ｂを用いたが、
本発明はこれに限るものではなく、上記演算を実現する
ハードウェアを用いても良い。
〈第２の実施例〉
第３図は本発明に係る画像処理装置の第２の実施例を示
すブロック図であり、第４図は第３図の２値化回路の代
表である２値化回路３０５ａの構成を示すブロック図で
ある。なお、２値化回路３０５ｂ〜３０５ｄも２値化回
路３０５ａと同じ構成である。
すブロック図であり、第４図は第３図の２値化回路の代
表である２値化回路３０５ａの構成を示すブロック図で
ある。なお、２値化回路３０５ｂ〜３０５ｄも２値化回
路３０５ａと同じ構成である。
本実施例では、第１実施例の誤差ＲＯＭ２１８（第２図
）を４つの２値化回路３０５ａ〜３０５ｄで共通使用す
る誤差ＲＯＭ３０６に起き換えている。なお、他の構成
は同様のため機能の説明を省略する。参照番号について
、第３図中、３０１は入力センサ部、３０２はＡ／Ｄ変
換部、３０３は補正回路、３０４は変換テーブル、３０
５ａ。
）を４つの２値化回路３０５ａ〜３０５ｄで共通使用す
る誤差ＲＯＭ３０６に起き換えている。なお、他の構成
は同様のため機能の説明を省略する。参照番号について
、第３図中、３０１は入力センサ部、３０２はＡ／Ｄ変
換部、３０３は補正回路、３０４は変換テーブル、３０
５ａ。
３０５ｂ、３０５ｃ、３０５ｄは２値化回路、３０７は
演算回路、３０８はプリンタを示している。第４図中、
４０１，４０２は遅延ＲＡＭ、４０３〜４１２，４１６
はＤＦ／Ｆ、４１３はＣＰＵ、４１３ａはＲＯＭ、４１
３ｂはＲＡＭ、４１４は減算器、４１５は比較器、４１
７は加算器をそれぞれ示している。
演算回路、３０８はプリンタを示している。第４図中、
４０１，４０２は遅延ＲＡＭ、４０３〜４１２，４１６
はＤＦ／Ｆ、４１３はＣＰＵ、４１３ａはＲＯＭ、４１
３ｂはＲＡＭ、４１４は減算器、４１５は比較器、４１
７は加算器をそれぞれ示している。
以上の構成において、誤差ＲＯＭ３０６は４つの２値化
回路３０５ａ〜３０５ｄで発生した誤差の和を一定比率
で各２Ｍ化回路３０５ａ〜３０５ｄに再配分する。この
ようにして、各２値化回路３０５ａ〜３０５ｄでＯＮに
なった部分が集中して干渉を起こすようなざらつきの発
生を防ぐことができる。勿論、第１実施例と同様の効果
を得ることができる。
回路３０５ａ〜３０５ｄで発生した誤差の和を一定比率
で各２Ｍ化回路３０５ａ〜３０５ｄに再配分する。この
ようにして、各２値化回路３０５ａ〜３０５ｄでＯＮに
なった部分が集中して干渉を起こすようなざらつきの発
生を防ぐことができる。勿論、第１実施例と同様の効果
を得ることができる。
さて、上記第２実施例でも、注目画素周辺の２値画像デ
ータから所定領域に重み付け演算を行うために、ＣＰＵ
４１３．ＲＯＭ４１３ａ、ＲＡＭ４１３ｂを用いたが、
本発明はこれに限るものではな（、上記演算を実現する
ハードウェアを用いても良い。
ータから所定領域に重み付け演算を行うために、ＣＰＵ
４１３．ＲＯＭ４１３ａ、ＲＡＭ４１３ｂを用いたが、
本発明はこれに限るものではな（、上記演算を実現する
ハードウェアを用いても良い。
［発明の効果］
以上説明したように、本発明によれば、階調性及び解像
度、共に優れた画像を簡単で安価なハードウェア構成で
得ることが出来、疑似輪郭の発生しない高品位な画像出
力が得られる。
度、共に優れた画像を簡単で安価なハードウェア構成で
得ることが出来、疑似輪郭の発生しない高品位な画像出
力が得られる。
第１図は本発明に係る画像処理装置の第１実施例を示す
ブロック図、 第２図は第１図の２値化回路の代表である２値化回路１
０５ａの構成を示すブロック図、第３図は本発明に係る
画像処理装置の第２の実施例を示すブロック図、 第４図は第３図の２値化回路の代表である２値化回路３
０５ａの構成を示すブロック図、第５図は第１実施例の
変換テーブル１０４による入出力特性を説明する図であ
る。 図中、１０１，３０１・・・入力センサ部、１０２．３
０２・・・Ａ／Ｄ変換部、１０３，３０３・・・補正回
路、１０４，３０４・＝変換テーブル、１０５ａ、
１０５ｂ、 １０５ｃ、 １０５ｄ、 ３０５ａ
、 ３０５ ｂ 、 ３０５ ｃ 、 ３０５ ｄ
−・−２値化回路、１０６．３０７・・・演算回路、１
０７，３０８・・・プリンタ、２０１，２０２，４０１
，４０２・・・遅延ＲＡＭ、 ２０３〜２１２． ２１
６，４０３〜４１２゜４１６・・・ＤＦ／Ｆ、 ２１
３． ４１３・・・ＣＰＵ、 ２１３ ａ、 ４ １
３ ａ−−−ＲＯＭ、 ２１３ｂ、４１３ｂ−・・Ｒ
ＡＭ、２１４，４１４・・・減算器、２１５，４１５・
・・比較器、２１７，４１７・・・加算器、２１８゜３
０６・・・誤差ＲＯＭ、２１９，４１８・・・誤差メモ
リである。
ブロック図、 第２図は第１図の２値化回路の代表である２値化回路１
０５ａの構成を示すブロック図、第３図は本発明に係る
画像処理装置の第２の実施例を示すブロック図、 第４図は第３図の２値化回路の代表である２値化回路３
０５ａの構成を示すブロック図、第５図は第１実施例の
変換テーブル１０４による入出力特性を説明する図であ
る。 図中、１０１，３０１・・・入力センサ部、１０２．３
０２・・・Ａ／Ｄ変換部、１０３，３０３・・・補正回
路、１０４，３０４・＝変換テーブル、１０５ａ、
１０５ｂ、 １０５ｃ、 １０５ｄ、 ３０５ａ
、 ３０５ ｂ 、 ３０５ ｃ 、 ３０５ ｄ
−・−２値化回路、１０６．３０７・・・演算回路、１
０７，３０８・・・プリンタ、２０１，２０２，４０１
，４０２・・・遅延ＲＡＭ、 ２０３〜２１２． ２１
６，４０３〜４１２゜４１６・・・ＤＦ／Ｆ、 ２１
３． ４１３・・・ＣＰＵ、 ２１３ ａ、 ４ １
３ ａ−−−ＲＯＭ、 ２１３ｂ、４１３ｂ−・・Ｒ
ＡＭ、２１４，４１４・・・減算器、２１５，４１５・
・・比較器、２１７，４１７・・・加算器、２１８゜３
０６・・・誤差ＲＯＭ、２１９，４１８・・・誤差メモ
リである。
Claims (7)
- （１）画素単位に画像データを入力する入力手段と、 前記入力手段で入力した画像データをｎ個（ｎ≧２）の
画像データに分割する分割手段と、前記分割手段で分割
した各データを２値化する２値化手段と、 前記２値化手段で２値化したｎ個の画像データから２＾
ｎ値のデータを算出する算出手段とを備えることを特徴
とする画像処理装置。 - （２）前記分割手段は、前記入力した画像データをＳ＿
０とし、ｎ個に分割した後の各画像データをそれぞれＳ
＿１、Ｓ＿２、・・・、Ｓ＿ｎとした場合、▲数式、化
学式、表等があります▼（ｉは自然数） なる式の関係が成り立つことを特徴とする請求項第１項
記載の画像処理装置。 - （３）前記２値化手段は、注目画素近傍の２値化済の画
像データの重み付け平均値を演算する演算手段と、前記
演算手段で求めた平均値を閾値として注目画素の画像デ
ータを２値化する注目画素２値化手段と、前記注目画素
２値化手段で２値化した際に発生した濃度誤差を前記注
目画素周辺の未２値化画素の画像データに配分する配分
手段とを含むことを特徴とする請求項第１項記載の画像
処理装置。 - （４）前記２値化手段は、ディザマトリクスを閾値とし
て２値化することを特徴とする請求項第１項記載の画像
処理装置。 - （５）前記２値化手段は、誤差拡散法を用いることを特
徴とする請求項第１項記載の画像処理装置。 - （６）前記算出手段は、前記２値化したｎ個の画像デー
タをＢ＿１、Ｂ＿２、・・・、Ｂ＿ｎとし、前記算出し
た画像データをＢ＿０とした場合、 ▲数式、化学式、表等があります▼（ｉは自然数） なる式の関係が成り立つことを特徴とする請求項第１項
記載の画像処理装置。 - （７）前記算出手段は、前記算出した画像データＢ＿０
を０〜（２＾ｎ−１）までのｎビットで表す場合、下位
から数えてｉ（１≦ｉ≦ｎ）番目のビットに前記２値化
した画像データＢ＿ｉの値を代入することを１からｎま
で行つて前記画像データＢ＿０を求めることを特徴とす
る請求項第６項記載の画像処理装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2330885A JPH04207470A (ja) | 1990-11-30 | 1990-11-30 | 画像処理装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2330885A JPH04207470A (ja) | 1990-11-30 | 1990-11-30 | 画像処理装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH04207470A true JPH04207470A (ja) | 1992-07-29 |
Family
ID=18237599
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2330885A Pending JPH04207470A (ja) | 1990-11-30 | 1990-11-30 | 画像処理装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH04207470A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH11205684A (ja) * | 1998-01-19 | 1999-07-30 | Casio Comput Co Ltd | 撮像装置及び撮像素子の駆動方法 |
-
1990
- 1990-11-30 JP JP2330885A patent/JPH04207470A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH11205684A (ja) * | 1998-01-19 | 1999-07-30 | Casio Comput Co Ltd | 撮像装置及び撮像素子の駆動方法 |
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