JPH04116887A - 回路パターンの形成方法 - Google Patents

回路パターンの形成方法

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JPH04116887A
JPH04116887A JP2236423A JP23642390A JPH04116887A JP H04116887 A JPH04116887 A JP H04116887A JP 2236423 A JP2236423 A JP 2236423A JP 23642390 A JP23642390 A JP 23642390A JP H04116887 A JPH04116887 A JP H04116887A
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Bunro Yamamoto
文朗 山本
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    • HELECTRICITY
    • H05ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05KPRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
    • H05K3/00Apparatus or processes for manufacturing printed circuits
    • H05K3/02Apparatus or processes for manufacturing printed circuits in which the conductive material is applied to the surface of the insulating support and is thereafter removed from such areas of the surface which are not intended for current conducting or shielding
    • H05K3/027Apparatus or processes for manufacturing printed circuits in which the conductive material is applied to the surface of the insulating support and is thereafter removed from such areas of the surface which are not intended for current conducting or shielding the conductive material being removed by irradiation, e.g. by photons, alpha or beta particles

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  • Manufacturing Of Printed Circuit Boards (AREA)
  • Laser Beam Processing (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔発明の目的〕 (産業上の利用分野) 本発明は例えば電気機器および電子機器に用いられる回
路基板上に展開する回路パターンの形成方法に関する。
(従来の技術) 一般に、電気機器および電子機器内部には回路パターン
を有する回路基板が多数組み込まれている。大量生産品
においては、それらの回路基板上への回路パターン形成
には、量産性の良いウェットエツチング処理により形成
する方法が採用されていることが多い。例えば第4図(
a)に示すように、回路基板41が回路基板絶縁部51
とその一方の主面側に接着された回路パターン形成用の
金属層52からなり、その金属層52にポジレジスト層
40を被着する。
次に、上記ポジレジスト層40に、所望回路パターン5
2が描かれているマスク42を密接させ、紫外線43を
照射する(第4図(b))。
ついで現像を施すとポジレジスト層40の上記感光部分
50bは除去される。なお、50aは上記マスク42に
よるポジレジスト層40の未感光部分である(第4図(
C))。
次に、上記ポジレジスト層40の残された未感光部分5
0bをマスクにしてエツチングを施すことにより、金属
層52の剥離予定域が除去されて所望回路パターン形状
の金属層52aが残る(第4図(d))。
ついで、上記ポジレジスト層の未感光部分50aを除去
して所望形状の回路パターン金属層52aが回路基板絶
縁部5)上に得られる(第4図(e))。
このように、ウェットエツチング処理方式ではマスクが
必要となり、高精度、広面積になる程高額の費用が必要
となる。このため、−枚のマスクでできるだけ多くの製
品を量産して亘担を軽減する必要があった。最近の少量
生産品や開発型製品においては、たとえ回路パターンの
標準化が設計時点で成されていても全て標準回路パター
ンで設計することは困難であり、多くの場合新規開発回
路パターが必要となる。また1回路基板1枚に数枚のマ
スクが必要であるような製品も多く、特に1台しか生産
しないような開発型システム製品においては、マスク化
だけで非常に高額なものとなってしまう問題があった。
更に、電気化学的手段にて処理されるため危険な薬品を
使用する工程がウェットエツチング処理にはあり、技術
的に無公害対策が必要で、そのため処理設備や処理工程
も複雑にならざるを得す製造リードダイムが増大し、こ
れによっても高額なものとなってしまう問題があった。
他の回路パターン形成方法においても、電気化学的手段
を用いないがマスクに代わるスクリーンが必要であり1
回路基板絶縁部に導電塗料を印刷して焼き付ける印刷法
や、マスクは必要としないが電気化学的手段を用いるレ
ーザ露光法、同様に電気化学的手段を用いるパターンめ
っき法等も、上記のいずれかの問題があり、このため少
量生産品や開発型製品の設計開発、製造において、より
低価格化が図れる代替技術の要求が強かった。
(発明が解決しようとする課題) 以上述べたように従来の回路パターンは多くの場合ウェ
ットエツチング処理により形成されるため、多数のマス
クを使用するわりには生産台数の少ない製品において、
機能に見合った低価格化が計れないという欠点があった
本発明は、上記の欠点を除去すべくなされたもので、マ
スクを用いた複雑なウェットエツチング処理工程を経ず
回路基板上に回路パターンを形成することを目的とする
〔発明の構成〕
(m1題を解決するための手段) 本発明に係る回路パターンの形成方法は、絶縁基板とこ
の上に積層された金属箔の導電層からなる回路基板の該
導電層を一部除去して所定回路パターンに形成するにあ
たり、導電層に対し回路パターン予定域と剥離予定域の
境界部に高密度レーザ光束を照射して除去し1次いで導
電層の剥離予定域に低密度レーザ光束を照射し絶縁基板
との付着力を低減させて剥離除去する手段を含む回路パ
ターンの形成方法。
(作 用) 本発明においてはエツチング処理工程を用いずに回路基
板上に回路パターンを形成するようにしたので、エツチ
ング処理にて発生する種々の欠点を除去する。更に回路
パターン設計時点よりCADを採用し数値制御機械等と
直結しておくことにより完全自動化を図ることができ、
少量生産における回路基板の回路パターンの形成におい
ても低価格、かつ短時間で達成できる。
(実施例) 以下、本発明における一実施例について図面を参照して
説明する。
一実施例に用いられる第3図のレーザ加工装置における
YAGレーザ加工加工部置部30レーザ開閉および出力
レベル等の加工に関する要因を制御装¥f31により制
御するようになっており、レーザ光の投射口に専用高精
度光学レンズ32を具備し、さらにその直下に、回路基
板33の金属層面登レーザ光束34に対し垂直に固定で
きる治具を有する高精度移動テーブル35が設置されて
いる。この高精度移動テーブル5は縦横斜め回転のそれ
ぞれの移動および修正が可能でYAGレーザ加工加工部
置部30通の制御装置31により制御されるものである
また、YAGレーザ加工加工部置部30精度移動テーブ
ル35を制御する制御装置31は、CAD装置36に接
続されており、このCAD装置36で作画した回路パタ
ーンの数値データのやり取りができるように構成されて
いる。
本発明の回路パターン形成方法では、上記CAD装置3
6で作画した回路パターンの数値データを制御装置31
が受は取り、レーサ開閉および出力レベル等の加工に関
する要因の制御および高精度移動テーブル35の制御を
施し、第1図(a)に、 またこの図の破線円で囲み示
す部分を拡大して第2図に示すように、高密度YAGレ
ーザ光束10を専用光学レンズ11を用いて絞り込み、
回路基板12上に金属層23に形成される所望回路パタ
ーンの予定域23aと剥離予定域23bの境界部に沿っ
て照射する。
このレーサ光照射により境界部の金属層のみを昇華除去
し切断して、それら予定域間に回路基板絶縁部22が底
に霞出する境界溝13を作り、それら予定域間が別離さ
れる。
次に、第1図の(b)に示すように、低密度YAGレー
レー束20を金属層の剥離予定域23bにのみ照射し加
熱する。この加熱処理によって、回路基板における金属
層23の剥離予定域23bと回路基板絶縁部22との間
の付着力が低下する。
次に、第1図(c)に示すように、剥離装置14を用い
て上記剥離予定域23bの金属層のみに対し剥離するこ
とにより、回路パターン形成予定域23aの金属層が残
留し所望の回路パターン15が形成される。
〔発明の効果〕
以上述べたようにこの発明によれば、エツチング処理工
程を用いずに回路基板上に回路パターンが形成できる。
これによりエツチング処理にて発生する種々の欠点から
容易に解放され、更に回路パターン設計時点よりCAD
を採用し数値制御機械等と直結しておけば完全自動化を
図ることもでき、たとえ1枚しか生産しない回路基板の
回路パターンの形成においても低価格でしかも短時間で
提供できる。
【図面の簡単な説明】
第1図(a)〜(c)は本発明の一実施例に係わる回路
形成方法を工程順に説明するためのいずれも斜視図、第
2図は第1図(a)の一部を拡大して示す斜視図、第3
図は回路形成に用いられるレーザ加工装置の斜視図、第
4図(a)〜(e)は従来の回路形成方法を工程順に説
明するためのいずれも斜視図である。 10・・・高密度レーザ光束 20・・・低密度レーザ光束 23・・・回路基板の金属層 23a・・・回路パターンの形成予定域23b・剥離予
定域 12・・・回路基板 22・・・回路基板絶縁部 代理人 弁理士 大 胡 典 夫 ;高宜崖YAGL−ヂ党束 23a: 1i]將パターンの1珀X予定」翫1に 専指光谷しンス゛ 23b−禾+1凝aデiに1−く 第 図 (Yの1) (c) 14;す】却Iむ1 15SIi口訃パターン 第 図 (蔓の2) 第 図 42ニ マスタ 43: 嘔やト嘉印・ 50a−未域尤1貨汀 50b : 6’t4i1 第 図 ((の1) 第 図 52a; U3多ドパターン縣膚 第 図 (糧の2)

Claims (1)

    【特許請求の範囲】
  1. 絶縁基板とこの上に積層された金属箔の導電層からなる
    回路基板の該導電層を一部除去して所定回路パターンに
    形成するにあたり、導電層に対し回路パターン予定域と
    剥離予定域の境界部に高密度レーザ光束を照射して除去
    し、次いで導電層の剥離予定域に低密度レーザ光束を照
    射し絶縁基板との付着力を低減させて剥離除去する手段
    を含む回路パターンの形成方法。
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Cited By (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
KR20010000881A (ko) * 2000-10-25 2001-01-05 안지양 회로기판의 회로패턴 형성방법
WO2011137896A1 (de) * 2010-05-04 2011-11-10 Lpkf Laser & Electronics Ag Verfahren zum partiellen lösen einer definierten fläche einer leitfähigen schicht
WO2011137897A3 (de) * 2010-05-04 2011-12-29 Lpkf Laser & Electronics Ag Verfahren zum einbringen elektrischer isolierungen in leiterplatten
US20200246910A1 (en) * 2019-02-05 2020-08-06 Preco, Inc. Laser cutting metal foil with a polymer backing layer

Cited By (13)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
KR20010000881A (ko) * 2000-10-25 2001-01-05 안지양 회로기판의 회로패턴 형성방법
WO2011137896A1 (de) * 2010-05-04 2011-11-10 Lpkf Laser & Electronics Ag Verfahren zum partiellen lösen einer definierten fläche einer leitfähigen schicht
WO2011137897A3 (de) * 2010-05-04 2011-12-29 Lpkf Laser & Electronics Ag Verfahren zum einbringen elektrischer isolierungen in leiterplatten
CN102870507A (zh) * 2010-05-04 2013-01-09 Lpkf激光和电子股份公司 用于将电绝缘引入印刷电路板的方法
JP2013526068A (ja) * 2010-05-04 2013-06-20 エル・ピー・ケー・エフ・レーザー・ウント・エレクトロニクス・アクチエンゲゼルシヤフト 導電層の特定の表面の一部を剥離するための方法
JP2013528937A (ja) * 2010-05-04 2013-07-11 エル・ピー・ケー・エフ・レーザー・ウント・エレクトロニクス・アクチエンゲゼルシヤフト 回路基板内に電気絶縁部を設けるための方法
KR101426637B1 (ko) * 2010-05-04 2014-08-06 엘피케이에프 레이저 앤드 일렉트로닉스 악티엔게젤샤프트 전도층의 한정된 면적을 부분적으로 떼어내기 위한 방법
KR101503580B1 (ko) * 2010-05-04 2015-03-17 엘피케이에프 레이저 앤드 일렉트로닉스 악티엔게젤샤프트 인쇄회로기판 안으로 전기적 절연부들을 도입하기 위한 방법
US9021691B2 (en) 2010-05-04 2015-05-05 Lpkf Laser & Electronics Ag Method for introducing electrical insulations in printed circuit boards
US9414499B2 (en) 2010-05-04 2016-08-09 Lpkf Laser & Electronics Ag Method for partially stripping a defined area of a conductive layer
US20200246910A1 (en) * 2019-02-05 2020-08-06 Preco, Inc. Laser cutting metal foil with a polymer backing layer
EP3695931A1 (en) * 2019-02-05 2020-08-19 Preco, Inc. Laser cutting metal foil with a polymer backing
US11992895B2 (en) * 2019-02-05 2024-05-28 Preco, Llc Laser cutting metal foil with a polymer backing layer

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